WO2021056857A1 - 驱动电路及其驱动方法与应用的显示面板 - Google Patents
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Abstract
一种驱动电路(100)及其驱动方法与应用的显示面板,驱动电路(100)包括:多个栅极阵列驱动单元(G1、G2~G(last))电路,其中的各个奇数级栅极阵列驱动单元电路进行级联,各个偶数级栅极阵列驱动单元电路进行级联;对应于奇数级栅极阵列驱动单元电路设置的分别用于提供奇数级扫描控制信号(Vfo)、奇数级扫描启动信号(STVo)、奇数级高频时钟信号(CKIo)的信号线;对应于偶数级栅极阵列驱动单元电路设置的分别用于提供偶数级扫描控制信号(Vfe)、偶数级扫描启动信号(STVe)、偶数级高频时钟信号(CKIe)的信号线;以及对应于所有栅极阵列驱动单元(G1、G2~G(last))电路设置的用于提供第一低频时钟信号与第二低频时钟信号的共用信号线(Busline)。
Description
本申请涉及显示领域,特别涉及一种驱动电路及其驱动方法与应用的显示面板。
液晶显示器(Liquid Crystal Display,LCD)是利用液晶材料的特性来显示图像的一种平板显示装置,其相较于其他显示装置而言具有轻薄、低驱动电压及低功耗等优点。
且液晶显示设备中通常具有栅极驱动电路、源极驱动电路和像素阵列。像素阵列中具有多个像素电路,每一个像素电路依据栅极驱动电路提供的扫描讯号开启和关闭,并依据源极驱动电路提供的数据讯号,显示数据画面。以栅极驱动电路来说,栅极驱动电路通常具有多级移位寄存器,并藉由一级移位寄存器传递至下一级移位寄存器的方式,来输出扫描讯号到像素阵列中,以依序地开启像素电路,使像素电路接收数据讯号。
因此在驱动电路的制程中,便直接将栅极驱动电路制作在阵列基板上,来取代由外连接IC制作的驱动芯片,此种被称为栅极阵列驱动(Gate On Array,GOA)技术的应用可直接做在面板周围,减少制作程序、降低产品成本且使面板更薄型化。
发明概述
近年来,随着技术的不断成熟和飞速发展,大尺寸,高解析度,曲面等成为了液晶面板市场的标签和卖点,同时消费者也对液晶面板提出了更高的要求,其中色偏成为了近年来困扰设计者的一个问题。为了解决色偏问题,像素区域已提出了多种电路设计方法,理论上可以解决色偏问题。但随着窄边框和低成本的考虑,GOA(Gate Driver on Array)技术已深入渗透到目前的面板领域,而如何使GOA技术有效搭配目前像素区域低色偏的电路设计,成为电路设计层面解 决色偏问题的关键。
因此本申请提出了一种可调变Gate N输出的GOA电路,通过采用此GOA电路,能根据客户需求有效解决色偏问题,有利于实现高品质液晶显示器面板。
问题的解决方案
为了解决上述技术问题,本申请的目的在于,提供一种驱动电路,包括:多个栅极阵列驱动单元电路,其中的各个奇数级栅极阵列驱动单元电路进行级联,各个偶数级栅极阵列驱动单元电路进行级联;对应于奇数级栅极阵列驱动单元电路设置的分别用于提供奇数级扫描控制信号、奇数级扫描启动信号、奇数级高频时钟信号的信号线;对应于偶数级栅极阵列驱动单元电路设置的分别用于提供偶数级扫描控制信号、偶数级扫描启动信号、偶数级高频时钟信号的信号线;以及对应于所有栅极阵列驱动单元电路设置的用于提供第一低频时钟信号与第二低频时钟信号的共用信号线。
本申请的目的及解决其技术问题是采用以下技术方案来实现的。
在本申请的一实施例中,每一级栅极阵列驱动单元电路均包括:正反向扫描控制模块、级传稳压模块、输出模块、第一下拉模块及下拉维持模块。
在本申请的一实施例中,更包括一画素电路,包括一第一开关,所述第一开关的一控制端用以接收一栅极阵列驱动单元输出的栅极讯号,所述第一开关的一第一端电性连接主画素电极,所述第一开关的一第二端用以接收一数据线讯号。
在本申请的一实施例中,更包括一第二开关,所述第二开关的一控制端用以接收所述栅极阵列驱动单元输出的栅极讯号,所述第二开关的一第一端电性连接子画素电极,所述第二开关的一第二端用以接收所述数据线讯号。
在本申请的一实施例中,更包括一第三开关,所述第三开关的一控制端用以接收下一级的一栅极阵列驱动单元输出的栅极讯号,所述第三开关的一第一端电性连接一储存电容,所述第三开关的一第二端电性连接子画素电极。
本申请的目的及解决其技术问题还可采用以下技术措施进一步实现。
本申请的另一目的为提供一种驱动电路的驱动方法,包括:提供如所述的驱动 电路;透过每一级栅极阵列驱动单元电路均包括:正反向扫描控制模块、级传稳压模块、输出模块、第一下拉模块及下拉维持模块;通过控制栅极阵列驱动单元电路中扫描启动信号的起始时间,可以实现不同的延迟时间;通过将多高频时钟信号电路的奇数高频时钟信号和偶数高频时钟信号分开,分别设置不同的宽度,即可实现不同的波形宽度;以及通过分别给奇数高频时钟信号和偶数高频时钟信号不同的波形高度讯号,可以实现不同的波形高度。
在本申请的一实施例中,所述方法,更包括一画素电路,包括一第一开关,所述第一开关的一控制端用以接收一栅极阵列驱动单元输出的栅极讯号,所述第一开关的一第一端电性连接主画素电极,所述第一开关的一第二端用以接收一数据线讯号。
在本申请的一实施例中,所述方法,更包括一第二开关,所述第二开关的一控制端用以接收所述栅极阵列驱动单元输出的栅极讯号,所述第二开关的一第一端电性连接子画素电极,所述第二开关的一第二端用以接收所述数据线讯号。
在本申请的一实施例中,所述方法,更包括一第三开关,所述第三开关的一控制端用以接收下一级的一栅极阵列驱动单元输出的栅极讯号,所述第三开关的一第一端电性连接一储存电容,所述第三开关的一第二端电性连接子画素电极。
本申请的又一目的为提供一种显示面板,包括:第一基板;以及第二基板,与该第一基板相对设置;还包括一种驱动电路,包括:多个栅极阵列驱动单元电路,其中的各个奇数级栅极阵列驱动单元电路进行级联,各个偶数级栅极阵列驱动单元电路进行级联;对应于奇数级栅极阵列驱动单元电路设置的分别用于提供奇数级扫描控制信号、奇数级扫描启动信号、奇数级高频时钟信号的信号线;对应于偶数级栅极阵列驱动单元电路设置的分别用于提供偶数级扫描控制信号、偶数级扫描启动信号、偶数级高频时钟信号的信号线;以及对应于所有栅极阵列驱动单元电路设置的用于提供第一低频时钟信号与第二低频时钟信号的共用信号线。
本申请提供的驱动电路,即可根据需求得到不同亮度的主画素和子画素亮度,不需要改变面内电路结构。尤其是当面板产出后,仍然可以根据色偏的情况, 通过外部改变电路信号有针对性地解决色偏问题,可调幅度大。
发明的有益效果
对附图的简要说明
为了更清楚地说明本申请实施例或现有技术中的技术方案,下面对实施例中所需要使用的附图作简单的介绍。下面描述中的附图仅为本申请的部分实施例,对于本领域普通技术人员而言,在不付出创造性劳动的前提下,还可以根据这些附图获取其他的附图。
图1为本申请一实施例的驱动电路的多级架构图;
图2为本申请一实施例的画素电路图;
图3为本申请一实施例的驱动电路可调变波形输出示意图;
图4为本申请一实施例的驱动电路可调变波形输出及画素电位示意图;
图5为本申请一实施例的驱动电路的驱动方法流程图。
发明实施例
请参照附图中的图式,其中相同的组件符号代表相同的组件。以下的说明是基于所例示的本申请具体实施例,其不应被视为限制本申请未在此详述的其它具体实施例。
以下各实施例的说明是参考附加的图式,用以例示本申请可用以实施的特定实施例。本申请所提到的方向用语,例如「上」、「下」、「前」、「后」、「左」、「右」、「内」、「外」、「侧面」等,仅是参考附加图式的方向。因此,使用的方向用语是用以说明及理解本申请,而非用以限制本申请。
在附图中,为了清晰起见,夸大了层、膜、面板、区域等的厚度。在附图中,为了理解和便于描述,夸大了一些层和区域的厚度。将理解的是,当例如层、膜、区域或基底的组件被称作“在”另一组件“上”时,所述组件可以直接在所述另一组件上,或者也可以存在中间组件。
附图和说明被认为在本质上是示出性的,而不是限制性的。在图中,结构相似 的单元是以相同标号表示。另外,为了理解和便于描述,附图中示出的每个组件的尺寸和厚度是任意示出的,但是本申请不限于此。
另外,在说明书中,除非明确地描述为相反的,否则词语“包括”将被理解为意指包括所述组件,但是不排除任何其它组件。此外,在说明书中,“在......上”意指位于目标组件上方或者下方,而不意指必须位于基于重力方向的顶部上。
为更进一步阐述本申请为达成预定发明目的所采取的技术手段及功效,以下结合附图及具体的实施例,对依据本申请提出的一种驱动电路及其驱动方法与应用的显示面板,其具体实施方式、结构、特征及其功效,详细说明如后。
图1为本申请一实施例的驱动电路的多级架构图,请参照图1,在本申请的一实施例中,一种驱动电路100,包括:多个栅极阵列驱动单元G1、G2~G(last)电路,其中的各个奇数级栅极阵列驱动单元电路进行级联,各个偶数级栅极阵列驱动单元电路进行级联;对应于奇数级栅极阵列驱动单元电路设置的分别用于提供奇数级扫描控制信号Vfo、奇数级扫描启动信号STVo、奇数级高频时钟信号CKIo的信号线;对应于偶数级栅极阵列驱动单元电路设置的分别用于提供偶数级扫描控制信号Vfe、偶数级扫描启动信号STVe、偶数级高频时钟信号CKIe的信号线;以及对应于所有栅极阵列驱动单元电路设置的用于提供第一低频时钟信号与第二低频时钟信号的共用信号线Busline。
在本申请的一实施例中,每一级栅极阵列驱动单元G1、G2~G(last)电路均包括:正反向扫描控制模块(图未示)、级传稳压模块(图未示)、输出模块(图未示)、第一下拉模块(图未示)及下拉维持模块(图未示)。
图2为本申请一实施例的画素电路图,请参照图2,在本申请的一实施例中,更包括一画素电路200,包括一第一开关T1,所述第一开关T1的一控制端T1a用以接收一栅极阵列驱动单元输出的栅极讯号Gate N,所述第一开关T1的一第一端T1b电性连接主画素105电极Va,所述第一开关T1的一第二端T1c用以接收一数据线讯号Data,实现对主画素105的充电。
请参照图2,在本申请的一实施例中,更包括一第二开关T2,所述第二开关T2的一控制端T2a用以接收所述栅极阵列驱动单元输出的栅极讯号Gate N,所述第二开关T2的一第一端T2b电性连接子画素106电极Vb,所述第二开关T2的一第二端 T2c用以接收所述数据线讯号Data,实现对子画素106的充电。
请参照图2,在本申请的一实施例中,更包括一第三开关T3,所述第三开关T3的一控制端T3a用以接收下一级的一栅极阵列驱动单元输出的栅极讯号Gate N+1,所述第三开关T3的一第一端T3b电性连接一储存电容110,所述第三开关T3的一第二端T3c电性连接子画素106电极Vb。
图3为本申请一实施例的驱动电路可调变波形输出示意图、图4为本申请一实施例的驱动电路可调变波形输出及画素电位示意图及图5为本申请一实施例的驱动电路的驱动方法流程图,请参照图1、图3、图4及图5,在本申请的一实施例中,一种驱动电路100的驱动方法,包括:提供如所述的驱动电路100;透过每一级栅极阵列驱动单元G1、G2~G(last)电路均包括:正反向扫描控制模块、级传稳压模块、输出模块、第一下拉模块及下拉维持模块;通过控制栅极阵列驱动单元G1、G2~G(last)电路中扫描启动信号STV的起始时间ΔX,可以实现不同的延迟时间X;通过将多高频时钟信号CK电路的奇数高频时钟信号CKIo_odd和偶数高频时钟信号CKIe_even分开,分别设置不同的宽度ΔY,即可实现不同的波形宽度Y;以及通过分别给奇数高频时钟信号CKIo_odd和偶数高频时钟信号CKIe_even不同的波形高度VGH1、VGH2讯号,可以实现不同的波形高度Z。
请参照图2,在本申请的一实施例中,所述方法,更包括一画素电路200,包括一第一开关T1,所述第一开关T1的一控制端T1a用以接收一栅极阵列驱动单元输出的栅极讯号Gate N,所述第一开关T1的一第一端T1b电性连接主画素105电极Va,所述第一开关T1的一第二端T1c用以接收一数据线讯号Data,实现对主画素105的充电。
请参照图2,在本申请的一实施例中,所述方法,更包括一第二开关T2,所述第二开关T2的一控制端T2a用以接收所述栅极阵列驱动单元输出的栅极讯号Gate N,所述第二开关T2的一第一端T2b电性连接子画素106电极Vb,所述第二开关T2的一第二端T2c用以接收所述数据线讯号Data,实现对子画素106的充电。
请参照图2,在本申请的一实施例中,所述方法,更包括一第三开关T3,所述第三开关T3的一控制端T3a用以接收下一级的一栅极阵列驱动单元输出的栅极讯号Gate N+1,所述第三开关T3的一第一端T3b电性连接一储存电容110,所述第三 开关T3的一第二端T3c电性连接子画素106电极Vb。
请参照图1,在本申请的一实施例中,一种显示面板10,包括:第一基板(图未示);以及第二基板(图未示),与该第一基板(图未示)相对设置:还包括一种驱动电路100,包括:多个栅极阵列驱动单元G1、G2~G(last)电路,其中的各个奇数级栅极阵列驱动单元电路进行级联,各个偶数级栅极阵列驱动单元电路进行级联;对应于奇数级栅极阵列驱动单元电路设置的分别用于提供奇数级扫描控制信号Vfo、奇数级扫描启动信号STVo、奇数级高频时钟信号CKIo的信号线;对应于偶数级栅极阵列驱动单元电路设置的分别用于提供偶数级扫描控制信号Vfe、偶数级扫描启动信号STVe、偶数级高频时钟信号CKIe的信号线;以及对应于所有栅极阵列驱动单元电路设置的用于提供第一低频时钟信号与第二低频时钟信号的共用信号线Busline。
请参考图5,在流程S510中,提供如所述的驱动电路。
请参考图5,在流程S520中,透过每一级栅极阵列驱动单元电路均包括:正反向扫描控制模块、级传稳压模块、输出模块、第一下拉模块及下拉维持模块。
请参考图5,在流程S530中,通过控制栅极阵列驱动单元电路中扫描启动信号的起始时间,可以实现不同的延迟时间。
请参考图5,在流程S540中,通过将多高频时钟信号电路的奇数高频时钟信号和偶数高频时钟信号分开,分别设置不同的宽度,即可实现不同的波形宽度。
请参考图5,在流程S550中,通过分别给奇数高频时钟信号和偶数高频时钟信号不同的波形高度讯号,可以实现不同的波形高度。
本申请提供的驱动电路,即可根据需求得到不同亮度的主画素和子画素亮度,不需要改变面内电路结构。尤其是当面板产出后,仍然可以根据色偏的情况,通过外部改变电路信号有针对性地解决色偏问题,可调幅度大。
以上所述,对于本领域的普通技术人员来说,可以根据本发明的技术方案和技术构思作出其他各种相应的改变和变形,而所有这些改变和变形都应属于本发明后附的权利要求的保护范围。
本申请的主题可以在工业中制造和使用,具备工业实用性。
Claims (10)
- 一种驱动电路,其包括:多个栅极阵列驱动单元电路,其中的各个奇数级栅极阵列驱动单元电路进行级联,各个偶数级栅极阵列驱动单元电路进行级联;对应于奇数级栅极阵列驱动单元电路设置的分别用于提供奇数级扫描控制信号、奇数级扫描启动信号、奇数级高频时钟信号的信号线;对应于偶数级栅极阵列驱动单元电路设置的分别用于提供偶数级扫描控制信号、偶数级扫描启动信号、偶数级高频时钟信号的信号线;以及对应于所有栅极阵列驱动单元电路设置的用于提供第一低频时钟信号与第二低频时钟信号的共用信号线。
- 如权利要求1所述驱动电路,其中,每一级栅极阵列驱动单元电路均包括:正反向扫描控制模块、级传稳压模块、输出模块、第一下拉模块及下拉维持模块。
- 如权利要求1所述驱动电路,其中,更包括一画素电路,包括一第一开关,所述第一开关的一控制端用以接收一栅极阵列驱动单元输出的栅极讯号,所述第一开关的一第一端电性连接主画素电极,所述第一开关的一第二端用以接收一数据线讯号。
- 如权利要求3所述驱动电路,其中,更包括一第二开关,所述第二开关的一控制端用以接收所述栅极阵列驱动单元输出的栅极讯号,所述第二开关的一第一端电性连接子画素电极,所述第二开关的一第二端用以接收所述数据线讯号。
- 如权利要求3所述驱动电路,其中,更包括一第三开关,所述第三开关的一控制端用以接收下一级的一栅极阵列驱动单元输出的栅极讯号,所述第三开关的一第一端电性连接一储存电容,所述第三开关的一第二端电性连接子画素电极。
- 一种驱动电路的驱动方法,其包括:提供如权利要求1所提供的驱动电路;透过每一级栅极阵列驱动单元电路均包括:正反向扫描控制模块、级传稳压模块、输出模块、第一下拉模块及下拉维持模块;通过控制栅极阵列驱动单元电路中扫描启动信号的起始时间,可以实现不同的延迟时间;通过将多高频时钟信号电路的奇数高频时钟信号和偶数高频时钟信号分开,分别设置不同的宽度,即可实现不同的波形宽度;以及通过分别给奇数高频时钟信号和偶数高频时钟信号不同的波形高度讯号,可以实现不同的波形高度。
- 如权利要求6所述驱动电路的驱动方法,其中,更包括一画素电路,包括一第一开关,所述第一开关的一控制端用以接收一栅极阵列驱动单元输出的栅极讯号,所述第一开关的一第一端电性连接主画素电极,所述第一开关的一第二端用以接收一数据线讯号。
- 如权利要求7所述驱动电路的驱动方法,其中,更包括一第二开关,所述第二开关的一控制端用以接收所述栅极阵列驱动单元输出的栅极讯号,所述第二开关的一第一端电性连接子画素电极,所述第二开关的一第二端用以接收所述数据线讯号。
- 如权利要求7所述驱动电路的驱动方法,其中,更包括一第三开关,所述第三开关的一控制端用以接收下一级的一栅极阵列驱动单元输出的栅极讯号,所述第三开关的一第一端电性连接一储存电容,所述第三开关的一第二端电性连接子画素电极。
- 一种显示面板,包括:第一基板;以及第二基板,与该第一基板相对设置;其中:还包括一种驱动电路,包括:多个栅极阵列驱动单元电路,其中的各个奇数级栅极阵列驱动单元电路进行级联,各个偶数级栅极阵列驱动单元电路进行级联;对应于奇数级栅极阵列驱动单元电路设置的分别用于提供奇数级扫描控制信号、奇数级扫描启动信号、奇数级高频时钟信号的信号线;对应于偶数级栅极阵列驱动单元电路设置的分别用于提供偶数级扫描控制信号、偶数级扫描启动信号、偶数级高频时钟信号的信号线;以及对应于所有栅极阵列驱动单元电路设置的用于提供第一低频时钟信号与第二低频时钟信号的共用信号线。
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