WO2020060008A1 - 표시 장치 - Google Patents

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WO2020060008A1
WO2020060008A1 PCT/KR2019/007907 KR2019007907W WO2020060008A1 WO 2020060008 A1 WO2020060008 A1 WO 2020060008A1 KR 2019007907 W KR2019007907 W KR 2019007907W WO 2020060008 A1 WO2020060008 A1 WO 2020060008A1
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switching element
electrode
gate
driving
data
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박세혁
이효진
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삼성디스플레이 주식회사
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    • G09G2320/0214—Crosstalk reduction, i.e. to reduce direct or indirect influences of signals directed to a certain pixel of the displayed image on other pixels of said image, inclusive of influences affecting pixels in different frames or fields or sub-images which constitute a same image, e.g. left and right images of a stereoscopic display with crosstalk due to leakage current of pixel switch in active matrix panels
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Definitions

  • the present invention relates to a display device and a driving method thereof.
  • a display device in general, includes a display panel and a display panel driver.
  • the display panel includes a plurality of pixels, a plurality of gate lines, a plurality of data lines, and a plurality of emission control lines.
  • the display panel driver includes a gate driver providing a gate signal to the plurality of gate lines, a data driver providing a data voltage to the data lines, a light emitting controller providing a light emission control signal to the light emission control line, and the gate driver ,
  • a driving control unit generating control signals for controlling the data driving unit and the light emission control unit.
  • One object of the present invention is to provide a display device that reduces power consumption of the display panel.
  • a display device includes a display panel including a first type of switching element and a pixel including a second type of switching element different from the first type.
  • a gate driver for generating a gate signal based on a gate clock signal, a gate driver for providing the gate signal to the display panel, a data driver for providing a data voltage to the display panel, and a light emitting control unit for providing a light emission control signal to the display panel;
  • the gate driving unit, the data driving unit and a driving control unit that generates control signals for controlling the light emission control unit may be included.
  • the saik driving control unit provides the gate clock signal swinging between a high level and a low level during a writing frame in which data is written to the pixel in a low frequency driving mode, and maintains the data written in the pixel
  • the gate clock signal having a DC voltage during a holding frame may be provided to the gate driver.
  • the gate clock signal in the low-frequency driving mode, may swing between the high level and the low level during the lighting frame, and maintain the low level during the holding frame.
  • the gate clock signal in the low frequency driving mode, may swing between the high level and the low level during the writing frame, and maintain the high level during the holding frame.
  • the first type of switching element may be a polysilicon thin film transistor
  • the second type of switching element may be an oxide thin film transistor
  • the first type of switching element may be a P-type transistor
  • the second type of switching element may be an N-type transistor
  • the pixel includes a first switching element including a gate electrode connected to a first node, a first electrode connected to a second node, and a second electrode connected to a third node, the first data writing gate A second switching element including a gate electrode to which a signal is applied, a first electrode to which the data voltage is applied, and a second electrode connected to the second node, a gate electrode to which a second data write gate signal is applied, and the first A third switching element including a first electrode connected to a node and a second node connected to the third node, a gate electrode to which a data initialization gate signal is applied, a first electrode to which an initialization voltage is applied, and the first node A fourth switching element including a second electrode connected, a gate electrode to which the light emission control signal is applied, a first electrode to which a high power voltage is applied, and a second electrode connected to the second node A sixth switching element including a fifth switching element including a pole, a gate electrode to which the emission control signal is
  • the first switching element, the second switching element, the fifth switching element and the sixth switching element are the polysilicon thin film transistor, the third switching element, the fourth switching element and the The seventh switching element may be the oxide thin film transistor.
  • the second switching element, the fifth switching element, and the sixth switching element are driven at a first driving frequency
  • the third switching element is lower than a first driving frequency. It can be driven at 2 driving frequencies.
  • the driving control unit may include a gate control unit generating the gate clock signal.
  • a display device includes a display panel including a first type of switching element and a pixel including a second type of switching element different from the first type.
  • a gate driving unit providing a gate signal to the display panel, a data driving unit providing a data voltage to the display panel, and a light emission control unit and a gate driving unit providing the light emission control signal to the display panel, the data driving unit and the light emission control unit It may include a driving control for generating the control signal.
  • the driving control unit supplies an analog driving voltage for operating the data driving unit to the data driving unit during a writing frame in which data is written to the pixel in a low frequency driving mode, and holds the data written to the pixel. ) During the frame, the analog driving voltage that does not operate the data driving unit may be supplied to the data driving unit.
  • the driving control unit in the low-frequency driving mode, provides an analog driving voltage having a first voltage level during the writing frame to the data driver, and a second voltage level lower than a first voltage level during the holding frame.
  • An analog driving voltage having a can be provided to the data driving unit.
  • the first type of switching element may be a polysilicon thin film transistor
  • the second type of switching element may be an oxide thin film transistor
  • the first type of switching element may be a P-type transistor
  • the second type of switching element may be an N-type transistor
  • the pixel includes a first switching element including a gate electrode connected to a first node, a first electrode connected to a second node, and a second electrode connected to a third node, the first date writing gate A second switching element including a gate electrode to which a signal is applied, a first electrode to which the data voltage is applied, and a second electrode connected to the second node, a gate electrode to which a second data write gate signal is applied, and the first A third switching element including a first electrode connected to a node and a second node connected to the third node, a gate electrode to which a data initialization gate signal is applied, a first electrode to which an initialization voltage is applied, and the first node A fourth switching element including a second electrode connected, a gate electrode to which the light emission control signal is applied, a first electrode to which a high power voltage is applied, and a second electrode connected to the second node A fifth switching element comprising: a sixth switching element comprising a gate electrode to which the emission control signal is applied, a first
  • the first switching element, the second switching element, the fifth switching element and the sixth switching element are the polysilicon thin film transistor, the third switching element, the fourth switching element and the The seventh switching element may be the oxide thin film transistor.
  • the second switching element, the fifth switching element, and the sixth switching element are driven at a first driving frequency
  • the third switching element is lower than a first driving frequency. It can be driven at 2 driving frequencies.
  • the pixel comprises an eighth electrode including a gate electrode to which a sustain voltage enable signal is applied, a first electrode to which a sustain voltage is applied, and a second electrode connected to the first electrode of the second switching element. It may further include a switching element.
  • the driving control unit may provide an analog driving voltage during the lighting frame to the data driving unit and a sustain voltage during the holding frame to the pixel.
  • the eighth switching element may be the polysilicon thin film transistor.
  • the driving control part may include a voltage generating part that generates a voltage provided to the data driving part and the pixel.
  • the display device gates a gate clock signal having a DC voltage during a holding frame in a low frequency driving mode of a display device including a pixel including a first type switching element and a second type switching element.
  • a gate clock signal having a DC voltage during a holding frame in a low frequency driving mode of a display device including a pixel including a first type switching element and a second type switching element.
  • the display device consumes by not operating a data driver during a holding frame in a low frequency driving mode of a display device including a pixel including a first type of switching element and a second type of switching element. Power can be reduced.
  • the display device provides a sustain voltage to a pixel during a holding frame in a low frequency driving mode of a display device including a pixel including a first type of switching element and a second type of switching element. , It is possible to prevent the leakage current from occurring and to maintain the luminance of the pixel constant.
  • FIG. 1 is a block diagram illustrating a display device according to some example embodiments of the present invention.
  • FIG. 2 is a circuit diagram illustrating an example of a pixel included in the display device of FIG. 1.
  • FIG. 3 is a timing diagram illustrating input signals applied to the pixel of FIG. 2.
  • FIG. 4 is a timing diagram showing an example of signals applied to the pixel of FIG. 2 in a low frequency driving mode.
  • FIG. 5 is a timing diagram illustrating another example of signals applied to the pixel of FIG. 2 in a low frequency driving mode.
  • FIG. 6 is a circuit diagram illustrating another example of pixels included in the display device of FIG. 1.
  • FIG. 7 is a timing diagram illustrating an example of signals applied to the pixel of FIG. 6 in a low frequency driving mode.
  • FIG. 8 is a block diagram illustrating an electronic device including the display device of FIG. 1.
  • FIG. 9 is a diagram illustrating an example in which the electronic device of FIG. 8 is implemented as a smart phone.
  • FIG. 1 is a block diagram illustrating a display device according to some example embodiments of the present invention.
  • the display device 100 may include a display panel 110 and a display panel driver.
  • the display panel driver may include a gate driver 120, a data driver 130, a light emitting control unit 140, and a driving control unit 150.
  • the display panel 110 includes a plurality of gate lines (GWPL, GWNL, GIL, GBL), a plurality of data lines (DL), a plurality of emission control lines (EML), a sustain voltage supply line (VsusL), and the A plurality of pixels PX electrically connected to each of the gate lines GWPL, GWNL, GIL, and GBL, the data lines DL, the emission control lines EML, and the sustain voltage supply lines VsusL.
  • the gate lines GWPL, GWNL, GIL, and GBL, the emission control lines EML, and the sustain voltage supply lines VsusL extend in the first direction D1 and are perpendicular to the first direction D1. It may be arranged in the second direction (D2).
  • the data lines DL extend in the second direction D2 and may be arranged in the first direction D1.
  • the first direction D1 may be parallel to the long side of the display panel 110, and the second direction D2 may be parallel to the short side of the display panel 110.
  • Each pixel PX may be formed in an area where gate lines and data lines DL intersect.
  • the driving control unit 150 may receive input image data IMG and an input control signal CON from an external device.
  • the input image data IMG may include red image data, green image data, and blue image data.
  • the input image data IMG may include white image data.
  • the input image data IMG may include magenta image data, yellow image data, and cyan image data.
  • the input control signal CON may include a master clock signal and a data enable signal.
  • the input control signal CON may further include a vertical synchronization signal and a horizontal synchronization signal.
  • the driving control unit 150 controls control signals CTL1 and CTL2 that control the gate driving unit 120, the data driving unit 130, and the emission control unit 140 based on the input image data IMG and the input control signal CON. CTL3).
  • the driving control unit 150 may generate a first control signal CTL1 for controlling the operation of the gate driving unit 120 based on the input control signal CON.
  • the driving control unit 150 may output the first control signal CTL1 to the gate driving unit 120.
  • the first control signal CTL1 may include a vertical start signal and a gate clock signal.
  • the driving control unit 150 provides the gate driving unit 120 with a gate clock signal swinging between a high level and a low level during a writing frame writing data to the pixel PX in a low frequency driving mode
  • a gate clock signal having a DC voltage may be provided to the gate driver 120 during a holding frame for holding data written in the pixel PX.
  • the driving control unit 150 may include a gate control unit that generates a gate clock signal.
  • the driving control unit 150 may generate a second control signal CTL2 for controlling the operation of the data driving unit 130 based on the input control signal CON.
  • the driving control unit 150 may output the second control signal CTL2 to the data driving unit 130.
  • the second control signal CTL2 may include a horizontal start signal and a load signal.
  • the driving control unit 150 may generate a data signal DATA based on the input image data IMG. For example, the driving control unit 150 may convert the input image data IMG into a data signal DATA by applying an algorithm for correcting the image quality of the input image data IMG. The driving control unit 150 may output the data signal DATA to the data driving unit 130.
  • the driving control unit 150 may generate an analog driving voltage AVDD for operating the data driving unit 130.
  • the driving control unit 150 may output the analog driving voltage AVDD to the data driving unit 130.
  • the driving control unit 150 may generate a holding voltage Vsus for keeping the driving current of the pixel PX constant.
  • the driving control unit 150 may provide the sustain voltage Vsus to the pixel PX.
  • the driving control unit 150 may include a data driving unit 130 and a voltage generation unit that generates a voltage provided to the pixel PX.
  • the driving control unit 150 provides the analog driving voltage AVDD having the first voltage level during the writing frame in the low frequency driving mode to the data driving unit 130, and the second voltage level during the holding frame (eg For example, an analog driving voltage AVDD having 0V may be provided to the data driver 130.
  • the driving control unit 150 provides the analog driving voltage AVDD having the first voltage level during the writing frame in the low frequency driving mode to the data driving unit 130 and maintains the third voltage level during the holding frame.
  • the voltage Vsus may be provided to the pixel PX.
  • the third voltage level may be the same as or different from the first voltage level.
  • the driving control unit 150 may generate a third control signal CTL3 for controlling the operation of the light emission control unit 140 based on the input control signal CON.
  • the driving control unit 150 may output the third control signal CTL3 to the light emission control unit 140.
  • the gate driver 120 may generate gate signals GWP, GWN, GI, GB in response to the first control signal CTL1 supplied from the drive controller 150.
  • the gate driver 120 may output gate signals GWP, GWN, GI, and GB to the gate lines GWPL, GWNL, GIL, and GBL.
  • the data driving unit 130 may generate the data voltage Vd based on the second control signal CTL2, the analog driving voltage AVDD, and the data signal DATA supplied from the driving control unit 150.
  • the data driving unit 130 may generate a gamma reference voltage based on the second control signal CTL2 and the analog driving voltage AVDD received from the driving control unit 150.
  • the gamma reference voltage may have a value corresponding to each data signal DATA.
  • the data driving unit 130 may generate a gamma reference voltage by distributing the analog driving voltage AVDD supplied from the driving control unit 150.
  • the data driver 130 may convert the data signal DATA to an analog data voltage Vd using a gamma reference voltage.
  • the data driver 130 may output the data voltage Vd to the data line DL.
  • the light emission control unit 140 may generate a light emission control signal in response to a third control signal supplied from the driving control unit 150.
  • the emission control unit 140 may output emission control signals to the emission control lines EML.
  • FIG. 2 is a circuit diagram illustrating an example of a pixel included in the display device of FIG. 1, and FIG. 3 is a timing diagram showing input signals applied to the pixel of FIG. 2.
  • the display panel includes a plurality of pixels PX, and each of the pixels PX may include an organic light emitting diode (OLED).
  • OLED organic light emitting diode
  • the pixels PX receive data write gate signals GWP, GWN, data initialization gate signal GI, organic light emitting diode initialization gate signal GB, and light emission control signal EM to the level of the data voltage Vd. Accordingly, the image may be displayed by emitting an organic light emitting diode (OLED).
  • OLED organic light emitting diode
  • each pixel PX may include a first type of switching element and a second type of switching element different from the first type.
  • the first type of switching element may be a polysilicon thin film transistor.
  • the first type of switching element may be a low temperature polysilicon (LTPS) thin film transistor.
  • the second type of switching element may be an oxide thin film transistor.
  • the first type of switching element may be a P-type transistor, and the second type of switching element may be an N-type transistor.
  • the data write gate signals GWP and GWN may include a first data write gate signal GWP and a second data write gate signal GWN.
  • the first data write gate signal GWP is applied to the P-type transistor, and may have a low level activation signal at a data write timing.
  • the second data write gate signal GWN is applied to the N-type transistor, and may have a high level activation signal at the data write timing.
  • Each of the pixels PX according to embodiments of the present invention includes first to seventh switching elements T1, T2, T3, T4, T5, T6, T7, storage capacitor CST, and organic light emitting diode OLED It may include.
  • the first switching element T1 may include a gate electrode connected to the first node N1, a first electrode connected to the second node N2, and a second electrode connected to the third node N3.
  • the first switching element T1 may be a polysilicon thin film transistor.
  • the first switching element T1 may be a P-type thin film transistor.
  • the first electrode of the first switching element T1 may be a source electrode, and the second electrode may be a drain electrode.
  • the second switching element T2 includes a gate electrode to which the first data write gate signal GWP is applied, a first electrode to which the data voltage Vd is applied, and a second electrode connected to the second node N2. You can.
  • the second switching element T2 may be a polysilicon thin film transistor.
  • the second switching element T2 may be a P-type thin film transistor.
  • the first electrode of the second switching element T2 may be a source electrode, and the second electrode may be a drain electrode.
  • the third switching element T3 includes a gate electrode to which the second data write gate signal GWN is applied, a first electrode connected to the first node N1 and a second electrode connected to the third node N3. can do.
  • the third switching element T3 may be an oxide thin film transistor.
  • the third switching element T3 may be an N-type thin film transistor.
  • the first electrode of the third switching element T3 may be a source electrode, and the second electrode may be a drain electrode.
  • the fourth switching element T4 may include a gate electrode to which the data initialization gate signal GI is applied, a first electrode to which the initialization voltage VI is applied, and a second electrode connected to the first node N1.
  • the fourth switching element T4 may be an oxide thin film transistor.
  • the fourth switching element T4 may be an N-type thin film transistor.
  • the first electrode of the fourth switching element T4 may be a source electrode, and the second electrode may be a drain electrode.
  • the fifth switching element T5 may include a gate electrode to which the emission control signal EM is applied, a first electrode to which the high power voltage ELVDD is applied, and a second electrode connected to the second node N2.
  • the fifth switching element T5 may be a polysilicon thin film transistor.
  • the fifth switching element T5 may be a P-type thin film transistor.
  • the first electrode of the fifth switching element T5 may be a source electrode, and the second electrode may be a drain electrode.
  • the sixth switching element T6 includes a gate electrode to which the emission control signal EM is applied, a first electrode connected to the third node N3 and a second electrode connected to the anode electrode of the organic light emitting diode OLED. can do.
  • the sixth switching element T6 may be a polysilicon thin film transistor.
  • the sixth switching element T6 may be a P-type thin film transistor.
  • the first electrode of the sixth switching element T6 may be a source electrode, and the second electrode may be a drain electrode.
  • the seventh switching element T7 includes a gate electrode to which the organic light emitting diode initialization gate signal GB is applied, a first electrode to which the initialization voltage VI is applied, and a second electrode connected to the anode electrode of the organic light emitting diode OLED. It may include.
  • the seventh switching element T7 may be an oxide thin film transistor.
  • the seventh switching element T7 may be an N-type thin film transistor.
  • the first electrode of the seventh switching element T7 may be a source electrode, and the second electrode may be a drain electrode.
  • the storage capacitor CST may include a first electrode to which a high power voltage is applied and a second electrode to which the first node N1 is connected.
  • the organic light emitting diode OLED may include an anode electrode and a cathode electrode to which a low power voltage ELVSS is applied.
  • the pixel PX may operate in the first period T1 to the fourth period T4.
  • the fourth switching element T4 is turned on in response to the initialization gate signal GI to initialize the first node N1 and the storage capacitor CST.
  • the second switching element T2 and the third switching element T3 are turned on in response to the first data write gate signal GWP and the second data write gate signal GWN, so that the first switching is performed.
  • the threshold voltage of the element T1 is compensated, and the data voltage Vd compensated for the threshold voltage may be written to the first node N1.
  • the seventh switching element T7 is turned on in response to the organic light emitting diode initialization gate signal GB to initialize the anode electrode of the organic light emitting diode OLED.
  • the fifth switching element T5 and the sixth switching element T6 are turned on in response to the emission control signal EM to emit the organic light emitting diode OLED.
  • the data initialization gate signal GI may have an activation level.
  • the activation level of the data initialization gate signal GI may be a high level.
  • the first data write gate signal GWP and the second data write gate signal GWN may have an activation level.
  • the activation level of the first data write gate signal GWP may be a low level
  • the activation level of the second data write gate signal GWN may be a high level.
  • the second switching element T2 and the third switching element T3 may be turned on.
  • the first switching element T1 may also be turned on by the initialization voltage VI.
  • the data voltage Vd supplied to the first electrode of the second switching element T2 is set to the first node N1 along the path formed by turning on the first to third switching elements T1, T2, and T3. You can.
  • the threshold voltage of the first switching element T1 is compensated for the data voltage Vd (that is, at the data voltage).
  • the voltage minus the threshold voltage may be set at the first node N1.
  • the organic light emitting diode initialization gate signal GB may have an activation level.
  • the activation level of the organic light emitting diode initialization gate signal GB may be a high level.
  • the seventh switching element T7 is turned on so that the initialization voltage VI may be applied to the anode electrode of the organic light emitting diode OLED.
  • the emission control signal EM may have an activation level.
  • the activation level of the emission control signal EM may be a low level.
  • the fifth switching element T5 and the sixth switching element T6 may be turned on.
  • the first switching element T1 may also be turned on by the data voltage Vd.
  • the first switching element T1 may generate a driving current based on the data voltage Vd.
  • the driving current is supplied to the anode electrode of the organic light emitting diode (OLED) through the sixth switching element (T6) so that the organic light emitting diode (OLED) can emit light.
  • FIG. 4 is a timing diagram showing an example of signals applied to the pixels of FIG. 2 in a low frequency driving mode.
  • the display device may be driven in a normal driving mode operating at a normal driving frequency and a low frequency driving mode operating at a frequency lower than the normal driving frequency.
  • the display panel may operate in a normal driving mode.
  • the display panel may operate in a low frequency driving mode.
  • the display panel may operate in the low-frequency driving mode.
  • the display panel is driven in units of frames, and may be refreshed every frame in the normal driving mode. Therefore, the normal driving mode may include only a writing frame that writes data to pixels. In the low frequency driving mode, the display panel may be refreshed at a frequency in the low frequency driving mode. Therefore, the low-frequency driving mode may include a writing frame for writing data to a pixel and a holding frame for holding data written in a pixel. For example, when the frequency of the general driving mode is 60 Hz and the frequency of the low frequency driving mode is 1 Hz, the low frequency driving mode includes one writing frame and 59 holding frames for 1 second. do.
  • the second switching element T2, the fifth switching element T5, and the sixth switching element T6 operate at 60 Hz
  • the third switching element T3 operates at 1 Hz. can do.
  • the low frequency driving mode includes 10 writing frames and 50 holding frames for 1 second. do.
  • the frequency of the normal driving mode is 60 Hz and the frequency of the low frequency driving mode is 10 Hz
  • five consecutive holding frames may be disposed between two neighboring lighting frames.
  • the second switching element T2, the fifth switching element T5, and the sixth switching element T6 operate at 60 Hz
  • the third switching element T3 operates at 10 Hz. can do.
  • the gate clock signals CLK1 and CLK2 may include a first gate clock signal CLK1 and a second gate clock signal CLK2.
  • the second gate clock signal CLK2 may be a signal in which the first gate clock signal CLK1 is delayed.
  • the second gate clock signal CLK2 may be an inversion signal of the first gate clock signal CLK1.
  • the gate clock signal is not limited thereto.
  • the gate driver may be further provided with a gate clock signal according to the configuration of the stage generating the gate signal.
  • the driving control unit of the display device may provide a gate clock signal having a DC voltage during a holding frame.
  • the gate clock signals CLK1 and CLK2 may swing between a high level and a low level during a writing frame, and maintain a low level during a holding frame.
  • the gate clock signals CLK1 and CLK2 may swing between the high level and the low level during the writing frame, and maintain the high level during the holding frame.
  • the high level may have a gate-on voltage level
  • the low level may have a gate-off voltage level.
  • the first gate clock signal CLK1 may swing between a high level and a low level during a writing frame, and maintain a low level during a holding frame.
  • the second gate clock signal CLK2 may swing between a high level and a low level during the writing frame, and maintain a high level during the holding frame.
  • the display device according to embodiments of the present invention does not swing the gate clock signals CLK1 and CLK2 during a holding frame in a low frequency driving mode, and maintains the DC power having a high level or a low level, thereby consuming power. Can be reduced.
  • FIG. 5 is a timing diagram illustrating another example of signals applied to the pixel of FIG. 2 in a low frequency driving mode.
  • the display device may be driven in a normal driving mode operating at a normal driving frequency and a low frequency driving mode operating at a frequency lower than the normal driving frequency.
  • the display panel may operate in a normal driving mode.
  • the display panel may operate in a low frequency driving mode.
  • the display panel can operate in a low-frequency driving mode.
  • the display panel is driven in units of frames, and may be refreshed every frame in the normal driving mode. Therefore, the normal driving mode may include only a writing frame that writes data to pixels. In the low frequency driving mode, the display panel may be refreshed at a frequency in the low frequency driving mode. Therefore, the low-frequency driving mode may include a writing frame for writing data to a pixel and a holding frame for holding data written in a pixel.
  • the driving control unit of the display device may not operate the data driving unit during the holding frame.
  • the driving control unit of the display device provides the analog driving voltage AVDD having the first voltage level during the writing frame in the low-frequency driving mode to the data driving unit and removes it during the holding frame.
  • the analog driving voltage AVDD having the second voltage level LV2 lower than one voltage level LV0 may be provided to the data driver.
  • the second voltage level may have a voltage level (eg, 0V) that does not operate the data driver.
  • the data driving unit may generate a gamma reference voltage based on the analog driving voltage AVDD having the first voltage level LV1 during the writing frame.
  • the data driver may convert the data signal supplied from the driving controller to an analog data voltage Vd using a gamma reference voltage, and output the data voltage Vd to the data line.
  • the data driving unit may be provided with an analog driving voltage AVDD having a second voltage level LV2 during a holding frame.
  • the data driver may not operate during the holding frame based on the analog drive voltage AVDD having the second voltage level LV2. Therefore, in the display device according to the exemplary embodiments of the present invention, since the data driving unit does not operate during the holding frame in the low frequency driving mode, power consumption can be reduced.
  • FIG. 6 is a circuit diagram illustrating another example of a pixel included in the display device of FIG. 1, and FIG. 7 is a timing diagram showing an example of signals applied to the pixel of FIG. 6 in a low frequency driving mode.
  • each of the pixels PXs includes first to eighth switching elements T1, T2, T3, T4, T5, T6, T7, and T8, and a storage capacitor CST. ) And an organic light emitting diode (OLED).
  • the pixel PX of FIG. 6 according to embodiments of the present invention may have a structure substantially the same as the pixel PX of FIG. 2, except that the eighth switching element T8 is included.
  • the eighth switching element T8 is a gate electrode to which the sustain voltage enable signal Vsus_en is applied, a first electrode to which the sustain voltage Vsus is applied, and a second electrode connected to the first electrode of the second switching element T2. It may include an electrode.
  • the eighth switching element T8 may be a polysilicon transistor.
  • the eighth switching element T8 may be a P-type thin film transistor.
  • the first electrode of the eighth switching element T8 may be a source electrode, and the second electrode may be a drain electrode.
  • the driving control unit of the display device provides the analog driving voltage AVDD during the writing frame in the low-frequency driving mode to the data driving unit, and the sustain voltage Vsus during the holding frame in pixels.
  • the driving control unit may include a voltage generating unit generating the analog driving voltage AVDD and the sustain voltage Vsus.
  • the driving control unit generates a voltage having a first voltage level during a writing frame and provides it to the data driving unit as the analog driving voltage AVDD, and is equal to or equal to the first voltage level during a holding frame. .., Voltages having different voltage levels may be generated and provided to the pixels as the sustain voltage Vsus. Since the voltage is not supplied to the data driver during the holding frame, the data driver may not operate.
  • the driving control unit may provide a sustain voltage enable signal Vsus_en to the pixel. 6 and 7, the sustain voltage enable signal Vsus_en may be activated during the holding frame HOLDING FRAME and supplied to the gate electrode of the eighth switching element T8. The eighth switching element T8 may be turned on in response to the holding voltage enable signal Vsus_en during the holding frame. Thus, the holding voltage Vsus may be supplied to the first electrode of the eighth switching element T8 through the eighth switching element T8 during the holding frame.
  • a leakage current may be generated through the second switching element T2 connected to the first switching element T1 during the holding frame.
  • the luminance of the pixel PX may be changed.
  • the pixel PX of the display device according to the exemplary embodiments of the present invention applies a sustain voltage Vsus to the first electrode of the second switching element T2 through the eighth switching element T8 during the holding frame. By supplying it, it is possible to prevent the leakage current caused by the second switching element T2 from being generated. Therefore, the pixel PX can emit light with a constant luminance.
  • the driving control unit of the display device provides the analog driving voltage AVDD to the data driving unit during the writing frame and the analog to the data driving unit during the holding frame.
  • the driving control unit of the display device may prevent the driving current from being changed due to the leakage current by providing the sustain voltage Vsus to the pixel PX during the holding frame. have.
  • FIG. 8 is a block diagram illustrating an electronic device including the display device of FIG. 1, and FIG. 9 is a diagram illustrating an example in which the electronic device of FIG. 8 is implemented as a smartphone.
  • the electronic device 200 includes a processor 210, a memory device 220, a storage device 230, an input / output device 240, a power supply 250, and a display device 260. It can contain.
  • the display device 260 may correspond to the display device 100 of FIG. 1.
  • the electronic device 200 may further include various ports that can communicate with a video card, sound card, memory card, USB device, or other systems.
  • the electronic device 200 may be implemented as a smartphone 300, but the electronic device 200 is not limited thereto.
  • the processor 210 can perform certain calculations or tasks.
  • the processor 210 may be a microprocessor, a central processing unit (CPU), or the like.
  • the processor 210 may be connected to other components through an address bus, a control bus, and a data bus.
  • the processor 210 may also be connected to an expansion bus, such as a Peripheral Component Interconnect (PCI) bus.
  • the memory device 220 may store data necessary for the operation of the electronic device 200.
  • the memory device 220 includes EPROM, EEPROM, flash memory, phase change random access memory (PRAM), resistance random access memory (RRAM), magnetic random access memory (MRAM), ferroelectric random access memory (FRAM), and the like.
  • Non-volatile memory devices and / or volatile memory devices such as dynamic random access memory (DRAM), static random access memory (SRAM), and mobile DRAM may be included.
  • the storage device 230 may include a solid state drive (SSD), a hard disk drive (HDD), a CD-ROM, and the like.
  • the input / output device 240 may include input means such as a keyboard, keypad, touch pad, touch screen, and mouse, and output means such as a speaker and a printer.
  • the display device 260 may be provided in the input / output device 240.
  • the power supply 250 may supply power required for the operation of the electronic device 200.
  • the display device 260 may be connected to other components through the buses or other communication links.
  • the display device 260 may include a display panel, a gate driver, a data driver, a light emitting controller, and a driving controller.
  • the display panel may include a plurality of pixels.
  • the driving control unit may generate control signals for controlling the gate driving unit, the data driving unit, and the emission control unit based on the input image data and the input control signal.
  • the gate driver may generate a gate signal based on the first control signal supplied from the driving control unit and output the gate signal to the gate line of the display panel.
  • the data driver may generate a data signal based on the second control signal supplied from the driving control unit and output the data signal to the data line of the display panel.
  • the light emission control unit may generate a light emission control signal based on the third control signal supplied from the driving control unit and output the light emission control signal to the light emission control line of the display panel.
  • the driving control unit may generate a first control signal for controlling the operation of the gate driving unit based on the input control signal.
  • the first control signal may include a vertical start signal and a gate clock signal.
  • the display panel according to embodiments of the present invention may operate in a writing frame for writing data to a pixel and a holding frame for holding data written in a pixel in a low frequency driving mode.
  • the driving control unit may reduce the power consumption of the display device 260 by providing a gate clock signal having a DC voltage during the holding frame to the gate driving unit.
  • the driving control unit may generate a second control signal for controlling the operation of the data driving unit based on the input control signal.
  • the driving control unit may generate an analog driving voltage for operating the data driving unit.
  • the driving control unit of the display device 260 may not operate the data driving unit during the holding frame.
  • the driving control unit provides an analog driving voltage having a first voltage level during a writing frame to the data driving unit, and provides an analog driving voltage having a second voltage level (eg, 0V) during a holding frame to the data driving unit. can do. Since the data driver does not operate during the holding frame, power consumption of the display device 260 may be reduced.
  • the driving control unit of the display device 260 provides an analog driving voltage having a first voltage level during a writing frame to a data driver, and a third voltage level during a holding frame.
  • a sustain voltage can be provided to the pixel.
  • the data driver may not operate because the analog driving voltage is not provided during the holding frame.
  • the pixel is provided with a sustain voltage during the holding frame, thereby preventing leakage current of the driving transistor (first switching element) from being generated. Accordingly, power consumption of the display device 260 is reduced, and display quality can be improved.
  • the present invention can be applied to all electronic devices having a display device.
  • the present invention includes televisions, computer monitors, laptops, digital cameras, cell phones, smart phones, smart pads, tablet PCs, PDAs, PMPs, MP3 players, navigation, video phones, head mounted displays ( Head Mount Display (HMD) device.
  • HMD Head Mount Display
  • display device 110 display panel

Landscapes

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Abstract

표시 장치는 제1 타입의 스위칭 소자 및 제1 타입과 상이한 제2 타입의 스위칭 소자를 포함하는 픽셀을 포함하는 표시 패널, 게이트 클럭 신호에 기초하여 게이트 신호를 생성하고, 게이트 신호를 상기 표시 패널에 제공하는 게이트 구동부, 데이터 전압을 상기 표시 패널에 제공하는 데이터 구동부, 발광 제어 신호를 상기 표시 패널에 제공하는 발광 제어부 및 게이트 구동부, 데이터 구동부 및 발광 제어부를 제어하는 제어 신호들을 생성하는 구동 제어부를 포함한다. 저주파 구동 모드에서 표시 패널은 픽셀에 데이터를 기입하는 라이팅(writing) 프레임과 픽셀에 기입된 데이터를 유지하는 홀딩(holing) 프레임에서 동작하고, 구동 제어부는 홀딩 프레임 동안 직류 전압을 갖는 게이트 클럭 신호를 게이트 구동부에 제공한다.

Description

표시 장치
본 발명은 표시 장치 및 이의 구동 방법에 관한 것이다.
일반적으로, 표시 장치는 표시 패널 및 표시 패널 구동부를 포함한다. 상기 표시 패널은 복수의 픽셀들, 복수의 게이트 라인들, 복수의 데이터 라인들 및 복수의 발광 제어 라인들을 포함한다. 상기 표시 패널 구동부는 상기 복수의 게이트 라인들에 게이트 신호를 제공하는 게이트 구동부, 상기 데이터 라인들에 데이터 전압을 제공하는 데이터 구동부, 상기 발광 제어 라인에 발광 제어 신호를 제공하는 발광 제어부 및 상기 게이트 구동부, 데이터 구동부 및 발광 제어부를 제어하는 제어 신호들을 생성하는 구동 제어부를 포함한다.
최근, 상기 표시 패널에 표시되는 영상이 정지 영상이거나, 표시 패널이 상시 표시(always on display; AOD) 모드에서 저주파 구동을 통해 소비 전력을 감소시키기 위한 방법이 연구되고 있다.
본 발명의 일 목적은 표시 패널의 소비 전력을 감소시키는 표시 장치를 제공하는 것이다.
그러나, 본 발명이 목적은 상술한 목적으로 한정되는 것은 아니며, 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위에서 다양하게 확장될 수 있을 것이다.
본 발명의 일 목적을 달성하기 위하여, 본 발명의 실시예들에 따른 표시 장치는 제1 타입의 스위칭 소자 및 상기 제1 타입과 상이한 제2 타입의 스위칭 소자를 포함하는 픽셀을 포함하는 표시 패널, 게이트 클럭 신호에 기초하여 게이트 신호를 생성하고, 상기 게이트 신호를 상기 표시 패널에 제공하는 게이트 구동부, 데이터 전압을 상기 표시 패널에 제공하는 데이터 구동부, 발광 제어 신호를 상기 표시 패널에 제공하는 발광 제어부 및 상기 게이트 구동부, 상기 데이터 구동부 및 상기 발광 제어부를 제어하는 제어 신호들을 생성하는 구동 제어부를 포함할 수 있다. 사익 구동 제어부는 저주파 구동 모드에서 상기 픽셀에 데이터를 기입하는 라이팅(writing) 프레임 동안 하이 레벨 및 로우 레벨 사이에서 스윙하는 상기 게이트 클럭 신호를 상기 게이트 구동부에 제공하고, 상기 픽셀에 기입된 데이터를 유지하는 홀딩(holing) 프레임 동안 직류 전압을 갖는 상기 게이트 클럭 신호를 상기 게이트 구동부에 제공할 수 있다.
일 실시예에 의하면, 상기 저주파 구동 모드에서 상기 게이트 클럭 신호는 상기 라이팅 프레임 동안 상기 하이 레벨 및 상기 로우 레벨 사이에서 스윙하고, 상기 홀딩 프레임 동안 상기 로우 레벨을 유지할 수 있다.
일 실시예에 의하면, 상기 저주파 구동 모드에서 상기 게이트 클럭 신호는 상기 라이팅 프레임 동안 상기 하이 레벨 및 상기 로우 레벨 사이에서 스윙하고, 상기 홀딩 프레임 동안 상기 하이 레벨을 유지할 수 있다.
일 실시예에 의하면, 상기 제1 타입의 스위칭 소자는 폴리 실리콘 박막 트랜지스터이고, 상기 제2 타입의 스위칭 소자는 산화물 박막 트랜지스터일 수 있다.
일 실시예에 의하면, 상기 제1 타입의 스위칭 소자는 P형 트랜지스터이고, 상기 제2 타입의 스위칭 소자는 N형 트랜지스터일 수 있다.
일 실시예에 의하면, 상기 픽셀은 제1 노드에 연결되는 게이트 전극, 제2 노드에 연결되는 제1 전극 및 제3 노드에 연결되는 제2 전극을 포함하는 제1 스위칭 소자, 제1 데이터 기입 게이트 신호가 인가되는 게이트 전극, 상기 데이터 전압이 인가되는 제1 전극 및 상기 제2 노드에 연결되는 제2 전극을 포함하는 제2 스위칭 소자, 제2 데이터 기입 게이트 신호가 인가되는 게이트 전극, 상기 제1 노드에 연결되는 제1 전극 및 상기 제3 노드에 연결되는 제2 노드를 포함하는 제3 스위칭 소자, 데이터 초기화 게이트 신호가 인가되는 게이트 전극, 초기화 전압이 인가되는 제1 전극 및 상기 제1 노드에 연결되는 제2 전극을 포함하는 제4 스위칭 소자, 상기 발광 제어 신호가 인가되는 게이트 전극, 고전원 전압이 인가되는 제1 전극 및 상기 제2 노드에 연결되는 제2 전극을 포함하는 제5 스위칭 소자, 상기 발광 제어 신호가 인가되는 게이트 전극, 상기 제3 노드에 연결되는 제1 전극 및 유기 발광 다이오드의 애노드 전극에 연결되는 제2 전극을 포함하는 제6 스위칭 소자, 유기 발광 다이오드 초기화 게이트 신호가 인가되는 게이트 전극, 상기 초기화 전압이 인가되는 제1 전극 및 상기 유기 발광 다이오드의 상기 애노드 전극에 연결되는 제2 전극을 포함하는 제7 스위칭 소자, 상기 고전원 전압이 인가되는 제1 전극 및 상기 제1 노드에 연결되는 제2 전극을 포함하는 스토리지 캐패시터 및 상기 애노드 전극 및 저전원 전압이 인가되는 캐소드 전극을 포함하는 상기 유기 발광 다이오드를 포함할 수 있다.
일 실시예에 의하면, 상기 제1 스위칭 소자, 상기 제2 스위칭 소자, 상기 제5 스위칭 소자 및 상기 제6 스위칭 소자는 상기 폴리 실리콘 박막 트랜지스터이고, 상기 제3 스위칭 소자, 상기 제4 스위칭 소자 및 상기 제7 스위칭 소자는 상기 산화물 박막 트랜지스터일 수 있다.
일 실시예에 의하면, 상기 저주파 구동 모드에서 상기 제2 스위칭 소자, 상기 제5 스위칭 소자 및 상기 제6 스위칭 소자를 제1 구동 주파수로 구동하고, 상기 제3 스위칭 소자를 제1 구동 주파수보다 낮은 제2 구동 주파수로 구동할 수 있다.
일 실시예에 의하면, 상기 구동 제어부는 상기 게이트 클럭 신호를 생성하는 게이트 제어부를 포함할 수 있다.
본 발명의 다른 목적을 달성하기 위하여, 본 발명의 실시예들에 따른 표시 장치는 제1 타입의 스위칭 소자 및 상기 제1 타입과 상이한 제2 타입의 스위칭 소자를 포함하는 픽셀을 포함하는 표시 패널, 게이트 신호를 상기 표시 패널에 제공하는 게이트 구동부, 데이터 전압을 상기 표시 패널에 제공하는 데이터 구동부, 발광 제어 신호를 상기 표시 패널에 제공하는 발광 제어부 및 상기 게이트 구동부, 상기 데이터 구동부 및 상기 발광 제어부를 제어하는 제어 신호들을 생성하는 구동 제어부를 포함할 수 있다. 상기 구동 제어부는 저주파 구동 모드에서 상기 픽셀에 데이터를 기입하는 라이팅(writing) 프레임 동안 상기 데이터 구동부를 동작시키는 아날로그 구동 전압을 상기 데이터 구동부에 공급하고, 상기 픽셀에 기입된 데이터를 유지하는 홀딩(holding) 프레임 동안 상기 데이터 구동부를 동작시키지 않는 상기 아날로그 구동 전압을 상기 데이터 구동부에 공급할 수 있다.
일 실시예에 의하면, 상기 저주파 구동 모드에서 상기 구동 제어부는 상기 라이팅 프레임 동안 제1 전압 레벨을 갖는 아날로그 구동 전압을 상기 데이터 구동부에 제공하고, 상기 홀딩 프레임 동안 제1 전압 레벨보다 낮은 제2 전압 레벨을 갖는 아날로그 구동 전압을 상기 데이터 구동부에 제공할 수 있다.
일 실시예에 의하면, 상기 제1 타입의 스위칭 소자는 폴리 실리콘 박막 트랜지스터이고, 상기 제2 타입의 스위칭 소자는 산화물 박막 트랜지스터일 수 있다.
일 실시예에 의하면, 상기 제1 타입의 스위칭 소자는 P형 트랜지스터이고, 상기 제2 타입의 스위칭 소자는 N형 트랜지스터일 수 있다.
일 실시예에 의하면, 상기 픽셀은 제1 노드에 연결되는 게이트 전극, 제2 노드에 연결되는 제1 전극 및 제3 노드에 연결되는 제2 전극을 포함하는 제1 스위칭 소자, 제1 데이트 기입 게이트 신호가 인가되는 게이트 전극, 상기 데이터 전압이 인가되는 제1 전극 및 상기 제2 노드에 연결되는 제2 전극을 포함하는 제2 스위칭 소자, 제2 데이터 기입 게이트 신호가 인가되는 게이트 전극, 상기 제1 노드에 연결되는 제1 전극 및 상기 제3 노드에 연결되는 제2 노드를 포함하는 제3 스위칭 소자, 데이터 초기화 게이트 신호가 인가되는 게이트 전극, 초기화 전압이 인가되는 제1 전극 및 상기 제1 노드에 연결되는 제2 전극을 포함하는 제4 스위칭 소자, 상기 발광 제어 신호가 인가되는 게이트 전극, 고전원 전압이 인가되는 제1 전극 및 상기 제2 노드에 연결되는 제2 전극을 포함하는 제5 스위칭 소자, 상기 발광 제어 신호가 인가되는 게이트 전극, 상기 제3 노드에 연결되는 제1 전극 및 유기 발광 다이오드의 애노드 전극에 연결되는 제2 전극을 포함하는 제6 스위칭 소자, 유기 발광 다이오드 초기화 게이트 신호가 인가되는 게이트 전극, 상기 초기화 전압이 인가되는 제1 전극 및 상기 유기 발광 다이오드의 상기 애노드 전극에 연결되는 제2 전극을 포함하는 제7 스위칭 소자, 상기 고전원 전압이 인가되는 제1 전극 및 상기 제1 노드에 연결되는 제2 전극을 포함하는 스토리지 캐패시터 및 상기 애노드 전극 및 저전원 전압이 인가되는 캐소드 전극을 포함하는 상기 유기 발광 다이오드를 포함할 수 있다.
일 실시예에 의하면, 상기 제1 스위칭 소자, 상기 제2 스위칭 소자, 상기 제5 스위칭 소자 및 상기 제6 스위칭 소자는 상기 폴리 실리콘 박막 트랜지스터이고, 상기 제3 스위칭 소자, 상기 제4 스위칭 소자 및 상기 제7 스위칭 소자는 상기 산화물 박막 트랜지스터일 수 있다.
일 실시예에 의하면, 상기 저주파 구동 모드에서 상기 제2 스위칭 소자, 상기 제5 스위칭 소자 및 상기 제6 스위칭 소자를 제1 구동 주파수로 구동하고, 상기 제3 스위칭 소자를 제1 구동 주파수보다 낮은 제2 구동 주파수로 구동할 수 있다.
일 실시예에 의하면, 상기 픽셀은 유지 전압 인에이블 신호가 인가되는 게이트 전극, 유지 전압이 인가되는 제1 전극 및 상기 제2 스위칭 소자의 상기 제1 전극과 연결되는 제2 전극을 포함하는 제8 스위칭 소자를 더 포함할 수 있다.
일 실시예에 의하면, 상기 저주파 구동 모드에서 상기 구동 제어부는 상기 라이팅 프레임 동안 아날로그 구동 전압을 상기 데이터 구동부에 제공하고, 상기 홀딩 프레임 동안 유지 전압을 상기 픽셀에 제공할 수 있다.
일 실시예에 의하면, 상기 제8 스위칭 소자는 상기 폴리 실리콘 박막 트랜지스터일 수 있다.
일 실시예에 의하면, 상기 구동 제어부는 상기 데이터 구동부 및 상기 픽셀에 제공되는 전압을 생성하는 전압 생성부를 포함할 수 있다.
본 발명의 실시예들에 따른 표시 장치는 제1 타입의 스위칭 소자 및 제2 타입의 스위칭 소자를 포함하는 픽셀을 포함하는 표시 장치의 저주파 구동 모드에서 홀딩 프레임 동안 직류 전압을 갖는 게이트 클럭 신호를 게이트 구동부에 제공함으로써, 소비 전력을 감소시킬 수 있다.
본 발명의 실시예들에 따른 표시 장치는 제1 타입의 스위칭 소자 및 제2 타입의 스위칭 소자를 포함하는 픽셀을 포함하는 표시 장치의 저주파 구동 모드에서 홀딩 프레임 동안 데이터 구동부를 동작시키지 않음으로써, 소비 전력을 감소시킬 수 있다.
또한, 본 발명의 실시예들에 따른 표시 장치는 제1 타입의 스위칭 소자 및 제2 타입의 스위칭 소자를 포함하는 픽셀을 포함하는 표시 장치의 저주파 구동 모드에서 홀딩 프레임 동안 픽셀에 유지 전압을 공급함으로써, 누설 전류가 발생하는 것을 방지하고, 픽셀의 휘도를 일정하게 유지할 수 있다.
도 1은 본 발명의 실시예들에 따른 표시 장치를 나타내는 블록도이다.
도 2는 도1의 표시 장치에 포함되는 픽셀의 일 예를 나타내는 회로도이다.
도 3은 도 2의 픽셀에 인가되는 입력 신호들을 나타내는 타이밍도이다.
도 4는 저주파 구동 모드에서 도2의 픽셀에 인가되는 신호들의 일 예를 나타내는 타이밍도이다.
도 5는 저주파 구동 모드에서 도 2의 픽셀에 인가되는 신호들의 다른 예를 나타내는 타이밍도이다.
도 6은 도 1의 표시 장치에 포함되는 픽셀의 다른 예를 나타내는 회로도이다.
도 7은 저주파 구동 모드에서 도 6의 픽셀에 인가되는 신호들의 일 예를 나타내는 타이밍도이다.
도 8은 도 1의 표시 장치를 포함하는 전자 기기를 나타내는 블록도이다.
도 9는 도 8의 전자 기기가 스마트폰으로 구현되는 일 예를 나타내는 도면이다.
이하, 첨부한 도면들을 참조하여, 본 발명의 바람직한 실시예를 보다 상세하게 설명하고자 한다. 도면상의 동일한 구성요소에 대해서는 동일한 참조부호를 사용하고 동일한 구성요소에 대해서 중복된 설명은 생략한다.
도 1은 본 발명의 실시예들에 따른 표시 장치를 나타내는 블록도이다.
도1을 참조하면, 표시 장치(100)는 표시 패널(110) 및 표시 패널 구동부를 포함할 수 있다. 상기 표시 패널 구동부는 게이트 구동부(120), 데이터 구동부(130), 발광 제어부(140) 및 구동 제어부(150)를 포함할 수 있다.
표시 패널(110)은 복수의 게이트 라인들(GWPL, GWNL, GIL, GBL), 복수의 데이터 라인(DL)들, 복수의 발광 제어 라인(EML)들, 유지 전압 공급 라인(VsusL)들 및 상기 게이트 라인들(GWPL, GWNL, GIL, GBL), 상기 데이터 라인(DL)들, 상기 발광 제어 라인(EML)들 및 상기 유지 전압 공급 라인(VsusL)들 각각에 전기적으로 연결된 복수의 픽셀(PX)들을 포함한다. 상기 게이트 라인들(GWPL, GWNL, GIL, GBL), 발광 제어 라인(EML)들 및 유지 전압 공급 라인(VsusL)들은 제1 방향(D1)으로 연장되고, 상기 제1 방향(D1)과 수직한 제2 방향(D2)으로 배열될 수 있다. 상기 데이터 라인(DL)들은 제2 방향(D2)으로 연장되고, 제1 방향(D1)으로 배열될 수 있다. 제1 방향(D1)은 표시 패널(110)의 장변과 평행하고, 제2 방향(D2)은 표시 패널(110)의 단변과 평행할 수 있다. 각각의 픽셀(PX)들은 게이트 라인들과 데이터 라인(DL)들이 교차되는 영역에 형성될 수 있다.
구동 제어부(150)는 외부의 장치로부터 입력 영상 데이터(IMG) 및 입력 제어 신호(CON)를 수신할 수 있다. 예를 들어, 입력 영상 데이터(IMG)는 적색 영상 데이터, 녹색 영상 데이터 및 청색 영상 데이터를 포함할 수 있다. 입력 영상 데이터(IMG)는 백색 영상 데이터를 포함할 수 있다. 입력 영상 데이터(IMG)는 마젠타색(magenta) 영상 데이터, 황색(yellow) 영상 데이터 및 시안색(cyan) 영상 데이터를 포함할 수 있다. 입력 제어 신호(CON)는 마스터 클럭 신호, 데이터 인에이블 신호를 포함할 수 있다. 입력 제어 신호(CON)는 수직 동기 신호 및 수평 동기 신호를 더 포함할 수 있다.
구동 제어부(150)는 입력 영상 데이터(IMG) 및 입력 제어 신호(CON)에 기초하여 게이트 구동부(120), 데이터 구동부(130) 및 발광 제어부(140)를 제어하는 제어 신호들(CTL1, CTL2, CTL3)을 생성할 수 있다.
구동 제어부(150)는 입력 제어 신호(CON)에 기초하여 게이트 구동부(120)의 동작을 제어하기 위한 제1 제어 신호(CTL1)를 생성할 수 있다. 구동 제어부(150)는 제1 제어 신호(CTL1)를 게이트 구동부(120)에 출력할 수 있다. 예를 들어, 제1 제어 신호(CTL1)는 수직 개시 신호 및 게이트 클럭 신호를 포함할 수 있다. 일 실시예에서, 구동 제어부(150)는 저주파 구동 모드에서 픽셀(PX)에 데이터를 기입하는 라이팅(wiring) 프레임 동안 하이 레벨 및 로우 레벨 사이에서 스윙하는 게이트 클럭 신호를 게이트 구동부(120)에 제공하고, 픽셀(PX)에 기입된 데이터를 유지하는 홀딩(holding) 프레임 동안 직류 전압을 갖는 게이트 클럭 신호를 게이트 구동부(120)에 제공할 수 있다. 예를 들어, 구동 제어부(150)는 게이트 클럭 신호를 생성하는 게이트 제어부를 포함할 수 있다.
구동 제어부(150)는 입력 제어 신호(CON)에 기초하여 데이터 구동부(130)의 동작을 제어하기 위한 제2 제어 신호(CTL2)를 생성할 수 있다. 구동 제어부(150)는 제2 제어 신호(CTL2)를 데이터 구동부(130)에 출력할 수 있다. 예를 들어, 제2 제어 신호(CTL2)는 수평 개시 신호 및 로드 신호를 포함할 수 있다.
구동 제어부(150)는 입력 영상 데이터(IMG)에 기초하여 데이터 신호(DATA)를 생성할 수 있다. 예를 들어, 구동 제어부(150)는 입력 영상 데이터(IMG)의 화질을 보정하는 알고리즘을 적용하여 입력 영상 데이터(IMG)를 데이터 신호(DATA)로 변환할 수 있다. 구동 제어부(150)는 데이터 신호(DATA)를 데이터 구동부(130)에 출력할 수 있다.
또한, 구동 제어부(150)는 데이터 구동부(130)를 동작시키기 위한 아날로그 구동 전압(AVDD)을 생성할 수 있다. 구동 제어부(150)는 아날로그 구동 전압(AVDD)을 데이터 구동부(130)에 출력할 수 있다. 또한, 구동 제어부(150)는 픽셀(PX)의 구동 전류를 일정하게 유지시키기 위한 유지 전압(Vsus)을 생성할 수 있다. 구동 제어부(150)는 유지 전압(Vsus)을 픽셀(PX)에 제공할 수 있다. 예를 들어, 구동 제어부(150)는 데이터 구동부(130) 및 픽셀(PX)에 제공되는 전압을 생성하는 전압 생성부를 포함할 수 있다. 일 실시예에서, 구동 제어부(150)는 저주파 구동 모드에서 라이팅 프레임 동안 제1 전압 레벨을 갖는 아날로그 구동 전압(AVDD)을 데이터 구동부(130)에 제공하고, 홀딩 프레임 동안 제2 전압 레벨(예를 들어, 0V)을 갖는 아날로그 구동 전압(AVDD)을 데이터 구동부(130)에 제공할 수 있다. 다른 실시예에서, 구동 제어부(150)는 저주파 구동 모드에서 라이팅 프레임 동안 제1 전압 레벨을 갖는 아날로그 구동 전압(AVDD)을 데이터 구동부(130)에 제공하고, 홀딩 프레임 동안 제3 전압 레벨을 갖는 유지 전압(Vsus)을 픽셀(PX)에 제공할 수 있다. 예를 들어, 제3 전압 레벨은 제1 전압 레벨과 동일하거나 상이할 수 있다.
구동 제어부(150)는 입력 제어 신호(CON)에 기초하여 발광 제어부(140)의 동작을 제어하기 위한 제3 제어 신호(CTL3)를 생성할 수 있다. 구동 제어부(150)는 제3 제어 신호(CTL3)를 발광 제어부(140)에 출력할 수 있다.
게이트 구동부(120)는 구동 제어부(150)로부터 공급되는 제1 제어 신호(CTL1)에 응답하여 게이트 신호들(GWP, GWN, GI, GB)을 생성할 수 있다. 게이트 구동부(120)는 게이트 신호들(GWP, GWN, GI, GB)을 게이트 라인들(GWPL, GWNL, GIL, GBL)에 출력할 수 있다.
데이터 구동부(130)는 구동 제어부(150)로부터 공급되는 제2 제어 신호(CTL2), 아날로그 구동 전압(AVDD) 및 데이터 신호(DATA)에 기초하여 데이터 전압(Vd)을 생성할 수 있다. 데이터 구동부(130)는 구동 제어부(150)로부터 입력 받은 제2 제어 신호(CTL2) 및 아날로그 구동 전압(AVDD)에 기초하여 감마 기준 전압을 생성할 수 있다. 감마 기준 전압은 각각의 데이터 신호(DATA)에 대응하는 값을 가질 수 있다. 예를 들어, 데이터 구동부(130)는 구동 제어부(150)로부터 공급되는 아날로그 구동 전압(AVDD)을 분배하여 감마 기준 전압을 생성할 수 있다. 데이터 구동부(130)는 데이터 신호(DATA)를 감마 기준 전압을 이용하여 아날로그 형태의 데이터 전압(Vd)으로 변환할 수 있다. 데이터 구동부(130)는 데이터 전압(Vd)을 데이터 라인(DL)에 출력할 수 있다.
발광 제어부(140)는 구동 제어부(150)로부터 공급되는 제3 제어 신호에 응답하여 발광 제어 신호를 생성할 수 있다. 발광 제어부(140)는 발광 제어 신호들을 발광 제어 라인(EML)들에 출력할 수 있다.
도 2는 도1의 표시 장치에 포함되는 픽셀의 일 예를 나타내는 회로도이고, 도 3은 도 2의 픽셀에 인가되는 입력 신호들을 나타내는 타이밍도이다.
도1 내지 도 3을 참조하면, 표시 패널은 복수의 픽셀(PX)들을 포함하고, 상기 픽셀(PX)들 각각은 유기 발광 다이오드(OLED)를 포함할 수 있다.
픽셀(PX)들은 데이터 기입 게이트 신호(GWP, GWN), 데이터 초기화 게이트 신호(GI), 유기 발광 다이오드 초기화 게이트 신호(GB) 및 발광 제어 신호(EM)를 입력받아 데이터 전압(Vd)의 레벨에 따라 유기 발광 다이오드(OLED)를 발광시켜 상기 영상을 표시할 수 있다.
본 발명의 실시예들에 따르면, 각각의 픽셀(PX)은 제1 타입의 스위칭 소자 및 제1 타입과 상이한 제2 타입의 스위칭 소자를 포함할 수 있다. 예를 들어, 상기 제1 타입의 스위칭 소자는 폴리 실리콘 박막 트랜지스터일 수 있다. 예를 들어, 상기 제1 타입의 스위칭 소자는 저온 폴리 실리콘(low temperature polysilicon; LTPS) 박막 트랜지스터일 수 있다. 예를 들어, 상기 제2 타입의 스위칭 소자는 산화물 박막 트랜지스터일 수 있다. 예를 들어, 상기 제1 타입의 스위칭 소자는 P형 트랜지스터일 수 있고, 상기 제2 타입의 스위칭 소자는 N형 트랜지스터일 수 있다.
예를 들어, 데이터 기입 게이트 신호(GWP, GWN)는 제1 데이터 기입 게이트 신호(GWP) 및 제2 데이터 기입 게이트 신호(GWN)를 포함할 수 있다. 제1 데이터 기입 게이트 신호(GWP)는 상기 P형 트랜지스터에 인가되며, 데이터 기입 타이밍에 로우 레벨의 활성화 신호를 가질 수 있다. 제2 데이터 기입 게이트 신호(GWN)는 상기 N형 트랜지스터에 인가되며, 데이터 기입 타이밍에 하이 레벨의 활성화 신호를 가질 수 있다.
본 발명의 실시예들에 따른 픽셀(PX)들 각각은 제1 내지 제7 스위칭 소자(T1, T2, T3, T4, T5, T6, T7), 스토리지 캐패시터(CST) 및 유기 발광 다이오드(OLED)를 포함할 수 있다.
제1 스위칭 소자(T1)는 제1 노드(N1)에 연결되는 게이트 전극, 제2 노드(N2)에 연결되는 제1 전극 및 제3 노드(N3)에 연결되는 제2 전극을 포함할 수 있다. 예를 들어, 제1 스위칭 소자(T1)는 폴리 실리콘 박막 트랜지스터일 수 있다. 제1 스위칭 소자(T1)는 P형 박막 트랜지스터일 수 있다. 제1 스위칭 소자(T1)의 제1 전극은 소스 전극이고, 제2 전극은 드레인 전극일 수 있다.
제2 스위칭 소자(T2)는 제1 데이터 기입 게이트 신호(GWP)가 인가되는 게이트 전극, 데이터 전압(Vd)이 인가되는 제1 전극 및 제2 노드(N2)에 연결되는 제2 전극을 포함할 수 있다. 예를 들어, 제2 스위칭 소자(T2)는 폴리 실리콘 박막 트랜지스터일 수 있다. 제2 스위칭 소자(T2)는 P형 박막 트랜지스터일 수 있다. 제2 스위칭 소자(T2)의 제1 전극은 소스 전극이고, 제2 전극은 드레인 전극일 수 있다.
제3 스위칭 소자(T3)는 제2 데이터 기입 게이트 신호(GWN)가 인가되는 게이트 전극, 제1 노드(N1)에 연결되는 제1 전극 및 제3 노드(N3)에 연결되는 제2 전극을 포함할 수 있다. 예를 들어, 제3 스위칭 소자(T3)는 산화물 박막 트랜지스터일 수 있다. 제3 스위칭 소자(T3)는 N형 박막 트랜지스터일 수 있다. 제3 스위칭 소자(T3)의 제1 전극은 소스 전극이고, 제2 전극은 드레인 전극일 수 있다.
제4 스위칭 소자(T4)는 데이터 초기화 게이트 신호(GI)가 인가되는 게이트 전극, 초기화 전압(VI)이 인가되는 제1 전극 및 제1 노드(N1)에 연결되는 제2 전극을 포함할 수 있다. 예를 들어, 제4 스위칭 소자(T4)는 산화물 박막 트랜지스터일 수 있다. 제4 스위칭 소자(T4)는 N형 박막 트랜지스터일 수 있다. 제4 스위칭 소자(T4)의 제1 전극은 소스 전극이고, 제2 전극은 드레인 전극일 수 있다.
제5 스위칭 소자(T5)는 발광 제어 신호(EM)가 인가되는 게이트 전극, 고전원 전압(ELVDD)이 인가되는 제1 전극 및 제2 노드(N2)에 연결되는 제2 전극을 포함할 수 있다. 예를 들어, 제5 스위칭 소자(T5)는 폴리 실리콘 박막 트랜지스터일 수 있다. 제5 스위칭 소자(T5)는 P형 박막 트랜지스터일 수 있다. 제5 스위칭 소자(T5)의 제1 전극은 소스 전극이고, 제2 전극은 드레인 전극일 수 있다.
제6 스위칭 소자(T6)는 발광 제어 신호(EM)가 인가되는 게이트 전극, 제3 노드(N3)에 연결되는 제1 전극 및 유기 발광 다이오드(OLED)의 애노드 전극에 연결되는 제2 전극을 포함할 수 있다. 예를 들어, 제6 스위칭 소자(T6)는 폴리 실리콘 박막 트랜지스터일 수 있다. 제6 스위칭 소자(T6)는 P형 박막 트랜지스터일 수 있다. 제6 스위칭 소자(T6)의 제1 전극은 소스 전극이고, 제2 전극은 드레인 전극일 수 있다.
제7 스위칭 소자(T7)는 유기 발광 다이오드 초기화 게이트 신호(GB)가 인가되는 게이트 전극, 초기화 전압(VI)이 인가되는 제1 전극 및 유기 발광 다이오드(OLED)의 애노드 전극에 연결되는 제2 전극을 포함할 수 있다. 예를 들어, 제7 스위칭 소자(T7)는 산화물 박막 트랜지스터일 수 있다. 제7 스위칭 소자(T7)는 N형 박막 트랜지스터일 수 있다. 제7 스위칭 소자(T7)의 제1 전극은 소스 전극이고, 제2 전극은 드레인 전극일 수 있다.
스토리지 캐패시터(CST)는 고전원 전압이 인가되는 제1 전극 및 제1 노드(N1)에 연결되는 제2 전극을 포함할 수 있다.
유기 발광 다이오드(OLED)는 애노드 전극 및 저전원 전압(ELVSS)이 인가되는 캐소드 전극을 포함할 수 있다.
도3을 참조하면, 상기 픽셀(PX)은 제1 구간(T1) 내지 제4 구간(T4)에서 동작할 수 있다. 제1 구간(T1) 동안 초기화 게이트 신호(GI)에 응답하여 제4 스위칭 소자(T4)가 턴온되어 제1 노드(N1) 및 스토리지 캐패시터(CST)가 초기화될 수 있다. 제2 구간(P2) 동안 제1 데이터 기입 게이트 신호(GWP) 및 제2 데이터 기입 게이트 신호(GWN)에 응답하여 제2 스위칭 소자(T2) 및 제3 스위칭 소자(T3)가 턴온되어 제1 스위칭 소자(T1)의 문턱 전압이 보상되고, 상기 문턱 전압이 보상된 데이터 전압(Vd)이 제1 노드(N1)에 기입될 수 있다. 제3 구간(P3) 동안 유기 발광 다이오드 초기화 게이트 신호(GB)에 응답하여 제7 스위칭 소자(T7)가 턴온되어 유기 발광 다이오드(OLED)의 애노드 전극이 초기화될 수 있다. 제4 구간(P4) 동안 발광 제어 신호(EM)에 응답하여 제5 스위칭 소자(T5) 및 제6 스위칭 소자(T6)가 턴온되어 유기 발광 다이오드(OLED)가 발광할 수 있다.
제1 구간(P1) 동안 데이터 초기화 게이트 신호(GI)가 활성화 레벨을 가질 수 있다. 예를 들어, 데이터 초기화 게이트 신호(GI)의 활성화 레벨은 하이 레벨일 수 있다. 활성화 레벨을 갖는 데이터 초기화 게이트 신호(GI)가 공급되는 경우, 제4 스위칭 소자(T4)가 턴온되어 초기화 전압(VI)이 제1 노드(N1)에 인가될 수 있다.
제2 구간(P2) 동안 제1 데이터 기입 게이트 신호(GWP) 및 제2 데이터 기입 게이트 신호(GWN)가 활성화 레벨을 가질 수 있다. 예를 들어, 제1 데이터 기입 게이트 신호(GWP)의 활성화 레벨은 로우 레벨이고, 제2 데이터 기입 게이트 신호(GWN)의 활성화 레벨은 하이 레벨일 수 있다. 활성화 레벨을 갖는 제1 데이터 기입 게이트 신호(GWP) 및 제2 데이터 기입 게이트 신호(GWN)가 공급되는 경우, 제2 스위칭 소자(T2) 및 제3 스위칭 소자(T3)가 턴온 될 수 있다. 또한, 상기 초기화 전압(VI)에 의해 제1 스위칭 소자(T1)도 턴온될 수 있다. 제1 내지 제3 스위칭 소자(T1, T2, T3)가 턴온되어 형성된 경로를 따라 제2 스위칭 소자(T2)의 제1 전극에 공급되는 데이터 전압(Vd)이 제1 노드(N1)에 설정될 수 있다. 이 때, 제3 스위칭 소자(T3)가 턴온되어 제1 스위칭 소자(T1)가 다이오드 결합을 하므로, 제1 스위칭 소자(T1)의 문턱 전압이 보상된 데이터 전압(Vd)(즉, 데이터 전압에서 상기 문턱 전압을 뺀 전압)이 제1 노드(N1)에 설정될 수 있다.
제3 구간(P3) 동안 유기 발광 다이오드 초기화 게이트 신호(GB)가 활성화 레벨을 가질 수 있다. 예를 들어, 유기 발광 다이오드초기화 게이트 신호(GB)의 활성화 레벨은 하이 레벨일 수 있다. 활성화 레벨을 가지는 유기 발광 다이오드 초기화 게이트 신호(GB)가 공급되는 경우, 제7 스위칭 소자(T7)가 턴온되어 초기화 전압(VI)이 유기 발광 다이오드(OLED)의 애노드 전극에 인가될 수 있다.
제4 구간(P4) 동안 발광 제어 신호(EM)가 활성화 레벨을 가질 수 있다. 예를 들어, 발광 제어 신호(EM)의 활성화 레벨은 로우레벨일 수 있다. 로우 레벨을 갖는 발광 제어 신호(EM)가 공급되는 경우, 제5 스위칭 소자(T5) 및 제6 스위칭 소자(T6)가 턴온될 수 있다. 또한, 데이터 전압(Vd)에 의해 제1 스위칭 소자(T1)도 턴온될 수 있다. 제1 스위칭 소자(T1)는 데이터 전압(Vd)에 기초하여 구동 전류를 생성할 수 있다. 상기 구동 전류는 제6 스위칭 소자(T6)를 통해 유기 발광 다이오드(OLED)의 애노드 전극에 공급되어 유기 발광 다이오드(OLED)가 발광할 수 있다.
도4는 저주파 구동 모드에서 도2의 픽셀들에 인가되는 신호들의 일 예를 나타내는 타이밍도이다.
도1 내지 도 4를 참조하면, 표시 장치는 정상 구동 주파수에서 동작하는 일반 구동 모드 및 정상 구동 주파수보다 낮은 주파수에서 동작하는 저주파 구동 모드로 구동 될 수 있다. 예를 들어, 입력 영상 데이터가 동영상일 때, 표시 패널은 일반 구동 모드로 동작할 수 있다. 예를 들어, 입력 영상 데이터가 정지 영상일 때, 표시 패널은 저주파 구동 모드로 동작할 수 있다. 예를 들어, 표시 장치가 상시 표시 (always on display; AOD) 모드일 때, 표시 패널은 상기 저주파 구동 모드로 동작할 수 있다.
표시 패널은 프레임 단위로 구동되고, 일반 구동 모드에서 매 프레임마다 리프레쉬될 수 있다. 따라서, 일반 구동 모드는 픽셀에 데이터를 기입하는 라이팅 프레임(WRITING FRAME)만을 포함할 수 있다. 저주파 구동 모드에서 표시 패널은 저주파 구동 모드의 주파수로 리프레쉬될 수 있다. 따라서, 저주파 구동 모드는 픽셀에 데이터를 기입하는 라이팅 프레임(WRITING FRAME) 및 픽셀에 기입된 데이터를 유지하는 홀딩 프레임(HOLDING FRAME)을 포함할 수 있다. 예를 들어, 상기 일반 구동 모드의 주파수가 60Hz이고 저주파 구동 모드의 주파수가 1Hz인 경우, 상기 저주파 구동 모드는 1초 동안 하나의 라이팅 프레임(WRITING FRAME)과 59개의 홀딩 프레임(HOLDING FRAME)을 포함한다. 상기 일반 구동 모드의 주파수가 60Hz이고 저주파 구동 모드의 주파수가 1Hz인 경우, 이웃하는 2개의 라이팅 프레임(WRITING FRAME)들 사이에는 59개의 연속하는 홀딩 프레임(HOLDING FRAME)이 배치될 수 있다. 이 경우, 도 2의 픽셀에 있어서, 제2 스위칭 소자(T2), 제5 스위칭 소자(T5) 및 제6 스위칭 소자(T6)는 60Hz로 동작하고, 제3 스위칭 소자(T3)는 1Hz로 동작할 수 있다. 예를 들어, 상기 일반 구동 모드의 주파수가 60Hz이고 저주파 구동 모드의 주파수가 10Hz인 경우, 상기 저주파 구동 모드는 1초 동안 10개의 라이팅 프레임(WRITING FRAME)과 50개의 홀딩 프레임(HOLDING FRAME)을 포함한다. 상기 일반 구동 모드의 주파수가 60Hz이고 저주파 구동 모드의 주파수가 10Hz인 경우, 이웃하는 2개의 라이팅 프레임(WRITING FRAME)들 사이에는 5개의 연속하는 홀딩 프레임(HOLDING FRAME)이 배치될 수 있다. 이 경우, 도 2의 픽셀에 있어서, 제2 스위칭 소자(T2), 제5 스위칭 소자(T5) 및 제6 스위칭 소자(T6)는60Hz로 동작하고, 제3 스위칭 소자(T3)는 10Hz로 동작할 수 있다.
도4를 참조하면, 게이트 클럭 신호(CLK1, CLK2)는 제1 게이트 클럭 신호(CLK1) 및 제2 게이트 클럭 신호(CLK2)를 포함할 수 있다. 예를 들어, 제2 게이트 클럭 신호(CLK2)는 제1 게이트 클럭 신호(CLK1)가 지연된 신호일 수 있다. 예를 들어, 제2 게이트 클럭 신호(CLK2)는 제1 게이트 클럭 신호(CLK1)의 반전(inversion) 신호일 수 있다. 도 4에는 제1 게이트 클럭 신호(CLK1) 및 제2 게이트 클럭 신호(CLK2)를 도시하였으나, 게이트 클럭 신호는 이에 한정되지 않는다. 예를 들어, 게이트 구동부는 게이트 신호를 생성하는 스테이지의 구성에 따라 게이트 클럭 신호를 더 제공받을 수 있다.
본 발명의 실시예들에 따른 표시 장치의 구동 제어부는 홀딩 프레임(HOLDING FRAME) 동안 직류 전압을 갖는 게이트 클럭 신호를 게이트 구동부에 제공할 수 있다. 일 실시예에서, 저주파 구동 모드에서 게이트 클럭 신호(CLK1, CLK2)는 라이팅 프레임(WRITING FRAME) 동안 하이 레벨 및 로우 레벨 사이에서 스윙하고, 홀딩 프레임(HOLDING FRAME) 동안 로우 레벨을 유지할 수 있다. 다른 실시예에서, 저주파 구동 모드에서 게이트 클럭 신호(CLK1, CLK2)는 라이팅 프레임(WRITING FRAME) 동안 하이 레벨 및 로우 레벨 사이에서 스윙하고, 홀딩 프레임(HOLDING FRAME) 동안 하이 레벨을 유지할 수 있다. 예를 들어, 하이 레벨은 게이트 온 전압 레벨을 가지고, 로우 레벨은 게이트 오프 전압 레벨을 가질 수 있다.
도4를 참조하면, 제1 게이트 클럭 신호(CLK1)는 라이팅 프레임(WRITING FRAME) 동안 하이 레벨 및 로우 레벨 사이에서 스윙하고, 홀딩 프레임(HOLDING FRAME) 동안 로우 레벨을 유지할 수 있다. 또한, 제2 게이트 클럭 신호(CLK2)는 라이팅 프레임(WRITING FRAME) 동안 하이 레벨 및 로우 레벨 사이에서 스윙하고, 홀딩 프레임(HOLDING FRAME) 동안 하이 레벨을 유지할 수 있다. 본 발명의 실시예들에 따른 표시 장치는 저주파 구동 모드에서 홀딩 프레임(HOLDING FRAME) 동안 게이트 클럭 신호(CLK1, CLK2)를 스윙하지 않고, 하이 레벨 또는 로우 레벨을 갖는 직류 전압으로 유지하므로 소비 전력을 감소시킬 수 있다.
도5는 저주파 구동 모드에서 도 2의 픽셀에 인가되는 신호들의 다른 예를 나타내는 타이밍도이다.
도1, 도 2, 도 3 및 도 5를 참조하면, 표시 장치는 정상 구동 주파수에서 동작하는 일반 구동 모드 및 정상 구동 주파수보다 낮은 주파수에서 동작하는 저주파 구동 모드로 구동될 수 있다. 예를 들어, 입력 영상 데이터가 동영상일 때, 표시 패널은 일반 구동 모드로 동작할 수 있다. 예를 들어, 입력 영상 데이터가 정지 영상 일 때, 표시 패널은 저주파 구동 모드로 동작할 수 있다. 예를 들어, 표시 장치가 상시 표시 모드일 때, 표시 패널은 저주파 구동 모드로 동작할 수 있다.
표시 패널은 프레임 단위로 구동되고, 일반 구동 모드에서 매 프레임마다 리프레쉬될 수 있다. 따라서, 일반 구동 모드는 픽셀에 데이터를 기입하는 라이팅 프레임(WRITING FRAME)만을 포함할 수 있다. 저주파 구동 모드에서 표시 패널은 저주파 구동 모드의 주파수로 리프레쉬될 수 있다. 따라서, 저주파 구동 모드는 픽셀에 데이터를 기입하는 라이팅 프레임(WRITING FRAME) 및 픽셀에 기입된 데이터를 유지하는 홀딩 프레임(HOLDING FRAME)을 포함할 수 있다. 표시 장치의 구동 제어부는 상기 홀딩 프레임(HOLDING FRAME) 동안 데이터 구동부를 동작시키지 않을 수 있다.
도5를 참조하면, 표시 장치의 구동 제어부는 저주파 구동 모드에서 라이팅 프레임(WRITING FRAME) 동안 제1 전압 레벨을 갖는 아날로그 구동 전압(AVDD)을 데이터 구동부에 제공하고, 홀딩 프레임(HOLDING FRAME) 동안 제1 전압 레벨(LV0)보다 낮은 제2 전압 레벨(LV2)을 갖는 아날로그 구동 전압(AVDD)을 데이터 구동부에 제공할 수 있다. 제2 전압 레벨은 데이터 구동부를 동작 시키지 않는 전압 레벨(예를 들어, 0V)을 가질 수 있다. 데이터 구동부는 라이팅 프레임(WRITING FRAME) 동안 제1 전압 레벨(LV1)을 갖는 아날로그 구동 전압(AVDD)에 기초하여 감마 기준 전압을 생성할 수 있다. 데이터 구동부는 구동 제어부에서 공급되는 데이터 신호를 감마 기준 전압을 이용하여 아날로그 형태의 데이터 전압(Vd)으로 변환하고, 상기 데이터 전압(Vd)을 데이터 라인에 출력할 수 있다. 데이터 구동부는 홀딩 프레임(HOLDING FRAME) 동안 제2 전압 레벨(LV2)을 갖는 아날로그 구동 전압(AVDD)을 제공받을 수 있다. 제2 전압 레벨(LV2)을 갖는 아날로그 구동 전압(AVDD)에 기초하여 데이터 구동부는 홀딩 프레임(HOLDING FRAME) 동안 동작하지 않을 수 있다. 따라서, 본 발명의 실시예들에 따른 표시 장치는 저주파 구동 모드에서 홀딩 프레임(HOLDING FRAME) 동안 데이터 구동부가 동작하지 않으므로 소비 전력을 감소시킬 수 있다.
도6은 도 1의 표시 장치에 포함되는 픽셀의 다른 예를 나타내는 회로도이고, 도 7은 저주파 구동 모드에서 도 6의 픽셀에 인가되는 신호들의 일 예를 나타내는 타이밍도이다.
도6을 참조하면, 본 발명의 실시예들에 따른 픽셀(PX)들 각각은 제1 내지 제8 스위칭 소자(T1, T2, T3, T4, T5, T6, T7, T8), 스토리지 캐패시터(CST) 및 유기 발광 다이오드(OLED)를 포함할 수 있다. 본 발명의 실시예들에 따른 도 6의 픽셀(PX)은 제8 스위칭 소자(T8)를 포함하는 것을 제외하면, 도 2의 픽셀(PX)과 실질적으로 동일한 구조를 가질 수 있다.
제8 스위칭 소자(T8)는 유지 전압 인에이블 신호(Vsus_en) 가 인가되는 게이트 전극, 유지 전압(Vsus)이 인가되는 제1 전극 및 제2 스위칭 소자(T2)의 제1 전극과 연결되는 제2 전극을 포함할 수 있다. 예를 들어, 제8 스위칭 소자(T8)는 폴리 실리콘 트랜지스터일 수 있다. 제8 스위칭 소자(T8)는 P형 박막 트랜지스터일 수 있다. 제8 스위칭 소자(T8)의 제1 전극은 소스 전극이고, 제2 전극은 드레인 전극일 수 있다.
도7을 참조하면, 표시 장치의 구동 제어부는 저주파 구동 모드에서 라이팅 프레임(WRITING FRAME) 동안 아날로그 구동 전압(AVDD)을 데이터 구동부에 제공하고, 홀딩 프레임(HOLDING FRAME) 동안 유지 전압(Vsus)을 픽셀(PX)에 제공할 수 있다. 예를 들어, 구동 제어부는 상기 아날로그 구동 전압(AVDD) 및 상기 유지 전압(Vsus)을 생성하는 전압 생성부를 포함할 수 있다.
구동 제어부는 라이팅 프레임(WRITING FRAME) 동안 제1 전압 레벨을 갖는 전압을 생성하여 상기 아날로그 구동 전압(AVDD)으로써 상기 데이터 구동부에 제공하고, 홀딩 프레임(HOLDING FRAME) 동안 상기 제1 전압 레벨과 동일하거나, 상이한 전압 레벨을 갖는 전압을 생성하여 상기 유지 전압(Vsus)으로써 상기 픽셀에 제공할 수 있다. 홀딩 프레임(HOLDING FRAME) 동안 데이터 구동부에 전압이 공급되지 않으므로, 데이터 구동부가 동작하지 않을 수 있다.
또한, 구동 제어부는 유지 전압 인에이블 신호(Vsus_en)를 상기 픽셀에 제공할 수 있다. 도 6 및 도 7을 참조하면, 유지 전압 인에이블 신호(Vsus_en)는 홀딩 프레임(HOLDING FRAME) 동안 활성화되어 제8 스위칭 소자(T8)의 게이트 전극에 공급될 수 있다. 제8 스위칭 소자(T8)는 홀딩 프레임(HOLDING FRAME) 동안 유지 전압 인에이블 신호(Vsus_en)에 응답하여 턴온될 수 있다. 따라서, 홀딩 프레임(HOLDING FRAME) 동안 제8 스위칭 소자(T8)를 통해 유지 전압(Vsus)이 제8 스위칭 소자(T8)의 제1 전극에 공급될 수 있다.
도6의 픽셀에 있어서, 홀딩 프레임(HOLDING FRAME) 동안 제1 스위칭 소자(T1)와 연결되는 제2 스위칭 소자(T2)를 통해 누설 전류가 발생할 수 있다. 제2 스위칭 소자(T2)로 인해 발생하는 누설 전류로 인해 제1 스위칭 소자(T1)의 제1 전극의 전압이 변경되는 경우, 구동 전류가 변경되므로 픽셀(PX)의 휘도가 변경될 수 있다. 본 발명의 실시예들에 따른 표시 장치의 픽셀(PX)은 홀딩 프레임(HOLDING FRAME) 동안 제8 스위칭 소자(T8)를 통해 제2 스위칭 소자(T2)의 제1 전극에 유지 전압(Vsus)을 공급함으로써, 제2 스위칭 소자(T2)로 인한 누설 전류가 발생하는 것을 방지할 수 있다. 따라서, 상기 픽셀(PX)이 일정한 휘도로 발광할 수 있다.
상술한 바와 같이, 본 발명의 실시예들에 따른 표시 장치의 구동 제어부는 라이팅 프레임(WRITING FRAME) 동안 데이터 구동부에 아날로그 구동 전압(AVDD)을 제공하고, 홀딩 프레임(HOLDING FRAME) 동안 데이터 구동부에 아날로그 구동 전압(AVDD)을 제공하지 않음으로써, 홀딩 프레임(HOLDING FRAME) 동안 데이터 구동부가 동작하지 않도록 할 수 있다. 따라서, 홀딩 프레임(HOLDING FRAME) 동안 표시 장치의 소비 전력이 감소될 수 있다. 또한, 본 발명의 실시예들에 따른 표시 장치의 구동 제어부는 홀딩 프레임(HOLDING FRAME) 동안 픽셀(PX)에 유지 전압(Vsus)을 제공함으로써, 누설 전류로 인해 구동 전류가 변경되는 것을 방지할 수 있다.
도8은 도 1의 표시 장치를 포함하는 전자 기기를 나타내는 블록도이고, 도 9는 도 8의 전자 기기가 스마트폰으로 구현되는 일 예를 나타내는 도면이다.
도 8 및 도 9를 참조하면, 전자 기기(200)는 프로세서(210), 메모리 장치(220), 저장 장치(230), 입출력 장치(240), 파워 서플라이(250) 및 표시 장치(260)를 포함할 수 있다. 이 때, 표시 장치(260)는 도 1의 표시 장치(100)에 상응할 수 있다. 나아가, 전자 기기(200)는 비디오 카드, 사운드 카드, 메모리 카드, USB 장치 등과 통신하거나, 다른 시스템들과 통신할 수 있는 여러 포트(port)들을 더 포함할 수 있다. 한편, 도 9에 도시된 바와 같이, 전자 기기(200)는 스마트폰(300)으로 구현될 수 있으나, 전자 기기(200)가 그에 한정되는 것은 아니다.
프로세서(210)는 특정 계산들 또는 태스크(task)들을 수행할 수 있다. 일 실시예에서, 프로세서(210)는 마이크로프로세서(microprocessor), 중앙 처리 장치(CPU) 등일 수 있다. 프로세서(210)는 어드레스 버스(address bus), 제어 버스(control bus) 및 데이터 버스(data bus) 등을 통하여 다른 구성 요소들에 연결될 수 있다. 또한, 프로세서(210)는 주변 구성요소 상호연결(Peripheral Component Interconnect; PCI) 버스와 같은 확장 버스에도 연결될 수 있다. 메모리 장치(220)는 전자 기기(200)의 동작에 필요한 데이터들을 저장할 수 있다. 예를 들어, 메모리 장치(220)는 EPROM, EEPROM, 플래시 메모리, PRAM(Phase Change Random Access Memory), RRAM(Resistance Random Access Memory), MRAM(Magnetic Random Access Memory), FRAM(Ferroelectric Random Access Memory) 등과 같은 비휘발성 메모리 장치 및/또는 DRAM(Dynamic Random Access Memory), SRAM(Static Random Access Memory), 모바일 DRAM 등과 같은 휘발성 메모리 장치를 포함할 수 있다. 저장 장치(230)는 솔리드 스테이트 드라이브(Solid State Drive; SSD), 하드 디스크 드라이브(Hard Disk Drive; HDD), 씨디롬(CD-ROM) 등을 포함할 수 있다.
입출력 장치(240)는 키보드, 키패드, 터치패드, 터치스크린, 마우스 등과 같은 입력 수단 및 스피커, 프린터 등과 같은 출력 수단을 포함할 수 있다. 표시 장치(260)는 입출력 장치(240) 내에 구비될 수도 있다. 파워 서플라이(250)는 전자 기기(200)의 동작에 필요한 파워를 공급할 수 있다. 표시 장치(260)는 상기 버스들 또는 다른 통신 링크를 통해서 다른 구성 요소들에 연결될 수 있다.
상술한 바와 같이, 표시 장치(260)는 표시 패널, 게이트 구동부, 데이터 구동부, 발광 제어부 및 구동 제어부를 포함할 수 있다. 표시 패널은 복수의 픽셀들을 포함할 수 있다. 구동 제어부는 입력 영상 데이터 및 입력 제어 신호에 기초하여 게이트 구동부, 데이터 구동부 및 발광 제어부를 제어하는 제어 신호들을 생성할 수 있다. 게이트 구동부는 구동 제어부에서 공급되는 제1 제어 신호에 기초하여 게이트 신호를 생성하고, 표시 패널의 게이트 라인에 출력할 수 있다. 데이터 구동부는 구동 제어부에서 공급되는 제2 제어 신호에 기초하여 데이터 신호를 생성하고, 표시 패널의 데이터 라인에 출력할 수 있다. 발광 제어부는 구동 제어부에서 공급되는 제3 제어 신호에 기초하여 발광 제어 신호를 생성하고, 표시 패널의 발광 제어 라인에 출력할 수 있다.
구동 제어부는 입력 제어 신호에 기초하여 게이트 구동부의 동작을 제어하기 위한 제1 제어 신호를 생성할 수 있다. 예를 들어, 제1 제어 신호는 수직 개시 신호 및 게이트 클럭 신호를 포함할 수 있다. 본 발명의 실시예들에 따른 표시 패널은 저주파 구동 모드에서 픽셀에 데이터를 기입하는 라이팅 프레임과 픽셀에 기입된 데이터를 유지하는 홀딩 프레임에서 동작할 수 있다. 일 실시예에서, 구동 제어부는 홀딩 프레임 동안 직류 전압을 갖는 게이트 클럭 신호를 게이트 구동부에 제공함으로써, 표시 장치(260)의 소비 전력을 감소시킬 수 있다.
구동 제어부는 입력 제어 신호에 기초하여 데이터 구동부의 동작을 제어하기 위한 제2 제어 신호를 생성할 수 있다. 구동 제어부는 데이터 구동부를 동작시키기 위한 아날로그 구동 전압을 생성할 수 있다. 일 실시예에서, 본 발명의 실시예들에 따른 표시 장치(260)의 구동 제어부는 홀딩 프레임 동안 데이터 구동부를 동작시키지 않을 수 있다. 예를 들어, 구동 제어부는 라이팅 프레임 동안 제1 전압 레벨을 갖는 아날로그 구동 전압을 데이터 구동부에 제공하고, 홀딩 프레임 동안 제2 전압 레벨(예를 들어, 0V)을 갖는 아날로그 구동 전압을 데이터 구동부에 제공할 수 있다. 상기 데이터 구동부는 홀딩 프레임 동안 동작하지 않으므로, 표시 장치(260)의 소비 전력이 감소될 수 있다. 다른 실시예에서, 본 발명의 실시예들에 따른 표시 장치(260)의 구동 제어부는 라이팅 프레임 동안 제1 전압 레벨을 갖는 아날로그 구동 전압을 데이터 구동부에 제공하고, 홀딩 프레임 동안 제3 전압 레벨을 갖는 유지 전압을 픽셀에 제공할 수 있다. 상기 데이터 구동부는 홀딩 프레임 동안 아날로그 구동 전압을 제공받지 않으므로, 동작하지 않을 수 있다. 또한, 상기 픽셀은 홀딩 프레임 동안 유지 전압을 제공받음으로써, 구동 트랜지스터(제1 스위칭 소자)의 누설 전류가 발생하는 것을 방지할 수 있다. 따라서, 표시 장치(260)의 소비 전력이 감소하고, 표시 품질이 향상될 수 있다.
본 발명은 표시 장치를 구비한 모든 전자 기기에 적용될 수 있다. 예를 들어, 본 발명은 텔레비전, 컴퓨터 모니터, 노트북, 디지털 카메라, 휴대폰, 스마트폰, 스마트패드, 타블렛 PC, 피디에이(PDA), 피엠피(PMP), MP3 플레이어, 네비게이션, 비디오폰, 헤드 마운트 디스플레이(Head Mount Display; HMD) 장치 등에 적용될 수 있다.
이상에서는 본 발명의 예시적인 실시예들을 참조하여 설명하였지만, 해당 기술 분야에서 통상의 지식을 가진 자라면 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.
<부호의 설명>
100: 표시 장치 110: 표시 패널
120: 게이트 구동부 130: 데이터 구동부
140: 발광 제어부 150: 구동 제어부
200: 전자 기기 300: 스마트폰

Claims (20)

  1. 제1 타입의 스위칭 소자 및 상기 제1 타입과 상이한 제2 타입의 스위칭 소자를 포함하는 픽셀을 포함하는 표시 패널;
    게이트클럭 신호에 기초하여 게이트 신호를 생성하고, 상기 게이트 신호를 상기 표시 패널에 제공하는 게이트 구동부;
    데이터전압을 상기 표시 패널에 제공하는 데이터 구동부;
    발광 제어 신호를 상기 표시 패널에 제공하는 발광 제어부; 및
    상기 게이트 구동부, 상기 데이터 구동부 및 상기 발광 제어부를 제어하는 제어 신호들을 생성하는 구동 제어부를 포함하고,
    상기 구동 제어부는 저주파 구동 모드에서 상기 픽셀에 데이터를 기입하는 라이팅(writing) 프레임 동안 하이 레벨 및 로우 레벨 사이에서 스윙하는 상기 게이트 클럭 신호를 상기 게이트 구동부에 제공하고, 상기 픽셀에 기입된 데이터를 유지하는 홀딩(holing) 프레임 동안 직류 전압을 갖는 상기 게이트 클럭 신호를 상기 게이트 구동부에 제공하는 것을 특징으로 하는 표시 장치.
  2. 제1 항에 있어서, 상기 저주파 구동 모드에서 상기 게이트 클럭 신호는 상기 라이팅 프레임 동안 상기 하이 레벨 및 상기 로우 레벨 사이에서 스윙하고, 상기 홀딩 프레임 동안 상기 로우 레벨을 유지하는 것을 특징으로 하는 표시 장치.
  3. 제1 항에 있어서, 상기 저주파 구동 모드에서 상기 게이트 클럭 신호는 상기 라이팅 프레임 동안 상기 하이 레벨 및 상기 로우 레벨 사이에서 스윙하고, 상기 홀딩 프레임 동안 상기 하이 레벨을 유지하는 것을 특징으로 하는 표시 장치.
  4. 제1 항에 있어서, 상기 제1 타입의 스위칭 소자는 폴리 실리콘 박막 트랜지스터이고,
    상기 제2 타입의 스위칭 소자는 산화물 박막 트랜지스터인 것을 특징으로 하는 표시 장치.
  5. 제4 항에 있어서, 상기 제1 타입의 스위칭 소자는 P형 트랜지스터이고,
    상기 제2 타입의 스위칭 소자는 N형 트랜지스터인 것을 특징으로 하는 표시 장치.
  6. 제4 항에 있어서, 상기 픽셀은 제1 노드에 연결되는 게이트 전극, 제2 노드에 연결되는 제1 전극 및 제3 노드에 연결되는 제2 전극을 포함하는 제1 스위칭 소자;
    제1 데이터 기입 게이트 신호가 인가되는 게이트 전극, 상기 데이터 전압이 인가되는 제1 전극 및 상기 제2 노드에 연결되는 제2 전극을 포함하는 제2 스위칭 소자;
    제2 데이터 기입 게이트 신호가 인가되는 게이트 전극, 상기 제1 노드에 연결되는 제1 전극 및 상기 제3 노드에 연결되는 제2 노드를 포함하는 제3 스위칭 소자;
    데이터초기화 게이트 신호가 인가되는 게이트 전극, 초기화 전압이 인가되는 제1 전극 및 상기 제1 노드에 연결되는 제2 전극을 포함하는 제4 스위칭 소자;
    상기 발광 제어 신호가 인가되는 게이트 전극, 고전원 전압이 인가되는 제1 전극 및 상기 제2 노드에 연결되는 제2 전극을 포함하는 제5 스위칭 소자;
    상기 발광 제어 신호가 인가되는 게이트 전극, 상기 제3 노드에 연결되는 제1 전극 및 유기 발광 다이오드의 애노드 전극에 연결되는 제2 전극을 포함하는 제6 스위칭 소자;
    유기 발광 다이오드 초기화 게이트 신호가 인가되는 게이트 전극, 상기 초기화 전압이 인가되는 제1 전극 및 상기 유기 발광 다이오드의 상기 애노드 전극에 연결되는 제2 전극을 포함하는 제7 스위칭 소자;
    상기 고전원 전압이 인가되는 제1 전극 및 상기 제1 노드에 연결되는 제2 전극을 포함하는 스토리지 캐패시터; 및
    상기 애노드 전극 및 저전원 전압이 인가되는 캐소드 전극을 포함하는 상기 유기 발광 다이오드를 포함하는 것을 특징으로 하는 표시 장치.
  7. 제6 항에 있어서, 상기 제1 스위칭 소자, 상기 제2 스위칭 소자, 상기 제5 스위칭 소자 및 상기 제6 스위칭 소자는 상기 폴리 실리콘 박막 트랜지스터이고,
    상기 제3 스위칭 소자, 상기 제4 스위칭 소자 및 상기 제7 스위칭 소자는 상기 산화물 박막 트랜지스터인 것을 특징으로 하는 표시 장치.
  8. 제6 항에 있어서, 상기 저주파 구동 모드에서 상기 제2 스위칭 소자, 상기 제5 스위칭 소자 및 상기 제6 스위칭 소자를 제1 구동 주파수로 구동하고, 상기 제3 스위칭 소자를 제1 구동 주파수보다 낮은 제2 구동 주파수로 구동하는 것을 특징으로 하는 표시 장치.
  9. 제1 항에 있어서, 상기 구동 제어부는 상기 게이트 클럭 신호를 생성하는 게이트 제어부를 포함하는 것을 특징으로 하는 표시 장치.
  10. 제1 타입의 스위칭 소자 및 상기 제1 타입과 상이한 제2 타입의 스위칭 소자를 포함하는 픽셀을 포함하는 표시 패널;
    게이트신호를 상기 표시 패널에 제공하는 게이트 구동부;
    데이터전압을 상기 표시 패널에 제공하는 데이터 구동부;
    발광 제어 신호를 상기 표시 패널에 제공하는 발광 제어부; 및
    상기 게이트 구동부, 상기 데이터 구동부 및 상기 발광 제어부를 제어하는 제어 신호들을 생성하는 구동 제어부를 포함하고,
    상기 구동 제어부는 저주파 구동 모드에서 상기 픽셀에 데이터를 기입하는 라이팅(writing) 프레임 동안 상기 데이터 구동부를 동작시키는 아날로그 구동 전압을 상기 데이터 구동부에 제공하고, 상기 픽셀에 기입된 데이터를 유지하는 홀딩(holding) 프레임 동안 상기 데이터 구동부를 동작시키지 않는 상기 아날로그 구동 전압을 상기 데이터 구동부에 제공하는 것을 특징으로 하는 표시 장치.
  11. 제10 항에 있어서, 상기 저주파 구동 모드에서 상기 구동 제어부는 상기 라이팅 프레임 동안 제1 전압 레벨을 갖는 상기 아날로그 구동 전압을 상기 데이터 구동부에 제공하고, 상기 홀딩 프레임 동안 제1 전압 레벨보다 낮은 제2 전압 레벨을 갖는 상기 아날로그 구동 전압을 상기 데이터 구동부에 제공하는 것을 특징으로 하는 표시 장치.
  12. 제10 항에 있어서, 상기 제1 타입의 스위칭 소자는 폴리 실리콘 박막 트랜지스터이고,
    상기 제2 타입의 스위칭 소자는 산화물 박막 트랜지스터인 것을 특징으로 하는 표시 장치.
  13. 제12 항에 있어서, 상기 제1 타입의 스위칭 소자는 P형 트랜지스터이고,
    상기 제2 타입의 스위칭 소자는 N형 트랜지스터인 것을 특징으로 하는 표시 장치.
  14. 제12 항에 있어서, 상기 픽셀은 제1 노드에 연결되는 게이트 전극, 제2 노드에 연결되는 제1 전극 및 제3 노드에 연결되는 제2 전극을 포함하는 제1 스위칭 소자;
    제1 데이트 기입 게이트 신호가 인가되는 게이트 전극, 상기 데이터 전압이 인가되는 제1 전극 및 상기 제2 노드에 연결되는 제2 전극을 포함하는 제2 스위칭 소자;
    제2 데이터 기입 게이트 신호가 인가되는 게이트 전극, 상기 제1 노드에 연결되는 제1 전극 및 상기 제3 노드에 연결되는 제2 노드를 포함하는 제3 스위칭 소자;
    데이터초기화 게이트 신호가 인가되는 게이트 전극, 초기화 전압이 인가되는 제1 전극 및 상기 제1 노드에 연결되는 제2 전극을 포함하는 제4 스위칭 소자;
    상기 발광 제어 신호가 인가되는 게이트 전극, 고전원 전압이 인가되는 제1 전극 및 상기 제2 노드에 연결되는 제2 전극을 포함하는 제5 스위칭 소자;
    상기 발광 제어 신호가 인가되는 게이트 전극, 상기 제3 노드에 연결되는 제1 전극 및 유기 발광 다이오드의 애노드 전극에 연결되는 제2 전극을 포함하는 제6 스위칭 소자;
    유기 발광 다이오드 초기화 게이트 신호가 인가되는 게이트 전극, 상기 초기화 전압이 인가되는 제1 전극 및 상기 유기 발광 다이오드의 상기 애노드 전극에 연결되는 제2 전극을 포함하는 제7 스위칭 소자;
    상기 고전원 전압이 인가되는 제1 전극 및 상기 제1 노드에 연결되는 제2 전극을 포함하는 스토리지 캐패시터; 및
    상기 애노드 전극 및 저전원 전압이 인가되는 캐소드 전극을 포함하는 상기 유기 발광 다이오드를 포함하는 것을 특징으로 하는 표시 장치.
  15. 제14 항에 있어서, 상기 제1 스위칭 소자, 상기 제2 스위칭 소자, 상기 제5 스위칭 소자 및 상기 제6 스위칭 소자는 상기 폴리 실리콘 박막 트랜지스터이고,
    상기 제3 스위칭 소자, 상기 제4 스위칭 소자 및 상기 제7 스위칭 소자는 상기 산화물 박막 트랜지스터인 것을 특징으로 하는 표시 장치.
  16. 제14 항에 있어서, 상기 저주파 구동 모드에서 상기 제2 스위칭 소자, 상기 제5 스위칭 소자 및 상기 제6 스위칭 소자를 제1 구동 주파수로 구동하고, 상기 제3 스위칭 소자를 제1 구동 주파수보다 낮은 제2 구동 주파수로 구동하는 것을 특징으로 하는 표시 장치.
  17. 제14 항에 있어서, 상기 픽셀은
    유지 전압 인에이블 신호가 인가되는 게이트 전극, 유지 전압이 인가되는 제1 전극 및 상기 제2 스위칭 소자의 상기 제1 전극과 연결되는 제2 전극을 포함하는 제8 스위칭 소자를 더 포함하는 것을 특징으로 하는 표시 장치.
  18. 제17 항에 있어서, 상기 저주파 구동 모드에서 상기 구동 제어부는 상기 라이팅 프레임 동안 아날로그 구동 전압을 상기 데이터 구동부에 제공하고, 상기 홀딩 프레임 동안 유지 전압을 상기 픽셀에 제공하는 것을 특징으로 하는 표시 장치.
  19. 제18 항에 있어서, 상기 제8 스위칭 소자는 상기 폴리 실리콘 박막 트랜지스터인 것을 특징으로 하는 표시 장치.
  20. 제10 항에 있어서, 상기 구동 제어부는 상기 데이터 구동부 및 상기 픽셀에 제공되는 전압을 생성하는 전압 생성부를 포함하는 것을 특징으로 하는 표시 장치.
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