CN114255707A - 显示驱动电路及使用该显示驱动电路的显示装置 - Google Patents

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Abstract

显示驱动电路及使用该显示驱动电路的显示装置。公开了一种使用可变刷新率(VRR)模式的电致发光显示装置。本公开的目的是减少在刷新率改变的时间点出现亮度差异，从而防止观察者感知到刷新率的改变。

Description

显示驱动电路及使用该显示驱动电路的显示装置
技术领域
本公开涉及使用可变刷新率(VRR)模式的电致发光显示装置，并且被设计为减少在更新数据电压的刷新率改变的时间点处出现亮度差异。
背景技术
可以按照各种驱动频率来驱动使用诸如有机发光二极管之类的电致发光装置的电致发光显示装置。
最近，作为显示装置所需的各种功能之一，还需要可变刷新率(VRR)。VRR是一种以恒定频率驱动显示装置并在需要高速驱动时通过提高刷新率来激活像素并且在必须降低功耗或需要低速驱动时通过降低刷新率来驱动像素的技术。
当根据VRR而更新数据电压的刷新率改变时，观看者可能不自然地感知刷新率的变化。因此，需要防止观看者感知刷新率的改变。
发明内容
技术问题
本公开涉及一种使用可变刷新率(VRR)模式的电致发光显示装置，并且本公开的目的是减少在刷新率改变的时间点出现亮度差异，从而防止观众感知到刷新率的改变。
本公开提供了解决上述问题的手段，并具有以下实施方式。
技术方案
一个实施方式是一种显示装置，该显示装置包括：标志单元，其输出用于区分刷新率的标志值；计数器，其根据标志值对刷新帧和保持帧进行计数并累加计数值；第一寄存器单元，其包括多个寄存器，该多个寄存器分别储存调整后的偏置电压值；第二寄存器单元，其包括多个寄存器，该多个寄存器分别存储用于生成发光控制信号的发光信号值；以及比较器，其输出比较值，使得第一寄存器单元根据标志值和计数值选择调整后的偏置电压值，并选择发光信号值。显示装置被驱动以根据比较值调整发光信号的脉冲宽度或偏置电压。
另一实施方式是显示驱动器。根据图像以帧为单位改变刷新率。帧被区分为用于写入数据电压的刷新帧和用于维持写入刷新帧中的数据电压的保持帧。根据刷新率以刷新帧和保持帧为单位对帧进行计数，并累加计数值。在刷新率切换的时间点前后调整并施加偏置电压。根据计数值在刷新率切换的时间点前后调整发光信号的脉冲宽度。
附图说明
附图被包括进来以提供对本发明的进一步理解并且被并入并构成本说明书的一部分，附图例示了本发明的实施方式，并且与描述一起用于解释本发明的原理。在附图中：
图1是示意性地示出了根据本发明实施方式的电致发光显示装置的框图；
图2A至图2C是根据本发明实施方式的电致发光显示装置的像素电路的示例性电路图；
图3A至图3K是用于描述图2A、图2B和图2C所示的显示装置的像素电路中的刷新帧的像素电路和电致发光装置的驱动的图；
图4A至图4C是用于描述图2A、图2B和图2C所示的显示装置的像素电路中的保持帧的像素电路和电致发光装置的驱动的图；
图5是用于描述在使用VRR模式时刷新率从60Hz切换为1Hz时出现亮度差异的问题的图；
图6A至图6D示出了用于生成偏置电压的电路的框图和用于生成发光信号的电路的框图；
图7是用于描述用于亮度偏差补偿驱动的第一方法的图；
图8是用于描述用于亮度偏差补偿驱动的第二方法的图；以及
图9是用于描述用于亮度偏差补偿驱动的第三方法的图。
具体实施方式
通过参照以下描述的详细实施方式以及附图，实现本发明的特征、优点和方法将更加清楚。然而，本发明不限于下面要公开的实施方式，而是以不同的和各种形式来实现。实施方式构成本发明的完整公开，并且仅仅是为了使本领域的技术人员充分理解本发明的范围。本发明仅由所附权利要求的范围来限定。贯穿本公开的相同附图标记对应于相同元件。
一个组件被称为“连接至”或“联接至”另一组件的情况包括一个组件直接连接或联接至另一组件的情况以及又一组件介于它们之间的情况二者。同时，一个组件被称为“直接连接至”或“直接联接至”另一组件的情况表示没有又一组件介于它们之间。术语“和/或”包括每个所提及的项目以及他们的一个或更多个所有组合。
本说明书中使用的术语是为了描述本发明的仅具体实施方式而提供的，并非旨在进行限制。在本说明书中，如果没有特别提及，单数形式的表述包括其复数形式的表述。说明书中使用的术语“包括”和/或“包含”旨在指明说明书中提到的特征、数量、步骤、操作、组件、部分或它们的任何组合，并不旨在排除至少另一个特征、数量、步骤、操作、组件、部分或它们的任何组合的存在或添加。
虽然诸如第一和第二等的术语可以用于描述各种组件，但组件不受上述术语的限制。这些术语仅用于在一个组件和其他组件之间进行区分。
因此，在本发明的精神内，下面要描述的第一组件可以是第二组件。除非另有定义，否则本文所用的、包括技术和科学术语的所有术语具有与本发明所属领域的普通技术人员通常理解的含义相同的含义。而且，只要在本申请中没有明确和具体地定义，就不应理想地或过度地解释字典中定义的常用术语。
本说明书中使用的术语“模块”或“部分”可以表示诸如现场可编程门阵列(FPGA)、专用集成电路(ASIC)的软件组件或硬件组件。“部分”或“模块”执行一些功能。然而，“部分”或“模块”并非表示限于软件或硬件。“部分”或“模块”可以被配置为放置在可寻址存储介质中或恢复一个或更多个处理器。因此，作为一个示例，“部分”或“模块”可以包括诸如软件组件、面向对象的软件组件、类组件和任务组件之类的组件，并且可以包括处理、功能、属性、过程、子例程、程序代码段、驱动器、固件、微代码、电路、数据、数据库、数据结构、表、数组和变量。“部分”或“模块”中提供的组件和功能可以与较少数量的组件和“部分”或“模块”组合在一起，或者可以进一步划分为附加组件和“部分”或“模块”。
关于本公开的一些实施方式所描述的方法或算法步骤可以直接由处理器执行的硬件和软件模块实现，也可以直接由其组合实现。软件模块可以驻留在RAM、闪存、ROM、EPROM、EEPROM、电阻器、硬盘、可移动盘、CD-ROM或本领域技术人员已知的任何其他类型的记录介质上。示例性记录介质联接至处理器并且处理器可以从记录介质读取信息并且可以将信息记录在存储介质中。在另一种方式中，记录介质可以与处理器一体形成。处理器和记录介质可以驻留在专用集成电路(ASIC)内。ASIC可以驻留在用户的终端内。
图1是示意性示出了根据本发明实施方式的电致发光显示装置的框图。
参照图1，电致发光显示装置100包括具有多个像素的显示面板110、向多个像素中的每一个提供选通信号的选通驱动器130、及向多个像素中的每一个提供数据信号的数据驱动器140、以及向多个像素中的每一个提供发光信号的有源控制信号发生器150和定时控制器120。
定时控制器120针对显示面板110的尺寸和分辨率适当地处理从外部输入的图像数据RGB，并将其提供给数据驱动器140。定时控制器120通过使用从外部输入的同步信号SYNC(例如，点时钟信号CLK、数据启用信号DE、水平同步信号Hsync和垂直同步信号Vsync)生成多个选通控制信号GCS、多个数据控制信号DCS和多个发光控制信号ECS。通过将所生成的多个选通控制信号GCS、数据控制信号DCS和发光控制信号ECS分别提供给选通驱动器130、数据驱动器140和发光信号发生器150，定时控制器120控制选通驱动器130、数据驱动器140和发光信号发生器150。
根据所安装的装置，定时控制器120可以联接至各种处理器，例如，微处理器、移动处理器、应用处理器等。
定时控制器120生成信号，使得可以以各种刷新率驱动像素。也就是说，定时控制器120生成与驱动相关的信号，使得以可变刷新率VRR模式驱动像素或在第一刷新率和第二刷新率之间可切换地驱动像素。例如，定时控制器120简单地改变时钟信号的速度，生成同步信号以生成水平消隐或垂直消隐，或以掩模方法驱动选通驱动器130，从而以各种刷新率驱动像素。
而且，定时控制器120生成用于以第一刷新率驱动像素驱动电路的各种信号。具体地，当以第一刷新率驱动像素驱动电路时，定时控制器120生成发光控制信号ECS使得发光信号发生器150生成具有第一占空比的发光信号EM。然后，定时控制器120操作以第二刷新率驱动像素驱动电路，并且为此生成用于以第二刷新率进行驱动的各种信号。具体而言，当以第二刷新率驱动像素驱动电路时，发光信号发生器150生成发光控制信号ECS使得发光信号发生器150生成具有与第一占空比不同的第二占空比的发光信号EM。
选通驱动器130根据从定时控制器120提供的选通控制信号GCS向选通线GL提供扫描信号SC。在图1中，选通驱动器130被示出为与显示面板110的一侧分开布置。然而，选通驱动器130的数量和布置位置不限于此。也就是说，选通驱动器130可以以面板内栅极(GIP)方法设置在显示面板110的一侧或两侧上。
数据驱动器140根据从定时控制器120提供的数据控制信号DCS将图像数据RGB转换为数据电压Vdata，并通过数据线DL将转换后的数据电压Vdata提供给像素。
在显示面板110中，多条选通线GL、多条发光线EL以及多条数据线DL彼此交叉，并且多个像素中的每一个连接至选通线GL、发光线EL和数据线DL。具体地，一个像素通过选通线GL从选通驱动器130接收选通信号，通过数据线DL从数据驱动器140接收数据信号，通过发光线EL接收发光信号EM，以及通过电源线接收各种电力。这里，选通线GL提供扫描信号SC，发光线EL提供发光信号EM，而数据线DL提供数据电压Vdata。然而，根据各种实施方式，选通线GL可以包括多条扫描信号线，并且数据线DL还可以包括多条电源线VL。而且，发光线EL还可以包括多条发光信号线。而且，一个像素接收高电位电压ELVDD和低电位电压ELVSS。而且，一个像素可以通过多条电源线VL接收第一偏置电压V1和第二偏置电压V2。
另外，每个像素包括电致发光装置和控制电致发光装置的驱动的像素驱动电路。此处，电致发光装置包括阳极、阴极和位于阳极和阴极之间的有机发光层。像素驱动电路包括多个开关元件、驱动开关元件和电容器。这里，开关元件可以由TFT构成。在像素驱动电路中，驱动TFT根据参考电压和被充入电容器中的数据电压之间的差来控制提供给电致发光装置的电流量，并控制电致发光装置的发光量。而且，多个开关TFT接收通过选通线GL提供的扫描信号SC和通过发光线EL提供的发光信号EM，并且在电容器中充入数据电压Vdata。
根据本发明实施方式的电致发光显示装置100包括用于驱动包括多个像素的显示面板110的选通驱动器130、数据驱动器140和发光信号发生器150，以及用于控制它们的定时控制器120。这里，发光信号发生器150被配置为能够控制发光信号EM的占空比。例如，发光信号发生器150可以包括用于控制发光信号EM的占空比的移位寄存器、锁存器等。发光信号发生器150可以被配置为根据由定时控制器120生成的发光控制信号ECS在以第一刷新率驱动像素驱动电路时，生成具有第一占空比的发光信号并将其提供给像素驱动电路，并且可以被配置为在以第二刷新率驱动像素驱动电路时，生成具有不同于第一占空比的第二占空比的发光信号并将其提供给像素驱动电路。
图2A、图2B和图2C是根据本发明实施方式的电致发光显示装置的像素电路的电路图。
图2A、图2B和图2C仅示例性地示出了像素驱动电路以进行描述，只要像素驱动电路具有被提供有发光信号EM并且能够控制电致发光装置ELD的发光的结构就没有限制。例如，像素驱动电路可以包括附加扫描信号、连接至扫描信号的开关TFT、和被施加附加初始化电压的开关TFT。而且，开关元件之间的连接关系或电容器的连接位置可以以各种方式来布置。也就是说，由于根据发光信号EM的占空比的改变来控制电致发光装置ELD的发光，因此只要能够根据刷新率来控制发光，就可以使用具有各种结构的像素驱动电路。例如，可以使用诸如3T1C、4T1C、6T1C、7T1C、7T2C等各种像素驱动电路。在下文中，为了便于描述，将描述具有图2A、图2B和图2C的7T1C的像素驱动电路的电致发光显示装置。
参照图2A，多个像素P中的每一个可以包括具有驱动晶体管DT的像素电路PC、以及连接至像素电路PC的电致发光装置ELD。
像素电路PC可以通过控制流过电致发光装置ELD的驱动电流Id来驱动电致发光装置ELD。像素电路PC可以包括驱动晶体管DT、第一晶体管T1至第六晶体管T6、以及存储电容器Cst。晶体管DT和T1至T6中的每一个可以包括第一电极、第二电极和栅极。第一电极和第二电极中的一个可以是源极，并且第一电极和第二电极中的另一个可以是漏极。
晶体管DT和T1至T6中的每一个可以是PMOS晶体管或NMOS晶体管。在图2A和图2B的实施方式中，第一晶体管T1是NMOS晶体管，并且其他晶体管DT和T2至T6是PMOS晶体管。此外，在图2C的实施方式中，第一晶体管T1也由PMOS晶体管构成。
在下文中，将描述第一晶体管T1为NMOS晶体管并且其他晶体管DT和T2至T6为PMOS晶体管的情况，作为示例。因此，第一晶体管T1通过被施加高电压而导通，而其他晶体管DT和T2至T6通过被施加低电压而导通。
根据示例，构成像素电路PC的第一晶体管T1可以起到补偿晶体管的作用，第二晶体管T2可以起到数据提供晶体管的作用，第三晶体管T3和第四晶体管T4可以起到发光控制晶体管的作用，并且第五晶体管T5和第六晶体管T6可以起到偏置晶体管的作用。
电致发光装置ELD可以包括像素电极(或阳极电极)和阴极电极。电致发光装置ELD的像素电极可以连接至第五节点N5，并且阴极电极可以连接至第二电源电压ELVSS。
驱动晶体管DT可以包括连接至第二节点N2的第一电极、连接至第三节点N3的第二电极、和连接至第一节点N1的栅极。驱动晶体管DT可以基于第一节点N1的电压(或稍后描述的电容器Cst中所存储的数据电压)向电致发光装置ELD提供驱动电流Id。
第一晶体管T1可以包括连接至第一节点N1的第一电极、连接至第三节点N3的第二电极、和接收第一扫描信号SC1的栅极。第一晶体管T1可以响应于第一扫描信号SC1而导通并且可以将数据信号Vdata发送给第一节点N1。第一晶体管T1以二极管方式连接在第一节点N1和第三节点N3之间，从而对驱动晶体管DT的阈值电压Vth进行采样。第一晶体管T1可以是补偿晶体管。
电容器Cst可以连接或形成在第一节点N1和第四节点N4之间。电容器Cst可以存储或维持所提供的数据信号Vdata。
第二晶体管T2可以包括连接至数据线DL(或接收数据信号Vdata)的第一电极、连接至第二节点N2的第二电极、以及接收第三扫描信号SC3的栅极。第二晶体管T2可以响应于第三扫描信号SC3而导通并且可以将数据信号Vdata发送给第二节点N2。第二晶体管T2可以是数据提供晶体管。
第三晶体管T3和第四晶体管T4(或第一发光控制晶体管和第二发光控制晶体管)可以连接在第一电源电压ELVDD和电致发光装置ELD之间，并且可以形成由驱动晶体管DT生成的驱动电流Id移动所通过的电流移动路径。
第三晶体管T3可以包括连接至第四节点N4并接收第一电源电压ELVDD的第一电极、连接至第二节点N2的第二电极、和接收发光控制信号ECS的栅极。
类似地，第四晶体管T4可以包括连接第三节点N3的第一电极、连接第四节点N4的第二电极(或电致发光装置ELD的像素电极)和接收发光控制信号ECS的栅极。
第三晶体管T3和第四晶体管T4响应于发光控制信号ECS而导通。在这种情况下，驱动电流Id被提供给电致发光装置ELD，并且电致发光装置ELD可以发射亮度对应于驱动电流Id的光。
第五晶体管T5包括连接第三节点N3的第一电极、接收第一偏置电压V1的第二电极以及接收第二扫描信号SC2的栅极。
第六晶体管T6可以包括连接至第五节点N5的第一电极、接收第二偏置电压V2的第二电极、和接收第二扫描信号SC2的栅极。在图2A中，第五晶体管T5和第六晶体管T6的栅极被配置为共同接收第二扫描信号SC2。然而，本发明不一定限于此，并且如图2B和图2C所示，第五晶体管T5和第六晶体管T6的栅极可以被配置为分别接收单独的扫描信号并且被独立地控制。
第六晶体管T6可以包括连接至第五节点N5的第一电极、连接至第二偏置电压V2的第二电极/和接收第二扫描信号SC2的栅极。在电致发光装置ELD发光之前(或在电致发光装置ELD发光之后)，第六晶体管T6可以响应于第二扫描信号SC2而导通并且可以通过使用第二偏置电压V2初始化电致发光装置ELD的像素电极(或阳极电极)。电致发光装置ELD可以具有形成于像素电极和阴极电极之间的寄生电容器。而且，在电致发光装置ELD发光的同时，寄生电容器被充电，使得电致发光装置ELD的像素电极可以具有特定电压。因此，通过经由第六晶体管T6向电致发光装置ELD的像素电极施加第二偏置电压V2，能够初始化电致发光装置ELD中累加的电荷量。
本公开涉及使用可变刷新率(VRR)模式的电致发光显示装置。VRR是这样一种技术，该技术以恒定频率驱动显示装置并在需要高速驱动时通过增加更新数据电压Vdata的刷新率来激活像素，并且在必须降低功耗或需要低速驱动时通过降低刷新率来驱动像素。
可以在一秒内通过刷新帧和保持帧的组合来驱动多个像素P中的每一个。在本说明书中，一个设置被定义为重复更新数据电压Vdata的刷新帧。此外，一个设置时段(oneset period)是重复更新数据电压Vdata的刷新帧的周期。
当以120Hz刷新率驱动像素时，仅由刷新帧来驱动像素。也就是说，能够在一秒内驱动刷新帧120次。一个刷新帧时段为1/120＝8.33ms，并且一个设置时段也是8.33ms。
当以60Hz刷新率驱动像素时，可以交替驱动刷新帧和保持帧。也就是说，刷新帧和保持帧可以在一秒内被交替驱动60次。一个刷新帧时段和一个保持帧时段分别为0.5/60＝8.33ms，并且一个设置时段为16.66ms。
当以1Hz的刷新率驱动像素时，可以用一个刷新帧和一个刷新帧之后的119个保持帧来驱动一个帧。一个刷新帧时段和一个保持帧时段分别为1/120＝8.33ms，并且一个设置时段为1s。
图3A至图3K是用于描述图2A、图2B和图2C所示的显示装置的像素电路中的刷新帧和电致发光装置的驱动的图。
图4A至图4C是用于描述图2A、图2B和图2C所示的显示装置的像素电路中的保持帧的像素电路和电致发光装置的驱动的图。
在刷新帧中，新的数据信号Vdata被充电并施加至驱动晶体管DT的栅极，而在保持帧中，维持并使用前一帧的数据信号Vdata。同时，保持帧也被称为跳过帧，其中省略了将新的数据信号Vdata施加到驱动晶体管DT的栅极的过程。
多个像素P中的每一个可以初始化在刷新时段期间被充电或保留在像素电路PC中的电压。具体地，在刷新帧中，多个像素P中的每一个可以去除在前一帧中所存储的数据电压Vdata和驱动电压VDD的影响。因此，在保持时段中，多个像素P中的每一个可以显示与新的数据电压Vdata相对应的图像。
多个像素P中的每一个可以通过在保持帧时段期间向电致发光装置ELD提供与数据电压Vdata相对应的驱动电流Id来显示图像，并且可以维持电致发光装置ELD的接通状态。
首先，将参照图3A至图3K描述刷新帧的像素电路和电致发光装置的驱动。刷新帧可以操作包括至少一个偏置区段、初始化区段、采样区段和发光区段。然而，这仅是实施方式，并且不一定限于该顺序。
图3A至图3C示出了第一偏置区段。
在图3A中，示出了第一偏置电压V1从第一电压变化到第二电压的区段。发光控制信号ECS代表高电压，并且第三四晶体管T3和第四晶体管T4截止。第一电压表示为V1_L，并且第二电压表示为V1_H。V1_H高于V1_L，并且优选的是V1_H高于数据电压Vdata。第一扫描信号SC1为低电压且第一晶体管T1截止。第二扫描信号SC2和第三扫描信号SC3为高电压，并且第二晶体管T2、第五晶体管T5和第六晶体管T6截止。连接至第一节点N1的驱动晶体管DT的栅极的电压为Vdata(n-1)-|Vth|，也就是说，前一帧n-1的数据电压Vdata(n-1)与驱动晶体管DT的阈值电压Vth的差值。
在图3B中，输入低的第二扫描信号SC2，并且第五晶体管T5和第六晶体管T6导通。随着第五晶体管T5导通，第一偏置电压V1(V1_H)被施加到连接至第二节点N2的驱动晶体管DT的第一电极。连接至第二节点N2的驱动晶体管DT的第一电极的电压增加到电压V1_H。驱动晶体管DT可以是PMOS晶体管，并且在此情况下，第一电极可以是源极。这里，驱动晶体管DT的栅极和源极之间的电压Vgs为
Vgs＝Vdata(n-1)-|Vth|-V1_H。
在此，第一偏置电压V1＝V1_H被提供给第三节点N3(即，驱动晶体管DT的漏极)，使得在发光区段中能够减小(作为电致发光装置ELD的阳极电极的)第五节点N5的电压的充电时间或充电延迟。驱动晶体管DT维持更强的饱和。例如，随着第一偏置电压V1＝V1_H的增加，作为驱动晶体管DT的漏极的第三节点N3的电压可以增加，并且驱动晶体管DT的栅源电压或漏源电压可以减小。因此，优选的是第一偏置电压V1_H至少高于数据电压Vdata。在此，可以减小经过驱动晶体管DT的漏源电流Id的大小，并且在正偏置应力的情况下使驱动晶体管DT的应力减小，从而消除第三节点N3的电压的充电延迟。换言之，在对驱动晶体管DT的阈值电压Vth进行采样之前，驱动晶体管DT的Vgs被偏置到Vdata，从而能够减小驱动晶体管DT的滞后。因此，导通偏置应力可以被定义为在非发光时段期间直接向驱动晶体管DT施加合适的偏置电压(例如，V1＝V1_H)的操作。
而且，随着第六晶体管T6在第一偏置电压区段导通，连接至第五节点N5的电致发光装置ELD的像素电极(或阳极电极)被初始化为第二偏置电压V2。然而，第五晶体管T5和第六晶体管T6的栅极可以被配置为分别接收单独的扫描信号并且被独立地控制。也就是说，不一定需要在第一偏置区段中同时向驱动晶体管DT的源极和电致发光装置ELD的像素电极施加偏置电压。
在图3C中，输入高的第二扫描信号SC2，并且第一偏置电压V1从V1_H改变为V1_L。随着输入高的第二扫描信号SC2，第五晶体管T5和第六晶体管T6截止。
图3D示出了初始化区段。在初始化区段中，驱动晶体管DT的栅极的电压被初始化。
在图3D中，第一扫描信号SC1代表高电压，并且第一晶体管T1导通。第二扫描信号SC2代表低电压，并且第五晶体管T5和第六晶体管T6导通。随着第一晶体管T1和第五晶体管T5导通，连接至第一节点N1的驱动晶体管DT的栅极的电压被初始化为电压V1_L。而且，随着第六晶体管T6导通，电致发光装置ELD的像素电极(或阳极电极)被初始化为第二偏置电压V2。然而，如上所述，第五晶体管T5和第六晶体管T6的栅极可以被配置为分别接收单独的扫描信号并且被独立地控制。也就是说，不一定需要在第一偏置区段中同时向驱动晶体管DT的源极和电致发光装置ELD的像素电极施加偏置电压。
图3E至图3G示出了采样区段。在采样区段中，驱动晶体管DT的阈值电压Vth和数据电压被采样并存储在第一节点N1处。
在图3E中，输入高的第二扫描信号SC2，并且第五晶体管T5和第六晶体管T6截止。第一晶体管T1维持导通状态。
在图3F中，输入低的第三扫描信号SC3，并且第二晶体管T2导通。随着第二晶体管T2导通，当前帧n的电压Vdata(n)被施加到连接至第二节点N2的驱动晶体管DT的源极。而且，第一晶体管T1维持导通状态。由于在第一晶体管T1导通的状态下，驱动晶体管DT以二极管方式连接，所以连接至第一节点N1的驱动晶体管DT的栅极的电压为Vdata(n)-|Vth|。也就是说，第一晶体管T1以二极管方式连接在第一节点N1和第三节点N3之间，从而对驱动晶体管DT的阈值电压Vth进行采样。
在图3G中，输入高的第三扫描信号SC3，并且第二晶体管T2截止。
图3H至图3J示出了第二偏置区段。
由于第二偏置区段中的驱动波形与第一偏置区段的驱动波形相同，因此将省略其详细描述。
在图3H中，第一偏置电压V1从V1_L改变为V1_H。
在图3I中，随着第五晶体管T5导通，连接至第二节点N2的驱动晶体管DT的第一电极的电压增加至电压V1_H。这里，驱动晶体管DT的栅极和源极之间的电压Vgs为Vgs＝Vdata(n)-|Vth|-V1_H。也就是说，驱动晶体管DT维持更强的饱和。而且，随着第六晶体管T6导通，电致发光装置ELD的像素电极(或阳极电极)被初始化为第二偏置电压V2。连接至第一节点N1的驱动晶体管DT的栅极的电压维持Vdata(n)-|Vth|。
在图3J中，输入高电平的第二扫描信号SC2，第一偏置电压V1由V1_H变为V1_L。当输入高电平的第二扫描信号SC2时，第五晶体管T5和第六晶体管T6截止。连接至第一节点N1的驱动晶体管DT的栅极的电压维持Vdata(n)-|Vth|。
图3K示出了发光区段。在发光区段中，采样的阈值电压Vth被取消，并且使得电致发光装置ELD以与采样的数据电压相对应的驱动电流发光。
在图3K中，发光控制信号ECS代表低电压，并且第三四晶体管T3和第四晶体管T4导通。
随着第三晶体管T3导通，连接至第四节点N4的第一电源电压ELVDD通过第三晶体管T3施加到连接至第二节点N2的驱动晶体管DT的源极。由驱动晶体管DT经由第四晶体管T4提供给电致发光装置ELD的驱动电流Id变得与驱动晶体管DT的阈值电压Vth的值无关，从而补偿并且操作驱动晶体管DT的阈值电压Vth。
接下来，将参照图4A至图4C描述保持帧的像素电路和电致发光装置的驱动。保持帧可以包括至少一个偏置区段和发光区段。
如上所述，刷新帧和保持帧的不同之处在于，在刷新帧中，新的数据信号Vdata被充电并施加到驱动晶体管DT的栅极；在保持帧中，维持并使用前一帧的数据信号Vdata。因此，与刷新帧不同，保持帧不需要初始化区段和采样时段。
图4A和图4B示出了第一偏置区段和第二偏置区段，而图4C示出了发光区段。
在保持帧的操作中，甚至一个偏置时段可能就足够了。然而，在本实施方式中，为了驱动电路方便，第二扫描信号SC2与刷新帧的第二扫描信号SC2以相同的方式来驱动，因此存在两个偏置区段。
参照图3A至图3K描述的刷新帧中的驱动信号和图4A至图4C中保持帧的中的驱动信号由于第一扫描信号SC1和第三扫描信号SC3而不同。在保持帧的中不需要初始化区段和采样区段。因此，不同于刷新帧，第一扫描信号SC1总是处于低状态，而第三扫描信号SC3总是处于高状态。也就是说，第一晶体管T1和第二晶体管T2始终截止。
图5是用于描述在使用VRR模式时刷新率从60Hz切换到1Hz时出现亮度差异的问题的图。
图5中的(a)示出了刷新率为60Hz的情况，并且图5中的(b)示出了刷新率为1Hz的情况。每种情况的刷新帧时段和保持帧时段分别为1/120秒(＝8.33ms)。当以60Hz的刷新率驱动像素时，一个设置时段为1/60秒(＝16.66ms)，并且当以1Hz的刷新率驱动像素时，一个设置时段为1秒(＝1s)。
如图5中的(a)所示，当以60Hz的刷新率驱动像素时，可以交替驱动刷新帧和保持帧。因此，在保持帧中施加的偏置电压可以通过刷新帧的初始化区段被重置而不被累加。
然而，如图5中的(b)所示，当以1Hz的刷新率驱动像素时，刷新帧连续跟随保持帧。因此，在保持帧中施加的偏置电压被累加，作为驱动晶体管DT的应力电压。随着偏置电压被施加到驱动晶体管DT的次数增加，驱动晶体管DT的电荷增加，然后驱动晶体管DT饱和。也就是说，当以60Hz和1Hz驱动像素时，驱动晶体管DT的特性改变，导致亮度差异。
驱动晶体管DT在60Hz驱动和1Hz驱动之间的特性差异是由一个设置内偏置应力的量的差异而引起的。也就是说，当以60Hz的刷新率驱动像素时，一个设置内存在一个保持帧，使得偏置应力为1倍；当以1Hz的刷新率驱动像素时，一个设置内存在119个保持帧，使得偏置应力为119倍。因此，出现偏置应力的量的差异。结果，驱动晶体管DT的特性改变并且出现亮度差异。换言之，当通过将刷新率从高刷新率(例如，60Hz)改变为低刷新率(例如，1Hz)来驱动像素时，出现驱动晶体管DT的偏置应力的量的差异，并且这使得驱动晶体管DT的特性发生改变，从而使驱动电流Id的大小减小。结果，当通过将刷新率从高刷新率改变为低刷新率来驱动像素时，电致发光装置ELD的亮度由于驱动电流Id的减小而减小。这在刷新率改变的时间点被观众感知为闪烁。
在本发明提供的显示装置中，可以通过从第一刷新率RR1切换到刷新率低于第一刷新率RR1的第二刷新率RR2来驱动像素电路。
图6A是用于生成第一偏置电压或第二偏置电压的电路的框图，并且图6B是用于生成发光信号的电路的框图。图6C和图6D详细示出了根据刷新率对帧进行计数并且将选择信号发送到MUX的电路块。
参照图6A至图6D，标志单元210可以包括输出每个区段的刷新率的标志值的第一标志211和第二标志212。
第一标志211和第二标志212根据施加至像素的驱动的刷新率输出逻辑高电压或逻辑低电压。例如，当第一标志211输出用于60Hz的频率驱动的第一标志值，并且第二标志212输出用于1Hz的频率驱动的第二标志值时，施加至驱动的刷新率为60Hz，第一标志211可以输出逻辑高电压，并且第二标志212可以输出逻辑低电压。相反，当施加至驱动的刷新率为1Hz时，第一标志211可以输出逻辑低电压并且第二标志212可以输出逻辑高电压。
计数器220基于从标志单元210输出的标志值针对每个刷新率通过在刷新帧和保持帧之间进行区分来进行计数，从而在每个帧的驱动定时之间进行区分并输出累加的计数值。
参照图6C至图6D，计数器220可以仅由第一计数器221组成，或者可以包括第一计数器221和第二计数器222。
第一计数器221可以对刷新帧或保持帧进行计数，并输出针对每个刷新率所累加的第一计数值。例如，当刷新率为60Hz时，对于一个周期刷新帧和保持帧各被驱动一次，所以第一计数值在刷新帧中被计数为“1”，并且在保持帧中被计数为“2”。而且，第一计数值在下一个刷新帧中再次被初始化并且可以被计数为“1”。这里，由第一计数器221计数的每个第一计数值可以表示为一个帧(R0、Hn、n是自然数)。
如果刷新率为1Hz，则对于一个周期用1个刷新帧和119个保持帧来驱动像素，使得第一计数值在刷新帧中被初始化并且被计数为“1”。计数在保持帧中被累加，并且第一计数值在最后的第119个保持帧中被计数为“120”，然后被初始化，从而该帧能够被重复地计数。
这里，第一计数器221可以被设计为启用128位操作，因为它从“1”到“120”累加并计数。然而，第一计数器不限于此，并且可以根据设计而改变。
第二计数器222可以根据标志单元210输出的标志值和第一计数器221的第一计数值对第二计数值进行累加并计数。在这种情况下，由第二计数器222计数的每个第二计数值可以表示为1SET。
每当第一计数器221被初始化时，第二计数器值可以被累加并计数，并且当标志值转换时，第二计数值可以被初始化。
此处，第二计数器222被设计为启用2比特操作，使得它仅能从“1”到“4”进行计数和累加，并维持第二计数值为“4”直到再次被初始化。然而，第二计数器不限于此并且可以根据设计而改变。比较器230可以接收从标志单元210输出的每个刷新率的标志值和从计数器220输出的计数值，可以根据输入的标志值和计数值像AND门一样操作，并且可以向MUX输出比较值。
第一寄存器单元240包括多个寄存器，并且每个寄存器可以存储针对每个刷新率在刷新帧和保持帧中所施加的偏置电压的调整值。
MUX可以被配置为使得多个开关SW1至SWn与多个寄存器一一对应，以根据从比较器230输出的比较值选择第一寄存器单元240的多个寄存器中所存储的调整值之一。
例如，当计数器220仅包括第一计数器221时，MUX可以包括第一开关SW1至第四开关SW4。
当第一标志211的第一标志值作为逻辑高电压输入比较器230时并且当第一计数器221的计数值作为逻辑高电压输入时，MUX可以输出比较值以接通第一开关SW1。
当第一标志211的第一标志值作为逻辑高电压输入比较器230时并且当第一计数器221的计数值作为逻辑低电压输入时，MUX可以输出比较值以接通第二开关SW2。
当第二标志212的第二标志值作为逻辑高电压输入比较器230时并且当第一计数器221的计数值作为逻辑高电压输入时，MUX可以输出比较值以接通第三开关SW3。
当第二标志212的第二标志值作为逻辑高电压输入比较器230时并且当第一计数器221的计数值作为逻辑低电压输入时，MUX可以输出比较值以接通第四开关SW4。
而且，当计数器220包括第一计数器221和第二计数器222时，MUX可以包括第一开关SW1至第六开关SW6。
当第一标志211的第一标志值为逻辑高电压时，从比较器230输出的比较值与当计数器220仅包括第一计数器221时的比较值相同。
当第二标志212的第二标志值作为逻辑高电压输入比较器230时，当第一计数器221的计数值作为逻辑高电压输入时，以及当第二计数器222的计数值作为逻辑高电压输入时，MUX可以输出比较值，以接通第三开关SW3。
当第二标志212的第二标志值作为逻辑高电压输入比较器230时，当第一计数器221的计数值作为逻辑高电压输入时，以及当第二计数器222的计数值作为逻辑低电压输入时，MUX可以输出比较值，以接通第四开关SW4。
当第二标志212的第二标志值作为逻辑高电压输入比较器230时，当第一计数器221的计数值作为逻辑低电压输入时，以及当第二计数器222的计数值作为逻辑高电压输入时，MUX可以输出比较值，以接通第五开关SW5。
当第二标志212的第二标志值作为逻辑高电压输入比较器230时，当第一计数器221的计数值作为逻辑低电压输入时，并且当第二计数器222的计数值作为逻辑低电压输入时，MUX可以输出比较值，以接通第六开关SW6。
如此，MUX可以选择第一寄存器单元240的多个寄存器中所存储的调整值之一并将其输出给DAC。DAC可以将输入的调整值转换为模拟电压，并且可以通过放大器被输出与参考电压V_Ref相比由第一电平或第二电平控制的偏置电压V1和V2。
参照图6B，生成发光信号EM的电路块与生成偏置电压的电路块以相同的方式包括标志单元210、计数器220、比较器230和MUX，并且执行与生成偏置电压的电路块的操作相同的操作，将省略其描述。
第二寄存器单元250包括多个寄存器，并且每个寄存器可以存储在针对每个刷新率的刷新帧和保持帧中所施加的值发光信号。
发光控制信号发生器260可以基于由MUX所选择的发光信号值生成发光控制信号。
发光信号驱动器270可以从发光控制信号发生器260接收发光控制信号，并且可以控制在针对每个刷新率的刷新帧和保持帧中提供的发光信号(EM脉冲)的脉冲宽度并输出发光信号。
在下文中，本发明提出了一种用于通过在刷新率改变的时间点前后调整第一偏置电压V1或第二偏置电压V2以及发光信号EM而防止出现亮度差异的方法。
图7是用于描述用于亮度偏差补偿驱动的第一方法的图。
例如，第一刷新率RR1可以是60Hz，并且第二刷新率RR2可以是1Hz。在第一刷新率RR1区段中，第一刷新率RR1的第一标志值可以具有逻辑高电压，而第二刷新率RR2的第二标志值可以具有逻辑低电压。而且，在第二刷新率RR2区段中，第一刷新率RR1的第一标志值可以具有逻辑低电压，而第二刷新率RR2的第二标志值可以具有逻辑高电压。
在切换到第二刷新率RR2之后的第一刷新帧时段(1SET的R0)中，第一偏置电压V1可以被调整为比参考电压V_Ref高第一电平的电压。例如，第一电平可以是参考电压V_Ref的5％至7％的值，并且不限于此，并且可以根据设计而改变。
当以第二刷新率RR2对第一刷新帧进行计数(1SET的R0)时，调整第一偏置电压V1是为了补偿该区段中的亮度变化。当第一偏置电压V1增加时，驱动晶体管DT的沟道电压变得高于栅极电压，从而使驱动电流Id增加。结果，由于电致发光装置ELD的亮度被增大和补偿，当通过刷新率从高刷新率改变为低刷新率来驱动像素时，可以解决在刷新率改变的时间点出现闪烁的问题。
当以第二刷新率RR2对除第一刷新帧之外的其余刷新帧(n+1SET的R0，n为自然数)进行计数时，可以将第一偏置电压V1调整为比参考电压V_Ref高第二电平的电压。例如，第二电平可以是参考电压V_Ref的2％至3％的值，并且可以根据设计而改变，而不限于此。驱动晶体管DT的特性在切换到第二刷新率RR2后立即变化最大，并且驱动电流Id的减少量也最大。因此，在第一刷新帧时段之后的刷新帧时段中，需要使电致发光装置ELD的亮度补偿较小。因此，优选的是，第二电平低于第一电平。
当以第二刷新率RR2对第一刷新帧(1SET的R0帧)进行计数时，可以通过施加比参考电压V_Ref调整了第一电平的第一偏置电压V1，来去除第一刷新率RR1和第二刷新率RR2的偏置应力的偏差。通过控制发光信号EM的脉冲宽度，能够额外补偿细微的亮度偏差。
换言之，当通过将第一偏置电压V1调整为比参考电压V_Ref大第一电平来去除偏置应力偏差时，在第二刷新率RR2下的亮度可以略高于在第一刷新率RR1下的亮度。由于可以以几微秒(μs)为单位微调发光信号EM的脉冲宽度，因此在1SET的R0帧中通过施加更大脉冲宽度的发光信号EM来降低亮度，使得能够额外补偿细微的亮度偏差。例如，在1SET的R0帧中发光信号EM的脉冲宽度w1可以处于高状态约300μs，而在除此之外的其余时段期间发光信号EM的脉冲宽度w2可以处于高状态约100μs。然而，脉冲宽度不限于此并且可以根据设计而改变。
同时，在第一实施方式中，计数器220可以同时使用第一计数器221和第二计数器222。通过第二计数器222指定每个SET区段，并且通过第一计数器221指定R0帧，所以能够针对每个SET的每个R0帧调整第一偏置电压V1和发光信号EM的脉冲宽度。
图8是用于描述用于亮度偏差补偿驱动的第二方法的图。
上面已经描述了在第一刷新率RR1下的驱动和第二刷新率RR2下的驱动之间出现驱动晶体管DT的特性差异。驱动晶体管DT的特性差异是由一个设置内偏置应力的量的差异而引起的。第二实施方式提供了一种用于去除作为驱动晶体管DT的特性差异的原因的偏置应力的量的偏差的方法。
为了降低第二刷新率RR2下的偏置应力的量，必须在保持帧时段中降低第一偏置电压V1，为刷新帧时段做准备。具体地，可以通过在第二刷新率RR2下的整个保持帧时段中将第一偏置电压V1调整为与第一电平一样低，来去除偏置应力的量的偏差。例如，第一电平可以是参考电压V_Ref的5％至7％的值并且可以根据设计而改变，但不限于此。
因此，由于驱动电流Id等于驱动晶体管DT在第一刷新率RR1和第二刷新率RR2下的沟道活性，因此能够改善亮度偏差。
同时，因为在保持帧时段中降低了第一偏置电压V1，因此在刷新帧和保持帧之间可能出现亮度偏差。因此，为了去除刷新帧和保持帧之间的亮度偏差，当以第一刷新率RR1和第二刷新率RR2对刷新帧R0进行计数时，通过调整发光信号EM的脉冲宽度w1，能够额外补偿细微亮度偏差。
换言之，由于可以以几微秒(μs)为单位微调发光信号EM的脉冲宽度，因此能够调整近似值以对于更准确地针对目标亮度。因此，当以第一刷新率RR1和第二刷新率RR2对R0帧进行计数时，通过施加脉冲宽度w1更大的发光信号EM来降低亮度，从而能够额外补偿细微的亮度偏差。例如，在所有R0帧中，发光信号EM的脉冲宽度w1可以处于高状态大约300μs，并且在除此之外的其余时段期间发光信号EM的脉冲宽度w2可以处于高状态大约100μs。然而，脉冲宽度不限于此，并且可以根据设计而改变。同时，在第二实施方式中，在计数器220中可以仅使用第一计数器221。与针对每个SET调整R0帧的第一偏置电压V1和发光信号EM的脉冲宽度的第一实施方式不同，在第二实施方式中，由于在以第二刷新率RR2对保持帧进行计数的整个区段中对刷新帧R0进行计数或者以第一刷新率RR1和第二刷新率RR2对刷新帧R0进行计数时，调整发光信号EM的脉冲宽度以及第一偏置电压V1，因此不需要区分SET。因此，第二实施方式的计数器220可以仅包括第一计数器221。
图9是用于描述用于亮度偏差补偿驱动的第三方法的图。
与第一实施方式和第二实施方式不同，在第三实施方式中，可以额外调整第二偏置电压V2。第二偏置电压V2是用于初始化电致发光装置ELD的像素电极的电压。当第一偏置电压V1之前的初始化电压被降低时，发光装置ELD的最终亮度降低，从而防止刷新帧和保持帧之间的亮度偏差。第二偏置电压V2初始化电致发光装置ELD的像素电极。由于通过在第一偏置电压V1之前降低初始化电压来降低电致发光装置ELD的最终亮度，因此能够防止刷新帧和保持帧之间的亮度偏差。
首先，为了降低在第二刷新率RR2下的偏置应力的量，在保持帧时段中降低第一偏置电压V1。具体地，当以第二刷新率RR2对刷新帧R0进行计数时，第一偏置电压V1被调整为与第一电平一样高。
而且，为了去除刷新帧和保持帧之间的亮度偏差，需要通过在保持帧时段中增加第二偏置电压V2来校正亮度。具体地，在以第二刷新率RR2对保持帧进行计数的整个区段中，将第二偏置电压V2调整为与第一电平一样高的电压。而且，当对第一刷新率RR1的保持帧H1进行计数时，第二偏置电压V2被调整为与第一电平一样高。例如，第一电平可以是参考电压V_Ref的5％至7％并且不限于此。
最后，通过调整发光信号EM的脉冲宽度能够补偿通过调整第一偏置电压V1和第二偏置电压V2的电压电平没有消除的细微亮度偏差。
也就是说，由于可以以几微秒(μs)为单位微调发光信号EM的脉冲宽度，因此能够调整近似值以更准确地针对目标亮度。因此，当以第一刷新率RR1和第二刷新率RR2对刷新帧R0进行计数时，通过施加脉冲宽度w1更大的发光信号EM来降低亮度，从而能够额外补偿细微的亮度偏差。例如，在刷新帧R0中，发光信号EM的脉冲宽度w1可以处于高状态大约300μs，并且在除此之外的其余时段期间发光信号EM的脉冲宽度w2可以处于高状态大约100μs。然而，脉冲宽度不限于此，并且可以根据设计而改变。
同时，在第三实施方式中，与第二实施方式一样，计数器220可以仅包括第一计数器221。在第三实施方式中，刷新帧和保持帧被区分，并且在保持帧(Hn帧)时段或刷新帧时段(R0帧)中调整发光信号EM的脉冲宽度、第一偏置电压V1和第二偏置电压V2。因此，第三实施方式的计数器220可以仅包括第一计数器221。
根据上述亮度偏差补偿驱动的第一方法至第三方法，能够消除当通过将刷新率从高刷新率(例如，60Hz)变为低刷新率(例如，1Hz)来驱动像素时出现的亮度偏差。
如上所述，本公开涉及一种使用可变刷新率(VRR)模式的电致发光显示装置。根据亮度偏差补偿驱动的第一方法至第四方法，可以消除在通过将刷新率从高刷新率(例如，60Hz)改变为低刷新率(例如，1Hz)来驱动像素时出现的驱动晶体管DT的偏置应力的量的偏差。结果，减少了在刷新率改变的时间点出现亮度差异，并且观看者不会感知到刷新率改变。
以上描述和附图仅用于例示本发明的精神。本发明所属领域的技术人员在不脱离本发明的本质特征的范围内，可以进行诸如组合、拆分、替换、改变等的各种修改和变型。因此，本公开所公开的实施方式仅用于描述而非限制本发明的精神，本发明的精神的范围不受这些实施方式的限制。本发明的保护范围应由所附权利要求来解释，并且凡在与其等同范围内的技术精神全部应解释为包含在本发明的保护范围内。
本申请要求于2020年9月25日提交的韩国专利申请No.10-2020-0124809号的优先权，其全部内容通过引用出于所有目的并入本文中，如同在本文中完整阐述一样。

Claims (24)

1.一种显示驱动电路，该显示驱动电路包括：
标志单元，该标志单元输出用于区分刷新率的标志值；
计数器，该计数器接收所述标志值并通过在刷新帧和保持帧之间进行区分来生成计数值，所述刷新帧是用于写入数据电压的帧并且所述保持帧是用于维持写入所述刷新帧中的数据电压的帧；以及
比较器，该比较器根据所述标志值和所述计数值输出用于使偏置电压的电压电平和发光信号的脉冲宽度变化的比较值。
2.根据权利要求1所述的显示驱动电路，
其中，所述标志单元输出用于所述刷新率的第一刷新率的第一标志值和用于所述刷新率的第二刷新率的第二标志值，所述第二刷新率低于所述第一刷新率，并且
其中，所述第一标志值和所述第二标志值是相互反相的逻辑电压。
3.根据权利要求2所述的显示驱动电路，其中，在第一刷新率区段中，所述第一刷新率的所述第一标志值具有逻辑高电压，并且所述第二刷新率的所述第二标志值具有逻辑低电压，并且在第二刷新率区段中，所述第一刷新率的所述第一标志值具有逻辑低电压，并且第二刷新率的所述第二标志值具有逻辑高电压。
4.根据权利要求2所述的显示驱动电路，其中，所述计数器包括：
第一计数器，该第一计数器根据所述刷新帧和所述保持帧生成第一计数值，并且根据所述第一刷新率或所述第二刷新率的周期来初始化所述第一计数值；以及
第二计数器，该第二计数器在每次初始化所述第一计数器值时生成第二计数值，并且在所述第一标志值或所述第二标志值切换时初始化所述第二计数值。
5.根据权利要求4所述的显示驱动电路，其中，所述第二计数器根据从所述标志单元输出的所述第一标志值和所述第二标志值以及所述第一计数器的所述第一计数值对所述第二计数值进行累加和计数。
6.根据权利要求1所述的显示驱动电路，其中，所述计数器周期性地初始化所述计数值。
7.根据权利要求2所述的显示驱动电路，其中，所述偏置电压包括第一偏置电压，并且其中，所述第一偏置电压变化了第一电平或变化了低于所述第一电平的第二电平，所述第一电平为参考电压的5％至7％的值，所述第二电平为所述参考电压的2％至3％的值。
8.根据权利要求7所述的显示驱动电路，其中，在以所述第二刷新率对所述刷新帧的第一刷新帧进行计数时，所述第一偏置电压变化了所述第一电平。
9.根据权利要求8所述的显示驱动电路，其中，在以所述第二刷新率对除所述第一刷新帧之外的其余刷新帧进行计数时，所述第一偏置电压变化了所述第二电平。
10.根据权利要求7所述的显示驱动电路，其中，当以所述第二刷新率对所述保持帧进行计数时，所述第一偏置电压变化了所述第一电平。
11.根据权利要求7所述的显示驱动电路，
其中，所述偏置电压还包括第二偏置电压，
其中，当以所述第二刷新率对所述保持帧进行计数时，所述第一偏置电压变化了所述第一电平，
并且其中，当对所述刷新帧进行计数时，所述第二偏置电压变化了所述第一电平。
12.根据权利要求7所述的显示驱动电路，其中，当对所述刷新帧进行计数时，使所述发光信号的脉冲宽度变化。
13.根据权利要求7所述的显示驱动电路，其中，当以所述第二刷新率对第一刷新帧进行计数时，使所述发光信号的脉冲宽度变化。
14.根据权利要求2所述的显示驱动电路，其中，所述第一刷新率为60Hz，并且所述第二刷新率为1Hz。
15.一种显示装置，该显示装置包括：
显示驱动电路，该显示驱动电路根据图像以帧为单位来改变刷新率，将所述帧区分为用于写入数据电压的刷新帧和用于维持写入所述刷新帧中的数据电压的保持帧，根据所述刷新率以所述刷新帧和所述保持帧为单位生成计数值，并且根据所述计数值输出比较值以使偏置电压变化或发光信号的脉冲宽度变化；
第一寄存器单元，该第一寄存器单元包括多个寄存器，所述多个寄存器分别储存具有不同电平的调整后的偏置电压值；
数模转换器，该数模转换器将根据所述比较值所选择的调整后的偏置电压值转换为模拟电压并输出所述模拟电压；
第二寄存器单元，该第二寄存器单元包括多个寄存器，所述多个寄存器分别存储不同的发光信号值；
发光控制信号发生器，该发光控制信号发生器基于依据所述比较值所选择的所述发光信号值生成发光控制信号；以及
发光信号驱动器，该发光信号驱动器操作使得发光信号的脉冲宽度根据所述发光控制信号而变化。
16.根据权利要求15所述的显示装置，
其中，所述刷新率包括第一刷新率和第二刷新率，所述第二刷新率的刷新率低于所述第一刷新率，
并且其中，所述计数值被周期性地初始化。
17.根据权利要求16所述的显示装置，其中，所述第一刷新率为60Hz，并且所述第二刷新率为1Hz。
18.根据权利要求16所述的显示装置，
其中，所述偏置电压包括第一偏置电压，
并且其中，所述第一偏置电压根据调整后的偏置电压值变化了第一电平或变化了低于所述第一电平的第二电平。
19.根据权利要求18所述的显示装置，其中，当以所述第二刷新率对第一刷新帧进行计数时，所述第一偏置电压变化了所述第一电平。
20.根据权利要求19所述的显示装置，其中，当以所述第二刷新率对除所述第一刷新帧之外的其余刷新帧进行计数时，所述第一偏置电压变化了所述第二电平。
21.根据权利要求18所述的显示装置，其中，当以所述第二刷新率对所述保持帧进行计数时，所述第一偏置电压变化了所述第一电平。
22.根据权利要求18所述的显示装置，
其中，所述偏置电压还包括第二偏置电压，
其中，当以所述第二刷新率对所述保持帧进行计数时，所述第一偏置电压变化了所述第一电平，
并且其中，当对所述刷新帧进行计数时，所述第二偏置电压变化了所述第一电平。
23.根据权利要求18所述的显示装置，其中，当对所述刷新帧进行计数时，使所述发光信号的脉冲宽度变化。
24.根据权利要求18所述的显示装置，其中，当根据所述发光控制信号以所述第二刷新率对第一刷新帧进行计数时，使所述发光信号的脉冲宽度变化。
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