WO2019087612A1 - 固体撮像素子、撮像装置、および、固体撮像素子の制御方法 - Google Patents

固体撮像素子、撮像装置、および、固体撮像素子の制御方法 Download PDF

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貴博 赤羽
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ソニーセミコンダクタソリューションズ株式会社
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    • H04N25/62—Detection or reduction of noise due to excess charges produced by the exposure, e.g. smear, blooming, ghost image, crosstalk or leakage between pixels
    • H04N25/625—Detection or reduction of noise due to excess charges produced by the exposure, e.g. smear, blooming, ghost image, crosstalk or leakage between pixels for the control of smear

Definitions

  • the present technology relates to a solid-state imaging device, an imaging device, and a control method of the solid-state imaging device.
  • the present invention relates to a solid-state imaging device provided with an ADC (Analog to Digital Converter), an imaging device, and a control method of the solid-state imaging device.
  • ADC Analog to Digital Converter
  • an imaging device for example, a solid-state imaging device configured using a charge coupled device (CCD) image sensor, a complementary MOS (CMOS) image sensor, or the like is known.
  • CCD charge coupled device
  • CMOS complementary MOS
  • the power supply voltage may fluctuate due to factors such as electromagnetic induction, and the fluctuation of the power supply voltage may generate streaked noise in the image data.
  • a solid-state imaging device that corrects a pixel signal of an effective pixel using a correction signal from a light-shielded pixel (see, for example, Patent Document 1).
  • an ADC is disposed for each of the column of effective pixels and the column of light-shielded pixels.
  • the correction signal from the light-shielded pixel includes a noise component due to the fluctuation of the power supply voltage.
  • the solid-state imaging device described above removes noise components by subtracting a statistic of a value obtained by AD (Analog to Digital) conversion of the correction signal from the AD conversion value of the pixel signal, thereby causing streaking or voltage fluctuation. Noise can be suppressed.
  • AD Analog to Digital
  • the present technology is produced in view of such a situation, and it is an object of the present invention to reduce the number of ADCs in a solid-state imaging device that converts analog pixel signals into digital signals.
  • a first aspect of the present technology is an effective pixel that generates an analog signal according to the amount of light received using a power supply from a power supply line.
  • a correction signal generation unit that generates an analog signal including a noise component generated in the power supply line as a correction signal, a selection circuit that sequentially selects and outputs the effective pixel signal and the correction signal, and the output effective
  • An analog-to-digital converter that performs processing of converting pixel signals into digital signals and outputting as effective pixel data and processing of converting the output correction signals into digital signals and outputting as correction data, and based on the correction data
  • a solid-state imaging device including a signal processing unit that corrects the effective pixel data, and a control method thereof. This brings about the effect that the effective pixel signal and the correction signal are sequentially selected and converted to a digital signal.
  • the correction signal generation unit may include a light-shielded light-shielded pixel. This brings about the effect that the effective pixel signal and the light-shielded pixel signal from the light-shielded pixel are sequentially selected.
  • the correction signal generation unit may include a high pass filter that passes high frequency components higher than a predetermined frequency of the signals from the power supply line and outputs the high frequency components as the correction signal. Good. This brings about the effect that the high frequency component of the signal from the power supply line and the effective pixel signal are sequentially selected.
  • the analog-to-digital converter may be a SARADC (Successive Approximation Register Analog to Digital Converter). This brings about the effect that the effective pixel signal and the correction signal are converted into digital signals by the SAR ADC.
  • SARADC Successessive Approximation Register Analog to Digital Converter
  • the first aspect further includes a timing control unit that controls the operation timing of the selection circuit, the selection circuits are arranged in a predetermined number, and the timing control unit is configured to control the predetermined number of the selection circuits. And the other may output the effective pixel signal. This brings about the effect that the correction signal from the sequentially selected selection circuit is converted into correction data.
  • the timing control unit may sequentially select the predetermined number of selection circuits in a predetermined order to output the correction signal. This brings about the effect that the correction signal from the selection circuit selected in a predetermined order is converted into correction data.
  • the timing control unit generates a random number indicating any one of the predetermined number of selection circuits, selects the selection circuit indicated by the random number, and outputs the correction signal. It is also good.
  • the correction signal from the selection circuit indicated by the random number is converted into correction data.
  • a predetermined number of the effective pixels are arranged in a pixel array portion in a two-dimensional grid, the pixel array portion is divided into a plurality of effective pixel areas, and the selection circuit is The effective pixel signal from any one of a plurality of effective pixel areas and the correction signal may be sequentially selected. This brings about the effect that the effective pixel signal and the correction signal from any of the plurality of effective pixel areas are converted into digital signals.
  • the effective pixels may be arranged in a Bayer arrangement. This brings about the effect that the effective pixel signal from the pixel array part of Bayer arrangement is converted into a digital signal.
  • each of a plurality of effective pixels adjacent in the pixel array unit may photoelectrically convert light of the same color to generate the effective pixel signal. This brings about the effect that the effective pixel signal from the pixel array part of the same color of a plurality of adjacent effective pixels is converted into a digital signal.
  • the pair of effective pixels adjacent in the pixel array unit may be pixels for detecting a phase difference between a pair of images. This brings about the effect that the focus is detected from the phase difference.
  • a plurality of effective pixels having different light receiving areas may be arranged in the pixel array unit. This brings about an effect that the effective pixel signal from the pixel array unit in which a plurality of effective pixels having different light receiving areas are arranged is converted into a digital signal.
  • the second aspect of the present technology corrects an analog signal including a noise component generated in an effective pixel that generates an analog signal according to the amount of received light as an effective pixel signal using a power supply from a power supply line
  • a correction signal generation unit that generates as a signal, a selection circuit that sequentially selects and outputs the effective pixel signal and the correction signal, converts the output effective pixel signal into a digital signal, and outputs it as effective pixel data
  • An analog-to-digital converter for performing processing and processing for converting the output correction signal into a digital signal and outputting it as correction data; a signal processing unit for correcting the effective pixel data based on the correction data; And an image processing unit that performs predetermined image processing on the image data including the effective pixel data.
  • the present technology in a solid-state imaging device that converts an analog pixel signal into a digital signal, it is possible to achieve an excellent effect that the number of ADCs can be reduced.
  • the effect described here is not necessarily limited, and may be any effect described in the present disclosure.
  • FIG. 1 is a block diagram illustrating an exemplary configuration of an imaging device according to a first embodiment of the present technology. It is a figure showing an example of layered structure of a solid-state image sensing device in a 1st embodiment of this art. It is an example of the top view of the pixel chip in a 1st embodiment of this art.
  • FIG. 1 is a block diagram showing an exemplary configuration of a logic chip according to a first embodiment of the present technology. It is an example of the top view of the pixel array part in a 1st embodiment of this art. It is an example of the top view of the shade pixel block and effective pixel block in a 1st embodiment of this art.
  • circuit diagram of the effective pixel block in a 1st embodiment of this art It is an example of the circuit diagram of the effective pixel block in a 1st embodiment of this art. It is a block diagram showing an example of 1 composition of an AD conversion part in a 1st embodiment of this art. It is a block diagram showing an example of 1 composition of ADC in a 1st embodiment of this art. It is an example of the circuit diagram of the multiplexer in a 1st embodiment of this art. It is a block diagram showing an example of 1 composition of a signal processing part in a 1st embodiment of this art. It is a figure showing an example of the selection order of the signal in a 1st embodiment of this art. It is a figure showing an example of the order chosen at random in a 1st embodiment of this art.
  • FIG. 16 is a block diagram showing an example of configuration of a logic chip in a fourth modified example of the first embodiment of the present technology. It is a top view showing an example of 1 composition of a pixel chip in a 2nd embodiment of this art. It is a block diagram showing an example of 1 composition of a power source fluctuation detection part in a 2nd embodiment of this art. It is a block diagram showing an example of rough composition of a vehicle control system. It is explanatory drawing which shows an example of the installation position of an imaging part.
  • First embodiment example of sequentially selecting an effective pixel signal and a correction signal
  • Second embodiment example of sequentially selecting an effective pixel signal and a correction signal from a high pass filter
  • FIG. 1 is a block diagram showing an exemplary configuration of an imaging device 100 according to a first embodiment of the present technology.
  • the imaging apparatus 100 is an apparatus having an imaging function, and includes an imaging lens 110, a solid-state imaging device 200, an image processing unit 120, an imaging control unit 130, and a recording unit 140.
  • As the imaging device 100 a digital camera, a smartphone, a personal computer, etc. are assumed.
  • the imaging lens 110 condenses light from a subject and guides the light to the solid-state imaging device 200.
  • the solid-state imaging device 200 captures image data in synchronization with the vertical synchronization signal VSYNC from the imaging control unit 130.
  • the vertical synchronization signal VSYNC is a timing signal indicating the timing of imaging. For example, periodic signals of 30 hertz (Hz) or 60 hertz (Hz) are used as the vertical synchronization signal VSYNC.
  • the solid-state imaging device 200 supplies image data to the image processing unit 120 via the signal line 209.
  • the imaging control unit 130 controls the solid-state imaging device 200.
  • the imaging control unit 130 supplies the vertical synchronization signal VSYNC, a signal for controlling the exposure time, and the like to the solid-state imaging device 200 through the signal line 139. Further, the imaging control unit 130 starts supply of the vertical synchronization signal VSYNC, for example, when an operation for starting imaging (such as pressing of a shutter button) is performed.
  • the image processing unit 120 executes predetermined image processing such as demosaicing processing and white balance processing on the image data.
  • the image processing unit 120 supplies the processed image data to the recording unit 140 via the signal line 129.
  • the recording unit 140 is for recording image data.
  • FIG. 2 is a view showing an example of a laminated structure of the solid-state imaging device 200 according to the first embodiment of the present technology.
  • the solid-state imaging device 200 includes a pixel chip 201 and a logic chip 202 stacked on the pixel chip 201.
  • FIG. 3 is an example of a plan view of the pixel chip 201 according to the first embodiment of the present technology.
  • the pixel chip 201 includes a pixel array unit 210 in which a plurality of pixels are arranged in a two-dimensional grid.
  • the pixels arranged in the pixel array unit 210 are classified into light-shielded light-shielded pixels and non-light-shielded effective pixels.
  • the effective pixels are arranged in the effective pixel area 340.
  • the light blocking pixels are disposed in light blocking areas 320 and 380 provided around the effective pixel area 340.
  • the selection unit 310 is disposed between the light shielding area 320 and the outer periphery of the pixel array unit 210, and the selection unit 390 is arranged between the light shielding area 380 and the outer periphery of the pixel array unit 210. Details of the configuration of the selection units 310 and 390 will be described later.
  • M ⁇ N (M and N are integers) effective pixel areas 340 are arranged in M rows ⁇ N columns. Then, with the predetermined direction parallel to the vertical direction as the upper direction, the light shielding area 320 is disposed above the respective columns of the effective pixel area 340, and the light shielding area 380 is disposed below the same.
  • the selection unit 310 is disposed above each of the light shielding areas 320, and the selection unit 390 is disposed below each of the light shielding areas 380. Since the effective pixel areas 340 have N columns, N light shielding areas 320, light shielding areas 380, selection units 310 and selection units 390 are respectively arranged.
  • FIG. 4 is a block diagram showing one configuration example of the logic chip 202 in the first embodiment of the present technology.
  • the logic chip 202 includes a scanning circuit 220, AD converters 230 and 270, a signal processor 250, and a timing controller 260.
  • the timing control unit 260 controls the operation timings of the circuits in the logic chip 202 in synchronization with the vertical synchronization signal VSYNC from the imaging control unit 130.
  • the scanning circuit 220 drives the pixels in the pixel chip 201 in a predetermined order.
  • the AD conversion unit 230 converts each of the analog signals from the selection unit 310 in the pixel chip 201 into digital signals and supplies the digital signals to the signal processing unit 250.
  • the AD conversion unit 270 converts each of the analog signals from the selection unit 390 in the pixel chip 201 into digital signals and supplies the digital signals to the signal processing unit 250.
  • the signal processing unit 250 performs predetermined signal processing on the digital signals from the AD conversion units 230 and 270 to generate image data.
  • the signal processing unit 250 supplies the image data to the image processing unit 120.
  • the pixel array unit 210 is disposed in the pixel chip 201 and the other components are disposed in the logic chip 202, the disposition in each chip is not limited to this configuration. For example, part of the circuit in the pixel can be disposed in the logic chip 202. Further, although both of the AD conversion units 230 and 270 are arranged, only one of them may be arranged.
  • FIG. 5 is an example of a plan view of the pixel array unit 210 according to the first embodiment of the present technology.
  • the selection unit 310 four multiplexers 311 are arranged in the horizontal direction, and in the light shielding area 320, four light shielding pixel blocks 330 are arranged in the horizontal direction.
  • the effective pixel area 340 32 effective pixel blocks 350 are arranged in 8 rows ⁇ 4 columns.
  • the configuration of the light shielding area 380 is similar to that of the light shielding area 320.
  • four multiplexers 391 are arranged in the horizontal direction as in the selection unit 310.
  • each column of effective pixel blocks 350 four vertical signal lines are wired along the vertical direction. Since the effective pixel block 350 has four columns, a total of 16 vertical signal lines are wired for each column of the effective pixel area 340.
  • the effective pixel blocks 350 in the first and second rows from the top are connected to the fourth vertical signal line from the left of the corresponding column, with the predetermined direction parallel to the horizontal direction as the left direction.
  • the effective pixel blocks 350 in the third and fourth rows from the top are connected to the third vertical signal line from the left of the corresponding column.
  • the effective pixel blocks 350 in the fifth and sixth rows from the top are connected to the second vertical signal line from the left of the corresponding column, and the effective pixel blocks 350 in the seventh and eighth rows from the top.
  • any of the light-shielded pixel blocks 330 in the light-shielded area 320 is connected to the logic chip 202 through one signal line.
  • Each of the multiplexers 311 is provided with four input terminals and two output terminals.
  • the four vertical signal lines of the corresponding column are connected to their input terminals.
  • the output terminal is also connected to the logic chip 202 through two signal lines.
  • the multiplexer 311 selects two of the four vertical signal lines according to the control of the scanning circuit 220, and outputs analog signals from them to the logic chip 202.
  • the number of pixel blocks in the effective pixel area 340 and the light shielding area 320 is not limited to 32 or 4.
  • FIG. 6 is an example of a plan view of the light-shielded pixel block 330 and the effective pixel block 350 according to the first embodiment of the present technology.
  • the light shielding pixel block 330 eight light shielding pixels 331 sharing a floating diffusion layer are arranged in 4 rows ⁇ 2 columns.
  • the effective pixel block 350 eight effective pixels 351 sharing the floating diffusion layer are arranged in 4 rows ⁇ 2 columns in a Bayer arrangement.
  • an effective pixel 351 of R (Red) that photoelectrically converts red light
  • an effective pixel 351 of G (Green) that photoelectrically converts green light
  • B (Blue) that photoelectrically converts blue light
  • the shapes of the effective pixel 351 and the light shielding pixel 331 are, for example, square, and the size of all the pixels is the same.
  • the effective pixel 351 generates an analog signal according to the amount of light received as an effective pixel signal using a power supply from a power supply line.
  • the light shielding pixel 331 generates an analog signal including a noise component generated in the power supply line as a correction signal.
  • the light shielding pixel 331 is an example of the correction signal generation unit described in the claims.
  • the scanning circuit 220 illustrated in FIG. 4 performs scanning for simultaneously selecting and driving 16 effective pixels 351 out of 32 ⁇ 8 in each of N effective pixel areas 340. At the same time, the scanning circuit 220 selects and drives one light-shielded pixel 331 for each of the light-shielded area 320 and the light-shielded area 380. By performing the scanning for driving the 16 times 16 times, 32 ⁇ 8 effective pixel signals are read out in each of N effective pixel areas 340. By performing this process M times, all valid pixel signals are read out and one image data is generated.
  • the scanning circuit 220 causes the selection unit 310 to output eight effective pixel signals of the sixteen driven in each scan to the logic chip 202, and causes the selection unit 390 to output the rest to the logic chip 202. Since the correction signal from the light shielding area 320 is also output to the logic chip 202, the selection unit 310 outputs nine analog signals consisting of eight effective pixel signals and one correction signal. Similarly, nine analog signals are output from the selection unit 390.
  • the number of pixels in the effective pixel block 350 and the light-shielded pixel block 330 is not limited to eight.
  • FIG. 7 is an example of a circuit diagram of the effective pixel block 350 according to the first embodiment of the present technology.
  • the effective pixel block 350 includes selection transistors 352, 353, 356, 357, 360, 361, 364, and 365, and photodiodes 354, 355, 358, 359, 362, 363, 366, and 367.
  • the effective pixel block 350 includes a reset transistor 368, a floating diffusion layer 369, an amplification transistor 370, and a selection transistor 371.
  • As a transistor such as the selection transistor 352 for example, an N-type MOS (Metal-Oxide-Semiconductor) transistor is used.
  • the circuit configuration of the light-shielded pixel block 330 is the same as that of the effective pixel block 350.
  • Each of the photodiodes 354, 355, 358, 359, 362, 363, 366, and 367 photoelectrically converts the received light to generate an electric charge.
  • the selection transistor 352 transfers charge from the photodiode 354 to the floating diffusion layer 369 in accordance with the transfer signal TRG0 from the scanning circuit 220 in the logic chip 202.
  • the selection transistor 353 transfers charge from the photodiode 355 to the floating diffusion layer 369 in accordance with the transfer signal TRG1 from the scanning circuit 220.
  • the selection transistor 356 transfers charge from the photodiode 358 to the floating diffusion layer 369 in accordance with the transfer signal TRG2 from the scanning circuit 220.
  • the selection transistor 357 transfers charge from the photodiode 359 to the floating diffusion layer 369 in accordance with the transfer signal TRG3 from the scanning circuit 220.
  • the selection transistor 360 transfers charge from the photodiode 362 to the floating diffusion layer 369 in accordance with the transfer signal TRG4 from the scanning circuit 220.
  • the selection transistor 361 transfers charge from the photodiode 363 to the floating diffusion layer 369 in accordance with the transfer signal TRG5 from the scanning circuit 220.
  • the selection transistor 364 transfers charge from the photodiode 366 to the floating diffusion layer 369 in accordance with the transfer signal TRG6 from the scanning circuit 220.
  • the selection transistor 365 transfers charge from the photodiode 367 to the floating diffusion layer 369 in accordance with the transfer signal TRG7 from the scanning circuit 220.
  • the floating diffusion layer 369 accumulates the transferred charge and generates a voltage according to the amount of the accumulated charge.
  • the reset transistor 368 extracts charges from the floating diffusion layer 369 in accordance with a reset signal RST from the scanning circuit 220 to initialize the charge amount.
  • the amplification transistor 370 is for amplifying the voltage of the floating diffusion layer 369.
  • the selection transistor 371 outputs the signal of the amplified voltage as an effective pixel signal to the selection unit 310 or the like through the vertical signal line in accordance with the selection signal SEL from the scanning circuit 220.
  • the eight effective pixels 351 share one floating diffusion layer 369, and such pixels are called FD (Floating Diffusion) shared pixels. Note that the number of pixels sharing the FD is not limited to eight. In addition, pixels that do not share an FD can be arranged as effective pixels 351.
  • FIG. 8 is a block diagram showing an exemplary configuration of the AD conversion unit 230 according to the first embodiment of the present technology.
  • the AD conversion unit 230 includes a multiplexer 231 and an ADC 240 for each of the selection units 310. Since the number of selection units 310 is N, the multiplexers 231 and the ADCs 240 are each arranged N each.
  • the multiplexer 231 receives nine signals including the effective pixel signals SIG 0 to SIG 7 from the selection unit 310 and the correction signal DK from the light shielding area 320. Then, the multiplexer 231 sequentially selects those nine signals according to the control of the timing control unit 260, and inputs them to the ADC 240 as an analog signal AIN.
  • the multiplexer 231 is an example of the selection circuit described in the claims.
  • the ADC 240 converts the analog signal AIN into a digital signal DOUT and outputs the digital signal DOUT to the signal processing unit 250.
  • FIG. 9 is a block diagram showing an exemplary configuration of the ADC 240 according to the first embodiment of the present technology.
  • the ADC 240 includes a sample and hold circuit 241, a DAC (Digital to Analog Converter) 242, a comparator 243, a SAR (Successive Approximation Register) logic circuit 244, and a register 245.
  • DAC Digital to Analog Converter
  • SAR Successessive Approximation Register
  • the sample and hold circuit 241 samples and holds the analog signal AIN.
  • the sample and hold circuit 241 inputs the voltage of the held signal as the input voltage V IN to the non-inverted input terminal (+) of the comparator 243.
  • the DAC 242 generates a DAC output voltage V DAC by DA (Digital to Analog) conversion of the digital signal from the register 245.
  • the DAC 242 inputs the DAC output voltage V DAC to the inverting input terminal ( ⁇ ) of the comparator 243.
  • the comparator 243 compares the input voltage V IN with the DAC output voltage V DAC .
  • the comparator 243 supplies the comparison result to the SAR logic circuit 244 as COMP.
  • the SAR logic circuit 244 updates the held value of the register 245 so that the input voltage V IN approximates to the DAC output voltage V DAC based on the comparison result COMP sequentially compared.
  • the register 245 holds M (M is an integer) bit data.
  • the register 245 is set to, for example, an intermediate scale, and the DAC output voltage V DAC is set to V REF / 2, with the predetermined reference voltage as V REF .
  • the comparator 243 first compares the input voltage V IN with the DAC output voltage V DAC of V REF / 2.
  • the comparator 243 outputs, for example, the comparison result COMP at a high level, and the SAR logic circuit 244 changes the MSB (most significant bit) of the register 245 to “1”. Do.
  • the DAC output voltage V DAC rises by the amount of V REF / 4.
  • the comparator 243 outputs the comparison result COMP at a low level, and the SAR logic circuit 244 sets the MSB of the register 245 to “0”. Then, the DAC output voltage V DAC drops by V REF / 4.
  • the comparator 243 makes the next comparison, and the SAR logic circuit 244 updates the next digit of the MSB based on the next comparison result COMP.
  • the same procedure is continued until LSB (Least Significant Bit / Byte).
  • the register 245 outputs the held digital signal to the signal processing unit 250 as DOUT.
  • the analog signal AIN (effective pixel signal or correction signal) is AD converted to the digital signal DOUT.
  • a digital signal obtained by AD-converting an effective pixel signal is referred to as “effective pixel data”
  • a digital signal obtained by AD-converting a correction signal is referred to as “correction data”.
  • the ADC 240 that performs comparisons in order from MSB is called SARADC (Successive Approximation Register Analog to Digital Converter).
  • SARADC Successessive Approximation Register Analog to Digital Converter
  • an ADC that compares a sawtooth ramp signal with an analog signal AIN and measures the time until the comparison result is inverted is called a sloped ADC.
  • the AD conversion rate of this sloped ADC is slower than that of SARADC, and is often used in solid-state imaging devices. Then, in the solid-state imaging device using the tilt ADC, the tilt ADC is disposed for each of the effective pixel signal and the correction signal, and the effective pixel signal and the correction signal are AD converted in parallel.
  • the solid-state imaging device 200 since the effective pixel signal and the correction signal are sequentially selected and AD converted, the number of AD conversions per unit time is increased as compared with the case where AD conversion is performed in parallel. For this reason, if the inclined ADC is temporarily applied to the solid-state imaging device 200, the time required for AD conversion becomes long, and there is a possibility that the process may not be completed within the allowable time.
  • the influence of the increase in the number of conversions is suppressed by using a SAR ADC whose conversion speed is faster than that of the inclined ADC.
  • the solid-state imaging device 200 may use an ADC other than the SAR ADC as long as the ADC has a high conversion speed.
  • a delta sigma ADC, a cyclic ADC, or a pipelined ADC can be used instead of the SAR ADC.
  • FIG. 10 is an example of a circuit diagram of the multiplexer 231 in the first embodiment of the present technology.
  • the multiplexer 231 includes nine switches 232.
  • the effective pixel signals SIG0 to SIG7 are input to one end of eight of these.
  • the correction signal DK is input to one end of the remaining one switch 232.
  • the other end of each of the switches 232 is connected in common to the output terminal of the multiplexer 231.
  • the switch 232 outputs the corresponding analog signal to the output terminal of the multiplexer 231 according to the control of the timing control unit 260.
  • a 9-input 1-output multiplexer is disposed, the present invention is not limited to this configuration, and multiplexers such as 5-input 1-output and 11-input 1-output can also be disposed.
  • a 5-input 1-output multiplexer for example, effective pixel signals SIG0 to SIG3 and a correction signal DK are input.
  • an 11-input 1-output multiplexer for example, effective pixel signals SIG0 to SIG9 and a correction signal DK are input.
  • FIG. 11 is a block diagram showing an exemplary configuration of the signal processing unit 250 according to the first embodiment of the present technology.
  • the signal processing unit 250 includes a CDS (Correlated Double Sampling) processing unit 251, a correction unit 252, and a post-processing unit 253.
  • CDS Correlated Double Sampling
  • the CDS processing unit 251 performs CDS processing on the digital signals DOUT (effective pixel data or correction data) from each of the AD conversion units 230 and 270.
  • the CDS processing unit 251 supplies the signal after the CDS processing to the correction unit 252.
  • the correction unit 252 corrects effective pixel data based on the correction data.
  • Each of the selection units 310 and 390 outputs eight effective pixel signals and one correction signal. Since N selection units 310 and 390 are arranged, the total number of effective pixel signals driven simultaneously is 16 ⁇ N, and the total number of correction signals is 2 ⁇ N. These are AD converted in order, CDS processing is performed, and 16 ⁇ N effective pixel data and 2 ⁇ N correction data are input to the correction unit 252.
  • the correction unit 252 obtains, for example, statistics (average value, median value, and the like) of 2 ⁇ N pieces of correction data as correction values, and subtracts the correction values from each of the effective pixel data. Thereby, noise due to streaking and voltage fluctuation can be suppressed.
  • the light shielding pixels 331 are arranged above and below the effective pixel 351 in the vertical direction, streaking in the vertical direction is particularly suppressed.
  • the light shielding pixels 331 may be further disposed on the left and right of the effective pixel 351 in the horizontal direction, and the correction unit 252 may perform correction also in the horizontal direction. Thereby, streaking in the horizontal direction can also be suppressed.
  • the light shielding pixel 331 may be disposed only on the left and right of the effective pixel 351 in the horizontal direction, and the correction unit 252 may perform only the correction in the horizontal direction.
  • the post-processing unit 253 executes various post-processing as necessary. For example, contrast AF (Auto Focus) processing is performed as necessary, which determines the contrast of the image data and detects the focus based on the contrast.
  • the post-processing unit 253 supplies the processed effective pixel data to the image processing unit 120.
  • Such a method of detecting the focus from the contrast is called a contrast AF method.
  • FIG. 12 is a diagram showing an example of a signal selection order in the first embodiment of the present technology.
  • N ADCs 240 are arranged, but these ADCs 240 are divided into a plurality of groups of nine adjacent ADCs 240. Since the total number is N, the number of groups is N / 9. Since the multiplexer 231 is disposed for each ADC 240, the multiplexer 231 is similarly divided into N / 9 groups.
  • the timing control unit 260 sequentially selects nine multiplexers 231 in a predetermined order in each group to output the correction signal DK, and outputs the effective pixel signal SIG to the rest. For example, in the 9 k (k is an integer) AD conversion, the timing control unit 260 selects the 0th multiplexer 231 in the group and causes the 0th ADC 240 to output the correction signal DK. On the other hand, the timing control unit 260 controls the other multiplexer 231 to output the effective pixel signal SIG0 to the corresponding ADC 240.
  • the timing control unit 260 In the 9k + 1st AD conversion, the timing control unit 260 outputs the correction signal DK to the first ADC 240 in the group, and outputs the effective pixel signal SIG0 or SIG1 to the remaining ADCs 240. In the 9k + 2nd AD conversion, the timing control unit 260 outputs the correction signal DK to the second ADC 240 in the group, and outputs the effective pixel signal SIG1 or SIG2 to the remaining ADCs 240.
  • the timing control unit 260 causes the eighth ADC 240 in the group to output the correction signal DK, and outputs the effective pixel signal SIG7 to the remaining ADCs 240.
  • the signal processing unit 250 can obtain the correction data without interruption every AD conversion by shifting the ADC 240 as the output destination of the correction signal DK one by one. Thereby, the accuracy of the correction can be improved.
  • the timing control unit 260 sequentially selects the multiplexers 231 that output the correction signal DK in a predetermined order, it can also select randomly as illustrated in FIG. In this case, the timing control unit 260 generates a random number indicating any one of the nine multiplexers 231 in the 9k-th AD conversion, selects the multiplexer 231 relating to the random number, and outputs the correction signal DK. In the 9k + 1st AD conversion, the timing control unit 260 generates a random number indicating any one of the eight multiplexers 231 except the selected one, and selects the multiplexer 231 related to the random number to output the correction signal DK. .
  • the timing control unit 260 In the 9k + 2nd AD conversion, the timing control unit 260 generates a random number indicating any one of the seven multiplexers 231 except the selected one, and selects the multiplexer 231 related to the random number to output the correction signal DK. . Thereafter, the same procedure is repeated, and at the 9k + 8th time, the timing control unit 260 outputs the correction signal DK to the multiplexer 231 not selected from the 9kth to 9k + 7th times. Further, as illustrated in FIG. 14, the timing control unit 260 may periodically output the correction signal DK at timing when the high luminance signal is not included. In this case, the timing control unit 260 causes all the multiplexers 231 to output the correction signal DK at the 10 kth time.
  • the ADC 240 as the output destination of the correction signal DK is shifted one by one.
  • the correction signal DK of this timing since the streaking component is not mixed, by using the correction signal DK of this timing, it is possible to further stabilize the pure streaking amount observation.
  • the correction signal DK and the effective pixel signal by using the correction signal DK and the effective pixel signal, it is possible to observe the amount of streaking that occurs due to the influence of the high luminance signal.
  • FIG. 15 is a timing chart illustrating an example of reset level AD conversion operation according to the first embodiment of the present technology.
  • the scanning circuit 220 supplies the reset signal RST to the 16 effective pixels 351 and the two light-shielded pixels 331 for each effective pixel area 340.
  • effective pixel signals from eight pixels and one correction signal are output to the upper selection unit 310, and the rest are output to the lower side.
  • the levels of the effective pixel signal and the light-shielded pixel signal at the time of reset are referred to as “reset levels”.
  • the solid line indicates the DAC output voltage V DAC
  • the coarse dotted line indicates the first reset level such as the effective pixel signal SIG0.
  • An alternate long and short dash line indicates a second reset level such as the effective pixel signal SIG2.
  • Fine dotted lines indicate the ninth reset level such as the correction signal DK.
  • the timing control unit 260 controls the upper AD conversion unit 230 to set nine reset levels in a period from the timing T1 when a fixed time until the reset level is settled to the timing T2 thereafter. Select sequentially to convert AD. Assuming that the time required for each AD conversion is, for example, 57 nanoseconds (ns), it takes 9 ⁇ 57 nanoseconds (ns) to complete nine AD conversions. On the other hand, the lower AD conversion unit 270 also operates in parallel to perform AD conversion nine times.
  • the DAC output voltage V DAC is set to an initial value.
  • the ADC 240 updates the MSB based on the comparison result of the DAC output voltage V DAC and the reset level. For dotted reset level is higher than the solid line of the DAC output voltage V DAC, DAC output voltage V DAC is min V REF / 4, increases.
  • the ADC 240 updates the next digit of the MSB based on the comparison result of the DAC output voltage V DAC and the reset level. Since the reset level is higher than the DAC output voltage V DAC, DAC output voltage V DAC is min V REF / 8, raised. Subsequently, the sequential comparison is performed by the same procedure.
  • FIG. 16 is a timing chart illustrating an example of the signal level AD conversion operation according to the first embodiment of the present technology.
  • the scanning circuit 220 transfers charge from the photodiode 354 or the like by the transfer signal TRG.
  • the levels of the effective pixel signal and the light-shielded pixel signal after the transfer are called “signal levels”.
  • the timing control unit 260 controls the upper AD conversion unit 230 to control nine signal levels in a period from the timing T3 when a fixed time until the signal level is settled to the timing T4 thereafter. Select sequentially to convert AD. A value larger than the reset level is set to the bit depth when AD converting the signal level. For this reason, one AD conversion of the signal level requires, for example, a longer 83 nanoseconds (ns), and it takes 9 ⁇ 83 nanoseconds (ns) to complete nine AD conversions.
  • the CDS processing unit 251 in the subsequent stage obtains the difference between the reset level of the effective pixel signal and the signal level, and uses it as net effective pixel data. Also, the CDS processing unit 251 obtains the difference between the reset level of the correction signal and the signal level, and uses it as the net correction data.
  • FIG. 17 is an example of the entire view of the solid-state imaging device 200 according to the first embodiment of the present technology.
  • the effective pixel 351 uses the power supply from the power supply line 211 to generate an analog signal according to the amount of light received as an effective pixel signal.
  • the light-shielded pixel 331 generates a correction signal including a noise component generated in the power supply line 211.
  • the multiplexer 231 sequentially selects an effective pixel signal (such as SIG1) and the correction signal DK, and outputs the selected signal to the ADC 240.
  • the ADC 240 AD converts the effective pixel signal and outputs it to the signal processing unit 250 as effective pixel data, AD converts the correction signal, and outputs it as correction data.
  • the signal processing unit 250 corrects the effective pixel data based on the correction data.
  • FIG. 18 is a flowchart illustrating an example of the operation of the solid-state imaging device 200 according to the first embodiment of the present technology. This operation is started, for example, when a predetermined application for capturing image data is executed.
  • the solid-state imaging device 200 initializes a variable m to "0" (step S901), and determines whether m is "8" (step S902). If m is not "8" (step S902: No), the solid-state imaging device 200 AD converts the reset level of the effective pixel signal SIGm (step S903), and increments m (step S904). After step S904, the solid-state imaging device 200 repeats step S902 and subsequent steps.
  • step S902 When m is “8” (step S902: Yes), the solid-state imaging device 200 AD converts the reset level of the correction signal DK (step S905). Then, the solid-state imaging device 200 AD converts the signal levels of the effective pixel signals SIG0 to SIG7 and the correction signal DK in order (step S906). The solid-state imaging device 200 executes CDS processing (step S 907), and performs correction processing of effective pixel data based on the correction data (step S 908). After step S908, the solid-state imaging device 200 ends the operation for reading out part of the effective pixel area 340. By repeating steps S901 to S908 a certain number of times, one sheet of image data is read out.
  • the AD conversion unit 230 sequentially selects the effective pixel signal and the correction signal and performs AD conversion, the effective pixel signal and the correction signal are AD-connected in parallel.
  • the number of ADCs can be reduced compared to the case of conversion.
  • the effective pixels are arranged in the pixel array portion 210 by the Bayer arrangement, but since pixels of the same color are not adjacent in the Bayer arrangement, a plurality of effective pixel data of the same color are pixels There is a possibility that the image quality may deteriorate when adding.
  • the pixel array unit 210 of the first modification of the first embodiment is different from that of the first embodiment in that a plurality of effective pixels of the same color are arranged adjacent to each other.
  • FIG. 19 is an example of a plan view of the pixel array unit 210 in a first modified example of the first embodiment of the present technology.
  • four effective pixels of the same color are arranged adjacent to each other.
  • the G effective pixel 351 is disposed at the upper left of the effective pixel block 350
  • the G effective pixel 372 is disposed on the right side thereof.
  • the G effective pixel 373 is disposed below the effective pixel 351, and the G effective pixel 374 is disposed on the right side thereof.
  • four R pixels are arranged in the remaining effective pixel block 350.
  • four B pixels and four G pixels are arranged.
  • the signal processing unit 250 performs pixel addition on adjacent four effective pixel data of the same color in the pixel addition mode or the like.
  • the scanning circuit 220 sets the exposure time of half of the adjacent four pixels of the same color to a value different from the remaining exposure time. For example, the scanning circuit 220 exposes the effective pixel 351 and the effective pixel 374 at the lower right thereof for the exposure time TS. Next, the scanning circuit 220 exposes the effective pixel 372 and the lower left effective pixel 373 over an exposure time TL longer than the exposure time TS. Then, the scanning circuit 220 combines the effective pixel data exposed at the exposure time TS and the effective pixel data exposed at the exposure time TL by alpha synthesis or the like. Thereby, the dynamic range can be expanded.
  • the AF speed of the contrast AF is slower than that of the phase difference AF method.
  • the solid-state imaging device 200 of the second modification of the first embodiment is different from that of the first embodiment in that the focus is detected using a phase difference AF method.
  • FIG. 20 is an example of a plan view of the pixel array unit 210 according to a second modified example of the first embodiment of the present technology.
  • the pixel array unit 210 of the second modified example of the first embodiment rectangular effective pixels are arranged. Also in the light shielding areas 320 and 380, rectangular light shielding pixels are arranged.
  • a pair of effective pixels of the same color are arranged adjacent to each other in the horizontal direction.
  • the G effective pixel 372 is disposed on the right side of the G effective pixel 351.
  • a pair of B pixels is arranged on the right side of the effective pixel 372.
  • a pair of R pixels is disposed below the effective pixels 351 and 372, and two G pixels are disposed to the right of them.
  • the dashed-dotted line in FIG. 19 represents the position of the microlens.
  • the incident light of one of the two pupil-divided images is input to one of the pair of effective pixels, and the other incident light of the two pupil-divided images is input to the other of the pair of effective pixels Be done.
  • the signal processing unit 250 obtains a phase difference between the two images from the effective pixel data, and executes phase difference AF processing to detect a focus from the phase difference.
  • the focus can be detected at high speed as compared with the case where the contrast AF method is used.
  • a solid-state imaging device 200 according to a third modification of the first embodiment is different from the first embodiment in that a plurality of pixels with different sensitivities are arranged in the pixel array unit 210.
  • FIG. 21 is an example of a plan view of the pixel array unit 210 in a third modified example of the first embodiment of the present technology.
  • effective pixels 375 and effective pixels 376 having different light receiving areas are arranged.
  • the shape of the effective pixel 375 is, for example, a rhombus, and the shape of the effective pixel 376 is, for example, an octagon.
  • a diamond-shaped gap is generated, so the effective pixels 375 are disposed in this gap. Focusing only on the diamond effective pixels 375, these pixels are arranged in a Bayer arrangement.
  • these pixels are also arranged in the Bayer arrangement.
  • the light shielding pixels in a rhombus shape and the light shielding pixels in an octagonal shape are arranged.
  • the scanning circuit 220 exposes the effective pixel 375 and the effective pixel 376 in the same exposure time, and the signal processing unit 250 expands the dynamic range by combining the effective pixel data of the same color. it can. As a result, it is not necessary to change the exposure time and to perform imaging a plurality of times.
  • the dynamic pixel data can be combined to combine them.
  • the range can be expanded.
  • the solid-state imaging device 200 of the fourth modified example of the first embodiment is different from that of the first embodiment in that the ADC is reduced to half.
  • FIG. 22 is an example of a plan view of a pixel chip 201 in a fourth modified example of the first embodiment of the present technology.
  • the pixel chip 201 of the fourth modified example of the first embodiment is different from the first embodiment in that the light shielding area 380 and the selection unit 390 are not disposed.
  • FIG. 23 is a block diagram showing one configuration example of the logic chip 202 in the fourth modified example of the first embodiment of the present technology.
  • the logic chip 202 of the fourth modification of the first embodiment is different from that of the first embodiment in that the AD converter 270 is not disposed.
  • the number of ADCs is halved by the reduction of the AD conversion unit 270, the number of effective pixel signals that can be read simultaneously by the scanning circuit 220 is halved from 16 to 8 although the number of ADCs is halved.
  • the number of ADCs is reduced to half, so that the mounting area of the logic chip 202 can be reduced.
  • the light-shielded pixels are arranged, and the effective pixel data is corrected using the correction data from the light-shielded pixels.
  • the light-shielded pixels in addition to the effective pixels, the light-shielded pixels also need to be arranged in the pixel chip 201. Therefore, assuming that the size of the pixel chip 201 is constant, the effective pixels are The arrangement area is narrowed.
  • a high pass filter for passing high frequency components of the power supply signal from the power supply line 211 is provided instead of the light shielding pixels, and the high frequency components are used to correct effective pixel data Is different from the first embodiment in that
  • FIG. 24 is a plan view showing a configuration example of the pixel chip 201 in the second embodiment of the present technology.
  • the pixel chip 201 according to the second embodiment is different from the first embodiment in that the light blocking areas 320 and 380 are not disposed and the power supply fluctuation detection unit 280 is further disposed.
  • the power supply fluctuation detection unit 280 detects high frequency components of the power supply signal as the fluctuation of the power supply.
  • FIG. 25 is a block diagram showing a configuration example of the power supply fluctuation detection unit 280 in the second embodiment of the present technology.
  • the power supply fluctuation detection unit 280 includes a high pass filter 281 and an amplifier 282.
  • the high pass filter 281 passes high frequency components higher than a predetermined frequency in the power supply signal from the power supply line 211.
  • the high pass filter 281 supplies the high frequency component to the amplifier 282 as a correction signal.
  • the amplifier 282 amplifies the correction signal and supplies it to the selection units 310 and 390.
  • a high pass filter for passing high frequency components of the power supply signal is provided instead of the light shielding pixels, and the signal processing unit 250 uses the high frequency components to generate effective pixel data.
  • the signal processing unit 250 uses the high frequency components to generate effective pixel data.
  • the number of effective pixels can be increased as the number of light-shielded pixels is reduced.
  • the pixel size of the effective pixel can be increased.
  • the technology according to the present disclosure can be applied to various products.
  • the technology according to the present disclosure is realized as a device mounted on any type of mobile object such as a car, an electric car, a hybrid electric car, a motorcycle, a bicycle, personal mobility, an airplane, a drone, a ship, a robot May be
  • FIG. 26 is a block diagram showing a schematic configuration example of a vehicle control system that is an example of a mobile control system to which the technology according to the present disclosure can be applied.
  • Vehicle control system 12000 includes a plurality of electronic control units connected via communication network 12001.
  • the vehicle control system 12000 includes a drive system control unit 12010, a body system control unit 12020, an external information detection unit 12030, an in-vehicle information detection unit 12040, and an integrated control unit 12050.
  • a microcomputer 12051, an audio image output unit 12052, and an in-vehicle network I / F (interface) 12053 are illustrated as a functional configuration of the integrated control unit 12050.
  • the driveline control unit 12010 controls the operation of devices related to the driveline of the vehicle according to various programs.
  • the drive system control unit 12010 includes a drive force generation device for generating a drive force of a vehicle such as an internal combustion engine or a drive motor, a drive force transmission mechanism for transmitting the drive force to the wheels, and a steering angle of the vehicle. It functions as a control mechanism such as a steering mechanism that adjusts and a braking device that generates a braking force of the vehicle.
  • Body system control unit 12020 controls the operation of various devices equipped on the vehicle body according to various programs.
  • the body system control unit 12020 functions as a keyless entry system, a smart key system, a power window device, or a control device of various lamps such as a headlamp, a back lamp, a brake lamp, a blinker or a fog lamp.
  • the body system control unit 12020 may receive radio waves or signals of various switches transmitted from a portable device substituting a key.
  • Body system control unit 12020 receives the input of these radio waves or signals, and controls a door lock device, a power window device, a lamp and the like of the vehicle.
  • Outside vehicle information detection unit 12030 detects information outside the vehicle equipped with vehicle control system 12000.
  • an imaging unit 12031 is connected to the external information detection unit 12030.
  • the out-of-vehicle information detection unit 12030 causes the imaging unit 12031 to capture an image outside the vehicle, and receives the captured image.
  • the external information detection unit 12030 may perform object detection processing or distance detection processing of a person, a vehicle, an obstacle, a sign, characters on a road surface, or the like based on the received image.
  • the imaging unit 12031 is an optical sensor that receives light and outputs an electrical signal according to the amount of light received.
  • the imaging unit 12031 can output an electric signal as an image or can output it as distance measurement information.
  • the light received by the imaging unit 12031 may be visible light or non-visible light such as infrared light.
  • In-vehicle information detection unit 12040 detects in-vehicle information.
  • a driver state detection unit 12041 that detects a state of a driver is connected to the in-vehicle information detection unit 12040.
  • the driver state detection unit 12041 includes, for example, a camera for imaging the driver, and the in-vehicle information detection unit 12040 determines the degree of fatigue or concentration of the driver based on the detection information input from the driver state detection unit 12041. It may be calculated or it may be determined whether the driver does not go to sleep.
  • the microcomputer 12051 calculates a control target value of the driving force generation device, the steering mechanism or the braking device based on the information inside and outside the vehicle acquired by the outside information detecting unit 12030 or the in-vehicle information detecting unit 12040, and a drive system control unit A control command can be output to 12010.
  • the microcomputer 12051 controls the driving force generating device, the steering mechanism, the braking device, and the like based on the information around the vehicle acquired by the outside information detecting unit 12030 or the in-vehicle information detecting unit 12040 so that the driver can Coordinated control can be performed for the purpose of automatic driving that travels autonomously without depending on the operation.
  • the microcomputer 12051 can output a control command to the body system control unit 12020 based on the information outside the vehicle acquired by the external information detection unit 12030.
  • the microcomputer 12051 controls the headlamp according to the position of the preceding vehicle or oncoming vehicle detected by the external information detection unit 12030, and performs cooperative control for the purpose of antiglare such as switching the high beam to the low beam. It can be carried out.
  • the audio image output unit 12052 transmits an output signal of at least one of audio and image to an output device capable of visually or aurally notifying information to a passenger or the outside of a vehicle.
  • an audio speaker 12061, a display unit 12062, and an instrument panel 12063 are illustrated as output devices.
  • the display unit 12062 may include, for example, at least one of an on-board display and a head-up display.
  • FIG. 27 is a diagram illustrating an example of the installation position of the imaging unit 12031.
  • imaging units 12101, 12102, 12103, 12104, and 12105 are provided as the imaging unit 12031.
  • the imaging units 12101, 12102, 12103, 12104, and 12105 are provided, for example, at positions such as the front nose of the vehicle 12100, a side mirror, a rear bumper, a back door, and an upper portion of a windshield of a vehicle interior.
  • the imaging unit 12101 provided in the front nose and the imaging unit 12105 provided in the upper part of the windshield in the vehicle cabin mainly acquire an image in front of the vehicle 12100.
  • the imaging units 12102 and 12103 included in the side mirror mainly acquire an image of the side of the vehicle 12100.
  • the imaging unit 12104 provided in the rear bumper or the back door mainly acquires an image of the rear of the vehicle 12100.
  • the imaging unit 12105 provided on the top of the windshield in the passenger compartment is mainly used to detect a leading vehicle or a pedestrian, an obstacle, a traffic light, a traffic sign, a lane, or the like.
  • FIG. 26 shows an example of the imaging range of the imaging units 12101 to 12104.
  • the imaging range 12111 indicates the imaging range of the imaging unit 12101 provided on the front nose
  • the imaging ranges 12112 and 12113 indicate the imaging ranges of the imaging units 12102 and 12103 provided on the side mirrors
  • the imaging range 12114 indicates The imaging range of the imaging part 12104 provided in the rear bumper or the back door is shown. For example, by overlaying the image data captured by the imaging units 12101 to 12104, a bird's eye view of the vehicle 12100 viewed from above can be obtained.
  • At least one of the imaging units 12101 to 12104 may have a function of acquiring distance information.
  • at least one of the imaging units 12101 to 12104 may be a stereo camera including a plurality of imaging devices, or an imaging device having pixels for phase difference detection.
  • the microcomputer 12051 measures the distance to each three-dimensional object in the imaging ranges 12111 to 12114, and the temporal change of this distance (relative velocity with respect to the vehicle 12100). In particular, it is possible to extract a three-dimensional object traveling at a predetermined speed (for example, 0 km / h or more) in substantially the same direction as the vehicle 12100 as a leading vehicle, in particular by finding the it can. Further, the microcomputer 12051 can set an inter-vehicle distance to be secured in advance before the preceding vehicle, and can perform automatic brake control (including follow-up stop control), automatic acceleration control (including follow-up start control), and the like. As described above, it is possible to perform coordinated control for the purpose of automatic driving or the like that travels autonomously without depending on the driver's operation.
  • automatic brake control including follow-up stop control
  • automatic acceleration control including follow-up start control
  • the microcomputer 12051 converts three-dimensional object data relating to a three-dimensional object into a two-wheeled vehicle, an ordinary vehicle, a large vehicle, a pedestrian, a telephone pole, or other three-dimensional object It can be classified, extracted and used for automatic avoidance of obstacles. For example, the microcomputer 12051 identifies obstacles around the vehicle 12100 into obstacles visible to the driver of the vehicle 12100 and obstacles difficult to see.
  • the microcomputer 12051 determines the collision risk indicating the degree of risk of collision with each obstacle, and when the collision risk is a setting value or more and there is a possibility of a collision, through the audio speaker 12061 or the display unit 12062 By outputting a warning to the driver or performing forcible deceleration or avoidance steering via the drive system control unit 12010, driving support for collision avoidance can be performed.
  • At least one of the imaging units 12101 to 12104 may be an infrared camera that detects infrared light.
  • the microcomputer 12051 can recognize a pedestrian by determining whether a pedestrian is present in the images captured by the imaging units 12101 to 12104.
  • pedestrian recognition is, for example, a procedure for extracting feature points in images captured by the imaging units 12101 to 12104 as an infrared camera, and pattern matching processing on a series of feature points indicating the outline of an object to determine whether it is a pedestrian or not
  • the procedure is to determine
  • the audio image output unit 12052 generates a square outline for highlighting the recognized pedestrian.
  • the display unit 12062 is controlled so as to display a superimposed image. Further, the audio image output unit 12052 may control the display unit 12062 to display an icon or the like indicating a pedestrian at a desired position.
  • the technology according to the present disclosure may be applied to the imaging unit 12031 among the configurations described above.
  • the imaging device 100 in FIG. 1 can be applied to the imaging unit 12031.
  • the processing procedure described in the above embodiment may be regarded as a method having a series of these procedures, and a program for causing a computer to execute the series of procedures or a recording medium storing the program. You may catch it.
  • a recording medium for example, a CD (Compact Disc), an MD (Mini Disc), a DVD (Digital Versatile Disc), a memory card, a Blu-ray disc (Blu-ray (registered trademark) Disc) or the like can be used.
  • the present technology can also be configured as follows. (1) An effective pixel that generates an analog signal according to the amount of light received using a power supply from a power supply line as an effective pixel signal, A correction signal generation unit that generates an analog signal including a noise component generated in the power supply line as a correction signal; A selection circuit that sequentially selects and outputs the effective pixel signal and the correction signal; An analog-to-digital converter that performs processing of converting the output effective pixel signal into a digital signal and outputting it as effective pixel data and processing of converting the output correction signal into a digital signal and outputting it as correction data; And a signal processing unit configured to correct the effective pixel data based on the correction data.
  • the solid-state imaging device wherein the correction signal generation unit includes a light-shielded pixel that is shielded from light.
  • the correction signal generation unit includes a high pass filter that passes high frequency components higher than a predetermined frequency among the signals from the power supply line and outputs the high frequency components as the correction signal.
  • the analog-to-digital converter is a SAR ADC (Successive Approximation Register Analog to Digital Converter).
  • the solid-state imaging device according to any one of (1) to (4), wherein the timing control unit causes the correction signal to be output to any of the predetermined number of selection circuits and causes the remaining effective pixel signal to be output to the rest. .
  • the solid-state imaging device according to (5), wherein the timing control unit sequentially selects the predetermined number of the selection circuits in a predetermined order to output the correction signal.
  • the timing control unit generates a random number indicating any of the predetermined number of the selection circuits, selects the selection circuit indicated by the random numbers, and outputs the correction signal.
  • Image sensor It further comprises a timing control unit for controlling the operation timing of the selection circuit, A predetermined number of selection circuits are arranged,
  • the solid-state imaging device according to any one of (1) to (4), wherein the timing control unit causes the correction signal to be output to any of the predetermined number of selection circuits and causes
  • a predetermined number of the effective pixels are arranged in a pixel array unit in a two-dimensional grid shape,
  • the pixel array unit is divided into a plurality of effective pixel areas,
  • the solid-state imaging device according to any one of (1) to (7), wherein the selection circuit sequentially selects the effective pixel signal from any one of the plurality of effective pixel areas and the correction signal.
  • the solid-state imaging device according to (7), wherein the effective pixels are arranged in a Bayer arrangement in the pixel array unit.
  • each of a plurality of effective pixels adjacent in the pixel array unit photoelectrically converts light of the same color to generate the effective pixel signal.
  • the solid-state imaging device (11) The solid-state imaging device according to (7), wherein the pair of adjacent effective pixels in the pixel array unit is a pixel for detecting a phase difference between a pair of images. (12) The solid-state imaging device according to (7), wherein a plurality of effective pixels having mutually different light receiving areas are arranged in the pixel array portion.
  • An effective pixel that generates an analog signal according to the amount of received light using a power supply from a power supply line as an effective pixel signal, A correction signal generation unit that generates an analog signal including a noise component generated in the power supply line as a correction signal;
  • a selection circuit that sequentially selects and outputs the effective pixel signal and the correction signal;
  • An analog-to-digital converter that performs processing of converting the output effective pixel signal into a digital signal and outputting it as effective pixel data and processing of converting the output correction signal into a digital signal and outputting it as correction data;
  • a signal processing unit that corrects the effective pixel data based on the correction data;
  • An image processing unit configured to execute predetermined image processing on image data composed of the corrected effective pixel data;
  • An effective pixel signal generation procedure of generating an analog signal corresponding to the amount of light received as an effective pixel signal using a power supply from a power supply line;
  • Imaging apparatus 110 imaging lens 120 image processing unit 130 imaging control unit 140 recording unit 200 solid-state imaging device 201 pixel chip 202 logic chip 210 pixel array unit 220 scanning circuit 230, 270 AD conversion unit 231, 311, 391 multiplexer 232 switch 240 ADC 241 sample and hold circuit 242 DAC 243 comparator 244 SAR logic circuit 245 register 250 signal processing unit 251 CDS processing unit 252 correction unit 253 post-processing unit 260 timing control unit 280 power fluctuation detection unit 281 high-pass filter 282 amplifier 310, 390 selection unit 320, 380 light shielding area 330 light shielding pixel Block 331 light-shielded pixel 340 effective pixel area 350 effective pixel block 351, 372, 373, 374, 375, 376 effective pixel 352, 353, 356, 357, 360, 361, 364, 365 selection transistor 354, 355, 358, 359, 362, 363, 366, 367 photodiode 368 reset transistor 369 floating diffusion layer 370 amplification

Landscapes

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Abstract

アナログの画素信号をデジタル信号に変換する固体撮像素子において、ＡＤＣの個数を削減する。　有効画素は、電源線からの電源を用いて受光量に応じたアナログ信号を有効画素信号として生成する。補正信号生成部は、電源線に生じるノイズ成分を含むアナログ信号を補正信号として生成する。選択部は、有効画素信号と補正信号とを逐次選択して出力する。アナログデジタル変換器は、出力された有効画素信号をデジタル信号に変換して有効画素データとして出力する処理と出力された補正信号をデジタル信号に変換して補正データとして出力する処理とを行う。信号処理部は、補正データに基づいて有効画素データを補正する。

Description

固体撮像素子、撮像装置、および、固体撮像素子の制御方法
　本技術は、固体撮像素子、撮像装置、および、固体撮像素子の制御方法に関する。詳しくは、ＡＤＣ（Analog to Digital Converter）が設けられた固体撮像素子、撮像装置、および、固体撮像素子の制御方法に関する。
　従来、撮像装置として、例えば、ＣＣＤ（Charge Coupled Device）イメージセンサ、ＣＭＯＳ（Complementary MOS）イメージセンサ等を用いて構成される固体撮像装置が知られている。この固体撮像装置で、高輝度な被写体を撮像した場合、撮像画像に水平方向に帯状のストリーキングが生じる。また、電磁誘導などの要因により電源電圧が変動し、その電源電圧の変動により画像データに縞模様のノイズが発生することがある。このストリーキングや縞模様のノイズを抑制するために、例えば、遮光画素からの補正信号を用いて有効画素の画素信号を補正する固体撮像素子が提案されている（例えば、特許文献１参照。）。この固体撮像素子には、有効画素のカラムと、遮光画素のカラムとのそれぞれについてＡＤＣが配置される。
特開２００８－２８８８１６号公報
　上述の従来技術において、遮光画素からの補正信号は、電源電圧の変動に起因するノイズ成分を含む。このため、上述の固体撮像素子は、その補正信号をＡＤ（Analog to Digital）変換した値の統計量を画素信号のＡＤ変換値から減算することにより、ノイズ成分を除去してストリーキングや電圧変動によるノイズを抑制することができる。しかしながら、上述の従来技術では、遮光画素および有効画素の両方のカラムについてＡＤＣを配置するため、有効画素のカラムのみについてＡＤＣを配置する場合と比較してＡＤＣの個数が多くなり、実装面積やコストが増大する、という問題がある。
　本技術はこのような状況に鑑みて生み出されたものであり、アナログの画素信号をデジタル信号に変換する固体撮像素子において、ＡＤＣの個数を削減することを目的とする。
　本技術は、上述の問題点を解消するためになされたものであり、その第１の側面は、電源線からの電源を用いて受光量に応じたアナログ信号を有効画素信号として生成する有効画素と、上記電源線に生じるノイズ成分を含むアナログ信号を補正信号として生成する補正信号生成部と、上記有効画素信号と上記補正信号とを逐次選択して出力する選択回路と、上記出力された有効画素信号をデジタル信号に変換して有効画素データとして出力する処理と上記出力された補正信号をデジタル信号に変換して補正データとして出力する処理とを行うアナログデジタル変換器と、上記補正データに基づいて上記有効画素データを補正する信号処理部とを具備する固体撮像素子、および、その制御方法である。これにより、有効画素信号と補正信号とが逐次選択されてデジタル信号に変換されるという作用をもたらす。
　また、この第１の側面において、上記補正信号生成部は、遮光された遮光画素を含むものであってもよい。これにより、有効画素信号と遮光画素からの遮光画素信号とが逐次選択されるという作用をもたらす。
　また、この第１の側面において、上記補正信号生成部は、上記電源線からの信号のうち所定周波数より高い高周波数成分を通過させて上記補正信号として出力するハイパスフィルタを含むものであってもよい。これにより、電源線からの信号の高周波数成分と有効画素信号とが逐次選択されるという作用をもたらす。
　また、この第１の側面において、上記アナログデジタル変換器は、ＳＡＲＡＤＣ（Successive Approximation Register Analog to Digital Converter）であってもよい。これにより、有効画素信号と補正信号とがＳＡＲＡＤＣによりデジタル信号に変換されるという作用をもたらす。
　また、この第１の側面において、上記選択回路の動作タイミングを制御するタイミング制御部をさらに具備し、上記選択回路は、所定個数が配列され、上記タイミング制御部は、上記所定個数の上記選択回路のいずれかに上記補正信号を出力させるとともに残りに上記有効画素信号を出力させてもよい。これにより、逐次選択された選択回路からの補正信号が補正データに変換されるという作用をもたらす。
　また、この第１の側面において、上記タイミング制御部は、上記所定個数の上記選択回路を所定の順序で逐次選択して上記補正信号を出力させてもよい。これにより、所定の順序で選択された選択回路からの補正信号が補正データに変換されるという作用をもたらす。
　また、この第１の側面において、上記タイミング制御部は、上記所定個数の上記選択回路のいずれかを示す乱数を生成して当該乱数の示す上記選択回路を選択して上記補正信号を出力させてもよい。乱数の示す選択回路からの補正信号が補正データに変換されるという作用をもたらす。
　また、この第１の側面において、所定数の上記有効画素が、二次元格子状に画素アレイ部に配列され、上記画素アレイ部は、複数の有効画素エリアに分割され、上記選択回路は、上記複数の有効画素エリアのいずれかからの上記有効画素信号と上記補正信号とを逐次選択してもよい。これにより、複数の有効画素エリアのいずれかからの有効画素信号と補正信号とがデジタル信号に変換されるという作用をもたらす。
　また、この第１の側面において、上記画素アレイ部において、上記有効画素は、ベイヤー配列により配列されてもよい。これにより、ベイヤー配列の画素アレイ部からの有効画素信号がデジタル信号に変換されるという作用をもたらす。
　また、この第１の側面において、上記画素アレイ部において隣接する複数の有効画素のそれぞれは、同一の色の光を光電変換して上記有効画素信号を生成してもよい。これにより、隣接する複数の有効画素が同色の画素アレイ部からの有効画素信号がデジタル信号に変換されるという作用をもたらす。
　また、この第１の側面において、上記画素アレイ部において隣接する一対の上記有効画素は、一対の像の位相差を検出するための画素であってもよい。これにより、位相差から焦点が検出されるという作用をもたらす。
　また、この第１の側面において、上記画素アレイ部には、互いに受光面積の異なる複数の有効画素が配列されてもよい。これにより、互いに受光面積の異なる複数の有効画素が配列された画素アレイ部からの有効画素信号がデジタル信号に変換されるという作用をもたらす。
　また、本技術の第２の側面は、電源線からの電源を用いて受光量に応じたアナログ信号を有効画素信号として生成する有効画素と、上記電源線に生じるノイズ成分を含むアナログ信号を補正信号として生成する補正信号生成部と、上記有効画素信号と上記補正信号とを逐次選択して出力する選択回路と、上記出力された有効画素信号をデジタル信号に変換して有効画素データとして出力する処理と上記出力された補正信号をデジタル信号に変換して補正データとして出力する処理とを行うアナログデジタル変換器と、上記補正データに基づいて上記有効画素データを補正する信号処理部と、上記補正された有効画素データからなる画像データに対して所定の画像処理を実行する画像処理部とを具備する撮像装置である。
　本技術によれば、アナログの画素信号をデジタル信号に変換する固体撮像素子において、ＡＤＣの個数を削減することができるという優れた効果を奏し得る。なお、ここに記載された効果は必ずしも限定されるものではなく、本開示中に記載されたいずれかの効果であってもよい。
本技術の第１の実施の形態における撮像装置の一構成例を示すブロック図である。 本技術の第１の実施の形態における固体撮像素子の積層構造の一例を示す図である。 本技術の第１の実施の形態における画素チップの平面図の一例である。 本技術の第１の実施の形態におけるロジックチップの一構成例を示すブロック図である。 本技術の第１の実施の形態における画素アレイ部の平面図の一例である。 本技術の第１の実施の形態における遮光画素ブロックおよび有効画素ブロックの平面図の一例である。 本技術の第１の実施の形態における有効画素ブロックの回路図の一例である。 本技術の第１の実施の形態におけるＡＤ変換部の一構成例を示すブロック図である。 本技術の第１の実施の形態におけるＡＤＣの一構成例を示すブロック図である。 本技術の第１の実施の形態におけるマルチプレクサの回路図の一例である。 本技術の第１の実施の形態における信号処理部の一構成例を示すブロック図である。 本技術の第１の実施の形態における信号の選択順序の一例を示す図である。 本技術の第１の実施の形態におけるランダムに選択した順序の一例を示す図である。 本技術の第１の実施の形態における信号の選択順序の別の例を示す図である。 本技術の第１の実施の形態におけるリセットレベルのＡＤ変換動作の一例を示すタイミングチャートである。 本技術の第１の実施の形態における信号レベルのＡＤ変換動作の一例を示すタイミングチャートである。 本技術の第１の実施の形態における固体撮像素子の全体図の一例である。 本技術の第１の実施の形態における固体撮像素子の動作の一例を示すフローチャートである。 本技術の第１の実施の形態の第１の変形例における画素アレイ部の平面図の一例である。 本技術の第１の実施の形態の第２の変形例における画素アレイ部の平面図の一例である。 本技術の第１の実施の形態の第３の変形例における画素アレイ部の平面図の一例である。 本技術の第１の実施の形態の第４の変形例における画素チップの平面図の一例である。 本技術の第１の実施の形態の第４の変形例におけるロジックチップの一構成例を示すブロック図である。 本技術の第２の実施の形態における画素チップの一構成例を示す平面図である。 本技術の第２の実施の形態における電源揺れ検出部の一構成例を示すブロック図である。 車両制御システムの概略的な構成例を示すブロック図である。 撮像部の設置位置の一例を示す説明図である。
　以下、本技術を実施するための形態（以下、実施の形態と称する）について説明する。説明は以下の順序により行う。
　１．第１の実施の形態（有効画素信号と補正信号とを逐次選択する例）
　２．第２の実施の形態（有効画素信号とハイパスフィルタからの補正信号とを逐次選択する例）
　３．移動体への応用例
　＜１．第１の実施の形態＞
　［撮像装置の構成例］
　図１は、本技術の第１の実施の形態における撮像装置１００の一構成例を示すブロック図である。この撮像装置１００は、撮像機能を有する装置であり、撮像レンズ１１０、固体撮像素子２００、画像処理部１２０、撮像制御部１３０および記録部１４０を備える。撮像装置１００としては、デジタルカメラやスマートフォン、パーソナルコンピュータなどが想定される。
　撮像レンズ１１０は、被写体からの光を集光して固体撮像素子２００に導くものである。
　固体撮像素子２００は、撮像制御部１３０からの垂直同期信号ＶＳＹＮＣに同期して、画像データを撮像するものである。ここで、垂直同期信号ＶＳＹＮＣは、撮像のタイミングを示すタイミング信号である。例えば、３０ヘルツ（Ｈｚ）や６０ヘルツ（Ｈｚ）の周期信号が垂直同期信号ＶＳＹＮＣとして用いられる。固体撮像素子２００は、画像データを画像処理部１２０に信号線２０９を介して供給する。
　撮像制御部１３０は、固体撮像素子２００を制御するものである。この撮像制御部１３０は、垂直同期信号ＶＳＹＮＣや、露光時間を制御する信号などを固体撮像素子２００に信号線１３９を介して供給する。また、撮像制御部１３０は、例えば、撮像を開始させるための操作（シャッターボタンの押下など）が行われたときに、垂直同期信号ＶＳＹＮＣの供給を開始する。
　画像処理部１２０は、画像データに対して、デモザイク処理やホワイトバランス処理などの所定の画像処理を実行するものである。この画像処理部１２０は、処理後の画像データを記録部１４０に信号線１２９を介して供給する。記録部１４０は、画像データを記録するものである。
　図２は、本技術の第１の実施の形態における固体撮像素子２００の積層構造の一例を示す図である。この固体撮像素子２００は、画素チップ２０１と、その画素チップ２０１に積層されたロジックチップ２０２とを備える。
　［画素チップの構成例］
　図３は、本技術の第１の実施の形態における画素チップ２０１の平面図の一例である。画素チップ２０１は、二次元格子状に複数の画素が配列された画素アレイ部２１０を備える。ここで、画素アレイ部２１０に配列される画素は、遮光された遮光画素と遮光されていない有効画素とに分類される。これらのうち有効画素は、有効画素エリア３４０に配置される。また、遮光画素は、有効画素エリア３４０の周囲に設けられた遮光エリア３２０および３８０に配置される。また、遮光エリア３２０と画素アレイ部２１０の外周との間に選択部３１０が配置され、遮光エリア３８０と画素アレイ部２１０の外周との間に選択部３９０が配置される。選択部３１０および３９０の構成の詳細については後述する。
　例えば、画素アレイ部２１０には、Ｍ×Ｎ（ＭおよびＮは整数）個の有効画素エリア３４０が、Ｍ行×Ｎ列に配列される。そして、垂直方向に平行な所定方向を上方向として、有効画素エリア３４０の列のそれぞれについて、その上方に遮光エリア３２０が配置され、下方に遮光エリア３８０が配置される。また、遮光エリア３２０のそれぞれの上方に選択部３１０が配置され、遮光エリア３８０のそれぞれの下方に選択部３９０は配置される。有効画素エリア３４０がＮ列であるため、遮光エリア３２０、遮光エリア３８０、選択部３１０および選択部３９０のそれぞれは、Ｎ個ずつ配置される。
　［ロジックチップの構成例］
　図４は、本技術の第１の実施の形態におけるロジックチップ２０２の一構成例を示すブロック図である。このロジックチップ２０２は、走査回路２２０と、ＡＤ変換部２３０および２７０と、信号処理部２５０と、タイミング制御部２６０とを備える。
　タイミング制御部２６０は、撮像制御部１３０からの垂直同期信号ＶＳＹＮＣに同期して、ロジックチップ２０２内の回路のそれぞれの動作タイミングを制御するものである。
　走査回路２２０は、画素チップ２０１内の画素を所定の順序で駆動するものである。ＡＤ変換部２３０は、画素チップ２０１内の選択部３１０からのアナログ信号のそれぞれをデジタル信号に変換して信号処理部２５０に供給するものである。ＡＤ変換部２７０は、画素チップ２０１内の選択部３９０からのアナログ信号のそれぞれをデジタル信号に変換して信号処理部２５０に供給するものである。
　信号処理部２５０は、ＡＤ変換部２３０および２７０からのデジタル信号に対して所定の信号処理を実行して画像データを生成するものである。この信号処理部２５０は、画像データを画像処理部１２０に供給する。
　なお、画素チップ２０１に画素アレイ部２１０を配置し、それ以外をロジックチップ２０２に配置しているが、それぞれのチップへの配置は、この構成に限定されない。例えば、画素内の回路の一部をロジックチップ２０２に配置することもできる。また、ＡＤ変換部２３０および２７０の両方を配置しているが、一方のみを配置する構成とすることもできる。
　［画素アレイ部の構成例］
　図５は、本技術の第１の実施の形態における画素アレイ部２１０の平面図の一例である。選択部３１０には、４個のマルチプレクサ３１１が水平方向に配列され、遮光エリア３２０には、４個の遮光画素ブロック３３０が水平方向に配列される。有効画素エリア３４０には、３２個の有効画素ブロック３５０が８行×４列に配列される。また、遮光エリア３８０の構成は、遮光エリア３２０と同様である。選択部３９０にも、選択部３１０と同様に４個のマルチプレクサ３９１が水平方向に配置される。
　有効画素ブロック３５０の列ごとに、４本の垂直信号線が垂直方向に沿って配線される。有効画素ブロック３５０は４列であるため、有効画素エリア３４０の列ごとに計１６本の垂直信号線が配線される。上から１行目および２行目の有効画素ブロック３５０は、水平方向に平行な所定方向を左方向として、対応する列の左から４番目の垂直信号線に接続される。また、上から３行目および４行目の有効画素ブロック３５０は、対応する列の左から３番目の垂直信号線に接続される。また、上から５行目および６行目の有効画素ブロック３５０は、対応する列の左から２番目の垂直信号線に接続され、また、上から７行目および８行目の有効画素ブロック３５０は、対応する列の左から１番目の垂直信号線に接続される。
　また、遮光エリア３２０内のいずれかの遮光画素ブロック３３０は、１本の信号線を介してロジックチップ２０２と接続される。
　マルチプレクサ３１１のそれぞれには、４つの入力端子と２つの出力端子とが設けられる。それらの入力端子には、対応する列の４本の垂直信号線が接続される。また、出力端子は、２本の信号線を介してロジックチップ２０２と接続される。マルチプレクサ３１１は、走査回路２２０の制御に従って４本の垂直信号線のうち２本を選択し、それらからのアナログ信号をロジックチップ２０２へ出力する。
　なお、有効画素エリア３４０や遮光エリア３２０における画素ブロックの個数は、３２個や４個に限定されない。
　［画素ブロックの構成例］
　図６は、本技術の第１の実施の形態における遮光画素ブロック３３０および有効画素ブロック３５０の平面図の一例である。遮光画素ブロック３３０には、浮遊拡散層を共有する８個の遮光画素３３１が４行×２列に配列される。有効画素ブロック３５０には、浮遊拡散層を共有する８個の有効画素３５１が４行×２列にベイヤー配列で配列される。ベイヤー配列においては、赤色の光を光電変換するＲ(Red)の有効画素３５１と、緑色の光を光電変換するＧ(Green)の有効画素３５１と、青色の光を光電変換するＢ(Blue)の有効画素３５１とが配列される。これらの有効画素３５１および遮光画素３３１の形状は、例えば、正方形であり、全ての画素のサイズは同一である。
　また、有効画素エリア３４０当たりの有効画素ブロック３５０は、３２個であるため、有効画素エリア３４０ごとに、３２×８個の有効画素３５１が配列される。
　有効画素３５１は、電源線からの電源を用いて受光量に応じたアナログ信号を有効画素信号として生成するものである。遮光画素３３１は、その電源線に生じるノイズ成分を含むアナログ信号を補正信号として生成するものである。なお、遮光画素３３１は、特許請求の範囲に記載の補正信号生成部の一例である。
　図４に例示した走査回路２２０は、Ｎ列の有効画素エリア３４０のそれぞれにおいて、３２×８個のうち１６個の有効画素３５１を同時に選択して駆動する走査を行う。また、同時に走査回路２２０は、遮光エリア３２０および遮光エリア３８０のそれぞれについて１個の遮光画素３３１を選択して駆動する。この１６個を駆動する走査を１６回行うことにより、Ｎ列の有効画素エリア３４０のそれぞれにおいて３２×８個の有効画素信号が読み出される。この処理をＭ回行うことにより、全ての有効画素信号が読み出され、１枚の画像データが生成される。
　また、走査回路２２０は、それぞれの走査において駆動した１６個のうち８個の有効画素信号を選択部３１０からロジックチップ２０２へ出力させ、残りを選択部３９０からロジックチップ２０２へ出力させる。遮光エリア３２０からの補正信号もロジックチップ２０２に出力されるため、選択部３１０からは、８個の有効画素信号と１個の補正信号とからなる９個のアナログ信号が出力される。選択部３９０からも同様に９個のアナログ信号が出力される。
　なお、有効画素ブロック３５０や遮光画素ブロック３３０内の画素数は、８個に限定されない。
　図７は、本技術の第１の実施の形態における有効画素ブロック３５０の回路図の一例である。この有効画素ブロック３５０は、選択トランジスタ３５２、３５３、３５６、３５７、３６０、３６１、３６４および３６５と、フォトダイオード３５４、３５５、３５８、３５９、３６２、３６３、３６６および３６７とを備える。また、有効画素ブロック３５０は、リセットトランジスタ３６８、浮遊拡散層３６９、増幅トランジスタ３７０および選択トランジスタ３７１を備える。選択トランジスタ３５２等のトランジスタとして、例えば、Ｎ型のＭＯＳ（Metal-Oxide-Semiconductor）トランジスタが用いられる。なお、遮光画素ブロック３３０の回路構成は、有効画素ブロック３５０と同様である。
　フォトダイオード３５４、３５５、３５８、３５９、３６２、３６３、３６６および３６７のそれぞれは、受光した光を光電変換して電荷を生成するものである。
　選択トランジスタ３５２は、ロジックチップ２０２内の走査回路２２０からの転送信号ＴＲＧ０に従ってフォトダイオード３５４から浮遊拡散層３６９へ電荷を転送するものである。選択トランジスタ３５３は、走査回路２２０からの転送信号ＴＲＧ１に従ってフォトダイオード３５５から浮遊拡散層３６９へ電荷を転送するものである。
　選択トランジスタ３５６は、走査回路２２０からの転送信号ＴＲＧ２に従ってフォトダイオード３５８から浮遊拡散層３６９へ電荷を転送するものである。選択トランジスタ３５７は、走査回路２２０からの転送信号ＴＲＧ３に従ってフォトダイオード３５９から浮遊拡散層３６９へ電荷を転送するものである。
　また、選択トランジスタ３６０は、走査回路２２０からの転送信号ＴＲＧ４に従ってフォトダイオード３６２から浮遊拡散層３６９へ電荷を転送するものである。選択トランジスタ３６１は、走査回路２２０からの転送信号ＴＲＧ５に従ってフォトダイオード３６３から浮遊拡散層３６９へ電荷を転送するものである。
　選択トランジスタ３６４は、走査回路２２０からの転送信号ＴＲＧ６に従ってフォトダイオード３６６から浮遊拡散層３６９へ電荷を転送するものである。選択トランジスタ３６５は、走査回路２２０からの転送信号ＴＲＧ７に従ってフォトダイオード３６７から浮遊拡散層３６９へ電荷を転送するものである。
　浮遊拡散層３６９は、転送された電荷を蓄積して、蓄積した電荷の量に応じた電圧を生成するものである。リセットトランジスタ３６８は、走査回路２２０からのリセット信号ＲＳＴに従って浮遊拡散層３６９から電荷を引き抜いて、電荷量を初期化するものである。増幅トランジスタ３７０は、浮遊拡散層３６９の電圧を増幅するものである。選択トランジスタ３７１は、走査回路２２０からの選択信号ＳＥＬに従って、増幅された電圧の信号を有効画素信号として垂直信号線を介して選択部３１０等へ出力するものである。
　８個の有効画素３５１は、１つの浮遊拡散層３６９を共有しており、このような画素はＦＤ（Floating Diffusion）共有型の画素と呼ばれる。なお、ＦＤを共有する画素数は、８個に限定されない。また、ＦＤを共有しない画素を有効画素３５１として配置することもできる。
　　［ＡＤ変換部の構成例］
　図８は、本技術の第１の実施の形態におけるＡＤ変換部２３０の一構成例を示すブロック図である。このＡＤ変換部２３０は、選択部３１０のそれぞれについて、マルチプレクサ２３１およびＡＤＣ２４０を備える。選択部３１０の個数がＮ個であるため、マルチプレクサ２３１およびＡＤＣ２４０は、それぞれＮ個ずつ配置される。
　マルチプレクサ２３１には、選択部３１０からの有効画素信号ＳＩＧ０乃至ＳＩＧ７と、遮光エリア３２０からの補正信号ＤＫとからなる９個の信号が入力される。そして、マルチプレクサ２３１は、タイミング制御部２６０の制御に従って、それらの９個の信号を逐次選択し、アナログ信号ＡＩＮとしてＡＤＣ２４０に入力する。なお、マルチプレクサ２３１は、特許請求の範囲に記載の選択回路の一例である。
　ＡＤＣ２４０は、アナログ信号ＡＩＮをデジタル信号ＤＯＵＴに変換し、信号処理部２５０に出力するものである。
　［ＡＤＣの構成例］
　図９は、本技術の第１の実施の形態におけるＡＤＣ２４０の一構成例を示すブロック図である。このＡＤＣ２４０は、サンプル・ホールド回路２４１、ＤＡＣ（Digital to Analog Converter）２４２、コンパレータ２４３、ＳＡＲ（Successive Approximation Register）ロジック回路２４４およびレジスタ２４５を備える。
　サンプル・ホールド回路２４１は、アナログ信号ＡＩＮをサンプリングして保持するものである。このサンプル・ホールド回路２４１は、保持した信号の電圧を入力電圧ＶＩＮとしてコンパレータ２４３の非反転入力端子（＋）に入力する。
　ＤＡＣ２４２は、レジスタ２４５からのデジタル信号に対するＤＡ（Digital to Analog）変換により、ＤＡＣ出力電圧ＶＤＡＣを生成するものである。ＤＡＣ２４２は、ＤＡＣ出力電圧ＶＤＡＣをコンパレータ２４３の反転入力端子（－）に入力する。
　コンパレータ２４３は、入力電圧ＶＩＮと、ＤＡＣ出力電圧ＶＤＡＣとを比較するものである。このコンパレータ２４３は、比較結果をＣＯＭＰとしてＳＡＲロジック回路２４４に供給する。
　ＳＡＲロジック回路２４４は、逐次比較された比較結果ＣＯＭＰに基づいて、入力電圧ＶＩＮと、ＤＡＣ出力電圧ＶＤＡＣとが近似するようにレジスタ２４５の保持値を更新するものである。レジスタ２４５は、Ｍ（Ｍは整数）ビットのデータを保持するものである。
　初期状態においてレジスタ２４５は、例えば、中間スケールに設定され、ＤＡＣ出力電圧ＶＤＡＣは、所定の参照電圧をＶＲＥＦとして、ＶＲＥＦ／２に設定される。そして、コンパレータ２４３は、最初に入力電圧ＶＩＮと、ＶＲＥＦ／２のＤＡＣ出力電圧ＶＤＡＣとを比較する。入力電圧ＶＩＮがＤＡＣ出力電圧ＶＤＡＣより大きい場合、コンパレータ２４３は、例えば、ハイレベルの比較結果ＣＯＭＰを出力し、ＳＡＲロジック回路２４４は、レジスタ２４５のＭＳＢ（most significant bit）を「１」にする。そして、ＤＡＣ出力電圧ＶＤＡＣは、ＶＲＥＦ／４の分、上昇する。
　一方、入力電圧ＶＩＮがＤＡＣ出力電圧ＶＤＡＣ以下の場合、コンパレータ２４３は、ローレベルの比較結果ＣＯＭＰを出力し、ＳＡＲロジック回路２４４は、レジスタ２４５のＭＳＢを「０」にする。そして、ＤＡＣ出力電圧ＶＤＡＣは、ＶＲＥＦ／４の分、降下する。
　コンパレータ２４３は、次の比較を行い、ＳＡＲロジック回路２４４は、次の比較結果ＣＯＭＰに基づいてＭＳＢの次の桁を更新する。以下、同様の手順が、ＬＳＢ(Least Significant Bit/Byte)まで継続される。そして、レジスタ２４５は、保持したデジタル信号をＤＯＵＴとして信号処理部２５０に出力する。これにより、アナログ信号ＡＩＮ（有効画素信号または補正信号）が、デジタル信号ＤＯＵＴにＡＤ変換される。以下、有効画素信号をＡＤ変換したデジタル信号を「有効画素データ」と称し、補正信号をＡＤ変換したデジタル信号を「補正データ」と称する。
　このように、ＭＳＢから順に比較を行うＡＤＣ２４０は、ＳＡＲＡＤＣ（Successive Approximation Register Analog to Digital Converter）と呼ばれる。一方、のこぎり状のランプ信号とアナログ信号ＡＩＮとを比較して比較結果が反転するまでの時間を計時するＡＤＣは、傾斜型ＡＤＣと呼ばれる。この傾斜型ＡＤＣのＡＤ変換速度は、ＳＡＲＡＤＣよりも遅く、固体撮像素子においては、よく用いられる。そして、傾斜型ＡＤＣを用いる固体撮像素子では、有効画素信号と補正信号とのそれぞれについて傾斜型ＡＤＣが配置され、有効画素信号と補正信号とが並列にＡＤ変換される。
　これに対して、固体撮像素子２００では、有効画素信号と補正信号とを逐次選択してＡＤ変換するため、並列にＡＤ変換する場合と比較して、単位時間当たりのＡＤ変換回数が多くなる。このため、仮に傾斜型ＡＤＣを固体撮像素子２００に適用すると、ＡＤ変換に要する時間が長くなり、許容時間内に完了しないおそれがある。
　そこで、固体撮像素子２００では、傾斜型ＡＤＣよりも変換速度の速いＳＡＲＡＤＣを用いて、変換回数の増大の影響を抑制している。なお、固体撮像素子２００は、変換速度が高速なＡＤＣであれば、ＳＡＲＡＤＣ以外のＡＤＣを用いることもできる。例えば、デルタシグマ型ＡＤＣ、サイクリック型ＡＤＣや、パイプライン型ＡＤＣをＳＡＲＡＤＣの代わりに用いることもできる。
　［マルチプレクサの構成例］
　図１０は、本技術の第１の実施の形態におけるマルチプレクサ２３１の回路図の一例である。このマルチプレクサ２３１は、９個のスイッチ２３２を備える。これらのうち８個の一端には、有効画素信号ＳＩＧ０乃至ＳＩＧ７が入力される。また、残りの１個のスイッチ２３２の一端には、補正信号ＤＫが入力される。そして、スイッチ２３２のそれぞれの他端は、マルチプレクサ２３１の出力端子に共通に接続される。スイッチ２３２は、タイミング制御部２６０の制御に従って、対応するアナログ信号をマルチプレクサ２３１の出力端子に出力する。なお、９入力１出力のマルチプレクサを配置しているが、この構成に限定されず、５入力１出力や１１入力１出力などのマルチプレクサを配置することもできる。５入力１出力のマルチプレクサを用いる場合には、例えば、有効画素信号ＳＩＧ０乃至ＳＩＧ３と補正信号ＤＫとが入力される。また、１１入力１出力のマルチプレクサを用いる場合には、例えば、有効画素信号ＳＩＧ０乃至ＳＩＧ９と補正信号ＤＫとが入力される。
　［信号処理部の構成例］
　図１１は、本技術の第１の実施の形態における信号処理部２５０の一構成例を示すブロック図である。この信号処理部２５０は、ＣＤＳ（Correlated Double Sampling）処理部２５１、補正部２５２および後段処理部２５３を備える。
　ＣＤＳ処理部２５１は、ＡＤ変換部２３０および２７０のそれぞれからのデジタル信号ＤＯＵＴ（有効画素データまたは補正データ）に対してＣＤＳ処理を行うものである。ＣＤＳ処理部２５１は、ＣＤＳ処理後の信号を補正部２５２に供給する。
　補正部２５２は、補正データに基づいて有効画素データを補正するものである。選択部３１０および３９０のそれぞれは、８個の有効画素信号と１個の補正信号を出力する。選択部３１０および３９０は、Ｎ個ずつ配置されるため、同時に駆動される有効画素信号の総数は１６×Ｎ個であり、補正信号の総数は２×Ｎ個である。これらが順にＡＤ変換され、ＣＤＳ処理が実行されて１６×Ｎ個の有効画素データと、２×Ｎ個の補正データとが補正部２５２に入力される。補正部２５２は、例えば、２×Ｎ個の補正データの統計量（平均値や中央値など）を求めて補正値とし、有効画素データのそれぞれから補正値を減算する。これにより、ストリーキングや電圧変動によるノイズを抑制することができる。
　前述したように遮光画素３３１は、垂直方向において有効画素３５１の上下に配置されているため、特に、垂直方向のストリーキングが抑制される。なお、水平方向において有効画素３５１の左右に遮光画素３３１をさらに配置し、補正部２５２が水平方向においても補正を行ってもよい。これにより、水平方向のストリーキングも抑制することができる。また、遮光画素３３１を水平方向において有効画素３５１の左右にのみ配置し、補正部２５２が水平方向の補正のみを行ってもよい。
　後段処理部２５３は、各種の後段処理を必要に応じて実行するものである。例えば、画像データのコントラストを求め、そのコントラストに基づいて焦点を検出するコントラストＡＦ（Auto Focus）処理が必要に応じて実行される。この後段処理部２５３は、処理後の有効画素データを画像処理部１２０に供給する。このようにコントラストから焦点を検出する方式は、コントラストＡＦ方式と呼ばれる。
　図１２は、本技術の第１の実施の形態における信号の選択順序の一例を示す図である。固体撮像素子２００には、Ｎ個のＡＤＣ２４０が配置されるが、これらのＡＤＣ２４０は、隣接する９個のＡＤＣ２４０からなる複数のグループに分割される。総数がＮ個であるため、グループの個数はＮ／９個となる。マルチプレクサ２３１は、ＡＤＣ２４０ごとに配置されるため、マルチプレクサ２３１も同様にＮ／９個のグループに分割される。
　タイミング制御部２６０は、それぞれのグループ内において、９個のマルチプレクサ２３１を所定順序で逐次選択して補正信号ＤＫを出力させ、残りに有効画素信号ＳＩＧを出力させる。例えば、９ｋ（ｋは整数）回目のＡＤ変換においてタイミング制御部２６０は、グループ内の０番目のマルチプレクサ２３１を選択して０番目のＡＤＣ２４０に補正信号ＤＫを出力させる。一方、タイミング制御部２６０は、他のマルチプレクサ２３１を制御して、有効画素信号ＳＩＧ０を対応するＡＤＣ２４０を出力させる。
　９ｋ＋１回目のＡＤ変換においてタイミング制御部２６０は、グループ内の１番目のＡＤＣ２４０へ補正信号ＤＫを出力させ、残りのＡＤＣ２４０へ有効画素信号ＳＩＧ０またはＳＩＧ１を出力させる。９ｋ＋２回目のＡＤ変換においてタイミング制御部２６０は、グループ内の２番目のＡＤＣ２４０へ補正信号ＤＫを出力させ、残りのＡＤＣ２４０へ有効画素信号ＳＩＧ１またはＳＩＧ２を出力させる。
　以下、同様に補正信号ＤＫを変換するＡＤＣ２４０を１つずつシフトし、９ｋ＋８回目においてタイミング制御部２６０は、グループ内の８番目のＡＤＣ２４０へ補正信号ＤＫを出力させ、残りのＡＤＣ２４０へ有効画素信号ＳＩＧ７を出力させる。
　このように、補正信号ＤＫの出力先のＡＤＣ２４０を１つずつシフトすることにより、信号処理部２５０は、ＡＤ変換のたびに補正データを途切れることなく取得することができる。これにより、補正の精度を向上させることができる。
　なお、タイミング制御部２６０は、補正信号ＤＫを出力するマルチプレクサ２３１を所定順序で逐次選択しているが、図１３に例示するようにランダムに選択することもできる。この場合にタイミング制御部２６０は、９ｋ回目のＡＤ変換において、９個のマルチプレクサ２３１のいずれかを示す乱数を生成し、その乱数に係るマルチプレクサ２３１を選択して補正信号ＤＫを出力させる。９ｋ＋１回目のＡＤ変換において、タイミング制御部２６０は、選択済みのものを除く８個のマルチプレクサ２３１のいずれかを示す乱数を生成し、その乱数に係るマルチプレクサ２３１を選択して補正信号ＤＫを出力させる。９ｋ＋２回目のＡＤ変換において、タイミング制御部２６０は、選択済みのものを除く７個のマルチプレクサ２３１のいずれかを示す乱数を生成し、その乱数に係るマルチプレクサ２３１を選択して補正信号ＤＫを出力させる。以下同様の手順を繰り返し、９ｋ＋８回目において、タイミング制御部２６０は、９ｋ回目から９ｋ＋７回目までに選択しなかったマルチプレクサ２３１に補正信号ＤＫを出力させる。また、タイミング制御部２６０は、図１４に例示するように、高輝度信号が含まれないタイミングで定期的にさらに補正信号ＤＫを出力させてもよい。この場合には、１０ｋ回目においてタイミング制御部２６０は、全てのマルチプレクサ２３１に補正信号ＤＫを出力させる。そして、１０ｋ＋１乃至１０ｋ＋９回目において、補正信号ＤＫの出力先のＡＤＣ２４０を１つずつシフトさせる。１０ｋ回目においては、ストリーキング成分が混入することがないので、このタイミングの補正信号ＤＫを用いることによって、純粋のストリーキング量観測をより安定化させることができる。また、１０ｋ＋１乃至１０ｋ＋９回目においては、補正信号ＤＫおよび有効画素信号を用いることにより、高輝度信号からの影響を受けて発生するストリーキングの量を観測することができる。
　図１５は、本技術の第１の実施の形態におけるリセットレベルのＡＤ変換動作の一例を示すタイミングチャートである。走査回路２２０は、有効画素エリア３４０ごとに、１６個の有効画素３５１と２個の遮光画素３３１とにリセット信号ＲＳＴを供給する。これらのうち８個の画素からの有効画素信号と１個の補正信号とが上側の選択部３１０に出力され、残りは下側に出力される。このリセット時の有効画素信号および遮光画素信号のレベルは、「リセットレベル」と呼ばれる。同図において、実線は、ＤＡＣ出力電圧ＶＤＡＣを示し、粗い点線は、有効画素信号ＳＩＧ０などの１回目のリセットレベルを示す。一点鎖線は、有効画素信号ＳＩＧ２などの２回目のリセットレベルを示す。細かい点線は、補正信号ＤＫなどの９回目のリセットレベルを示す。
　リセットレベルが静定するまでの一定時間が経過したときのタイミングＴ１から、その後のタイミングＴ２までの間において、タイミング制御部２６０は、上側のＡＤ変換部２３０を制御して９個のリセットレベルを逐次選択してＡＤ変換させる。それぞれのＡＤ変換に要する時間を例えば、５７ナノ秒（ｎｓ）とすると、９回分のＡＤ変換が完了するまでに９×５７ナノ秒（ｎｓ）を要する。一方、下側のＡＤ変換部２７０も並列に動作してＡＤ変換を９回に亘って行う。
　タイミングＴ１においてＤＡＣ出力電圧ＶＤＡＣは、初期値に設定される。タイミングＴ１からＴ１１までの期間において、ＡＤＣ２４０は、ＤＡＣ出力電圧ＶＤＡＣとリセットレベルとの比較結果に基づいてＭＳＢを更新する。点線のリセットレベルが実線のＤＡＣ出力電圧ＶＤＡＣより高いため、ＤＡＣ出力電圧ＶＤＡＣは、ＶＲＥＦ／４の分、上昇する。タイミングＴ１１からＴ１２までの期間において、ＡＤＣ２４０は、ＤＡＣ出力電圧ＶＤＡＣとリセットレベルとの比較結果に基づいてＭＳＢの次の桁を更新する。リセットレベルがＤＡＣ出力電圧ＶＤＡＣより高いため、ＤＡＣ出力電圧ＶＤＡＣは、ＶＲＥＦ／８の分、上昇する。以下、同様の手順により、逐次比較が行われる。
　図１６は、本技術の第１の実施の形態における信号レベルのＡＤ変換動作の一例を示すタイミングチャートである。走査回路２２０は、リセットの後に、転送信号ＴＲＧにより電荷をフォトダイオード３５４等から転送させる。この転送後の有効画素信号および遮光画素信号のレベルは、「信号レベル」と呼ばれる。
　信号レベルが静定するまでの一定時間が経過したときのタイミングＴ３から、その後のタイミングＴ４までの間において、タイミング制御部２６０は、上側のＡＤ変換部２３０を制御して９個の信号レベルを逐次選択してＡＤ変換させる。信号レベルをＡＤ変換する際のビット深度には、リセットレベルよりも大きな値が設定される。このため、信号レベルの１回のＡＤ変換には、例えば、より長い８３ナノ秒（ｎｓ）を要し、９回分のＡＤ変換が完了するまでに９×８３ナノ秒（ｎｓ）を要する。
　後段のＣＤＳ処理部２５１は、有効画素信号のリセットレベルと信号レベルとの差分を求め、正味の有効画素データとする。また、ＣＤＳ処理部２５１は、補正信号のリセットレベルと信号レベルとの差分を求め、正味の補正データとする。
　図１７は、本技術の第１の実施の形態における固体撮像素子２００の全体図の一例である。有効画素３５１は、電源線２１１からの電源を用いて受光量に応じたアナログ信号を有効画素信号として生成する。また、遮光画素３３１は、その電源線２１１に生じるノイズ成分を含む補正信号を生成する。
　マルチプレクサ２３１は、有効画素信号（ＳＩＧ１など）と補正信号ＤＫとを逐次選択してＡＤＣ２４０に出力する。ＡＤＣ２４０は、有効画素信号をＡＤ変換して有効画素データとして信号処理部２５０に出力し、補正信号をＡＤ変換して補正データとして出力する。信号処理部２５０は、補正データに基づいて有効画素データを補正する。
　［固体撮像素子の動作例］
　図１８は、本技術の第１の実施の形態における固体撮像素子２００の動作の一例を示すフローチャートである。この動作は、例えば、画像データを撮像するための所定のアプリケーションが実行されたときに開始される。
　固体撮像素子２００は、変数ｍを「０」に初期化し（ステップＳ９０１）、ｍが「８」であるか否かを判断する（ステップＳ９０２）。ｍが「８」でない場合に（ステップＳ９０２：Ｎｏ）、固体撮像素子２００は、有効画素信号ＳＩＧｍのリセットレベルをＡＤ変換し（ステップＳ９０３）、ｍをインクリメントする（ステップＳ９０４）。ステップＳ９０４の後に固体撮像素子２００は、ステップＳ９０２以降を繰り返す。
　ｍが「８」である場合に（ステップＳ９０２：Ｙｅｓ）、固体撮像素子２００は、補正信号ＤＫのリセットレベルをＡＤ変換する（ステップＳ９０５）。そして、固体撮像素子２００は、有効画素信号ＳＩＧ０乃至ＳＩＧ７と補正信号ＤＫとのそれぞれの信号レベルを順にＡＤ変換する（ステップＳ９０６）。固体撮像素子２００は、ＣＤＳ処理を実行し（ステップＳ９０７）、補正データに基づいて有効画素データの補正処理を行う（ステップＳ９０８）。ステップＳ９０８の後に固体撮像素子２００は、有効画素エリア３４０の一部を読み出すための動作を終了する。ステップＳ９０１乃至Ｓ９０８を一定回数繰り返すことにより、１枚の画像データが読み出される。
　このように、本技術の第１の実施の形態によれば、ＡＤ変換部２３０が有効画素信号と補正信号とを逐次選択してＡＤ変換するため、有効画素信号と補正信号とを並列にＡＤ変換する場合と比較してＡＤＣの個数を削減することができる。
　［第１の変形例］
　上述の第１の実施の形態では、ベイヤー配列により有効画素を画素アレイ部に２１０に配列していたが、ベイヤー配列では同色の画素が隣り合っていないため、同色の複数の有効画素データを画素加算する際に画質が低下するおそれがある。この第１の実施の形態の第１の変形例の画素アレイ部２１０は、同色の複数の有効画素を隣接して配置した点において第１の実施の形態と異なる。
　図１９は、本技術の第１の実施の形態の第１の変形例における画素アレイ部２１０の平面図の一例である。同図に例示するように、第１の実施の形態の第１の変形例では、同色の４個の有効画素が隣接して配置される。例えば、Ｇの有効画素３５１が有効画素ブロック３５０の左上に配置され、その右側にＧの有効画素３７２が配置される。また、有効画素３５１の下方にＧの有効画素３７３が配置され、その右側にＧの有効画素３７４が配置される。有効画素ブロック３５０において残りには、Ｒ画素が４つ配置される。その右側の有効画素ブロック３５０には、４個のＢ画素と４個のＧ画素とが配置される。
　信号処理部２５０は、画素加算モードなどにおいて、隣接する同色の４個の有効画素データを画素加算する。
　また、走査回路２２０は、ダイナミックレンジを拡大するモードにおいて、隣接する同色の４個の画素のうち半分の露光時間を、残りの露光時間と異なる値に設定する。例えば、走査回路２２０は、有効画素３５１と、その右下の有効画素３７４とを露光時間ＴＳに亘って露光させる。次に、走査回路２２０は、有効画素３７２と、その左下の有効画素３７３とを、露光時間ＴＳより長い露光時間ＴＬに亘って露光させる。そして、走査回路２２０は、露光時間ＴＳで露光した有効画素データと、露光時間ＴＬで露光した有効画素データとをアルファ合成などにより合成する。これにより、ダイナミックレンジを拡大することができる。
　このように、本技術の第１の実施の形態では、同色の複数の有効画素を隣接して配置したため、隣接する画素の色が異なるベイヤー配列の場合と比較して、画素加算した画像データの画質を向上させることができる。
　［第２の変形例］
　上述の第１の実施の形態では、コントラストＡＦ方式を用いて焦点を検出していたが、コントラストＡＦは、位相差ＡＦ方式と比較して、ＡＦ速度が遅くなってしまう。この第１の実施の形態の第２の変形例の固体撮像素子２００は、位相差ＡＦ方式を用いて焦点を検出する点において第１の実施の形態と異なる。
　図２０は、本技術の第１の実施の形態の第２の変形例における画素アレイ部２１０の平面図の一例である。この第１の実施の形態の第２の変形例の画素アレイ部２１０には、長方形の有効画素が配列される。遮光エリア３２０や３８０においても長方形の遮光画素が配列される。
　また、画素アレイ部２１０においては、同色の一対の有効画素が、水平方向に隣接して配列される。例えば、Ｇの有効画素３５１の右側にＧの有効画素３７２が配置される。その有効画素３７２の右側に一対のＢ画素が配列される。有効画素３５１および３７２の下方には一対のＲ画素が配置され、それらの右側には２つのＧ画素が配置される。
　そして、隣接する同色の一対の有効画素には、同一のマイクロレンズが設けられる。図１９における一点鎖線は、マイクロレンズの位置を表す。これらの一対の有効画素の一方には、瞳分割された２つの像の一方の入射光が入力され、一対の有効画素の他方には、瞳分割された２つの像の他方の入射光が入力される。信号処理部２５０は、有効画素データから２つの像の位相差を求め、その位相差から焦点を検出する位相差ＡＦ処理を実行する。
　このように、本技術の第１の実施の形態の第２の変形例では、位相差ＡＦ方式を用いるため、コントラストＡＦ方式を用いる場合と比較して、高速に焦点を検出することができる。
　［第３の変形例］
　上述の第１の実施の形態では、画素アレイ部２１０に同じサイズの画素を配列していた。この構成では、全画素の感度が同一となり、ダイナミックレンジを向上させるには、露光時間を変えて複数回に亘って画像データを撮像しなければならなくなる。この第１の実施の形態の第３の変形例の固体撮像素子２００は、感度の異なる複数の画素を画素アレイ部２１０に配置した点において第１の実施の形態と異なる。
　図２１は、本技術の第１の実施の形態の第３の変形例における画素アレイ部２１０の平面図の一例である。この第１の実施の形態の第３の変形例の画素アレイ部２１０には、受光面積の異なる有効画素３７５と有効画素３７６とが配列される。有効画素３７５の形状は、例えば、ひし形であり、有効画素３７６の形状は、例えば、８角形である。有効画素３７６を配列すると、ひし形の隙間が生じるため、この隙間に有効画素３７５が配置される。ひし形の有効画素３７５のみに注目すると、これらの画素はベイヤー配列で配置される。また、８角形の有効画素３７６のみを注目すると、これらの画素もベイヤー配列で配置される。遮光エリア３２０や３８０においても同様に、ひし形の遮光画素と８角形の遮光画素とが配列される。
　受光面積が異なるため、有効画素３７５と有効画素３７６とのそれぞれの感度は異なる。このため、走査回路２２０が同一の露光時間で有効画素３７５および有効画素３７６を露光し、信号処理部２５０が、それらの有効画素データを同色同士で合成することにより、ダイナミックレンジを拡大することができる。これにより、露光時間を変えて複数回に亘って撮像する必要がなくなる。
　このように、本技術の第１の実施の形態の第３の変形例によれば、受光面積の異なる有効画素３７５と有効画素３７６とを配列したため、それらの有効画素データを合成することによりダイナミックレンジを拡大することができる。
　［第４の変形例］
　上述の第１の実施の形態では、３２×８個の有効画素３５１を配列した有効画素エリア３４０の列ごとに、２つのＡＤＣを配置していたが、画素数が増大するほど、ＡＤＣの個数が増大してしまう。この第１の実施の形態の第４の変形例の固体撮像素子２００は、ＡＤＣを半分に削減した点において第１の実施の形態と異なる。
　図２２は、本技術の第１の実施の形態の第４の変形例における画素チップ２０１の平面図の一例である。この第１の実施の形態の第４の変形例の画素チップ２０１は、遮光エリア３８０および選択部３９０が配置されない点において第１の実施の形態と異なる。
　図２３は、本技術の第１の実施の形態の第４の変形例におけるロジックチップ２０２の一構成例を示すブロック図である。この第１の実施の形態の第４の変形例のロジックチップ２０２は、ＡＤ変換部２７０が配置されない点において第１の実施の形態と異なる。ＡＤ変換部２７０の削減により、ＡＤＣの個数が半分になるものの、有効画素エリア３４０ごとに、走査回路２２０が同時に読み出すことのできる有効画素信号の個数は、１６個から８個に半減する。
　このように、本技術の第１の実施の形態の第４の変形例によれば、ＡＤＣの個数を半分に削減したため、ロジックチップ２０２の実装面積を小さくすることができる。
　＜第２の実施の形態＞
　上述の第１の実施の形態では、遮光画素を配置して、その遮光画素からの補正データを用いて有効画素データを補正していた。しかし、この構成では、有効画素に加えて、遮光画素も画素チップ２０１に配置する必要があるため、画素チップ２０１のサイズを一定とすると、有効画素のみを配置する場合と比較して有効画素を配置面積が狭くなってしまう。この第２の実施の形態の固体撮像素子２００は、電源線２１１からの電源信号の高周波数成分を通過させるハイパスフィルタを遮光画素の代わりに設け、その高周波数成分を用いて有効画素データを補正する点において第１の実施の形態と異なる。
　図２４は、本技術の第２の実施の形態における画素チップ２０１の一構成例を示す平面図である。この第２の実施の形態の画素チップ２０１は、遮光エリア３２０および３８０が配置されず、電源揺れ検出部２８０がさらに配置される点において第１の実施の形態と異なる。電源揺れ検出部２８０は、電源の揺れとして、電源信号の高周波数成分を検出するものである。
　図２５は、本技術の第２の実施の形態における電源揺れ検出部２８０の一構成例を示すブロック図である。この電源揺れ検出部２８０は、ハイパスフィルタ２８１およびアンプ２８２を備える。
　ハイパスフィルタ２８１は、電源線２１１からの電源信号のうち、所定周波数より高い高周波数成分を通過させるものである。このハイパスフィルタ２８１は、その高周波数成分を補正信号としてアンプ２８２に供給する。アンプ２８２は、補正信号を増幅して、選択部３１０や３９０に供給するものである。
　このように、本技術の第２の実施の形態では、電源信号の高周波数成分を通過させるハイパスフィルタを遮光画素の代わりに設け、信号処理部２５０がその高周波数成分を用いて有効画素データを補正するため、遮光画素を設ける必要がなくなる。これにより、遮光画素を削減した分、有効画素の画素数を多くすることができる。あるいは、有効画素の画素サイズを大きくすることができる。
　＜３．移動体への応用例＞
　本開示に係る技術（本技術）は、様々な製品へ応用することができる。例えば、本開示に係る技術は、自動車、電気自動車、ハイブリッド電気自動車、自動二輪車、自転車、パーソナルモビリティ、飛行機、ドローン、船舶、ロボット等のいずれかの種類の移動体に搭載される装置として実現されてもよい。
　図２６は、本開示に係る技術が適用され得る移動体制御システムの一例である車両制御システムの概略的な構成例を示すブロック図である。
　車両制御システム１２０００は、通信ネットワーク１２００１を介して接続された複数の電子制御ユニットを備える。図２６に示した例では、車両制御システム１２０００は、駆動系制御ユニット１２０１０、ボディ系制御ユニット１２０２０、車外情報検出ユニット１２０３０、車内情報検出ユニット１２０４０、及び統合制御ユニット１２０５０を備える。また、統合制御ユニット１２０５０の機能構成として、マイクロコンピュータ１２０５１、音声画像出力部１２０５２、及び車載ネットワークＩ／Ｆ（ｉｎｔｅｒｆａｃｅ）１２０５３が図示されている。
　駆動系制御ユニット１２０１０は、各種プログラムにしたがって車両の駆動系に関連する装置の動作を制御する。例えば、駆動系制御ユニット１２０１０は、内燃機関又は駆動用モータ等の車両の駆動力を発生させるための駆動力発生装置、駆動力を車輪に伝達するための駆動力伝達機構、車両の舵角を調節するステアリング機構、及び、車両の制動力を発生させる制動装置等の制御装置として機能する。
　ボディ系制御ユニット１２０２０は、各種プログラムにしたがって車体に装備された各種装置の動作を制御する。例えば、ボディ系制御ユニット１２０２０は、キーレスエントリシステム、スマートキーシステム、パワーウィンドウ装置、あるいは、ヘッドランプ、バックランプ、ブレーキランプ、ウィンカー又はフォグランプ等の各種ランプの制御装置として機能する。この場合、ボディ系制御ユニット１２０２０には、鍵を代替する携帯機から発信される電波又は各種スイッチの信号が入力され得る。ボディ系制御ユニット１２０２０は、これらの電波又は信号の入力を受け付け、車両のドアロック装置、パワーウィンドウ装置、ランプ等を制御する。
　車外情報検出ユニット１２０３０は、車両制御システム１２０００を搭載した車両の外部の情報を検出する。例えば、車外情報検出ユニット１２０３０には、撮像部１２０３１が接続される。車外情報検出ユニット１２０３０は、撮像部１２０３１に車外の画像を撮像させるとともに、撮像された画像を受信する。車外情報検出ユニット１２０３０は、受信した画像に基づいて、人、車、障害物、標識又は路面上の文字等の物体検出処理又は距離検出処理を行ってもよい。
　撮像部１２０３１は、光を受光し、その光の受光量に応じた電気信号を出力する光センサである。撮像部１２０３１は、電気信号を画像として出力することもできるし、測距の情報として出力することもできる。また、撮像部１２０３１が受光する光は、可視光であっても良いし、赤外線等の非可視光であっても良い。
　車内情報検出ユニット１２０４０は、車内の情報を検出する。車内情報検出ユニット１２０４０には、例えば、運転者の状態を検出する運転者状態検出部１２０４１が接続される。運転者状態検出部１２０４１は、例えば運転者を撮像するカメラを含み、車内情報検出ユニット１２０４０は、運転者状態検出部１２０４１から入力される検出情報に基づいて、運転者の疲労度合い又は集中度合いを算出してもよいし、運転者が居眠りをしていないかを判別してもよい。
　マイクロコンピュータ１２０５１は、車外情報検出ユニット１２０３０又は車内情報検出ユニット１２０４０で取得される車内外の情報に基づいて、駆動力発生装置、ステアリング機構又は制動装置の制御目標値を演算し、駆動系制御ユニット１２０１０に対して制御指令を出力することができる。例えば、マイクロコンピュータ１２０５１は、車両の衝突回避あるいは衝撃緩和、車間距離に基づく追従走行、車速維持走行、車両の衝突警告、又は車両のレーン逸脱警告等を含むＡＤＡＳ(Advanced Driver Assistance System)の機能実現を目的とした協調制御を行うことができる。
　また、マイクロコンピュータ１２０５１は、車外情報検出ユニット１２０３０又は車内情報検出ユニット１２０４０で取得される車両の周囲の情報に基づいて駆動力発生装置、ステアリング機構又は制動装置等を制御することにより、運転者の操作に拠らずに自律的に走行する自動運転等を目的とした協調制御を行うことができる。
　また、マイクロコンピュータ１２０５１は、車外情報検出ユニット１２０３０で取得される車外の情報に基づいて、ボディ系制御ユニット１２０２０に対して制御指令を出力することができる。例えば、マイクロコンピュータ１２０５１は、車外情報検出ユニット１２０３０で検知した先行車又は対向車の位置に応じてヘッドランプを制御し、ハイビームをロービームに切り替える等の防眩を図ることを目的とした協調制御を行うことができる。
　音声画像出力部１２０５２は、車両の搭乗者又は車外に対して、視覚的又は聴覚的に情報を通知することが可能な出力装置へ音声及び画像のうちの少なくとも一方の出力信号を送信する。図２６の例では、出力装置として、オーディオスピーカ１２０６１、表示部１２０６２及びインストルメントパネル１２０６３が例示されている。表示部１２０６２は、例えば、オンボードディスプレイ及びヘッドアップディスプレイの少なくとも一つを含んでいてもよい。
　図２７は、撮像部１２０３１の設置位置の例を示す図である。
　図２７では、撮像部１２０３１として、撮像部１２１０１，１２１０２，１２１０３，１２１０４，１２１０５を有する。
　撮像部１２１０１，１２１０２，１２１０３，１２１０４，１２１０５は、例えば、車両１２１００のフロントノーズ、サイドミラー、リアバンパ、バックドア及び車室内のフロントガラスの上部等の位置に設けられる。フロントノーズに備えられる撮像部１２１０１及び車室内のフロントガラスの上部に備えられる撮像部１２１０５は、主として車両１２１００の前方の画像を取得する。サイドミラーに備えられる撮像部１２１０２，１２１０３は、主として車両１２１００の側方の画像を取得する。リアバンパ又はバックドアに備えられる撮像部１２１０４は、主として車両１２１００の後方の画像を取得する。車室内のフロントガラスの上部に備えられる撮像部１２１０５は、主として先行車両又は、歩行者、障害物、信号機、交通標識又は車線等の検出に用いられる。
　なお、図２６には、撮像部１２１０１ないし１２１０４の撮影範囲の一例が示されている。撮像範囲１２１１１は、フロントノーズに設けられた撮像部１２１０１の撮像範囲を示し、撮像範囲１２１１２，１２１１３は、それぞれサイドミラーに設けられた撮像部１２１０２，１２１０３の撮像範囲を示し、撮像範囲１２１１４は、リアバンパ又はバックドアに設けられた撮像部１２１０４の撮像範囲を示す。例えば、撮像部１２１０１ないし１２１０４で撮像された画像データが重ね合わせられることにより、車両１２１００を上方から見た俯瞰画像が得られる。
　撮像部１２１０１ないし１２１０４の少なくとも１つは、距離情報を取得する機能を有していてもよい。例えば、撮像部１２１０１ないし１２１０４の少なくとも１つは、複数の撮像素子からなるステレオカメラであってもよいし、位相差検出用の画素を有する撮像素子であってもよい。
　例えば、マイクロコンピュータ１２０５１は、撮像部１２１０１ないし１２１０４から得られた距離情報を基に、撮像範囲１２１１１ないし１２１１４内における各立体物までの距離と、この距離の時間的変化（車両１２１００に対する相対速度）を求めることにより、特に車両１２１００の進行路上にある最も近い立体物で、車両１２１００と略同じ方向に所定の速度（例えば、０ｋｍ／ｈ以上）で走行する立体物を先行車として抽出することができる。さらに、マイクロコンピュータ１２０５１は、先行車の手前に予め確保すべき車間距離を設定し、自動ブレーキ制御（追従停止制御も含む）や自動加速制御（追従発進制御も含む）等を行うことができる。このように運転者の操作に拠らずに自律的に走行する自動運転等を目的とした協調制御を行うことができる。
　例えば、マイクロコンピュータ１２０５１は、撮像部１２１０１ないし１２１０４から得られた距離情報を元に、立体物に関する立体物データを、２輪車、普通車両、大型車両、歩行者、電柱等その他の立体物に分類して抽出し、障害物の自動回避に用いることができる。例えば、マイクロコンピュータ１２０５１は、車両１２１００の周辺の障害物を、車両１２１００のドライバが視認可能な障害物と視認困難な障害物とに識別する。そして、マイクロコンピュータ１２０５１は、各障害物との衝突の危険度を示す衝突リスクを判断し、衝突リスクが設定値以上で衝突可能性がある状況であるときには、オーディオスピーカ１２０６１や表示部１２０６２を介してドライバに警報を出力することや、駆動系制御ユニット１２０１０を介して強制減速や回避操舵を行うことで、衝突回避のための運転支援を行うことができる。
　撮像部１２１０１ないし１２１０４の少なくとも１つは、赤外線を検出する赤外線カメラであってもよい。例えば、マイクロコンピュータ１２０５１は、撮像部１２１０１ないし１２１０４の撮像画像中に歩行者が存在するか否かを判定することで歩行者を認識することができる。かかる歩行者の認識は、例えば赤外線カメラとしての撮像部１２１０１ないし１２１０４の撮像画像における特徴点を抽出する手順と、物体の輪郭を示す一連の特徴点にパターンマッチング処理を行って歩行者か否かを判別する手順によって行われる。マイクロコンピュータ１２０５１が、撮像部１２１０１ないし１２１０４の撮像画像中に歩行者が存在すると判定し、歩行者を認識すると、音声画像出力部１２０５２は、当該認識された歩行者に強調のための方形輪郭線を重畳表示するように、表示部１２０６２を制御する。また、音声画像出力部１２０５２は、歩行者を示すアイコン等を所望の位置に表示するように表示部１２０６２を制御してもよい。
　以上、本開示に係る技術が適用され得る車両制御システムの一例について説明した。本開示に係る技術は、以上説明した構成のうち、撮像部１２０３１に適用され得る。具体的には、図１の撮像装置１００を撮像部１２０３１に適用することができる。撮像部１２０３１に本開示に係る技術を適用することにより、より見やすい撮影画像を得ることができるため、ドライバの疲労を軽減することが可能になる。
　なお、上述の実施の形態は本技術を具現化するための一例を示したものであり、実施の形態における事項と、特許請求の範囲における発明特定事項とはそれぞれ対応関係を有する。同様に、特許請求の範囲における発明特定事項と、これと同一名称を付した本技術の実施の形態における事項とはそれぞれ対応関係を有する。ただし、本技術は実施の形態に限定されるものではなく、その要旨を逸脱しない範囲において実施の形態に種々の変形を施すことにより具現化することができる。
　また、上述の実施の形態において説明した処理手順は、これら一連の手順を有する方法として捉えてもよく、また、これら一連の手順をコンピュータに実行させるためのプログラム乃至そのプログラムを記憶する記録媒体として捉えてもよい。この記録媒体として、例えば、ＣＤ（Compact Disc）、ＭＤ（MiniDisc）、ＤＶＤ（Digital Versatile Disc）、メモリカード、ブルーレイディスク（Blu-ray（登録商標）Disc）等を用いることができる。
　なお、本明細書に記載された効果はあくまで例示であって、限定されるものではなく、また、他の効果があってもよい。
　なお、本技術は以下のような構成もとることができる。
（１）電源線からの電源を用いて受光量に応じたアナログ信号を有効画素信号として生成する有効画素と、
　前記電源線に生じるノイズ成分を含むアナログ信号を補正信号として生成する補正信号生成部と、
　前記有効画素信号と前記補正信号とを逐次選択して出力する選択回路と、
　前記出力された有効画素信号をデジタル信号に変換して有効画素データとして出力する処理と前記出力された補正信号をデジタル信号に変換して補正データとして出力する処理とを行うアナログデジタル変換器と、
　前記補正データに基づいて前記有効画素データを補正する信号処理部と
を具備する固体撮像素子。
（２）前記補正信号生成部は、遮光された遮光画素を含む
前記（１）記載の固体撮像素子。
（３）前記補正信号生成部は、前記電源線からの信号のうち所定周波数より高い高周波数成分を通過させて前記補正信号として出力するハイパスフィルタを含む
前記（１）記載の固体撮像素子。
（４）前記アナログデジタル変換器は、ＳＡＲＡＤＣ（Successive Approximation Register Analog to Digital Converter）である
前記（１）から（３）のいずれかに記載の固体撮像素子。
（５）前記選択回路の動作タイミングを制御するタイミング制御部をさらに具備し、
　前記選択回路は、所定個数が配列され、
　前記タイミング制御部は、前記所定個数の前記選択回路のいずれかに前記補正信号を出力させるとともに残りに前記有効画素信号を出力させる
前記（１）から（４）のいずれかに記載の固体撮像素子。
（６）前記タイミング制御部は、前記所定個数の前記選択回路を所定の順序で逐次選択して前記補正信号を出力させる
前記（５）記載の固体撮像素子。
（７）前記タイミング制御部は、前記所定個数の前記選択回路のいずれかを示す乱数を生成して当該乱数の示す前記選択回路を選択して前記補正信号を出力させる
前記（５）記載の固体撮像素子。
（８）所定数の前記有効画素が、二次元格子状に画素アレイ部に配列され、
　前記画素アレイ部は、複数の有効画素エリアに分割され、
　前記選択回路は、前記複数の有効画素エリアのいずれかからの前記有効画素信号と前記補正信号とを逐次選択する
前記（１）から（７）のいずれかに記載の固体撮像素子。
（９）前記画素アレイ部において、前記有効画素は、ベイヤー配列により配列される
前記（７）記載の固体撮像素子。
（１０）前記画素アレイ部において隣接する複数の有効画素のそれぞれは、同一の色の光を光電変換して前記有効画素信号を生成する
前記（７）記載の固体撮像素子。
（１１）前記画素アレイ部において隣接する一対の前記有効画素は、一対の像の位相差を検出するための画素である
前記（７）記載の固体撮像素子。
（１２）前記画素アレイ部には、互いに受光面積の異なる複数の有効画素が配列される
前記（７）記載の固体撮像素子。
（１３）電源線からの電源を用いて受光量に応じたアナログ信号を有効画素信号として生成する有効画素と、
　前記電源線に生じるノイズ成分を含むアナログ信号を補正信号として生成する補正信号生成部と、
　前記有効画素信号と前記補正信号とを逐次選択して出力する選択回路と、
　前記出力された有効画素信号をデジタル信号に変換して有効画素データとして出力する処理と前記出力された補正信号をデジタル信号に変換して補正データとして出力する処理とを行うアナログデジタル変換器と、
　前記補正データに基づいて前記有効画素データを補正する信号処理部と、
　前記補正された有効画素データからなる画像データに対して所定の画像処理を実行する画像処理部と
を具備する撮像装置。
（１４）電源線からの電源を用いて受光量に応じたアナログ信号を有効画素信号として生成する有効画素信号生成手順と、
　前記電源線に生じるノイズ成分を含むアナログ信号を補正信号として生成する補正信号生成手順と、
　前記有効画素信号と前記補正信号とを逐次選択して出力する選択手順と、
　前記出力された有効画素信号をデジタル信号に変換して有効画素データとして出力する処理と前記出力された補正信号をデジタル信号に変換して補正データとして出力する処理とを行うアナログデジタル変換手順と、
　前記補正データに基づいて前記有効画素データを補正する信号処理手順と
を具備する固体撮像素子の制御方法。
　１００　撮像装置
　１１０　撮像レンズ
　１２０　画像処理部
　１３０　撮像制御部
　１４０　記録部
　２００　固体撮像素子
　２０１　画素チップ
　２０２　ロジックチップ
　２１０　画素アレイ部
　２２０　走査回路
　２３０、２７０　ＡＤ変換部
　２３１、３１１、３９１　マルチプレクサ
　２３２　スイッチ
　２４０　ＡＤＣ
　２４１　サンプル・ホールド回路
　２４２　ＤＡＣ
　２４３　コンパレータ
　２４４　ＳＡＲロジック回路
　２４５　レジスタ
　２５０　信号処理部
　２５１　ＣＤＳ処理部
　２５２　補正部
　２５３　後段処理部
　２６０　タイミング制御部
　２８０　電源揺れ検出部
　２８１　ハイパスフィルタ
　２８２　アンプ
　３１０、３９０　選択部
　３２０、３８０　遮光エリア
　３３０　遮光画素ブロック
　３３１　遮光画素
　３４０　有効画素エリア
　３５０　有効画素ブロック
　３５１、３７２、３７３、３７４、３７５、３７６　有効画素
　３５２、３５３、３５６、３５７、３６０、３６１、３６４、３６５　選択トランジスタ
　３５４、３５５、３５８、３５９、３６２、３６３、３６６、３６７　フォトダイオード
　３６８　リセットトランジスタ
　３６９　浮遊拡散層
　３７０　増幅トランジスタ
　３７１　選択トランジスタ
　１２０３１　撮像部

Claims (14)

  1. 　電源線からの電源を用いて受光量に応じたアナログ信号を有効画素信号として生成する有効画素と、
    　前記電源線に生じるノイズ成分を含むアナログ信号を補正信号として生成する補正信号生成部と、
    　前記有効画素信号と前記補正信号とを逐次選択して出力する選択回路と、
    　前記出力された有効画素信号をデジタル信号に変換して有効画素データとして出力する処理と前記出力された補正信号をデジタル信号に変換して補正データとして出力する処理とを行うアナログデジタル変換器と、
    　前記補正データに基づいて前記有効画素データを補正する信号処理部と
    を具備する固体撮像素子。
  2. 　前記補正信号生成部は、遮光された遮光画素を含む
    請求項１記載の固体撮像素子。
  3. 　前記補正信号生成部は、前記電源線からの信号のうち所定周波数より高い高周波数成分を通過させて前記補正信号として出力するハイパスフィルタを含む
    請求項１記載の固体撮像素子。
  4. 　前記アナログデジタル変換器は、ＳＡＲＡＤＣ（Successive Approximation Register Analog to Digital Converter）である
    請求項１記載の固体撮像素子。
  5. 　前記選択回路の動作タイミングを制御するタイミング制御部をさらに具備し、
    　前記選択回路は、所定個数が配列され、
    　前記タイミング制御部は、前記所定個数の前記選択回路のいずれかに前記補正信号を出力させるとともに残りに前記有効画素信号を出力させる
    請求項１記載の固体撮像素子。
  6. 　前記タイミング制御部は、前記所定個数の前記選択回路を所定の順序で逐次選択して前記補正信号を出力させる
    請求項５記載の固体撮像素子。
  7. 　前記タイミング制御部は、前記所定個数の前記選択回路のいずれかを示す乱数を生成して当該乱数の示す前記選択回路を選択して前記補正信号を出力させる
    請求項５記載の固体撮像素子。
  8. 　所定数の前記有効画素が、二次元格子状に画素アレイ部に配列され、
    　前記画素アレイ部は、複数の有効画素エリアに分割され、
    　前記選択回路は、前記複数の有効画素エリアのいずれかからの前記有効画素信号と前記補正信号とを逐次選択する
    請求項１記載の固体撮像素子。
  9. 　前記画素アレイ部において、前記有効画素は、ベイヤー配列により配列される
    請求項７記載の固体撮像素子。
  10. 　前記画素アレイ部において隣接する複数の有効画素のそれぞれは、同一の色の光を光電変換して前記有効画素信号を生成する
    請求項７記載の固体撮像素子。
  11. 　前記画素アレイ部において隣接する一対の前記有効画素は、一対の像の位相差を検出するための画素である
    請求項７記載の固体撮像素子。
  12. 　前記画素アレイ部は、互いに受光面積の異なる複数の有効画素が配列される
    請求項７記載の固体撮像素子。
  13. 　電源線からの電源を用いて受光量に応じたアナログ信号を有効画素信号として生成する有効画素と、
    　前記電源線に生じるノイズ成分を含むアナログ信号を補正信号として生成する補正信号生成部と、
    　前記有効画素信号と前記補正信号とを逐次選択して出力する選択回路と、
    　前記出力された有効画素信号をデジタル信号に変換して有効画素データとして出力する処理と前記出力された補正信号をデジタル信号に変換して補正データとして出力する処理とを行うアナログデジタル変換器と、
    　前記補正データに基づいて前記有効画素データを補正する信号処理部と、
    　前記補正された有効画素データからなる画像データに対して所定の画像処理を実行する画像処理部と
    を具備する撮像装置。
  14. 　電源線からの電源を用いて受光量に応じたアナログ信号を有効画素信号として生成する有効画素信号生成手順と、
    　前記電源線に生じるノイズ成分を含むアナログ信号を補正信号として生成する補正信号生成手順と、
    　前記有効画素信号と前記補正信号とを逐次選択して出力する選択手順と、
    　前記出力された有効画素信号をデジタル信号に変換して有効画素データとして出力する処理と前記出力された補正信号をデジタル信号に変換して補正データとして出力する処理とを行うアナログデジタル変換手順と、
    　前記補正データに基づいて前記有効画素データを補正する信号処理手順と
    を具備する固体撮像素子の制御方法。
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