WO2014125786A1 - 薄膜形成方法、及びそれを用いて作製した半導体基板ならびに電子デバイス - Google Patents

薄膜形成方法、及びそれを用いて作製した半導体基板ならびに電子デバイス Download PDF

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耕平 酒池
義崇 小林
将吾 中村
宗樹 赤澤
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Definitions

  • the present invention relates to a thin film forming method, and a semiconductor substrate and an electronic device manufactured using the method.
  • the performance of thin film transistors and solar cells depends on the crystallinity of the silicon thin film formed on the quartz substrate, the glass substrate, and the flexible substrate. Therefore, conventionally, techniques for improving the crystallinity of a silicon thin film formed on a quartz substrate, a glass substrate, and a flexible substrate have been actively studied.
  • Patent Document 1 As a typical method of forming a polycrystalline silicon film on a quartz substrate, a glass substrate, and a flexible substrate, a laser annealing method is known (Patent Document 1).
  • High crystalline silicon films have been realized by improving the technology for forming silicon films on quartz, glass, and flexible substrates.
  • Single crystal silicon films have been formed on quartz, glass, and flexible substrates. It is difficult to form.
  • the present invention has been made in view of such problems, and its main purpose is to form a thin film such as a single crystal semiconductor film on a substrate such as a quartz substrate, a glass substrate, or a flexible substrate, and a method for forming the same.
  • An object of the present invention is to provide a semiconductor substrate and an electronic device manufactured using the same.
  • a thin film forming method includes a step of preparing a first substrate having a thin film formed on a surface thereof, a step of forming a plurality of openings in the thin film, and etching the first substrate through the openings. Forming a hollow portion between the first substrate and the thin film, interposing a liquid between the thin film and the second substrate, and attaching the thin film to the second substrate; Heating the first substrate and / or the second substrate, and in the heating step, the liquid interposed between the thin film and the second substrate is dried, so that the thin film is removed from the first substrate. It is separated and transferred to the second substrate.
  • the thin film is formed on a first substrate with a sacrificial layer interposed therebetween, and the step of forming the hollow portion includes etching the sacrificial layer instead of the first substrate. In the heating step, the thin film is separated from the sacrificial layer and transferred to the second substrate.
  • a semiconductor substrate according to an embodiment of the present invention is characterized by a semiconductor substrate including a semiconductor thin film transferred to the surface by the above-described thin film forming method.
  • An electronic device is characterized by an electronic device having a semiconductor thin film transferred to a substrate surface by the above-described thin film forming method.
  • a method of manufacturing a thin film transistor includes a step of preparing a first substrate having a semiconductor thin film formed on the surface with an insulating layer interposed therebetween, and the semiconductor thin film becomes a channel region and a source / drain region. Patterning the region, forming a plurality of openings in the semiconductor thin film to be the source / drain regions, and etching the insulating layer through the openings to form a hollow portion between the insulating layer and the semiconductor thin film.
  • the channel region and the region to be the source / drain region are patterned in a matrix.
  • a method for manufacturing a solar cell includes: a step of preparing a second substrate having a transparent electrode formed on a surface thereof; Including a step of sequentially transferring the first-conductivity-type semiconductor thin film and the second-conductivity-type semiconductor thin film. In the transfer step, a PN junction made of the semiconductor thin film is formed on the transparent electrode.
  • a thin film forming method for forming a thin film such as a single crystal semiconductor film on a substrate such as a quartz substrate, a glass substrate, or a flexible substrate, and a semiconductor substrate and an electronic device manufactured using the thin film forming method are provided.
  • a substrate such as a quartz substrate, a glass substrate, or a flexible substrate
  • a semiconductor substrate and an electronic device manufactured using the thin film forming method are provided. Can do.
  • (A)-(d) is process drawing which showed the thin film formation method in the 1st Embodiment of this invention.
  • (A)-(b) is process drawing which showed the thin film formation method in the 1st Embodiment of this invention.
  • (A)-(c) is the figure explaining the formation method of a hollow part.
  • (A)-(c) is the figure explaining the formation method of a hollow part.
  • (A)-(c) is the figure explaining the mechanism of transcription
  • (A)-(c) is the figure explaining the mechanism of transcription
  • (A)-(c) is process drawing which showed the heating method of the board
  • FIG. 6 is a graph showing a relationship between a transfer rate and a liquid amount. It is the graph which showed the relationship between a transfer rate and heating temperature. It is the graph which showed the relationship between a transfer rate and pillar size.
  • (A) is an optical micrograph showing the surface of the thin film before transfer
  • (b) is an SEM (scanning electron microscope) photo showing the surface of the thin film after transfer
  • (c) is after transfer.
  • 2 is an EBSD (electron beam backscatter diffraction) image of the thin film.
  • (A) is the optical micrograph which showed the surface of the thin film pattern before transcription
  • (b) is the optical micrograph which showed the surface of the thin film pattern after transcription
  • FIGS. 4A to 4E are process diagrams showing a method of manufacturing a thin film transistor using the thin film transfer technique according to the present invention.
  • FIGS. 4A to 4D are process diagrams showing a method of manufacturing a thin film transistor using the thin film transfer technique according to the present invention.
  • (A) is the top view which showed the shape of the patterned single crystal silicon film
  • (b) is the top view which showed the shape of the single crystal silicon film
  • (A)-(d) is process drawing which showed the other manufacturing method of the thin-film transistor in this invention.
  • FIG. 6 is a graph showing I DS -V GS characteristics of a thin film transistor (insulating film is only a thermal oxide film) formed by being transferred to a flexible substrate.
  • (A), (b) is the SEM photograph which showed the state of the channel area
  • (A), (b) is the optical microscope photograph which showed the state of the silicon film after transferring the silicon film of a hollow structure to a glass substrate. It is the graph which showed the displacement of the silicon film with respect to the film thickness of a thermal oxide film. It is a top view of the single crystal silicon film pattern formed in the matrix form.
  • FIGS. 4A to 4E are process diagrams showing a method for manufacturing an amorphous silicon thin film transistor.
  • FIGS. 4A to 4D are process diagrams showing a method for manufacturing an amorphous silicon thin film transistor.
  • (A)-(d) is process drawing which showed the manufacturing method of the solar cell using the transfer technique of the thin film in this invention.
  • (A)-(e) is process drawing which showed the manufacturing method of the solar cell using the transfer technique of the thin film in this invention.
  • (A)-(e) is process drawing which showed the other manufacturing method of the solar cell using the transfer technique of the thin film in this invention.
  • (A)-(d) is process drawing which showed the other manufacturing method of the solar cell using the transfer technique of the thin film in this invention.
  • (A)-(d) is process drawing which showed the other manufacturing method of the solar cell using the transfer technique of the thin film in this invention.
  • the inventors of the present application have disclosed a technique for transferring an amorphous silicon film formed on a transfer source quartz substrate to a transfer destination substrate (glass substrate or flexible substrate) simultaneously with crystallization, as disclosed in Japanese Patent Application No. 2011-176335. It is disclosed in the document.
  • this transfer technology an opening is formed in an amorphous silicon film, and the quartz substrate is etched through the opening to form a hollow structure of the amorphous silicon film supported by the quartz pillar.
  • laser irradiation is performed from the quartz substrate side to melt and recrystallize the amorphous silicon film. Since the crystallized silicon film has strong chemical bonds with the transfer destination substrate, the crystallized silicon film is transferred to the transfer destination substrate.
  • the inventors of the present application pay attention to a single crystal silicon film formed on an SOI (Silicon on Insulator) substrate, and a technique for transferring the single crystal silicon film to a substrate such as a quartz substrate, a glass substrate, or a flexible substrate.
  • SOI Silicon on Insulator
  • the present invention has been studied and conceived.
  • (First embodiment) 1 and 2 are process diagrams showing a thin film forming method according to the first embodiment of the present invention.
  • a first substrate 1 having a thin film 2 formed on a surface with a sacrificial layer 3 interposed therebetween is prepared.
  • a substrate for example, an SOI substrate can be used.
  • the first substrate 1 is a single crystal silicon substrate
  • the thin film 2 is a single crystal silicon film
  • the sacrificial layer 3 is a silicon oxide film.
  • a plurality of openings 4 are formed in the thin film 2.
  • the opening 4 can be formed by etching using, for example, a photolithography process.
  • the sacrificial layer 3 is etched through the opening 4 to form a hollow portion 5 between the first substrate 1 and the thin film 2.
  • the sacrificial layer 3 is a silicon oxide film, it can be etched using hydrofluoric acid. Etching is preferably performed using an etching solution having a high etching selectivity between the thin film 2 and the first substrate 1.
  • a liquid (not shown) is interposed between the thin film 2 and the second substrate 10, and the second substrate 10 is adhered to the thin film 2.
  • the liquid is filled between the thin film 2 and the second substrate 10, and the opening 4 and the hollow portion 5 are also filled with the liquid.
  • the second substrate 10 for example, a quartz substrate, a glass substrate, a flexible substrate, or the like can be used.
  • water, ethanol, acetone, etc. can be used for a liquid, for example.
  • a liquid having a large surface tension (such as water) is preferable.
  • the first substrate 1 and / or the second substrate 10 is heated.
  • the heating is performed at a temperature below the boiling point of the liquid, and can be performed using, for example, a halogen lamp or a hot plate.
  • the heating step is intended to dry the liquid interposed between the thin film 2 and the second substrate 10 and the liquid filling the opening 4 and the hollow portion 5, and is not necessarily the first. It is not necessary to directly heat both the substrate 1 and the second substrate 10. For example, a method of heating one substrate and indirectly heating the other substrate may be used.
  • the liquid interposed between the thin film 2 and the second substrate is dried, so that the thin film 2 is separated from the first substrate 1. Accordingly, when the second substrate 10 is pulled up, the thin film 2 is transferred to the second substrate 10. At this time, the thin film 2 is transferred to the second substrate 10 with the pattern in which the opening 4 is formed. Further, the pillar 3 a made of a part of the sacrificial layer 3 remains on the first substrate 1.
  • the thin film 2 formed on the first substrate 1 is transferred to the second substrate 10 as it is. Therefore, if the thin film 2 is a single crystal film, the single crystal film is transferred to the second substrate 10 as it is.
  • a single crystal semiconductor thin film can be formed on a substrate such as a quartz substrate, a glass substrate, or a flexible substrate.
  • FIG. 3A is a plan view of the thin film 2 in which a plurality of openings 4 are formed. As shown in FIG. 3A, the plurality of openings 4 are formed in an array. Then, an etching solution for etching the sacrificial layer 3 is supplied through the opening 4 so that the sacrificial layer 3 is isotropically etched. When the etching for the thickness of the sacrificial layer 3 proceeds, the etching further proceeds along the direction parallel to the film of the sacrificial layer 3. A dotted line in FIG. 3A indicates the boundary of the sacrificial layer 3 when etching proceeds in a direction parallel to the film of the sacrificial layer 3 with the opening 4 as the center.
  • FIG. 3 (b) and 3 (c) are cross-sectional views showing this state
  • FIG. 3 (b) is a cross-sectional view taken along line IIIb-IIIb in FIG. 3 (a)
  • FIG. FIG. 3 (a) is a cross-sectional view taken along IIIc-IIIc.
  • a hollow portion 5 is formed between the first substrate 1 and the thin film 2 at a position along IIIb-IIIb. As shown, the hollow portion 5 is not yet formed at the location along IIIc-IIIc.
  • the sacrificial layer 3 between the first substrate 1 and the thin film 2 is all etched at a location along IIIb-IIIb so that only the hollow portion 5 is formed.
  • a column 3a made of a part of the sacrificial layer 3 remains at a position along IIIc-IIIc.
  • the thin film 2 has a hollow structure supported by the pillars 3a arranged in an array.
  • the etching of the sacrificial layer 3 is controlled by time management or the like so that the size of the pillar 3a becomes a transferable size described later. Since the pillar 3a is formed by etching in a direction parallel to the film of the sacrificial layer 3, the pillar 3a having a predetermined size can be formed with good control.
  • FIG. 5A shows a state in which the liquid 20b is interposed between the thin film 2 and the second substrate 10 so that the second substrate 10 is in close contact with the thin film 2 as shown in FIG. 1D. It is sectional drawing which showed. At this time, the opening 4 and the hollow portion 5 are also filled with the liquid 20a.
  • FIG. 5A for convenience of explanation, the opening 4 shown in FIG. 4B and the column 3a shown in FIG. 4C are shown in the same cross section.
  • the liquid 20b interposed between the thin film 2 and the second substrate 10 is drawn with an exaggerated thickness.
  • FIG. 6A is an enlarged cross-sectional view of a region indicated by a circle A in FIG.
  • the liquid 20b interposed between the thin film 2 and the second substrate 10 forms a capillary bridge, and a capillary adhesive force (meniscus force) is acting on the thin film 2 supported by the column 3a.
  • the magnitude of the capillary adhesive forces, the liquid 20b height (height of the bridge) H depends on the contact area between the thin film 2 and the liquid 20b, and degree of contact theta E.
  • Figure 7 is a liquid and water, the membrane 2 and the contact area (one area supporting at pillar 3a) of 9 .mu.m ⁇ 9 .mu.m with the liquid 20b, when formed into a 30 ° contact angle theta E, the height of the liquid 20b
  • the magnitude of the capillary adhesion was determined as follows ("Physics of surface tension", Pierre-Gilles de Gennes, Francoise Brochard-Wyart, David Quere), Takeshi Okumura (translation): (See 2nd edition (2008) p.6-9).
  • the adhesion force of the substrate that is, the capillary adhesion force F is an attractive force and is expressed by the following equation.
  • the capillary adhesive force F depends on the contact area between the thin film 2 and the liquid 20b, and the bonding force between the first substrate 1 and the pillar 3a depends on the contact area between the first substrate 1 and the pillar 3a.
  • the pillars 3 a are formed in an array at the same interval as the opening 4.
  • the thin film 2 surrounded by the four openings 4 in the 2 ⁇ 2 array is supported by the single pillar 3a at the center. Therefore, the area of the thin film 2 supported by one column 3a, that is, the contact area between the thin film 2 and the liquid 20b can be adjusted by changing the interval between the openings 4.
  • the contact area between the first substrate 1 and the pillar 3a can be adjusted by changing the cross-sectional area (size) of the pillar 3a.
  • the cross-sectional area of the pillar 3 a can be changed by adjusting the etching amount of the sacrificial layer 3 in the step of forming the hollow portion 5.
  • the capillary adhesive force F by the liquid interposed between the thin film 2 and the second substrate 10 is when the contact angle ⁇ E of the liquid in contact with the thin film 2 is less than 90 °, as shown in FIG. Act on. Therefore, it is more preferable that the second substrate 10 is hydrophilic to the liquid. Therefore, when the second substrate 10 is made of a material that is not hydrophilic with respect to the liquid, it is preferable to perform a surface treatment that makes the surface of the second substrate 10 hydrophilic.
  • the surface treatment for imparting hydrophilicity can be performed, for example, by forming a polar thin film on the surface of the second substrate 10.
  • substrate 10 is a flexible substrate, it can carry out by apply
  • the transfer of the thin film 2 to the second substrate 10 is performed by using the capillary adhesive force of the liquid 20b interposed between the thin film 2 and the second substrate 10, but actually In the surface of the thin film 2 and the surface of the second substrate, the liquid 20b interposed between the thin film 2 and the second substrate 10 varies depending on the location. Therefore, the capillary adhesive force also varies depending on the location. Therefore, if the liquid 20b is dried all over the substrate all at once, the transfer proceeds from various directions, and the thin film 2 transferred to the second substrate 10 may be wrinkled.
  • FIG. 8 is a process diagram showing a method of heating a substrate that has improved this problem.
  • FIG. 8A shows the same state as FIG. 5A.
  • the column 3a is not shown for convenience of explanation.
  • the first substrate 1 and the second substrate 10 are heated so that the liquid evaporates in a certain direction from the end portions of the substrates 1 and 10, first, the first substrate 1.
  • the gap between the thin film 2 and the second substrate 10 passes through the opening 4 from the side close to the end (left side in the figure).
  • the liquid 20b intervening in the vapor passes through the hollow portion 5 and evaporates to the outside.
  • the liquid 20b interposed between the thin film 2 near the ends of the substrates 1 and 10 and the second substrate 10 evaporates, so that the thin film 2 in that portion is separated from the pillar 3a (not shown), Transferred to the second substrate 10.
  • the transfer timing can be controlled by heating the first substrate 1 and the second substrate 10 so that the liquid evaporates from the end portions of the substrates 1 and 10 along a certain direction. .
  • the thin film 2 can be transferred to the second substrate 10 without wrinkles.
  • the transfer technique in the present invention utilizes the difference between the capillary adhesive force acting on the thin film 2 by the liquid 20b existing between the thin film 2 and the second substrate 10 and the bonding force between the thin film 2 and the column 3a.
  • the thin film 2 is transferred to the second substrate 10. Therefore, in order to reliably transfer the thin film 2 to the second substrate 10, the amount of liquid supplied between the thin film 2 and the second substrate, the heating temperature for evaporating the liquid, and the hollow
  • the size of the pillar 3a that supports the structural thin film 2 is an important parameter.
  • FIGS. 9 to 11 are graphs showing the results of measuring the transfer rate with respect to these parameters.
  • an SOI substrate in which a single crystal silicon thin film (thickness: 180 nm) is formed on a silicon substrate via a silicon oxide film (thickness: 500 nm) is used as the first substrate 1.
  • a PET (polyethylene terephthalate) substrate was used as the second substrate 10.
  • the thin film (single crystal silicon film) 2 has openings 4 having a size of 2 ⁇ m ⁇ 2 ⁇ m formed in an array shape with a pitch of 11 ⁇ m, and pillars 3 a that support the hollow single crystal silicon film are 1 ⁇ m ⁇ 1 ⁇ m. It was made the size.
  • the hollow structure was formed in a region of 6 mm ⁇ 6 mm in the first substrate 1. Moreover, water was used as the liquid. Further, the transfer rate was calculated from (transferred Si film area) / (Si film area before transfer) ⁇ 100 (%).
  • FIG. 9 is a graph showing the result of measuring the transfer rate of the thin film 2 with respect to the amount of liquid (water) supplied between the thin film 2 and the second substrate 10.
  • the liquid (water) is supplied by dropping 2 ⁇ l to 8 ⁇ l of water with a pipette into the center of the area (6 mm ⁇ 6 mm) where the hollow structure is formed, and then bringing it into close contact with the transfer destination substrate. It was.
  • a transfer rate of 100% can be realized without depending on the amount of liquid to be supplied.
  • the transfer rate decreased to 80% when the amount of liquid was 2 ⁇ l because the supply of liquid was insufficient and a region where no liquid was present was formed between the thin film 2 and the second substrate depending on the location. it is conceivable that.
  • the transfer rate was 0%. This is because no liquid is present between the thin film 2 and the second substrate 10, so that the capillary adhesive force that separates from the column 3 a does not act on the thin film 2 at all.
  • FIG. 10 is a graph showing the result of measuring the transfer rate of the thin film 2 with respect to the heating temperature for evaporating the liquid (water) interposed between the thin film 2 and the second substrate.
  • the heating temperature is 30 ° C. or higher, a transfer rate of 100% can be realized. This means that the transfer rate does not depend on the drying speed, but is limited by the capillary adhesive force acting on the thin film 2. Note that heating at a temperature equal to or higher than the boiling point of the liquid (100 ° C. or higher in the case of water) is not preferable because the quasi-static capillary adhesive force does not act on the thin film 2 and uniform transfer cannot be performed.
  • FIG. 11 is a graph showing the result of measuring the transfer rate of the thin film 2 with respect to the size of the pillar 3a supporting the thin film 2 having a hollow structure.
  • the transfer rate of the thin film 2 is 100%.
  • the transfer rate decreased as the size of the pillar 3a increased. This is because the capillary adhesion force acting on the thin film 2 by the liquid 20b interposed between the thin film 2 and the second substrate 10 is larger than the bonding force between the thin film 2 and the column 3a. This suggests that the thin film 2 is transferred to the second substrate 10.
  • the graphs shown in FIGS. 9 to 11 give guidelines on how to set important parameters that contribute to the transfer in order to transfer the thin film 2 to the second substrate 10 with certainty. It is. Therefore, the numerical values shown in the graph vary depending on the shape of the hollow structure, the materials of the substrates 1, 10 and the thin film 2, the sacrificial layer 3, the liquid to be supplied, and the like, and do not make an absolute meaning.
  • FIG. 12 (a) is an optical micrograph showing the surface of the thin film 2 before transfer
  • FIG. 12 (b) is an SEM (scanning electron microscope) photo showing the surface of the thin film 2 after transfer.
  • an SOI substrate was used as the transfer source substrate, and the openings 4 were formed in a staggered pattern.
  • a glass substrate was used as the transfer destination substrate.
  • FIG. 12B the thin film 2 is transferred to the transfer destination substrate while the opening 4 is formed.
  • FIG. 12C shows an EBSD (electron beam backscatter diffraction) image of the thin film (single crystal silicon film) after transfer, and the single crystal silicon film having a uniform crystal orientation of (100) is transferred. It could be confirmed.
  • EBSD electron beam backscatter diffraction
  • FIG. 13A is an optical micrograph showing a thin film pattern before transfer when the thin film 2 is formed into a thin film transistor pattern to be described later, and FIG. 13B shows the thin film pattern after transfer. It is the optical microscope photograph.
  • an SOI substrate was used as the transfer source substrate, and the opening 4 was formed in the source / drain region of the thin film transistor.
  • a flexible substrate was used as the transfer destination substrate. As shown in FIG. 13B, the thin film 2 is transferred to the transfer destination substrate in the pattern in which the opening 4 is formed.
  • FIG. 14 is a cross-sectional SEM photograph showing the state of the thin film 2 having a hollow structure. As shown in FIG. 14, it can be seen that the thin film 2 in which the hollow portion 5 is formed is supported by the pillar 3a while maintaining the film shape.
  • the hollow portion 5 is formed by etching the sacrificial layer 3 through the opening 4 formed in the thin film 2. Therefore, the arrangement of the pillars 3 a remaining after the etching of the sacrificial layer 3 also changes depending on the arrangement of the openings 4.
  • FIG. 15 is a plan view showing an example in which the openings 4 are arranged in a staggered manner.
  • the pillars 3 a are formed at six places surrounding the opening 4.
  • the pillars 3 a are formed at four places surrounding the openings 4. Therefore, the number of columns 3a supporting the thin film 2 in the hollow state can be formed more by arranging the openings 4 in a zigzag pattern than arranging the openings 4 in an array pattern.
  • the SOI substrate is described as an example of the transfer source substrate, but the present invention is not limited to this, and substrates of various materials can be used.
  • the first substrate may be a quartz substrate or a glass substrate.
  • the transferred thin film 2 may be a polycrystalline silicon film or an amorphous silicon film.
  • Other semiconductor thin films for example, germanium film, silicon carbide (SiC) film, hydrogenated amorphous silicon (a-Si: H) a film or the like.
  • the thin film 2 to be transferred may be an insulating film such as an oxide film or other films.
  • the liquid interposed between the thin film and the second substrate is not particularly limited, and for example, perhydropolysilazane may be used in addition to water, ethanol, and acetone.
  • perhydropolysilazane when perhydropolysilazane is used, when the polysilazane evaporates, capillary adhesion acts on the thin film, and in addition to the change in the molecular structure (silica conversion) of the perhydropolysilazane, Since the polysilazane is chemically bonded, the chemical bonding force further acts on the thin film, so that it can be transferred to the second substrate.
  • the shape of the opening 4 formed in the thin film 2 is not particularly limited, and may be, for example, a rectangle or a circle. Further, the arrangement of the openings 4 is not limited to an array (including a matrix), and may include, for example, an irregular arrangement.
  • the thin film 2 is transferred to the second substrate 10 as it is, but the thin film 2 is transferred to further improve the adhesion between the thin film 2 and the second substrate 10.
  • a step of heat treating the second substrate 10 may be further added.
  • the second substrate 10 as a transfer destination is a flexible substrate made of PET (polyethylene terephthalate) resin
  • PET polyethylene terephthalate
  • the heat treatment temperature is 150 ° C. or higher
  • the PET substrate is altered, and therefore, the heat treatment temperature is preferably less than 150 ° C.
  • heat treatment can be performed by performing laser irradiation.
  • a thermal plasma jet, a flash lamp, an electric furnace or the like may be used.
  • the transfer source substrate described in the first embodiment a substrate in which the thin film 2 is formed on the first substrate 1 with the sacrificial layer 3 interposed therebetween is used.
  • the hollow portion 5 is formed by etching the sacrificial layer 3 through the opening 4 formed in the thin film 2. That is, the height of the hollow portion 5 is regulated by the thickness of the sacrificial layer 3.
  • the hollow portion 5 can be formed without using the sacrificial layer 3.
  • a method of transferring a thin film 2 to a second substrate using a transfer substrate having a thin film 2 formed on a first substrate will be described.
  • 16 and 17 are process diagrams showing a thin film forming method according to the second embodiment of the present invention.
  • a first substrate 1 having a thin film 2 formed on the surface is prepared.
  • a substrate for example, a substrate in which an amorphous silicon film is formed on a quartz substrate can be used.
  • a plurality of openings 4 are formed in the thin film 2.
  • the opening 4 can be formed by etching using, for example, a photolithography process.
  • the first substrate 1 is etched through the opening 4 to form a hollow portion 5 between the first substrate 1 and the thin film 2.
  • etching can be performed using hydrofluoric acid.
  • the height of the hollow portion 5 is substantially the same as the lateral etching length of the first substrate 1.
  • a liquid (not shown) is interposed between the thin film 2 and the second substrate 10, and the thin film 2 is brought into close contact with the second substrate 10.
  • the second substrate 10 for example, a quartz substrate, a glass substrate, a flexible substrate, or the like can be used.
  • water, ethanol, acetone, etc. can be used for a liquid, for example.
  • the first substrate 1 and / or the second substrate 10 is heated.
  • the heating is performed at a temperature below the boiling point of the liquid, and can be performed using, for example, a halogen lamp or a hot plate.
  • This heating step is intended to dry the liquid interposed between the thin film 2 and the second substrate 10, and both the first substrate 1 and the second substrate 10 are not necessarily heated directly.
  • a method of heating one substrate and indirectly heating the other substrate may be used.
  • the liquid interposed between the thin film 2 and the second substrate 10 is dried, so that the thin film 2 is separated from the first substrate 1. Accordingly, when the second substrate 10 is pulled up, the thin film 2 is transferred to the second substrate 10. At this time, the thin film 2 is transferred to the second substrate 10 with the pattern in which the opening 4 is formed. Further, the pillar 1 a that is a part of the first substrate 1 remains on the surface of the first substrate 1.
  • the transfer mechanism in the present embodiment is basically the same as the transfer mechanism in the first embodiment. That is, using the difference between the capillary adhesive force acting on the thin film 2 by the liquid interposed between the thin film 2 and the second substrate 10 and the bonding force between the thin film 2 and the pillar 1a, the thin film 2 is Can be transferred to the substrate 10.
  • the quartz substrate having the thin film 2 formed on the surface is described as an example of the transfer source substrate.
  • the present invention is not limited to this, and substrates of various materials can be used.
  • the first substrate may be a silicon substrate or a glass substrate.
  • the transferred thin film 2 may be a polysilicon film, and may be another semiconductor thin film (for example, a germanium film, a silicon carbide (SiC) film, a hydrogenated amorphous silicon (a-Si: H) film, etc.). There may be.
  • the thin film 2 to be transferred may be an insulating film such as an oxide film or other films.
  • the liquid interposed between the thin film and the second substrate is not particularly limited, and for example, perhydropolysilazane may be used in addition to water, ethanol, and acetone.
  • perhydropolysilazane when perhydropolysilazane is used, when the polysilazane evaporates, capillary adhesion acts on the thin film, and in addition to the change in the molecular structure (silica conversion) of the perhydropolysilazane, Since the polysilazane is chemically bonded, the chemical bonding force further acts on the thin film, so that it can be transferred to the second substrate.
  • the shape of the opening 4 formed in the thin film 2 is not particularly limited, and may be, for example, a rectangle or a circle. Further, the arrangement of the openings 4 is not limited to an array (including a matrix), and may include an irregular arrangement, for example.
  • the thin film 2 is transferred to the second substrate 10 as it is, but the thin film 2 is transferred to further improve the adhesion between the thin film 2 and the second substrate 10.
  • a step of heat treating the second substrate 10 may be further added.
  • the thin film formed on the transfer source substrate can be transferred to the transfer destination substrate (second substrate) maintaining the film quality, and the transfer source substrate and the transfer destination substrate can be transferred.
  • a substrate can be arbitrarily selected. Therefore, for example, by transferring a single crystal silicon film formed on an SOI substrate to a glass substrate or a flexible substrate, the plane orientation is completely controlled on the glass substrate or the flexible substrate, which has conventionally been difficult.
  • a single crystal silicon film can be formed.
  • FIGS. 18 and 19 are process diagrams showing a method of manufacturing a thin film transistor (field effect transistor) using the thin film transfer technique of the present invention.
  • silicon film 2 a p-type single crystal silicon film (hereinafter simply referred to as “silicon film”) 2 is formed on a silicon substrate 1 with a silicon oxide film 3 interposed therebetween.
  • the p-type silicon film 2 is patterned into regions that will be the source / drain and channel of the transistor.
  • the source / drain regions 2b and 2c are doped with n-type impurities (for example, phosphorus) by ion implantation, and then heat treatment (for example, about 600 to 1000 ° C.) is performed. Then, the impurities are activated.
  • n-type impurities for example, phosphorus
  • the silicon oxide film 3 is isotropically etched with hydrofluoric acid through the opening to obtain the silicon substrate 1.
  • a hollow portion 5 is formed between the silicon film 2 and the silicon film 2.
  • the silicon film 2 has a hollow structure supported by the pillars 3 a left by the etching of the silicon oxide film 3.
  • FIG. 20 (a) is a plan view showing the shape of the patterned silicon film 2
  • FIG. 20 (b) is a plan view showing the shape of the silicon film 2 having a hollow structure.
  • the opening 4 is formed only in the region to be the source / drain regions 2b and 2c, and is not formed in the region to be the channel region 2a.
  • the openings 4 are formed in a matrix (3 ⁇ 3), and a connecting portion 2d is formed at the boundary between the channel region 2a and the source / drain regions 2b and 2c.
  • a hollow silicon film 2 supported by a plurality of pillars 3a is formed as shown in FIG.
  • the pillar 3a is formed only in the source / drain regions 2b and 2c, and the channel region 2a is in a completely floating hollow state.
  • the plurality of pillars 3a are formed over the entire source / drain regions 2b and 2c, and the pillar 3b is also formed in the connecting portion 2d, the hollow channel region 2a is stably supported. be able to.
  • FIG. 21 is a SEM photograph of the hollow structure silicon film 2 prepared by the above method. As shown in FIG. 21, it can be seen that the film shape is maintained even when the silicon film is hollow.
  • water (not shown) is interposed between the silicon film 2 and the flexible substrate 10 to bring the silicon film 2 into close contact with the flexible substrate 10.
  • the silicon substrate 1 and / or the flexible substrate 10 is heated. Thereby, the water interposed between the silicon film 2 and the flexible substrate 10 is dried, so that the silicon film 2 is separated from the silicon substrate 1 and transferred to the flexible substrate 10. Thereafter, the flexible substrate 10 to which the silicon film 2 is transferred is heat-treated.
  • the flexible substrate 10 is a PET substrate
  • heat treatment is preferably performed at a temperature of about 120 ° C. Thereby, the bonding force between the silicon film 2 and the flexible substrate 19 can be further increased.
  • a gate insulating film 11 is formed on the transferred silicon film 2.
  • the gate insulating film 11 can be formed, for example, by coating using a polysilazane solution.
  • a gate electrode 12 is formed on the gate insulating film 11.
  • the gate electrode can be formed by, for example, aluminum vapor deposition, sputtering, or an ink jet method using metal nanoparticles.
  • an interlayer insulating film 13 is formed on the gate electrode 12
  • openings are formed in the interlayer insulating film 13 and the gate insulating film 11, and source / Drain electrodes 14 and 15 are formed.
  • the interlayer insulating film 13 can be formed by, for example, coating
  • the source / drain electrodes can be formed by, for example, sputtering of aluminum, vapor deposition, or an ink jet method using metal nanoparticles.
  • a thin film transistor made of a single crystal silicon film can be manufactured on the flexible substrate 10 by using the thin film transfer technique of the present invention. Also, if this transfer technology is used, activation of the source / drain which requires a high-temperature process is performed on the SOI substrate as the transfer source, and the flexible substrate 10 with low heat resistance at the transfer destination is gated by the low-temperature process. An insulating film, an electrode, or the like can be formed. Thereby, a high-performance thin film transistor can be realized with little variation.
  • the interface state between the silicon film 2 and the gate insulating film 11 in the channel region 2a affects the characteristics of the thin film transistor.
  • a method for improving the interface state it is effective to improve the film quality of the gate insulating film 11.
  • a method for improving the film quality of the gate insulating film 11 by heat-treating the gate insulating film 11 formed on the flexible substrate 10 having low heat resistance at a high temperature cannot be employed.
  • the surface of the silicon film 2 is thermally oxidized before the silicon film 2 is transferred to the flexible substrate 10. It is conceivable to form a thermal oxide film on the surface of the silicon film 2. In this case, since a thermal oxide film having a good film quality is interposed between the silicon film 2 in the channel region 2a and the gate insulating film 11, the silicon film 2 in the channel region 2a and the gate insulating film 11 The interface state can be made favorable.
  • FIGS. 22A to 22D show a method for improving the interface state between the silicon film 2 and the gate insulating film 11 in the channel region 2a in the method for manufacturing the thin film transistor shown in FIGS. It is process drawing.
  • the steps shown in FIGS. 22B to 22D are the same as the steps shown in FIGS. 18E and 19A to 19B.
  • FIG. 22A the silicon oxide film 3 is isotropically etched through the opening 4 formed in the silicon film 2 as shown in FIG.
  • FIG. 2 is a diagram in which after the hollow portion 5 is formed, the surface of the silicon film 2 supported by the pillar 3 a made of the silicon oxide film 3 is thermally oxidized to form a thermal oxide film 16 on the surface of the silicon film 2.
  • Thermal oxidation may be performed, for example, in an oxygen atmosphere at a temperature of 800 to 1100 ° C., and a thermal oxide film 16 of about 2 to 15 nm may be formed on the surface of the silicon film 2.
  • the thermal oxide film 16 having the same film thickness as the surface of the silicon film 2 opened outward (upper surface in the drawing) is formed.
  • the substantially uniform thermal oxide film 16 is formed over the entire surface of the silicon film 2. It is formed. In this thermal oxidation step, activation of the impurities ion-implanted into the source / drain regions 2b and 2c can be performed simultaneously.
  • water (not shown) is interposed between the silicon film 2 and the flexible substrate 10 to bring the silicon film 2 into close contact with the flexible substrate 10.
  • the silicon substrate 1 and / or the flexible substrate 10 is heated. Thereby, the water interposed between the silicon film 2 and the flexible substrate 10 is dried, so that the silicon film 2 is separated from the silicon substrate 1 and transferred to the flexible substrate 10.
  • a gate insulating film 11 is formed on the transferred silicon film 2.
  • the thermal oxide film 16 is interposed between the silicon film 2 in the channel region 2a and the gate insulating film 11, the interface state between the silicon film 2 and the gate insulating film 11 in the channel region 2a. Can be improved.
  • the gate electrode 12 and the source / drain electrodes 14 and 15 are formed to complete the thin film transistor.
  • the gate insulating film 11 is further formed on the thermal oxide film 16, but when the thermal oxide film 16 has a film thickness sufficient to obtain predetermined characteristics of the thin film transistor.
  • the thermal oxide film 16 may be used as it is as the gate insulating film.
  • the thermal oxidation condition takes into account the impurity concentration (particularly, the impurity concentration in the source / drain regions 2 b and 2 c). You only have to set it. Alternatively, the impurity concentration may be adjusted as appropriate in order to obtain the thermal oxide film 16 having a predetermined thickness.
  • FIG. 23A and 23B are graphs showing the results of evaluating the characteristics of the thin film transistor manufactured by such a method.
  • FIG. 23A is a graph showing a change in drain current (I DS ) with respect to a gate-source voltage (V GS ) (I DS -V GS characteristic) and a change in field effect mobility.
  • FIG. 23B is a graph showing a change (I DS -V DS characteristic) of the drain current (I DS ) with respect to the drain-source voltage (V DS ).
  • the manufactured thin film transistor was an n-channel field effect transistor having a channel length of 4 ⁇ m (an effective channel length of 3.7 ⁇ m) and a channel width of 3 ⁇ m.
  • the film thickness of the thermal oxide film 16 was 10 nm, and the film thickness of the gate insulating film 11 was 206 nm.
  • the transfer destination substrate 10 was a glass substrate.
  • the maximum value of the field effect mobility was 742 cm 2 V ⁇ 1 s ⁇ 1 and the threshold value was 1.5V.
  • the subthreshold leakage current was about 1 ⁇ 10 ⁇ 13 A, and the on / off ratio of the drain current (I DS ) was about 8 digits.
  • Such high performance as a thin film transistor indicates that the silicon film 2 transferred to the glass substrate 10 is a single crystal, and the interface state between the silicon film 2 and the gate insulating film 11 in the channel region 2a is It shows that it is favorable.
  • the surface of the silicon film 2 is thermally oxidized, and the thermal oxide film 16 is formed on the surface of the silicon film 2.
  • a high performance thin film transistor can be obtained.
  • the glass substrate to which the silicon film 2 is transferred in order to improve the adhesion between the silicon film 2 and the glass substrate 10. 10 may be heat-treated.
  • impurities contained in the glass substrate 10 for example, alkali metal or the like present on the substrate surface or inside the substrate
  • the impurity forms a mobile ion or a trap level, which may cause a decrease in leakage current, mobility, or reliability.
  • the thermal oxide film 16 is interposed between the glass substrate 10 and the silicon film 2, the thermal oxide film 16 is doped with impurities from the glass substrate 10 into the silicon film. 2 is a barrier to prevent diffusion into Therefore, even if impurities serving as a contamination source are present in the glass substrate 10 as a transfer destination, it is possible to prevent deterioration of the characteristics of the thin film transistor due to diffusion of the impurities.
  • FIG. 24 shows the result of evaluation of I DS -V GS characteristics by manufacturing a thin film transistor under the same conditions as above using a PET substrate (flexible substrate) instead of a glass substrate as the transfer destination substrate 10. It is a graph.
  • the maximum value of the field effect mobility was 343 cm 2 V ⁇ 1 s ⁇ 1 and the threshold value was 3.9 V.
  • the subthreshold leakage current was about 6 ⁇ 10 ⁇ 10 A, and the on / off ratio of the drain current (I DS ) was about 4 digits.
  • FIG. 25 is a graph showing a result of manufacturing a thin film transistor using a PET substrate (flexible substrate) instead of a glass substrate as the transfer destination substrate 10 and evaluating the I DS -V GS characteristics.
  • the thermal oxide film 16 having a film thickness of 10 nm is used as it is as the gate insulating film without forming the gate insulating film 11 on the thermal oxide film 16.
  • the thin film transistor was manufactured under the same conditions as those shown in FIG.
  • the maximum value of the field effect mobility was 627 cm 2 V ⁇ 1 s ⁇ 1 and the threshold value was 0.07 V.
  • the subthreshold leakage current was 1.3 ⁇ 10 ⁇ 12 A, and the on / off ratio of the drain current (I DS ) was about 7 digits.
  • the gate insulating film 11 on the thermal oxide film 16 is formed by a low temperature process (for example, deposition using plasma CVD or coating using a polysilazane solution), so that the quality of the oxide film is higher than that of the thermal oxide film. Although it is inferior and the leak current becomes large, it is considered that when the gate insulating film is only the thermal oxide film 11, the leak current is suppressed.
  • a low temperature process for example, deposition using plasma CVD or coating using a polysilazane solution
  • the silicon film 2 before transfer has a hollow structure supported by a plurality of pillars 3a.
  • the channel region 2a is in a completely floating hollow state.
  • the thermal oxide film 16 is formed on the surface of the silicon film 2 having such a hollow structure, volume expansion occurs when the surface of the silicon film 2 is changed to the thermal oxide film 16 by thermal oxidation. Therefore, the formed thermal oxide film 16 may be warped in the hollow silicon film 2 when stress is applied to the silicon film 2.
  • FIGS. 26A and 26B are SEM photographs showing the state in the vicinity of the channel region 2a when a 10 nm thick thermal oxide film 16 is formed on the surface of the silicon film 2 having a hollow structure.
  • FIG. 26A is an SEM photograph when the channel length (L) is 5 ⁇ m
  • FIG. 26B is an SEM photograph when the channel length (L) is 15 ⁇ m.
  • FIGS. 27A and 27B are optical micrographs showing the state of the silicon film 2 after the silicon film 2 having the hollow structure shown in FIGS. 26A and 26B is transferred to the glass substrate 10. It is. As shown in FIG. 27A, when the channel length (L) is as short as 5 ⁇ m, the channel region 2a is completely transferred in contact with the glass substrate 10, but FIG. As shown, when the channel length (L) is as long as 15 ⁇ m, an interference color is observed in the channel region 2a, and a part of the channel region 2a is transferred to the glass substrate 10 while being floated from the glass substrate 10. Yes.
  • thermal oxide films 16 having different thicknesses were formed on the silicon film 2 and the warpage of the silicon film 2 in the channel region 2a was measured.
  • the warpage of the silicon film 2 was calculated by calculating the amount of displacement from the original position of the central portion of the channel region 2a from the SEM photograph of the silicon film 2 taken from an angle of 70 °.
  • the original position was based on the height (300 nm) of the hollow portion 5 between the silicon substrate 1 and the silicon film 2.
  • FIG. 28 is a graph showing the results. As shown in FIG. 28, the displacement of the silicon film 2 increases as the thickness of the thermal oxide film 16 increases. Further, when the thermal oxide film 16 has the same thickness, the displacement of the silicon film 2 increases as the channel length increases.
  • the thermal deformation of the silicon film generated when the thermal oxide film 16 is formed on the surface of the silicon film 2 is considered. It is preferable to set the thickness of the oxide film 16.
  • the conditions for transferring the silicon film 2 in close contact with the glass substrate 10 as a transfer destination are factors other than the warp of the silicon film 2, for example, in the state shown in FIG. Since it varies depending on the degree of adhesion between the transfer film 10 and the transfer destination substrate 10, the type of liquid interposed between the silicon film 2 and the flexible substrate 10, the heating conditions for drying the liquid, etc., it is not uniquely determined. If the displacement of the silicon film 2 is set to 50 nm or less, when the channel length is 5 ⁇ m, the film thickness of the thermal oxide film 16 is 12 nm or less, and when the channel length is 10 ⁇ m, the film thickness of the thermal oxide film 16 is 8 nm. The following should be set.
  • the example in which the process of forming the thermal oxide film 16 on the surface of the silicon film 2 having the hollow structure is applied to the manufacturing process of the thin film transistor (field effect transistor) is not limited to this.
  • a step of forming the thermal oxide film 16 on the surface of the silicon film 2 having a hollow structure can be employed before the transfer.
  • the SOI substrate is used as the transfer source substrate.
  • the present invention is not limited to this.
  • a silicon substrate or a quartz substrate on which a polysilicon film is formed via an insulating film is used.
  • a flexible substrate is used as a transfer destination substrate, the substrate is not limited to this, and for example, a quartz substrate, a glass substrate, a metal wheel substrate, a wafer having an integrated circuit, or the like can be used.
  • the pattern of the silicon film 2 shown in FIG. 20A in a matrix as shown in FIG. 29, the pattern was arranged in a matrix on a transferable flexible substrate or a glass substrate.
  • a thin film transistor can be formed.
  • the opening 4 formed in the source / drain region is omitted. Accordingly, a high-performance liquid crystal display device can be manufactured by forming a wiring for driving the thin film transistor, a liquid crystal cell, or the like in a region where the thin film transistor is not formed.
  • FIG. 30A is an optical micrograph showing the pattern of the silicon film 2 transferred to the glass substrate 10. As shown in FIG. 30B, it can be seen that only the pattern of the silicon film 2 formed in the region A is transferred to the glass substrate 10.
  • the reason why a part of the silicon film 2 formed on the SOI substrate can be partially transferred to the glass substrate 10 is as follows. That is, since the silicon film 2 other than the region A is in contact with the insulating layer 3 over a large area, the silicon film 2 other than the region A than the capillary adhesive force acting on the silicon film 2 other than the region A The bond strength with the insulating layer 3 is greater. Therefore, it is considered that only the silicon film 2 in the region A in which the capillary adhesive force larger than the bonding force between the silicon film 2 and the pillar 3 a acts is transferred to the glass substrate 10.
  • FIG. 31A is an optical micrograph showing the pattern of the silicon film 2 formed in the region B with respect to the silicon film 2 remaining after the first transfer
  • FIG. 2 is an optical micrograph showing the pattern of the silicon film 2 transferred to the film. In this way, the portion remaining in the first transfer can be used for transfer again, and the silicon film 2 formed on the SOI substrate can be used effectively.
  • 32 and 33 are process diagrams showing a method of manufacturing an amorphous silicon thin film transistor using the quartz substrate 1 having the amorphous silicon film 2 formed on the surface.
  • an amorphous silicon film 2 doped with n-type impurities is deposited on the surface of the quartz substrate 1.
  • a quartz substrate 1 on which an amorphous silicon film 2 doped with n-type impurities is deposited may be separately prepared.
  • the amorphous silicon film 2 is etched to form source / drain regions.
  • a non-doped amorphous silicon film 6 is deposited on the quartz substrate 1 to pattern the channel region.
  • openings are formed in the amorphous silicon films 2 and 6, and then the quartz substrate 1 is isotropically etched with hydrofluoric acid through the openings.
  • a hollow portion 5 is formed between the substrate 1 and the amorphous silicon films 2 and 6.
  • the amorphous silicon films 2 and 6 have a hollow structure supported by the pillars 1 a left by the etching of the quartz substrate 1.
  • water (not shown) is interposed between the amorphous silicon film 6 and the flexible substrate 10 so that the amorphous silicon film 6 is brought into close contact with the flexible substrate 10.
  • the quartz substrate 1 and / or the flexible substrate 10 is heated. Thereby, the water interposed between the amorphous silicon film 6 and the flexible substrate 10 is dried, whereby the amorphous silicon films 2 and 6 are separated from the quartz substrate 1 and transferred to the flexible substrate 10.
  • a gate insulating film 11 is deposited on the transferred amorphous silicon films 2 and 6.
  • the gate insulating film 11 can be deposited, for example, by application using a polysilazane solution or by depositing a nitride film.
  • the gate electrode 12 is formed on the gate insulating film 11.
  • the gate electrode can be formed by, for example, sputtering of aluminum, vapor deposition, or an ink jet method using metal nanoparticles.
  • FIGS. 34 and 35 are process diagrams showing a method of manufacturing a solar cell using the thin film transfer technique of the present invention.
  • a single crystal silicon film (hereinafter simply referred to as “silicon film”) 2A doped with a p-type impurity is formed on a silicon substrate 1 via a silicon oxide film 3.
  • a prepared SOI substrate is prepared.
  • the silicon oxide film 3 is isotropically etched with hydrofluoric acid through the opening 4A to obtain the silicon substrate 1
  • the p-type silicon film 2 are formed with a hollow portion 5.
  • the p-type silicon film 2 has a hollow structure supported by columns (not shown) left by the etching of the silicon oxide film 3.
  • a flexible substrate 10 having a transparent electrode 18 formed on the surface is prepared, and water (not shown) is interposed between the p-type silicon film 2 and the transparent electrode 18. Then, the silicon film 2 is brought into close contact with the flexible substrate 10.
  • the silicon substrate 1 and / or the flexible substrate 10 is heated. Thereby, the water interposed between the p-type silicon film 2 and the transparent electrode 18 is dried, whereby the p-type silicon film 2 is separated from the silicon substrate 1 and transferred to the flexible substrate 10.
  • an SOI substrate is prepared in which a silicon film 2B doped with an n-type impurity is formed on a silicon substrate 1 with a silicon oxide film 3 interposed therebetween.
  • the silicon oxide film 3 is isotropically etched with hydrofluoric acid through the opening 4B to obtain the silicon substrate 1
  • a hollow portion 5 is formed between the n-type silicon film 2B and the n-type silicon film 2B.
  • the n-type silicon film 2B has a hollow structure supported by pillars (not shown) left by the etching of the silicon oxide film 3.
  • water (not shown) is interposed between the n-type silicon film 2B and the p-type silicon film 2A transferred to the flexible substrate 10, so that the n-type silicon film 2B is adhered to the flexible substrate 10.
  • the opening 4A formed in the p-type silicon film 2A and the opening 4B formed in the n-type silicon film 2B are brought into close contact with each other while being displaced from each other.
  • the silicon substrate 1 and / or the flexible substrate 10 is heated. Thereby, the water interposed between the n-type silicon film 2B and the p-type silicon film 2A is dried, so that the n-type silicon film 2B is separated from the silicon substrate 1 and transferred to the flexible substrate 10.
  • the electrode 17 is deposited on the transferred n-type silicon film 2B.
  • the electrode 17 can be formed, for example, by vapor deposition of aluminum. Thereby, the solar cell which has the PN junction which consists of laminated
  • the SOI substrate is used as the transfer source substrate.
  • the present invention is not limited to this.
  • a substrate in which a polysilicon film is formed on a silicon substrate or a quartz substrate via an insulating film is used. It may be used.
  • the flexible substrate was used as a transfer destination substrate, it is not limited to this, and for example, a glass substrate or the like can be used.
  • a step of heat treating the flexible substrate 10 may be further added to further improve the adhesion between the silicon films 2A and 2B and the flexible substrate 10. .
  • 36 to 38 are process diagrams showing another method of manufacturing a solar cell using the thin film transfer technique according to the present invention.
  • an SOI substrate is prepared in which a silicon film 2 doped with a p-type impurity is formed on a silicon substrate 1 via a silicon oxide film 3. Then, an opening 4 is formed in the silicon film 2.
  • the silicon oxide film 3 is isotropically etched with hydrofluoric acid through the opening 4 to form a hollow portion 5 between the silicon substrate 1 and the silicon film 2. .
  • the silicon film 2 has a hollow structure supported by the pillars 3 a left by the etching of the silicon oxide film 3.
  • the surface of the p-type silicon film and the back surface facing the hollow portion 5 are textured.
  • the texture processing can be performed, for example, by anisotropic etching with a TMAH (trimethylanilinium hydroxide) solution. If this method is used, the back surface facing the hollow portion 5 can be textured.
  • TMAH trimethylanilinium hydroxide
  • an n + layer is formed on the surface of the p-type silicon film 2.
  • the n + layer can be formed, for example, by applying a phosphoric acid aqueous solution and then heating. If this method is used, the phosphoric acid aqueous solution is also introduced into the opening 4 and the hollow portion 5, so that the n + layer is also formed on the side surface of the opening 4 of the p-type silicon film 2 and the back surface facing the hollow portion 5. Can be formed.
  • a silicon nitride film 7 is formed on the surface of the n + layer.
  • the silicon nitride film 7 can be formed by using, for example, a plasma CVD method.
  • water (not shown) is interposed between the silicon nitride film 7 and the glass substrate 10 so that the silicon nitride film 7 is adhered to the glass substrate 10.
  • the silicon substrate 1 and / or the glass substrate 10 is heated. Thereby, the water interposed between the silicon nitride film 7 and the glass substrate 10 is dried, whereby the silicon film 2 and the silicon nitride film 7 are separated from the silicon substrate 1 and transferred to the glass substrate 10.
  • the Ag electrode 21 is embedded in the opening 4.
  • the embedding of the Ag electrode 21 can be performed by screen printing of Ag paste.
  • an Al electrode 22 is formed on the surface of the n + layer.
  • the Al electrode 22 can be formed by applying a paste material containing aluminum powder using screen printing or the like.
  • the BSF (BackSurface Field) layer 23 is formed between the Al electrode 22 and the p-type silicon film 2 by baking the aluminum paste and diffusing aluminum into the n + layer. Form.
  • a flexible substrate 30 having an electrode 31 formed on the surface is prepared, and formed on the glass substrate 10 using an adhesive as shown in FIG. 38C.
  • the structured body including the PN junction is transferred to the flexible substrate 30.
  • the Ag electrode 21 and the Al electrode 22 are joined to the electrode 31, respectively.
  • an Ag electrode 32 is formed on the silicon nitride film 7 so as to fill the opening 4. Thereby, the solar cell formed in the flexible substrate 30 is manufactured.
  • an electronic device is not limited to the thin-film transistor and solar cell which were demonstrated in the said application example, Various electronic containing a thin film as a component Applicable to devices.

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Abstract

　本発明の薄膜形成方法は、表面に薄膜２が形成された第１の基板１を用意する工程と、薄膜２に複数の開口部４を形成する工程と、開口部４を通じて第１の基板１をエッチングして、第１の基板１と薄膜２との間に中空部５を形成する工程と、薄膜２と第２の基板１０との間に液体を介在させて、薄膜２第２の基板１０に密着させる工程と、第１の基板１及び／又は第２の基板１０を加熱する工程とを含み、加熱工程において、薄膜２と第２の基板１０との間に介在する液体が乾燥することによって、薄膜２は、第１の基板１から引き離されて、第２の基板１０に転写される。

Description

薄膜形成方法、及びそれを用いて作製した半導体基板ならびに電子デバイス
　本発明は、薄膜形成方法、及びそれを用いて作製した半導体基板ならびに電子デバイスに関する。
　薄膜トランジスタや太陽電池は、石英基板、ガラス基板、及びフレキシブル基板上に形成されたシリコン薄膜の結晶性によって、その性能が左右される。そのため、従来から、石英基板、ガラス基板、及びフレキシブル基板上に形成されたシリコン薄膜の結晶性を向上させる技術が盛んに研究されている。
　石英基板、ガラス基板、及びフレキシブル基板上に多結晶シリコン膜を形成する代表的な方法として、レーザアニール法が知られている（特許文献１）。
特開２０００－９１６０４号公報
　石英基板、ガラス基板、及びフレキシブル基板上へのシリコン膜の形成技術の向上により、高結晶性のシリコン膜が実現されているが、石英基板、ガラス基板、及びフレキシブル基板上に単結晶シリコン膜を形成することは困難とされている。
　本発明は、かかる課題に鑑みなされたもので、その主な目的は、石英基板、ガラス基板、フレキシブル基板等の基板上に、単結晶半導体膜等の薄膜を形成する薄膜形成方法、及びそれを用いて作製した半導体基板ならびに電子デバイスを提供することにある。
　本発明の一実施形態における薄膜形成方法は、表面に薄膜が形成された第１の基板を用意する工程と、薄膜に複数の開口部を形成する工程と、開口部を通じて第１の基板をエッチングして、第１の基板と薄膜との間に中空部を形成する工程と、　薄膜と第２の基板との間に液体を介在させて、薄膜を第２の基板に密着させる工程と、第１の基板及び／又は前記第２の基板を加熱する工程とを含み、加熱工程において、薄膜と第２の基板との間に介在する液体が乾燥することによって、薄膜は、第１の基板から引き離されて、第２の基板に転写されることを特徴とする。
　ある好適な実施形態において、上記薄膜は、犠牲層を挟んで第１の基板上に形成されており、上記中空部を形成する工程は、第１の基板の代わりに、犠牲層をエッチングすることにより行われ、上記加熱工程において、薄膜は、犠牲層から引き離されて、第２の基板に転写される。
　本発明の一実施形態における半導体基板は、上記の薄膜形成方法により、表面に転写された半導体薄膜を備えた半導体基板を特徴とする。
　本発明の一実施形態における電子デバイスは、上記の薄膜形成方法により、基板表面に転写された半導体薄膜を有する電子デバイスを特徴とする。
　本発明の一実施形態における薄膜トランジスタの製造方法は、表面に絶縁層を挟んで半導体薄膜が形成された第１の基板を用意する工程と、半導体薄膜を、チャネル領域、及びソース・ドレイン領域となる領域にパターニングする工程と、ソース・ドレイン領域となる半導体薄膜に複数の開口部を形成する工程と、開口部を通じて絶縁層をエッチングして、絶縁層と半導体薄膜との間に中空部を形成する工程と、半導体薄膜と第２の基板との間に液体を介在させて、半導体薄膜を第２の基板に密着させる工程と、第１の基板及び／又は第２の基板を加熱する工程とを含み、加熱工程において、半導体薄膜と第２の基板との間に介在する液体が乾燥することによって、半導体薄膜のパターンが、第１の基板から引き離されて、第２の基板に転写されることを特徴とする。
　ある好適な実施形態において、上記半導体薄膜のパターニング工程において、チャネル領域、及びソース・ドレイン領域となる領域が、マトリクス状にパターニングされる。
　本発明の一実施形態における太陽電池の製造方法は、表面に透明電極が形成された第２の基板を用意する工程と、上記薄膜形成方法により、第１の基板から第２の基板に、第１導電型の半導体薄膜及び第２導電型の半導体薄膜を、順次転写する工程とを含み、転写工程において、透明電極上に、半導体薄膜からなるＰＮ接合が形成させることを特徴とする。
　本発明によれば、石英基板、ガラス基板、フレキシブル基板等の基板上に、単結晶半導体膜等の薄膜を形成する薄膜形成方法、及びそれを用いて作製した半導体基板ならびに電子デバイスを提供することができる。
（ａ）～（ｄ）は、本発明の第１の実施形態における薄膜形成方法を示した工程図である。 （ａ）～（ｂ）は、本発明の第１の実施形態における薄膜形成方法を示した工程図である。 （ａ）～（ｃ）は、中空部の形成方法について説明した図である。 （ａ）～（ｃ）は、中空部の形成方法について説明した図である。 （ａ）～（ｃ）は、本発明における転写のメカニズムを説明した図である。 （ａ）～（ｃ）は、本発明における転写のメカニズムを説明した図である。 毛管接着力と液体の高さとの関係を示したグラフである。 （ａ）～（ｃ）は、基板の加熱方法を示した工程図である。 転写率と液体量との関係を示したグラフである。 転写率と加熱温度との関係を示したグラフである。 転写率と柱サイズとの関係を示したグラフである。 （ａ）は、転写前の薄膜の表面を示した光学顕微鏡写真で、（ｂ）は、転写後の薄膜の表面を示したＳＥＭ（走査型電子顕微鏡）写真で、（ｃ）は、転写後の薄膜のＥＢＳＤ（電子線後方散乱回折）像である。 （ａ）は、転写前の薄膜パターンの表面を示した光学顕微鏡写真で、（ｂ）は、転写後の薄膜パターンの表面を示した光学顕微鏡写真である。 中空構造の薄膜の状態を示した断面ＳＥＭ写真である。 開口部を千鳥状に配列した例を示した平面図である。 （ａ）～（ｄ）は、本発明の第２の実施形態における薄膜形成方法を示した工程図である。 （ａ）～（ｂ）は、本発明の第２の実施形態における薄膜形成方法を示した工程図である。 （ａ）～（ｅ）は、本発明における薄膜の転写技術を用いた薄膜トランジスタの製造方法を示した工程図である。 （ａ）～（ｄ）は、本発明における薄膜の転写技術を用いた薄膜トランジスタの製造方法を示した工程図である。 （ａ）は、パターニングされた単結晶シリコン膜の形状を示した平面図で、（ｂ）は、中空構造になった単結晶シリコン膜の形状を示した平面図である。 中空構造の単結晶シリコン膜のＳＥＭ写真である。 （ａ）～（ｄ）は、本発明における薄膜トランジスタの他の製造方法を示した工程図である。 （ａ）は、ガラス基板上に作製した薄膜トランジスタのＩＤS－ＶＧＳ特性を示したグラフ、（ｂ）は、薄膜トランジスタのＩＤS－ＶＤＳ特性を示したグラフである フレキシブル基板に転写して形成した薄膜トランジスタのＩＤS－ＶＧＳ特性を示したグラフである。 フレキシブル基板に転写して形成した薄膜トランジスタ(絶縁膜は熱酸化膜のみ)のＩＤS－ＶＧＳ特性を示したグラフである。 （ａ）、（ｂ）は、中空構造のシリコン膜の表面に熱酸化膜を形成したときの、チャネル領域近傍の状態を示したＳＥＭ写真である。 （ａ）、（ｂ）は、中空構造のシリコン膜をガラス基板に転写した後のシリコン膜の状態を示した光学顕微鏡写真である。 熱酸化膜の膜厚に対するシリコン膜の変位を示したグラフである。 マトリクス状に形成された単結晶シリコン膜パターンの平面図である。 （ａ）は、転写前の単結晶シリコン膜のパターンを示した光学顕微鏡写真で、（ｂ）は、転写後の単結晶シリコン膜のパターンを示した光学顕微鏡写真である。 （ａ）は、転写前の単結晶シリコン膜のパターンを示した光学顕微鏡写真で、（ｂ）は、転写後の単結晶シリコン膜のパターンを示した光学顕微鏡写真である。 （ａ）～（ｅ）は、アモルファスシリコン薄膜トランジスタを製造する方法を示した工程図である。 （ａ）～（ｄ）は、アモルファスシリコン薄膜トランジスタを製造する方法を示した工程図である。 （ａ）～（ｄ）は、本発明における薄膜の転写技術を用いた太陽電池の製造方法を示した工程図である。 （ａ）～（ｅ）は、本発明における薄膜の転写技術を用いた太陽電池の製造方法を示した工程図である。 （ａ）～（ｅ）は、本発明における薄膜の転写技術を用いた太陽電池の他の製造方法を示した工程図である。 （ａ）～（ｄ）は、本発明における薄膜の転写技術を用いた太陽電池の他の製造方法を示した工程図である。 （ａ）～（ｄ）は、本発明における薄膜の転写技術を用いた太陽電池の他の製造方法を示した工程図である。
　本願発明者等は、転写元の石英基板上に形成されたアモルファスシリコン膜を、結晶化と同時に、転写先の基板（ガラス基板やフレキシブル基板）に転写する技術を、特願２０１１－１７６３３５の明細書に開示している。この転写技術は、アモルファスシリコン膜に開口部を形成し、この開口部を通じて、石英基板をエッチングすることにより、石英柱に支えられたアモルファスシリコン膜の中空構造を形成した後、転写先の基板をアモルファスシリコン膜に密着させた状態で、石英基板側からレーザ照射を行って、アモルファスシリコン膜を溶融、再結晶化させるというものである。そして、結晶化されたシリコン膜は、転写先の基板との化学結合が強いため、転写先の基板に転写される。
　この転写技術によれば、ガラス基板やフレキシブル基板上に、大面積の結晶性の良いシリコン膜を形成することができるため、高性能の液晶パネル、太陽電池等の電子デバイスの実現が期待できる。
　しかしながら、この転写技術は、アモルファスシリコン膜の溶融、再結晶化技術が必要となるため、転写先の基板に、大面積の単結晶シリコン膜を転写するには、まだ解決すべき課題を残す。
　そこで、本願発明者等は、ＳＯＩ（Silicon on Insulator）基板に形成された単結晶シリコン膜に注目し、この単結晶シリコン膜を、石英基板、ガラス基板、フレキシブル基板等の基板に転写する技術を検討し、本発明を想到するに至った。
　以下、本発明の実施形態を図面に基づいて詳細に説明する。なお、本発明は、以下の実施形態に限定されるものではない。また、本発明の効果を奏する範囲を逸脱しない範囲で、適宜変更は可能である。
　（第１の実施形態）　
　図１及び図２は、本発明の第１の実施形態における薄膜形成方法を示した工程図である。
　まず、図１（ａ）に示すように、表面に犠牲層３を挟んで薄膜２が形成された第１の基板１を用意する。このような基板として、例えば、ＳＯＩ基板を用いることができる。この場合、第１の基板１は単結晶シリコン基板であり、薄膜２は単結晶シリコン膜であり、犠牲層３はシリコン酸化膜である。
　次に、図１（ｂ）に示すように、薄膜２に、複数の開口部４を形成する。開口部４は、例えば、フォトリソグラフィ工程を用いて、エッチングにより形成することができる。
　次に、図１（ｃ）に示すように、開口部４を通じて、犠牲層３をエッチングして、第１の基板１と薄膜２との間に中空部５を形成する。例えば、犠牲層３がシリコン酸化膜の場合、フッ酸を用いてエッチングすることができる。また、エッチングは、薄膜２と第１の基板１とのエッチング選択比の大きいエッチング液を用いることが好ましい。
　次に、図１（ｄ）に示すように、薄膜２と第２の基板１０との間に液体（不図示）を介在させて、薄膜２に第２の基板１０を密着させる。このとき、薄膜２と第２の基板１０との間に液体が介在する他、開口部４及び中空部５にも液体が充満する。第２の基板１０は、例えば、石英基板、ガラス基板、フレキシブル基板等を用いることができる。また、液体は、例えば、水、エタノール、アセトン等を用いることができる。特に、表面張力の大きな液体（例えば水等）が好ましい。
　次に、図２（ａ）に示すように、第１の基板１及び／又は第２の基板１０を加熱する。加熱は、液体の沸点以下の温度で行い、例えば、ハロゲンランプやホットープレート等を用いて行うことができる。なお、この加熱工程は、薄膜２と第２の基板１０との間に介在する液体、並びに開口部４及び中空部５内に充満する液体を乾燥させることを目的とするもので、必ずしも第１の基板１及び第２の基板１０の両方を直接加熱する必要はなく、例えば、一方の基板を加熱して、他方の基板を間接的に加熱する方法であってもよい。
　図２（ｂ）に示すように、この加熱工程において、薄膜２と第２の基板との間に介在する液体が乾燥することによって、薄膜２は、第１の基板１から引き離される。これにより、第２の基板１０を引き上げれば、薄膜２は、第２の基板１０に転写される。このとき、薄膜２は、開口部４が形成されたパターンのまま、第２の基板１０に転写される。また、第１の基板１上には、犠牲層３の一部からなる柱３ａが残る。
　以上説明したように、本実施形態における薄膜形成方法によれば、第２の基板１０には、第１の基板１に形成された薄膜２がそのまま転写される。従って、薄膜２が単結晶膜であれば、単結晶膜のまま、第２の基板１０に転写されることになる。これにより、石英基板、ガラス基板、及びフレキシブル基板等の基板上に、単結晶半導体薄膜を形成することが可能となる。
　次に、図３及び図４を参照しながら、中空部５の形成方法について説明する。
　図３（ａ）は、複数の開口部４が形成された薄膜２の平面図である。図３（ａ）に示すように、複数の開口部４はアレイ状に形成されている。そして、開口部４を通じて、犠牲層３をエッチングするエッチング液を供給して、犠牲層３を等方性エッチングする。犠牲層３の膜厚分のエッチングが進むと、エッチングは、犠牲層３の膜に平行な方向に沿ってさらに進む。図３（ａ）中の点線は、開口部４を中心にして、犠牲層３の膜に平行な方向にエッチングが進んだ状態のときの犠牲層３の境界を示す。
　図３（ｂ）、（ｃ）は、この状態を示した断面図で、図３（ｂ）は、図３（ａ）のIIIb－IIIbに沿った断面図、図３（ｃ）は、図３（ａ）のIIIc－IIIcに沿った断面図である。このとき、図３（ｂ）に示すように、IIIb－IIIbに沿った箇所では、第１の基板１と薄膜２との間に中空部５が形成されているが、図３（ｃ）に示すように、IIIc－IIIcに沿った箇所では、中空部５はまだ形成されていない。
　さらにエッチングを進めて、図４（ａ）に示すように、IIIb－IIIbに沿った箇所で、第１の基板１と薄膜２との間の犠牲層３は全てエッチングされて中空部５のみとなるが、図４（ｃ）に示すように、IIIc－IIIcに沿った箇所では、犠牲層３の一部からなる柱３ａが残る。その結果、図４（ａ）に示すように、薄膜２は、アレイ状に配置された柱３ａによって支えられた中空構造となる。
　ここで、犠牲層３のエッチングは、柱３ａのサイズが、後述する転写可能なサイズになるように、時間管理等によって制御される。なお、柱３ａは、犠牲層３の膜に平行な方向のエッチングによって形成されるため、所定サイズの柱３ａを制御よく形成することができる。
　次に、図５～図６を参照しながら、本発明における転写のメカニズムを説明する。
　図５（ａ）は、図１（ｄ）に示したように、薄膜２と第２の基板１０との間に液体２０ｂを介在させて、薄膜２に第２の基板１０を密着させた状態を示した断面図である。このとき、開口部４及び中空部５にも液体２０ａが充満される。
　なお、図５（ａ）では、説明の都合上、図４（ｂ）に示した開口部４と、図４（ｃ）に示した柱３ａとを、同一断面で示している。また、薄膜２と第２の基板１０との間に介在する液体２０ｂは、厚みを誇張して描いている。
　次に、図５（ｂ）に示すように、第１の基板１及び／又は第２の基板１０を加熱すると、まず、外部に通じた中空部５及び開口部４に充填された液体２０ａが乾燥し、さらに乾燥が進むと、図５（ｃ）に示すように、薄膜２と第２の基板１０との間に介在する液体２０ｂのみ残る。
　図６（ａ）は、図５（ｃ）中のサークルＡで示した領域を拡大した断面図である。薄膜２と第２の基板１０との間に介在する液体２０ｂは、毛管架橋を形成し、柱３ａに支えられた薄膜２には、毛管接着力（メニスカス力）が働いている。この毛管接着力の大きさは、液体２０ｂの高さ（架橋の高さ）Ｈ、薄膜２と液体２０ｂとの接触面積、及び接触度θＥに依存する。
　図７は、液体を水とし、薄膜２と液体２０ｂとの接触面積（１本の柱３ａで支える面積）を９μｍ×９μｍ、接触角θＥを３０°としたときの、液体２０ｂの高さＨに対する毛管接着力の大きさを、シミュレーションにより計算した値を示したグラフである。ここで、毛管接着力の大きさは、以下のようにして求めた（「表面張力の物理学」，Pierre-Gilles de Gennes, Francoise Brochard-Wyart, David Quere（著），奥村剛（訳）：第２版（２００８）p.6-9を参照）。
　間隔Ｈの２枚の基板間に液体を入れた場合、液体は毛管架橋と呼ばれる形になる。その半径をＲとすると、液体内のラプラス圧力Δｐは、次式で表される。
Figure JPOXMLDOC01-appb-M000001
　θＥ＜π／２であれば、基板の張り付かす力、すなわち毛管接着力Ｆは引力となり、次式で表される。
Figure JPOXMLDOC01-appb-M000002
　図７に示すように、液体２０ｂの高さＨが小さくなると、急激に毛管接着力が大きくなるのが分かる。そのため、図６（ｂ）に示すように、液体２０ｂの乾燥が進み、液体２０ｂ高さＨが所定の値よりも小さくなると、毛管接着力Ｆは、第１の基板１と柱３ａとの結合力よりも大きくなり、図６（ｃ）に示すように、薄膜２と第２の基板１０との間に介在する液体２０ｂが完全に乾燥すると、薄膜２は、柱３ａから引き離され、第２の基板１０に転写される。
　毛管接着力Ｆは、薄膜２と液体２０ｂとの接触面積に依存し、第１の基板１と柱３ａとの結合力は、第１の基板１と柱３ａとの接触面積に依存する。例えば、中空部５を、図３及び図４に示したような方法で作成した場合、柱３ａは、開口部４と同じ間隔でアレイ状に形成される。この場合、２個×２個のアレイにある４個の開口部４に囲まれた薄膜２は、中央にある一つの柱３ａによって支えられた格好になる。従って、一つの柱３ａによって支えられた薄膜２の面積、すなわち、薄膜２と液体２０ｂとの接触面積は、開口部４の間隔を変えることによって調整することができる。また、第１の基板１と柱３ａとの接触面積は、柱３ａの横断面積（サイズ）を変えることによって調整することができる。ここで、柱３ａの横断面積は、中空部５を形成する工程において、犠牲層３のエッチング量を調整することによって変えることができる。
　なお、薄膜２と第２の基板１０との間に介在する液体による毛管接着力Ｆは、図６（ａ）に示すように、薄膜２に接する液体の接触角θＥが９０°未満のときに作用する。そのため、第２の基板１０は、液体に対して親水性であれば、より好ましい。従って、第２の基板１０が液体に対して親水性を有さない材料の場合には、第２の基板１０の表面に、親水性をもたせる表面処理を行うのが好ましい。　　
　なお、親水性をもたせる表面処理としては、例えば、第２の基板１０の表面に極性を持った薄膜を形成する等により行うことができる。また、第２の基板１０がフレキシブル基板の場合には、基板表面にキトサンを塗布する等により行うことができる。
　以上、説明したように、薄膜２の第２の基板１０への転写は、薄膜２と第２の基板１０との間に介在する液体２０ｂによる毛管接着力を利用して行われるが、実際には、薄膜２の表面及び第２の基板の表面は、薄膜２と第２の基板１０との間に介在する液体２０ｂは、場所によってバラツキがある。従って、毛管接着力も、場所によってバラツキが生じる。そのため、液体２０ｂの乾燥を、基板全体で一斉に行うと、様々な方向から転写が進行し、第２の基板１０に転写された薄膜２に皺が生じるおそれがある。
　図８は、この問題を改善した基板の加熱方法を示した工程図である。
　図８（ａ）は、図５（ａ）と同じ状態を示した図である。なお、図８（ａ）では、説明の都合上、柱３ａは示していない。
　図８（ｂ）に示すように、第１の基板１及び第２の基板１０を、基板１、１０の端部から一定方向に液体が蒸発するように加熱すると、まず、第１の基板１と薄膜２との間の中空部５にある液体２０ａが外部に蒸発した後、端部（図中の左側）に近い側から、開口部４を通して、薄膜２と第２の基板１０との間に介在する液体２０ｂが、中空部５を通って、外部に蒸発していく。その結果、基板１、１０の端部に近い薄膜２と第２の基板１０との間に介在する液体２０ｂが蒸発することによって、当該部分の薄膜２が柱３ａ（不図示）から引き離され、第２の基板１０に転写される。さらに、加熱を基板１、１０の内側（図中の右側）方向に進めると、図８（ｃ）に示すように、さらに内側にある薄膜２と第２の基板１０との間に介在する液体２０ｂが蒸発することによって、当該部分の薄膜２が柱３ａ（不図示）から引き離され、第２の基板１０に転写される。
　このように、第１の基板１及び第２の基板１０を、基板１、１０の端部から一定方向に沿って液体が蒸発するように加熱することによって、転写するタイミングを制御することができる。その結果、皺のない状態で、薄膜２を第２の基板１０に転写することが可能となる。
　本発明における転写技術は、薄膜２と第２の基板１０との間に存在する液体２０ｂによって薄膜２に作用する毛管接着力と、薄膜２と柱３ａとの結合力との差を利用して、薄膜２を第２の基板１０に転写するものである。そのため、薄膜２の第２の基板１０への転写を確実に行うためには、薄膜２と第２の基板との間に供給する液体の量、当該液体を蒸発させるための加熱温度、及び中空構造の薄膜２を支える柱３ａのサイズが重要なパラメータとなる。
　図９～図１１は、これらのパラメータに対して転写率を測定した結果を示したグラフである。なお、測定には、第１の基板１として、シリコン基板上に、シリコン酸化膜（厚さ：５００ｎｍ）を介して単結晶シリコン薄膜（厚さ：１８０ｎｍ）が形成されたＳＯＩ基板を用い、第２の基板１０として、ＰＥＴ（ポリエチレンテレフタレート）基板を用いた。また、薄膜（単結晶シリコン膜）２には、２μｍ×２μｍの大きさの開口部４を、１１μｍのピッチでアレイ状に形成し、中空構造の単結晶シリコン膜を支える柱３ａを１μｍ×１μｍのサイズにした。なお、中空構造は、第１の基板１において、６ｍｍ×６ｍｍの領域に形成した。また、液体は、水を用いた。また、転写率は、（転写されたSi膜面積)／(転写前のSi膜面積)×１００（％）より求めた。
　図９は、薄膜２と第２の基板１０との間に供給した液体（水）の量に対して、薄膜２の転写率を測定した結果を示したグラフである。ここで、液体（水）の供給は、中空構造が形成された領域（６ｍｍ×６ｍｍ）の中央に、ピペットで、２μｌ～８μｌの水を滴下した後、転写先の基板と密着させることによって行った。
　図９に示すように、一定以上（４μｌ）の液体があれば、供給する液体の量に依存せず、１００％の転写率が実現できる。なお、液体量が２μｌの場合に転写率が８０％に低下したのは、液体の供給が不十分で、場所によって、薄膜２と第２の基板との間に液体の存在しない領域ができたためと考えられる。また、液体を全く供給しない場合、転写率は０％であった。これは、薄膜２と第２の基板１０との間に液体が存在しないため、薄膜２に、柱３ａから引き離す毛管接着力が全く作用しなかったためである。
　図１０は、薄膜２と第２の基板との間に介在した液体（水）を蒸発させるための加熱温度に対して、薄膜２の転写率を測定した結果を示したグラフである。
　図１０に示すように、加熱温度が３０℃以上であれば、１００％の転写率が実現できる。これは、転写率が、乾燥速度に依存せず、薄膜２に作用する毛管接着力によって律速されていることを意味する。なお、液体の沸点以上の温度（水の場合、１００℃以上）で加熱すると、準静的な毛管接着力が薄膜２に作用しないため、均一な転写ができず、好ましくない。
　図１１は、中空構造の薄膜２を支える柱３ａのサイズに対して、薄膜２の転写率を測定した結果を示したグラフである。
　図１１に示すように、柱３ａのサイズが１．２μｍ×１．２μｍ以下の場合、薄膜２の転写率は１００％となった。一方、柱３ａのサイズが大きくなるに従い、転写率は低下した。これは、本発明における転写のメカニズムが、薄膜２と第２の基板１０との間に介在する液体２０ｂによって薄膜２に作用する毛管接着力が、薄膜２と柱３ａとの結合力よりも大きくなったときに、薄膜２が第２の基板１０に転写されることを示唆するものである。
　なお、図９～図１１に示したグラフは、薄膜２を第２の基板１０に確実に転写するために、転写に寄与する重要なパラメータをどのように設定すればよいかの指針を与えるものである。従って、グラフに示した数値は、中空構造の形状、基板１、１０や薄膜２、犠牲層３の材料、供給する液体等によって変わるもので、絶対的な意味をなすものでない。
　図１２（ａ）は、転写前の薄膜２の表面を示した光学顕微鏡写真で、図１２（ｂ）は、転写後の薄膜２の表面を示したＳＥＭ（走査型電子顕微鏡）写真である。ここで、転写元の基板はＳＯＩ基板を用い、開口部４は、千鳥状に形成した。また、転写先の基板はガラス基板を用いた。図１２（ｂ）に示すように、薄膜２は、開口部４が形成された状態のまま、転写先の基板に転写されている。図１２（ｃ）は、転写後の薄膜（単結晶シリコン膜）のＥＢＳＤ（電子線後方散乱回折）像を示し、（１００）の結晶方位の揃った単結晶シリコン膜が転写されているのが確認できた。
　また、図１３（ａ）は、薄膜２を、後述する薄膜トランジスタのパターンに形成したときの転写前の薄膜パターンを示した光学顕微鏡写真で、図１３（ｂ）は、転写後の薄膜パターンを示した光学顕微鏡写真である。ここで、転写元の基板はＳＯＩ基板を用い、開口部４は、薄膜トランジスタのソース・ドレイン領域に形成した。また、転写先の基板はフレキシブル基板を用いた。図１３（ｂ）に示すように、薄膜２は、開口部４が形成されたパターンのまま、転写先の基板に転写されている。
　また、図１４は、中空構造の薄膜２の状態を示した断面ＳＥＭ写真である。図１４に示すように、中空部５が形成された薄膜２は、膜形状を維持したまま、柱３ａによって支持されているのが分かる。
　本発明において、中空部５は、薄膜２に形成した開口部４を通じて、犠牲層３をエッチングすることにより形成される。従って、開口部４の配列の仕方に応じて、犠牲層３のエッチング後に残る柱３ａの配列も変わる。
　図１５は、開口部４を千鳥状に配列した例を示した平面図である。この場合、図１５に示すように、柱３ａは、開口部４を囲む６箇所に形成される。一方、図４に示したように、開口部４をアレイ状に配列した場合、柱３ａは、開口部４を囲む４箇所に形成される。従って、中空状態の薄膜２を支える柱３ａの数は、開口部４をアレイ状に配列するよりも、千鳥状に配列した方が多く形成できる。
　本実施形態において、転写元の基板として、ＳＯＩ基板を例に説明したが、これに限定されず、種々の材料の基板を用いることができる。例えば、第１の基板は、石英基板やガラス基板であってもよい。また、転写される薄膜２は、多結晶シリコン膜や、アモルファスシリコン膜であってもよく、他の半導体薄膜（例えば、ゲルマニウム膜、炭化ケイ素（ＳｉＣ）膜、水素化アモルファスシリコン（ａ-Ｓｉ：Ｈ）膜等）であってもよい。また、転写される薄膜２は、酸化膜等の絶縁膜や、その他の膜であってもよい。
　また、本実施形態において、薄膜と第２の基板との間に介在させる液体は特に限定されず、水、エタノール、アセトン以外に、例えば、パーヒドロポリシラザン等を用いてもよい。なお、パーヒドロポリシラザンを用いた場合には、ポリシラザンが蒸発した際、薄膜に毛管接着力が作用することに加え、パーヒドロポリシラザンの分子構造の変化（シリカ転化）に伴い、薄膜界面とパーヒドロポリシラザンとが化学結合することより、薄膜に化学結合力がさらに作用することによって、第２の基板に転写させることができる。
　また、本実施形態において、薄膜２に形成する開口部４の形状は特に限定されず、例えば、長方形や円形であってもよい。また、開口部４の配列も、アレイ状（マトリクス状も含む）に限定されず、例えば、不規則な配列を含んでいてもよい。
　また、本実施形態において、薄膜２は、そのままの状態で第２の基板１０に転写されるが、薄膜２と第２の基板１０との密着性をさらに高めるために、薄膜２が転写された第２の基板１０を熱処理する工程をさらに加えてもよい。例えば、転写先の第２の基板１０が、ＰＥＴ（ポリエチレンテレフタレート）樹脂からなるフレキシブル基板の場合、第２の基板（ＰＥＴ基板）１０のガラス転移温度（約１１０℃）以上で熱処理を行うと、密着強度をより高めることができる。なお、熱処理温度が１５０℃以上になると、ＰＥＴ基板が変質するため、熱処理温度は、１５０℃未満にするのが好ましい。また、例えば、転写先の第２の基板１０が、石英基板やガラス基板の場合には、レーザ照射を行うことにより、熱処理を行うことができる。と熱処理手段としては、レーザ照射の他に、熱プラズマジェット、フラッシュランプ、電気炉等を用いてもよい。
　（第２の実施形態）
　第１の実施形態で説明した転写元の基板は、第１の基板１上に犠牲層３を挟んで薄膜２が形成されたものを用いた。この場合、中空部５は、薄膜２に形成された開口部４を通じて、犠牲層３をエッチングすることにより形成される。すなわち、中空部５の高さは、犠牲層３の膜厚で規制される。
　しかしながら、犠牲層３を用いなくても、中空部５を形成することは可能である。本発明の第２の実施形態では、転写元の基板として、第１の基板上に薄膜２が形成されたものを用いて、薄膜２を第２の基板に転写する方法を説明する。
　図１６及び図１７は、本発明の第２の実施形態における薄膜形成方法を示した工程図である。
　まず、図１６（ａ）に示すように、表面に薄膜２が形成された第１の基板１を用意する。このような基板として、例えば、石英基板上にアモルファスシリコン膜が形成されたものを用いることができる。
　次に、図１６（ｂ）に示すように、薄膜２に、複数の開口部４を形成する。開口部４は、例えば、フォトリソグラフィ工程を用いて、エッチングにより形成することができる。
　次に、図１６（ｃ）に示すように、開口部４を通じて、第１の基板１をエッチングして、第１の基板１と薄膜２との間に中空部５を形成する。例えば、第１の基板１が石英基板の場合、フッ酸を用いてエッチングすることができる。このとき、中空部５の高さは、第１の基板１の横方向のエッチング長さとほぼ同じになる。
　次に、図１６（ｄ）に示すように、薄膜２と第２の基板１０との間に液体（不図示）を介在させて、薄膜２を第２の基板１０を密着させる。第２の基板１０は、例えば、石英基板、ガラス基板、フレキシブル基板等を用いることができる。また、液体は、例えば、水、エタノール、アセトン等を用いることができる。
　次に、図１７（ａ）に示すように、第１の基板１及び／又は第２の基板１０を加熱する。加熱は、液体の沸点以下の温度で行い、例えば、ハロゲンランプやホットープレート等を用いて行うことができる。なお、この加熱工程は、薄膜２と第２の基板１０との間に介在する液体を乾燥させることを目的にするもので、必ずしも第１の基板１及び第２の基板１０の両方を直接加熱する必要はなく、例えば、一方の基板を加熱して、他方の基板を間接的に加熱する方法であってもよい。
　図１７（ｂ）に示すように、この加熱工程において、薄膜２と第２の基板１０との間に介在する液体が乾燥することによって、薄膜２は、第１の基板１から引き離される。これにより、第２の基板１０を引き上げれば、薄膜２は、第２の基板１０に転写される。このとき、薄膜２は、開口部４が形成されたパターンのまま、第２の基板１０に転写される。また、第１の基板１の表面には、第１の基板１の一部である柱１ａが残る。
　本実施形態における転写のメカニズムは、第１の実施形態における転写のメカニズムと基本的に同じである。すなわち、薄膜２と第２の基板１０との間に介在する液体によって薄膜２に作用する毛管接着力と、薄膜２と柱１ａとの結合力との差を利用して、薄膜２を第２の基板１０に転写することがきる。
　本実施形態において、転写元の基板として、表面に薄膜２が形成された石英基板を例に説明したが、これに限定されず、種々の材料の基板を用いることができる。例えば、第１の基板は、シリコン基板やガラス基板であってもよい。また、転写される薄膜２は、ポリシリコン膜であってもよく、他の半導体薄膜（例えば、ゲルマニウム膜、炭化ケイ素（ＳｉＣ）膜、水素化アモルファスシリコン（ａ-Ｓｉ：Ｈ）膜等）であってもよい。また、転写される薄膜２は、酸化膜等の絶縁膜や、その他の膜であってもよい。
　また、本実施形態において、薄膜と第２の基板との間に介在させる液体は特に限定されず、水、エタノール、アセトン以外に、例えば、パーヒドロポリシラザン等を用いてもよい。なお、パーヒドロポリシラザンを用いた場合には、ポリシラザンが蒸発した際、薄膜に毛管接着力が作用することに加え、パーヒドロポリシラザンの分子構造の変化（シリカ転化）に伴い、薄膜界面とパーヒドロポリシラザンとが化学結合することより、薄膜に化学結合力がさらに作用することによって、第２の基板に転写させることができる。
　また、本実施形態において、薄膜２に形成する開口部４の形状は特に限定されず、例えば、長方形や円形であってもよい。また、開口部４の配列も、アレイ状（マトリクス状も含む）に限定されず、例えば、不規則な配列を含んでいてもよい。
　また、本実施形態において、薄膜２は、そのままの状態で第２の基板１０に転写されるが、薄膜２と第２の基板１０との密着性をさらに高めるために、薄膜２が転写された第２の基板１０を熱処理する工程をさらに加えてもよい。
　（応用例）
　本発明では、転写元の基板（第１の基板）に形成した薄膜を、膜質を維持したまた転写先の基板（第２の基板）に転写させることができ、転写元の基板と転写先の基板とを、任意に選べることができる。従って、例えば、ＳＯＩ基板に形成された単結晶シリコン膜を、ガラス基板やフレキシブル基板に転写することによって、従来、困難とされていた、ガラス基板やフレキシブル基板上に面方位が完全に制御された単結晶シリコン膜を形成することが可能となる。
　以下、本発明における薄膜の転写技術を用いた電子デバイスの製造方法について説明する。
　（１）薄膜トランジスタの製造
　図１８及び図１９は、本発明における薄膜の転写技術を用いた薄膜トランジスタ（電界効果トランジスタ）の製造方法を示した工程図である。
　まず、図１８（ａ）に示すように、シリコン基板１上に、シリコン酸化膜３を介してｐ型の単結晶シリコン膜（以下、単に「シリコン膜」という）２が形成されたＳＯＩ基板を用意する。
　次に、図１８（ｂ）に示すように、ｐ型シリコン膜２を、トランジスタのソース・ドレイン、及びチャネルとなる領域にパターニングする。
　次に、図１８（ｃ）に示すように、ソース・ドレイン領域２ｂ、２ｃに、ｎ型不純物（例えば、リン）をイオン注入によりドープした後、熱処理（例えば、約６００－１０００℃）を行って、不純物の活性化を行う。
　次に、図１８（ｄ）に示すように、シリコン膜２に開口部（不図示）を形成した後、開口部を通じて、シリコン酸化膜３をフッ酸で等方性エッチングして、シリコン基板１とシリコン膜２との間に中空部５を形成する。このとき、シリコン膜２は、シリコン酸化膜３のエッチングにより残された柱３ａによって支えられた中空構造となる。
　図２０（ａ）は、パターニングされたシリコン膜２の形状を示した平面図で、図２０（ｂ）は、中空構造になったシリコン膜２の形状を示した平面図である。
　図２０（ａ）に示すように、開口部４は、ソース・ドレイン領域２ｂ、２ｃとなる領域のみに形成され、チャネル領域２ａとなる領域には形成されていない。また、開口部４は、マトリクス状（３個×３個）に形成され、チャネル領域２ａと、ソース・ドレイン領域２ｂ、２ｃとの境界には、繋ぎ部２ｄが形成されている。
　このように形成された開口部４を通じて、シリコン酸化膜３をエッチングすると、図２０（ｂ）に示すように、複数の柱３ａで支えられた中空構造のシリコン膜２が形成される。ここで、柱３ａは、ソース・ドレイン領域２ｂ、２ｃのみに形成され、チャネル領域２ａは、完全に浮いた中空状態になっている。しかしながら、ソース・ドレイン領域２ｂ、２ｃの全領域に亘って複数の柱３ａが形成され、かつ、繋ぎ部２ｄにも柱３ｂが形成されているため、中空状態のチャネル領域２ａを安定して支えることができる。
　図２１は、上記方法で作成した中空構造のシリコン膜２のＳＥＭ写真である。図２１に示すように、シリコン膜を中空状態にしても、膜形状が維持されているのが分かる。
　次に、図１８（ｅ）に示すように、シリコン膜２とフレキシブル基板１０との間に水（不図示）を介在させて、シリコン膜２をフレキシブル基板１０に密着させる。
　次に、図１９（ａ）に示すように、シリコン基板１及び／又はフレキシブル基板１０を加熱する。これにより、シリコン膜２とフレキシブル基板１０との間に介在した水が乾燥することによって、シリコン膜２は、シリコン基板１から引き離され、フレキシブル基板１０に転写される。その後、シリコン膜２が転写されたフレキシブル基板１０を熱処理する。例えば、フレキシブル基板１０がＰＥＴ基板の場合、約１２０℃の温度で熱処理するのが好ましい。これにより、シリコン膜２とフレキシブル基板１９との結合力をより高めることができる。
　次に、図１９（ｂ）に示すように、転写されたシリコン膜２上に、ゲート絶縁膜１１を形成する。ゲート絶縁膜１１の形成は、例えば、ポリシラザン溶液を用いて塗布により形成することができる。
　次に、図１９（ｃ）に示すように、ゲート絶縁膜１１上に、ゲート電極１２を形成する。ゲート電極の形成は、例えば、アルミニウムの蒸着、スパッタリング、あるいは金属ナノ粒子を用いたインクジェット方式により形成することができる。
　最後に、図１９（ｄ）に示すように、ゲート電極１２上に、層間絶縁膜１３を形成した後、層間絶縁膜１３及びゲート絶縁膜１１に開口部を形成し、この開口部にソース・ドレイン電極１４、１５を形成する。これにより、単結晶シリコン膜からなる薄膜トタンジスタが製造される。ここで、層間絶縁膜１３は、例えば、塗布により形成することができ、ソース・ドレイン電極は、例えば、アルミニウムのスパッタリング、蒸着、あるいは金属ナノ粒子を用いたインクジェット方式により形成することができる。
　以上、説明したように、本発明における薄膜の転写技術を用いれば、フレキシブル基板１０上に、単結晶シリコン膜からなる薄膜トランジスタを製造することができる。また、この転写技術を用いれば、高温プロセスが必要なソース・ドレインの活性化を、転写元のＳＯＩ基板に対して行い、転写先の耐熱性の低いフレキシブル基板１０に対して、低温プロセスによるゲート絶縁膜や電極等を形成することができる。これにより、高性能な薄膜トランジスタをバラツキが少なく実現することができる。
　ところで、チャネル領域２ａにおけるシリコン膜２と、ゲート絶縁膜１１との界面状態は、薄膜トランジスタの特性に影響を与える。この界面状態を良好にする方法として、ゲート絶縁膜１１の膜質を向上させることが有効である。しかしながら、耐熱性の低いフレキシブル基板１０上に形成されたゲート絶縁膜１１に対しては、高温で熱処理することによって、ゲート絶縁膜１１の膜質を向上させる方法を採用することはできない。
　そこで、チャネル領域２ａにおけるシリコン膜２と、ゲート絶縁膜１１との界面状態を良好にする方法として、シリコン膜２を、フレキシブル基板１０に転写する前に、シリコン膜２の表面を熱酸化して、シリコン膜２の表面に熱酸化膜を形成しておくことが考えられる。このようにすれば、チャネル領域２ａにおけるシリコン膜２と、ゲート絶縁膜１１との間に、膜質のよい熱酸化膜が介在するため、チャネル領域２ａにおけるシリコン膜２と、ゲート絶縁膜１１との界面状態を良好なものにすることができる。
　図２２（ａ）～（ｄ）は、図１８及び図１９に示した薄膜トランジスタの製造方法において、チャネル領域２ａにおけるシリコン膜２と、ゲート絶縁膜１１との界面状態を良好にする方法を示した工程図である。なお、図２２（ｂ）～（ｄ）に示した工程は、図１８（ｅ）、図１９（ａ）～（ｂ）に示した工程と同じである。
　図２２（ａ）は、図１８（ｄ）に示したように、シリコン膜２に形成された開口部４を通じて、シリコン酸化膜３を等方性エッチングして、シリコン基板１とシリコン膜２との間に中空部５を形成した後、シリコン酸化膜３からなる柱３aによって支えられたシリコン膜２の表面を熱酸化して、シリコン膜２の表面に熱酸化膜１６を形成した図である。熱酸化は、例えば、酸素雰囲気中で、８００～１１００℃の温度で行い、シリコン膜２の表面に、約２～１５ｎｍの熱酸化膜１６を形成すればよい。このとき、中空部５内にも、シリコン膜２に形成された開口部４から十分な量の酸素が供給されるため、中空部５に面するシリコン膜２の表面（図中の下面）にも、外方に開放されたシリコン膜２の表面（図中の上面）とほぼ同じ膜厚の熱酸化膜１６が形成される。なお、ソース・ドレイン領域２ｂ、２ｃと柱３aとが接する部位にも、当該部位の界面に沿って酸素が拡散するため、シリコン膜２の表面全体に亘って、ほぼ均一な熱酸化膜１６が形成される。また、この熱酸化工程において、ソース・ドレイン領域２ｂ、２ｃにイオン注入された不純物の活性化も、同時に行うことができる。
　次に、図２２（ｂ）に示すように、シリコン膜２とフレキシブル基板１０との間に水（不図示）を介在させて、シリコン膜２をフレキシブル基板１０に密着させる。
　次に、図２２（ｃ）に示すように、シリコン基板１及び／又はフレキシブル基板１０を加熱する。これにより、シリコン膜２とフレキシブル基板１０との間に介在した水が乾燥することによって、シリコン膜２は、シリコン基板１から引き離され、フレキシブル基板１０に転写される。
　次に、図２２（ｄ）に示すように、転写されたシリコン膜２上に、ゲート絶縁膜１１を形成する。このとき、チャネル領域２ａにおけるシリコン膜２と、ゲート絶縁膜１１との間には、熱酸化膜１６が介在しているため、チャネル領域２ａにおけるシリコン膜２と、ゲート絶縁膜１１との界面状態を良好なものにすることができる。
　最後に、図１９（ｃ）～（ｄ）に示した工程に従い、ゲート電極１２、及びソース・ドレイン電極１４、１５を形成して、薄膜トランジスタを完成させる。
　なお、上記工程において、熱酸化膜１６上に、さらにゲート絶縁膜１１を形成したが、熱酸化膜１６が、薄膜トランジスタの所定の特性を得るのに十分な膜厚を有している場合には、ゲート絶縁膜１１を形成せずに、熱酸化膜１６を、そのままゲート絶縁膜として使用してもよい。
　また、シリコン膜２の熱酸化速度は、シリコン膜２中の不純物濃度に依存するため、熱酸化の条件は、不純物濃度（特に、ソース・ドレイン領域２ｂ、２ｃにおける不純物濃度）を考慮して、設定すればよい。あるいは、所定の膜厚の熱酸化膜１６を得るために、不純物濃度を適宜調整してもよい。
　図２３（ａ）、（ｂ）は、このような方法で製造した薄膜トランジスタの特性を評価した結果を示したグラフである。ここで、図２３（ａ）は、ゲート・ソース間電圧（ＶＧＳ）に対するドレイン電流（ＩＤＳ）の変化（ＩＤＳ－ＶＧＳ特性）、及び電界効果移動度の変化を示したグラフである。また、図２３（ｂ）は、ドレイン－ソース間電圧（ＶＤＳ）に対するドレイン電流（ＩＤＳ）の変化(ＩＤＳ－ＶＤＳ特性)を示したグラフである。なお、製造した薄膜トランジスタは、ｎチャネル型の電界効果トランジスタで、チャネル長を４μｍ（実効チャネル長が３．７μｍ）、チャネル幅を３μｍとした。また、熱酸化膜１６の膜厚は、１０ｎｍとし、ゲート絶縁膜１１の膜厚は、２０６ｎｍとした。また、転写先の基板１０は、ガラス基板とした。
　図２３（ａ）に示すように、電界効果移動度の最大値は７４２ｃｍ２Ｖ－１ｓ－１で、しきい値は１．５Ｖであった。また、サブスレッショルド・リーク電流は、約１×１０－１３Ａで、ドレイン電流（ＩＤＳ）のオン／オフ比は、約８桁であった。これらの数値は、バルクの単結晶シリコン基板に形成したｎチャネル型の電界効果トランジスタの特性に近く、薄膜トランジスタとして、高い性能を示すものである。
　また、図２３（ｂ）に示すように、ＩＤＳ－ＶＤＳ特性においても、寄生抵抗及びキンクは確認されず、飽和特性のよい特性を示している。
　このような薄膜トランジスタとしての高い性能は、ガラス基板１０に転写されたシリコン膜２が、単結晶であることを示すととともに、チャネル領域２ａにおけるシリコン膜２と、ゲート絶縁膜１１との界面状態が良好であることを示すものである。
　すなわち、図１８及び図１９に示した薄膜トランジスタの製造方法において、シリコン膜２をガラス基板１０に転写する前に、シリコン膜２の表面を熱酸化して、シリコン膜２の表面に熱酸化膜１６を形成しておくことによって、高い性能の薄膜トランジスタを得ることができる。
　ところで、図２２（ｃ）に示したように、シリコン膜２をガラス基板１０に転写した後、シリコン膜２とガラス基板１０との密着性を高めるために、シリコン膜２が転写されたガラス基板１０を熱処理する場合がある。このとき、ガラス基板１０に含まれる不純物（例えば、基板表面または基板内部に存在するアルカリ金属等）は、熱処理によって活性化され、シリコン膜２中に拡散するおそれがある。特に、チャネル領域２ａ中に不純物が拡散されると、この不純物が可動イオンやトラップ準位を形成し、リーク電流や移動度、信頼性の低下を招くおそれがある。
　しかしながら、図２２（ｃ）に示すように、ガラス基板１０とシリコン膜２との間に、熱酸化膜１６が介在しているため、この熱酸化膜１６が、ガラス基板１０から不純物がシリコン膜２中に拡散するのを防止する障壁となる。従って、転写先のガラス基板１０に汚染源となる不純物が存在していても、当該不純物の拡散に起因する薄膜トランジスタの特性劣化を防止することができる。
　図２４は、転写先の基板１０を、ガラス基板の代わりに、ＰＥＴ基板（フレキシブル基板）を用いて、上記と同様の条件で薄膜トランジスタを製造し、ＩＤＳ－ＶＧＳ特性を評価した結果を示したグラフである。
　図２４に示すように、電界効果移動度の最大値は３４３ｃｍ２Ｖ－１ｓ－１で、しきい値は３．９Ｖであった。また、サブスレッショルド・リーク電流は、約６×１０－１０Ａで、ドレイン電流（ＩＤＳ）のオン／オフ比は、約４桁であった。これらの数値は、シリコン膜２をガラス基板に転写して製造した薄膜トランジスタの特性には至らないものの、多結晶シリコン膜からなる薄膜トランジスタに比して、非常に高い性能を示すものである。なお、転写先の基板１０をガラス基板にした場合と較べて、薄膜トランジスタの性能が低下した理由は、転写されたシリコン膜２上に堆積されたゲート絶縁膜１１が、ガラス基板よりも低い温度で堆積させており、ガラス基板上に堆積させたゲート絶縁膜と比較して膜質が劣るためと考えられる。
　図２５は、転写先の基板１０を、ガラス基板の代わりに、ＰＥＴ基板（フレキシブル基板）を用いて薄膜トランジスタを製造し、ＩＤＳ－ＶＧＳ特性を評価した結果を示したグラフである。なお、この薄膜トランジスタは、熱酸化膜１６上に、さらにゲート絶縁膜１１を形成せずに、膜厚１０ｎｍの熱酸化膜１６を、そのままゲート絶縁膜として使用したもので、それ以外は、図２４に示した薄膜トランジスタと同じ条件で製造した。
　図２５に示すように、電界効果移動度の最大値は６２７ｃｍ２Ｖ－１ｓ－１で、しきい値は０．０７Ｖであった。また、サブスレッショルド・リーク電流は、１．３×１０－１２Ａで、ドレイン電流（ＩＤＳ）のオン／オフ比は、約７桁であった。このように、ゲート絶縁膜を、熱酸化膜１６上だけで形成した薄膜トランジスタは、熱酸化膜１６の上にゲート絶縁膜１１を形成した薄膜トランジスタよりも、特性が大幅に向上しているのが分かる。これは、熱酸化膜１６上のゲート絶縁膜１１は、低温プロセス（例えば、プラズマＣＶＤを用いた堆積、またはポリシラザン溶液を用いた塗布）によって形成されるため、酸化膜の膜質が熱酸化膜より劣っており、リーク電流が大きくなるが、ゲート絶縁膜が熱酸化膜１１のみの場合には、リーク電流が抑制されたためと考えられる。
　ところで、本発明において、転写前のシリコン膜２は、複数の柱３ａに支えられた中空構造になっている。特に、図２２（ａ）に示したように、チャネル領域２ａは、完全に浮いた中空状態になっている。このような中空構造のシリコン膜２の表面に、熱酸化膜１６を形成した場合、熱酸化によりシリコン膜２の表面が熱酸化膜１６に変わる際、体積膨張が起きる。そのため、形成された熱酸化膜１６は、シリコン膜２に応力が加わることによって、中空構造のシリコン膜２に反りが生じるおそれがある。
　図２６（ａ）、（ｂ）は、中空構造のシリコン膜２の表面に、１０ｎｍの厚みの熱酸化膜１６を形成したときの、チャネル領域２ａ近傍の状態を示したＳＥＭ写真である。図２６（ａ）は、チャネル長（Ｌ）が５μｍで、図２６（ｂ）は、チャネル長（Ｌ）が１５μｍの場合のＳＥＭ写真である。
　図２６（ａ）に示すように、チャネル長（Ｌ）が５μｍと短い場合には、チャネル領域２ａの反りは見られないが、チャネル長（Ｌ）が１５μｍと長い場合には、チャネル領域２ａの反りが見られた。
　図２７（ａ）、（ｂ）は、図２６（ａ）、（ｂ）に示した中空構造のシリコン膜２を、ガラス基板１０に転写した後のシリコン膜２の状態を示した光学顕微鏡写真である。図２７（ａ）に示すように、チャネル長（Ｌ）が５μｍと短い場合には、チャネル領域２ａは、完全にガラス基板１０に接触した状態で転写されているが、図２７（ｂ）に示すように、チャネル長（Ｌ）が１５μｍと長い場合には、チャネル領域２ａに干渉色が観察され、チャネル領域２ａの一部が、ガラス基板１０から浮いた状態でガラス基板１０に転写されている。
　そこで、中空構造のシリコン膜２の表面に、熱酸化膜１６を形成した場合のシリコン膜２の反りを調べるために、チャネル長の異なる３種類の中空構造のシリコン膜２を作成し、それぞれのシリコン膜２に、膜厚の異なる熱酸化膜１６を形成して、チャネル領域２ａにおけるシリコン膜２の反りを測定した。なお、シリコン膜２の反りは、７０°の角度から撮影したシリコン膜２のＳＥＭ写真から、チャネル領域２ａの中央部の元の位置からの変位量を算出した。ここで、元の位置は、シリコン基板１とシリコン膜２との間の中空部５の高さ（３００ｎｍ）を基準にした。
　図２８は、その結果を示したグラフである。図２８に示すように、熱酸化膜１６の膜厚が大きくなるに従い、シリコン膜２の変位は大きくなる。また、熱酸化膜１６の膜厚が同じ場合、チャネル長が長くなるほど、シリコン膜２の変位は大きくなる。
　従って、シリコン膜２を、転写先のガラス基板１０に密着した状態で転写するためには、シリコン膜２の表面に熱酸化膜１６を形成した際に生じるシリコン膜の反りを考慮して、熱酸化膜１６の膜厚を設定することが好ましい。
　なお、シリコン膜２を、転写先のガラス基板１０に密着した状態で転写するための条件は、シリコン膜２の反り以外の要因、例えば、図２２（ｂ）に示した状態において、シリコン膜２と転写先の基板１０との密着度合いや、シリコン膜２とフレキシブル基板１０との間に介在する液体の種類、当該液体を乾燥させる加熱条件等によって変わるため、一義的には決まらない。仮に、シリコン膜２の変位を５０ｎｍ以下に設定するとしたら、チャネル長が５μｍの場合、熱酸化膜１６の膜厚を１２ｎｍ以下に、チャネル長が１０μｍの場合、熱酸化膜１６の膜厚を８ｎｍ以下に設定すればよい。
　なお、上記の説明において、中空構造のシリコン膜２の表面に、熱酸化膜１６を形成する工程を、薄膜トランジスタ（電界効果トランジスタ）の製造工程に適用する例を説明したが、これに限定されず、シリコン膜２を転写先の基板１０に転写する工程において、転写前に、中空構造のシリコン膜２の表面に、熱酸化膜１６を形成する工程を採用することができる。
　上記の説明おいて、転写元の基板として、ＳＯＩ基板を用いたが、これに限定されず、例えば、シリコン基板または石英基板上に絶縁膜を介してポリシリコン膜が形成されたものを用いてもよい。また、転写先の基板として、フレキシブル基板を用いたが、これに限定されず、例えば、石英基板、ガラス基板、金属ホイール基板、集積回路を有するウェハ等を用いることができる。
　また、図２０（ａ）に示したシリコン膜２のパターンを、図２９に示すように、マトリクス状に形成することによって、転写先のフルキシブル基板、またはガラス基板上に、マトリクス状に配列された薄膜トランジスタを形成することができる。なお、図２９では、ソース・ドレイン領域に形成する開口部４を省略している。これにより、薄膜トランジスタが形成されていない領域に、薄膜トランジスタを駆動する配線や、液晶セル等を形成することによって、高性能な液晶表示装置を製造することができる。
　また、図３０（ａ）の光学顕微鏡写真に示すように、図２０（ａ）に示したシリコン膜２のパターンの周囲にある領域Ａのシリコン膜を除去することによって、領域Ａ内に形成されたシリコン膜２のパターンだけを、転写先の基板に転写することができる。図３０（ｂ）は、ガラス基板１０に転写されたシリコン膜２のパターンを示した光学顕微鏡写真である。図３０（ｂ）に示すように、領域Ａ内に形成されたシリコン膜２のパターンだけが、ガラス基板１０に転写されているのが分かる。
　このように、ＳＯＩ基板上に形成されたシリコン膜２の一部を、部分的に、ガラス基板１０に転写することができるのは、次のような理由によるものと考えられる。すなわち、領域Ａ以外のシリコン膜２は、絶縁層３と大面積に亘って接触しているため、領域Ａ以外のシリコン膜２に作用する毛管接着力よりも、領域Ａ以外のシリコン膜２と絶縁層３との結合力の方が大きい。そのため、シリコン膜２と柱３ａとの結合力よりも大きな毛管接着力が作用する領域Ａ内のシリコン膜２のみが、ガラス基板１０に転写されたものと考えられる。
　図３１（ａ）は、１回目の転写で残ったシリコン膜２に対して、領域Ｂ内に形成したシリコン膜２のパターンを示した光学顕微鏡写真で、図３１（ｂ）は、ガラス基板１０に転写されたシリコン膜２のパターンを示した光学顕微鏡写真である。このように、１回目の転写で残った部分を用いて、再度転写することができ、ＳＯＩ基板に形成されたシリコン膜２を有効に利用することができる。
　図３２及び図３３は、表面にアモルファスシリコン膜２が形成された石英基板１を用いて、アモルファスシリコン薄膜トランジスタを製造する方法を示した工程図である。
　まず、図３２（ａ）に示すように、石英基板１の表面に、ｎ型不純物がドープされたアモルファスシリコン膜２を堆積する。なお、表面にｎ型不純物がドープされたアモルファスシリコン膜２が堆積された石英基板１を、別途用意してもよい。
　次に、図３２（ｂ）に示すように、アモルファスシリコン膜２をエッチングして、ソース・ドレイン領域を形成する。
　次に、図３２（ｃ）に示すように、石英基板１上に、ノンドープのアモルファスシリコン膜６を堆積して、チャネル領域をパターニングする。
　次に、図３２（ｄ）に示すように、アモルファスシリコン膜２、６に開口部（不図示）を形成した後、開口部を通じて、石英基板１をフッ酸で等方性エッチングして、石英基板１とアモルファスシリコン膜２、６との間に中空部５を形成する。このとき、アモルファスシリコン膜２、６は、石英基板１のエッチングにより残された柱１ａによって支えられた中空構造となる。
　次に、図３２（ｅ）に示すように、アモルファスシリコン膜６とフレキシブル基板１０との間に水（不図示）を介在させて、アモルファスシリコン膜６をフレキシブル基板１０に密着させる。
　次に、図３３（ａ）に示すように、石英基板１及び／又はフレキシブル基板１０を加熱する。これにより、アモルファスシリコン膜６とフレキシブル基板１０との間に介在した水が乾燥することによって、アモルファスシリコン膜２、６は、石英基板１から引き離され、フレキシブル基板１０に転写される。
　次に、図３３（ｂ）に示すように、転写されたアモルファスシリコン膜２、６上に、ゲート絶縁膜１１を堆積する。ゲート絶縁膜１１の堆積は、例えば、ポリシラザン溶液を用いた塗布による形成、あるいは窒化膜を堆積することにより形成することができる。
　次に、図３３（ｃ）に示すように、ゲート絶縁膜１１上に、ゲート電極１２を形成する。ゲート電極の形成は、例えば、アルミニウムのスパッタリング、蒸着、あるいは金属ナノ粒子を用いたインクジェット方式により形成することができる。
　最後に、図３３（ｄ）に示すように、ゲート電極１２上に、保護膜１３を形成した後、保護膜１３及びゲート絶縁膜１１に開口部を形成し、この開口部にソース・ドレイン電極１４、１５を形成する。これにより、アモルファスシリコン膜からなる薄膜トタンジスタが製造される。
　（２）太陽電池の製造
　図３４及び図３５は、本発明における薄膜の転写技術を用いた太陽電池の製造方法を示した工程図である。
　まず、図３４（ａ）に示すように、シリコン基板１上に、シリコン酸化膜３を介してｐ型不純物がドープされた単結晶シリコン膜（以下、単に、「シリコン膜」という）２Ａが形成されたＳＯＩ基板を用意する。
　次に、図３４（ｂ）に示すように、ｐ型シリコン膜２に開口部４Ａを形成した後、開口部４Ａを通じて、シリコン酸化膜３をフッ酸で等方性エッチングして、シリコン基板１とｐ型シリコン膜２との間に中空部５を形成する。このとき、ｐ型シリコン膜２は、シリコン酸化膜３のエッチングにより残された柱（不図示）によって支えられた中空構造となる。
　次に、図３４（ｃ）に示すように、表面に透明電極１８が形成されたフレキシブル基板１０を用意し、ｐ型シリコン膜２と透明電極１８との間に水（不図示）を介在させて、シリコン膜２をフレキシブル基板１０に密着させる。
　次に、図３４（ｄ）に示すように、シリコン基板１及び／又はフレキシブル基板１０を加熱する。これにより、ｐ型シリコン膜２と透明電極１８との間に介在した水が乾燥することによって、ｐ型シリコン膜２は、シリコン基板１から引き離され、フレキシブル基板１０に転写される。
　次に、図３５（ａ）に示すように、シリコン基板１上に、シリコン酸化膜３を介してｎ型不純物がドープされたシリコン膜２Ｂが形成されたＳＯＩ基板を用意する。
　次に、図３５（ｂ）に示すように、ｎ型シリコン膜２Ｂに開口部４Ｂを形成した後、開口部４Ｂを通じて、シリコン酸化膜３をフッ酸で等方性エッチングして、シリコン基板１とｎ型シリコン膜２Ｂとの間に中空部５を形成する。このとき、ｎ型シリコン膜２Ｂは、シリコン酸化膜３のエッチングにより残された柱（不図示）によって支えられた中空構造となる。
　次に、図３５（ｃ）に示すように、ｎ型シリコン膜２Ｂと、フレキシブル基板１０に転写されたｐ型シリコン膜２Ａとの間に水（不図示）を介在させて、ｎ型シリコン膜２Ｂをフレキシブル基板１０に密着させる。このとき、ｐ型シリコン膜２Ａに形成されて開口部４Ａと、ｎ型シリコン膜２Ｂに形成されて開口部４Ｂとは、互いに位置をずらして密着させる。
　次に、図３５（ｄ）に示すように、シリコン基板１及び／又はフレキシブル基板１０を加熱する。これにより、ｎ型シリコン膜２Ｂとｐ型シリコン膜２Ａとの間に介在した水が乾燥することによって、ｎ型シリコン膜２Ｂは、シリコン基板１から引き離され、フレキシブル基板１０に転写される。
　次に、図３５（ｅ）に示すように、転写されたｎ型シリコン膜２Ｂ上に、電極１７を堆積する。電極１７は、例えば、アルミニウムの蒸着により形成することができる。これにより、フレキシブル基板１０上に、積層されたシリコン膜２Ａ、２ＢからなるＰＮ接合を有する太陽電池が製造される。
　なお、上記の説明おいて、転写元の基板として、ＳＯＩ基板を用いたが、これに限定されず、例えば、シリコン基板または石英基板上に絶縁膜を介してポリシリコン膜が形成されたものを用いてもよい。また、転写先の基板として、フレキシブル基板を用いたが、これに限定されず、例えば、ガラス基板等を用いることができる。また、シリコン膜２Ａ、２Ｂをフレキシブル基板１０に転写した後、シリコン膜２Ａ、２Ｂとフレキシブル基板１０との密着性をさらに高めるために、フレキシブル基板１０を熱処置する工程をさらに追加してもよい。
　図３６～図３８は、本発明における薄膜の転写技術を用いた太陽電池の他の製造方法を示した工程図である。
　まず、図３６（ａ）に示すように、シリコン基板１上に、シリコン酸化膜３を介してｐ型不純物がドープされたシリコン膜２が形成されたＳＯＩ基板を用意する。そして、シリコン膜２に開口部４を形成する。
　次に、図３６（ｂ）に示すように、開口部４を通じて、シリコン酸化膜３をフッ酸で等方性エッチングして、シリコン基板１とシリコン膜２との間に中空部５を形成する。このとき、シリコン膜２は、シリコン酸化膜３のエッチングにより残された柱３ａによって支えられた中空構造となる。
　次に、図３６（ｃ）に示すように、ｐ型シリコン膜の表面、及び中空部５に面した裏面をテクスチャー加工する。テクスチャー加工は、例えばＴＭＡＨ（水酸化トリメチルアニリニウム）溶液による異方性エッチングによって行うことができる。この方法を用いれば、中空部５に面した裏面にもテクスチャー加工することができる。
　次に、図３６（ｄ）に示すように、ｐ型シリコン膜２の表面に、ｎ＋層を形成する。ｎ＋層は、例えば、リン酸水溶液を塗布した後に加熱することにより形成することができる。この方法を用いれば、開口部４及び中空部５にもリン酸水溶液が導入されるため、ｐ型シリコン膜２の開口部４の側面、及び中空部５に面した裏面にも、ｎ＋層を形成することができる。
　次に、図３６（ｅ）に示すように、ｎ＋層の表面に、シリコン窒化膜７を形成する。シリコン窒化膜７の形成は、例えば、プラズマＣＶＤ法を用いて形成することができる。
　次に、図３７（ａ）に示すように、シリコン窒化膜７とガラス基板１０との間に水（不図示）を介在させて、シリコン窒化膜７をガラス基板１０に密着させる。
　次に、図３７（ｂ）に示すように、シリコン基板１及び／又はガラス基板１０を加熱する。これにより、シリコン窒化膜７とガラス基板１０との間に介在した水が乾燥することによって、シリコン膜２及びシリコン窒化膜７は、シリコン基板１から引き離され、ガラス基板１０に転写される。
　次に、図３７（ｃ）に示すように、開口部４にＡｇ電極２１を埋め込む。Ａｇ電極２１の埋め込みは、Ａｇペーストのスクリーン印刷によって行うことができる。
　次に、図３７（ｄ）に示すように、ｎ＋層の表面に、Ａｌ電極２２を形成する。Ａｌ電極２２は、アルミニウム粉末を含むペースト材料を、スクリーン印刷などを用いて塗布により形成することができる。
　次に、図３８（ａ）に示すように、アルミニウムペーストを焼成して、アルミニウムをｎ＋層に拡散することによって、Ａｌ電極２２とｐ型シリコン膜２との間にＢＳＦ（ＢａｃｋＳｕｒｆａｃｅ Ｆｉｅｌｄ）層２３を形成する。
　次に、図３８（ｂ）に示すように、表面に電極３１が形成されたフレキシブル基板３０を用意して、図３８（ｃ）に示すように、接着剤を用いて、ガラス基板１０に形成されたＰＮ接合を含む構造体を、フレキシブル基板３０に転写する。このとき、Ａｇ電極２１及びＡｌ電極２２は、それぞれ、電極３１に接合される。
　最後に、図３８（ｄ）に示すように、開口部４を埋めるようにして、Ａｇ電極３２をシリコン窒化膜７上に形成する。これにより、フレキシブル基板３０に形成された太陽電池が製造される。
　以上、本発明における薄膜の転写技術を用いた電子デバイスの製造方法について説明したが、電子デバイスは、上記応用例で説明した薄膜トランジスタや太陽電池に限定されず、薄膜を構成要素として含む種々の電子デバイスに適用できる。
　１　　　第１の基板 
　１ａ　　柱 
　２　　　薄膜
　２ａ　　チャネル領域 
　２ｂ、２ｃ　　ソース・ドレイン領域 
　２ｄ　　繋ぎ部 
　３　　　犠牲層 
　３ａ　　柱 
　４　　　開口部 
　５　　　中空部 
　７　　　シリコン窒化膜 
　１０　　第２の基板 
　１１　　ゲート絶縁膜 
　１２　　ゲート電極 
　１３　　層間絶縁膜
　１４、１５　　ソース・ドレイン電極 
　１６　　熱酸化膜
　１８　　透明電極
　２０ａ、２０ｂ　　液体
　２１　　Ａｇ電極 
　２２　　Ａｌ電極 
　３０　　フレキシブル基板 
　３１　　電極
　３２　　Ａｇ電極 

Claims (25)

  1. 　表面に薄膜が形成された第１の基板を用意する工程と、
    　前記薄膜に複数の開口部を形成する工程と、
    　前記開口部を通じて前記第１の基板をエッチングして、前記第１の基板と前記薄膜との間に中空部を形成する工程と、
    　前記薄膜と第２の基板との間に液体を介在させて、前記薄膜を前記第２の基板に密着させる工程と、
    　前記第１の基板及び／又は前記第２の基板を加熱する工程と
    を含み、
    　前記加熱工程において、前記薄膜と第２の基板との間に介在する液体が乾燥することによって、前記薄膜は、前記第１の基板から引き離されて、前記第２の基板に転写される、薄膜形成方法。
  2. 　前記薄膜は、犠牲層を挟んで前記第１の基板上に形成されており、
    　前記中空部を形成する工程は、前記第１の基板の代わりに、前記犠牲層をエッチングすることにより行われ、
    　前記加熱工程において、前記薄膜は、前記犠牲層から引き離されて、前記第２の基板に転写される、請求項１に記載の薄膜形成方法。
  3. 　前記第１の基板は、ＳＯＩ基板からなり、
    　前記薄膜は、単結晶半導体薄膜からなる、請求項２に記載の薄膜形成方法。
  4. 　前記加熱工程において、前記第１の基板及び／又は前記第２の基板は、該基板の端部から液体が一定方向に沿って蒸発するように加熱される、請求項１または２に記載の薄膜形成方法。
  5. 　前記加熱工程は、前記液体の沸点より低い温度で行われる、請求項１または２に記載の薄膜形成方法。
  6. 　前記液体は、水、エタノール、アセトン、又はポリシラザンからなる、請求項１または２に記載の薄膜形成方法。
  7. 　前記第２の基板は、表面に親水性を持たせる表面処理がなされている、請求項１または２に記載の薄膜形成方法。
  8. 　前記加熱工程の後、前記薄膜が転写された前記第２の基板を熱処理する工程をさらに含む、請求項１または２に記載の薄膜形成方法。
  9. 　前記第２の基板は、フレキシブル基板であって、
    　前記熱処理工程は、前記フレキシブル基板のガラス転移温度以上で行われる、請求項８に記載の薄膜形成方法。
  10. 　前記薄膜は、シリコン膜であって、
    　前記中空部を形成する工程の後、前記薄膜を前記第２の基板に密着させる工程の前に、前記薄膜の表面に熱酸化膜を形成する工程をさらに含む、請求項１または２に記載の薄膜形成方法。
  11. 　前記開口部を形成する工程において、前記複数の開口部は、アレイ状又は千鳥状に形成されている、請求項１または２に記載の薄膜形成方法。
  12. 　前記第２の基板は、フレキシブル基板、石英基板、またはガラス基板からなる、請求項１または２に記載の薄膜形成方法。
  13. 　請求項１～１２の何れかに記載の方法により、表面に転写された半導体薄膜を備えた半導体基板。
  14. 　請求項１～１２の何れかに記載の方法により、基板表面に転写された半導体薄膜を有する電子デバイス。
  15. 　表面に絶縁層を挟んで半導体薄膜が形成された第１の基板を用意する工程と、
    　前記半導体薄膜を、チャネル領域、及びソース・ドレイン領域となる領域にパターニングする工程と、
    　前記ソース・ドレイン領域となる半導体薄膜に複数の開口部を形成する工程と、
    　前記開口部を通じて前記絶縁層をエッチングして、前記第１の基板と前記半導体薄膜との間に中空部を形成する工程と、
    　前記半導体薄膜と第２の基板との間に液体を介在させて、前記半導体薄膜を前記第２の基板に密着させる工程と、
    　前記第１の基板及び／又は前記第２の基板を加熱する工程と
    を含み、
    　前記加熱工程において、前記半導体薄膜と第２の基板との間に介在する液体が乾燥することによって、前記半導体薄膜のパターンが、前記絶縁層から引き離されて、前記第２の基板に転写される、薄膜トランジスタの製造方法。
  16. 　前記パターニング工程の後、前記ソース・ドレイン領域となる領域に不純物を注入した後、熱処理を行って、ソース・ドレイン領域を形成する工程をさらに含み、
    　前記加熱工程の後、前記第２の基板に転写された前記半導体薄膜のチャネル領域上にゲート絶縁膜を形成する工程をさらに含む、請求項１５に記載の薄膜トランジスタの製造方法。
  17. 　前記半導体薄膜は、シリコン膜であって、
    　前記中空部を形成する工程の後、前記半導体薄膜を前記第２の基板に密着させる工程の前に、前記半導体薄膜の表面に熱酸化膜を形成する工程をさらに含む、請求項１５に記載の薄膜トランジスタの製造方法。
  18. 　前記熱酸化膜は、ゲート絶縁膜として使用される、請求項１７に記載の薄膜トランジスタの製造方法。
  19. 　前記第２の基板は、フレキシブル基板、石英基板、またはガラス基板からなる、請求項１５に記載の薄膜トランジスタの製造方法。
  20. 　前記半導体薄膜のパターニング工程において、前記チャネル領域、及びソース・ドレイン領域となる領域が、マトリクス状にパターニングされる、請求項１５に記載の薄膜トランジスタの製造方法。
  21. 　請求項２０に記載された製造方法により製造された薄膜トランジスタがマトリクス状に配置された表示装置。
  22. 　表面に透明電極が形成された第２の基板を用意する工程と、
    　請求項１～３の何れかに記載の製造方法により、前記第１の基板から前記第２の基板に、第１導電型の半導体薄膜及び第２導電型の半導体薄膜を、順次転写する工程と
    を含み、
    　前記転写工程において、前記透明電極上に、半導体薄膜からなるＰＮ接合が形成させる、太陽電池の製造方法。
  23. 　前記転写工程において、前記第１導電型の半導体薄膜に形成されて第１の開口部と、前記第２導電型の半導体薄膜に形成されて第２の開口部とは、互いに位置をずらして転写される、請求項２２に記載の太陽電池の製造方法。
  24. 　前記転写工程の後、前記第２の基板を熱処置する工程をさらに含む、請求項２２に記載の太陽電池の製造方法。
  25. 　前記第２の基板は、フレキシブル基板、石英基板、またはガラス基板からなる、請求項２２に記載の太陽電池の製造方法。
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN105428312A (zh) * 2015-11-18 2016-03-23 上海大学 柔性衬底的制备和分离方法

Families Citing this family (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN104934330A (zh) * 2015-05-08 2015-09-23 京东方科技集团股份有限公司 一种薄膜晶体管及其制备方法、阵列基板和显示面板
DE102017123290A1 (de) 2017-10-06 2019-04-11 Osram Opto Semiconductors Gmbh Lichtemittierendes Bauteil, Anzeigevorrichtung und Verfahren zur Herstellung einer Anzeigevorrichtung
DE102017126338A1 (de) * 2017-11-10 2019-05-16 Osram Opto Semiconductors Gmbh Bauteilverbund, Bauteil und Verfahren zur Herstellung von Bauteilen
JP7199307B2 (ja) * 2019-05-24 2023-01-05 株式会社ディスコ 移設方法
US10797009B1 (en) * 2019-07-09 2020-10-06 Mikro Mesa Technology Co., Ltd. Method for transferring micro device
CN111261023B (zh) * 2019-12-07 2021-09-17 深圳优色专显科技有限公司 一种自热前导式显示屏的双态防水结构
CN112599468B (zh) * 2020-12-31 2022-10-14 福建江夏学院 一种基于溶剂处理制备二硫化钼薄层及其薄膜晶体管的方法
KR102622207B1 (ko) 2021-11-17 2024-01-05 울산대학교 산학협력단 페로브스카이트 구조의 독립형 단결정 멤브레인의 제조방법 및 페로브스카이트 구조의 독립형 단결정 멤브레인의 전사방법
WO2024087905A1 (zh) * 2022-10-25 2024-05-02 隆基绿能科技股份有限公司 激光转印方法和设备、太阳能电池

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5710057A (en) * 1996-07-12 1998-01-20 Kenney; Donald M. SOI fabrication method
JP2000188269A (ja) * 1998-10-16 2000-07-04 Canon Inc 部材の分離方法及び分離装置並びに基板の製造方法
WO2007083570A1 (ja) * 2006-01-16 2007-07-26 Matsushita Electric Industrial Co., Ltd. 半導体小片の製造方法ならびに電界効果トランジスタおよびその製造方法
JP2008525998A (ja) * 2004-12-16 2008-07-17 ウイスコンシン アラムニ リサーチ ファンデーション ひずみヘテロ接合構造体の製造
JP2009508322A (ja) * 2005-06-02 2009-02-26 ザ ボード オブ トラスティーズ オブ ザ ユニヴァーシティー オブ イリノイ 印刷可能な半導体構造、並びに関連する製造方法及び組立方法

Family Cites Families (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2000091604A (ja) 1998-09-10 2000-03-31 Showa Denko Kk 多結晶半導体膜、光電変換素子及びこれらの製造法
EP0989593A3 (en) 1998-09-25 2002-01-02 Canon Kabushiki Kaisha Substrate separating apparatus and method, and substrate manufacturing method
JP4082242B2 (ja) * 2003-03-06 2008-04-30 ソニー株式会社 素子転写方法
US7799699B2 (en) 2004-06-04 2010-09-21 The Board Of Trustees Of The University Of Illinois Printable semiconductor structures and related methods of making and assembling
US8951888B2 (en) 2010-06-14 2015-02-10 Sharp Kabushiki Kaisha Method for fabricating semiconductor device, and method for fabricating display device

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5710057A (en) * 1996-07-12 1998-01-20 Kenney; Donald M. SOI fabrication method
JP2000188269A (ja) * 1998-10-16 2000-07-04 Canon Inc 部材の分離方法及び分離装置並びに基板の製造方法
JP2008525998A (ja) * 2004-12-16 2008-07-17 ウイスコンシン アラムニ リサーチ ファンデーション ひずみヘテロ接合構造体の製造
JP2009508322A (ja) * 2005-06-02 2009-02-26 ザ ボード オブ トラスティーズ オブ ザ ユニヴァーシティー オブ イリノイ 印刷可能な半導体構造、並びに関連する製造方法及び組立方法
WO2007083570A1 (ja) * 2006-01-16 2007-07-26 Matsushita Electric Industrial Co., Ltd. 半導体小片の製造方法ならびに電界効果トランジスタおよびその製造方法

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN105428312A (zh) * 2015-11-18 2016-03-23 上海大学 柔性衬底的制备和分离方法
CN105428312B (zh) * 2015-11-18 2018-05-01 上海大学 柔性衬底的制备和分离方法

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