WO2002056184A1 - Cache-speicher und verfahren zur adressierung - Google Patents
Cache-speicher und verfahren zur adressierung Download PDFInfo
- Publication number
- WO2002056184A1 WO2002056184A1 PCT/DE2001/004821 DE0104821W WO02056184A1 WO 2002056184 A1 WO2002056184 A1 WO 2002056184A1 DE 0104821 W DE0104821 W DE 0104821W WO 02056184 A1 WO02056184 A1 WO 02056184A1
- Authority
- WO
- WIPO (PCT)
- Prior art keywords
- address
- cache memory
- index
- encrypted
- cache
- Prior art date
Links
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/02—Addressing or allocation; Relocation
- G06F12/08—Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
- G06F12/0802—Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
- G06F12/0864—Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches using pseudo-associative means, e.g. set-associative or hashing
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/14—Protection against unauthorised use of memory or access to memory
- G06F12/1408—Protection against unauthorised use of memory or access to memory by using cryptography
Definitions
- the present invention relates to a cache memory that is used on a security controller.
- Cache memories are generally relatively small but fast buffers that are used to reduce the latency when a processor accesses slow external memories.
- the cache memory covers selected address areas of the external memory and contains the temporarily modified data and related information, such as. B. Information on the location of the data.
- An overview of cache memories is provided by Alan Jay Smith's article "Cache Memories” in Computing Surveys, Vol. 14, No. 3, September 1982, pages 473-530.
- the cache memories implemented in hardware can generally be characterized as an N-way-associative memory field.
- the limit cases N 1 mean a memory with direct
- N M a fully associative cache, where M is the total number of entries in the memory.
- the data is stored in blocks of 2 b bytes per memory entry.
- the p-bit address of the date is usually divided in such a way that n bits form the index, b bits the offset and the remaining p - n - b bits form the tag. This is illustrated in the attached figure.
- the index field is used to address a set directly.
- the tag field is saved together with the respective block in order to clearly identify it within a set.
- the tag field of the address with the tag co ⁇ ISJ DO H 1 H 1 cn o JI o ⁇ O L ⁇
- TJ c- d PJ 3 0 H- d H- PJ ⁇ H- H- ⁇ ⁇ ⁇ H- ⁇ H- H- 0 PJ ⁇ ⁇ ro H lh ü 0 0 0 ⁇ rt ü rt ⁇ CQ tr 0 ⁇ 0 LQ h- 1 0 CQ 0 h- 1
- P- tr CQ ⁇ d ra P- d ⁇ P- ⁇ Ti i 0 LQ CQ ti ii ii ⁇ ⁇ P- ⁇ ⁇ 3 rt ⁇ P. ⁇ P- rt rt rt 3 Pi .—. d 0 ⁇ H ⁇ ) LQ ⁇ tr Hi CQ H 0 o tr 0 Pi
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Computer Security & Cryptography (AREA)
- Memory System Of A Hierarchy Structure (AREA)
- Storage Device Security (AREA)
Abstract
Description
Claims
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
EP01984723A EP1352328A1 (de) | 2001-01-15 | 2001-12-20 | Cache-speicher und verfahren zur adressierung |
JP2002556374A JP2004530962A (ja) | 2001-01-15 | 2001-12-20 | キャッシュメモリおよびアドレス指定方法 |
US10/619,979 US20040015644A1 (en) | 2001-01-15 | 2003-07-15 | Cache memory and method for addressing |
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE10101552A DE10101552A1 (de) | 2001-01-15 | 2001-01-15 | Cache-Speicher und Verfahren zur Adressierung |
DE10101552.6 | 2001-01-15 |
Related Child Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
US10/619,979 Continuation US20040015644A1 (en) | 2001-01-15 | 2003-07-15 | Cache memory and method for addressing |
Publications (1)
Publication Number | Publication Date |
---|---|
WO2002056184A1 true WO2002056184A1 (de) | 2002-07-18 |
Family
ID=7670595
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
PCT/DE2001/004821 WO2002056184A1 (de) | 2001-01-15 | 2001-12-20 | Cache-speicher und verfahren zur adressierung |
Country Status (6)
Country | Link |
---|---|
US (1) | US20040015644A1 (de) |
EP (1) | EP1352328A1 (de) |
JP (1) | JP2004530962A (de) |
CN (1) | CN1486463A (de) |
DE (1) | DE10101552A1 (de) |
WO (1) | WO2002056184A1 (de) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2003048943A2 (de) * | 2001-11-28 | 2003-06-12 | Infineon Technologies Ag | Speicher für die zentraleinheit einer rechenanlage, rechenanlage und verfahren zum synchronisieren eines speichers mit dem hauptspeicher einer rechenanlage |
WO2008008147A2 (en) * | 2006-07-12 | 2008-01-17 | Hewlett-Packard Development Company, L.P. | Address masking between users |
Families Citing this family (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE10258767A1 (de) * | 2002-12-16 | 2004-07-15 | Infineon Technologies Ag | Verfahren zum Betrieb eines Cache-Speichers |
US20070020639A1 (en) * | 2005-07-20 | 2007-01-25 | Affymetrix, Inc. | Isothermal locus specific amplification |
US7543122B2 (en) * | 2005-08-11 | 2009-06-02 | Research In Motion Limited | System and method for obscuring hand-held device data traffic information |
DE602005002747T2 (de) * | 2005-08-11 | 2008-02-07 | Research In Motion Ltd., Waterloo | Vorrichtung und Verfahren zur Verschleierung der Datenverkehrsinformationen eines Handcomputers |
CN101123471B (zh) * | 2006-08-09 | 2011-03-16 | 中兴通讯股份有限公司 | 可变带宽通信寻址数据处理方法 |
WO2010055171A1 (en) * | 2008-11-17 | 2010-05-20 | Intrinsic-Id B.V. | Distributed puf |
CN104899159B (zh) | 2014-03-06 | 2019-07-23 | 华为技术有限公司 | 高速缓冲存储器Cache地址的映射处理方法和装置 |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5379393A (en) * | 1992-05-14 | 1995-01-03 | The Board Of Governors For Higher Education, State Of Rhode Island And Providence Plantations | Cache memory system for vector processing |
EP0694846A1 (de) * | 1994-07-29 | 1996-01-31 | STMicroelectronics S.A. | Verfahren zur numerischen Verschleierung und Anwendung auf eine programmierbare Schaltung |
EP0745940A1 (de) * | 1995-06-02 | 1996-12-04 | Sun Microsystems, Inc. | Ein Gerät und Verfahren, das ein für Cache-Kollisionen weniger anfälliges Cache-Indizierungsverfahren vorsieht |
DE19957810A1 (de) * | 1999-03-03 | 2000-09-07 | Via Tech Inc | Streuabbildungsverfahren für eine Cache-Speicher-Einrichtung |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5314A (en) * | 1847-10-02 | pease |
-
2001
- 2001-01-15 DE DE10101552A patent/DE10101552A1/de not_active Withdrawn
- 2001-12-20 EP EP01984723A patent/EP1352328A1/de not_active Ceased
- 2001-12-20 JP JP2002556374A patent/JP2004530962A/ja not_active Withdrawn
- 2001-12-20 CN CNA018220215A patent/CN1486463A/zh active Pending
- 2001-12-20 WO PCT/DE2001/004821 patent/WO2002056184A1/de not_active Application Discontinuation
-
2003
- 2003-07-15 US US10/619,979 patent/US20040015644A1/en not_active Abandoned
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5379393A (en) * | 1992-05-14 | 1995-01-03 | The Board Of Governors For Higher Education, State Of Rhode Island And Providence Plantations | Cache memory system for vector processing |
EP0694846A1 (de) * | 1994-07-29 | 1996-01-31 | STMicroelectronics S.A. | Verfahren zur numerischen Verschleierung und Anwendung auf eine programmierbare Schaltung |
EP0745940A1 (de) * | 1995-06-02 | 1996-12-04 | Sun Microsystems, Inc. | Ein Gerät und Verfahren, das ein für Cache-Kollisionen weniger anfälliges Cache-Indizierungsverfahren vorsieht |
DE19957810A1 (de) * | 1999-03-03 | 2000-09-07 | Via Tech Inc | Streuabbildungsverfahren für eine Cache-Speicher-Einrichtung |
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2003048943A2 (de) * | 2001-11-28 | 2003-06-12 | Infineon Technologies Ag | Speicher für die zentraleinheit einer rechenanlage, rechenanlage und verfahren zum synchronisieren eines speichers mit dem hauptspeicher einer rechenanlage |
WO2003048943A3 (de) * | 2001-11-28 | 2004-04-08 | Infineon Technologies Ag | Speicher für die zentraleinheit einer rechenanlage, rechenanlage und verfahren zum synchronisieren eines speichers mit dem hauptspeicher einer rechenanlage |
US7181576B2 (en) | 2001-11-28 | 2007-02-20 | Infineon Technologies Ag | Method for synchronizing a cache memory with a main memory |
WO2008008147A2 (en) * | 2006-07-12 | 2008-01-17 | Hewlett-Packard Development Company, L.P. | Address masking between users |
WO2008008147A3 (en) * | 2006-07-12 | 2008-05-08 | Hewlett Packard Development Co | Address masking between users |
US8819348B2 (en) | 2006-07-12 | 2014-08-26 | Hewlett-Packard Development Company, L.P. | Address masking between users |
Also Published As
Publication number | Publication date |
---|---|
CN1486463A (zh) | 2004-03-31 |
DE10101552A1 (de) | 2002-07-25 |
JP2004530962A (ja) | 2004-10-07 |
US20040015644A1 (en) | 2004-01-22 |
EP1352328A1 (de) | 2003-10-15 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
EP1246043B1 (de) | Verfahren zur Übertragung von Daten über einen Datenbus | |
DE69432314T2 (de) | Cachespeicher mit aufgeteiltem pegel | |
DE3811378C3 (de) | Informationsaufzeichnungssystem | |
DE3902425C2 (de) | ||
DE10345385B4 (de) | Entschlüsselung bzw. Verschlüsselung bei Schreibzugriffen auf einen Speicher | |
WO2002056184A1 (de) | Cache-speicher und verfahren zur adressierung | |
DE69334149T2 (de) | Speicherkarte | |
EP0168121A1 (de) | Verfahren und Vorrichtung zum Speicherzugriff in Mehrprozessorsystemen | |
DE19646624A1 (de) | System und Verfahren zur Identifizierung konformationselastischer Moleküle | |
EP1358558B1 (de) | Mikroprozessorschaltung für datenträger und verfahren zum organisieren des zugriffs auf in einem speicher abgelegten daten | |
EP0224639B1 (de) | Verfahren zum Kontrollieren eines Speicherzugriffs auf einer Chipkarte und Anordnung zur Durchführung des Verfahrens | |
DE102015010906A1 (de) | Verfahren und Einrichtung zum Erzeugen von Inhaltsleere über Mülldaten, wenn Verschlüsselungsparameter geändert werden | |
WO2003060721A2 (de) | Verfahren und anordnung zum beschreiben von nv-memories in einer controller-architektur sowie ein entsprechendes computerprogrammprodukt und ein entsprechendes computerlesbares speichermedium | |
EP0010186A1 (de) | Vorrichtung zum Bearbeiten bezeichneter Hinweise | |
DE102010006148A1 (de) | Verfahren zum Reagieren auf einen Befehl zum Löschen einer Datei und Datenspeichervorrichtung | |
DE10339212A1 (de) | Datenübertragungssystem und Verfahren zum Betreiben eines Datenübertragungssystems | |
EP1449091B1 (de) | Verfahren zum synchronisieren eines speichers mit dem hauptspeicher einer rechenanlage | |
JP3088866B2 (ja) | Icカード | |
EP0609703A2 (de) | Monolithisch integrierte Datenspeicheranordnung und Verfahren zu deren Betrieb | |
DE60016383T2 (de) | Geschützte optische platte und verfahren zur sicherung einer optischen platte | |
DE102004015020A1 (de) | Unterstützte Speichervorrichtung mit integriertem Cache | |
AT389776B (en) | Chip card | |
DE10107833B4 (de) | Speicheranordnung und Verfahren zum Auslesen einer Speicheranordnung | |
JPS6029419B2 (ja) | バツフア・メモリ装置 | |
EP1639466B1 (de) | Verfahren und vorrichtung zur fehlererkennung für einen cachespeicher und entsprechender cachespeicher |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
AK | Designated states |
Kind code of ref document: A1 Designated state(s): BR CA CN IL IN JP KR MX RU UA US |
|
AL | Designated countries for regional patents |
Kind code of ref document: A1 Designated state(s): AT BE CH CY DE DK ES FI FR GB GR IE IT LU MC NL PT SE TR |
|
121 | Ep: the epo has been informed by wipo that ep was designated in this application | ||
DFPE | Request for preliminary examination filed prior to expiration of 19th month from priority date (pct application filed before 20040101) | ||
WWE | Wipo information: entry into national phase |
Ref document number: 802/KOLNP/2003 Country of ref document: IN |
|
WWE | Wipo information: entry into national phase |
Ref document number: 2001984723 Country of ref document: EP Ref document number: 2002556374 Country of ref document: JP |
|
WWE | Wipo information: entry into national phase |
Ref document number: 018220215 Country of ref document: CN Ref document number: 10619979 Country of ref document: US |
|
WWP | Wipo information: published in national office |
Ref document number: 2001984723 Country of ref document: EP |
|
WWR | Wipo information: refused in national office |
Ref document number: 2001984723 Country of ref document: EP |
|
WWW | Wipo information: withdrawn in national office |
Ref document number: 2001984723 Country of ref document: EP |