EP1352328A1 - Cache-speicher und verfahren zur adressierung - Google Patents

Cache-speicher und verfahren zur adressierung

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EP1352328A1
EP1352328A1 EP01984723A EP01984723A EP1352328A1 EP 1352328 A1 EP1352328 A1 EP 1352328A1 EP 01984723 A EP01984723 A EP 01984723A EP 01984723 A EP01984723 A EP 01984723A EP 1352328 A1 EP1352328 A1 EP 1352328A1
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EP
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address
cache memory
index
encrypted
cache
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EP01984723A
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English (en)
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Berndt Gammel
Thomas KÜNEMUND
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Infineon Technologies AG
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Infineon Technologies AG
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Publication date
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    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F12/00Accessing, addressing or allocating within memory systems or architectures
    • G06F12/02Addressing or allocation; Relocation
    • G06F12/08Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
    • G06F12/0802Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
    • G06F12/0864Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches using pseudo-associative means, e.g. set-associative or hashing
    • GPHYSICS
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    • G06F12/00Accessing, addressing or allocating within memory systems or architectures
    • G06F12/14Protection against unauthorised use of memory or access to memory
    • G06F12/1408Protection against unauthorised use of memory or access to memory by using cryptography

Definitions

  • the present invention relates to a cache memory that is used on a security controller.
  • Cache memories are generally relatively small but fast buffers that are used to reduce the latency when a processor accesses slow external memories.
  • the cache memory covers selected address areas of the external memory and contains the temporarily modified data and related information, such as. B. Information on the location of the data.
  • An overview of cache memories is provided by Alan Jay Smith's article "Cache Memories” in Computing Surveys, Vol. 14, No. 3, September 1982, pages 473-530.
  • the cache memories implemented in hardware can generally be characterized as an N-way-associative memory field.
  • the limit cases N 1 mean a memory with direct
  • N M a fully associative cache, where M is the total number of entries in the memory.
  • the data is stored in blocks of 2 b bytes per memory entry.
  • the p-bit address of the date is usually divided in such a way that n bits form the index, b bits the offset and the remaining p - n - b bits form the tag. This is illustrated in the attached figure.
  • the index field is used to address a set directly.
  • the tag field is saved together with the respective block in order to clearly identify it within a set.
  • the tag field of the address with the tag co ⁇ ISJ DO H 1 H 1 cn o JI o ⁇ O L ⁇
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Landscapes

  • Engineering & Computer Science (AREA)
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  • General Engineering & Computer Science (AREA)
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Abstract

Bei dem Cache-Speicher, dessen Adressen in Tag, Index und Offset aufgeteilt sind, sind als Hardware Mittel vorhanden, die eine umkehrbar eindeutige Transformation zwischen dem jeweiligen Tag-Teil der Adresse und einer verschlüsselten Tag-Adresse vornehmen. Es kann zusätzlich das Index-Feld der Adressen des Cache-Speichers durch eine weitere umkehrbar eindeutige Abbildung, die das Index-Feld auf ein verschlüsseltes Index-Feld abbildet, verschlüsselt werden. Auch dazu wird eine entsprechend vorzusehende Hardware-Einheit verwendet.

Description

Beschreibung
Cache-Speicher und Verfahren zur Adressierung
Die vorliegende Erfindung betrifft einen Cache-Speicher, der auf einem Security-Controller verwendet wird.
Cache-Speicher sind im allgemeinen relativ kleine, aber schnelle Pufferspeicher, die eingesetzt werden, um die La- tenzzeit beim Zugriff eines Prozessors auf langsame externe Speicher zu reduzieren. Der Cache-Speicher überdeckt dabei ausgewählte Adressbereiche des externen Speichers und enthält die temporär modifizierten Daten sowie damit verbundene Informationen, wie z. B. Informationen zur Lokalisierung der Daten. Eine Übersicht über Cache-Speicher gibt der Artikel von Alan Jay Smith "Cache Memories" in Computing Surveys, Vol. 14, No. 3, September 1982, Seite 473 - 530. Die in Hardware realisierten Cache-Speicher können allgemein als ein N- way-set-assoziatives Speicherfeld charakterisiert werden. Da- bei bedeuten die Grenzfälle N = 1 einen Speicher mit Direct
Mapping und N = M einen voll-assoziativen Cache-Speicher, wobei M die Gesamtzahl der Einträge im Speicher bedeutet.
Im Allgemeinen werden die Daten in Blöcken von 2b Bytes pro Speichereintrag gespeichert. Im allgemeinen Fall eines teilassoziativen Cache-Speichers mit N = 2n Wegen wird üblicherweise die p Bit breite Adresse des Datums so aufgeteilt, dass n Bit den Index, b Bit den Offset und die übrigen p - n - b Bit das Tag bilden. Das ist in der beigefügten Figur veran- schaulicht.
Beim Zugriff auf ein Datum im Cache-Speicher, z. B. bei einem Lese- oder Schreibvorgang, wird das Index-Feld verwendet, um ein Set direkt zu adressieren. Das Tag-Feld wird zusammen mit dem jeweiligen Block abgespeichert, um ihn eindeutig innerhalb eines Sets zu identifizieren. Bei einer assoziativen Suche nach dem Block wird das Tag-Feld der Adresse mit den Tag- co ω ISJ DO H1 H1 cn o JI o Π O LΠ
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Claims

Als weitere Ausgestaltung der Erfindung kann zusätzlich das Index-Feld der Adressen des Cache-Speichers durch eine weitere umkehrbar eindeutige Abbildung, die das Index-Feld auf ein verschlüsseltes Index-Feld abbildet, verschlüsselt werden. Auch dazu wird eine entsprechend vorzusehende Hardware-Einheit verwendet. Damit wird ein sogenanntes Set-Scrambling erreicht, bei dem der im Cache-Speicher zu verwaltende Block in einem nicht auf triviale Weise aufzufindenden Set abgelegt wird. Eine derartige Verschlüsselung wird vorzugsweise dann zusätzlich durchgeführt, wenn die Architektur des Prozessors nicht vorsieht, dass auf Daten "unaligned" zugegriffen werden kann, so dass die Daten über die Blockgrenzen hinausragen.Eine erfindungsgemäße Ausgestaltung eines Cache-Speichers ist insbesondere bei Cache-Speichern auf Sicherheitscontrollern (security-controller) bevorzugt. Patentansprüche
1. Cache-Speicher, dessen Adressen eine Aufteilung in Tag, Index und Offset aufweisen, d a du r c h g e k e n n z e i c h n e t , dass Mittel vorhanden sind, die eine umkehrbar eindeutige Transformation zwischen dem jeweiligen Tag-Teil der Adresse und einer verschlüsselten Tag-Adresse vornehmen.
2. Cache-Speicher nach Anspruch 1, bei dem die Mittel zusätzlich eine umkehrbar eindeutige Transformation zwischen dem jeweiligen Index-Teil der Adresse und einer verschlüsselten Index-Adresse vornehmen.
3. Verfahren zur Adressierung eines Cache-Speichers, bei dem eine umkehrbar eindeutige Transformation zwischen einem Tag- Teil einer Cache-Adresse und einer verschlüsselten Tag-Adresse vorgenommen wird.
4. Verfahren nach Anspruch 3 , bei dem zusätzlich eine umkehrbar eindeutige Transformation zwischen einem Index-Teil einer Cache-Adresse und einer verschlüsselten Index-Adresse vorgenommen wird.
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