TWI750115B - 帶著具有凹處之中介件的積體電路結構 - Google Patents
帶著具有凹處之中介件的積體電路結構 Download PDFInfo
- Publication number
- TWI750115B TWI750115B TW105113095A TW105113095A TWI750115B TW I750115 B TWI750115 B TW I750115B TW 105113095 A TW105113095 A TW 105113095A TW 105113095 A TW105113095 A TW 105113095A TW I750115 B TWI750115 B TW I750115B
- Authority
- TW
- Taiwan
- Prior art keywords
- recess
- package
- conductive contacts
- interposer
- component
- Prior art date
Links
- 239000000463 material Substances 0.000 claims description 70
- 238000000034 method Methods 0.000 claims description 38
- 239000004020 conductor Substances 0.000 claims description 26
- 238000012545 processing Methods 0.000 claims description 23
- 239000003990 capacitor Substances 0.000 claims description 22
- 238000004519 manufacturing process Methods 0.000 claims description 18
- 229910000679 solder Inorganic materials 0.000 claims description 16
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 claims description 9
- 229910052802 copper Inorganic materials 0.000 claims description 9
- 239000010949 copper Substances 0.000 claims description 9
- 238000005520 cutting process Methods 0.000 claims description 8
- 230000008878 coupling Effects 0.000 claims description 6
- 238000010168 coupling process Methods 0.000 claims description 6
- 238000005859 coupling reaction Methods 0.000 claims description 6
- 238000004891 communication Methods 0.000 description 20
- 238000003860 storage Methods 0.000 description 7
- 230000008569 process Effects 0.000 description 5
- 238000010030 laminating Methods 0.000 description 3
- 238000003698 laser cutting Methods 0.000 description 3
- 238000007639 printing Methods 0.000 description 3
- 238000013459 approach Methods 0.000 description 2
- 238000010276 construction Methods 0.000 description 2
- 238000000151 deposition Methods 0.000 description 2
- 238000010295 mobile communication Methods 0.000 description 2
- 239000007787 solid Substances 0.000 description 2
- 238000012546 transfer Methods 0.000 description 2
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 1
- 239000004593 Epoxy Substances 0.000 description 1
- 238000009825 accumulation Methods 0.000 description 1
- 239000000654 additive Substances 0.000 description 1
- 230000008901 benefit Effects 0.000 description 1
- 230000005540 biological transmission Effects 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 239000004566 building material Substances 0.000 description 1
- 229910052799 carbon Inorganic materials 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 238000005260 corrosion Methods 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 238000005553 drilling Methods 0.000 description 1
- 230000005670 electromagnetic radiation Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 125000003700 epoxy group Chemical group 0.000 description 1
- 239000000835 fiber Substances 0.000 description 1
- 230000006870 function Effects 0.000 description 1
- 239000010931 gold Substances 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 239000011810 insulating material Substances 0.000 description 1
- 230000007774 longterm Effects 0.000 description 1
- 239000002184 metal Substances 0.000 description 1
- 229910052751 metal Inorganic materials 0.000 description 1
- 238000004806 packaging method and process Methods 0.000 description 1
- 239000012188 paraffin wax Substances 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 229920000647 polyepoxide Polymers 0.000 description 1
- 229920001296 polysiloxane Polymers 0.000 description 1
- -1 polysiloxanes Polymers 0.000 description 1
- 239000003755 preservative agent Substances 0.000 description 1
- 230000002335 preservative effect Effects 0.000 description 1
- 238000004886 process control Methods 0.000 description 1
- 230000009467 reduction Effects 0.000 description 1
- 229920005989 resin Polymers 0.000 description 1
- 239000011347 resin Substances 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
- 239000000758 substrate Substances 0.000 description 1
- 230000001629 suppression Effects 0.000 description 1
- 238000012360 testing method Methods 0.000 description 1
- 230000001131 transforming effect Effects 0.000 description 1
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/12—Mountings, e.g. non-detachable insulating substrates
- H01L23/13—Mountings, e.g. non-detachable insulating substrates characterised by the shape
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/49838—Geometry or layout
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/48—Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the subgroups H01L21/06 - H01L21/326
- H01L21/4814—Conductive parts
- H01L21/4846—Leads on or in insulating or insulated substrates, e.g. metallisation
- H01L21/4853—Connection or disconnection of other leads to or from a metallisation, e.g. pins, wires, bumps
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/48—Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the subgroups H01L21/06 - H01L21/326
- H01L21/4814—Conductive parts
- H01L21/4846—Leads on or in insulating or insulated substrates, e.g. metallisation
- H01L21/4857—Multilayer substrates
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/49822—Multilayer substrates
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/49833—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers the chip support structure consisting of a plurality of insulating substrates
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/50—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor for integrated circuit devices, e.g. power bus, number of leads
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
- H01L23/538—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames the interconnection structure between a plurality of semiconductor chips being formed on, or in, insulating substrates
- H01L23/5385—Assembly of a plurality of insulating substrates
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/58—Structural electrical arrangements for semiconductor devices not otherwise provided for, e.g. in combination with batteries
- H01L23/64—Impedance arrangements
- H01L23/66—High-frequency adaptations
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/10—Bump connectors ; Manufacturing methods related thereto
- H01L24/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L24/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/03—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
- H01L25/04—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
- H01L25/065—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L25/0657—Stacked arrangements of devices
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2223/00—Details relating to semiconductor or other solid state devices covered by the group H01L23/00
- H01L2223/58—Structural electrical arrangements for semiconductor devices not otherwise provided for
- H01L2223/64—Impedance arrangements
- H01L2223/66—High-frequency adaptations
- H01L2223/6661—High-frequency adaptations for passive devices
- H01L2223/6666—High-frequency adaptations for passive devices for decoupling, e.g. bypass capacitors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16153—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being arranged next to each other, e.g. on a common substrate
- H01L2224/16155—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being arranged next to each other, e.g. on a common substrate the item being non-metallic, e.g. being an insulating substrate with or without metallisation
- H01L2224/16157—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being arranged next to each other, e.g. on a common substrate the item being non-metallic, e.g. being an insulating substrate with or without metallisation the bump connector connecting to a bond pad of the item
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16153—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being arranged next to each other, e.g. on a common substrate
- H01L2224/16195—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being arranged next to each other, e.g. on a common substrate the item being a discrete passive component
- H01L2224/16197—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being arranged next to each other, e.g. on a common substrate the item being a discrete passive component the bump connector connecting to a bonding area disposed in a recess of the surface of the item
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/03—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
- H01L25/04—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
- H01L25/065—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L25/0655—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L27/00 the devices being arranged next to each other
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/12—Passive devices, e.g. 2 terminal devices
- H01L2924/1205—Capacitor
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/151—Die mounting substrate
- H01L2924/153—Connection portion
- H01L2924/1531—Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
- H01L2924/15311—Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a ball array, e.g. BGA
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/19—Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
- H01L2924/1901—Structure
- H01L2924/1904—Component type
- H01L2924/19041—Component type being a capacitor
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/19—Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
- H01L2924/1901—Structure
- H01L2924/1904—Component type
- H01L2924/19042—Component type being an inductor
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/19—Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
- H01L2924/1901—Structure
- H01L2924/1904—Component type
- H01L2924/19043—Component type being a resistor
Landscapes
- Engineering & Computer Science (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Ceramic Engineering (AREA)
- Manufacturing & Machinery (AREA)
- Geometry (AREA)
- Production Of Multi-Layered Print Wiring Board (AREA)
- Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
Abstract
此處揭示帶著具有凹處之中介件的積體電路(IC)結構。舉例言之,一IC結構可包括:具有一抗蝕表面的一中介件;設置於該抗蝕表面中的一凹處,其中該凹處的一底部係經表面精加工;及位在該抗蝕表面的多個傳導接點。其它實施例可經揭示及/或請求專利。
Description
本文揭示大體上係有關於積體電路(IC)領域,及更特別,係有關於帶著具有凹處之中介件的積體電路結構。
於積體電路(IC)中,中介件偶爾被用來減少積體電路裝置的腳印。然而,習知帶有中介件之結構的高度對小形狀因數的裝置設定諸如智慧型電話而言可能過大。
依據本發明之一實施例,係特地提出一種積體電路(IC)結構,其包含:具有一抗蝕表面的一中介件;設置於該抗蝕表面中的一凹處,其中該凹處的一底部係經表面精加工;以及位在該抗蝕表面的多個傳導接點。
100:中介件
102:抗蝕表面
106、1416:凹處
108、1492:底部
110、234、308:傳導接點
190、316、502、508:堆積材料
198、1444、1446:深度
200:積體電路(IC)結構
204、208:堆積部
206:厚度
214、1502、1504:組件
228:IC封裝
230、232、310:表面
236:距離
242:焊料球
272:IC組件
300、400、500、600、700、800、900、1000、1100:結構
312:電氣結構
402:離型層
408、410:區域
510:傳導結構
1200、1300:方法
1202-1214、1302、1304:方塊
1462、1464:寬度
1600:計算裝置
1602:母板
1604:處理器
1606:通訊晶片
1608:儲存裝置
藉如下詳細說明部分結合附圖將容易瞭解實施例。為了輔助本詳細說明部分,相似的元件符號標示相似的結構元件。於附圖之各圖中將藉舉例說明,而非限制性,來例示實施例。
圖1為依據各種實施例一中介件的一部分之剖面側視圖。
圖2為依據各種實施例IC結構的一部分連同在中介件結構上的一封裝的剖面側視圖。
圖3-11為依據各種實施例於一製造順序中的各個階段IC結構的剖面側視圖。
圖12為依據各種實施例製造一中介件的一方法的流程圖。
圖13為依據各種實施例製造一IC結構連同在中介件結構上的一封裝的一方法的流程圖。
圖14為依據各種實施例一中介件的一部分之剖面側視圖。
圖15為依據各種實施例IC結構的一部分連同在中介件結構上的一封裝的剖面側視圖。
圖16為計算裝置之一實例的方塊圖,該計算裝置可包括一或多個此處揭示的該等中介件及IC結構中之任一者。
此處揭示為帶著具有凹處的中介件之積體電路(IC)結構,及相關結構及方法。此處揭示之實施例中之各者可啟用IC結構其中一中介件包括一凹處,使得耦接至該中介件的一IC封裝的一或多個組件延伸入該凹處。
以中介件為基礎的結構已經用來提供用於小形
狀因數裝置,諸如智慧型電話及平板電腦,的高密度邏輯(例如,藉由堆疊記憶體組件)。更明確言之,一中介件可用來將一IC封裝耦接至一母板或其它組件來縮小一裝置的腳印。如此可稱作為「中介件上封裝」或「中介件上補片」(PoINT)結構。一中介件可使用電路板製造技術(例如,減法製程)製造,其成本可實質上低於製造一IC封裝的成本(例如,使用半加法製程)。
習知IC封裝可使用中間層級互連(MLI)技術而耦接至一中介件。此種技術可包括球柵陣列(BGA)耦接。當期望高密度時,BGA凸塊間之節距可小於600微米。IC封裝與中介件間之此種細小節距習知表示IC封裝與中介件間之「MLI間隙」為極小。
雖然小MLI間隙似乎為限制裝置的高度所需,但習知以中介件為基礎的結構尚無法達成減低高度而未有損功率傳遞效能。更明確言之,設置於中介件上的IC封裝經常包括一處理裝置(例如,涵括於中央處理單元(CPU)的一處理核心)配置成使得該IC封裝係設置於該處理裝置與該中介件間。當此種包括一處理裝置的一IC封裝係設置於一中介件上時,須透過中介件傳遞功率給處理裝置。解耦電容器習知配置於電源與其目的地間來減少雜訊,但中介件與IC封裝間的小MLI間隙表示在中介件與IC封裝間不可能涵括夠強的(及因而夠大的)解耦電容器。若干習知手段已經將一解耦電容器置於中介件「下方」,介於母板與中介件間。然而,從此種解耦電容器通過中介件及通過IC封裝到
處理裝置的路徑長,產生了且吸引了雜訊,其降級了處理裝置的效能。其它習知手段曾經使用「低輪廓外形」電容器固定到IC封裝介於IC封裝與中介件間(來縮短電容器與處理裝置間之路徑長度),但此等電容器的有限尺寸(例如,高度小於200微米)已經表示此等電容器提供的電容不足以達成期望的雜訊遏止。確實,低輪廓外形電容器可具有期望電容的一半或以下的最大電容。
此處揭示之實施例中之各者包括於中介件內的一凹處以達成在該中介件與設置其上的一IC封裝間具有較大組裝間隙高度的一區域。該IC封裝的一組件可延伸入一中介件內的一凹處。如此允許此等組件,比較先前可能達成者,實體上更靠近IC封裝上的其它組件而不會危害以中介件為基礎的結構的總高度。舉例言之,一夠強的解耦電容器(例如,具有約0.47微法拉的電容及大於200微米的高度)可置放於一IC封裝的「底側」且可延伸入於其上設置該IC封裝的一中介件的一凹處內。當一處理裝置耦接至該IC封裝的「頂側」時,該解耦電容器可夠強及夠接近處理裝置來達成期望的效能而不會犧牲MLI密度。
於後文詳細說明部分中,參考構成該詳細說明部分的一部分之附圖,其中相似的元件符號標示全文中相似的部件,及其中藉由例示顯示可實施的實施例。須瞭解可不背離本文揭示之範圍而運用其它實施例且可做出結構或邏輯變化。因此,後文詳細說明部分並非解譯為限制性意義,實施例之範圍係由隨附之申請專利範圍及其相當範圍
所界定。
各種操作可以最有助於瞭解申請專利的主旨之方式依序描述為多個分開的動作或操作。然而,描述的順序不應解譯為暗示此等操作必然為順序相依性。特別,此等操作可不以呈現的順序進行。所描述的操作可以所描述之實施例的不同順序進行。可進行各種額外操作及/或於額外操作中可刪除所描述的操作。
為了本文揭示之目的,片語「A及/或B」及「A或B」表示(A)、(B)、或(A及B)。用於本文揭示之目的,片語「A、B、及/或C」表示(A)、(B)、(C)、(A及B)、(A及C)、(B及C)、或(A、B及C)。
描述中使用片語「於一實施例中」或「於實施例中」,其可各自指稱相同的或相異的實施例中之一或多者。又復,有關本文揭示之實施例使用的術語「包含」、「包括」、「具有」等為同義詞。
如此處使用,「中介件」一詞可表示經組配以置於電路板(例如,母板)與封裝體間的一組件。一中介件可使用電路板組構技術(例如,母板組構技術)建構。
圖1為依據各種實施例一中介件100的一部分之剖面側視圖。中介件100可具有一抗蝕表面102及位在該抗蝕表面102內的一凹處106。該凹處106之一底部108可經表面精加工。於若干實施例中,該凹處106的底部108可由已經表面精加工的傳導材料112諸如經機械研磨的銅製成。於若干實施例中,表面精加工可包括鎳-鈀-金(NiPdAu)精加工
或銅有機可焊性保存劑(CuOSP)精加工之施加。於若干實施例中,凹處106的底部108可由絕緣材料諸如阻焊劑製成,而可不包括傳導材料112。
一或多個傳導接點110可位在抗蝕表面102。抗蝕表面102可形成於一堆積材料190上,及根據任何合宜的已知技術可經製作圖樣來暴露傳導接點110。任何合宜堆積材料皆可用於此處討論的堆積材料,諸如味之素(Ajinomoto)堆積膜(ABF)及預浸物堆積膜。堆積材料190可包括額外結構於其中,諸如通孔、傳導通孔、其它裝置、或任何其它合宜電氣或絕緣結構(圖中顯示若干非限制性實例)。
凹處106可具有一深度198(介於在抗蝕表面102下方的堆積材料190之「頂」與凹處106下方的堆積材料190之「頂」間測量)。凹處106的深度198可具有任何合宜數值(及如後文參考圖3-11之討論,方便於製造期間藉改變堆積厚度或堆積層數而予調整)。舉例言之,於若干實施例中,凹處106可具有50微米至300微米的一深度198。
於若干實施例中,至少兩個傳導接點110可位在抗蝕表面102,且可間隔少於600微米的距離(於圖1中未顯示),但可使用任何合宜的間隔。傳導接點110中之一或多者可由銅製成(例如,呈銅墊片)。於使用中,中介件100可耦接至位在中介件100「下方」的一母板(於圖中未顯示)。如前文討論,中介件100可安排電氣信號的路徑自母板至耦接至中介件100的其它組件(例如,耦接至中介件110的IC封裝,如後文參考圖2之討論)。
圖2為依據各種實施例IC結構200的一部分連同在中介件結構上的一封裝的剖面側視圖。如圖中例示,IC結構200可包括中介件100的一實施例。雖然特定數目的IC封裝及組件係例示於圖2中,但視需要,此處揭示之技術可用來製造具有更少或更多個封裝(例如,配置於凹處內)的一IC結構。若干此等實施例之實例係如後文參考圖14-15的討論。
如前文參考圖1的討論,圖2之中介件100可具有一抗蝕表面102及位在該抗蝕表面102內的一凹處106。該凹處106之一底部108可經表面精加工。於圖2之中介件100實施例中,傳導材料112顯示為配置於凹處106的底部108。傳導材料112可涵括於其中使用雷射來「切割」出凹處106的實施例內,如後文參考圖7的討論,且可用作為雷射停止劑。於使用另一項技術來切割出凹處106的實施例中(例如,機械路徑安排),可不涵括傳導材料112。
中介件100可包括配置於抗蝕表面102下方的第一堆積部204。第一堆積部204可具有一厚度206。中介件100可包括位於凹處106的底部108下方的第二堆積部208。第二堆積部208可具有一厚度210。厚度206可大於厚度210。如於圖2中例示,第一堆積部204可包括多個電氣結構,諸如通孔及傳導墊片,配置於其中且與傳導接點110電氣接觸。第二堆積部208也可包括多個電氣結構,諸如通孔及傳導墊片,配置於其中。
如後文參考圖3-5的討論,第一堆積部204及第二
堆積部208可使用一串堆積沈積操作製成。更明確言之,堆積的第一階段可提供第二堆積部208,而第一堆積部204可由堆積的第一階段與接在該堆積的第一階段之後的堆積的第二階段的組合提供。
圖2之IC結構200包括IC封裝228。該IC封裝228可具有一第一表面230,配置與該第一表面230相對的一第二表面232,及位在該第二表面232的一或多個傳導接點234。IC封裝228可以是任何合宜IC封裝,且可具有額外置放其上的IC封裝或其它組件(例如,容後詳述)。更明確言之,IC封裝228可具有耦接至IC封裝228的第二表面232的一組件214。組件214可以是主動組件(例如,仰賴能源的組件)或被動組件(例如,不會將淨能源導入一電路中的組件)。主動組件的實例可包括射頻(RF)電路。其中組件214為被動組件的實施例中,組件214可包括電容器、電阻器、電感器、或該等組件之任何組合。
如於圖2中例示,IC封裝228可耦接至中介件100,使得組件214配置於中介件100與IC封裝228間。傳導接點234中之一或多者可電氣耦接至傳導接點110中之對應一或多者,及組件214可延伸入凹處106內部。如於圖2中例示,於若干實施例中,組件214可藉由無任何元件設置於其中之一間隙與凹處106的底部108隔開。於圖2中,傳導接點234例示為透過配置於抗蝕表面102的傳導接點110上的焊料球242(例如,於由已製作圖樣的抗蝕表面102所形成的孔徑內)而耦接至傳導接點110。
圖2之IC結構200也包括一IC組件272。該IC組件272例如可以是裸晶粒,及/或可以是任何合宜IC組件,諸如單晶片系統(SoC)、應用處理器、中央處理單元(CPU)、或製程控制中樞器(PCH)。IC組件272可位在IC封裝228的第一表面230。於若干實施例中,IC組件272可包括一處理核心,及組件214可以是用於IC組件272的處理核心的一解耦電容器。IC封裝228的第二表面232可與中介件100的該抗蝕表面102隔開一距離236。於若干實施例中,距離236可少於250微米。
如前記,凹處106的深度可具有任何合宜數值。更特別,凹處106的深度可鑑於下列因素而予選取:將延伸入凹處106內部的組件214之高度,及/或中介件100與耦接至抗蝕表面102的傳導接點110之另一個IC封裝(例如,IC封裝228)間之預期間隔。
圖3-11為依據各種實施例於一製造順序中的各個階段IC結構的剖面側視圖。特別,由圖3-11例示的製造順序係顯示為製造圖2的IC結構200。然而,此點僅為例示,後文參考圖3-11討論的操作可用來製造任何合宜的IC結構。此外,雖然如後文參考圖3-11討論的各種製造操作及此處揭示的其它方法係以特定順序討論,但製造操作可以任何合宜順序進行。舉例言之,切割堆積材料及離型層(例如,如後文參考圖7的討論)的相關操作可在抗蝕表面之形成之前或之後進行(例如,如後文參考圖6的討論)。如後文參考圖3-11討論的製造操作也可於不同時間或於不同設施
進行。舉例言之,參考圖3-10討論的操作可作為生產順序之一部分進行,而參考圖11討論的操作可作為結構順序之一部分分開地進行。
圖3例示包括一堆積材料316及電氣結構312配置於其中及其上的一結構300。更明確言之,結構300可包括設置於表面310的第一區域408之一傳導材料112及設置於表面310的第二區域410之一或多個傳導接點308。傳導材料112與傳導接點308可由相同材料(例如,銅)製成。第一區域408與第二區域410可在表面310上不重疊。結構300可使用任何合宜的習知基材堆積法製成。
圖4例示於結構300的第一區域408上方提供一離型層402之後的一結構400。更明確言之,離型層402可設於傳導材料112之頂上,且可跨據傳導材料112之幅度的至少部分。於結構400中,傳導材料112可設置於離型層402與堆積材料316間。離型層402可不接觸第二區域410中的傳導接點308。於若干實施例中,提供離型層402可包括糊膏印刷離型層402。於其它實施例中,提供離型層402可包括積層離型層402。離型層402使用的材料可對傳導材料112具有弱黏著性,故於後來製造操作中方便被去除(例如,如後文參考圖8的討論)。任何合宜的離型材料皆可用於此處揭示的離型層,諸如環氧樹脂、聚矽氧樹脂、或含以碳為主的粒子或纖維之以鏈烷烴為主的樹脂。離型材料可與堆積膜(例如,預浸膜)及銅具有不良黏著性。
圖5例示提供堆積材料給結構400且形成額外傳
導結構510及傳導接點110之後的一結構500。更明確言之,堆積材料可包括設於第一區域408上方的堆積材料502及設於第二區域410上方的堆積材料508。雖然堆積材料502與堆積材料508係經分開辨識,但堆積材料502及堆積材料508可在一連續製造操作中提供。堆積材料502可經提供使得離型層402係設置於堆積材料502與傳導材料112間。傳導結構510(例如,傳導墊片及通孔)可與堆積材料的提供(例如,藉由沈積堆積材料,鑽孔或以其它方式去除堆積材料的一部分,形成傳導結構,然後重複該製程)交錯地形成。傳導接點110可形成於第二區域410上方。並無任何傳導接點或其它傳導結構可形成於設置於離型層402「上方」的該堆積材料502之內或之上。
圖6例示在結構500上形成抗蝕表面102之後的一結構600。如前文參考圖1及圖2的討論,抗蝕表面102可經製作圖樣而暴露出第二區域410上方的傳導接點110。於第一區域408上方可不施加抗焊劑。
圖7例示切割第一區域408上方的結構600之該堆積材料502向下到且含離型層402之後的一結構700。於若干實施例中,切割堆積材料502可藉雷射切割在第一區域408邊界的該堆積材料502進行。於若干實施例中,用來切割堆積材料502向下到離型層402的雷射能可切穿離型層402且在到達傳導材料112(例如,硬質金屬,諸如銅)時停止。可出現切割的深度可取決於用來進行切割的雷射功率。於其它實施例中,切割該堆積材料502可藉機械式路徑安排在第
一區域邊界的該堆積材料502進行。注意圖7為一結構的一剖面側視圖;當從「頂部」觀看時,堆積材料502可被切割而形成任何期望的形狀(例如,矩形),及藉此形成具有任何期望的腳印的一凹處,容後詳述。
圖8例示去除離型層402及設置於結構700的離型層402上的堆積材料502之後的一結構800。當於雷射切割後離型層402的邊緣暴露出時(如於圖7中顯示),離型層402可藉機械方式舉升及從傳導材料112「剝離」去除,同時去除堆積材料502。當離型層402及堆積材料502被去除時,可形成一凹處106,及於凹處106的底部108的傳導材料112可暴露出。結構800可以是如前文參考圖1討論的中介件100之一實施例。更明確言之,結構800可形成一中介件具有一抗蝕表面102、一凹處106、及位在抗蝕表面102的一或多個傳導接點110。凹處106的深度為設置於離型層402上的該堆積材料502之厚度的函數。如此,凹處106的深度可於製造期間藉由調整連同各層而沈積的堆積材料之厚度及/或於沈積離型層402之後所形成的層數(例如,疊加數目)而予設定。
圖9例示將結構800表面精加工之後的一結構900。於若干實施例中,將結構800表面精加工可包括根據已知技術機械式研磨結構900的適當部分。於若干實施例中,表面精加工可包括施加一精加工材料,諸如NiPdAu或CuOSP。特別,傳導接點110及傳導材料112的暴露表面可經表面精加工。結構900的其它部分也可經表面精加工(例如,在結構900之「底部」上的第二層級互連(SLI))。結構
900可以是如前文參考圖1討論的中介件100之一實施例。更明確言之,結構900可形成一中介件,其具有一抗蝕表面102、具有經表面精加工的一底部108的一凹處106、及位在抗蝕表面102的一或多個傳導接點110。
圖10例示提供焊料球242給在抗蝕表面102的傳導接點110之後的一結構1000。焊料球242可使用習知技術,諸如球柵陣列(BGA)附接提供。結構1000可以是如前文參考圖1討論的中介件100之一實施例。更明確言之,結構1000可形成一中介件,其具有一抗蝕表面102、具有經表面精加工的一底部108的一凹處106、及位在抗蝕表面102的一或多個傳導接點110。
圖11例示透過焊料球242耦接一IC封裝228至結構1000之後的一結構1100。IC封裝228可包括傳導接點234,其係透過焊料球242電氣耦接至傳導接點110。結構1000可呈如前文參考圖2討論的IC結構200之該等實施例中之任一者的形式。結構1000也可以是如前文參考圖1討論的中介件100之一實施例。更明確言之,結構1000可形成一中介件,其具有一抗蝕表面102、具有經表面精加工的一底部108的一凹處106、及位在抗蝕表面102的一或多個傳導接點110。IC封裝228可在耦接228到結構1000之前經預先組裝。
圖12為依據各種實施例製造一中介件的一方法1200的流程圖。雖然方法1200之操作可參考中介件100及其組件之討論,但如此僅用於例示目的,方法1200可被運用來形成任何合宜的IC結構。
於1202,可提出一結構(例如,圖3之結構300)。該結構可具有一表面含一第一區域及一第二區域(例如,圖3之表面310的第一區域408及第二區域410)。第一區域與第二區域可以是不重疊,一或多個傳導接點可位在第二區域中的表面(例如,圖3之一或多個傳導接點308)。傳導材料可位在第一區域中的表面(例如,圖3之傳導材料112)。
於1204,一離型層可提供給該表面的第一區域(例如,圖4之結構400的離型層402)。於若干實施例中,該離型層可提供於該表面的第一區域內的一傳導材料上方(例如,傳導材料112)。於若干實施例中,1204可包括糊膏印刷該離型層。於若干實施例中,1204可包括積層該離型層。
於1206,堆積材料可提供給第一及第二區域(例如,圖5之結構500的第一區域408及第二區域410分別的堆積材料502及508)。
於1208,一或多個傳導接點可形成於該第二區域上方(例如,圖5之結構500的傳導接點110)。
於1210,抗焊劑可提供於該等一或多個傳導接點上方(例如,如於形成圖6之結構600的抗蝕表面102中例示)。
於1212,堆積材料可切割到離型層(例如,切割到離型層402,如參考圖7之結構700例示)。於若干實施例中,1212可包括雷射切割或機械路徑安排在第一區域的邊界的堆積材料。
於1214,離型層及設置於離型層上的堆積材料可
經去除以暴露出該表面的第一區域(例如,暴露傳導材料112,如前文參考圖8之結構800的討論)。
於若干實施例中,於1206提供堆積材料之後而於1212切割堆積材料之前,方法1200也可包括於第二區域的堆積材料中形成一或多個傳導通孔(例如,如前文參考圖5的討論)。於若干此點實施例中,方法1200也可包括提供焊料球給於1208形成的該等傳導接點。於若干實施例中,方法1200可包括將該凹處的一底部表面精加工。表面精加工可包括機械研磨及/或施加NiPdAu或CuOSP精加工。
圖13為依據各種實施例製造一IC結構的一方法1300的流程圖。雖然方法1300之操作可參考IC結構200及其組件之討論,但如此僅用於例示目的,方法1300可被運用來形成任何合宜的IC結構。
於1302,可設有一中介件(例如,圖1之中介件100)。於1302提供的中介件可具有一抗蝕表面;設置於該抗蝕表面中之一凹處,其中該凹處之一底部係經表面精加工;及位在該抗蝕表面的第一多個傳導接點(例如,設置於抗蝕表面102中之凹處106及第一多個傳導接點110)。
於1304,一IC封裝可耦接至中介件(例如,圖2之耦接至中介件100的IC封裝228)。該IC封裝可具有一第一表面、一第二表面、位在該IC封裝之第二表面的第二多個傳導接點、及位在該IC封裝之第二表面的一組件(例如,圖2之第一表面230、第二表面232、傳導接點234、及組件214)。該組件可以是被動組件,諸如電容器。該等第二多個傳導
接點可電氣耦接至該等第一多個傳導接點,及該IC封裝可經配置使得該組件延伸至該凹處內。
此處揭示的中介件之各種實施例可包括多個凹處,組件可延伸入該凹處中。舉例言之,圖14為依據各種實施例一中介件100的一部分之剖面側視圖。類似圖1之中介件100,圖14之中介件100可具有一抗蝕表面102及位在該抗蝕表面102內的一凹處106。該凹處106可具有一底部108。於若干實施例中,底部108可經表面精加工。一或多個傳導接點110可位在抗蝕表面102。抗蝕表面102可形成於一堆積材料190上,及可根據任何合宜的已知技術製作圖樣來暴露出傳導接點110。堆積材料190可包括額外結構於其中,諸如通孔、傳導接點、其它裝置、或任何其它合宜電氣或絕緣結構(為求方便例示故於圖中未顯示)。
此外,中介件100可包括設置於抗蝕表面102中的一額外凹處1416。該凹處1416可具有一底部1492。於若干實施例中,底部1492可經表面精加工。凹處106可具有一深度1444,及凹處1416可具有一深度1446。於若干實施例中,深度1444及深度1446可相異。舉例言之,如於圖14中例示,深度1446可少於深度1444。凹處106可具有一寬度1462,及凹處1416可具有一寬度1464。於若干實施例中,寬度1462及寬度1464可相異。舉例言之,如於圖14中例示,寬度1462可少於寬度1464。圖14的中介件100之凹處、抗蝕表面、及傳導接點可呈此處揭示的中介件100之該等實施例中之任一者的形式。
此處揭示的IC結構之各種實施例可包括含中介件的IC結構附有多個凹處及/或多個組件延伸入單一凹處內。舉例言之,圖15為依據各種實施例IC結構200之一實施例的一部分之剖面側視圖。類似圖2之IC結構200,圖15的IC結構200可包括中介件100之一實施例(如圖例示,圖14之中介件100)。
圖15的IC結構200包括電氣耦接至中介件100的傳導接點110之一IC封裝228的傳導接點234。IC封裝228包括被固定至IC封裝228的一組件214,使得組件214延伸入凹處106內部(例如,依據如前文參考圖2討論的實施例中之任一者)。
圖15的IC結構200也包括被固定至IC封裝228的組件1502及1504,使得組件1502及1504延伸入凹處1416內。組件1502及1504可於凹處1416中彼此相鄰(例如,依據如前文參考圖2討論的實施例中之任一者)。如於圖15中例示,於若干實施例中,組件214、1502、及1504可不與中介件100實體接觸。
本文揭示之實施例可使用其可從此處揭示的凹陷的傳導接點及製造技術獲益的任何中介件、IC封裝、或IC封裝結構而具體實現為一系統。圖16示意地例示依據若干具體實施例一計算裝置1600,其可包括具有依據此處揭示實施例中之任一者所形成的凹處之中介件。舉例言之,中介件100或IC結構200可經組配以包括計算裝置1600的一儲存裝置1608、一處理器1604、或一通訊晶片1606(容後詳
述)。
計算裝置1600例如可以是一行動通訊裝置或一以桌上型電腦或機架為基礎的計算裝置。計算裝置1600可罩住一板,諸如母板1602。該母板1602可包括多個組件,包括(但非限制性)一處理器1604及至少一個通訊晶片1606。此處參考計算裝置1600討論的組件中之任一者可依據此處揭示之技術配置成一以中介件為基礎的結構。於進一步具體實施例中,通訊晶片1606可以是處理器1604的部件。
計算裝置1600可包括一儲存裝置1608。於若干實施例中,儲存裝置1608可包括一或多個固態驅動裝置。可涵括於儲存裝置1608中之儲存裝置的實例包括依電性記憶體(例如,動態隨機存取記憶體(DRAM))、非依電性記憶體(例如,唯讀記憶體,ROM)、快閃記憶體、及大容量儲存裝置(諸如硬碟驅動裝置、光碟(CD)、數位影音碟(DVD)等)。
取決於其應用,計算裝置1600可包括其它組件,其可以或可不實體上及電氣上耦接至母板1602。此等其它組件可包括,但非限制性,圖形處理器、數位信號處理器、密碼處理器、晶片組、天線、顯示器、觸控螢幕顯示器、觸控螢幕控制器、電池組、音訊編解碼器、視訊編解碼器、功率放大器、全球定位系統(GPS)裝置、羅盤、蓋革計數器、加速度計、迴轉儀、揚聲器、及相機。
通訊晶片1606及天線使得能進行無線通訊,用於資料的移轉至及自計算裝置1600。術語「無線」及其衍生
詞可使用來描述透過經由一非固體媒體的經調變電磁輻射的使用而通訊資料的電路、裝置、系統、方法、技術、通訊通道等。該術語並不暗示相關聯的裝置不含任何導線,但於若干實施例中可能不含任何導線。通訊晶片1606可具體實現多個無線標準或協定中之任一者,包括但非僅限於美國電機及電子工程師學會(IEEE)標準包括Wi-Fi(IEEE 802.11家族)、IEEE 802.16標準(例如,IEEE 802.16-2005修訂)、長期演進(LTE)專案連同任何修訂、更新、及/或修訂版(例如,進階LTE專案、超行動寬頻(UMB)專案(又稱「3GPP2」)等)。IEEE 802.16可相容性寬頻無線存取(BWA)網路通稱作WiMAX網路,此乃微波接取全球互通服務的頭字語縮語詞,其乃通過IEEE 802.16標準的一致性與互動性測試產品的正字標記。通訊晶片1606可根據全球行動通訊系統(GSM)、通用封包無線電服務(GPRS)、通用行動電信系統(UMTS)、高速封包存取(HSPA)、演進HSPA(E-HSPA)、或LTE網路操作。通訊晶片1606可根據加強式GSM演進資料(EDGE)、GSM EDGE無線電接取網路(GERAN)、通用地面無線電接取網路(UTRAN)、或演進UTRAN(E-UTRAN)操作。通訊晶片1606可根據劃碼多向接取(CDMA)、分時多向接取(TDMA)、數位加強式無線電信(DECT)、演進資料優化(EV-DO)、其衍生標準,以及標示為3G、4G、5G、及以上的任何其它無線協定操作。於其它實施例中,通訊晶片1606可根據其它無線協定操作。
計算裝置1600可包括多個通訊晶片1606。舉例言
之,第一通訊晶片1606可專用於較短程無線通訊諸如Wi-Fi及藍牙,第二通訊晶片1606可專用於較長程無線通訊諸如GPS、EDGE、GPRS、CDMA、WiMAX、LTE、EV-DO、及其它。於若干實施例中,通訊晶片1606可支援有線通訊。例如,計算裝置1600可包括一或多個有線伺服器。
計算裝置1600之處理器1604及/或通訊晶片1606可於IC封裝內包括一或多個晶粒或其它組件。此種IC封裝可使用此處揭示之技術中之任一者(例如,使用此處揭示之凹處結構)而與一中介件或另一封裝耦接。「處理器」一詞可指任何裝置或裝置部分,其處理得自暫存器及/或記憶體之電子資料用以將該電子資料變換成可儲存於暫存器及/或記憶體的其它電子資料。
於各種實施例中,計算裝置1600可以是膝上型電腦、小筆電、筆記型電腦、超筆電、智慧型電話、平板、個人數位助理器(PDA)、超行動PC、行動電話、桌上型電腦、伺服器、列印器、掃描器、監視器、機上盒、娛樂控制單元、數位相機、可攜式音樂播放器、或數位視訊紀錄器。於進一步實施例中,計算裝置1600可以是處理資料的任何其它電子裝置。於若干實施例中,此處揭示的凹陷的傳導接點可於高效計算裝置中具體實現。
下列段落提出此處揭示之實施例的實例。
實例1為一種IC結構,包括:具有一抗蝕表面的一中介件;設置於該抗蝕表面中的一凹處,其中該凹處的一底部係經表面精加工;及位在該抗蝕表面的多個傳導接
點。
實例2可包括實例1的主旨,及可進一步載明該等多個傳導接點為一第一多個傳導接點,及其中該IC結構進一步包括一IC封裝具有一第一表面、與該第一表面相對的一第二表面、位在該IC封裝的該第二表面之一第二多個傳導接點、及耦接至該IC封裝的該第二表面之一組件;其中該等第二多個傳導接點係電氣耦接至該等第一多個傳導接點及該IC封裝係配置使得該組件延伸入該凹處內。
實例3可包括實例2的主旨,及可進一步載明該組件為一電容器,其具有大於0.5微法拉的一電容。
實例4可包括實例2-3中之任一者的主旨,及可進一步載明該組件具有一高度其係大於200微米。
實例5可包括實例2-4中之任一者的主旨,及可進一步載明該IC封裝具有位在該IC封裝的該第一表面的一處理核心及該組件為用於該處理核心之一解耦電容器。
實例6可包括實例2-5中之任一者的主旨,及可進一步載明該IC封裝的該第二表面與該抗蝕表面間之一距離為小於250微米。
實例7可包括實例2-6中之任一者的主旨,及可進一步包括一焊接材料與該等第一多個傳導接點中之一者實體接觸及也與該等第二多個傳導接點中之一者實體接觸。
實例8可包括實例2-7中之任一者的主旨,及可進一步載明該組件係不與該中介件實體接觸。
實例9可包括實例1-8中之任一者的主旨,及可進
一步載明該凹處具有大於100微米之一深度。
實例10可包括實例1-9中之任一者的主旨,及可進一步載明該等多個傳導接點包含多個銅墊片。
實例11可包括實例1-10中之任一者的主旨,及可進一步載明該中介件為無核心。
實例12為一種製造一中介件之方法,包括:提供具有一表面之一結構;提供一離型層至該表面的一第一區域,其中該離型層係不提供給該第一表面的一第二區域;於提供該離型層之後,於該表面的該等第一及第二區域上方提供一堆積材料;於該第二區域上方形成多個傳導接點;於該等多個傳導接點上方提供抗焊劑;切割該堆積材料及該離型層;及去除該離型層及設置於該離型層上的該堆積材料以暴露該表面的該第一區域。
實例13可包括實例12的主旨,及可進一步載明提供該離型層包含糊膏印刷該離型層。
實例14可包括實例12-13中之任一者的主旨,及可進一步載明提供該離型層包含積層該離型層。
實例15可包括實例12-14中之任一者的主旨,及可進一步載明切割該堆積材料及該離型層包含雷射切割於該第一區域之一邊界的該堆積材料及該離型層。
實例16可包括實例12-15中之任一者的主旨,及可進一步包括,於提供該堆積材料之後而於切割該堆積材料及該離型層之前,於該第二區域上方的該堆積材料中形成多個傳導通孔。
實例17可包括實例12-16中之任一者的主旨,及可進一步包括提供焊接材料至該等多個傳導接點。
實例18可包括實例12-17中之任一者的主旨,及可進一步載明該表面的該第一區域不包括任何傳導接點。
實例19為一種製造一IC結構之方法,包括:提供一中介件,其中該中介件包括一抗蝕表面,設置於該抗蝕表面中的一凹處,其中該凹處的一底部係經表面精加工,及位在該抗蝕表面的一第一多個傳導接點;及將一積體電路(IC)封裝耦接至該中介件,其中該IC封裝具有一第一表面、與該第一表面相對的一第二表面、位在該IC封裝的該第二表面之一第二多個傳導接點、及耦接至該IC封裝的該第二表面之一組件,及其中該等第二多個傳導接點係電氣耦接至該等第一多個傳導接點及該IC封裝係配置使得該組件延伸入該凹處內。
實例20可包括實例19的主旨,及可進一步載明該IC封裝包括位在該IC封裝之該第一表面的一處理裝置。
實例21可包括實例19-20中之任一者的主旨,及可進一步載明該凹處具有50微米至300微米的一深度。
實例22可包括實例19-21中之任一者的主旨,及可進一步載明該組件為一電容器,其具有大於0.5微法拉的一電容。
實例23可包括實例19-22中之任一者的主旨,及可進一步載明該組件具有一高度其係大於200微米。
實例24可包括實例19-23中之任一者的主旨,及
可進一步載明該IC封裝具有位在該IC封裝的該第一表面的一處理核心及該組件為用於該處理核心之一解耦電容器。
實例25可包括實例19-24中之任一者的主旨,及可進一步包括,作為將該IC封裝耦接至該中介件的部分,提供一焊接材料與該等第一多個傳導接點中之一者實體接觸及也與該等第二多個傳導接點中之一者實體接觸。
100‧‧‧中介件
102‧‧‧抗蝕表面
106‧‧‧凹處
108‧‧‧底部
110‧‧‧傳導接點
190‧‧‧堆積材料
198‧‧‧深度
Claims (20)
- 一種積體電路(IC)結構,其包含:具有一抗蝕表面的一中介件,該抗蝕表面設於一堆積材料之頂部上;設置於該抗蝕表面中延伸至該堆積材料內的一凹處,其中該凹處的一底部係由經表面精加工之一傳導材料所形成;位在該抗蝕表面的多個傳導接點;以及延伸至該凹處內的一組件,其具有面向該凹處的該底部之該組件的一面,該組件的該面藉由無任何元件設置於其中之一間隙與該凹處的該底部隔開。
- 如請求項1之IC結構,其中該等多個傳導接點為一第一多個傳導接點,且其中該IC結構進一步包含:一IC封裝,其具有一第一表面、與該第一表面相對的一第二表面、位在該IC封裝的該第二表面之一第二多個傳導接點、及耦接至該IC封裝的該第二表面之該組件;其中該等第二多個傳導接點係電氣耦接至該等第一多個傳導接點且該IC封裝係配置使得該組件延伸進入該凹處內。
- 如請求項2之IC結構,其中該組件為一電容器,其具有大於0.5微法拉的一電容。
- 如請求項2之IC結構,其中該組件具有大於200微米之一 高度。
- 如請求項2之IC結構,其中該IC封裝具有位在該IC封裝的該第一表面的一處理核心且該組件為用於該處理核心之一解耦電容器。
- 如請求項2之IC結構,其中該IC封裝的該第二表面與該抗蝕表面間之一距離為小於250微米。
- 如請求項2之IC結構,其進一步包含:一焊接材料,其與該等第一多個傳導接點中之一者實體接觸並且也與該等第二多個傳導接點中之一者實體接觸。
- 如請求項2之IC結構,其中該組件係不與該中介件實體接觸。
- 如請求項1之IC結構,其中該凹處具有大於100微米之一深度。
- 如請求項1之IC結構,其中該等多個傳導接點包含多個銅墊片。
- 如請求項1之IC結構,其中該中介件為無核心。
- 如請求項1之IC結構,其進一步包含設置於該抗蝕表面中延伸至該堆積材料內的另一凹處,其中該另一凹處的一底部係經表面精加工。
- 如請求項12之IC結構,其中該抗蝕表面與該凹處的該底部間之一深度係大於該抗蝕表面與該另一凹處的該底部間之一深度,且其中該凹處具有一第一寬度,且該另一凹處具有一第二寬度,該第一寬度小於該第二寬度。
- 一種製造積體電路(IC)結構之方法,其包含:形成一中介件,其包含:提供一個具有一表面之結構,該表面具有一第一區域及一第二區域,其中一傳導材料被設置在該第一區域中之該表面上;在該傳導材料上方提供一離型層;在該表面之該等第一及第二區域上方提供一堆積材料;在該第二區域上方形成一第一多個傳導接點;在該等一或多個傳導接點上方提供一抗焊劑;在該第一區域之一邊界處切割該堆積材料及該離型層;去除該離型層及設置在該離型層上之該堆積材料,以暴露出該傳導材料並形成在該第一區域之一凹處,其中該凹處的一底部係由經表面精加工之該傳導材料所形成,以及將一積體電路(IC)封裝耦接至該中介件。
- 如請求項14之方法,其中該IC封裝具有一第一表面、與該第一表面相對的一第二表面、位在該IC封裝的該第二表面之一第二多個傳導接點、及位在該IC封裝的該第二表面之一組件,並且其中該等第二多個傳導接點係電氣耦接至該等第一多個傳導接點且該IC封裝係配置使得該組件延伸進入該凹處內,其具有面向該凹處的該底部之該組件的一面,該組件的該面藉由無任何元件設置於 其中之一間隙與該凹處的該底部隔開。
- 如請求項14之方法,其中該凹處具有介於50微米至300微米之間的一深度。
- 如請求項15之方法,其中該組件為一電容器,其具有大於0.5微法拉的一電容。
- 如請求項15之方法,其中該組件具有大於200微米之一高度。
- 如請求項14之方法,其中該IC封裝具有位在該IC封裝的該第一表面的一處理核心且該組件為用於該處理核心之一解耦電容器。
- 如請求項15之方法,其進一步包含提供一焊接材料與該等第一多個傳導接點中之一者實體接觸並且也與該等第二多個傳導接點中之一者實體接觸,以作為將該IC封裝耦接至該中介件的部分。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
WOPCT/US15/37808 | 2015-06-25 | ||
PCT/US2015/037808 WO2016209243A1 (en) | 2015-06-25 | 2015-06-25 | Integrated circuit structures with interposers having recesses |
Publications (2)
Publication Number | Publication Date |
---|---|
TW201701372A TW201701372A (zh) | 2017-01-01 |
TWI750115B true TWI750115B (zh) | 2021-12-21 |
Family
ID=57586161
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
TW105113095A TWI750115B (zh) | 2015-06-25 | 2016-04-27 | 帶著具有凹處之中介件的積體電路結構 |
Country Status (7)
Country | Link |
---|---|
US (1) | US20170170109A1 (zh) |
EP (1) | EP3314648A4 (zh) |
JP (1) | JP2018520507A (zh) |
KR (1) | KR102484173B1 (zh) |
CN (1) | CN107750388A (zh) |
TW (1) | TWI750115B (zh) |
WO (1) | WO2016209243A1 (zh) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN107646141A (zh) | 2015-06-25 | 2018-01-30 | 英特尔公司 | 用于堆叠封装的具有凹陷导电接触部的集成电路结构 |
US11550158B2 (en) | 2020-06-24 | 2023-01-10 | Meta Platforms Technologies, Llc | Artificial reality system having system-on-a-chip (SoC) integrated circuit components including stacked SRAM |
Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
TWI224486B (en) * | 1999-03-30 | 2004-11-21 | Ngk Spark Plug Co | Printed wiring substrate |
TW200908827A (en) * | 2007-05-07 | 2009-02-16 | Ngk Spark Plug Co | Wiring board with built-in component and method for manufacturing the same |
TW201005895A (en) * | 2008-02-22 | 2010-02-01 | Intel Corp | Integrated circuit package and method of manufacturing same |
TW201133769A (en) * | 2009-09-23 | 2011-10-01 | Stats Chippac Ltd | Semiconductor device and method of forming open cavity in TSV interposer to contain semiconductor die in WLCSMP |
TW201309123A (zh) * | 2011-08-05 | 2013-02-16 | Unimicron Technology Corp | 嵌埋有中介層之封裝基板及其製法 |
US20150156880A1 (en) * | 2013-11-29 | 2015-06-04 | Ibiden Co., Ltd. | Printed wiring board and method for manufacturing printed wiring board |
JP2015106610A (ja) * | 2013-11-29 | 2015-06-08 | イビデン株式会社 | 電子部品内蔵基板、電子部品内蔵基板の製造方法 |
Family Cites Families (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN100539106C (zh) * | 2000-09-25 | 2009-09-09 | 揖斐电株式会社 | 半导体元件及其制造方法、多层印刷布线板及其制造方法 |
US7271476B2 (en) | 2003-08-28 | 2007-09-18 | Kyocera Corporation | Wiring substrate for mounting semiconductor components |
KR20060026130A (ko) * | 2004-09-18 | 2006-03-23 | 삼성전기주식회사 | 칩패키지를 실장한 인쇄회로기판 및 그 제조방법 |
US7491567B2 (en) * | 2005-11-22 | 2009-02-17 | Honeywell International Inc. | MEMS device packaging methods |
US8338936B2 (en) * | 2008-07-24 | 2012-12-25 | Infineon Technologies Ag | Semiconductor device and manufacturing method |
JP2010219367A (ja) * | 2009-03-18 | 2010-09-30 | Sharp Corp | 有機プリント基板の製造方法及び有機プリント基板、並びに、有機プリント基板を用いた高周波モジュール |
US8558392B2 (en) * | 2010-05-14 | 2013-10-15 | Stats Chippac, Ltd. | Semiconductor device and method of forming interconnect structure and mounting semiconductor die in recessed encapsulant |
JP2012084799A (ja) * | 2010-10-14 | 2012-04-26 | Panasonic Corp | 電子回路 |
US9204552B2 (en) * | 2012-01-26 | 2015-12-01 | Ibiden Co., Ltd. | Printed wiring board |
JP2015072984A (ja) * | 2013-10-02 | 2015-04-16 | イビデン株式会社 | プリント配線板、プリント配線板の製造方法、パッケージ−オン−パッケージ |
US9620463B2 (en) * | 2015-02-27 | 2017-04-11 | Qualcomm Incorporated | Radio-frequency (RF) shielding in fan-out wafer level package (FOWLP) |
US9786623B2 (en) * | 2015-03-17 | 2017-10-10 | STATS ChipPAC Pte. Ltd. | Semiconductor device and method of forming PoP semiconductor device with RDL over top package |
CN107646141A (zh) * | 2015-06-25 | 2018-01-30 | 英特尔公司 | 用于堆叠封装的具有凹陷导电接触部的集成电路结构 |
-
2015
- 2015-06-25 EP EP15896530.1A patent/EP3314648A4/en not_active Ceased
- 2015-06-25 JP JP2017559635A patent/JP2018520507A/ja active Pending
- 2015-06-25 KR KR1020187002242A patent/KR102484173B1/ko active IP Right Grant
- 2015-06-25 CN CN201580081219.1A patent/CN107750388A/zh active Pending
- 2015-06-25 US US15/038,001 patent/US20170170109A1/en not_active Abandoned
- 2015-06-25 WO PCT/US2015/037808 patent/WO2016209243A1/en active Application Filing
-
2016
- 2016-04-27 TW TW105113095A patent/TWI750115B/zh active
Patent Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
TWI224486B (en) * | 1999-03-30 | 2004-11-21 | Ngk Spark Plug Co | Printed wiring substrate |
TW200908827A (en) * | 2007-05-07 | 2009-02-16 | Ngk Spark Plug Co | Wiring board with built-in component and method for manufacturing the same |
TW201005895A (en) * | 2008-02-22 | 2010-02-01 | Intel Corp | Integrated circuit package and method of manufacturing same |
TW201133769A (en) * | 2009-09-23 | 2011-10-01 | Stats Chippac Ltd | Semiconductor device and method of forming open cavity in TSV interposer to contain semiconductor die in WLCSMP |
TW201309123A (zh) * | 2011-08-05 | 2013-02-16 | Unimicron Technology Corp | 嵌埋有中介層之封裝基板及其製法 |
US20150156880A1 (en) * | 2013-11-29 | 2015-06-04 | Ibiden Co., Ltd. | Printed wiring board and method for manufacturing printed wiring board |
JP2015106610A (ja) * | 2013-11-29 | 2015-06-08 | イビデン株式会社 | 電子部品内蔵基板、電子部品内蔵基板の製造方法 |
Also Published As
Publication number | Publication date |
---|---|
US20170170109A1 (en) | 2017-06-15 |
WO2016209243A1 (en) | 2016-12-29 |
CN107750388A (zh) | 2018-03-02 |
JP2018520507A (ja) | 2018-07-26 |
KR102484173B1 (ko) | 2023-01-02 |
TW201701372A (zh) | 2017-01-01 |
KR20180020287A (ko) | 2018-02-27 |
EP3314648A1 (en) | 2018-05-02 |
EP3314648A4 (en) | 2019-01-09 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US10424561B2 (en) | Integrated circuit structures with recessed conductive contacts for package on package | |
JP6193415B2 (ja) | ビルドアップ層に埋め込まれたロジックダイ及びその他コンポーネント | |
TWI691043B (zh) | 帶有雙層介電結構之封裝體 | |
US9412625B2 (en) | Molded insulator in package assembly | |
JP2016535462A (ja) | ワイヤボンディングされたマルチダイスタックを有する集積回路パッケージ | |
TWI587495B (zh) | 關於電容感器(capductor)組合之技術與組態 | |
US9601421B2 (en) | BBUL material integration in-plane with embedded die for warpage control | |
US9936582B2 (en) | Integrated circuit assemblies with molding compound | |
TW201606955A (zh) | 可攀登之封裝體架構與相關聯技術及組態 | |
TW201703147A (zh) | 積體電路(ic)基體之選擇性金屬化技術 | |
TWI750115B (zh) | 帶著具有凹處之中介件的積體電路結構 | |
US10403604B2 (en) | Stacked package assembly with voltage reference plane | |
US20230187368A1 (en) | Hybrid semiconductor package for improved power integrity |