TWI578302B - 顯示裝置及其畫素驅動方法 - Google Patents

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Description

顯示裝置及其畫素驅動方法
本發明是有關於一種顯示技術，且特別是有關於一種顯示裝置及其畫素驅動方法。
由於液晶顯示裝置具有低耗電量、低輻射量及輕、薄、短、小的外型等的特性，漸漸成為現今人類生活中最重要的電子產品之一。並且，隨著科技的進步，液晶顯示裝置的畫面解析度不斷的提高，造成顯示裝置的電耗不斷的增加，因此如何降低顯示裝置的電力消耗且不影響畫面的顯示則成為一個重要的課題。
本發明提供一種顯示裝置及其畫素驅動方法，可降低顯示裝置的電力消耗。
本發明的顯示裝置，包括一源極驅動器、多條資料線及多個畫素。源極驅動器接收一極性信號與一畫面切換信號且具有多個資料通道。這些資料通道依據極性信號交錯地提供多個第一畫素電壓及多個第二畫素電壓，其中各個資料通道依據極性信號與畫面切換信號交替地輸出對應的第一畫素電壓及對應的第二畫素電壓，這些第一畫素電壓具有一第一驅動能力，並且這些第二畫素電壓具有一第二驅動能力。資料線耦接源極驅動器，用以接收這些第一畫素電壓及這些第二畫素電壓。畫素耦接這些資料線以接收對應的第一畫素電壓或對應的第二畫素電壓。
本發明的畫素的驅動方法，適用於耦接至一源極驅動器的多個畫素，且包括下列步驟。透過源極驅動器提供多個資料通道，以交錯地提供多個第一畫素電壓及多個第二畫素電壓，其中各個資料通道依據一極性信號及一畫面切換信號交替地輸出對應的第一畫素電壓及對應的第二畫素電壓，這些第一畫素電壓具有一第一驅動能力，並且這些第二畫素電壓具有一第二驅動能力；以及，提供多條資料線，以傳送這些第一畫素電壓及這些第二畫素電壓至這些畫素。
基於上述，本發明實施例的顯示裝置及其畫素驅動方法，其資料通道依據極性信號及畫面切換信號交替地輸出具有第一驅動能力的第一畫素電壓及具有第二驅動能力的第二畫素電壓至畫素。藉此，因此可避免寫入畫面的驅動能力形成落差，並且可降低畫面寫入的電力消耗。
為讓本發明的上述特徵和優點能更明顯易懂，下文特舉實施例，並配合所附圖式作詳細說明如下。
圖1A為依據本發明第一實施例的顯示裝置的系統示意圖。請參照圖1，在本實施例中，顯示裝置100包括源極驅動器110及顯示面板120。源極驅動器110接收資料信號XDD、極性信號XPOL、畫面切換信號XFS及閂鎖信號XSTB，以提供第一驅動能力的多個第一畫素電壓VP1，並且提供具有第二驅動能力的多個第二畫素電壓VP2至顯示面板120。其中，第一畫素電壓VP1可以是大於共同電壓的畫素電壓，第二畫素電壓VP2可以是小於共同電壓的畫素電壓，並且第一驅動能力例如小於第二驅動能力。
在本實施例中，畫面切換信號XFS用以表示畫面期間的切換，亦即畫面切換信號XFS可以是垂直空白信號，但本發明實施例不以此為限。並且，源極驅動器110是依據一行反轉(Column inversion)驅動方式產生第一畫素電壓VP1及第二畫素電壓VP2，亦即第一畫素電壓VP1及第二畫素電壓VP2是交錯輸出，並且在一畫面期間中，各個輸出端點會維持輸出第一畫素電壓VP1或第二畫素電壓VP2。
源極驅動器110包括移位暫存器111、多個資料通道(如113_1~113_4)、第一驅動能力設定單元115。移位暫存器111接收資料信號XDD，以提供多個顯示資料XDP至資料通道(如113_1~113_4)。資料通道(如113_1~113_4)接收極性信號XPOL、畫面切換信號XFS及閂鎖信號XSTB，並且依據極性信號XPOL交錯地提供第一畫素電壓VP1及第二畫素電壓VP2，亦即兩相鄰資料通道(如113_1~113_4)分別提供第一畫素電壓VP1及第二畫素電壓VP2。並且，各個資料通道(如113_1~113_4)依據閂鎖信號XSTB決定是否轉換所接收的顯示資料XDP，並且各個資料通道(如113_1~113_4)依據極性信號XPOL、畫面切換信號XFS交替地輸出對應的第一畫素電壓VP1及對應的第二畫素電壓VP2。換言之，在一畫面期間，各個資料通道(如113_1~113_4)提供對應的第一畫素電壓VP1；在下一畫面期間，各個資料通道(如113_1~113_4)提供對應的第二畫素電壓VP2。
第一驅動能力設定單元115耦接資料通道(如113_1~113_4)，且接收極性信號XPOL、畫面切換信號XFS及閂鎖信號XSTB，以提供第一偏壓VB1及第二偏壓VB2至資料通道(如113_1~113_4)，其中第一偏壓VB1用以設定第一畫素電壓VP1具有第一驅動能力，第二偏壓VB2用以設定第二畫素電壓VP2具有第二驅動能力。
進一步來說，第一驅動能力設定單元115包括第一偏壓電路117、第二偏壓電路119及多個第一電壓傳送電路(如VSC11、VSC12)。第一偏壓電路117用以提供第一偏壓VB1。第二偏壓電路119用以提供第二偏壓VB2。第一電壓傳送電路(如VSC11、VSC12)接收極性信號XPOL、及閂鎖信號XSTB及畫面切換信號XFS，並且分別耦接於第一偏壓電路117、第二偏壓電路119與兩相鄰資料通道(如113_1~113_4)之間。各個第一電壓傳送電路(如VSC11、VSC12)依據極性信號XPOL、及閂鎖信號XSTB及畫面切換信號XFS將第一偏壓VB及第二偏壓VB2分別傳送至兩相鄰的資料通道(如113_1~113_4)。
顯示面板120包括多條資料線(如121_1~121_5)及多個畫素(如紅色畫素PR、綠色畫素PG及藍色畫素PB)。資料線(如121_1~121_5)耦接源極驅動器110，用以接收第一畫素電壓VP1及第二畫素電壓VP2。畫素(如PR、PG及PB)耦接資料線(如121_1~121_5)以接收對應的第一畫素電壓VP1或對應的第二畫素電壓VP2。在本實施例中，畫素(如PR、PG及PB)與資料線(如121_1~121_5）的耦接結構為Z型畫素配置，亦即各個資料線（如121_1~121_5）所耦接的畫素（如PR、PG及PB）位於相鄰的兩行畫素中，並且各個資料線（如121_1~121_5）所對應的畫素（如PR、PG及PB）位於不同列且彼此不相鄰。
舉例來說，在第一畫面期間中，資料通道（如113_1~113_4）依據極性信號XPOL及畫面切換信號XFS透過資料線（如121_1~121_5）中的偶數資料線（如121_2、121_4，對應第一資料線）分別提供第一畫素電壓VP1至畫素（如PR、PG及PB），並且資料通道（如113_1~113_4）依據極性信號XPOL及畫面切換信號XFS透過資料線（如121_1~121_5）中的奇數資料線（如121_1、121_3、121_5，對應第二資料線）分別提供第二畫素電壓VP2至畫素（如PR、PG及PB）；在第一畫面期間之後的一第二畫面期間中，資料通道（如113_1~113_4）依據極性信號XPOL及畫面切換信號XFS透過偶數資料線（如121_2、121_4）分別提供第二畫素電壓VP2至畫素（如PR、PG及PB），資料通道（如113_1~113_4）依據極性信號XPOL及畫面切換信號XFS透過奇數資料線（如121_1、121_3、121_5）分別提供第一畫素電壓VP1至畫素（如PR、PG及PB）。依據上述，本發明實施例的第一資料線是不同於第二資料線。
在本發明的實施例中，顯示裝置100可更包括時序控制器（未繪示）及閘極驅動器（未繪示），並且顯示面板120可更包括掃描線。其中，掃描線耦接閘極驅動器及對應的畫素（如PR、PG及PB），以逐列驅動畫素（如PR、PG及PB），並且閘極驅動器受控於時序控制器提供閘極信號至掃描線，以及源極驅動器110受控於時序控制器提供第一畫素電壓VP1或對應的第二畫素電壓VP2至資料線（如121_1~121_5），亦即時序控制器可提供資料信號XDD、極性信號XPOL、畫面切換信號XFS及閂鎖信號XSTB至源極驅動器110。
圖1B至圖1D為依據本發明第一實施例的顯示面板的驅動示意圖。請參照圖1A至圖1D，在本實施例中，假設紅色畫面、綠色畫面及藍色畫面為分時寫入，並且為正極性的第一畫素電壓VP1是具有較低的第一驅動能力A1（例如為62.5%的驅動能力），為負極性的第二畫素電壓VP2是具有較高的第二驅動能力A2（例如為100%的驅動能力）。
請參照圖1B，在顯示紅色畫面時，紅色畫素PR會被寫入對應的畫素電壓（如第一畫素電壓VP1或第二畫素電壓VP2），而其餘畫素（如綠色畫素PG及藍色畫素PB）則被寫入黑色資料（亦即對應灰階值0的畫素電壓）。進一步來說，奇數資料線（如121_1、121_3、121_5）例如接收對應的第二畫素電壓VP2，資料線121_1、121_3、121_5的驅動波形如V11、V13、V15所示，並且偶數資料線（如121_2、121_4）例如接收對應的第一畫素電壓VP1，資料線121_1、121_3、121_5的驅動波形如V12、V14所示。
請參照圖1C，在顯示綠色畫面時，綠色畫素PG會被寫入對應的畫素電壓（如第一畫素電壓VP1或第二畫素電壓VP2），而其餘畫素（如紅色畫素PR及藍色畫素PB）則被寫入黑色資料。並且，奇數資料線121_1、121_3、121_5的驅動波形如V21、V23、V25所示，並且偶數資料線121_1、121_3、121_5的驅動波形如V22、V24所示。
請參照圖1D，在顯示藍色畫面時，藍色畫素PB會被寫入對應的畫素電壓（如第一畫素電壓VP1或第二畫素電壓VP2），而其餘畫素（如紅色畫素PR及綠色畫素PG）則被寫入黑色資料。並且，奇數資料線121_1、121_3、121_5的驅動波形如V31、V33、V35所示，並且偶數資料線121_1、121_3、121_5的驅動波形如V32、V34所示。
依據上述，寫入紅色畫面、綠色畫面及藍色畫面時皆會使用到第一畫素電壓VP1及第二畫素電壓VP2，亦即寫入紅色畫面、綠色畫面及藍色畫面的驅動能力會大致相同，因此可避免驅動能力的落差影響畫面的顯示。並且，寫入紅色畫面、綠色畫面及藍色畫面時皆會使用到具有較低驅動能力的第一畫素電壓VP1，因此可降低畫面寫入的電力消耗。
此外，在某些實施例中，資料通道（如113_1~113_4）的形態是會影響畫素電壓（如第一畫素電壓VP1及第二畫素電壓VP2）的電氣特性。舉例來說，當資料通道（如113_1~113_4）是由NMOS電晶體所構成時，第一畫素電壓VP1（在此為大於共同電壓的畫素電壓）的上升時間為0.96微秒（μs），下降時間為1.22微秒，第二畫素電壓VP2（在此為小於共同電壓的畫素電壓）的上升時間為1.28微秒（μs），下降時間為0.98微秒。參照上述，第一畫素電壓VP1及第二畫素電壓VP2的上升時間（亦即充電能力）是不同的，因此可透過驅動能力的調整，使得第一畫素電壓VP1及第二畫素電壓VP2的充電能力大致相同，以避免畫面閃爍的情況，進而提升畫面品質。
圖2A為依據本發明第二實施例的顯示裝置的系統示意圖。請參照圖1A及圖2A，在本實施例中，顯示裝置200大致相同於顯示裝置100，其不同之處在於顯示面板210。在本實施例中，顯示面板210包括多條資料線（如211_1~211_5）及多個畫素（如備用畫素PD、紅色畫素PR、綠色畫素PG及藍色畫素PB）。資料線（如211_1~211_5）耦接源極驅動器110，用以接收第一畫素電壓VP1及第二畫素電壓VP2。畫素（如PD、PR、PG及PB）耦接資料線（如211_1~211_5）以接收對應的第一畫素電壓VP1或對應的第二畫素電壓VP2。
在本實施例中，畫素（如PD、PR、PG及PB）與資料線（如121_1~121_5）的耦接結構為類Z型畫素配置，亦即各個資料線（如121_1~121_5）所耦接的畫素（如PD、PR、PG及PB）位於相鄰的四行畫素中。並且，各個資料線（如121_1~121_5）所對應的畫素（如PD、PR、PG及PB）中位於不同列的畫素（如PD、PR、PG及PB）是彼此不相鄰，各個資料線（如121_1~121_5）所對應的畫素（如PD、PR、PG及PB）中位於同列的畫素（如PD、PR、PG及PB）是彼此相鄰。
圖2B至圖2D為依據本發明第二實施例的顯示面板的驅動示意圖。請參照圖2A至圖2D，在本實施例中，同樣假設紅色畫面、綠色畫面及藍色畫面為分時寫入，並且為正極性的第一畫素電壓VP1是具有較低的第一驅動能力A1（例如為62.5%的驅動能力），為負極性的第二畫素電壓VP2是具有較高的第二驅動能力A2（例如為100%的驅動能力）。
請參照圖2B，在顯示紅色畫面時，紅色畫素PR會被寫入對應的畫素電壓（如第一畫素電壓VP1或第二畫素電壓VP2），而其餘畫素（如備用畫素PD、綠色畫素PG及藍色畫素PB）則被寫入黑色資料。進一步來說，奇數資料線（如211_1、211_3、211_5）例如接收對應的第二畫素電壓VP2，資料線211_1、211_3、211_5的驅動波形如V41、V43、V45所示，並且偶數資料線（如211_2、211_4）例如接收對應的第一畫素電壓VP1，資料線211_1、211_3、211_5的驅動波形如V42、V44所示。
請參照圖2C，在顯示綠色畫面時，綠色畫素PG會被寫入對應的畫素電壓（如第一畫素電壓VP1或第二畫素電壓VP2），而其餘畫素（如備用畫素PD、紅色畫素PR及藍色畫素PB）則被寫入黑色資料。並且，奇數資料線211_1、211_3、211_5的驅動波形如V51、V53、V55所示，並且偶數資料線211_1、211_3、211_5的驅動波形如V52、V54所示。
請參照圖2D，在顯示藍色畫面時，藍色畫素PB會被寫入對應的畫素電壓（如第一畫素電壓VP1或第二畫素電壓VP2），而其餘畫素（如備用畫素PD、紅色畫素PR及綠色畫素PG）則被寫入黑色資料。並且，奇數資料線211_1、211_3、211_5的驅動波形如V61、V63、V65所示，並且偶數資料線211_1、211_3、211_5的驅動波形如V62、V64所示。
依據上述，在類Z型畫素配置中，寫入紅色畫面、綠色畫面及藍色畫面時皆會使用到第一畫素電壓VP1及第二畫素電壓VP2，亦即寫入紅色畫面、綠色畫面及藍色畫面的驅動能力會大致相同。
圖3為依據本發明第三實施例的顯示裝置的系統示意圖。請參照圖1A及圖3，在本實施例中，顯示裝置300大致相同於顯示裝置100，其不同之處在於源極驅動器310的第二驅動能力設定單元311。在本實施例中，第二驅動能力設定單元311耦接資料通道（如113_1~113_4）且接收畫面率指令XCF、畫面切換信號XFS、極性信號XPOL及閂鎖信號XSTB，以提供第三偏壓VB3及第四偏壓VB4至資料通道（如113_1~113_4），其中第三偏壓VB3及第四偏壓VB4用以設定第一驅動能力及第二驅動能力，並且畫面率指令XCF可以是英偉達（NVIDIA）公司所定義的G-SYNC信號或超微半導體（AMD）公司所定義的FreeSync信號，但本發明實施例不以此為限。
當畫面率指令XCF設定顯示裝置300處於該高畫面率模式時（亦即顯示裝置300的畫面率大於等於120赫芝），第二驅動能力設定單元311將第三偏壓VB3及第四偏壓VB4傳送至資料通道(如113_1~113_4)，以設定第一畫素電壓VP1的第一驅動能力小於第二畫素電壓VP2的第二驅動能力；反之，當畫面率指令XCF設定顯示裝置300處非於該高畫面率模式時(亦即顯示裝置300的畫面率小於120赫芝)，第二驅動能力設定單元311將第三偏壓VB3及第四偏壓VB4的其中之一傳送至資料通道(如113_1~113_4)，以設定第一畫素電壓VP1的第一驅動能力等於第二畫素電壓VP2的第二驅動能力。
進一步來說，第二驅動能力設定單元311包括第三偏壓電路313、第四偏壓電路315及多個第二電壓傳送電路(如VSC21、VSC22)。第三偏壓電路313用以提供第三偏壓VB3。第四偏壓電路315用以提供第四偏壓VB4。第二電壓傳送電路(如VSC21、VSC22)接收極性信號XPOL、畫面率指令XCF、閂鎖信號XSTB、及畫面切換信號XFS，並且分別耦接於第三偏壓電路313、第四偏壓電路315與兩相鄰資料通道(如113_1~113_4)之間。當畫面率指令XCF設定顯示裝置300的畫面率大於等於120赫芝時，各個第二電壓傳送電路(如VSC21、VSC22)依據極性信號XPOL、及閂鎖信號XSTB及畫面切換信號XFS將第三偏壓VB3及第四偏壓VB4分別傳送至兩相鄰的資料通道(如113_1~113_4)；反之，當畫面率指令XCF設定顯示裝置300的畫面率小於120赫芝時，第二電壓傳送電路(如VSC21、VSC22)共同地將第三偏壓VB3及第四偏壓VB4的其中之一傳送至資料通道(如113_1~113_4)。
圖4為依據本發明第四實施例的顯示裝置的系統示意圖。
請參照圖2A、圖3及圖4，在本實施例中，顯示裝置400包括源極驅動器310及顯示面板210，其中顯示面板210可參照圖2A實施例所述，源極驅動器310可參照圖3實施例所述，在此則不再贅述。
圖5為依據本發明一實施例的資料通道的系統示意圖。請參照圖1A、圖2A、圖3、圖4及圖5，在本實施例中，資料通道113_1~113_4可以如資料通道500所示，並且資料通道500包括閂鎖器510、準位移位器(level shifter)520、數位類比轉換器530及輸出緩衝器540。閂鎖器510接收並閂鎖顯示資料XDP，且接收閂鎖信號XSTB以輸出閂鎖顯示資料XLDP。
準位移位器520耦接閂鎖器510，以依據閂鎖顯示資料XLDP提供待轉換顯示資料XTDP。數位類比轉換器530耦接準位移位器520且接收多個伽瑪電壓VGM及極性信號XPOL，用以將待轉換顯示資料STDP轉換為畫素參考電壓VPRX。輸出緩衝器540耦接數位類比轉換器530，且接收畫素參考電壓VPRX、極性信號XPOL，以提供第一畫素電壓VP1或第二畫素電壓VP2。
當輸出緩衝器540耦接第一驅動能力設定單元115時，輸出緩衝器540會接收到第一偏壓VB1或第二偏壓VB2；當輸出緩衝器540耦接第二驅動能力設定單元311時，輸出緩衝器540會接收到第三偏壓VB3或第四偏壓VB4。當輸出緩衝器540接收第一偏壓VB1及第三偏壓VB3時，輸出緩衝器VB1提供具有第一驅動能力的第一畫素電壓VP1；當輸出緩衝器540接收第二偏壓VB2及第四偏壓VB4時，輸出緩衝器540提供具有第二驅動能力的第二畫素電壓VP2。
圖6為依據本發明一實施例的顯示面板的電路示意圖。請參照圖1A及圖6，在本實施例中，顯示面板600大致相同於顯示面板120，其不同之處在於顯示面板600更包括多個多工器（如MX1、MX2）。各個多工器（如MX1、MX2）耦接於對應的資料通道（如113_1~113_4）與對應的資料線（如121_1~121_5）之間，用以將第一畫素電壓VP1及第二畫素電壓VP2依序傳送至對應的資料線（如121_1~121_5），其中些多工器（如MX1、MX2）分別由多個電晶體所構成。
圖7為依據本發明一實施例的畫素的驅動方法的流程圖。請參照圖7，在本實施例中，畫素的驅動方法包括下列步驟。首先，透過源極驅動器提供多個資料通道，以交錯地提供多個第一畫素電壓及多個第二畫素電壓，其中各個資料通道依據一極性信號及一畫面切換信號交替地輸出對應的第一畫素電壓及對應的第二畫素電壓，這些第一畫素電壓具有一第一驅動能力，並且這些第二畫素電壓具有一第二驅動能力（步驟S710）。接著，提供多條資料線，以傳送這些第一畫素電壓及這些第二畫素電壓至這些畫素（步驟S720）。其中，步驟S710及S720的順序為用以說明，本發明實施例不以此為限。並且，步驟S710及S720的細節可參照圖1A至圖1D、圖2A至圖2D、圖3至圖6實施例所述，在此則不再贅述。
綜上所述，本發明實施例的顯示裝置及其畫素驅動方法，其資料通道依據極性信號及畫面切換信號交替地輸出具有第一驅動能力的第一畫素電壓及具有第二驅動能力的第二畫素電壓至為Z型畫素配置的顯示面板。藉此，因此可避免寫入畫面的驅動能力落差造成影像品質不佳的問題，並且可降低畫面寫入的電力消耗。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何所屬技術領域中具有通常知識者，在不脫離本發明的精神和範圍內，當可作些許的更動與潤飾，故本發明的保護範圍當視後附的申請專利範圍所界定者為準。
100、200、300、400‧‧‧顯示裝置
110、310‧‧‧源極驅動器
111‧‧‧移位暫存器
113_1~113_4、500‧‧‧資料通道
115‧‧‧第一驅動能力設定單元
117‧‧‧第一偏壓電路
119‧‧‧第二偏壓電路
120、210、600‧‧‧顯示面板
121_1~121_5、211_1~211_5‧‧‧資料線
311‧‧‧第二驅動能力設定單元
313‧‧‧第三偏壓電路
315‧‧‧第四偏壓電路
510‧‧‧閂鎖器
520‧‧‧準位移位器
530‧‧‧數位類比轉換器
540‧‧‧輸出緩衝器
A1‧‧‧第一驅動能力
A2‧‧‧第二驅動能力
MX1、MX2‧‧‧多工器
PB‧‧‧藍色畫素
PD‧‧‧備用畫素
PG‧‧‧綠色畫素
PR‧‧‧紅色畫素
V11~V15、V21~V25、V31~V35、V41~V45、V51~V55、V61~V65‧‧‧驅動波形
VB1‧‧‧第一偏壓
VB2‧‧‧第二偏壓
VB3‧‧‧第三偏壓
VB4‧‧‧第四偏壓
VGM‧‧‧伽瑪電壓
VP1‧‧‧第一畫素電壓
VP2‧‧‧第二畫素電壓
VPRX‧‧‧畫素參考電壓
VSC11、VSC12‧‧‧第一電壓傳送電路
VSC21、VSC22‧‧‧第二電壓傳送電路
XCF‧‧‧畫面率指令
XDD‧‧‧資料信號
XDP‧‧‧顯示資料
XFS‧‧‧畫面切換信號
XLDP‧‧‧閂鎖顯示資料
XPOL‧‧‧極性信號
XSTB‧‧‧閂鎖信號
XTDP‧‧‧待轉換顯示資料
S710、S720‧‧‧步驟
圖1A為依據本發明第一實施例的顯示裝置的系統示意圖。 圖1B至圖1D為依據本發明第一實施例的顯示面板的驅動示意圖。 圖2A為依據本發明第二實施例的顯示裝置的系統示意圖。 圖2B至圖2D為依據本發明第二實施例的顯示面板的驅動示意圖。 圖3為依據本發明第三實施例的顯示裝置的系統示意圖。 圖4為依據本發明第四實施例的顯示裝置的系統示意圖。 圖5為依據本發明一實施例的資料通道的系統示意圖。 圖6為依據本發明一實施例的顯示面板的電路示意圖。 圖7為依據本發明一實施例的畫素的驅動方法的流程圖。
100‧‧‧顯示裝置
110‧‧‧源極驅動器
111‧‧‧移位暫存器
113_1~113_4‧‧‧資料通道
115‧‧‧第一驅動能力設定單元
117‧‧‧第一偏壓電路
119‧‧‧第二偏壓電路
120‧‧‧顯示面板
121_1~121_5‧‧‧資料線
PB‧‧‧藍色畫素
PG‧‧‧綠色畫素
PR‧‧‧紅色畫素
VB1‧‧‧第一偏壓
VB2‧‧‧第二偏壓
VP1‧‧‧第一畫素電壓
VP2‧‧‧第二畫素電壓
VSC11、VSC12‧‧‧第一電壓傳送電路
XDD‧‧‧資料信號
XDP‧‧‧顯示資料
XFS‧‧‧畫面切換信號
XPOL‧‧‧極性信號
XSTB‧‧‧閂鎖信號

Claims (19)

  1. 一種顯示裝置，包括：一源極驅動器，接收一極性信號與一畫面切換信號且具有多個資料通道，該些資料通道依據該極性信號交錯地提供多個第一畫素電壓及多個第二畫素電壓，其中各該些資料通道依據該極性信號與該畫面切換信號交替地輸出對應的第一畫素電壓及對應的第二畫素電壓，該些第一畫素電壓具有一第一驅動能力，並且該些第二畫素電壓具有一第二驅動能力；多條資料線，耦接該源極驅動器，用以接收該些第一畫素電壓及該些第二畫素電壓；以及多個畫素，耦接該些資料線以接收對應的第一畫素電壓或對應的第二畫素電壓；其中，在同一畫面期間中，該些第一畫素電壓大於一共同電壓，該些第二畫素電壓小於該共同電壓，並且該第一驅動能力小於該第二驅動能力。
  2. 如申請專利範圍第1項所述的顯示裝置，其中該源極驅動器更包括：一第一驅動能力設定單元，耦接該些資料通道，且接收該極性信號、該畫面切換信號及一閂鎖信號，以提供一第一偏壓及一第二偏壓至該些資料通道，其中該第一偏壓用以設定該些第一畫素電壓具有該第一驅動能力，該第二偏壓用以設定該些第二畫素電壓具有一第二驅動能力。
  3. 如申請專利範圍第2項所述的顯示裝置，其中該第一驅動能力設定單元包括：一第一偏壓電路，用以提供該第一偏壓；一第二偏壓電路，用以提供該第二偏壓；以及多個第一電壓傳送電路，接收該極性信號及該畫面切換信號，耦接該第一偏壓電路及該第二偏壓電路及該些資料通道，各該些第一電壓傳送電路依據該極性信號、該畫面切換信號及該閂鎖信號將該第一偏壓及該第二偏壓分別傳送至兩相鄰的資料通道。
  4. 如申請專利範圍第2項所述的顯示裝置，其中各該些資料通道包括：一閂鎖器，接收並閂鎖一顯示資料，且接收該閂鎖信號以輸出一閂鎖顯示資料；一準位移位器(level shifter)，耦接該閂鎖器，以依據該閂鎖顯示資料提供一待轉換顯示資料；一數位類比轉換器，耦接該準位移位器且接收多個伽瑪電壓及該極性信號，用以將該待轉換顯示資料轉換為一畫素參考電壓；以及一輸出緩衝器，耦接該數位類比轉換器及該第一驅動能力設定單元，且接收該畫素參考電壓、該極性信號，以提供該第一畫素電壓或該第二畫素電壓，當該輸出緩衝器接收該第一偏壓時，該輸出緩衝器提供具有該第一驅動能力的該第一畫素電壓，當該 輸出緩衝器接收該第二偏壓時，該輸出緩衝器提供具有該第二驅動能力的該第二畫素電壓。
  5. 如申請專利範圍第1項所述的顯示裝置，其中該些第一畫素電壓大於一共同電壓，該些第二畫素電壓小於該共同電壓，並且當該顯示裝置的畫面率大於等於120赫芝時，該第一驅動能力小於該第二驅動能力，當該顯示裝置的畫面率小於120赫芝時，該第一驅動能力等於該第二驅動能力。
  6. 如申請專利範圍第5項所述的顯示裝置，其中該源極驅動器更包括：一第二驅動能力設定單元，耦接該些資料通道，且接收一畫面率指令、該畫面切換信號、該極性信號及一閂鎖信號，以提供一第三偏壓及一第四偏壓，當該畫面率指令設定該顯示裝置的畫面率大於等於120赫芝時，該第三偏壓及該第四偏壓傳送至該些資料通道以設定該些第一畫素電壓的該第一驅動能力小於該些第二畫素電壓的該第二驅動能力，當該畫面率指令設定該顯示裝置的畫面率小於120赫芝時，該第三偏壓及該第四偏壓的其中之一傳送至該些資料通道以設定該些第一畫素電壓的該第一驅動能力等於該些第二畫素電壓的該第二驅動能力。
  7. 如申請專利範圍第6項所述的顯示裝置，其中第二驅動能力設定單元包括：一第三偏壓電路，用以提供該第三偏壓；一第四偏壓電路，用以提供該第四偏壓；以及 多個第二電壓傳送電路，耦接該第三偏壓電路及該第四偏壓電路及該些資料通道，當該畫面率指令設定該顯示裝置的畫面率大於等於120赫芝時，各該些第二電壓傳送電路依據該極性信號、該畫面切換信號及該閂鎖信號將該第三偏壓及該第四偏壓分別傳送至兩相鄰的資料通道，當該畫面率指令設定該顯示裝置的畫面率小於120赫芝時，該些第二電壓傳送電路將該第三偏壓及該第四偏壓的其中之一傳送至該些資料通道。
  8. 如申請專利範圍第6項所述的顯示裝置，其中各該些資料通道包括：一閂鎖器，接收並閂鎖一顯示資料，且接收該閂鎖信號以輸出一閂鎖顯示資料；一準位移位器(level shifter)，耦接該閂鎖器，以依據該閂鎖顯示資料提供一待轉換顯示資料；一數位類比轉換器，耦接該準位移位器且接收多個伽瑪電壓及該極性信號，用以將該待轉換顯示資料轉換為一畫素參考電壓；以及一輸出緩衝器，耦接該數位類比轉換器及該第二驅動能力設定單元，且接收該畫素參考電壓、該極性信號，以提供該第一畫素電壓或該第二畫素電壓，當該輸出緩衝器接收該第三偏壓時，該輸出緩衝器提供具有該第一驅動能力的該第一畫素電壓，當該輸出緩衝器接收該第四偏壓時，該輸出緩衝器提供具有該第二驅動能力的該第二畫素電壓。
  9. 如申請專利範圍第1項所述的顯示裝置，其中在一第一畫面期間中，該些資料通道依據該極性信號及該畫面切換信號透過該些資料線中的多個第一資料線分別提供該些第一畫素電壓至該些畫素，該些資料通道依據該極性信號及該畫面切換信號透過該些資料線中的多個第二資料線分別提供該些第二畫素電壓至該些畫素，在該第一畫面期間之後的一第二畫面期間中，該些資料通道依據該極性信號及該畫面切換信號透過該些第一資料線分別提供該些第二畫素電壓至該些畫素，該些資料通道依據該極性信號及該畫面切換信號透過該些第二資料線分別提供該些第一畫素電壓至該些畫素，其中該些第一資料線不同於該些第二資料線。
  10. 如申請專利範圍第9項所述的顯示裝置，其中該些第一資料線及該些第二資料線分別為多個奇數資料線及多個偶數資料線。
  11. 如申請專利範圍第1項所述的顯示裝置，其中各該些資料線所耦接的該些畫素位於兩行畫素中，該些資料線所對應的該些畫素位於不同列且彼此不相鄰。
  12. 如申請專利範圍第1項所述的顯示裝置，其中各該些資料線所耦接的該些畫素位於四行畫素中，該些資料線所對應的該些畫素中位於同列的該些畫素彼此相鄰，該些資料線所對應的該些畫素中位於不同列的該些畫素彼此不相鄰。
  13. 如申請專利範圍第1項所述的顯示裝置，更包括多個多工器，耦接於該些資料通道與該些資料線之間，用以將該些第 一畫素電壓及該些第二畫素電壓傳送至該些資料線，其中該些多工器分別由多個電晶體所構成。
  14. 一種畫素的驅動方法，適用於耦接至一源極驅動器的多個畫素，包括：透過該源極驅動器提供多個資料通道，以交錯地提供多個第一畫素電壓及多個第二畫素電壓，其中各該些資料通道依據一極性信號及一畫面切換信號交替地輸出對應的第一畫素電壓及對應的第二畫素電壓，該些第一畫素電壓具有一第一驅動能力，並且該些第二畫素電壓具有一第二驅動能力；以及提供多條資料線，以傳送該些第一畫素電壓及該些第二畫素電壓至該些畫素；其中，在同一畫面期間中，該些第一畫素電壓大於一共同電壓，該些第二畫素電壓小於該共同電壓，並且該第一驅動能力小於該第二驅動能力。
  15. 如申請專利範圍第14項所述的畫素的驅動方法，其中該些第一畫素電壓大於一共同電壓，該些第二畫素電壓小於該共同電壓，並且當該顯示裝置的畫面率大於等於120赫芝時，該第一驅動能力小於該第二驅動能力，當該顯示裝置的畫面率小於120赫芝時，該第一驅動能力等於該第二驅動能力。
  16. 如申請專利範圍第14項所述的畫素的驅動方法，其中“提供該些資料線，以傳送該些第一畫素電壓及該些第二畫素電壓至該些畫素”的步驟包括： 在一第一畫面期間中，該些資料通道依據該極性信號及該畫面切換信號透過該些資料線中的多個第一資料線分別提供該些第一畫素電壓至該些畫素，該些資料通道依據該極性信號及該畫面切換信號透過該些資料線中的多個第二資料線分別提供該些第二畫素電壓至該些畫素；以及在該第一畫面期間之後的一第二畫面期間中，該些資料通道依據該極性信號及該畫面切換信號透過該些第一資料線分別提供該些第二畫素電壓至該些畫素，該些資料通道依據該極性信號及該畫面切換信號透過該些第二資料線分別提供該些第一畫素電壓至該些畫素，其中該些第一資料線不同於該些第二資料線。
  17. 如申請專利範圍第16項所述的畫素的驅動方法，其中該些第一資料線及該些第二資料線分別為多個奇數資料線及多個偶數資料線。
  18. 如申請專利範圍第14項所述的畫素的驅動方法，其中各該些資料線所耦接的該些畫素位於兩行畫素中，該些資料線所對應的該些畫素位於不同列且彼此不相鄰。
  19. 如申請專利範圍第14項所述的畫素的驅動方法，其中各該些資料線所耦接的該些畫素位於四行畫素中，該些資料線所對應的該些畫素中位於同列的該些畫素彼此相鄰，該些資料線所對應的該些畫素中位於不同列的該些畫素彼此不相鄰。
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