CN105390105B - 显示装置及其像素驱动方法 - Google Patents

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Abstract

一种显示装置及其像素驱动方法。显示装置包括一源极驱动器、多条数据线及多个像素。源极驱动器接收一极性信号与一画面切换信号且具有多个数据通道。该多个数据通道依据极性信号交错地提供多个具有一第一驱动能力的第一像素电压及多个具有一第二驱动能力的第二像素电压。各个数据通道依据极性信号与画面切换信号交替地输出对应的第一像素电压及对应的第二像素电压。数据线耦接源极驱动器，用以接收该多个第一像素电压及该多个第二像素电压。像素耦接该多个数据线以接收对应的第一像素电压或对应的第二像素电压。

Description

显示装置及其像素驱动方法
【技术领域】
本发明是有关于一种显示技术，且特别是有关于一种显示装置及其像素驱动方法。
【背景技术】
由于液晶显示装置具有低耗电量、低辐射量及轻、薄、短、小的外型等的特性，渐渐成为现今人类生活中最重要的电子产品的一。并且，随着科技的进步，液晶显示装置的画面解析度不断的提高，造成显示装置的电耗不断的增加，因此如何降低显示装置的电力消耗且不影响画面的显示则成为一个重要的课题。
【发明内容】
本发明提供一种显示装置及其像素驱动方法，可降低显示装置的电力消耗。
本发明的显示装置，包括一源极驱动器、多条数据线及多个像素。源极驱动器接收一极性信号与一画面切换信号且具有多个数据通道。该多个数据通道依据极性信号交错地提供多个第一像素电压及多个第二像素电压，其中，各个数据通道依据极性信号与画面切换信号交替地输出对应的第一像素电压及对应的第二像素电压，该多个第一像素电压具有一第一驱动能力，并且该多个第二像素电压具有一第二驱动能力。数据线耦接源极驱动器，用以接收该多个第一像素电压及该多个第二像素电压。像素耦接该多个数据线以接收对应的第一像素电压或对应的第二像素电压。
本发明的像素的驱动方法，适用于耦接至一源极驱动器的多个像素，且包括下列步骤。通过源极驱动器提供多个数据通道，以交错地提供多个第一像素电压及多个第二像素电压，其中，各个数据通道依据一极性信号及一画面切换信号交替地输出对应的第一像素电压及对应的第二像素电压，该多个第一像素电压具有一第一驱动能力，并且该多个第二像素电压具有一第二驱动能力；以及，提供多条数据线，以传送该多个第一像素电压及该多个第二像素电压至该多个像素。
基于上述，本发明实施例的显示装置及其像素驱动方法，其数据通道依据极性信号及画面切换信号交替地输出具有第一驱动能力的第一像素电压及具有第二驱动能力的第二像素电压至像素。借此，因此可避免写入画面的驱动能力形成落差，并且可降低画面写入的电力消耗。
为让本发明的上述特征和优点能更明显易懂，下文特举实施例，并配合所附图式作详细说明如下。
【附图说明】
图1A为依据本发明第一实施例的显示装置的系统示意图。
图1B至图1D为依据本发明第一实施例的显示面板的驱动示意图。
图2A为依据本发明第二实施例的显示装置的系统示意图。
图2B至图2D为依据本发明第二实施例的显示面板的驱动示意图。
图3为依据本发明第三实施例的显示装置的系统示意图。
图4为依据本发明第四实施例的显示装置的系统示意图。
图5为依据本发明一实施例的数据通道的系统示意图。
图6为依据本发明一实施例的显示面板的电路示意图。
图7为依据本发明一实施例的像素的驱动方法的流程图。
【符号说明】
100、200、300、400：显示装置
110、310：源极驱动器
111：移位寄存器
113_1～113_4、500：数据通道
115：第一驱动能力设定单元
117：第一偏压电路
119：第二偏压电路
120、210、600：显示面板
121_1～121_5、211_1～211_5：数据线
311：第二驱动能力设定单元
313：第三偏压电路
315：第四偏压电路
510：闩锁器
520：电位移位器
530：数字模拟转换器
540：输出缓冲器
A1：第一驱动能力
A2：第二驱动能力
MX1、MX2：多工器
PB：蓝色像素
PD：备用像素
PG：绿色像素
PR：红色像素
V11～V15、V21～V25、V31～V35、V41～V45、V51～V55、V61～V65：驱动波形
VB1：第一偏压
VB2：第二偏压
VB3：第三偏压
VB4：第四偏压
VGM：伽玛电压
VP1：第一像素电压
VP2：第二像素电压
VPRX：像素参考电压
VSC11、VSC12：第一电压传送电路
VSC21、VSC22：第二电压传送电路
XCF：画面率指令
XDD：数据信号
XDP：显示数据
XFS：画面切换信号
XLDP：闩锁显示数据
XPOL：极性信号
XSTB：闩锁信号
XTDP：待转换显示数据
S710、S720：步骤
【具体实施方式】
图1A为依据本发明第一实施例的显示装置的系统示意图。请参照图1，在本实施例中，显示装置100包括源极驱动器110及显示面板120。源极驱动器110接收数据信号XDD、极性信号XPOL、画面切换信号XFS及闩锁信号XSTB，以提供第一驱动能力的多个第一像素电压VP1，并且提供具有第二驱动能力的多个第二像素电压VP2至显示面板120。其中，第一像素电压VP1可以是大于共同电压的像素电压，第二像素电压VP2可以是小于共同电压的像素电压，并且第一驱动能力例如小于第二驱动能力。
在本实施例中，画面切换信号XFS用以表示画面期间的切换，亦即画面切换信号XFS可以是垂直空白信号，但本发明实施例不以此为限。并且，源极驱动器110是依据一行反转(Column inversion)驱动方式产生第一像素电压VP1及第二像素电压VP2，亦即第一像素电压VP1及第二像素电压VP2是交错输出，并且在一画面期间中，各个输出端点会维持输出第一像素电压VP1或第二像素电压VP2。
源极驱动器110包括移位寄存器111、多个数据通道(如113_1～113_4)、第一驱动能力设定单元115。移位寄存器111接收数据信号XDD，以提多个显示数据XDP至数据通道(如113_1～113_4)。数据通道(如113_1～113_4)接收极性信号XPOL、画面切换信号XFS及闩锁信号XSTB，并且依据极性信号XPOL交错地提供第一像素电压VP1及第二像素电压VP2，亦即两相邻数据通道(如113_1～113_4)分别提供第一像素电压VP1及第二像素电压VP2。并且，各个数据通道(如113_1～113_4)依据闩锁信号XSTB决定是否转换所接收的显示数据XDP，并且各个数据通道(如113_1～113_4)依据极性信号XPOL、画面切换信号XFS交替地输出对应的第一像素电压VP1及对应的第二像素电压VP2。换言之，在一画面期间，各个数据通道(如113_1～113_4)提供对应的第一像素电压VP1；在下一画面期间，各个数据通道(如113_1～113_4)提供对应的第二像素电压VP2。
第一驱动能力设定单元115耦接数据通道(如113_1～113_4)，且接收极性信号XPOL、画面切换信号XFS及闩锁信号XSTB，以提供第一偏压VB1及第二偏压VB2至数据通道(如113_1～113_4)，其中，第一偏压VB1用以设定第一像素电压VP1具有第一驱动能力，第二偏压VB2用以设定第二像素电压VP2具有第二驱动能力。
进一步来说，第一驱动能力设定单元115包括第一偏压电路117、第二偏压电路119及多个第一电压传送电路(如VSC11、VSC12)。第一偏压电路117用以提供第一偏压VB1。第二偏压电路119用以提供第二偏压VB2。第一电压传送电路(如VSC11、VSC12)接收极性信号XPOL、及闩锁信号XSTB及画面切换信号XFS，并且分别耦接于第一偏压电路117、第二偏压电路119与两相邻数据通道(如113_1～113_4)之间。各个第一电压传送电路(如VSC11、VSC12)依据极性信号XPOL、及闩锁信号XSTB及画面切换信号XFS将第一偏压VB及第二偏压VB2分别传送至两相邻的数据通道(如113_1～113_4)。
显示面板120包括多条数据线(如121_1～121_5)及多个像素(如红色像素PR、绿色像素PG及蓝色像素PB)。数据线(如121_1～121_5)耦接源极驱动器110，用以接收第一像素电压VP1及第二像素电压VP2。像素(如PR、PG及PB)耦接数据线(如121_1～121_5)以接收对应的第一像素电压VP1或对应的第二像素电压VP2。在本实施例中，像素(如PR、PG及PB)与数据线(如121_1～121_5)的耦接结构为Z型像素配置，亦即各个数据线(如121_1～121_5)所耦接的像素(如PR、PG及PB)位于相邻的两行像素中，并且各个数据线(如121_1～121_5)所对应的像素(如PR、PG及PB)位于不同列且彼此不相邻。
举例来说，在第一画面期间中，数据通道(如113_1～113_4)依据极性信号XPOL及画面切换信号XFS通过数据线(如121_1～121_5)中的偶数数据线(如121_2、121_4，对应第一数据线)分别提供第一像素电压VP1至像素(如PR、PG及PB)，并且数据通道(如113_1～113_4)依据极性信号XPOL及画面切换信号XFS通过数据线(如121_1～121_5)中的奇数数据线(如121_1、121_3、121_5，对应第二数据线)分别提供第二像素电压VP2至像素(如PR、PG及PB)；在第一画面期间之后的一第二画面期间中，数据通道(如113_1～113_4)依据极性信号XPOL及画面切换信号XFS通过偶数数据线(如121_2、121_4)分别提供第二像素电压VP2至像素(如PR、PG及PB)，数据通道(如113_1～113_4)依据极性信号XPOL及画面切换信号XFS通过奇数数据线(如121_1、121_3、121_5)分别提供第一像素电压VP1至像素(如PR、PG及PB)。依据上述，本发明实施例的第一数据线是不同于第二数据线。
在本发明的实施例中，显示装置100可更包括时序控制器(未绘示)与门栅极驱动器(未绘示)，并且显示面板120可更包括扫描线。其中，扫描线耦接栅极驱动器及对应的像素(如PR、PG及PB)，以逐列驱动像素(如PR、PG及PB)，并且栅极驱动器受控于时序控制器提供栅极信号至扫描线，以及源极驱动器110受控于时序控制器提供第一像素电压VP1或对应的第二像素电压VP2至数据线(如121_1～121_5)，亦即时序控制器可提供数据信号XDD、极性信号XPOL、画面切换信号XFS及闩锁信号XSTB至源极驱动器110。
图1B至图1D为依据本发明第一实施例的显示面板的驱动示意图。请参照图1A至图1D，在本实施例中，假设红色画面、绿色画面及蓝色画面为分时写入，并且为正极性的第一像素电压VP1是具有较低的第一驱动能力A1(例如为62.5％的驱动能力)，为负极性的第二像素电压VP2是具有较高的第二驱动能力A2(例如为100％的驱动能力)。
请参照图1B，在显示红色画面时，红色像素PR会被写入对应的像素电压(如第一像素电压VP1或第二像素电压VP2)，而其余像素(如绿色像素PG及蓝色像素PB)则被写入黑色数据(亦即对应灰度值0的像素电压)。进一步来说，奇数数据线(如121_1、121_3、121_5)例如接收对应的第二像素电压VP2，数据线121_1、121_3、121_5的驱动波形如V11、V13、V15所示，并且偶数数据线(如121_2、121_4)例如接收对应的第一像素电压VP1，数据线121_1、121_3、121_5的驱动波形如V12、V14所示。
请参照图1C，在显示绿色画面时，绿色像素PG会被写入对应的像素电压(如第一像素电压VP1或第二像素电压VP2)，而其余像素(如红色像素PR及蓝色像素PB)则被写入黑色数据。并且，奇数数据线121_1、121_3、121_5的驱动波形如V21、V23、V25所示，并且偶数数据线121_1、121_3、121_5的驱动波形如V22、V24所示。
请参照图1D，在显示蓝色画面时，蓝色像素PB会被写入对应的像素电压(如第一像素电压VP1或第二像素电压VP2)，而其余像素(如红色像素PR及绿色像素PG)则被写入黑色数据。并且，奇数数据线121_1、121_3、121_5的驱动波形如V31、V33、V35所示，并且偶数数据线121_1、121_3、121_5的驱动波形如V32、V34所示。
依据上述，写入红色画面、绿色画面及蓝色画面时皆会使用到第一像素电压VP1及第二像素电压VP2，亦即写入红色画面、绿色画面及蓝色画面的驱动能力会大致相同，因此可避免驱动能力的落差影响画面的显示。并且，写入红色画面、绿色画面及蓝色画面时皆会使用到具有较低驱动能力的第一像素电压VP1，因此可降低画面写入的电力消耗。
此外，在某些实施例中，数据通道(如113_1～113_4)的形态是会影响像素电压(如第一像素电压VP1及第二像素电压VP2)的电气特性。举例来说，当数据通道(如113_1～113_4)是由NMOS晶体管所构成时，第一像素电压VP1(在此为大于共同电压的像素电压)的上升时间为0.96微秒(μs)，下降时间为1.22微秒，第二像素电压VP2(在此为小于共同电压的像素电压)的上升时间为1.28微秒(μs)，下降时间为0.98微秒。参照上述，第一像素电压VP1及第二像素电压VP2的上升时间(亦即充电能力)是不同的，因此可通过驱动能力的调整，使得第一像素电压VP1及第二像素电压VP2的充电能力大致相同，以避免画面闪烁的情况，进而提升画面品质。
图2A为依据本发明第二实施例的显示装置的系统示意图。请参照图1A及图2A，在本实施例中，显示装置200大致相同于显示装置100，其不同的处在于显示面板210。在本实施例中，显示面板210包括多条数据线(如211_1～211_5)及多个像素(如备用像素PD、红色像素PR、绿色像素PG及蓝色像素PB)。数据线(如211_1～211_5)耦接源极驱动器110，用以接收第一像素电压VP1及第二像素电压VP2。像素(如PD、PR、PG及PB)耦接数据线(如211_1～211_5)以接收对应的第一像素电压VP1或对应的第二像素电压VP2。
在本实施例中，像素(如PD、PR、PG及PB)与数据线(如121_1～121_5)的耦接结构为类Z型像素配置，亦即各个数据线(如121_1～121_5)所耦接的像素(如PD、PR、PG及PB)位于相邻的四行像素中。并且，各个数据线(如121_1～121_5)所对应的像素(如PD、PR、PG及PB)中位于不同列的像素(如PD、PR、PG及PB)是彼此不相邻，各个数据线(如121_1～121_5)所对应的像素(如PD、PR、PG及PB)中位于同列的像素(如PD、PR、PG及PB)是彼此相邻。
图2B至图2D为依据本发明第二实施例的显示面板的驱动示意图。请参照图2A至图2D，在本实施例中，同样假设红色画面、绿色画面及蓝色画面为分时写入，并且为正极性的第一像素电压VP1是具有较低的第一驱动能力A1(例如为62.5％的驱动能力)，为负极性的第二像素电压VP2是具有较高的第二驱动能力A2(例如为100％的驱动能力)。
请参照图2B，在显示红色画面时，红色像素PR会被写入对应的像素电压(如第一像素电压VP1或第二像素电压VP2)，而其余像素(如备用像素PD、绿色像素PG及蓝色像素PB)则被写入黑色数据。进一步来说，奇数数据线(如211_1、211_3、211_5)例如接收对应的第二像素电压VP2，数据线211_1、211_3、211_5的驱动波形如V41、V43、V45所示，并且偶数数据线(如211_2、211_4)例如接收对应的第一像素电压VP1，数据线211_1、211_3、211_5的驱动波形如V42、V44所示。
请参照图2C，在显示绿色画面时，绿色像素PG会被写入对应的像素电压(如第一像素电压VP1或第二像素电压VP2)，而其余像素(如备用像素PD、红色像素PR及蓝色像素PB)则被写入黑色数据。并且，奇数数据线211_1、211_3、211_5的驱动波形如V51、V53、V55所示，并且偶数数据线211_1、211_3、211_5的驱动波形如V52、V54所示。
请参照图2D，在显示蓝色画面时，蓝色像素PB会被写入对应的像素电压(如第一像素电压VP1或第二像素电压VP2)，而其余像素(如备用像素PD、红色像素PR及绿色像素PG)则被写入黑色数据。并且，奇数数据线211_1、211_3、211_5的驱动波形如V61、V63、V65所示，并且偶数数据线211_1、211_3、211_5的驱动波形如V62、V64所示。
依据上述，在类Z型像素配置中，写入红色画面、绿色画面及蓝色画面时皆会使用到第一像素电压VP1及第二像素电压VP2，亦即写入红色画面、绿色画面及蓝色画面的驱动能力会大致相同。
图3为依据本发明第三实施例的显示装置的系统示意图。请参照图1A及图3，在本实施例中，显示装置300大致相同于显示装置100，其不同的处在于源极驱动器310的第二驱动能力设定单元311。在本实施例中，第二驱动能力设定单元311耦接数据通道(如113_1～113_4)且接收画面率指令XCF、画面切换信号XFS、极性信号XPOL及闩锁信号XSTB，以提供第三偏压VB3及第四偏压VB4至数据通道(如113_1～113_4)，其中，第三偏压VB3及第四偏压VB4用以设定第一驱动能力及第二驱动能力，并且画面率指令XCF可以是英伟达(NVIDIA)公司所定义的G-SYNC信号或超微半导体(AMD)公司所定义的FreeSync信号，但本发明实施例不以此为限。
当画面率指令XCF设定显示装置300处于该高画面率模式时(亦即显示装置300的画面率大于等于120赫兹)，第二驱动能力设定单元311将第三偏压VB3及第四偏压VB4传送至数据通道(如113_1～113_4)，以设定第一像素电压VP1的第一驱动能力小于第二像素电压VP2的第二驱动能力；反之，当画面率指令XCF设定显示装置300处非于该高画面率模式时(亦即显示装置300的画面率小于120赫兹)，第二驱动能力设定单元311将第三偏压VB3及第四偏压VB4的其中之一传送至数据通道(如113_1～113_4)，以设定第一像素电压VP1的第一驱动能力等于第二像素电压VP2的第二驱动能力。
进一步来说，第二驱动能力设定单元311包括第三偏压电路313、第四偏压电路315及多个第二电压传送电路(如VSC21、VSC22)。第三偏压电路313用以提供第三偏压VB3。第四偏压电路315用以提供第四偏压VB4。第二电压传送电路(如VSC21、VSC22)接收极性信号XPOL、画面率指令XCF、闩锁信号XSTB、及画面切换信号XFS，并且分别耦接于第三偏压电路313、第四偏压电路315与两相邻数据通道(如113_1～113_4)之间。当画面率指令XCF设定显示装置300的画面率大于等于120赫兹时，各个第二电压传送电路(如VSC21、VSC22)依据极性信号XPOL、及闩锁信号XSTB及画面切换信号XFS将第三偏压VB3及第四偏压VB4分别传送至两相邻的数据通道(如113_1～113_4)；反之，当画面率指令XCF设定显示装置300的画面率小于120赫兹时，第二电压传送电路(如VSC21、VSC22)共同地将第三偏压VB3及第四偏压VB4的其中之一传送至数据通道(如113_1～113_4)。
图4为依据本发明第四实施例的显示装置的系统示意图。
请参照图2A、图3及图4，在本实施例中，显示装置400包括源极驱动器310及显示面板210，其中，显示面板210可参照图2A实施例所述，源极驱动器310可参照图3实施例所述，在此则不再赘述。
图5为依据本发明一实施例的数据通道的系统示意图。请参照图1A、图2A、图3、图4及图5，在本实施例中，数据通道113_1～113_4可以如数据通道500所示，并且数据通道500包括闩锁器510、电位移位器(level shifter)520、数字模拟转换器530及输出缓冲器540。闩锁器510接收并闩锁显示数据XDP，且接收闩锁信号XSTB以输出闩锁显示数据XLDP。
电位移位器520耦接闩锁器510，以依据闩锁显示数据XLDP提供待转换显示数据XTDP。数字模拟转换器530耦接电位移位器520且接收多个伽玛电压VGM及极性信号XPOL，用以将待转换显示数据STDP转换为像素参考电压VPRX。输出缓冲器540耦接数字模拟转换器530，且接收像素参考电压VPRX、极性信号XPOL，以提供第一像素电压VP1或第二像素电压VP1。
当输出缓冲器540耦接第一驱动能力设定单元115时，输出缓冲器540会接收到第一偏压VB1或第二偏压VB2；当输出缓冲器540耦接第二驱动能力设定单元311时，输出缓冲器540会接收到第三偏压VB3或第四偏压VB4。当输出缓冲器540接收第一偏压VB1及第三偏压VB3时，输出缓冲器VB1提供具有第一驱动能力的第一像素电压VP1；当输出缓冲器540接收第二偏压VB2及第四偏压VB4时，输出缓冲器540提供具有第二驱动能力的第二像素电压VP2。
图6为依据本发明一实施例的显示面板的电路示意图。请参照图1A及图6，在本实施例中，显示面板600大致相同于显示面板120，其不同的处在于显示面板600更包括多个多工器(如MX1、MX2)。各个多工器(如MX1、MX2)耦接于对应的数据通道(如113_1～113_4)与对应的数据线(如121_1～121_5)之间，用以将第一像素电压VP1及第二像素电压VP2依序传送至对应的数据线(如121_1～121_5)，其中，些多工器(如MX1、MX2)分别由多个晶体管所构成。
图7为依据本发明一实施例的像素的驱动方法的流程图。请参照图7，在本实施例中，像素的驱动方法包括下列步骤。首先，通过源极驱动器提供多个数据通道，以交错地提供多个第一像素电压及多个第二像素电压，其中，各个数据通道依据一极性信号及一画面切换信号交替地输出对应的第一像素电压及对应的第二像素电压，该多个第一像素电压具有一第一驱动能力，并且该多个第二像素电压具有一第二驱动能力(步骤S710)。接着，提供多条数据线，以传送该多个第一像素电压及该多个第二像素电压至该多个像素(步骤S720)。其中，步骤S710及S720的顺序为用以说明，本发明实施例不以此为限。并且，步骤S710及S720的细节可参照图1A至图1D、图2A至图2D、图3至图6实施例所述，在此则不再赘述。
综上所述，本发明实施例的显示装置及其像素驱动方法，其数据通道依据极性信号及画面切换信号交替地输出具有第一驱动能力的第一像素电压及具有第二驱动能力的第二像素电压至为Z型像素配置的显示面板。借此，因此可避免写入画面的驱动能力落差造成影像品质不佳的问题，并且可降低画面写入的电力消耗。
虽然本发明已以实施例揭露如上，然其并非用以限定本发明，任何所属技术领域中具有通常知识者，在不脱离本发明的精神和范围内，当可作些许的更动与润饰，故本发明的保护范围当视后附的申请专利范围所界定者为准。

Claims (15)

1.一种显示装置，包括：
一源极驱动器，接收一极性信号与一画面切换信号且具有多个数据通道，该多个数据通道依据该极性信号交错地提供多个第一像素电压及多个第二像素电压，其中各该多个数据通道依据该极性信号与该画面切换信号交替地输出对应的第一像素电压及对应的第二像素电压，该多个第一像素电压具有一第一驱动能力，并且该多个第二像素电压具有一第二驱动能力；
多条数据线，耦接该源极驱动器，用以接收该多个第一像素电压及该多个第二像素电压；以及
多个像素，耦接该多条数据线以接收对应的第一像素电压或对应的第二像素电压；
在一第一画面期间中，该多个数据通道依据该极性信号及该画面切换信号通过该多条数据线中的多个第一数据线分别提供该多个第一像素电压至该多个像素，该多个数据通道依据该极性信号及该画面切换信号通过该多条数据线中的多个第二数据线分别提供该多个第二像素电压至该多个像素，在该第一画面期间之后的一第二画面期间中，该多个数据通道依据该极性信号及该画面切换信号通过该多个第一数据线分别提供该多个第二像素电压至该多个像素，该多个数据通道依据该极性信号及该画面切换信号通过该多个第二数据线分别提供该多个第一像素电压至该多个像素，其中，该多个第一数据线不同于该多个第二数据线；
该多个第一像素电压大于一共同电压，该多个第二像素电压小于该共同电压，并且当该显示装置的画面率大于等于120赫兹时，该第一驱动能力小于该第二驱动能力，当该显示装置的画面率小于120赫兹时，该第一驱动能力等于该第二驱动能力。
2.如权利要求1所述的显示装置，其特征在于，该源极驱动器更包括：
一第一驱动能力设定单元，耦接该多个数据通道，且接收该极性信号、该画面切换信号及一闩锁信号，以提供一第一偏压及一第二偏压至该多个数据通道，其中该第一偏压用以设定该多个第一像素电压具有该第一驱动能力，该第二偏压用以设定该多个第二像素电压具有一第二驱动能力。
3.如权利要求2所述的显示装置，其特征在于，该第一驱动能力设定单元包括：
一第一偏压电路，用以提供该第一偏压；
一第二偏压电路，用以提供该第二偏压；以及
多个第一电压传送电路，接收该极性信号及该画面切换信号，耦接该第一偏压电路及该第二偏压电路及该多个数据通道，各该多个第一电压传送电路依据该极性信号、该画面切换信号及该闩锁信号将该第一偏压及该第二偏压分别传送至两相邻的数据通道。
4.如权利要求2所述的显示装置，其特征在于，各该多个数据通道包括：
一闩锁器，接收并闩锁一显示数据，且接收该闩锁信号以输出一闩锁显示数据；
一电位移位器(level shifter)，耦接该闩锁器，以依据该闩锁显示数据提供一待转换显示数据；
一数字模拟转换器，耦接该电位移位器且接收多个伽玛电压及该极性信号，用以将该待转换显示数据转换为一像素参考电压；以及
一输出缓冲器，耦接该数字模拟转换器及该第一驱动能力设定单元，且接收该像素参考电压、该极性信号，以提供该第一像素电压或该第二像素电压，当该输出缓冲器接收该第一偏压时，该输出缓冲器提供具有该第一驱动能力的该第一像素电压，当该输出缓冲器接收该第二偏压时，该输出缓冲器提供具有该第二驱动能力的该第二像素电压。
5.如权利要求1所述的显示装置，其特征在于，该源极驱动器更包括：
一第二驱动能力设定单元，耦接该多个数据通道，且接收一画面率指令、该画面切换信号、该极性信号及一闩锁信号，以提供一第三偏压及一第四偏压，当该画面率指令设定该显示装置的画面率大于等于120赫兹时，该第三偏压及该第四偏压传送至该多个数据通道以设定该多个第一像素电压的该第一驱动能力小于该多个第二像素电压的该第二驱动能力，当画面率指令设定该显示装置的画面率小于120赫兹时，该第三偏压及该第四偏压的其中之一传送至该多个数据通道以设定该多个第一像素电压的该第一驱动能力等于该多个第二像素电压的该第二驱动能力。
6.如权利要求5所述的显示装置，其特征在于，第二驱动能力设定单元包括：
一第三偏压电路，用以提供该第三偏压；
一第四偏压电路，用以提供该第四偏压；以及
多个第二电压传送电路，耦接该第三偏压电路及该第四偏压电路及该多个数据通道，当该画面率指令设定该显示装置的画面率大于等于120赫兹时，各该多个第二电压传送电路依据该极性信号、该画面切换信号及该闩锁信号将该第三偏压及该第四偏压分别传送至两相邻的数据通道，当该画面率指令设定该显示装置的画面率小于120赫兹时，该多个第二电压传送电路将该第三偏压及该第四偏压的其中之一传送至该多个数据通道。
7.如权利要求5所述的显示装置，其特征在于，各该多个数据通道包括：
一闩锁器，接收并闩锁一显示数据，且接收该闩锁信号以输出一闩锁显示数据；
一电位移位器(level shifter)，耦接该闩锁器，以依据该闩锁显示数据提供一待转换显示数据；
一数字模拟转换器，耦接该电位移位器且接收多个伽玛电压及该极性信号，用以将该待转换显示数据转换为一像素参考电压；以及
一输出缓冲器，耦接该数字模拟转换器及该第二驱动能力设定单元，且接收该像素参考电压、该极性信号，以提供该第一像素电压或该第二像素电压，当该输出缓冲器接收该第三偏压时，该输出缓冲器提供具有该第一驱动能力的该第一像素电压，当该输出缓冲器接收该第四偏压时，该输出缓冲器提供具有该第二驱动能力的该第二像素电压。
8.如权利要求1所述的显示装置，其特征在于，
该多个第一数据线及该多个第二数据线分别为多个奇数数据线及多个偶数数据线。
9.如权利要求1所述的显示装置，其特征在于，
各该多条数据线所耦接的该多个像素位于两行像素中，该多条数据线所对应的该多个像素位于不同列且彼此不相邻。
10.如权利要求1所述的显示装置，其特征在于，
各该多条数据线所耦接的该多个像素位于四行像素中，该多条数据线所对应的该多个像素中位于同列的该多个像素彼此相邻，该多条数据线所对应的该多个像素中位于不同列的该多个像素彼此不相邻。
11.如权利要求1所述的显示装置，其特征在于，
更包括多个多工器，耦接于该多个数据通道与该多条数据线之间，用以将该多个第一像素电压及该多个第二像素电压传送至该多条数据线，其中，该多个多工器分别由多个晶体管所构成。
12.一种像素的驱动方法，适用于耦接至一源极驱动器的多个像素，其特征在于，包括：
通过该源极驱动器提供多个数据通道，以交错地提供多个第一像素电压及多个第二像素电压，其中各该多个数据通道依据一极性信号及一画面切换信号交替地输出对应的第一像素电压及对应的第二像素电压，该多个第一像素电压具有一第一驱动能力，并且该多个第二像素电压具有一第二驱动能力；以及
提供多条数据线，以传送该多个第一像素电压及该多个第二像素电压至该多个像素；
其中，在一第一画面期间中，该多个数据通道依据该极性信号及该画面切换信号通过该多条数据线中的多个第一数据线分别提供该多个第一像素电压至该多个像素，该多个数据通道依据该极性信号及该画面切换信号通过该多条数据线中的多个第二数据线分别提供该多个第二像素电压至该多个像素；以及
在该第一画面期间之后的一第二画面期间中，该多个数据通道依据该极性信号及该画面切换信号通过该多个第一数据线分别提供该多个第二像素电压至该多个像素，该多个数据通道依据该极性信号及该画面切换信号通过该多个第二数据线分别提供该多个第一像素电压至该多个像素，其中，该多个第一数据线不同于该多个第二数据线；
该多个第一像素电压大于一共同电压，该多个第二像素电压小于该共同电压，并且当显示装置的画面率大于等于120赫兹时，该第一驱动能力小于该第二驱动能力，当该显示装置的画面率小于120赫兹时，该第一驱动能力等于该第二驱动能力。
13.如权利要求12所述的像素的驱动方法，其特征在于，该多个第一数据线及该多个第二数据线分别为多个奇数数据线及多个偶数数据线。
14.如权利要求12所述的像素的驱动方法，其特征在于，各该多条数据线所耦接的该多个像素位于两行像素中，该多条数据线所对应的该多个像素位于不同列且彼此不相邻。
15.如权利要求12所述的像素的驱动方法，其特征在于，
各该多条数据线所耦接的该多个像素位于四行像素中，该多条数据线所对应的该多个像素中位于同列的该多个像素彼此相邻，该多条数据线所对应的该多个像素中位于不同列的该多个像素彼此不相邻。
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