TWI533296B - 光學讀取器系統，解碼資料之方法及用於多個通道光學讀取器之解碼方法 - Google Patents

光學讀取器系統，解碼資料之方法及用於多個通道光學讀取器之解碼方法 Download PDF

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Description

光學讀取器系統，解碼資料之方法及用於多個通道光學讀取器之解碼方法
本文中所揭示標的係關於光學儲存，且更特定而言，係關於解碼光學儲存系統中資料之技術。
由於已改進計算能力，計算技術已進入新的應用領域，諸如消費者視訊、資料歸檔、文件儲存、成像及電影製作等等。此等應用提供了一持續動力來開發儲存容量增加及資料速率增加之資料儲存技術。
開發資料儲存技術的一項實例可為光學儲存系統逐漸更高的儲存容量。例如，1980年代早期開發的光碟具有大約650 MB至700 MB資料或者大約74分鐘至80分鐘之二頻道音訊節目的一容量。相比較而言，1990年代早期開發的數位多功能光碟(DVD)格式具有大約4.7 GB(單層)或8.5 GB(雙層)之一容量。此外，已開發更高容量儲存技術以滿足更高要求，諸如對更高解析度視訊格式之要求。例如，高容量記錄格式(諸如Blu-ray DiscTM格式)能夠在一單層碟中保留大約25 GB或者在一雙層碟中保留50 GB。隨著計算技術繼續發展，可能希望具有更高容量之儲存媒體。例如，全像儲存系統及顯微全像儲存系統為可達成儲存產業中容量需求增加的其他開發中儲存技術之實例。
連同資料容量增加，亦希望獲得高資料速率。例如，一標準DVD格式之視訊位元速率可能為大約9.8 Mbps，而一標準Blu-ray DiscTM格式之視訊位元速率可能為大約40.0 Mbps。隨著開發更高容量儲存系統亦可期望增加進一步之資料速率。為支援此類高資料處理率，可將高能量用於包含在典型通道解碼程序中的大量計算及步驟。例如，一有效里德所羅門(Reed-Solomon)解碼器可以1Gbps作業且可消耗大約200 mW/s。複雜的軟決策解碼可消耗明顯更多功率。
光學儲存系統中使用的複雜解碼程序可使用大量能量且導致熱累積，此可導致需要內部及/或外部冷卻。歸因於令人無法接受之長期故障率可能不希望此類冷卻方法。因此可能希望得到有效率之資料解碼程序。
在一項實施例中，提供一光學讀取器系統。該系統包含光學讀取電路，其經組態以基於來自一光學媒體之一光學資料讀取而產生一資料串流。該系統亦包含總和檢查碼電路及一處理器，該總和檢查碼電路經組態以將一總和檢查碼測試應用於該資料串流，該處理器經組態以判定該資料串流是否通過該總和檢查碼測試。此外，該系統包含一解碼器，其經組態以在該處理器判定該資料串流通過該總和檢查碼測試時撤銷啟動該解碼器，且經組態以在該處理器判定該資料串流未通過該總和檢查碼測試時啟動該解碼器。
另一實施例提供一種方法，其包含：從一儲存媒體讀取一資料區塊；基於該資料區塊產生一位元串流；緩衝該位元串流；將一總和檢查碼測試應用於該位元串流；及若該位元串流通過該總和檢查碼測試，則撤銷啟動一解碼器。
在又一實施例中，提供一種為一多個通道光學讀取器解碼之方法。該方法包含：從多個光學資料通道讀取多個資料區塊；基於該多個資料區塊產生多個資料串流；及對該多個資料串流各者執行一總和檢查碼測試。此外，該方法包含為該多個資料串流各者使用一共同解碼器。
當參考附圖閱讀下列[實施方式]時將更佳理解本發明之此等及其他特徵、態樣及優點，其中在整個圖式中相同字元表示相同部分。
在某些儲存系統(諸如光學儲存系統)中，一資料寫入程序可典型包含寫入後讀取(RAW)驗證以驗證可準確恢復寫入至媒體的資料。RAW驗證一般可包括將資料寫入至一媒體，及立即讀取並檢查讀取資料以驗證資料經正確寫入。例如，在一些系統中，當寫入資料至一媒體上時可將其依區塊編碼。可節省對應於經編碼寫入區塊的未編碼資料區塊。接著可讀回經編碼資料區塊並將其解碼，且可比較經解碼讀取資料與所儲存未編碼資料。若資料區塊匹配，則經寫入資料可為準確，且寫入程序可繼續用於後續資料區塊。若資料區塊不匹配，則RAW驗證可能未通過，且可重新寫入資料區塊(例如寫入於媒體別處)。因此，當寫入程序期間RAW驗證資料準確度時，已通過RAW驗證的資料一般具有高準確概率。
在典型儲存系統中，用於讀取所儲存資料的一程序通常可包含解碼讀取資料。例如，可從一媒體讀取資料且將其轉換為一位元串流。接著可解碼位元串流以移除可對應於一些不同經錯誤修正碼(ECC)(例如包含里德所羅門編碼、前向饋送系統碼、遞迴系統碼、維特比(Viterbi)碼、位元錯誤率最小碼等等)的任何冗餘位元。接著可將冗餘位元用於修正可能已在讀取程序期間發生的錯誤。此類解碼程序通常消耗高能量。例如，以1 Gbps操作的一里德所羅門解碼器可消耗約200 mW，且某些類型之軟決策解碼可消耗更多能量。由於當讀取各個通道時解碼器可能不斷地解碼，因此使用多個通道讀取程序的儲存系統可使用更多能量且亦需要額外電路。用於操作典型解碼方案的高能量可導致熱累積。雖然一些系統藉由安裝內部或外部冷卻以解決熱累積，但此類方法增加系統複雜性且可能具有不希望的長期故障率。
因此，用於讀取經儲存資料的典型解碼程序可使用高能量、增加熱累積且增加系統設計複雜度來實施並行解碼器及/或冷卻機制。然而，經常在讀取同時解碼之典型解碼方法並不總是有效率。特定而言，當使用RAW驗證讀取已記錄之資料時，歸因於RAW驗證資料極可能已經正確，進一步解碼或經錯誤修正可能並非總是有用或必需。換言之，由於RAW驗證資料通常正確，因此解碼讀取資料之預設程序可能無效率。本文中揭示的一項或多項實施例藉由執行一總和檢查碼演算法及基於該總和檢查碼結果選擇性解碼經讀取資料而為減少能量消耗及系統複雜度提供方法及系統。
現轉至圖式，圖1係一方塊圖，其提供一儲存系統讀取器的一項實例，該儲存系統讀取器可實施選擇性解碼技術之一實施例。雖然圖1中繪示的特定讀取器系統係一光學讀取器系統10，但應注意，其他類型的儲存系統讀取器亦可實施本技術。光學讀取器系統10可用於從儲存媒體(諸如光學儲存碟12)讀取資料。由一系列光學元件14讀取儲存於光學資料碟12上的資料，該等光學元件14將一讀取束16投射到光學資料碟12上。由光學元件14從光學資料碟12拾取一反射束18。光學元件14可包括經設計以產生激發束的任何數目之不同元件，將此等光束聚焦於光學資料碟12上，且偵測從光學資料碟12返回的反射18。反射束18可包含：從光儲存碟12上之一顯微全像反射的光之某組合；從光儲存碟12之一表面反射之光；及從顯微全像反射之光及從表面反射之光的某交互作用。透過至一光學驅動電子器件封裝22之一耦合20以控制光學元件14。光學驅動電子器件封裝22可包含：作為用於一個或多個雷射系統之電力供應的此類單元；偵測電子器件，其等偵測來自偵測器之一電子信號；類比轉數位轉換器，其等將經偵測信號轉換為一數位信號；及其他單元，諸如一數位預測器，其預測何時偵測器信號實際暫存儲存於光學資料碟12上的一位元值。
由一循軌伺服系統24控制光學元件14在光學資料碟12上之位置，該循軌伺服系統24具有一機械致動器26，其經組態以將光學元件在光學資料碟12表面上來回移動。由一處理器28控制光學驅動電子器件22及循軌伺服系統24。在根據本技術的一些實施例中，處理器28可基於取樣資訊能夠判定光學元件14之位置，可由光學元件14接收該取樣資訊並將其回饋給處理器28。可判定光學元件14之位置以增強及/或放大反射18或減少反射18之干涉。在一些實施例中，循軌伺服系統24或光學驅動電子器件22可基於由光學元件14接收的取樣資訊而能夠判定光學元件14之位置。
處理器28亦控制一馬達控制器30，該馬達控制器30提供電力32至一主軸馬達34。該主軸馬達34耦合至一主軸36，該主軸36控制光學資料碟12之旋轉速度。當光學元件14從光學資料碟12外邊緣移動靠近主軸36時，可由處理器28增加光學資料碟之旋轉速度。可執行此增加以當光學元件14處於較外邊緣及當光學元件處於較內邊緣時保持來自光學資料碟12之資料的資料速率基本相同。碟之最大旋轉速度可為大約每分鐘500轉(rpm)、1000 rpm、1500 rpm、3000 rpm、5000 rpm、10,000 rpm或更高。
在一些實施例中，一旦在光學元件14處從光學資料碟12接收反射束18形式之光學資料並由光學驅動電子器件封裝22將其轉換為一位元串流時，光學驅動電子器件22即可將一位元串流(例如對應於反射束18的數位化資料串流)傳輸至總和檢查碼電路58。總和檢查碼電路58可包含於光學驅動電子器件22中或耦接至光學驅動電子器件22。在同時讀取超過一個資料通道(例如一光碟上之超過一個的資料磁軌)的實施例中，光學驅動電子器件22可從不同通道通過一個或多個位元線56傳輸若干位元串流。總和檢查碼電路58可藉由應用一總和檢查碼演算法以計算一總和檢查碼，並比較經計算總和檢查碼與原始嵌入總和檢查碼，而檢查各個位元串流準確度。通過總和檢查碼電路58之一總和檢查碼測試之資料可判被定為準確的並可予以輸出。處理器28可控制：總和檢查碼電路58之操作、資料輸出及/或導致總和檢查碼未通過之資料的處理。
總和檢查碼電路58可耦合至一解碼器60，該解碼器60可包含用於解碼來自總和檢查碼電路58之位元串流以移除冗餘位元及/或修正錯誤(可能在讀取程序期間發生)的電路。在一些實施例中，必須經由來自處理器28之一控制信號62來撤銷啟動或啟動解碼器60。例如，解碼器60可保持撤銷啟動直至總和檢查碼電路58判定已發生一總和檢查碼未通過。處理器28可發送一控制信號62以啟動解碼器60。
處理器28連接至隨機存取記憶體(或RAM)38以及唯讀記憶體(或ROM)40。ROM 40含有程式，該等程式容許處理器28控制：循軌伺服系統24、光學驅動電子器件22及馬達控制器30。此外，ROM 40亦可含有用於控制解碼器60的資料及容許處理器28分析來自光學驅動電子器件22已儲存於RAM 38(例如經緩衝之資料串流)中之資料的程式，及其他。在一些實施例中，解碼器60可亦包含用於儲存演算法(例如總和檢查碼演算法及/或一解碼演算法)之記憶體。如本文中將進一步詳細討論，儲存於RAM 38中資料之此類分析可包含例如：驗證讀取資料之準確度(例如一總和檢查碼演算法)、解碼，或將來自光學資料碟12之資訊轉換為可由其他單元使用之一資料串流所必要之其它功能。
若光學讀取器系統10為一商用單元(諸如一消費者電子器件)，則其可能具有控制以容許由一使用者存取及控制處理器28。此類控制可採取面板控制42之形式(諸如鍵盤、節目選擇切換器及類似者)。此外，可由一遠端接收器44執行處理器28之控制。遠端接收器44可經組態以從一遠端控制48接收一控制信號46。控制信號46可採取一紅外線束、一聲學信號或一無線電信號等等之形式。
在處理器28已分析儲存於RAM 38中之資料以產生一資料串流時，可由處理器28提供資料串流至其他單元。例如，可將資料作為一數位資料串流透過一網路介面50提供至外部數位單元，諸如電腦或定位於一外部網路上的其他器件。或者，處理器28可提供數位資料串流至一消費者電子器件數位介面52，諸如一高清晰度多媒體介面(HDMI)或其他高速介面(諸如一USB埠)等等。處理器28亦可具有其他經連接介面單元，諸如一數位轉類比信號處理器54。數位轉類比信號處理器54可容許處理器28提供一類比信號以供輸出至其他類型器件，諸如至一電視上之一類比輸入信號，或至輸入至一放大系統之一音訊信號。
圖2中提供一流程圖，其繪示使用一總和檢查碼演算法的一選擇性解碼方案之一程序。程序70可開始於從一儲存媒體之一通道讀取(方塊72)一資料區塊。例如，返回參考圖1，程序可開始於一光學讀取器系統10傳輸一讀取束16並在光學元件14處接收一反射束18。反射束18之資料可經處理以產生一位元串流76。應注意到，程序70可包含重複讀取反覆。下文中將詳細描述判定讀取反覆數目之程序(例如第一讀取決策區塊74)。另外，可緩衝位元串流76(方塊78)並將其儲存於一記憶體組件(例如圖1之RAM 38)中作為經緩衝位元串流80，若偵測到一讀取錯誤，則可存取該經緩衝位元串流80。
應用總和檢查碼測試(方塊82)可指稱應用一總和檢查碼演算法、功能或計算一資料區塊之一總和檢查碼，並比較該經計算總和檢查碼與一原始編碼總和檢查碼的程序，該原始編碼總和檢查碼可用資料區塊傳輸及/或儲存。一總和檢查碼可指稱可用於識別一資料區塊的任何固定大小資料，使得經計算總和檢查碼與原始總和檢查碼間之一差別可指示原始儲存資料與當前讀取資料間之一差別。例如，總和檢查碼技術可包含同位位元組、模數總和、總和檢查碼等等。若經計算總和檢查碼匹配經編碼總和檢查碼，則位元串流80可通過總和檢查碼測試(方塊82)，且若經計算總和檢查碼不匹配經編碼總和檢查碼，則可能未通過總和檢查碼測試(方塊82)。在一些實施例中，任何適當處理器28可藉由透過總和檢查碼電路58傳輸一位元串流並判定位元串流是否通過或未通過總和檢查碼測試而控制一總和檢查碼測試。
若程序70判定(方塊84)位元串流76通過總和檢查碼測試(方塊82)，則可輸出位元串流76(方塊86)而不需要進一步解碼。由於已使用一寫入後讀取(RAW)驗證技術記錄資料，因此資料可能已足夠準確。因此，將瞭解到，位元串流76一般可通過總和檢查碼測試(方塊82)。在一些實施例中，輸出位元串流76可包括進一步處理。
若程序判定(方塊84)位元串流76未通過總和檢查碼測試(方塊82)，則可解碼經緩衝位元串流80(方塊88)。例如，可從總和檢查碼電路58傳輸經緩衝位元串流80至圖1之光學讀取器系統10中的解碼器60。除非一資料區塊未通過總和檢查碼測試(方塊82)，否則通常不會發生資料解碼。若資料區塊通過總和檢查碼測試，則如提供經緩衝位元串流80至解碼程序(方塊88)的點線路徑所指示可能不需要解碼經緩衝位元串流80(方塊88)。正如所討論，由於可節省否則會用於對可能準確的資料執行不必要之解碼程序的能量，因此選擇性解碼可能不準確的資料可改良解碼系統之效率。
解碼(方塊88)經緩衝位元串流80可涉及從位元串流80移除任何冗餘位元及/或錯誤修正經緩衝位元串流80。例如，位元串流中的冗餘位元可對應於一些不同經錯誤修正碼(ECC)，包含例如里德所羅門編碼、前向饋送系統碼、遞迴系統碼、維特比碼、位元錯誤率最小化碼等等。接著可將冗餘位元用於修正讀取程序期間可能已發生的錯誤。一經修正位元串流90可源於解碼(方塊88)，且總和檢查碼演算法(方塊92)將應用於經修正位元串流90。雖然在此流程圖中將總和檢查碼演算法不同地編號(方塊82及92)，但應注意，總和檢查碼演算法可大體上相同，且可僅經不同編號以在應用一共同總和檢查碼測試的不同位元串流間加以區分。程序70可再次判定(方塊94)經修正位元串流90是否通過總和檢查碼測試(方塊92)。若經修正位元串流90通過總和檢查碼測試(方塊92)，則可輸出結果(方塊86)。
若經修正位元串流90未通過第二總和檢查碼測試(方塊92)，則在一些實施例中，可再次讀取未通過的資料區塊(方塊72)以產生同一資料區塊之一額外位元串流96。一總和檢查碼測試亦可應用於額外位元串流96，且關於原始讀取位元串流76，若額外位元串流96未通過總和檢查碼測試，則可將其解碼；或若額外位元串流96通過總和檢查碼測試，則將其輸出。在一些實施例中，程序70可追蹤已對資料區塊完成的讀取數目，且若程序70判定(方塊74)當前讀取(方塊72)並非第一讀取，則額外位元串流96可與原始經緩衝位元串流組合(方塊98)以形成組合位元串流100。將經緩衝位元串流80與額外位元串流96組合(方塊98)可基於資料區塊之兩個讀取而組合位元預測，且可在解碼後具有較高準確概率。可解碼組合位元串流100(方塊88)，且可將額外總和檢查碼測試應用於經修正組合位元串流90。若程序70判定(方塊94)經修正組合位元串流90現通過額外總和檢查碼測試(方塊92)，則可輸出經修正組合位元串流90(方塊86)。若經修正組合位元串流90仍未通過額外總和檢查碼測試(方塊92)，則在一些實施例中，可再次讀取資料區塊(方塊72)。
在一些實施例中，程序70可遞迴讀取(方塊72)一通道以重新讀取未通過總和檢查碼測試之一資料區塊(方塊92)，且在各個額外讀取處，當前位元串流96可與經緩衝位元串流80組合(方塊98)以供解碼(方塊88)。在一項實施例中，程序70之一次反覆期間產生之各個組合位元串流100亦可經緩衝以在程序之將來反覆中用於組合(方塊98)。此外，在一些實施例中，程序70可能限制用於任何給定資料區塊的讀取數目。例如，處理器28(圖1)可控制程序70並追蹤各個資料區塊讀取的數目，且可在一特定臨限值之後(例如4個讀取)停止用於一資料區塊的程序70。
正如將瞭解到，大多數使用RAW驗證記錄的資料極可能是正確的，且可通過第一總和檢查碼測試(方塊82)。當資料通過第一總和檢查碼測試(方塊82)時，不需要進一步解碼資料(方塊88)，且不需要啟動系統10之一解碼器60(圖1)。在一些實施例中，在一總和檢查碼未通過事件中可啟動一解碼器60(例如經由來自處理器28之一控制信號62)，以進一步修正未通過資料之錯誤。然而，解碼器60之預設撤銷啟動狀態可大體為系統10保留能量及減少熱。
此外，由於在一項或多項實施例中一解碼器60可能不持續地啟動，因此多個通道讀取器系統可使用一個解碼器60。例如，由於一般總是在讀取期間及/或讀取後立即解碼資料，因此典型讀取器系統可為同時讀取的各個通道使用一個解碼器。此類系統可不僅導致高能量消耗及熱產生，且由於必須使用額外解碼器及電路為多個通道讀取器實施一解碼器而因此增加複雜度。在一些實施例中，為多個通道讀取器使用一個解碼器60可導致減少能量消耗及減少系統複雜度。
圖3中提供描繪四個同時通道讀取且使用一個共同解碼器之一方塊圖。正如所討論，大多數RAW驗證資料可能正確，且可能通過總和檢查碼測試而被輸出(方塊86)。因此，資料可能不需要進一步解碼(方塊88)。由於一個通道上之資料可傳輸用於輸出(方塊86)多於傳輸用於解碼(方塊88)，因此可由超過一個通道讀取器有效率地共用解碼器60。例如，在圖3中繪示的實施例中，一多個通道讀取器可讀取四個通道，且四個通道之各者可使用一共同解碼器60以供在一總和檢查碼未通過之一般罕見事件中解碼(方塊88)。在一些實施例中，一處理器可控制一多工器以選擇可能未通過一總和檢查碼測試的一特定通道之解碼(方塊88)。
雖然本文中已闡釋及描述本發明之僅某些特徵，但熟習此技術者將想到許多修改及變化。因此，應理解意欲隨附申請專利範圍涵蓋屬於本發明之真正精神的此類修改及變化。
10．．．光學讀取系統
12．．．光學或全像碟
14．．．光學元件
16．．．讀取束
18．．．反射束
20．．．光學驅動/信號耦合
22．．．光學驅動元件
24．．．循軌伺服系統
26．．．機械致動器
28．．．處理器
30．．．馬達控制器
32．．．馬達驅動連接
34．．．主軸馬達
36．．．主軸
38．．．隨機存取記憶體(RAM)
40．．．唯讀記憶體(ROM)
42．．．面板控制
44．．．遠端接收器
46．．．遠端信號
48．．．遠端控制器
50．．．網路介面
52．．．消費者數位介面
54．．．數位/類比信號處理器
56．．．位元線
58．．．總和檢查碼電路
60．．．解碼器
62．．．輸入信號
70．．．程序
72．．．讀取通道
74．．．第一次讀取？
76．．．位元串流
78．．．緩衝器
80．．．經緩衝位元串流
82．．．總和檢查碼演算法
84．．．總和檢查碼通過？
86．．．輸出
88．．．解碼
90．．．經修正位元串流
92．．．總和檢查碼演算法
94．．．總和檢查碼通過？
96．．．額外位元串流
98．．．組合
100．．．組合位元串流
圖1係一方塊圖，其描繪根據一實施例之一光學讀取器系統；
圖2係一流程圖，其繪示根據一實施例使用一總和檢查碼演算法用於有效解碼的一程序；及
圖3係一流程圖，其繪示根據一實施例使用一共同解碼器讀取多個通道之一程序。
10．．．光學讀取系統
12．．．光學或全像碟
14．．．光學元件
16．．．讀取束
18．．．反射束
20．．．光學驅動/信號耦合
22．．．光學驅動元件
24．．．循軌伺服系統
26．．．機械致動器
28．．．處理器
30．．．馬達控制器
32．．．馬達驅動連接
34．．．主軸馬達
36．．．主軸
38．．．隨機存取記憶體(RAM)
40．．．唯讀記憶體(ROM)
42．．．面板控制
44．．．遠端接收器
46．．．遠端信號
48．．．遠端控制器
50．．．網路介面
52．．．消費者數位介面
54．．．數位/類比信號處理器
56．．．位元線
58．．．總和檢查碼電路
60．．．解碼器
62．．．輸入信號

Claims (20)

  1. 一種光學讀取器系統，其包括：一或多個元件，其經組態以偵測朝一光學媒體之一顯微全像傳輸之一讀取束之一反射；光學讀取電路，其經組態以基於來自該光學媒體的該讀取束之該反射而產生一第一資料串流；總和檢查碼電路，其經組態以將一總和檢查碼測試應用於該第一資料串流；一處理器，其經組態以判定該第一資料串流是否通過該總和檢查碼測試；及一解碼器，其經組態以在該處理器判定該第一資料串流通過該總和檢查碼測試時撤銷啟動該解碼器，且經組態以在該處理器判定該第一資料串流未通過該總和檢查碼測試時啟動該解碼器。
  2. 如請求項1之系統，其包括可接達該總和檢查碼電路之一記憶體系統，其中該記憶體系統經組態以儲存該總和檢查碼測試之一總和檢查碼演算法。
  3. 如請求項1之系統，其中該處理器經組態以經由一控制信號撤銷啟動或啟動該解碼器。
  4. 如請求項1之系統，其包括一緩衝器，該緩衝器耦合至該光學讀取電路及該解碼器，其中該緩衝器經組態以緩衝由該光學讀取電路產生的該第一資料串流，且其中該解碼器經組態以存取該緩衝器、解碼該經緩衝第一資料串流並產生一經錯誤修正第一資料串流。
  5. 如請求項4之系統，其中該總和檢查碼電路經組態以將該總和檢查碼測試應用於該經錯誤修正第一資料串流，且其中該處理器經組態以判定該經錯誤修正第一資料串流通過該總和檢查碼測試。
  6. 如請求項5之系統，其中該處理器經組態以在該處理器判定該經錯誤修正第一資料串流未通過該總和檢查碼測試時控制來自該光學媒體之一第二光學資料讀取，且其中該光學讀取電路經組態以基於該第二光學讀取而產生一第二資料串流。
  7. 如請求項1之系統，其中該處理器經組態以控制來自該光學媒體之一第二光學資料讀取，且其中該光學讀取電路經組態以基於該第二光學讀取而產生一第二資料串流。
  8. 如請求項7之系統，其中該處理器經組態以：將該第一資料串流與該第二資料串流組合以產生一組合資料串流；將該組合資料串流傳輸至該解碼器以產生一經錯誤修正組合資料串流；及將該經錯誤修正組合資料串流傳輸至該總和檢查碼電路，以將該總和檢查碼測試應用於該經錯誤修正組合資料串流。
  9. 如請求項8之系統，其中該處理器經組態以：判定該經錯誤修正組合資料串流是否通過該總和檢查碼測試；及 若該處理器判定該經錯誤修正組合資料串流通過該總和檢查碼測試，則輸出該經錯誤修正組合資料串流。
  10. 如請求項8之系統，其中該處理器經組態以：判定該經錯誤修正組合資料串流是否通過該總和檢查碼測試；若該處理器判定該經錯誤修正組合資料串流未通過該總和檢查碼測試，則控制來自該光學媒體之一第三光學資料讀取，其中該光學讀取電路經組態以基於該第三光學讀取而產生一第三資料串流；及將該第三資料串流與該一第一資料串流、該第二資料串流、該組合資料串流及該經錯誤修正組合資料串流之一者或多者組合。
  11. 如請求項1之系統，其中該光學讀取系統經組態以同時讀取光學資料之多個通道而產生多個資料串流，且其中該解碼器經組態以經啟動而一次解碼該多個資料串流之一者。
  12. 如請求項1之系統，其中該光學讀取器系統經組態以同時讀取光學資料多個通道，且其中該總和檢查碼電路經組態以將該總和檢查碼測試並行應用於多個資料串流，其中該多個資料串流之各者對應於光學資料之該多個通道之一者。
  13. 一種解碼資料之方法，其包括：偵測朝一光學儲存媒體傳輸之一讀取束之一反射，其中該讀取束之該反射包含來自於儲存於該光學儲存媒體 上之一顯微全像之一第一資料區塊；基於該第一資料區塊產生一第一位元串流；緩衝該第一位元串流；將一總和檢查碼測試應用於該第一位元串流；且若該第一位元串流通過該總和檢查碼測試，則撤銷啟動一解碼器。
  14. 如請求項13之方法，其包括：若該第一位元串流未通過該總和檢查碼測試，則啟動該解碼器；若該第一位元串流未通過該總和檢查碼測試，則解碼該經緩衝第一位元串流，其中解碼該經緩衝第一位元串流產生一經修正第一位元串流；將該總和檢查碼測試應用於該經修正第一位元串流；及若該經修正第一位元串流通過該總和檢查碼測試，則輸出該經修正第一位元串流。
  15. 如請求項14之方法，其包括：若該經修正第一位元串流未通過該總和檢查碼測試，則從該光學儲存媒體讀取一第二資料區塊；基於該第二資料區塊產生一第二位元串流；將該第二位元串流與該經緩衝第一位元串流組合以產生一組合位元串流；及將該組合位元串流解碼以產生一經修正組合位元串流。
  16. 如請求項15之方法，其包括：將該總和檢查碼測試應用於該經修正組合位元串流；及 若該經修正組合位元串流通過該總和檢查碼測試，則輸出該經修正組合位元串流。
  17. 如請求項13之方法，其中應用該總和檢查碼測試包括：計算該第一位元串流之一總和檢查碼；比較該經計算總和檢查碼與該第一位元串流之一編碼總和檢查碼；若該經計算總和檢查碼匹配該經編碼總和檢查碼，則判定該第一位元串流通過該總和檢查碼測試；及若該經計算總和檢查碼不匹配該經編碼總和檢查碼，則判定該第一位元串流未通過該總和檢查碼測試。
  18. 一種用於一多個通道光學讀取器之解碼方法，該方法包括：從一光學儲存媒體之各自多個光學資料通道偵測複數個顯微全像之反射，其中該等反射包含各自多個資料區塊；基於該多個資料區塊產生多個資料串流；對該多個資料串流各者執行一總和檢查碼測試；及為該多個資料串流之各者使用一共同解碼器。
  19. 如請求項18之方法，其中為該多個資料串流各者使用該共同解碼器包括：除非該多個資料串流任一者未通過該總和檢查碼測試，否則將該共同解碼器維持在一撤銷啟動狀態中；及若該多個資料串流任一者未通過該總和檢查碼測試，則啟動該共同解碼器。
  20. 如請求項18之方法，其中為該多個資料串流各者使用該共同解碼器包括：僅當該多個資料串流之任一者未通過該總和檢查碼測試時啟動該共同解碼器；及解碼未通過該總和檢查碼測試的該多個資料串流之一者。
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