TWI441262B - 蕭基二極體元件的製作方法 - Google Patents

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Description

蕭基二極體元件的製作方法
本發明係關於蕭基二極體元件之技術領域，特別是關於一種可避免漏電流現象之蕭基二極體元件之製作方法。
已知，蕭基二極體元件係為一種適用於高頻整流之二極體。對應於PN接面二極體，蕭基二極體之接面並非為PN接面，其接面係為半導體(通常為N型)與金屬，例如金、銀或鉑等，所構成之金屬/半導體接面。由於金屬/半導體接面係主要以多數載子(majority carrier)傳遞電流訊號，因此在高頻運作時，不會產生類似如PN接面電流訊號難以快速截止之現象。
於習知蕭基二極體元件之結構，至少具有一N型基底、一N型磊晶層、一環狀場氧化層、一金屬矽化物層、一源極導電層、以及一汲極導電層。其中，N型磊晶層係藉由磊晶製程成長於N型基底之上。環狀場氧化層，例如二氧化矽，係形成於在N型磊晶層的表面上，俾以定義出一主動區域。金屬矽化物層形成於環狀場氧化層所定義出之主動區域內，且導電層係分別設置於金屬矽化物層之上以及N型基底之底部。其中，汲極導電層與N型磊晶層係構成一蕭基接觸(Schottky contact)。此外，在環狀場氧化層所覆蓋的N型磊晶層中另可存在一P型護環(guard ring)結構，俾以電性絕緣兩相鄰之元件以及降低於二極體終端結構因電場聚集效應(Electric Field Crowding)所導致之高漏電現象。
然而，上述之先前技藝仍有諸多問題需要進一步被克服。舉例來說，因為磊晶製程以及自我對準金屬矽化物(Self-Aligned Silicide,salicide)製程的技術限制，主動區域內之N型磊晶層表面通常存在有許多磊晶缺陷結構以及形成金屬矽化物時造成之缺陷，這些缺陷係為後續形成金屬矽化物與磊晶接觸時之缺陷來源。已知金屬矽化物與磊晶缺陷結構間之耐壓能力劣於常規金屬/半導體接面之耐壓能力，因此當蕭基二極體元件處理電流訊號時，該些金屬矽化物與磊晶缺陷結構所存在之區域容易產生逆向漏電流之現象，使得蕭基二極體元件之耐壓能力降低以及漏電流上升。
可知，仍需一種蕭基二極體元件之製作方法，俾以解決上述漏電流之現象，使蕭基二極體元件之電性表現以及穩定性得以提升。
本發明之一目的在於提供一種蕭基二極體元件的製作方法，俾以解決磊晶缺陷結構所造成之逆向漏電流之現象。
為達到上述目的，根據本發明之一實施例，係提供一種蕭基二極體元件的製作方法，包含有：提供一基底，具有一第一導電型；於基底上成長一磊晶層，其中磊晶層具有第一導電型；於磊晶層上形成一圖案化介電層；於磊晶層之一表面形成一金屬矽化物層；於金屬矽化物層上形成一摻質來源層，其中摻質來源層具有第二導電型之摻質；進行一熱驅入製程，使摻質來源層內第二導電型之摻質擴散進入該磊晶層；以及於金屬矽化物層上形成一導電層。
根據本發明之另一實施例，係提供一種蕭基二極體元件的製作方法，包含有：提供一基底，具有一第一導電型；於基底上成長一磊晶層，其中磊晶層具有第一導電型，且磊晶層具有至少一磊晶缺陷結構；於磊晶層上形成一金屬矽化物層；於磊晶缺陷結構內形成一第二導電型之摻雜區，且摻雜區與磊晶層之間具有一PN接面；以及於金屬矽化物層上形成一導電層。
本發明係於蕭基二極體元件之磊晶層以及磊晶缺陷結構之間形成一PN介面，藉由PN接面的逆向耐壓能力，避免磊晶缺陷結構產生漏電流現象，俾以提升蕭基二極體元件之電性表現以及穩定性。
為讓本發明之上述目的、特徵及優點能更明顯易懂，下文特舉較佳實施方式，並配合所附圖式，作詳細說明如下。然而如下之較佳實施方式與圖式僅供參考與說明用，並非用來對本發明加以限制者。
以下配合圖式詳細說明本發明蕭基二極體元件之製作方法。雖然本發明以實施例揭露如下，然其並非用以限定本發明，任何熟習此技藝者，在不脫離本發明之精神和範圍內，當可作些許之更動與潤飾。因此本發明之保護範圍當視後附之申請專利範圍所界定者為準，且為了不致使本發明之精神晦澀難懂，部分習知製程步驟的細節將不在此揭露。
請參閱第1圖至第8圖，第1圖至第8圖所繪示的是根據本發明較佳實施例之蕭基二極體元件之製作方法示意圖。首先，如第1圖所示，提供一第一導電型之重摻雜基底20，例如N+ 矽基底，且基底20上定義有主動區域30以及周邊區域31，其中主動區域30係為蕭基接面(Schottky junction)存在之區域。此外，基底20之背面20a另可形成有一厚氧化層54，例如矽氧層，其厚度約為4000埃(angstrom)至6000埃左右。接著，進行一常規磊晶製程，在基底20的正面成長出第一導電型之磊晶層21，例如N- 矽基底，且磊晶層21之摻質濃度較佳小於基底20之摻質濃度。繼以利用熱氧化之方式，於磊晶層21之上方形成一場氧化層52，例如矽氧層。上述形成場氧化層52之製程不限於熱氧化之方式，另可包含高密度電漿化學氣相沈積(high density plasma CVD,HDPCVD)、次常壓化學氣相沈積(sub atmosphere CVD,SACVD)或旋塗式介電材料(spin on dielectric,SOD)等製程。請繼續參照第1圖，由於磊晶製程技術之限制，鄰近於磊晶層21表面之區域通常存在有磊晶缺陷結構(defects)23，例如：接縫缺陷(seam defects)、空穴缺陷(void defects)以及晶格錯位(lattice dislocation)。該些缺陷會影響蕭基二極體元件之耐壓能力，使得逆向漏電流易產生於磊晶缺陷結構23存在之處。
如第2圖所示，在接續的步驟中，將接著定義出護環結構24，以避免蕭基二極體元件與鄰近的元件產生電性上的干擾，其製程步驟詳述如下：首先，利用微影及蝕刻製程(photolithographic and etching process)，暴露出部分磊晶層21之表面，此時，部分周邊區域31的磊晶層21仍被場氧化層52覆蓋住。隨後，利用熱氧化製程，在暴露出於場氧化層52之磊晶層21表面形成一犧牲氧化層53，其目的在於避免後續製程之高能離子直接撞擊磊晶層21之表面。接著，利用曝光顯影製程，於磊晶層21上方形成一圖案化光阻(圖未示)，俾以定義出護環結構24存在之區域。繼以進行一離子佈植製程，在鄰近磊晶層21表面之區域形成具有第二導電型之護環結構24，例如P+ 型，且其濃度最佳大於鄰近磊晶層21之摻質濃度。最後，剝除圖案化光阻並且施行一熱退火製程，俾以活化護環結構24之摻質。透過上述之製程，即可於磊晶層21中定義出護環結構24。接著，如第3圖所示，利用另一微影及蝕刻製程，移除位於主動區域30內之犧牲氧化層53，俾以形成一圖案化犧牲氧化層53a。此時，部分之護環結構24會被覆蓋於圖案化犧牲氧化層53a之下。
在下列的步驟中，將於主動區域30內之磊晶層21表面形成一金屬矽化物層，俾以形成蕭基接面金屬。請參照第4圖以及第5圖，如第4圖所示，形成一層金屬層60，其係作為金屬矽化物層63的金屬來源層。其中，金屬層60包含鈦、鎳、鉑、鈷、鉻等金屬或其合金，在本實施例中係選用鈦。接著，如第5圖所示，在惰性氣體(例如氮氣)的環境下，進行一快速熱處理製程，俾使金屬層60內的金屬原子擴散進入磊晶層21內，並產生一金屬矽化物層63。金屬矽化物層63之組成係對應於金屬層60之成分。例如當金屬層60之組成為鎳時，金屬矽化物層63即為矽化鎳(nickel silicide,Ni2 Si)。根據本實施例，金屬層60為鈦，而金屬矽化物層63為矽化鈦(titanium silicide,TiSi2 )。另外，由圖可知，部分之磊晶缺陷結構23會涵蓋於金屬矽化物層63之內。最後，移除未反應之金屬層60，以暴露出磊晶層21之上表面。
根據上述，當形成金屬矽化物層63之後，仍會有部分之磊晶缺陷結構23存在於磊晶層21之中。而為了消除磊晶缺陷結構23對蕭基二極體元件電性之影響，本發明即利用熱擴散之方式，以消除磊晶缺陷結構23所產生之電性不良影響。其主要技術特徵敘述如下：如第6圖所示，首先，於磊晶層21上方形成一摻質來源層69，其具有複數個第二導電型之摻質，例如硼。且摻質來源層69之成分包含磊晶矽、多晶矽、非晶矽或硼摻雜矽玻璃(borosilicate glass,BSG)，但不限於此。接著，如第7圖所示，進行一熱驅入製程(drive-in)，俾使摻質來源層69內之摻質擴散進入磊晶層21中。其中，為了增加摻質擴散的均勻性，另可在摻質來源層69以及磊晶層21之接面形成一緩衝層(buffer)67，俾以增進接面之接觸性質。上述之熱驅入製程可包含快速熱處理製程(rapid thermal process,RTP)、瞬間熱退火(spike thermal annealing)、雷射熱退火(laser thermal annealing,LTA)或雷射瞬間退火(laser spike annealing,LSA)，但不限於此。此外，根據本發明之另一實施例，另可採用氣相擴散(vapor phase diffusion)製程或離子佈植(ion implantation)製程取代上述之熱驅入製程，亦即，摻質來源層69不會形成於磊晶層21之上，且摻質係由氣相的形式擴散進入磊晶層21中或藉由離子化的形式撞擊進入磊晶層21中。
仍如第7圖所示，經過上述之熱驅入製程、氣相擴散製程或離子佈植製程之後，會形成一緊鄰於金屬矽化物層63底部之載子濃度調整區71。在本發明之所有實施例中，載子濃度調整區71之導電型仍為第一導電型，例如N型，且其主要載子濃度係略低於鄰近的第一導電型磊晶層21，例如介於1E12 atoms/cm3 至1E19 atoms/cm3 之間。因此，載子濃度調整區71與磊晶層21之間不會形成PN介面且會使得能位障些微提高並降低漏電流現象之產生。在此需注意的是，當形成載子濃度調整區71的同時，由於磊晶缺陷結構23之晶格排列較為鬆散，該第二導電型之摻質會更容易擴散進入磊晶缺陷結構23中，而形成一具有第二導電型之摻雜區73，其濃度介於1E14 atoms/cm3 至1E19 atoms/cm3 之間。其中，摻雜區73之體積可恰包含或大於磊晶缺陷結構23之體積。因此，摻雜區73與磊晶層21或載子濃度調整區71之間會具有一PN接面75。當蕭基二極體元件承受一逆向電壓時，包覆住磊晶缺陷結構23之PN接面75會相應地擴大其空乏區(depletion region)。由於空乏區具有可承受逆向偏壓之能力，因此逆向漏電流便不會產生於磊晶缺陷結構23中。在此需注意的是，根據本發明之另一實施例，上述之第一導電型以及第二導電型可相互對調，亦即，第一導電型為P型，而第二導電型為N型。此時，摻雜區73與磊晶層21或載子濃度調整區71之間仍會具有一PN接面75。
最後，如第8圖所示，進行一研磨製程，將位於基底20的背面20a的氧化層54去除，暴露出基底20的背面20a。並在金屬矽化物層63上以及基底20的背面20a分別形成導電層77及導電層28。其中，導電層77與磊晶層21構成金屬接觸，而導電層28與基底20構成歐姆接觸(ohmic contact)。此外，上述導電層77及導電層28之材質可以是Ti、Ni、Ag、Al或其組合。至此，便完成本發明之蕭基二極體元件1結構。
綜上所述，本發明係採用一熱驅入、氣相擴散或離子佈植製程，俾以形成一PN介面75於主動區域30內之磊晶缺陷結構23與磊晶層21之間。藉由PN介面75之特性而提升因磊晶缺陷結構23導致之低蕭基位障(Schottky barrier height)，以增加磊晶缺陷結構23之耐壓能力，進而避免逆向漏電流之現象產生。
以上所述僅為本發明之較佳實施例，凡依本發明申請專利範圍所做之均等變化與修飾，皆應屬本發明之涵蓋範圍。
1．．．蕭基二極體元件
20．．．基底
20a．．．背面
21．．．磊晶層
23．．．磊晶缺陷結構
24．．．護環結構
28．．．導電層
30．．．主動區域
31．．．周邊區域
52．．．場氧化層
53．．．犧牲氧化層
53a．．．圖案化犧牲氧化層
54．．．氧化層
60．．．金屬層
63．．．金屬矽化物層
67．．．緩衝層
69．．．摻質來源層
71．．．載子濃度調整區
73．．．摻雜區
75．．．PN接面
77．．．導電層
第1圖至第8圖所繪示的是根據本發明較佳實施例之蕭基二極體元件之製作方法示意圖。
1．．．蕭基二極體元件
20．．．基底
20a．．．背面
21．．．磊晶層
24．．．護環結構
28．．．導電層
30．．．主動區域
31．．．周邊區域
52．．．場氧化層
53a．．．圖案化犧牲氧化層
63．．．金屬矽化物層
71．．．載子濃度調整區
73．．．摻雜區
75．．．PN接面
77．．．導電層

Claims (20)

  1. 一種蕭基二極體元件的製作方法，包含有：提供一基底，具有一第一導電型；於該基底上成長一磊晶層，其中該磊晶層具有該第一導電型；於該磊晶層上形成一圖案化介電層；於該磊晶層內形成一護環結構，其中該護環結構具有一第二導電型；於該磊晶層之一表面形成一金屬矽化物層，其中該金屬矽化物層覆蓋住該護環結構；於該金屬矽化物層上形成一摻質來源層，其中該摻質來源層具有該第二導電型之摻質；進行一熱驅入製程，使該摻質來源層內該第二導電型之摻質透過該金屬矽化物層擴散進入該磊晶層，而形成一具有該第一導電型的載子濃度調整區以及一具有該第二導電型的摻雜區；以及於該金屬矽化物層上形成一導電層。
  2. 如申請範圍第1項所述之蕭基二極體元件之製作方法，其中該磊晶層之該表面包含有至少一磊晶缺陷結構。
  3. 如申請範圍第2項所述之蕭基二極體元件之製作方法，其中該磊晶缺陷結構包含接縫缺陷(seam defects)、空穴缺陷(void defects)或晶格錯位(lattice dislocation)。
  4. 如申請範圍第1項所述之蕭基二極體元件之製作方法，其中該摻雜區所具有之該第二導電型之摻質的摻雜濃度係介於1E14atoms/cm3 至1E19atoms/cm3 之間。
  5. 如申請範圍第1項所述之蕭基二極體元件之製作方法，其中在形成該摻質來源層之前，另包含：於該金屬矽化物層上形成一緩衝層。
  6. 如申請範圍第5項所述之蕭基二極體元件之製作方法，其中在進行該熱驅入製程之後，另包含：去除該摻質來源層以及該緩衝層。
  7. 如申請範圍第6項所述之蕭基二極體元件之製作方法，其中該緩衝層包含氧化矽。
  8. 如申請範圍第1項所述之蕭基二極體元件之製作方法，其中該第一導電型為N型，該第二導電型為P型。
  9. 如申請範圍第1項所述之蕭基二極體元件之製作方法，其中該金屬矽化物層包含有矽化鈦(titanium silicide,TiSi2 )、矽化鎳(nickel silicide,Ni2 Si)、矽化鉑(platinum silicide,PtSi)、矽化鉬(molybdenum silicide,MoSi2 )或矽化鈷(cobalt silicide,CoSi2 )。
  10. 如申請專利範圍第1項所述之半導體功率元件的製作方法，其 中該摻質來源層包含有磊晶矽、多晶矽、非晶矽或硼摻雜矽玻璃(borosilicate glass,BSG)。
  11. 如申請範圍第1項所述之蕭基二極體元件之製作方法，其中該第二導電型之摻質包含有硼原子。
  12. 如申請範圍第1項所述之蕭基二極體元件之製作方法，其中該熱驅入製程包含快速熱處理製程(rapid thermal process,RTP)、瞬間熱退火(spike thermal annealing)、雷射熱退火(laser thermal annealing,LTA)或雷射瞬間退火(laser spike annealing,LSA)。
  13. 如申請範圍第1項所述之蕭基二極體元件之製作方法，其中該導電層包含鈦、鎳、金、鋁或其組合。
  14. 一種蕭基二極體元件的製作方法，包含有：提供一基底，具有一第一導電型；於該基底上成長一磊晶層，其中該磊晶層具有該第一導電型，該磊晶層具有至少一磊晶缺陷結構；於該磊晶層上形成一金屬矽化物層；於該磊晶層的一表面形成一具有該第一導電型之載子濃度調整區，並同時於該磊晶缺陷結構形成一第二導電型之摻雜區，且該摻雜區與該磊晶層之間或該摻雜區與該載子濃度調整區之間具有一PN接面；以及 於該金屬矽化物層上形成一導電層。
  15. 如申請範圍第14項所述之蕭基二極體元件之製作方法，其中該摻雜製程包含：於該金屬矽化物層上形成一摻質來源層，其中該摻質來源層具有該第二導電型之摻質；以及進行一熱驅入製程，使該第二導電型之摻質擴散進入該磊晶層。
  16. 如申請範圍第14項所述之蕭基二極體元件之製作方法，其中該摻雜製程係為一氣相擴散製程或一離子佈植製程。
  17. 如申請範圍第14項所述之蕭基二極體元件之製作方法，其中在形成該摻質來源層之前，另包含：於該金屬矽化物層上形成一緩衝層。
  18. 如申請範圍第17項所述之蕭基二極體元件之製作方法，其中在進行該熱驅入製程之後，另包含：去除該摻質來源層以及該緩衝層。
  19. 如申請範圍第14項所述之蕭基二極體元件之製作方法，其中該摻雜區具有第二導電型之摻質，其摻雜濃度係介於1E14atoms/cm3 至1E19atoms/cm3 之間。
  20. 如申請範圍第14項所述之蕭基二極體元件之製作方法，其中該 第一導電型為N型，該第二導電型為P型。
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