TWI406074B - 主動元件陣列基板 - Google Patents

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Description

主動元件陣列基板
本發明是有關於一種液晶顯示面板，且特別是有關於一種液晶顯示面板之主動元件陣列基板。
針對多媒體社會之急速進步，多半受惠於半導體元件或人機顯示裝置的飛躍性進步。就顯示器而言，陰極射線管(Cathode Ray Tube，CRT)已經被薄膜電晶體液晶顯示面板所取代，因此具有高畫質、空間利用效率佳、低消耗功率、無輻射等優越特性之平面顯示器，諸如薄膜電晶體液晶顯示面板(TFT-LCD panel)、有機電激發光顯示面板等，已逐漸成為市場主流。
一般而言，平面顯示器主要是由一顯示面板以及多個驅動晶片(Driver IC)所構成，其中顯示面板具有畫素陣列，而畫素陣列的畫素是藉由對應之掃描線以及對應之資料線所驅動。為了使得平面顯示器更為普及，業者皆如火如荼地進行降低成本作業，近年來，一種資料驅動晶片減半(Half Source Driver,HSD)的架構設計已被提出，其主要是利用畫素陣列上的佈局來降低資料驅動晶片的使用數量。詳細來說，在HSD架構的畫素陣列中，兩相鄰的子畫素(sub-pixel)是共用同一條資料線，故資料線的總數目減半，但掃描線的總數目則增加一倍。由於HSD架構可以使得資料線的總數目減半，因此所需之源極驅動器(source drivers)的數量亦減半，但所需之閘極驅動器(gate drivers)的數量則增加一倍。值得注意的是，由於閘極驅動器的造價低於源極驅動器的造價，因此整體而言，平面顯示器之製造成本仍可有效地被降低。
以薄膜電晶體液晶顯示面板為例，其主要是由薄膜電晶體陣列基板、彩色濾光基板以及液晶層所構成，且在薄膜電晶體陣列基板上，對應到各個子畫素之共通線皆為H型共通線設計(H-Shaped Com design)。由於習知的H型共通線與資料線之間的電容耦合效應十分顯著，因此共通電壓會因為資料線的耦合效應(coupling effect)而偏移，導致薄膜電晶體液晶顯示面板在顯示時出現亮暗線的問題，進而造成顯示品質不佳。
本發明提供一種主動元件陣列基板，其可降低共通線與資料線之間的耦合效應。
本發明提供一種主動元件陣列基板，其包括基板、多條第一掃描線、多條第二掃描線、多條資料線、多個顯示單元以及網狀共通線。第一掃描線與第二掃描線交替排列於基板上。資料線配置於基板上，並與第一掃描線以及第二掃描線交錯。顯示單元配置於基板上，各顯示單元分別位於二相鄰資料線之間，且各顯示單元包括第一畫素以及第二畫素，其中第一畫素與其中一條第一掃描線電性連接，而第二畫素與其中一條第二掃描線電性連接，且第一畫素與第二畫素分別與不同條資料線電性連接。此外，網 狀共通線配置於基板上，並且位於顯示單元下方，網狀共通線包括多個彼此電性連接之環狀圖案，各環狀圖案包括二彼此連接但分別位於單一資料線兩側之半環狀圖案，且同一環狀圖案中的二半環狀圖案分別位於不同顯示單元的下方。
在本發明之一實施例中，各第一畫素包括一第一主動元件以及一與該第一主動元件電性連接之第一畫素電極，而各該第二畫素包括一第二主動元件以及一與該第二主動元件電性連接之第二畫素電極。舉例而言，在同一顯示單元中，其中一個半環狀圖案係沿著第一畫素電極的邊緣延伸，而另一個半環狀圖案係沿著第二畫素電極的邊緣延伸。此外，在同一顯示單元中，二半環狀圖案的連接處例如是對應於第一畫素電極與第二畫素電極之間的區域。
在本發明之一實施例中，前述之網狀共通線可進一步包括多個連接圖案，其中連接圖案與第一掃描線以及第二掃描線交錯，且連接圖案連接於環狀圖案之間。舉例而言，前述之連接圖案的材料與第一畫素電極以及第二畫素電極的材料實質上相同。
在本發明之一實施例中，前述之第一掃描線、第二掃描線以及環狀圖案的材質實質上相同。
在本發明之一實施例中，前述之網狀共通線在資料線的下方之位置上不具有與資料線平行之圖案。
基於上述，由於本發明之網狀共通線與資料線的重疊面積很小，因此在本發明之主動元件陣列基板上，資料線與網狀共通線之間的寄生電容可以被有效地降低。
為讓本發明之上述特徵和優點能更明顯易懂，下文特舉實施例，並配合所附圖式作詳細說明如下。
圖1為本發明一實施例之主動元件陣列基板的示意圖，而圖2為本發明一實施例之主動元件陣列基板的佈局示意圖。請參照圖1與圖2，本實施例之主動元件陣列基板100包括基板110、多條第一掃描線120、多條第二掃描線130、多條資料線140、多個顯示單元150以及網狀共通線160。第一掃描線120與第二掃描線130交替排列於基板110上。資料線140配置於基板110上，並與第一掃描線120以及第二掃描線130交錯。顯示單元150配置於基板110上，各顯示單元150分別位於二相鄰資料線140之間，且各顯示單元150包括第一畫素152以及第二畫素154，其中第一畫素152與其中一條第一掃描線120電性連接，而第二畫素154與其中一條第二掃描線130電性連接，且第一畫素152與第二畫素154分別與不同條資料線140電性連接。
圖3為本發明一實施例之網狀共通線的示意圖。請參照圖1至圖3，網狀共通線160配置於基板110上，並且位於顯示單元150下方，網狀共通線160包括多個彼此電性連接之環狀圖案SR，各環狀圖案SR包括二彼此連接但分別位於單一資料線140兩側之半環狀圖案SR1、SR2，且同一環狀圖案SR中的二半環狀圖案SR1、SR2分別位 於不同顯示單元150。
在本實施例中，基板100可以採用可撓性基板(flexible substrate)或是硬質基板(rigid substrate)。舉例而言，基板100例如為玻璃基板、塑膠基板或是其他適當材質之基板，本發明不限制所使用之基板100的材質。
第一掃描線120、第二掃描線130以及環狀圖案SR例如係透過同一道微影與蝕刻製程(Photolithography and Etch Process，PEP)來製作。換言之，第一掃描線120、第二掃描線130以及環狀圖案SR屬於同一層圖案化薄膜，且具有實質上相同的材質。此外，第一掃描線120與第二掃描線130例如係沿著列方向D1延伸，且第一掃描線120與第二掃描線130係沿著行方向D2交替排列於基板110上。第一掃描線120、第二掃描線130與環狀圖案SR彼此相互電性絕緣。
如圖1至圖3所示，資料線140係沿著行方向D2延伸，且資料線140例如係透過另一道微影與蝕刻製程(PEP)來製作。值得注意的是，在製作資料線140之前，通常會先形成一閘絕緣層(未繪示)以覆蓋住前述之第一掃描線120、第二掃描線130以及環狀圖案SR，以確保資料線140不會與第一掃描線120、第二掃描線130、環狀圖案SR在交錯處發生短路。
在本實施例中，各個第一畫素150包括第一主動元件TFT1以及與該第一主動元件TFT1電性連接之第一畫素電極P1，而各該第二畫素154包括第二主動元件TFT2以及與該第二主動元件TFT2電性連接之第二畫素電極P2。如 圖1至圖3所示，第一主動元件TFT1與第二主動元件TFT2例如為薄膜電晶體，而薄膜電晶體的閘極、源極、汲極可與前述之資料線140、第一掃描線120、第二掃描線130、環狀圖案SR一併製作。舉例而言，薄膜電晶體的閘極可與第一掃描線120、第二掃描線130、環狀圖案SR一併製作，而薄膜電晶體的源極、汲極可與資料線140一併製作。
舉例而言，在同一顯示單元150中，其中一個半環狀圖案(即半環狀圖案SR1)係沿著第一畫素電極P1的邊緣延伸，而另一個半環狀圖案(即半環狀圖案SR2)係沿著第二畫素電極P2的邊緣延伸。詳言之，半環狀圖案SR1的缺口例如係朝向左側，而半環狀圖案SR的缺口例如係朝向右側。從圖1至圖3可清處得知，在排列於同一列且彼此相鄰之二顯示單元150中，位於不同顯示單元150內之二相鄰的半環狀圖案SR1與半環狀圖案SR2會構成所謂的環狀圖案SR。換言之，每一個環狀圖案SR皆分佈於二相鄰的顯示單元150中，並且被資料線140區分為半環狀圖案SR1與半環狀圖案SR2。如圖3所示，半環狀圖案SR1的開口端例如係朝向右側，而半環狀圖案SR2的開口端例如係朝向左側。
承上述，在同一顯示單元150中，半環狀圖案SR1與半環狀圖案SR2的連接處例如是對應於第一畫素電極P1與第二畫素電極P2之間的區域X。由於半環狀圖案SR1與半環狀圖案SR2的連接處與資料線140的距離不近，因此不容易產生電容耦合的效應。除此之外，由於網狀共通線160在資料線140的下方之位置上不具有與資料線140 平行之圖案，因此網狀共通線160與資料線140之間不容易產生電容耦合的效應。
除了環狀圖案SR之外，網狀共通線160可進一步包括多個連接圖案C，其中連接圖案C連接於環狀圖案SR之間，且連接圖案C與第一掃描線120以及第二掃描線130交錯。舉例而言，連接圖案C、第一畫素電極P1以及第二畫素電極P2例如係透過同一道微影與蝕刻製程(PEP)來製作。換言之，連接圖案C、第一畫素電極P1以及第二畫素電極P2屬於同一層圖案化薄膜，且具有實質上相同的材質。
基於上述，由於本發明之網狀共通線與資料線的重疊面積很小，因此在本發明之主動元件陣列基板上，資料線與網狀共通線之間的寄生電容可以被有效地降低，進而改善習知所提及的亮暗線問題。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何所屬技術領域中具有通常知識者，在不脫離本發明之精神和範圍內，當可作些許之更動與潤飾，故本發明之保護範圍當視後附之申請專利範圍所界定者為準。
100‧‧‧主動元件陣列基板
110‧‧‧基板
120‧‧‧第一掃描線
130‧‧‧第二掃描線
140‧‧‧資料線
150‧‧‧顯示單元
152‧‧‧第一畫素
154‧‧‧第二畫素
160‧‧‧網狀共通線
SR‧‧‧環狀圖案
SR1、SR2‧‧‧半環狀圖案
TFT1‧‧‧第一主動元件
TFT2‧‧‧第二主動元件
P1‧‧‧第一畫素電極
P2‧‧‧第二畫素電極
C‧‧‧連接圖案
D1‧‧‧列方向
D2‧‧‧行方向
X‧‧‧區域
圖1為本發明一實施例之主動元件陣列基板的示意圖。
圖2為本發明一實施例之主動元件陣列基板的佈局示意圖。
圖3為本發明一實施例之網狀共通線的示意圖
100‧‧‧主動元件陣列基板
110‧‧‧基板
120‧‧‧第一掃描線
130‧‧‧第二掃描線
140‧‧‧資料線
150‧‧‧顯示單元
152‧‧‧第一畫素
154‧‧‧第二畫素
160‧‧‧網狀共通線
SR‧‧‧環狀圖案
SR1、SR2‧‧‧半環狀圖案
TFT1‧‧‧第一主動元件
TFT2‧‧‧第二主動元件
P1‧‧‧第一畫素電極
P2‧‧‧第二畫素電極
C‧‧‧連接圖案

Claims (8)

  1. 一種主動元件陣列基板，包括：一基板；多條第一掃描線；多條第二掃描線，其中該些第一掃描線與該些第二掃描線交替排列於該基板上；多條資料線，配置於該基板上，並與該些第一掃描線以及該些第二掃描線交錯；多個顯示單元，配置於該基板上，各該顯示單元分別位於二相鄰資料線之間，且各該顯示單元包括：一第一畫素，與其中一條第一掃描線電性連接；一第二畫素，與其中一條第二掃描線電性連接，其中該第一畫素與該第二畫素分別與不同條資料線電性連接；以及一網狀共通線，配置於該基板上，並且位於該些顯示單元下方，其中該網狀共通線包括多個彼此電性連接之環狀圖案，各該環狀圖案包括二彼此連接但分別位於單一資料線兩側之半環狀圖案，且同一環狀圖案中的該二半環狀圖案分別位於不同顯示單元的下方。
  2. 如申請專利範圍第1項所述之主動元件陣列基板，其中各該第一畫素包括一第一主動元件以及一與該第一主動元件電性連接之第一畫素電極，而各該第二畫素包括一第二主動元件以及一與該第二主動元件電性連接之第二畫素電極。
  3. 如申請專利範圍第2項所述之主動元件陣列基 板，其中在同一顯示單元中，其中一個半環狀圖案係沿著該第一畫素電極的邊緣延伸，而另一個半環狀圖案係沿著該第二畫素電極的邊緣延伸。
  4. 如申請專利範圍第3項所述之主動元件陣列基板，其中在同一顯示單元中，該二半環狀圖案的連接處對應於該第一畫素電極與該第二畫素電極之間的區域。
  5. 如申請專利範圍第2項所述之主動元件陣列基板，其中該網狀共通線更包括多個連接圖案，其中該些連接圖案與該些第一掃描線以及該些第二掃描線交錯，且該些連接圖案連接於該些環狀圖案之間。
  6. 如申請專利範圍第5項所述之主動元件陣列基板，其中該些連接圖案的材料與該些第一畫素電極以及該些第二畫素電極的材料實質上相同。
  7. 如申請專利範圍第1項所述之主動元件陣列基板，其中該些第一掃描線、該些第二掃描線以及該些環狀圖案的材質實質上相同。
  8. 如申請專利範圍第1項所述之主動元件陣列基板，其中在平面俯視下，該網狀共通線在該些資料線的下方之位置上不具有與該些資料線平行之圖案。
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