TWI260641B - Method for storing compare data in a read-only memory built-in self-test circuit - Google Patents
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Description
1260641 九、發明說明: 【發明所屬之技術領域】 内建自我測試電路(BIST)。 【先前技術】 籲 傳統的唯讀記憶體内建自我測試電路(ROMBIST)在合成 (synthesis)之後,比較資料(compare data)的值會以電位〇/電位 1(GND/VDD)的方式存在測試電路的比較元件(compare component)。如果製作光罩以後要更新唯讀記憶體内的資料的話, 比較資料(compare data)也須更改,需在比較元件(compare component)的部分作佈局更動(layout ECO)。當比較元件(compare component)的繞線(routing)使用金屬層(metal layer)而唯讀記憶體 * 内的資料使用不同層,則必須更新數層的光罩。當比較元件 (compare component)的繞線(routing)使用金屬層(metal layer)而唯 讀記憶體内的資料也使用金屬層(metal layer),則必須視佈局更動 (layoutECO)的狀況來決定光罩必須更新的層數。如此不但造成成 本的增加,也造成時間的延後。 1260641 【發明内容】 本發明之優點在更改唯讀記憶體内的資料時,可同時更改唯讀 記憶體内建自我測試電路(ROMBIST)中的比較資料(compare data),不需在比較元件(compare component)的部分作佈局更動 (layoutECO)。不但省事也省時,而且又省光罩,最方便的是不用 更改測試程式(test pattern)。 本發明係使用唯讀記憶體(ROM)的一部分來儲存唯讀記憶體内 建自我測試電路(ROMBIST)中的比較資料(compare data),當内建 自我測試電路的控制器(BIST Controller)在讀取唯讀記憶體内的資 料時不讀取用來存放比較資料(compare data)的位址,當内建自我 測試電路的控制器(BIST Controller)讀取唯讀記憶體内的資料完成 時,再讀取比較資料(compare data)與多重輸入回授位移暫存器 (MISR)中的值,比較後決定内建自我測試電路測試結果正確(mST Good)或内建自我測試電路測試結果不正確(BISTFail)。 【貫施方式】 請參考第1圖與第2圖與第3圖。本實施例使用唯讀記憶體 (ROM)的最後一組位置,用來存放唯讀記憶體内建自我測試電路 (ROMBIST)中的比較資料(compare data) 〇内建自我測試電路 (BIST)啟動後進入P1-讀取唯讀記憶體(R〇M)資料。B3_内建自我 1260641 測減電路的控制器(BIST Controller)送出讀取B1 -唯讀記憶體 (ROM)内的資料所需之信號,並且將m_唯讀記憶體(R〇M)的資料 (data)持續送入B2-壓縮器(compressor),此為傳統之技藝,在此不 做詳述。 然後進入P2-比較位址是否相同(compare — address)。若唯讀記 憶體位址(ROM Address)與An-Ι相同則進入P3-比較資料是否相同 (compare the data),不同則進入pi-讀取唯讀記憶體(rom)資料。 當頃取到唯讀記憶體(ROM)的倒數第二組資料(data)時,唯讀記 憶體位址(ROM Address)與An_l相同,進入P3-比較資料是否相同 (compare the data)。B4-比較器(compare)比較多重輸入回授位移暫 存器(MISR)中的值與唯讀記憶體(R0M)的最後一組資料(data),若 相同則進入P4-内建自我測試電路測試結果正確(BIST Good),然 後結束;若不相同則進入P5-内建自我測試電路測試結果不正確 (BIST Fail),然後結束。 請參考第4圖與第5圖。本實施例使用另一個唯讀記憶體C5-唯讀記憶體2(ROM2)來存放唯讀記憶體内建自我測試電路 (ROMBIST)中的比較資料(compare data)。内建自我測試電路(BIST) 啟動後進入Q1-讀取唯讀記憶體(ROM)資料,C3-内建自我測試電 1260641 路的控制器(BIST Controller)送出讀取Cl-唯讀記憶體l(R〇Ml)内 的資料所需之信號,並且將C1-唯讀記憶體l(R〇Ml)的資料(data) 持續送入C2_壓縮器(compressor),此為傳統之技藝’在此不做詳 述0 然後進入Q2-比較位址是否相同(compare the address)。若唯讀記 憶體位址(ROM Address)與An相同則進入Q3-比較資料是否相同 (compare the data),不同則進入Q1-讀取唯讀記憶體(ROM)資料。 當讀取到唯讀記憶體(ROM)的最後一組資料(data)時,唯讀記憶 體位址(ROM Address)與An相同,進入Q3-比較資料是否相同 (compare the data)。C4-比較器(compare)比較多重輸入回授位移暫 存器(MISR)中的值與C5-唯讀記憶體2(R〇M2)的資料(data),若相 同則進入Q4-内建自我測試電路測試結果正確(mSTG〇〇d),然後 結束;若不相同則進入q5_内建自我測試電路測試結果不正確 (BIST Fail),然後結束。 惟以上所述者,僅為本發明之運作原理與較佳實施例而已,並 不限疋其細範圍與細環境,其可細之範圍如, ROM OTP ROM ’ Fuse等等,並無限制。因此,凡依本發 明之精神所作的均等變化與修飾,皆屬本發”請專利範圍。 1260641 【圖式簡單說明】 第1圖為本發明第一實施例之功能方塊圖。 第2圖為本發明第一實施例之操作流程圖。 弟3圖為本發明弟一貫施例中B4-比較器(compare)之電路圖。 • 第4圖為本發明第二實施例之功能方塊圖。 第5圖為本發明第二實施例之操作流程圖。 【主要元件符號說明】 B1-唯讀記憶體(R〇M)。 B2_壓縮器(compressor)。 B3-内建自我測試電路的控制器(BIST contr〇llei^。 _ B4_比較器(compare)。 P1-讀取唯讀記憶體(ROM)資料。 P2_比較位址是否相同(compare the address)。 P3-比較資料是否相同(compare the data)。 P4-内建自我測試電路測試結果正確(BISTG〇〇d)。 P5-内建自我測試電路測試結果不正確(BISTFail)。 1260641
Cl-唯讀記憶體l(ROMl)。 C2-壓縮器(compressor)。 C3-内建自我測試電路的控制器(BIST Controller)。 C4_比較器(compare)。 C5-唯讀記憶體2(R〇M2) Q1-讀取唯讀記憶體(ROM)資料。 Q2-比較位址是否相同(compare此address)。 Q3·比較資料是否相同(compare the (jata)。 Q4-内建自我測試電路測試結果正確(BISTG〇〇d)。 Q5_内建自我測試電路測試結果不正確(BIST Fail)
Claims (1)
1260641 十、申請專利範圍: 1· 一種唯讀記憶體内建自我測試電路(R0MBIST)中的比較資料 (〇〇11^代(1&1&)之儲存方式,其中,比較資料((:〇卿狀(^血)的儲 存位置為唯讀記憶體(ROM)的一部分。 > 2·如申請專利範圍第丨項之一種唯讀記憶體内建自我測試電路 (ROMBIST)中的比較資料(compare如也)之儲存方式其中唯讀 記憶體(ROM)的一部分為唯讀記憶體(R0M)的最後一組位址。 3·如申請專利範圍第1項之一種唯讀記憶體内建自我測試電路 (ROMBIST)中的比較資料(compare data)之儲存方式,其中唯讀 記憶體(ROM)的一部分使用至少一個唯讀記憶體(R〇M)的一部
4·如申請專利範圍第1項之一種唯讀記憶體内建自我測試電路 (ROMBIST)中的比較資料(compare data)之儲存方式,其中唯讀 記憶體(ROM)的一部分為另一個唯讀記憶體(R〇M)的一部分。 5·如申請專利範圍第1項之-種唯讀記憶體内建自我測試電路 (ROMBIST)中的比較資料(comparedata)之儲存方式,其中唯讀 12 1260641 圮憶體(ROM)的一部分使用至少一種唯讀記憶體(R〇M)的一部 分。 6·如申請專利範圍第1項之一種唯讀記憶體内建自我測試電路 (R0MBIST)中的比較資料(compare data)之儲存方式,其中唯讀 記憶體(ROM)的一部分為另一種唯讀記憶體(R〇M)的一部分。 7·如申清專利範圍第1項之一種唯讀記憶體内建自我測試電路 (ROMBIST)中的比較資料(compare data)之儲存方式,其中唯讀 記憶體(ROM)為光罩式唯讀記憶體(MASKROM;)。 8·如申請專利範圍第1項之一種唯讀記憶體内建自我測試電路 (ROMBIST)中的比較資料(compare data)之儲存方式,其中唯讀 記憶體(ROM)為可清除程式化唯讀記憶體(EPR〇M)。 9·如申請專利範圍第1項之一種唯讀記憶體内建自我測試電路 (ROMBIST)中的比較資料(compare data)之儲存方式,其中唯讀 0己|思體(ROM)為電子式可清除程式化唯讀記憶體(ggpRQM)。 10·如申請專利範圍第1項之一種唯讀記憶體内建自我測試電路 (ROMBIST)中的比較資料(compare data)之儲存方式,其中唯讀 13 1260641 記憶體(ROM)為單次可程式化唯讀記憶體(οτρ ROM)。 11·如申請專利範圍第丨項之一種唯讀記憶體内建自我測試電路 (ROMBIST)中的比較資料(compare data)之儲存方式,其中唯气 記憶體(ROM)為編譯式唯讀記憶體(c〇mpile R〇M)。
12·如申請專利範圍第1項之一種唯讀記憶體内建自我測軾命 (ROMBIST)中的比較資料(compare (jata)之儲存 記憶體(ROM)由熔絲(Fuse)所組成。 选 _____________ . A ’ *中唯讀 十一、圖式:
14
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US5631913A (en) * | 1994-02-09 | 1997-05-20 | Matsushita Electric Industrial Co., Ltd. | Test circuit and test method of integrated semiconductor device |
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US20040193984A1 (en) * | 2003-03-28 | 2004-09-30 | Stmicroelectronics Inc. | Signature Cell |
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