TW201644201A - 組合／序列脈衝寬度調變 - Google Patents

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史蒂芬 保林
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Abstract

數個標準PWM產生器產生可用於驅動針對全橋(Full-Bridge)、前饋(Feed-Forward)、推挽(Push-Pull)、相移(Phase-Shift)、零電壓轉換(ZVT)及其他開關模式電源供應(SMPS)轉換拓撲之功率級之PWM信號。此等PWM信號可饋入至一組合邏輯區塊之邏輯功能。將合適PWM信號選擇為運算元以及以此等輸入運算元操作之(若干)所要邏輯功能。接著，所得組合PWM信號可直接使用或可在輸出至一應用電路之前饋經停滯時間處理電路。除了組合邏輯功能外，序列邏輯功能亦可用於提供序列PWM信號，例如同步序列、非同步序列及/或序列組合PWM信號。

Description

組合/序列脈衝寬度調變 [相關申請案之交叉參考]
本申請案主張2015年3月12日申請之共同擁有之美國臨時專利申請案62/132,025號之優先權，該案之全文出於所有目的以引用之方式併入本文中。
本發明係關於組合脈衝寬度調變(PWM)，特定言之，本發明係關於PWM模組及用於包括此一組合PWM模組之微控制器中之周邊單元。
功率轉換應用正變得越來越精密。諸多功率轉換電路使用多個PWM產生器來控制功率流。通常存在多級PWM控制電路，其中一後級所需之PWM係依賴於在一前級中發生之行為(諸如同步整流)。當前級PWM之行為與外部非同步事件相關時，產生後級所需之PWM將變得困難。
廣泛使用同步整流器(例如，同步驅動場效電晶體(Sync-FET))，此係因為相較於標準整流器二極體，該等同步整流器具有更好之功率效率。控制同步整流器係有挑戰性的，此係因為需要在同步整流器之前對第一功率轉換級中發生之行為作出反應。現存同步整流器控制方法需要額外控制電路或額外計算資源來規劃正進行之功率級中之事件(諸如電流限制)且對其作出反應。圖5展示利用複數個PWM信號驅動 且用於一開關模式電源供應(SMPS)中之裝置之一典型應用。
歷史上，PWM模組係類比設計或用於馬達控制之十分簡單之數位設計。在此之前，複雜計算及/或類比電路需要用於功率裝置(諸如(例如)同步整流器)之下游控制。
因此，需要產生PWM信號來控制需要較少或不需要處理器計算且回應於諸如源PWM信號上之電流限制之非同步事件之下游功率裝置(諸如同步整流器)之一方法。
根據一實施例，用於產生一脈衝寬度調變(PWM)信號之設備，該PWM信號係出自兩個其他PWM信號之一邏輯組合，該設備可包括：一第一PWM產生器，其經調適以用於產生一第一PWM信號；一第二PWM產生器，其經調適以用於產生一第二PWM信號；及第一組合邏輯，其經調適以用於接收第一及第二PWM信號且自該等第一及第二PWM信號產生一第三PWM信號。
根據一進一步實施例，第一組合邏輯可包括複數個邏輯功能。根據一進一步實施例，複數個邏輯功能可選自由AND、NAND、OR、NOR、XOR及NXOR閘邏輯組成之群組之任何一或多者。根據一進一步實施例，第一PWM產生器可經調適以用於產生第一PWM信號及一逆第一PWM信號。根據一進一步實施例，第一PWM信號及逆第一PWM信號可耦合至第一組合邏輯。根據一進一步實施例，第二PWM產生器可經調適以用於產生第二PWM信號及一逆第二PWM信號。根據一進一步實施例，第二PWM信號及逆第二PWM信號可耦合至第一組合邏輯。根據一進一步實施例，第二組合邏輯可經調適以用於接收第一及第二PWM信號且自該等第一及第二PWM信號產生一第四PWM信號。根據一進一步實施例，第二組合邏輯可包括複數個邏輯功能。根據一進一步實施例，第一PWM信號及逆第一PWM信號可 耦合至第二組合邏輯。根據一進一步實施例，第二PWM信號及逆第二PWM信號可耦合至第二組合邏輯。
根據一進一步實施例，複數個邏輯功能係可選擇的。根據一進一步實施例，可選擇之複數個邏輯功能可經程式化。根據一進一步實施例，該經程式化之可選擇之複數個邏輯功能可儲存於一記憶體中。根據一進一步實施例，該記憶體可為至少一組態暫存器。根據一進一步實施例，複數個邏輯功能係可選擇的，所選擇之複數個邏輯功能可經程式化且經程式化之該所選擇之複數個邏輯功能可儲存於一記憶體中。根據一進一步實施例，第一序列邏輯可經調適以用於接收第一及第二PWM信號且自該等第一及第二PWM信號產生第三PWM信號。根據一進一步實施例，第二序列邏輯可經調適以用於接收第一及第二PWM信號且自該等第一及第二PWM信號產生第四PWM信號。根據一進一步實施例，第一序列邏輯可選自由同步及非同步序列邏輯組成之群組。根據一進一步實施例，一微控制器可包括PWM設備且經調適以選擇其之複數個邏輯功能之特定者。
根據另一實施例，用於產生一脈衝寬度調變(PWM)信號之方法，該PWM信號係出自兩個其他PWM信號之一邏輯組合，該方法可包括以下步驟：利用一第一PWM產生器產生一第一PWM信號；利用一第二PWM產生器產生一第二PWM信號；且自第一及第二PWM信號之一邏輯組合產生一第三PWM信號。
根據該方法之一進一步實施例，邏輯組合可選自由AND、NAND、OR、NOR、XOR及NXOR邏輯組成之群組。根據該方法之一進一步實施例，該方法可包括自第一及第二PWM信號之一第二邏輯組合產生一第四PWM信號之步驟。根據該方法之一進一步實施例，該方法可包括產生第三PWM信號與第四PWM信號之間之一停滯時間之步驟。根據該方法之一進一步實施例，該方法可包括用一非同步 PWM信號替代第三PWM信號之步驟。根據該方法之一進一步實施例，非同步PWM信號可為一電流限制PWM信號。根據該方法之一進一步實施例，該方法可包括自第一及第二PWM信號之一序列邏輯組合產生第三PWM信號之步驟。
根據另一實施例，用於產生一脈衝寬度調變(PWM)信號之方法，該PWM信號係出自兩個其他PWM信號之一序列邏輯組合，該方法可包括以下步驟：利用一第一PWM產生器產生一第一PWM信號；利用一第二PWM產生器產生一第二PWM信號；且自第一及第二PWM信號之一序列邏輯組合產生一第三PWM信號。
150‧‧‧第一脈衝寬度調變(PWM)產生器
152‧‧‧第一停滯時間邏輯
154‧‧‧第二脈衝寬度調變(PWM)產生器
156‧‧‧第二停滯時間邏輯
200‧‧‧組合脈衝寬度調變(PWM)模組
200A‧‧‧組合脈衝寬度調變(PWM)模組
202‧‧‧第一多工器
204‧‧‧第二多工器
206‧‧‧第一解多工器
208‧‧‧第二解多工器
210‧‧‧邏輯閘
212‧‧‧第三多工器
214‧‧‧第一暫存器
300‧‧‧組合脈衝寬度調變(PWM)模組
300A‧‧‧組合脈衝寬度調變(PWM)模組
322‧‧‧第四多工器
324‧‧‧第五多工器
326‧‧‧第三解多工器
328‧‧‧第四解多工器
330‧‧‧邏輯閘
332‧‧‧第六多工器
334‧‧‧第二暫存器
460‧‧‧信號ACPWMH
462‧‧‧停滯時間邏輯
464‧‧‧多工器
466‧‧‧多工器
468‧‧‧信號ACPWML
470‧‧‧暫存器/控制暫存器
500‧‧‧微控制器
500a‧‧‧微控制器
550‧‧‧第一脈衝寬度調變(PWM)產生器及停滯時間邏輯
552‧‧‧第二脈衝寬度調變(PWM)產生器及停滯時間邏輯
554‧‧‧數位處理器記憶體
556‧‧‧組合邏輯
556a‧‧‧組合及序列邏輯
558‧‧‧極性選擇XOR閘
560‧‧‧組合儲存暫存器
可藉由參考結合隨附圖式之以下描述獲取對本發明之一更完整之理解，其中：圖1繪示根據本發明之教示之具有停滯時間邏輯之PWM產生器之示意方塊圖；圖2、圖2A、圖3及圖3A繪示根據本發明之特定實例性實施例之PWM組合邏輯區塊之示意圖；圖4繪示根據本發明之教示之同步/非同步PWM選擇及停滯時間邏輯之一示意方塊圖；圖5繪示根據本發明之特定實例性實施例之包括多個PWM產生器、一組合邏輯區塊及極性選擇之一微控制器中之一PWM巨集塊；圖5A繪示根據本發明之特定實例性實施例之包括多個PWM產生器、一組合及序列邏輯區塊及極性選擇之一微控制器中之一PWM巨集塊；圖6繪示根據本發明之教示之一H橋初級及次級同步FET整流器之一示意圖；圖7繪示根據本發明之教示之當一SMPS處於連續導電模式時共同 提供同步整流控制之PWM信號OR之一示意時序圖；圖8繪示根據本發明之教示之當一SMPS處於不連續導電模式時共同提供同步整流控制之PWM信號AND之圖式之一示意時序圖；圖9繪示根據本發明之教示之共同提供用於一交錯正向轉換器之整流之PWM信號NOR之一示意時序圖；及圖10繪示根據本發明之教示之共同提供LED照明或馬達控制之PWM信號AND之一示意時序圖。
儘管本發明易於接受各種修改及替代形式，但在圖式中已展示且在本文中詳細描述本發明之特定實例性實施例。然而應瞭解，特定實例性實施例之本文中之描述不意欲將本發明限制於本文揭示之特定形式。
根據本發明之各種實施例，係其他PWM信號之邏輯處理之PWM信號之一使用者可控制產物可具有使用者可選擇組合及/或序列邏輯功能。
根據本發明之各種實施例，可提供基於複數個輸入PWM信號產生「衍生PWM」信號之一方法。各種實施例經由接收源PWM信號之組合及/或序列邏輯提供一微控制器裝置中之PWM信號之產物。微控制器係一單一積體電路晶粒(晶片)上之系統，該系統通常可包括一中央處理單元、記憶體、複數個輸入/輸出埠及各種周邊裝置。
數個標準PWM產生器產生可用於驅動針對全橋(Full-Bridge)、前饋(Feed-Forward)、推挽(Push-Pull)、相移(Phase-Shift)、零電壓轉換(ZVT)及其他開關模式電源供應(SMPS)轉換拓撲之功率級之PWM信號。此等PWM信號可饋入本文揭示及主張之組合邏輯區塊。使用者(經由控制暫存器)可選擇合適PWM信號作為運算元，且選擇在輸入運算元上操作之(若干)所要邏輯功能。所得組合PWM信號可直接使用或 在輸出至一應用電路之前饋經停滯時間處理電路。除了組合邏輯功能外，序列邏輯功能亦可用於提供序列PWM信號，例如同步序列、非同步序列及/或序列組合PWM信號。
現在參考圖式，示意地繪示特定實例性實施例之細節。圖式中之相同元件由相同數字表示，且類似元件將由具有一不同小寫字母後綴之相同數字表示。
參考圖1，其繪示根據本發明之教示之具有停滯時間邏輯之PWM產生器之示意方塊圖。一第一PWM產生器150可產生耦合至一第一停滯時間邏輯152之原第一PWM信號RPWM1H及RPWM1L，該第一停滯時間邏輯152可產生用於防止SMPS功率切換中之「電流過衝」之第一PWM信號PWM1H及PWM1L。一第二PWM產生器154可產生耦合至一第二停滯時間邏輯156之原第二PWM信號RPWM2H及RPWM2L，該第二停滯時間邏輯156可產生用於防止SMPS功率切換中之「電流過衝」之第二PWM信號PWM2H及PWM2L。
參考圖2、圖2A、圖3及圖3A，其描繪根據本發明之特定實例性實施例之PWM組合邏輯區塊之示意圖。在圖2中，一組合PWM模組200具有耦合至一第一多工器202及一第二多工器204之信號RPWM1H、RPWM1L、RPWM2H、RPWM2L、PWM1H、PWM1L、PWM2H及PWM2L。第一多工器202之輸出耦合至一第一解多工器206之一輸入，且第二多工器204之輸出耦合至一第二解多工器208之一輸入。第一解多工器206及第二解多工器208之輸出分別耦合至複數個不同邏輯閘210之第一輸入及第二輸入。一第三多工器212具有耦合至複數個不同邏輯閘210之各自輸出之輸入且用於選擇複數個不同邏輯閘210之哪個輸出將耦合至第三多工器212之輸出以提供PWM信號CPWM1H。一第一暫存器214可用於維持多工器及解多工器輸入/輸出操縱選擇且可由此組合PWM模組200之一使用者經程式化。
在圖2A中，一組合PWM模組200A具有耦合至一第一多工器202及一第二多工器204之信號RPWM1H、RPWM1L、RPWM2H、RPWM2L、PWM1H、PWM1L、PWM2H及PWM2L。第一多工器202之輸出耦合至複數個不同邏輯閘210之第一輸入。第二多工器204之輸出耦合至複數個不同邏輯閘210之第二輸入。一第三多工器212具有耦合至複數個不同邏輯閘210之各自輸出之輸入且用於選擇複數個不同邏輯閘210之哪個輸出將耦合至第三多工器212之輸出以提供PWM信號CPWM1H。一第一暫存器214可用於維持多工器及解多工器輸入/輸出操縱選擇且可由此組合PWM模組200A之一使用者經程式化。
在圖3中，一組合PWM模組300具有耦合至一第四多工器322及一第五多工器324之信號RPWM1H、RPWM1L、RPWM2H、RPWM2L、PWM1H、PWM1L、PWM2H及PWM2L。第四多工器322之輸出耦合至一第三解多工器326之一輸入，且第五多工器324之輸出耦合至一第四解多工器328之一輸入。第三解多工器326及第四解多工器328之輸出分別耦合至複數個不同邏輯閘330之第一輸入及第二輸入。一第六多工器332具有耦合至複數個不同邏輯閘330之各自輸出之輸入且用於選擇複數個不同邏輯閘330之哪個輸出將耦合至第六多工器332之輸出以提供PWM信號CPWM1L。一第二暫存器334可用於維持多工器及解多工器輸入/輸出操縱選擇且可由此組合PWM模組300之一使用者經程式化。
在圖3A中，一組合PWM模組300A具有耦合至一第四多工器322及一第五多工器324之信號RPWM1H、RPWM1L、RPWM2H、RPWM2L、PWM1H、PWM1L、PWM2H及PWM2L。第四多工器322之輸出耦合至複數個不同邏輯閘330之第一輸入。第五多工器324之輸出耦合至複數個不同邏輯閘330之第二輸入。一第六多工器332具有耦合至複數個不同邏輯閘330之各自輸出之輸入且用於選擇複數個不同 邏輯閘330之哪個輸出將耦合至第六多工器332之輸出以提供PWM信號CPWM1HL。一第二暫存器334可用於維持多工器及解多工器輸入/輸出操縱選擇且可由此組合PWM模組300A之一使用者經程式化。
圖2、圖2A、圖3及/或圖3A中展示之多工器及/或解多工器可由一X-Y切換矩陣代替且根據所展示之(若干)暫存器而經控制。可設想且在本發明之範疇內，具有數位電子積體電路設計中之一般技術且熟知本發明之優勢者將發現可據此起作用之其他電路設計。
參考圖4，其描繪根據本發明之教示之同步/非同步PWM選擇及停滯時間邏輯之一示意方塊圖。在圖4中，多工器464及466用於同步PWM信號CPWM1H及CPWM1L與非同步PWM信號ACPWMH 460及ACPWML 468之間之雙切換，例如過電流警報/跳脫。組合PWM模組200、200a、300及/或300A中之CPWM1H及CPWM1L PWM信號可進一步利用停滯時間邏輯462「調節」。一暫存器470可用於儲存且控制同步與非同步PWM信號之間之選擇。多工器464及466中之輸出PWM3H及PWM3L分別可用於驅動SMPS電路。使用者可使得控制暫存器470經程式化以選擇組合PWM信號之停滯時間經處理版本或直接使用組合區塊輸出之輸出。
參考圖5，其描繪根據本發明之特定實例性實施例之包括多個PWM產生器、一組合邏輯區塊及極性選擇之一微控制器中之一PWM巨集塊。一微控制器(通常由元件符號500表示)可包括一數位處理器及記憶體554、一第一PWM產生器及停滯時間邏輯550、一第二PWM產生器及停滯時間邏輯552、組合邏輯556、複數個極性選擇XOR閘558及一組合儲存暫存器560。組合邏輯556可包括圖2、圖2A、圖3、圖3A中展示之電路或功能邏輯電路設計中之任何其他相當者。組合邏輯556及複數個極性選擇XOR閘558可為使用者提供自由第一PWM產生器550及第二PWM產生器552提供之PWM信號導出之各種額外 PWM信號之受控選擇。組合暫存器560可使用複數個位元來儲存用於組合邏輯556中之組合邏輯組態。組合暫存器560可為數位處理器記憶體554之一部分或微控制器500中之一分離儲存暫存器。PWM輸出可在微控制器500封裝之外部連接節點(接腳)上經多工化且此等經多工化之接腳之所要組態可經程式化且儲存於組態暫存器(圖中未展示)中。
參考圖5A，其描繪根據本發明之特定實例性實施例之包括多個PWM產生器、一組合及序列邏輯區塊及極性選擇之一微控制器中之一PWM巨集塊。圖5A中展示之微控制器500a以實質上相同於圖5中展示之微控制器500之方式起作用且可進一步包括組合及序列邏輯556a。序列邏輯係輸出不僅與(若干)輸入之現有值相關且與過去輸入之一序列之邏輯之一類型相關，例如，序列邏輯可被認為係具有記憶體之組合邏輯。序列邏輯可進一步被定義為同步或非同步，其中同步序列邏輯與一時脈輸入(可為所選擇之PWM信號之一者)相關，且非同步序列邏輯不藉由一時脈信號同步。出於所有目的設想存在同步及非同步序列邏輯兩者之諸多實例。
參考圖6，其描繪根據本發明之教示之一H橋初級及次級同步FET整流器之一示意圖。圖1至圖4中導出之PWM信號可用於驅動圖6中展示之FET功率切換。廣泛使用同步整流器(Sync-FET)，此係因為相較於標準整流器二極體，該等同步整流器具有更好之功率效率。控制(Sync-FET)係有挑戰性的，此係因為需要在同步整流器之前對第一功率轉換級中發生之行為作出反應。現存(Sync-FET)控制方法需要額外控制電路或額外計算資源來規劃正進行之功率級中之事件(諸如電流限制)且對其作出反應。圖2、圖2A、圖3及/或圖3A中展示之組合PWM模組產生PWM信號來控制需要較少處理器計算且回應於諸如源PWM信號上之電流限制之非同步事件之同步整流器。一些實例性 PWM波形時序圖及描述如下：參考圖7，其描繪根據本發明之教示之當一SMPS處於連續導電模式時共同提供同步整流控制之PWM信號OR之一示意時序圖。PWM信號PWM1H係具有PWM2L之OR，且PWM1L係具有PWM2H之OR以產生兩個新PWM信號，如圖7中所展示。此等新PWM信號可用於控制SMPS處於連續導電模式之同步整流器。
參考圖8，其描繪根據本發明之教示之當一SMPS處於不連續導電模式時共同提供同步整流控制之PWM信號AND之圖式之一示意時序圖。PWM信號PWM1H係具有PWM2L之AND，且PWM1L係具有PWM2H之AND以產生兩個新PWM信號，如圖8中所展示。此等新PWM信號可用於當PSU處於不連續導電模式時控制同步整流器。
參考圖9，其描繪根據本發明之教示之共同提供用於一交錯正向轉換器之整流之PWM信號NOR之一示意時序圖。圖9展示當PWM1H信號係具有PWM2L信號之NOR時之逆結果。此新PWM信號可用於控制一SMPS中之交錯同步整流。
參考圖10，其描繪根據本發明之教示之共同提供LED照明或馬達控制之PWM信號AND之一示意時序圖。應注意，展示之信號未按比例繪製。此電路可有效控制LED燈之亮度或馬達速度。使用序列組合邏輯之一優勢係當較低頻率PWM2位於一低邏輯處時可關閉較高頻率PWM1信號以節約用電且接著當PWM2信號返回至一高邏輯處時PWM1信號可同步(電路未展示)例如經鎖相至PWM2信號之上升邊緣，藉此自AND閘提供一清楚(無尖峰)PWM輸出信號。
460‧‧‧信號ACPWMH
462‧‧‧停滯時間邏輯
464‧‧‧多工器
466‧‧‧多工器
468‧‧‧信號ACPWML
470‧‧‧暫存器/控制暫存器

Claims (28)

  1. 一種用於產生一脈衝寬度調變(PWM)信號之設備，該PWM信號係出自兩個其他PWM信號之一邏輯組合，該設備包括：一第一PWM產生器，其經調適以用於產生一第一PWM信號；一第二PWM產生器，其經調適以用於產生一第二PWM信號；及第一組合邏輯，其經調適以用於接收該等第一及第二PWM信號且自該等第一及第二PWM信號產生一第三PWM信號。
  2. 如請求項1之設備，其中該第一組合邏輯包括複數個邏輯功能。
  3. 如請求項2之設備，其中該複數個邏輯功能選自由AND、NAND、OR、NOR、XOR及NXOR閘邏輯組成之群組之任何一或多者。
  4. 如請求項1之設備，其中該第一PWM產生器經調適以用於產生該第一PWM信號及一逆第一PWM信號。
  5. 如請求項4之設備，其中該第一PWM信號及該逆第一PWM信號耦合至該第一組合邏輯。
  6. 如請求項5之設備，其中該第二PWM產生器經調適以用於產生該第二PWM信號及一逆第二PWM信號。
  7. 如請求項6之設備，其中該第二PWM信號及該逆第二PWM信號耦合至該第一組合邏輯。
  8. 如請求項3之設備，其進一步包括第二組合邏輯，該第二組合邏輯經調適以用於接收該等第一及第二PWM信號且自該等第一及第二PWM信號產生一第四PWM信號。
  9. 如請求項8之設備，其中該第二組合邏輯包括複數個邏輯功能。
  10. 如請求項4之設備，其中該第一PWM信號及該逆第一PWM信號 耦合至第二組合邏輯。
  11. 如請求項6之設備，其中該第二PWM信號及該逆第二PWM信號耦合至第二組合邏輯。
  12. 如請求項2之設備，其中該複數個邏輯功能係可選擇的。
  13. 如請求項12之設備，其中該可選擇的複數個邏輯功能可程式化。
  14. 如請求項13之設備，其中該可程式化之可選擇的複數個邏輯功能儲存於一記憶體中。
  15. 如請求項14之設備，其中該記憶體係至少一組態暫存器。
  16. 如請求項9之設備，其中該複數個邏輯功能係可選擇的，該複數個邏輯功能之該選擇可程式化且該可程式化之選擇的複數個邏輯功能儲存於一記憶體中。
  17. 如請求項1之設備，其進一步包括經調適以用於接收該等第一及第二PWM信號且自該等第一及第二PWM信號產生該第三PWM信號之第一序列邏輯。
  18. 如請求項8之設備，其進一步包括經調適以用於接收該等第一及第二PWM信號且自該等第一及第二PWM信號產生該第四PWM信號之第二序列邏輯。
  19. 如請求項17之設備，其中該第一序列邏輯選自由同步及非同步序列邏輯組成之群組。
  20. 一種微控制器，其包括如請求項12之PWM設備，其中該微控制器經調適以選擇該複數個邏輯功能之特定者。
  21. 一種用於產生一脈衝寬度調變(PWM)信號之方法，該PWM信號係出自兩個其他PWM信號之一邏輯組合，該方法包括以下步驟：利用一第一PWM產生器產生一第一PWM信號； 利用一第二PWM產生器產生一第二PWM信號；且自該等第一及第二PWM信號之一邏輯組合產生一第三PWM信號。
  22. 如請求項21之方法，其中該邏輯組合選自由AND、NAND、OR、NOR、XOR及NXOR邏輯組成之群組。
  23. 如請求項21之方法，其進一步包括自該等第一及第二PWM信號之一第二邏輯組合產生一第四PWM信號之步驟。
  24. 如請求項23之方法，其進一步包括產生該第三PWM信號與該第四PWM信號之間之一停滯時間之步驟。
  25. 如請求項21之方法，其進一步包括用一非同步PWM信號替代該第三PWM信號之步驟。
  26. 如請求項25之方法，其中該非同步PWM信號係一電流限制PWM信號。
  27. 如請求項21之方法，其進一步包括自該等第一及第二PWM信號之一序列邏輯組合產生該第三PWM信號之步驟。
  28. 一種用於產生一脈衝寬度調變(PWM)信號之方法，該PWM信號係出自兩個其他PWM信號之一序列邏輯組合，該方法包括以下步驟：利用一第一PWM產生器產生一第一PWM信號；利用一第二PWM產生器產生一第二PWM信號；且自該等第一及第二PWM信號之一序列邏輯組合產生一第三PWM信號。
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