SU957210A1 - Устройство микропрограммного управлени - Google Patents
Устройство микропрограммного управлени Download PDFInfo
- Publication number
- SU957210A1 SU957210A1 SU803254699A SU3254699A SU957210A1 SU 957210 A1 SU957210 A1 SU 957210A1 SU 803254699 A SU803254699 A SU 803254699A SU 3254699 A SU3254699 A SU 3254699A SU 957210 A1 SU957210 A1 SU 957210A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- decoder
- input
- conditions
- condition
- output
- Prior art date
Links
Landscapes
- Executing Machine-Instructions (AREA)
Description
Изобретение относится к вычислительной технике и может найти применение при построении вычислительных устройств с последовательным способом представления 'информации,’ в частности микрокалькуляторов. 5
Известно устройство микропрограммного управления, выполненное на программируемой логической матрице (ПЛМ), содержащее ПЛМ микропрограмм, первые входы которой соединены с выходом ПЛМ микропрограмм, а вторые - с шинами входных логических условий Cl }.
Недостатком такого устройства микропрограммного управления являются большие размеры матрицы при большом количестве различных входных логических условий. Это приводит к усложнению устройства, особенно при его интегральном исполнении. го
Известно устройство микропрограммного управления, содержащее ПЛМ микропрограмм, ПЛМ условий, регистр условий и блок синхронизации. Выход
ПЛМ микропрограмм соединен с первым входом ПЛМ условий и входом ПЛМ микропрограмм, внешний информационный вход устройства соединен с информационным входом регистра условий, выход блока синхронизации соединен с входом регистра условий, выходы которого соединены с входами ПЛМ условий [2].
Недостатком этого устройства является его сложность, так как содержащийся в нем регистр условий - многоразрядный, поскольку на нем должны быть запомнены все логические условия, которые могут воздействовать на входы ПЛМ микропрограмм.
Кроме того, блок синхронизации должен содержать довольно сложную схему, вырабатывающую последовательность синхроимпульсов для занесения всех условий на регистр условий. А связь блока синхронизации через регистр условий с ПЛМ условий усложняет устройтсво, приводит к увеличе
957210 4 нию площади ПЛИ условий при ее интег ральном испольнении, поскольку количество различных условий, в реальных устройствах велико.
Цель изобретения - упрощение устройства .
зации. На выходах дешифратора 2 условий формируется определенная совокупность. синхроимпульсов для каждого адреса, поступающего на первый вход дешифратора 2 условий. Эта совокупность синхроимпульсов соответствует
Поставленная цель достигается тем, что в устройство микропрограммного управления, содержащее дешифратор микропрограмм, первый выход которого , является информационным выходом устройства, второй выход соединен с первым адресным входом дешифратора микропрограмм и с первым информационным входом дешифратора условий, первый , выход блока синхронизации подключен к входу синхронизации дешифратора микропрограмм, регистр условий, информационный вход которого подключен к входу логических условий . устройства введены элемент ИЛИ, вход которого соединен с информационным выходом дешифратора условий) а выход - с входом сдвига регистра условий, информационный выход которого подключен к второму адресному входу дешифратора микропрограмм, второй выход блока синхронизации подключен к второму информационному входу дешифратора условий , ' .
На фиг. 1 изображена функционалы-‘ чая схема устройства; на фиг. 2 схема выполнения дешифратора микропрограмм; на фиг. 3 схема выполнения дешифратора условий.
Устройство содержит дешифратор 1 : микропрограмм, дешифратор 2 условий, регистр 3 условий, блок 4 синхронизации, элемент ИЛИ 5, вход 6 логических условий устройства, информационный выход 7 устройства.
Дешифратор микропрограмм (фиг. 2) представляет собой программируемую логическую матрицу и содержит регистр 8, блок элементов И 9, блок элементов ИЛИ 10, группу инверторов 11.
Дешифратор условий (фиг.. 3) представляет собой программируемую логическую матрицу и содержит блок элементов И 12 и группу инверторов 13.
Устройство работает следующим обра зом .
С первого выхода дешифратора 1 микропрограмм на первый вход дешифратора 2 условий поступает код адреса следующего состояния дешифратора 1 микропрограмм. На вторые входы.дешифратора 2 условий поступают синхронизирующие. сигналы из блока 4 синхрони моментам появления логических условий на входе 6 в данном адресе дешифратора 1 микропрограмм. Выходы дешифратора 2 условий соединены с входами элемента ИЛИ 5, на выходе которого появится последовательность упомянутых выше импульсов, которая поступит затем на сдвиговый вход регистра 3 условий, на вход 6 последовательно во времени и синхронно с импульсами на сдвиговом входе регистра 3 условий поступают логические условия из внешнего регистра данных. Таким образом, в регистр 3 условий будет записана совокупность условий, необходимых для данного адреса дешифратора! микропрограмм. После этого из блока 4 синхронизации на вход дешифратора 1 микропрограмм поступает синхроимпульс, обеспечивающий считывание из дешифратора 1 микропрограмм нового выходного сигнала', поступающего на выход 7, и следующего адреса, поступающего на вход дешифратора 2 условий.
Устройство применимо для случая последовательного способа представления информации в регистре данных, когда логические условия формируются последовательно на входе 6. Предлагаемое устройство выгодно отличается от известного, так как требует значительно меньших аппаратурных затрат, поскольку разрядность регистра 3 условий выбирается, исходя из количества условий, проверяемых в каждом конкретном адресе дешифратора 1 микропрограмм, что значительно меньше общего количества условий. Кроме того упрощается и блок 4 синхронизации, из которого исключается схема, специально формирующая синроимпульсы для записи всех логических условий в регистратор 4 условий, поскольку формирование синхроимпульсов из синхронизирующих сигналов выполняется непосредственно в самом дешифраторе 2 условий одновременно с расшифровкой соответствующего кода адреса, поступающего на первый вход дешифратора 2 условий.
Claims (2)
1.Микроэлектроника. М., Электронна техника. Э7,свр. 3, вып. 5 с. 22-26.
2.Микросхема К U5 ИКб, HyS.tSy.Oie 33 схема принципиальна (прототип).
J
Ж
/
/
. /
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU803254699A SU957210A1 (ru) | 1980-12-25 | 1980-12-25 | Устройство микропрограммного управлени |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU803254699A SU957210A1 (ru) | 1980-12-25 | 1980-12-25 | Устройство микропрограммного управлени |
Publications (1)
Publication Number | Publication Date |
---|---|
SU957210A1 true SU957210A1 (ru) | 1982-09-07 |
Family
ID=20945498
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU803254699A SU957210A1 (ru) | 1980-12-25 | 1980-12-25 | Устройство микропрограммного управлени |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU957210A1 (ru) |
-
1980
- 1980-12-25 SU SU803254699A patent/SU957210A1/ru active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
SU957210A1 (ru) | Устройство микропрограммного управлени | |
SU1425825A1 (ru) | Делитель частоты с переменным коэффициентом делени | |
SU1550525A1 (ru) | Устройство дл сопр жени канала св зи с ЭВМ | |
SU1737727A1 (ru) | Управл емый делитель частоты с дробным коэффициентом делени | |
SU1062702A1 (ru) | Микропрограммное управл ющее устройство | |
SU1388951A1 (ru) | Буферное запоминающее устройство | |
JP2924968B2 (ja) | 時間双方向シミュレーション装置 | |
SU1291988A1 (ru) | Устройство дл ввода информации | |
SU1589288A1 (ru) | Устройство дл выполнени логических операций | |
SU1553978A1 (ru) | Устройство дл тестового контрол цифровых блоков | |
SU739516A1 (ru) | Устройство дл сопр жени | |
SU746488A1 (ru) | Устройство дл сопр жени | |
SU1474730A1 (ru) | Устройство дл отображени информации | |
SU1381479A1 (ru) | Устройство дл цифровой индикации | |
SU1509920A1 (ru) | Матричное вычислительное устройство | |
SU1103229A1 (ru) | Устройство микропрограммного управлени | |
SU1238091A1 (ru) | Устройство дл вывода информации | |
SU1709293A2 (ru) | Устройство дл ввода информации | |
SU1550561A1 (ru) | Устройство дл сбора и регистрации данных | |
SU1458876A1 (ru) | Устройство дл воспроизведени функций | |
SU1667082A1 (ru) | Устройство мажорировани | |
SU1176327A1 (ru) | Микропрограммное устройство управлени | |
SU1283858A1 (ru) | Устройство дл контрол блоков пам ти | |
SU959078A1 (ru) | Микропрограммное устройство управлени | |
SU1437920A1 (ru) | Ассоциативное запоминающее устройство |