SU911501A2 - Exchange control device - Google Patents
Exchange control device Download PDFInfo
- Publication number
- SU911501A2 SU911501A2 SU802864929A SU2864929A SU911501A2 SU 911501 A2 SU911501 A2 SU 911501A2 SU 802864929 A SU802864929 A SU 802864929A SU 2864929 A SU2864929 A SU 2864929A SU 911501 A2 SU911501 A2 SU 911501A2
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- block
- exchange
- signal
- readiness
- time
- Prior art date
Links
Description
(5+)-УСТРОЙСТВО УПРАВЛЕНИЯ ОБМЕНОМ(5+) - EXCHANGE MANAGEMENT DEVICE
Изобретение относитс к вычислительной технике, и может быть исполь зовано в устройствах управлени обменом информацией между ЭВМ и внешни ми устройствами. По основному авт. св. № 7328 2 известно устройство управлени обменом , содержащее блок сопр жени , соединенный с первыми входом и выходом соответственно с первыми выходом и , j входом блока хранени признаков готов ностей, вторыми входом и выходом соответственно с входной и выходной информационными магистрал ми абонентов , а входом - выходом с информационной магистралью процессора, блок микрокоманд, соединенный первым и вторым входами - выходами соответственно с магистрал ми управл ющих сиг налов процессора и абонентов, первым выходом - со входом счетчика номеров абонентов, выход которого подключен к первому входу блока хранени признаков готовностей и адресной магистрали абонентов, регистр готовностей , первый вход которого соединен со вторым выходом блока хранени признаков готовностей, третьи вход и выход которого соответственно соединены со вторым выходом и входом блока микрокоманд, и блок контрол готовностей, включающий узел управлени , соединенный группой выходов и группой входов соответственно с группой входов и группой выходов счетчика времени, первый выход узла управлени подключен к первому входу блока микрокоманд, третий выход которого соединен с управл ющим входом регистра готовностей, первый и второй выходы которого подключены соответственно с первым и вторым входами узла управлени и магистрал ми готовности источника и приемника 1, Недостатком atoro устройства вл етс низка пропускна способность, поскольку в качестве контрольного интервала длительности обмена испрль39The invention relates to computing and can be used in control devices for the exchange of information between computers and external devices. According to the main author. St. No 7328 2 knows an exchange control device comprising an interface unit connected to the first input and output, respectively, to the first output and j input of the readiness sign storage unit, the second input and output respectively to the subscriber's input and output information highways, and the output to the information highway of the processor, the block of microinstructions connected by the first and second inputs - the outputs, respectively, to the highways of the control signals of the processor and subscribers, the first output to the input of the counter but Subscriber ers, the output of which is connected to the first input of the readiness signs storage unit and the subscribers' address line, the readiness register, the first input of which is connected to the second output of the readiness signs storage unit, the third input and output of which are respectively connected to the second output and input of the microcommand block, and the block readiness control, including a control node connected by a group of outputs and a group of inputs, respectively, to a group of inputs and a group of outputs of a time counter, the first output of the control node under The key is connected to the first input of the microinstructions unit, the third output of which is connected to the control input of the readiness register, the first and second outputs of which are connected respectively to the first and second inputs of the control node and the source and receiver 1 readiness arrays. The disadvantage of the atoro device is low throughput, since, as a control interval, the exchange duration is 39
зуетс константа, не меньша длительности обмена между двум наиболее медленными внешними устройствами (абонентами). В то же врем каждый обмен характеризуетс -в общем случае , разными длительност ми, В результате выдержка времени на прекращение неудачных обменов превышает необходимый интервал и устройство простаивает ,There is a constant not less than the duration of the exchange between the two slowest external devices (subscribers). At the same time, each exchange is characterized by - in the general case, different durations. As a result, the time delay for the termination of unsuccessful exchanges exceeds the required interval and the device is idle,
Цель изобретени - повышение пропускной способности устройства.The purpose of the invention is to increase the capacity of the device.
Поставленна цель достигаетс ,тем что в устройство введен блок регистров хранени контрольных значений, первый, второй и третий входы которого подключены соответственно к первым входу и выходу блока хранени признаков готовностей, третий вход к четвертому выходу блока микрокоман а выход - ко входу счетчика времени.The goal is achieved by the fact that a block of registers of control values is entered into the device, the first, second and third inputs of which are connected respectively to the first input and output of the storage of readiness signs, the third input to the fourth output of the microcoman and the output to the time counter input.
На чертеже приведена блок-схема устройства управлени обменом.The drawing shows a block diagram of an exchange control device.
Устройство содержит блок 1 сопр жени ., блок 2 микрокоманд, счетчик 3 номеров Моментов., блок k хранени признаков готовностей, регистр 5 готовностей, блок 6 контрол готовностей , блок 7 регистров хранени контрольных значений, адресную магистраль 8 абонентов, магистраль 9 готовности источника, магистраль 10 готовности приемника, магистраль 11 управл ющих сигналов абонентов, информационные магистрали 12 и 13 абонентов , внешние устройства (абоненты J 1, первый выход 15 регистра готовностей , первый выход 16 блока 4, информационную магистраль 17 процессора , магистраль 18 управл ющих сигналов процессора, узел 19 управлени и счетчик 20 времени блока 6 контрол готовностей.The device contains a block 1 mate., A block of 2 micro-commands, a counter of 3 Moment numbers., A block k of readiness signs, a register 5 of readiness, a block 6 of readiness, a block 7 of registers of control values, an address trunk 8 subscribers, a highway 9 readiness of the source, receiver readiness highway 10, subscriber control signal trunk 11, information lines 12 and 13 subscribers, external devices (J 1 subscribers, first exit 15 of the readiness register, first output 16 of block 4, information highway 17 litter, line 18 actuating signal processor, the control unit 19 and the counter 20 controlling the unit time 6 readily.
Блок 1 сопр жени выполн ет электрйческое согласование информационной магистрали процессора с информационной магистралью абонентов.Interface unit 1 performs electrical matching of the processor information highway with the subscribers information highway.
Блок 2 микрокоманд осуществл ет управление работой всех узлов уст .ройства, задает режим сканировани адреса, а также вырабатывает служебные сигналы, сопровождающие информацию при обмене. Счетчик 3 йомеров абонентов предназначен дл выработки адресов абонентов. Блок k хранени признаков готовностей осуществл ет хранение признаков, харак теризующих услови и режимы обменуBlock 2 of microinstructions controls the operation of all nodes of the device, sets the address scanning mode, and also generates service signals accompanying the information during the exchange. The 3 subscriber number counters are designed to generate subscriber addresses. The readiness sign storage unit k carries out the storage of the characteristics characterizing the conditions and exchange modes.
1414
на каждой программе. Регистр 5 готовностей предназначен дл выдачи сигналов готовности и поддержание их в течение всей операции обмена. Блок 6 контрол готовности определ ет тип операции обмена, контролирует ход операции обмена, определ е момент начала и окончани ее. Блокon each program. The readiness register 5 is designed to issue readiness signals and maintain them throughout the entire exchange operation. The readiness control unit 6 determines the type of exchange operation, controls the progress of the exchange operation, determines the starting and ending point of it. Block
«"
7 регистров хранени контрольных значений предназначен дл хранени и выдачи допустимого времени обмена по каждой программе.7 control value storage registers are intended for storing and issuing a valid exchange time for each program.
Устройство работает следующим образом.The device works as follows.
Всем программам обмена и, соответственно , абонентам присвоены определенные адреса (номера).Каждое внешнее устройство осуществл ет обмен информацией по одной или несколким программам. Имеетс два опраций обмена: обмен I, обмен . В . операци х обмен 1 осуществл етс обмен информацией между абонентом и процессором, в операци х типа обмен II два абонента осуществл ют обмен информацией между собой, мину процессор. Каждой программе обмена ставитс в соответствие двухразр дное число, один разр д - ГП (готовность приемника к обмену), втрой разр д - ГИ (готовность источника к обмену). Признаки ГП и ГИ каждой программы хран тс в блоке хранени признаков готовностей, а запись их и стирание осуществл етс по командам процессора в хОде выполнени рабочих nporpaf M.All exchange programs and, accordingly, subscribers are assigned certain addresses (numbers). Each external device exchanges information on one or several programs. There are two exchange operations: exchange I, exchange. AT . operations exchange 1 is the exchange of information between the subscriber and the processor; in operations such as exchange II, two subscribers exchange information between themselves, mine the processor. Each exchange program is assigned a two-bit number, one bit — GP (receiver readiness for exchange), the second bit — GI (source readiness for exchange). The signs of the HU and HI of each program are stored in the readiness readings block, and their recording and erasing is performed by the processor commands in the execution of the working nporpaf M.
Claims (2)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU802864929A SU911501A2 (en) | 1980-01-04 | 1980-01-04 | Exchange control device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU802864929A SU911501A2 (en) | 1980-01-04 | 1980-01-04 | Exchange control device |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU732842 Addition |
Publications (1)
Publication Number | Publication Date |
---|---|
SU911501A2 true SU911501A2 (en) | 1982-03-07 |
Family
ID=20870197
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU802864929A SU911501A2 (en) | 1980-01-04 | 1980-01-04 | Exchange control device |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU911501A2 (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5812871A (en) * | 1995-06-30 | 1998-09-22 | Motorola Inc. | Data processing system and a method of optimizing an operation of the data processing system |
-
1980
- 1980-01-04 SU SU802864929A patent/SU911501A2/en active
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5812871A (en) * | 1995-06-30 | 1998-09-22 | Motorola Inc. | Data processing system and a method of optimizing an operation of the data processing system |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR870004365A (en) | Channel data transmission device with serial transmission line and transmission method thereof | |
SU911501A2 (en) | Exchange control device | |
JPH02226419A (en) | Data array conversion control system | |
JPS636893B2 (en) | ||
SU1300482A1 (en) | Interface for linking computer with using equipment | |
SU809139A2 (en) | Interface device | |
USRE29246E (en) | Data transfer control apparatus and method | |
SU1539787A1 (en) | Multichannel processor-to-subscribers interface | |
SU1695319A1 (en) | Matrix computing device | |
KR890013568A (en) | Data transmission controller | |
SU741259A1 (en) | Interface | |
SU1451712A1 (en) | Adaptive data processing device | |
SU813401A2 (en) | Interface | |
SU1166123A1 (en) | Interface for linking digital computer with communication lines | |
SU1481787A1 (en) | Data exchange unit | |
SU1180876A1 (en) | Information output device | |
SU1257653A2 (en) | Interface for linking electronic computers | |
SU1354151A2 (en) | System for monitoring seismic information | |
SU943696A2 (en) | Computer interface | |
SU1118997A1 (en) | Information exchange device | |
KR100239055B1 (en) | Apparatus for processing and controlling digital signal | |
SU1259277A1 (en) | Interface for linking processors in pipeline computer system | |
JP2527335B2 (en) | High-speed transfer method | |
SU736086A1 (en) | Interface | |
SU1265781A1 (en) | Interface for linking two electronic computers |