SU767994A1 - Устройство дл выделени синхросигнала - Google Patents
Устройство дл выделени синхросигнала Download PDFInfo
- Publication number
- SU767994A1 SU767994A1 SU782662953A SU2662953A SU767994A1 SU 767994 A1 SU767994 A1 SU 767994A1 SU 782662953 A SU782662953 A SU 782662953A SU 2662953 A SU2662953 A SU 2662953A SU 767994 A1 SU767994 A1 SU 767994A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- input
- signal
- frequency divider
- block
- output
- Prior art date
Links
Landscapes
- Synchronisation In Digital Transmission Systems (AREA)
Description
(54) УСТРОЙСТВО ВЫДЕЛЕНИЯ СИНХРОСИГНАЛА
1
Изобретение относитс к устройствам передачи данных и может использоватьс дл фазового пуска аппаратуры при .передаче двоичных последовательностей .5
Известно устройство вьвделени синхросигнала, содержащее последовательно соединенные приемник и накопитель , выходы разр дов которого через блок элементов И подключены к 10 соответствующим входам селектора, при siTOM сигнальный вход приемника объединен с первым входом блока обработки сигнала 1 .
Однако точность выделени синхро 15 сигнала известным устройством недостаточна .
Целью изобретени вл етс повышение точности выделени Ьинхросигнала .20
Дл этого в устройство вьзделени синхросигнала, содержащее последовательно coeдинeннke приемник и накопитель , выходы разр дов которого через блок элементов И подключены к 25 соответствующим входам селектора/ При этом сигнальный вход приёмника объединен с первым входом блока обработки сигнала, введены последовательно соединенные блок суммирующих 30
усилителей, вычитаклций блок, дискриминатор и управл емый делитель астоты , при этом выход управл емого делител частоты подключен к управл ющему входу накопител , выходы дополнительных разр дов которого подключены к соответствующим входам блока суммирукнцих усилителей, а выход селектора подключен к соответствующему входу дискриминатора и к второму входу блока обработки сигнала, к управл ницему входу которого подключен дополнительный выход управл емого делител частоты. .
На чертеже изображена структурна электрическа схема предлагаемого устройства выделени синхросигнала..
Устройство выделени синхросигнала содержит приемник 1, накопитель 2, блок 3 элементов И, селектор 4, блок. 5 обработки сигналов, блок 6 суммирующих усилителей, вычитающий блок 7, дискриминатор 8, управл емый делитель 9 частоты.
Устройство выделени синхросигнала работает следующим образом.
В приемнике 1 осуществл етс прием сигнала по огибающей. С выхода, приемника 1 сигнал, имеющий один из двух уровней - высокий или низкий (I
или О) - поступает на информационный вход накопител 2, выполненного, например, в виде регистра сдвига. В накопителе 2 каждый символ сигнала синхронизации записываетс в виде нескольких двоачЯых знаков О или 1 4ака последовательность двоичных знаков продвигаетс по накопителю 2. При поступлении .сигнала синхронизации в момент его согласовани с дискретным фильтром, образованным накопителем 2, блоком3 и селектором 4, с выхода селектора 4 выдаетс импульс . Сигналы с выходов накопител 2, смежных с выходами, соединенными с входами блока 3, поступают на входы блока 6 суммирующих усилителей. Сигналы на выходе блока б характеризуют ошибку соответственно опережени или запаздывани момента вы влени сигнала синхронизации, обусловленную действием помех, случайным рассогласованием по фазе между приход щим сигналом и сигналом тактовой частоты приемной части, а также не-. .стабильностью генераторов. Величина и направление ошибки определ ютс путем вычислени разности сигналов с выходов блока б и вычитающего блока 7 . В дискриминаторе 8 величина ошибки преобразуетс в число импульсов , которые нужно добавить (или вычесть ) в последовательность, поступающую на управл емый делитель 9. Тактовые импульсы с управл емого делител 9 поступают на вход блока 5 обработки сигнала, в котором осуШест вл етс задержка входйого сигнала, и по сигналу селектора 4 - синхронный прием полезных сигналов.
Использование предлагаемого устройства вьоделени синхросигнала в системах передачи коротких сообщений позвол ет уменьшить врем передачи одного, сообщени , увеличить точность выделени синхросигнала и сократить энергетические и аппаратурные затраты на синхронизацию.
Claims (1)
- Формула изобретениУстройство выделени синхросигнала , содержащее последовательно соеди ненные приемний и накопитель, выходы разр дов которого через блок злементов И подКУйочёны к соотвётс вуюиим входам селек ора, при этом сигнальный5 вход приемника объединен с первым входом блока обработки сигнала, о т л ичающеес тем, что, с целью повышени точности ввделени синхро .сигнёша,- введены последовательно ср0 единенные блок суммирующих усилителей , вычитающий блок, дискриминатор и управл емый делитель частоты, при этом выход управл ёмого делител частоты подключен к управл ющему входу5 накопител , выходы дополнительных разр дов которого подключены к соответствук дим блока суммирующих усилителей, а выход селектора подклюмен к соответствующему входу дискриминатора и к второму входу блока обО работки сигнала, к управл ющему входу которого подключен дополнительный выход управл емого делител частоты.Источники информации, прин тые во внимание при экспертизе.1. Авторское свидетельство СССР I.543183, кл. Н 04 L 7/08. 1971 поототип).К декодирующемуScmfouemty
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU782662953A SU767994A1 (ru) | 1978-09-11 | 1978-09-11 | Устройство дл выделени синхросигнала |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU782662953A SU767994A1 (ru) | 1978-09-11 | 1978-09-11 | Устройство дл выделени синхросигнала |
Publications (1)
Publication Number | Publication Date |
---|---|
SU767994A1 true SU767994A1 (ru) | 1980-09-30 |
Family
ID=20784777
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU782662953A SU767994A1 (ru) | 1978-09-11 | 1978-09-11 | Устройство дл выделени синхросигнала |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU767994A1 (ru) |
-
1978
- 1978-09-11 SU SU782662953A patent/SU767994A1/ru active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US3701894A (en) | Apparatus for deriving synchronizing pulses from pulses in a single channel pcm communications system | |
US2949503A (en) | Pulse modulation system framing circuit | |
US3777062A (en) | Transmission system for a time-divisional multiplex psk signal | |
US3794978A (en) | Systems for the transmission of control and/or measurement information | |
US4361896A (en) | Binary detecting and threshold circuit | |
SU767994A1 (ru) | Устройство дл выделени синхросигнала | |
JP2947074B2 (ja) | フレーム同期検出回路 | |
RU2168864C2 (ru) | Система радиосвязи | |
US3241075A (en) | Pulse regenerative devices | |
US3336578A (en) | Detector of aperiodic diphase marker pulses | |
RU2194365C2 (ru) | Многоканальная система связи | |
SU1573550A1 (ru) | Устройство дл передачи и приема дискретных сообщений | |
RU2063661C1 (ru) | Многолучевая линия радиосвязи | |
SU1559421A1 (ru) | Система св зи с относительной фазовой и фазоимпульсной модул цией | |
SU1453608A1 (ru) | Многоканальна некогерентна система передачи и приема информации | |
SU788415A1 (ru) | Устройство приема сигналов синхронного запуска | |
SU944134A2 (ru) | Устройство синхронизации по циклам | |
SU1552394A1 (ru) | Устройство дл передачи и приема дискретных сообщений | |
SU869074A1 (ru) | Устройство тактовой синхронизации | |
SU860332A1 (ru) | Устройство тактовой синхронизации | |
SU1356246A2 (ru) | Система св зи с многоосновным кодированием | |
SU907861A1 (ru) | Устройство дл приема информации в частотном коде | |
SU720766A1 (ru) | Устройство синхронизации измерительных последовательностей | |
SU585619A2 (ru) | Устройство синхронизации с -последовательностью | |
SU1083391A1 (ru) | Приемник синхронизирующей рекуррентной последовательности |