SU1141578A2 - Устройство дл автоматического измерени характеристик дискретного канала св зи - Google Patents
Устройство дл автоматического измерени характеристик дискретного канала св зи Download PDFInfo
- Publication number
- SU1141578A2 SU1141578A2 SU833681367A SU3681367A SU1141578A2 SU 1141578 A2 SU1141578 A2 SU 1141578A2 SU 833681367 A SU833681367 A SU 833681367A SU 3681367 A SU3681367 A SU 3681367A SU 1141578 A2 SU1141578 A2 SU 1141578A2
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- input
- inputs
- output
- information
- counter
- Prior art date
Links
Landscapes
- Detection And Prevention Of Errors In Transmission (AREA)
Abstract
УСТРОЙСТВО ДЛЯ АВТОМАТИЧЕСКОГО ИЗМЕРЕНИЯ ХАРАКТЕРИСТИК ДИСКРЕТ .НОГО КАНАЛА СВЯЗИ по авт.св.№ 780210 о т л и ч а ю щ е е с тем, что, с целью повышени помехозащищенности,в него введены п тый и шестой элементы И,элемент ИЛИ и третий рекуррентный регистр, информационные выходы которого подключены к информационным входам блока сравнени , а тактовый выход и информационный вход соединены соответственно с первым входом п того элемента И и с выходом элемента ИЛИ, первый и второй входы которого соединены соответственно с выходами п того и шестого элементов И, первый вход которого соединен с информационным входом первого сумматора по модулю два, а вторые входы п того и шестого элементов И соединены с соответствующими выходами переключател режимов. (Л
Description
ел
00 1 Изобретение относитс к технике св зи и может использоватьс л контрол достоверности систем передачи данных. .По основному авт. св. № 780210 известно устройство дл автоматического измерени характеристик дискрет ного канала св зи, содержащее на входе блок сравнени , первый сумматор по модулю два, к одному из входов которого подключен информационный вход и выход первого рекурентного регистра, второй сумматор по модулю два, к одному из входов которого подключен выход второго рекурентного регистра, выходы разр дов которого подключены к входам дешифратора , а также элементы И, счетчик элемент задержки, дополнительный счетчик, переключатель режимов, счет чик нулей дл проверки фазы и блок индикации, при этом информационный вход блока сравнени соединен с другим входом первого сумматора по модулю два, выход которого подключен к первому входу элемента задержки и к входам второго рекурентного регист ра и второго сумматора по модулю два, выход которого подключен к входу счетчика и через первый элемент И к входу счетчика нулей дл проверки фазы, к входу Сброс которого подключен выход дешифратора, причем выход блока сравнени через второй элемент И, выход первого сумматора по модулю два через третий элемент И, а выходы счетчика и счетчика нулей дл проверки фазы непосредственн подключены к соответствующим входам переключател режимов, выходы которого подключены соответственно к другим входам первого, второго и тре тьего элементов И, причем другой вход второго элемента И объединен с вторым входом элемента задержки и с одним из входов четвертого элемента И, выход которого через дополнительный счетчик подключен к входам блока индикации, а- на другой вход четверто го элемента И поданы тактовые импульсы l3. Однако известное устройство имеет низку помехозащищенность. Цель изобретени - повышение помехазащищенности . Поставленна цель достигаетс тем что в устройство дл автоматичес - кого измерени характеристик дискрет 7а1 ного канала св зи, содержащее на входе блока сравнени , первый сумматор , по модулю два, к одному из входов которого подключен информационный v вход и выход первого рекуррентного регистра, второй сумматор по модулю два, к одному из входов которого подключен выход второго рекуррентного регистра, выходы разр дов которого подключены к входам дешифратора, а также элементы И, счетчик, элемент задержки, дополнительный счетчик, переключатель режимов, счетчик нулей дп проверки фазы и блок индикации , при этом информационньй вход блока сравнени соединен с другим входом первого сумматора по модулю два, вы- ход которого подключен к первому входу элемента задержки и к входам второго рекуррентного регистра и второго сумматора по модулю два, выход которого подключен к входу счетчика и через первьй элемент И к входу счет чика нулей дл проверки фазы,ft входу Сброс которого подключен выход дешифратора, причем выход блока сравнени через второй элемент И, выход первого сумматора по модулю два через третий элемент И, а выходы счетчика и счетчика нулей дл проверки фазы непосредственно подключены к соответствующим входам переключ.ате- л режимов, выходы которого подключены соответственно к другим входам первого, второго и третьего элементов И, причем другой вход второго элемента И объединен с вторь& входом элемента задержки и с одним из входов четвертого элемента И,выход которого через дополнительный счетчик подключен к входам блока индикации, а на другой вход четвертого элемента И поданы тактовые импульсы, введены п тый и шестой элементы И, элемент ИЛИ и третий рекуррентный регистр, информационные выходы которого подключены к информационным входам блока сравнени ,а тактовый выход и информационный вход соединены с&ответственно с первым входом п того элемента И и с выходом элемента ШШ, первый и второй входы которого соединены соответственно с выходами п того и шестого элементов И, первый вход которого соединен с информационным входом первого сумматора по модулю два, а вторые входы п того и шестого элементов И соединены с со31 ответствующими выходами переклочател режимов. На чертеже представлена структурна электрическа схема предпагаемо .го устройства. Устройство дл автоматического измерени характеристик дискретного канала св зи содержит блок, 1 сравнени , первый 2 и второй 3 суммато7 ры по модулю два, первый 4 и второй 5 рекуррентные регистры, дешифратор 6, первый 7, второй 8 и третий 9 элементы И, счетчики 10 и 11, элемент 12 задержки, переключатель 13 режимов, счетчик 14 нулей дл проверки фазы, блок 15 индикации, четвертый элемент И 16, дополнительный счетчик 17, дешифратор 18 состо ний, п тый 19 и шестой 20 элементы И, элемент ИЛИ 21, третий рекуррентный регистр 22. Устройство работает следующим образом. Принимаема последовательность сравниваетс в первом сумматоре 2 с эталонной, которую генерирует первый рекуррентный регистр 4. Результат сравнени поступает в элемент 12 задержки, а с его выхода на счетчик 10, в котором отсчитываетс число искаженных битов: Получаемый в первом сумматоре 2 результат сравнени принимаемой и эталонной последовательностей поступает на второй рекурентный регистр 5, включенный в режиме проверки. Одновременно принимаема последовательность через шестой элемент И 20 и третий рекуррентный регистр 22. поступает на блок 1 сравнени .- В режиме проверки третий рекуррентный регистр 22 работает как регистр сдвига, регистрирующий принимаемую последовательность из дискретного канала св зи. Если произошел сдвиг информации, |то при анализе во втором рекуррентном -регистре 5 выходной последовательности первого сумматора 2, вл ю щейс рекуррентной, получаетс нулевой выход с второго сумматора 3, который черэз первый элемент И 7 посту пает на счетчик 14.При правильно при имаемой информации счетчик 14 нули не считает, так как он сбрасьшаетс сигналом, с дешифратора 6. При по влении ошибок выходным сигналом счетчика 14 переключатель 13 переводитс в режим поиска фазы и сбра8 сываетс дополнительньш счетчик 17.В этом режиме останавливаетс первый рекуррентный регистр 4 (от него отключаютс .тактовые импульсы), а принимаема последовательность через шестой элемент И 20, элемент ИЛИ 2) и третий рекуррентный регистр 22 поступает в блок 1 сравнени . При этом принимаема последовательность запоминаетс третьим рекуррентным регистром 22. Когда на п тый элемент И 19 поступает сигнал переключени в режим поиска фазы, третий рекурент .ный регистр 22 начинает работать по цепи обратной св зи через п тый элемент И 19 и элемент ИЛИ 21 как эталонный рекуррентный регистр. В блоке 1 сравнени сравниваетс отрезок входной последовательности, занесенный в третий рекурретный регистр 22 (при его работе качество регистра сдвига в режиме проверки), и эталонна рекурретна последовательность , вырабатываема третьим рекуррентньм регистром 22 в режиме поиска фазы. При этом исключаетс воздействие помех и возможность ложного фазировани . Блок 1 сравнени имеет ту последовательность длиной N , на которой был остановлен первый рекуррентный регистр 4. В момент по влени такой последовательности блок 1 сравнени выдает сигнал перехода в режим определени величины, сдвига фазы, который черюз второй элемент И 8 поступает на переключатель -13. В течение всего времени работы в режиме поиска фазы дополнительный счетчик 17 подсчитьюает величину сдвига (фазы). Счет ведетс по модулю числа N через четвертый элемент И 16, Если при таком способе.отсче- та знак, записанный во втором рекуррентном регистре 5, не будет найден сразу, то он зафиксируетс после передачи iN битов ( i 1,2,...) при том же показйниигдополнительного с счетчика 17. Врем нахождени в режиме определени величины сдвига фазы отсчитываетс в течение некоторого зачетного промежутка при помощи счетчика 11,выходным сигналом которого устройство переводитс в режим проверки. В течение всего времени нахождени в режиме проверки дополнительный Гчетчик 17 сохран ет свое состо ние, которое регистрируетс на блоке 15
индикации. При необходимости дешифрируетс величина и направление Сдвига ;отсчитанного на дополнительном счетчике 17, при помощи дешифратора 1 состо ний.
Отсчет сдвига производитс по модулю числа.N следующим образом. Пусть -произошла вставка бит. Тогда третий рекуррентный регистр 22 будет задержан на i тактов и на дополнительном счетчике 17 будет отсчитано число 1/modN .
Если произошло выпадение ,i бит, то первый рекуррентный регистр 4 будет задержан на N-t тактов и на блоке 15 индикации окажетс число /M-l-l/iY ocJiJ,
Пусть известно, что вставки и выпадени могут происходить с кратностью - бит, при этом целесообразно выбрать число N взаимно простым с . Тогда дешифратор 18 после возвращени в режим проверки дешифрирует записанные в дополнительном счечике 17 числа л) /cnocl N ... -Кт /mod м . Сигнал , поступающий с вькода дополнительного счетчика 17 на дешифратор 18 и блок 15 индикации, свидетельствует о том, что сдвиг информации оз«ачает вставку из f блоков.
Если же дешифрирук тс числа )/тб 1...-К)/tnoj N, то определ етс выпадение -j- блоков. При этом число К выбираетс таким-образом, чтобы все перечисленные выше числа (по модулю N) были.различны. Управление переключателем 13 осуществл етс при этом сигналом с выхода третьего элемента И 9.
Таким образом, использование изобретени позвол ет повысить помехозащищенность принимаемой последовательности во определени величины и направлени сдвига информации при нарушении синхронизма, исключает возможность ложного фазировани и тем самым повьш1ает помехозащищенность всей работы устройства.
Claims (1)
- УСТРОЙСТВО ДЛЯ АВТОМАТИЧЕСКОГО ИЗМЕРЕНИЯ ХАРАКТЕРИСТИК ДИСКРЕТНОГО КАНАЛА СВЯЗИ по авт.св.№ 780210 отличающе е с’я тем, что, с целью повышения помехозащищенности,в него введены пятый и шестой элемен- ты И,элемент ИЛИ и третий рекуррентный регистр, информационные выходы которого подключены к информационным входам блока сравнения, а тактовый выход и информационный вход соединены’ соответственно с первым входом пя того элемента И и с выходом элемента ИЛИ, первый и второй входы которого соединены соответственно с выходами пятого и шестого элементов И, первый вход которого соединен с информационным входом первого сумматора по модулю два, а вторые входы пятого и шестого элементов И соединены с соответствующими выходами переключателя режимов.•1 1141
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU833681367A SU1141578A2 (ru) | 1983-12-27 | 1983-12-27 | Устройство дл автоматического измерени характеристик дискретного канала св зи |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU833681367A SU1141578A2 (ru) | 1983-12-27 | 1983-12-27 | Устройство дл автоматического измерени характеристик дискретного канала св зи |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU780210A Addition SU154814A1 (ru) |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1141578A2 true SU1141578A2 (ru) | 1985-02-23 |
Family
ID=21096213
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU833681367A SU1141578A2 (ru) | 1983-12-27 | 1983-12-27 | Устройство дл автоматического измерени характеристик дискретного канала св зи |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1141578A2 (ru) |
-
1983
- 1983-12-27 SU SU833681367A patent/SU1141578A2/ru active
Non-Patent Citations (1)
Title |
---|
1. Авторское свидетельство СССР 780210, кл. Н 04 В 3/46, 1975 (прототип). * |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US4385383A (en) | Error rate detector | |
CA1203026A (en) | Error detection circuitry for digital systems | |
US4234953A (en) | Error density detector | |
SU1141578A2 (ru) | Устройство дл автоматического измерени характеристик дискретного канала св зи | |
US4121195A (en) | Error detection in digital systems | |
US3657704A (en) | Magnetic tape readout signal processing systems | |
KR100439368B1 (ko) | 오류정정장치 | |
US5510786A (en) | CMI encoder circuit | |
US5023892A (en) | System for detecting and correcting signal distortion | |
JP2752654B2 (ja) | スクランブル化符号のデータ伝送方式 | |
US5483542A (en) | Byte error rate test arrangement | |
US3535448A (en) | Two-channel time-multiplex transmission systems | |
SU1485307A2 (ru) | Устройство для контроля синхронизма воспроизведенных сигналов | |
SU780210A1 (ru) | Устройство дл автоматического измерени характеристик дискретного канала св зи | |
KR100212051B1 (ko) | 데이타 수신 장치 및 방법 | |
US2737544A (en) | Telegraph repeaters | |
SU1619278A1 (ru) | Устройство дл мажоритарного выбора сигналов | |
JPS63312754A (ja) | エラ−発生回路 | |
SU1251335A1 (ru) | Устройство дл детектировани ошибок | |
SU1396136A1 (ru) | Устройство дл сопр жени микроЭВМ с кассетным магнитофоном | |
SU1298750A1 (ru) | Устройство дл обнаружени сост заний в синхронизируемых дискретных блоках | |
JP2736820B2 (ja) | データ通信機インタフェース回路 | |
JPH01129676A (ja) | 高品位テレビジョン信号の判別回路 | |
RU2017332C1 (ru) | Устройство для контроля качества дискретного канала связи | |
SU1223376A1 (ru) | Устройство дл контрол регенераторов |