KR980012347A - 반도체 패키지 제조방법 - Google Patents

반도체 패키지 제조방법 Download PDF

Info

Publication number
KR980012347A
KR980012347A KR1019960030792A KR19960030792A KR980012347A KR 980012347 A KR980012347 A KR 980012347A KR 1019960030792 A KR1019960030792 A KR 1019960030792A KR 19960030792 A KR19960030792 A KR 19960030792A KR 980012347 A KR980012347 A KR 980012347A
Authority
KR
South Korea
Prior art keywords
beaker
bonding
semiconductor chip
lead
semiconductor package
Prior art date
Application number
KR1019960030792A
Other languages
English (en)
Other versions
KR100209682B1 (ko
Inventor
이원상
Original Assignee
구자홍
엘지전자 주식회사
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 구자홍, 엘지전자 주식회사 filed Critical 구자홍
Priority to KR1019960030792A priority Critical patent/KR100209682B1/ko
Priority to US08/890,555 priority patent/US5960261A/en
Priority to JP9199778A priority patent/JPH1074854A/ja
Publication of KR980012347A publication Critical patent/KR980012347A/ko
Application granted granted Critical
Publication of KR100209682B1 publication Critical patent/KR100209682B1/ko

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/28Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/02Containers; Seals
    • H01L23/04Containers; Seals characterised by the shape of the container or parts, e.g. caps, walls
    • H01L23/053Containers; Seals characterised by the shape of the container or parts, e.g. caps, walls the container being a hollow construction and having an insulating or insulated base as a mounting for the semiconductor body
    • H01L23/057Containers; Seals characterised by the shape of the container or parts, e.g. caps, walls the container being a hollow construction and having an insulating or insulated base as a mounting for the semiconductor body the leads being parallel to the base
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/50Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32151Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32245Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/45099Material
    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45117Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
    • H01L2224/45124Aluminium (Al) as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/45099Material
    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/45139Silver (Ag) as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73251Location after the connecting process on different surfaces
    • H01L2224/73265Layer and wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/91Methods for connecting semiconductor or solid state bodies including different methods provided for in two or more of groups H01L2224/80 - H01L2224/90
    • H01L2224/92Specific sequence of method steps
    • H01L2224/922Connecting different surfaces of the semiconductor or solid-state body with connectors of different types
    • H01L2224/9222Sequential connecting processes
    • H01L2224/92242Sequential connecting processes the first connecting process involving a layer connector
    • H01L2224/92247Sequential connecting processes the first connecting process involving a layer connector the second connecting process involving a wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L24/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/00011Not relevant to the scope of the group, the symbol of which is combined with the symbol of this group
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/00014Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01079Gold [Au]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/013Alloys
    • H01L2924/0132Binary Alloys
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/013Alloys
    • H01L2924/0132Binary Alloys
    • H01L2924/01322Eutectic Alloys, i.e. obtained by a liquid transforming into two solid phases
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/14Integrated circuits
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/1515Shape
    • H01L2924/15153Shape the die mounting substrate comprising a recess for hosting the device
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/15165Monolayer substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/161Cap
    • H01L2924/1615Shape
    • H01L2924/16152Cap comprising a cavity for hosting the device, e.g. U-shaped cap
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Manufacturing & Machinery (AREA)
  • Die Bonding (AREA)
  • Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)

Abstract

본 발명은 반도체 패키지 제조방법에 관한 것으로, 제조 공정시 비효율적이고 비경제적인 문제점을 해결하기 위하여 홈이 형성된 베커, 베커의 캡, 본딩 패드를 갖는 반도체 칩 그리고 리드 프레임을 준비한 후 베커의 홈 및 베커와 캡의 에지 영역에 접착제를 도포하고 베커의 홈상에 반도체 칩을 올려놓은 다음 리드의 에지 영역에 전도성 물질을 형성하고 반도체 칩의 본딩 패드에 전도성 물질이 형성된 리드를 접촉시키며 지지대와 캡을 접착시킴으로써 공정시간을 줄이고 수율과 경제성을 향상시킬 수 있도록 한 것이다.

Description

반도체 패키지 제조방법
본 발명은 반도체 패키지(package)에 관한 것으로 특히, 반도체 패키지 제조방법에 관한 것이다.
일반적으로 반도체 소자의 제조공정시 웨이퍼에 집적회로를 형성하는 FAB공정(Fabriction process)을 완료한 후에는 웨이퍼상에 만들어진 각 칩을 서로 분리시키는 다이싱(Dicing)과, 분리된 각 칩을 리드 프레임(Lead Frame)의 다이 본딩 패드에 안착시키는 칩 본딩(Chip Bonding)과, 칩 위의 본딩 패드(Bonding pad)와 리드 프레임의 인너 리드(Inner Lead)를 전기적으로 접속시키는 와이어 본딩(Wire Bonding)을 순차적으로 수행한 후 회로를 보호하기 위해 몰딩(Molding)을 수행하게 된다. 또한, 몰딩을 수행한 후에는 리드 프레임의 서포트 바(Support Bar) 및 댐 바(Dam Bar)를 자르는 트리밍(Trimming)과 아웃 리드(Out Lead)를 소정의 형상으로 성형하는 포밍(Forming)을 차례로 수행하게 되며 트리밍 및 포밍을 실시함으로써 패키지 공정을 완료하게 된다.
도 1a내지 1d는 종래 기술에 따른 반도체 패키지의 제조공정을 보여주는 공정단면도이다.
도 1a에 도시된 바와 같이 리드 프레임의 다이 본딩 패드상에 본딩패드(2)가 형성된 반도체 칩(3)을 은(Ag)에폭시(epoxy)나 AuSn, AuSi 등과 같은 공융 물질(eutetic material)(4)을 사용하여 다이 본딩(die bonding)한다.
이때, 다이 본딩시의 조건은 약 200℃∼300℃의 온도와 5min∼2hr정도의 시간을 필요로 한다. 도 1b에 도시된 바와 같이 반도체 칩(3)의 상부표면에 형성된 본딩패드(2)와 리드 프레임의 내부 리드(5)에 은 또는 알루미늄 와이어(wire)(6)로 와이어 본딩하여 전기적으로 연결한다.
도 1c에 도시된 바와 같이 에폭시 몰딩 콤바운드(Epoxy Molding Compound)(7)로 외부 리드(8)를 제외한 나머지 부분을 모두 몰딩한다.
도 1d에 도시된 바와 같이 몰딩한 반도체 패키지를 리드 프레임으로부터 컷팅하고 외부 리드(8)를 원하는 형상으로 포밍(forming)하여 반도체 패키지를 완성시킨다.
이와 같은 종래 기술에 따른 반도체 패키지 제조방법에 있어서는 다음과 같은 문제점이 있었다. 첫째, 다이 본딩시 약 2시간정도의 큐어링(curing)시간이 필요하므로 비경제적이다.
둘째, 와이어 본딩시 열 또는 초음파를 사용하므로 그에 따른 반도체 칩에 마이크로 크랙(micro crack)이 발생한다.
셋째, 본딩과 몰딩 공정시에 시간이 많이 걸려 비효율적이고 비경제적이다.
본 발명은 이와 같은 문제점을 해결하기 위하여 안출한 것으로써, 비용과 시간을 줄이고 수율을 높이는 반도체 패키지 제조방법을 제공하는데 그 목적이 있다.
제1a도 내지 제1d도는 종래 기술에 따른 반도체 패키지의 제조공정을 보여주는 공정단면도.
제2a도 내지 제2e도는 본 발명에 따른 반도체 패키지의 제조공정을 보여주는 공정단면도.
* 도면의 주요부분에 대한 부호의 설명
10 : 베커 11 : 캡
12 : 접착제 13 : 반도체 칩
14 : 본딩 패드 15 : 리드
16 : 전도성 에폭시
본 발명에 따른 반도체 패키지 제조방법은 반도체 칩을 리드 프레임에 다이 본딩을 하지 않고 베커의 홈상에 직접 올려놓는데 그 특징이 있다. 본 발명의 다른 특징은 와이어 본딩을 하지않고 반도체 칩상의 본딩 패드와 리드를 직접 접속시키는데 있다. 본 발명의 또 다른 특징은 베커의 홈상에 반도체 칩을 올려놓고 한 스텝 공정으로 반도체 어셈블리를 완성시키는데 있다. 본 발명의 또 다른 특징은 베커의 홈 및 베커와 캡의 에지 영역에 동일한 물질의 접착제를 도포하는데 있다. 본 발명의 또 다른 특징은 리드의 에지 영역에 전도성 에폭시를 형성하여 베커와 캡의 접착시에 반도체 칩의 패드에 접착시키는데 있다.
상기와 같이 본 발명에 따른 반도체 패키지 제조방법을 첨부된 도면을 참조하여 보다 상세히 설명하면 다음과 같다.
도 2a 내지 2e는 본 발명에 따른 반도체 패키지의 제조공정을 보여주는 공정단면도이다. 도 2a에 도시된 바와 같이 홈이 형성된 베커(backer)(10)와 베커(10)의 뚜껑이 되는 캡(cap)(11)을 형성하고 베커(10)의 홈 및 베커(10)와 캡(11)의 에지 영역에 접착제(12)를 도포한다. 이때, 베커(10)의 홈은 반도체 칩의 크기를 고려하여 형성한다. 그리고 베커(10)의 홈 및 베커(10)와 캡(11)의 에지 영역에 도포된 접착제(12)는 모두 동일한 물질로 형성된다. 도 2b에 도시된 바와 같이 베커(10)의 홈상에 본딩 패드(14)가 형성된 반도체 칩(13)을 올려놓는다. 이때, 베커(10)의 홈은 반도체 칩(13)을 고정시키는 역할을 한다. 도 2c에 도시된 바와 같이 리드(15)의 에지 영역에 전도성 에폭시(16)를 형성하고 반도체 칩(13)의 본딩 패드(14)에 전도성 에폭시(16)가 형성된 리드(15)를 접착시킨다. 도 2d에 도시된 바와 같이 반도체 칩이 부착된 베커(10)와 캡(11)을 200℃∼250℃의 온도와 N2분위기에서 1∼2kg/㎠의 힘으로 접착시킨다. 이때, 모든 에지 영역에 접착제(12)가 도포된 베커(10)와 캡(11)은 접착제(12)가 녹으면서 리드(15)와 함께 접착된다. 그리고 리드(15)의 에지 영역에 형성된 전도성 에폭시(16)는 약 200℃의 온도에서 녹으면서 본딩 패드(14)와 접착될 때 반도체 칩(13)의 본딩 패드(14)에 접착된 리드(15)의 에지 영역은 팽창력(tension)이 있으므로 본딩 패드(14)와의 부착력(bond strength)을 강화시킨다.
즉 본딩 패드(14)에 리드(15)를 접착시킬때의 부착력은 팽창력에 의한 기계적인 함과 전도성 에폭시에 의한 접착력으로 인해 일반적인 와이어 본딩때 보다 약 10배정도 큰 부착력을 갖는다. 도 2e에 도시된 바와 같이 리드 프레임(15)을 트리밍(trimming)하고 소정의 형상으로 포밍(forming)하여 반도체 패키지를 완성한다.
본 발명에 따른 반도체 패키지 제조방법에 있어서는 다음과 같은 효과가 있다.
첫째, 본딩 패드와 리드를 접착할 때 일반적인 와이어 본딩때 보다 약 10배 정도 큰 부착력을 가짐으로써 신뢰성이 향상된 반도체 패키지를 생산할 수 있다. 둘째, 와이어 본딩의 공정이 없으므로 반도체 칩의 마이크로 크랙을 방지할 수 있으므로 수율이 향상되어 반도체 패키지의 생산성이 증가된다. 셋째, 다이 본딩과 와이어 본딩 및 몰딩 공정 없이 한 스텝으로 이루어짐으로써 공정시간과 공정비용을 줄일 수 있으므로 경제성이 우수한 반도체 패키지의 생산이 가능하다. 즉, 다이 본더(die bonder), 와이어 본더(wire bonder), 몰딩 기계(molding machine)와 같은 장비들을 1대의 장비로써 해결할 수 있다.

Claims (5)

  1. 홈이 형성된 베커, 상기 베커의 캡, 본딩 패드를 갖는 반도체 칩 그리고 리드 프레임을 준비하는 스텝; 상기 베커의 홈 및 상기 베커의 에지 영역에 접착제를 도포하는 스텝; 상기 베커의 홈상에 상기 칩을 올려놓는 스텝; 상기 리드의 에지 영역에 전도성 물질을 형성하고 상기 반도체 칩의 본딩 패드에 전도성 물질이 형성된 리드를 접촉시키는 스템; 상기 베커와 캡을 접착시키는 스텝; 그리고 상기 리드 프레임을 트리밍하고 포밍하는 스텝을 포함하여 이루어짐을 특징으로 하는 반도체 패키지 제조방법.
  2. 제1항에 있어서, 상기 리드의 전도성 물질은 전도성 에폭시로 형성함을 특징으로 하는 반도체 패키지 제조방법.
  3. 제1항에 있어서, 상기 베커와 캡 접착시 200℃∼250℃ 의 온도와 N2분위기에서 약 1∼2kg/㎠의 힘으로 접착시킴을 특징으로 하는 반도체 패키지 제조방법.
  4. 제1항에 있어서, 상기 반도체 칩의 본딩 패드에 접촉된 리드의 전도성 물질은 상기 베커와 캡의 접착시에 반도체 칩의 본딩 패드에 접착됨을 특징으로 하는 반도체 패키지 제조방법.
  5. 제1항에 있어서, 상기 베커의 홈 및 상기 베커와 캡의 에지 영역에 도포된 접착제는 모두 동일한 물질로 형성함을 특징으로 하는 반도체 패키지 제조방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019960030792A 1996-07-27 1996-07-27 반도체 패키지 제조방법 KR100209682B1 (ko)

Priority Applications (3)

Application Number Priority Date Filing Date Title
KR1019960030792A KR100209682B1 (ko) 1996-07-27 1996-07-27 반도체 패키지 제조방법
US08/890,555 US5960261A (en) 1996-07-27 1997-07-09 Method for manufacturing semiconductor package
JP9199778A JPH1074854A (ja) 1996-07-27 1997-07-25 半導体パッケージの形成方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
KR1019960030792A KR100209682B1 (ko) 1996-07-27 1996-07-27 반도체 패키지 제조방법

Publications (2)

Publication Number Publication Date
KR980012347A true KR980012347A (ko) 1998-04-30
KR100209682B1 KR100209682B1 (ko) 1999-07-15

Family

ID=19467756

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1019960030792A KR100209682B1 (ko) 1996-07-27 1996-07-27 반도체 패키지 제조방법

Country Status (3)

Country Link
US (1) US5960261A (ko)
JP (1) JPH1074854A (ko)
KR (1) KR100209682B1 (ko)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100706530B1 (ko) * 2001-03-19 2007-04-11 앰코 테크놀로지 코리아 주식회사 반도체 패키지 제조 방법

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7990727B1 (en) * 2006-04-03 2011-08-02 Aprolase Development Co., Llc Ball grid array stack

Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4355463A (en) * 1980-03-24 1982-10-26 National Semiconductor Corporation Process for hermetically encapsulating semiconductor devices
US5073521A (en) * 1989-11-15 1991-12-17 Olin Corporation Method for housing a tape-bonded electronic device and the package employed

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100706530B1 (ko) * 2001-03-19 2007-04-11 앰코 테크놀로지 코리아 주식회사 반도체 패키지 제조 방법

Also Published As

Publication number Publication date
US5960261A (en) 1999-09-28
KR100209682B1 (ko) 1999-07-15
JPH1074854A (ja) 1998-03-17

Similar Documents

Publication Publication Date Title
US5888847A (en) Technique for mounting a semiconductor die
JP3526731B2 (ja) 半導体装置およびその製造方法
US8836101B2 (en) Multi-chip semiconductor packages and assembly thereof
US6054772A (en) Chip sized package
JPH08111491A (ja) 半導体装置
KR19980067735A (ko) 반도체 패키지의 제조방법
US20020053736A1 (en) Semiconductor package
KR100209682B1 (ko) 반도체 패키지 제조방법
JPS63107152A (ja) 樹脂封止型電子部品
US7229849B2 (en) Method for packaging a semiconductor device
KR0184061B1 (ko) 반도체 패키지
WO2009013665A2 (en) A leadframe structure for electronic packages
WO2021155537A1 (en) Copper wire bond on gold bump on semiconductor die bond pad
KR100455698B1 (ko) 칩 싸이즈 패키지 및 그 제조 방법
JP3345759B2 (ja) 半導体装置およびその製造方法
KR100268922B1 (ko) 반도체패키지및그제조방법
KR0152902B1 (ko) 버텀리드형 반도체 패키지의 구조 및 그 제조방법
KR100402107B1 (ko) 솝 와이어 본딩방법
KR100218291B1 (ko) 세라믹 패들을 이용한 반도체 패키지 및 그 제작방법
KR0145393B1 (ko) 박리 방지부가 형성된 반도체 칩 및 이를 이용한 반도체 칩 패키지
JPH0294463A (ja) 半導体装置
KR0137067B1 (ko) 히트싱크 내장형 패키지 제조방법
JPH01135052A (ja) 半導体装置およびその製造方法
JP2564595B2 (ja) 半導体装置の製造方法
JP2001284370A (ja) 半導体装置の製造方法

Legal Events

Date Code Title Description
A201 Request for examination
E902 Notification of reason for refusal
E701 Decision to grant or registration of patent right
GRNT Written decision to grant
FPAY Annual fee payment

Payment date: 20060324

Year of fee payment: 8

LAPS Lapse due to unpaid annual fee