KR970705865A - CPM 확산 스펙트럼 통신의 전송 및 수신(Transmission and Reception of CPM Spread-Spectrum Communications) - Google Patents

CPM 확산 스펙트럼 통신의 전송 및 수신(Transmission and Reception of CPM Spread-Spectrum Communications)

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KR970705865A
KR970705865A KR1019970701540A KR19970701540A KR970705865A KR 970705865 A KR970705865 A KR 970705865A KR 1019970701540 A KR1019970701540 A KR 1019970701540A KR 19970701540 A KR19970701540 A KR 19970701540A KR 970705865 A KR970705865 A KR 970705865A
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KR
South Korea
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correlation
imaginary
real
chip
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Application number
KR1019970701540A
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Inventor
랜돌프 엘. 두란트
마크 티. 버바크
유겐 피. 호이트
Original Assignee
에블린 골드파인
옴니포인트 코포레이션
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Priority claimed from US08/480,914 external-priority patent/US5832028A/en
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Abstract

부호화된 위상 변조 확산 스펙트럼 통신 신호의 전송 및 수신을 위한 방법 및 장치가 개시되어 있다. 각종 실시예는 간섭성 또는 비간섭성 수신; 차동 부호화 및 복호화; 직렬 또는 병렬 상관(815,820); 수신 신호의 위상에 기초한 복조; 및 입력 데이타 또는 전송될 다른 정보에 기초한 표들로부터의 변조부호들의 선택 등과 같은 특징들을 포함한다.

Description

CPM 확산 스펙트럼 통신의 전송 및 수신(Transmission and Redeption of CPM Spread-Spectrum Communications)
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제12도는 수시된 확산 스펙트럼 신호의분리 가능한 실수 및 허수 부분들을 사용하는 확산 스펙트럼 수신기의 다른 실시에의 블록도이다, 제13도는 직렬 상관을 사용하는 확산 스펙트럼 수신기의 일 실시예의 블록도이며, 제13B도는 이와 관련된 파형 도표이다, 제14도는 수신된 확산 스펙트럼 신호의 분리 가능한 실수 및 허수 부분들에 대한 직렬 상관을 사용하는 확산 스펙트럼 수신기의 일 실시에의 블록도이다.

Claims (134)

  1. 확산 스펙트럼 신호를 수신하는 단계; 상기 확산 스펙트럼 신호를 서로의 복제물(duplicate)인 제1신호와 제2신호로 분할하는 단게; 제1지역(local) 기준 신호를 사용해 상기 제1신호를 복조하여 I 신호를 생성하는 단계, 제2지역 기준 신호를 사용해 상기 제2신호를 복조하여 Q신호를 생성하는 단계; 상기 I신호를 칩 부호(chip code)의 홀수 칩들과 상관시켜 I상관 신호를 생성하는 단계; 상기 Q신호를 상기 칩부호의 짝수 칩들과 상관시켜 Q상관 신호를 생성하는 단계; 및 상기 I상관 신호와 상기 Q 상관 신호를 결합하여 단일화된 상관 신호를 형성하는 단게를 포함하는 연속 위상 변조(continuous phase modulated) 확산 스펙트럼 신호 수렴 방법.
  2. 확산 스펙트럼 신호 수신 수단; 상기 수신된 확산 스펙트럼 신호를 제1신호와 제2신호로 분할하기 위한 출력 분할기; 제1지역 기준 신호를 사용해 상기 제1신호를 복조하여 I 신호를 생성하기 위한 I 복조기; 제2지역 기준 신호를 사용해 상기 제1신호를 복조하여 Q 신호를 생성하기 위한 Q 복조기; 상기 I신호를 칩 부호의 홀수 칩들과 상관시켜 I상관 신호를 생성하기 위한 제1병렬 상관기; 상기 Q 신호를 상기 칩 부호의 짝수 칩들과 상관시켜 Q 상관 신호를 생성하기 위한 제2병렬 상관기; 및 상기 I 상관 신호와 상기 Q 상관 신호를 결합하기 위한 가산기를 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 방법.
  3. 제2항에 있어서, 상기 I상관기는 상기 I 신호를 수신하기 위한 복수의 시퀀스 칩 기억 위치를 구비한 레지스터; 상기 복수의 칩 기억 위치 중 하나씩 걸른(alternating) 위치들을 상기 홀수 칩들과 비교하여 복수의 비교 값을 생성하기 위한 복수의 승산기; 및 상기 복수의 비교값을 더하기 위한 I 가산기를 더 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  4. 제2항에 있어서, 상기 Q 상관기는 상기 Q 신호를 수신하기 위한 복수의 시퀀스 칩 기억 위치를 구비한 레지스터; 상기 복수의 칩 기억 위치 중 하나씩 걸른 위치들을 상기 짝수 칩들과 비교하여 복수의 비교 값을 생성하기 위한 복수의 승산기; 및 상기 복수의 비교 값을 더하기 위한 Q 가산기를 더 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  5. 제2항에 있어서, 상기 연속 위상 변조 확산 스펙트럼 신호를 생성하여 전송하기 위한 송신기를 더 포함하며, 상기 송신기는 칩 스트림을 짝수 칩 스트림과 홀수 칩 스트림으로 분할하기 위한 스위치; 상기 홀수 칩 스트림으로부터 제2사인 파형을 생성하기 위한 홀수 파형 생성기; 상기 짝수 스트림으로부터 제1사인 파형을 생성하기 위한 짝수 파형 생성기; 주파수 wot의 제1반송자를 사용하여 상기 제1사인 파형을 변조하기 위한 홀수 변조기; 상기 제1반송자로부터 90도 만큼 위상 오프셋된 주파수 wot의 제2반송자를 사용하여 상기 제2사인 파형을 변조하기 위한 짝수 변조기; 상기 변조된 제1 및 제2파형들을 결합하여 연속 위상 변조 신호를 형성하기 위한 가산기; 및 상기 연속 위상 변조 신호를 전송하기 위한 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  6. 제2항에 있어서, 상기 제1지역 기준 신호는 상기 확산 스펙트럼 신호의 반송자와 동일한 주파수 및 위상을 갖는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  7. 제2항에 있어서, 상기 제2지역 기준 신호는 상기 제1지역 기준 신호와 동일한 주파수를 가지며 상기 제1지역 기준신호로 부터 90도의 위상 오프셋을 갖는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  8. 홀수 칩들 및 짝수 칩들의 시퀀스로부터 생성된 연속 위상 변조 확산 스팩트럼 신호를 수렴하는 방법에 있어서, 상기 확산 스펙트럼 신호를 수신하는 단계; 상기 확산 스펙트럼 신호를 제1 및 제2복제 신호들로 분할하는 단계; 상기 제1신호를 복조하여 상기 홀수 칩들에 대응하는 요소들의 제1시퀸스를 생성하는 단계; 상기 제2신호를 복조하여 상기 홀수 칩들에 대응하는 요소들의 제2시퀸스를 생성하는 단계; 상기 제1시퀀스를 상기 홀수 칩들과 상관시켜 홀수 상관 신호를 생성하는 단계; 상기 제2시퀀스를 상기 짝수 칩들과 상관시켜 짝수 상관 신호를 생성하는 단계; 및 상기 홀수 및 짝수 상관 신호들을 결합하여 단일화된 상관 신호를 생성하는 단계를 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 방법.
  9. 홀수 칩들 및 짝수 칩들의 시퀀스를 포함하는 수신된 확산 스펙트럼 신호에 결합되어 상기 확산 스펙트럼 신호를 제1 및 제2복제 신호들로 분할하는 신호 분학기; 상기 제1신호에 결합되어 상기 홀수 칩들에 대응하는 요소들의 제1시퀀스를 출력하는 제1복조기; 상기 제2신호에 결합되어 상기 짝수 칩들에 대응하는 요소들의 제2시퀀스를 출력하는 제2복조기; 상기 제1시퀀스 및 상기 홀수 칩들을 표현하는(representing) 지역적으로 생성된 신호에 결합되어 홀수 상관 신호를 출력하는 제1상관기; 상기 제2시퀀스 및 상기 짝수 칩들을 표현하는 지역적으로 생성된 신호에 결합도어 짝수 상관 신호를 출력하는 제2상관기; 및 상기 홀수 및 짝수 상관 신호들에 결합되어 단일화된 상관 신호를 출력하는 결합기를 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴장치.
  10. 제9항에 있어서, 상기 제1복조기는 상기 확산 스펙트럼 신호의 반송 신호에 주파수 및 위상 정합된 제1지역 기준 신호에 결합되는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  11. 제10항에 있어서, 상기 제2복조기는 상기 제1지역 기준 신호로부터 90도 위상 오프셋된 제2지역 기준신호에 결합되는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  12. 수신된 확산 스펙트럼 신호를 실수 신호와 허수 신호로 분할하는 단계; 상기 실수 신호를 복조하여 실수 I 신호와 실수 Q 신호를 생성하는 단계; 상기 허수 신호를 복조하여 허수 I 신호와 허수 Q 신호를 생성하는 단계; 상기 실수 I신호를 칩 시퀀스의 홀수 칩들과 상관시켜 실수 I상관 신호를 생성하는 단계; 상기 실수 Q신호를 상기 칩 시퀀스의 짝수 칩들과 상관시켜 실수 Q상관 신호를 생성하는 단계; 상기 허수 I신호를 상기 홀수 칩들과 상관시켜 허수 I상관 신호를 생성하는 단계; 상기 허수 Q신호를 상기 짝수 칩들과 상관시켜 허수 Q상관 신호를 생성하는 단계; 및 상기 실수 I상관 신호, 실수 Q상관 신호, 허수 I상관 신호, 및 허수 Q상관 신호를 결합하여 최종 상관 신호를 생성하는 단계를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 방법.
  13. 수신된 확산 스펙트럼 신호를 실수 신호와 허수 신호로 분할하기 위한 출력 분할기; 상기 실수 신호를 상관시켜 실수 상관 신호를 생성하기 위한 실수 CMP 상관기; 상기 허수 신호를 상관시켜 허수 상관 신호를 생성하기 위한 허수 CPM 상관기; 및 상기 실수 상관 신호 및 상기 허수 상관 신호를 결합하기 위한 수단을 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  14. 제13항에 있어서, 상기 실수 CPM 상관기및 상기 허수 CPM 상관기는 각각 입력 신호를 제1신호 및 제2신호로 분할하기 위한 수단; 상기 제1신호를 복조하여 I신호를 생성하기 위한 것으로서, 상기 확산 스펙트럼 신호의 반송자와 위상 정합되지 않은 제1지역 기준 신호를 더 포함하는 I복조기; 상기 제2신호를 복조하여 Q신호를 생성하기 위한 것으로서, 상기 제1지역 기준 신호와 동일한 주파수 및 상기 제1지역 기준 신호로부터 90도 만큼 오프셋된 위상을 가진 제2지역 기준 신호를 더 포함하는 Q 복조기; 상기 I 신호를 칩 시퀀스의 홀수 칩들과 상관시켜 I 상관 신호를 생성하기 위한 I 상관기; 상기 Q신호를 상기 실수 CPM 상관기를 위한 상기 칩 시퀀스의 짝수 칩들 또는 상기 허수 CPM 상관기를 위한 상기 짝수 칩들의 역순(inverse) 칩들과 상관시켜 Q 상관 신호를 생성하기 위한 Q 상관기; 및 상기 I 상관 신호와 상기 Q 상관 신호를 결합하여 출력 상관 신호를 생성하기 위한 가산기를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  15. 제14항에 있어서, 상기 I 상관기는 입력 신호를 수신하기 위한 복수의 칩 기억 위치를 가진 I 레지스터; 상기 칩 기억 위치들 중 하나씩 걸른 기억 위치들을 상기 홀수 칩들과 비교하여 복수의 I 비교 신호를 생성하기 위한 복수의 I 승산기; 및 상기 I 비교 신호들을 결합하여 I 상관 신호를 생성하기 위한 I 가산기를 포함하며, 상기 Q 상관기는 입력 신호를 수신하기 위한 복수의 칩 기억 위치를 가진 Q 레지스터; 상기 칩 기억 위치들중 하나씩 걸른 기억 위치들을 상기 실수 CMP 상관기를 위한 상기 짝수 칩들 또는 상기 허수 CPM 상관기를 위한 상기 짝수 칩들의 역순 칩들과 비교하여 복수의 Q 비교 신호를 생성하기 위한 복수의 Q 승산기; 및 상기 Q 비교 신호들을 결합하여 Q 상관신호를 생성하기 위한 Q 가산기를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  16. 제13항에 있어서, 상기 결합 수단은 상기 실수 상관 신호의 제곱 및 상기 허수 상관 신호의 제곱의 합의 제곱근 신호를 생성하기 위한 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  17. 수신된 확산 스펙트럼 신호를 서로의 복제물인 제1신호 및 제2신호로 분할하기 위한 출력 분할기; 상기 제1신호를 복조하여 실수 I/허수 Q 신호를 생성하기 위한 것으로서, 제1비간섭성 지역 기준 신호를 포함하는 수단; 상기 제2신호를 복조하여 실수 허수 I/실수 Q 신호를 생성하기 위한 것으로서, 상기 제1비간섭성 지역 기준 지역 기준 신호와 동일한 주파수 및 상기 제1비간섭성 지역 기준 신호로부터 90도 오프셋된 위상을 가진 제2비간섭성 지역 기준 신호를 포함하는 수단; 상기 실수 I/허수 Q 신호를 상관시켜 실수 I 상관 신호 및 허수 Q 상관 신호를 생성하기 위한 제1짝수/홀수 상관기; 상기 허수 I/실수 Q 신호를 상관시켜 허수 I 상관 신호 및 실수 Q 상관 신호를 생성하기 위한 제2짝수/홀수 상관기; 및 상기 실수 I 상관 신호, 상기 실수 Q 상관 신호, 상기 허수 I 상관 신호 및 상기 허수 Q 상관 신호를 결합하여 최종 상관 신호를 생성하기 위한 수단을 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  18. 제17항에 있어서, 상기 제1짝수/홀수 상관기 및 상기 제2짝수/홀수 상관기는 각각 입력신호를 수신하기 위한 복수의 칩 기억 위치를 가진 레지스터; 상기 칩 기억 위치들 중 하나씩 걸른 기억 위치들을 칩 시퀀스의 홀수 칩들과 비교하여 복수의 I 비교 신호를 생성하기 위한 복수의 I 승산기; 상기 I 비교 신호들을 결합하여 I 상관 신호를 생성하기 위한 I 가산기; 상기 칩 기억 위치들 중 하나씩 걸른 기억 위치들을 상기 제2짝수/홀수 상관기를 위한 상기 칩 시퀀스의 짝수 칩들 도는 상기 제1짝수/홀수 상관기를 위한 상기 짝수 칩들의 역순칩들과 비교하여 복수의 Q 비교 신호를 생성하기 위한 복수의 Q 승산기; 및 상기 Q 비교 신호들을 결합하여 Q 상관 신호를 생성하기 위한 Q 가산기를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  19. 제17항에 있어서, 상기 결합 수단은 사기 실수 I 상관 신호와 상기 실수 Q 신호를 결합하여 실수 상관 신호를 생성하기 위한 실수 가산기; 상기 허수 I 상관 신호와 상기 허수 Q 상관 신호를 결합하여 허수 상관 신호를 생성하기 위한 허수 가산기; 및 상기 실수 상관 신호의 제곱 및 상기 허수 상관 신호의 제곱의 합의 제곱근 신호를 생성하기 위한 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  20. 수신된 확산 스펙트럼 신호를 서로의 복제물인 제1신호 및 제2신호로 분할하는 단계; 제1비간섭성 지역 기준 신호를 사용해 상기 제1신호를 복조하여 실수 I/허수 Q 신호를 생성하는 단계; 상기 제1비간섭성 지역 기준 신호와 동일힌 주파수 및 상기 제1비간섭성 지역 기준 신호로부터 90도 오프셋된 위상을 가진 제2비간섭성 지역 기준 신호를 사용해 상기 제2신호를 복조하여 허수 I/실수 Q 신호를 생성하는 단계; 상기 실수 I/허수 Q 신호를 제1단일 레지스터에 일시 저장하는 단계; 상기 허수 I/실수 Q 신호를 제2단일 레지스터에 일시 저장하는 단계; 상기 제1레지스터의 내용들을 상관시켜 실수 1 상관 신호 및 허수 Q 상관 신호를 생성하는 단계; 상기 제2레지스터의 내용들을 상관시켜 허수 I 상관 신호 및 실수 Q 상관 신호를 생성하는 단계; 및 상기 실수 I 상관 신호, 상기 실수 Q 상관 신호, 상기 허수 I 상관 신호, 및 상기 허수 Q 상관 신호를 결합하여 최종 상관 신호를 생성하는 단계를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  21. 수신된 확산 스펙트럼 신호를 서로의 복제물인 제1신호 및 제2신호로 분할하는 단계; 제1비간섭성 지역 기준 신호를 사용해 상기 제1신호를 복조하여 제1복조 신호를 생성하는 단계; 상기 제1비간섭성 지역 기준 신호와 동일한 주파수 및 상기 제1비간섭성 지역 기준 신호로부터 90도 오프셋된 위상을 가진 제2비간섭성 지역기준 신호를 사용해 상기 제2신호를 복조하여 제2복조 신호를 생성하는 단계; 상기 제1복조 신호를 제1단일 레지스터에 일시 저장하는 단계; 상기 제2복조 신호를 제2단일 레지스터에 일시 저장하는 단계; 상기 제1레지스터의 내용들을 상관시켜 제1상관 신호 및 제2상관 신호를 생성하는 단계; 상기 제2레지스터의 내용들을 상관시켜 제3상관 신호 및 제4상관 신호를 생성하는 단계; 및 상기 제1상관 신호, 상기 제2상관 신호, 상기 제3상관 신호, 및 상기 제4상관 신호를 결합하여 최종 상관 신호를 생성하는 단계를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  22. 수신된 확장 스펙트럼 신호를 입력하여 제1신호 및 제2신호의 출력들을 구비한 출력 분할기; 상기 제1신호 및 상기 확산 스펙트럼 신호 내의 반송자와 위상 및 주파수가 다른 제1지역 기준 신호에 결합되며 제3신호를 출력하는 제1승산기; 상기 제2신호, 및 상기 제1지역 기준 신호로부터 90도 만큼 위상 오프셋된 제2지역 기준 신호에 결합되며 제4신호를 출력하는 제2승산기; 상기 제3신호에 결합되며 제1여파(filtered) 신호를 출력하는 제1저역 필터; 상기 제4신호에 결합되며 제2여파 신호를 출력하는 제2저역 필터; 상기 제1여파 신호를 수신하며 제1상관 신호 및 제2상관 신호를 출력하는 제1짝수/홀수 상관기; 상기 제2여파 신호를 수신하며 제3상관 신호 및 제4상관 신호를 출력하는 제2짝수/홀수 상관기; 및 상기 제1상관 신호. 상기 제2상관 신호, 상기 제3상관 신호, 및 상기 제4상관 신호를 결합하여 최종 상관 신호를 생성하기 위한 결합 수단을 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  23. 제22항에 있어서, 상기 제1짝수/홀수 상관기 및 상기 제2짝수/홀수 상관기는 각각 입력 신호를 수신하기 위한 복수의 칩 기억 위치를 가진 레지스터; 상기 칩 기억 위치들 중 홀수 기억 위치들, 및 칩 시퀀스 중 홀수 칩들에 접속되며 홀수 비교 신호를 각각 출력하는 복수의 홀수 승산기; 상기 홀수 비교 신호들의 각각에 접속되며 홀수 상관 신호를 출력하는 홀수 가산기; 상기 칩 기억 위치들 중 짝수 위치들, 및 상기 제2짝수/홀수 상관기를 위한 상기 칩 시퀀스의 짝수칩들 또는 상기 제1짝수/홀수 상관기를 위한 상기 짝수 칩들의 역순칩들에 접속되며 짝수 비교 신호를 각각 출력하는 복수의 짝수 승산기; 및 상기 짝수 비교 신호들의 각각에 접속되며 짝수 상관 신호를 출력하는 짝수 가산기를 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  24. 제22항에 있어서, 상기 결합 수단은 상기 제1상관 신호 및 상기 제4상관 신호를 입력받는 제1가산기; 상기 제2상관 신호 및 상기 제3상관 신호를 입력받는 제2가산기; 및 상기 제1가산기의 출력의 제곱 및 상기 제2가산기의 출력의 제곱의합의 제곱근 신호를 생성하기 위한 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  25. 제24항에 있어서, 상기 제1가산기의 출력의 제곱 및 상기 제2가산기의 출력의 제곱의 합의 제곱근 신호를 생성하기 위한 상기 수단은 로버트슨 장치(Robertson device)를 더 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  26. wo의 반송 주파수를 가진 CPM 신호를 생성하는 단계; 상기 CPM 신호를 전송하는 단계; 상기 CPM 신호를 수신하는 단계; 상기 수신 CPM 신호를 제1수신 CPM 신호 및 제2수신 CPM 신호를 분할하는 단계; 상기 수신기에서 상기 전송 반송자 신호 주파수 WO로부터 가변 위상 편이 θ만큼 오프셋된 동일 주파수를 각각 갖는 지역 코사인 파형 및 지역 사인 파형을 생성하는 단계; 상기 지역 코사인 파형을 사용해 상기 제1수신 CPM 신호를 변조하여 제1곱(product) 신호를 생성하는 단계; 상기 지역 사인 파형을 사용해 상기 제2수신 CPM 신호를 변조하여 제2곱 신호를 생성하는 단계; 상기 제1곱 신호를 저역 여파하여 제1여파 신호를 제공하는 단계; 상기 제2곱 신호를 저역 여파하여 제2여파 신호를 제공하는 단계; 상기 제1여파 신호를 제1짝수/홀수 상관기로 입력하는 단계; 상기 제2곱 신호를 제2짝수/홀수 상관기로 입력하는 단계; 상기 제2짝수/홀수 상관기에서 상기 제2여파 신호를 상관시켜 허수 I 상관 신호 및 허수 Q 상관 신호를 생성하는 단계; 상기 제2짝수/홀수 상관기에서 상기 제2여파 신호를 상관시켜 허수 I 상관 신호 및 실수 Q 상관 신호를 생성하는 단계; 상기 실수 I 신호 및 상기 실수 Q 신호를 더하여 실수 상관 신호를 생성하는 단계; 상기 허수 I 신호 및 상기 허수 Q 신호를 더하여 허수 상관 신호를 생성하는 단계; 상기 실수 상관 신호 및 상기 허수 상관 신호의 각각을 제곱하는 단계; 상기 제곱된 실수 및 허수 상관 신호들을 더하여 단일화된 상관 신호를 생성하는 단계; 및 상기 단일화된 상관 신호의 제곱근을 계산하는 단계를 포함하는 방법.
  27. 수신된 확산 스펙트럼 신호를 서로의 복제물인 제1신호 및 제2신호로 분할하기 위한 출력 분할기; 상기 제1신호에 제1간섭성 지역 기준 신호 및 칩 시퀀스의 홀수 칩들을 표현하는 홀수 칩 신호를 곱하여 I 곱 신호를 생성하기 위한 수단; 상기 제2신호에 상기 제1간섭성 지역 기준 신호와 동일한 주파수 및 90도 만큼 오프셋된 위상을 가진 제2간섭성 지역 기준 신호 및 상기 칩 시퀀스의 짝수 칩들을 표현하는 짝수 칩 신호를 곱하여 Q 곱 신호를 생성하기 위한 수단; 상기 I 곱 신호를 적분하여 I 상관 신호를 생성하기 위한 I 적분기; 상기 Q 곱 신호를 적분하여 Q 상관 신호를 생성하기 위한 Q 적분기; 및 상기 I 상관 신호 및 상기 Q 상관 신호를 결합하기 위한 가산기를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  28. 제27항에 있어서, 상기 홀수 칩 신호 및 상기 짝수 칩 신호는 각각 3가 0 복귀 파형(tri-valued return-to-zero waveform)을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  29. 수신된 확산 스펙트럼 신호를 서로의 복제물인 제1신호 및 제2신호로 분할하는 단계; 상기 제1신호에 제1간섭성 지역 기준 및 칩 시퀀스의 홀수 칩들을 표현하는 홀수 칩 신호를 곱하여 I 곱 신호를 생성하는 단계; 상기 제2신호에 상기 제1간섭성 지역 기준 신호와 동일한 주파수 및 90도 만큼 오프셋된 위상을 가진 제2간섭성 지역 기준 신호, 및 상기 칩 시퀀스의 짝수 칩들을 표현하는 짝수 칩 신호를 곱하여 Q 곱 신호를 생성하는 단계; 상기 I 곱 신호를 적분하여 I 상관 신호를 생성하는 단계; 상기 Q 곱 신호를 적분하여 Q 상관 신호를 생성하는 단계; 및 상기 I 상관 신호 및 상기 Q 상관 신호를 더하여 결합된 상관 신호를 생성하는 단계를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 방법.
  30. 수신된 확산 스펙트럼 신호를 실수 신호 및 허수 신호로 분할하기 위한 출력 분할기; 상기 실수 신호를 상관시켜 실수 상관신호를 생성하기 위한 제1직렬 상관기; 상기 허수 신호를 상관시켜 허수 상관 신호를 생성하기 위한 제2직렬 상관기; 및 상기 실수 상관 신호 및 사익 허수 상관 신호를 결합하기 위한 수단을 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  31. 제30항에 있어서, 상기 제1직렬 상관기 및 상기 제2직렬 상관기는 각각 입력신호를 서로의 복제물인 제1신호 및 제2신호로 분할하기 위한 출력 분할기; 제1비간섭성 지역 기준 신호를 사용해 상기 제1신호를 복조하여 I 신호를 생성하기 위한 수단; 상기 제1비간섭성 지역 기준 신호로부터 90도 만큼 위상 포프셋된 제2비간섭성 지역 기준 신호를 사용해 상기 제2신호를 복조하여 Q 신호를 생성하기 위한 수단; 상기 I 신호에 칩 시퀀스의 홀수 칩들을 표현하는 홀수 칩 신호를 곱하여 I 곱 신호를 생성하기 위한 I 승산기; 상기 Q 신호에 상기 직렬 상관기를 위한 상기 칩 시퀀스의 짝수 칩들을 표현하는 짝수 칩 신호 또는 상기 제2직렬 상관기를 위한 상기 짝수 칩들의 역순 칩들을 곱하여 Q 곱 신호를 생성하기 위한 Q 승산기; 상기 I 곱 신호를 적분하여 I 상관신호를 생성하기 위한 I 적분기; 상기 Q 곱 신호를 적분하여 Q 상관신호를 생성하기 위한 Q 적분기; 및 상기 I 상관 신호 및 상기 Q 상관 신호를 결합하여 출력 상관 신호를 생성하기 위한 가산기를 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  32. 제31항에 있어서, 상기 홀수 칩 신호 및 상기 짝수 칩 신호는 각각 3가 0 복귀 파형을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  33. 제30항에 있어서, 상기 결합 수단은 상기 실수 상관 신호의 제곱 및 상기 허수 상관신호의 제곱의 합의 제곱근을 계산하기 위한 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  34. 수신된 확산 스펙트럼 신호를 실수 신호 및 허수 신호로 분할하기 위한 출력 분할기; 상기 실수 신호를 상관시켜 실수 상관 신호를 생성하기 위한 것으로서, 상시 실수 신호를 서로의 복제물인 제1신호 및 제2신호로 분할하기 위한 실수 출력 분할기, 제1비간섭성 지역 기준 신호를 사용해 상기 제1신호를 복조하여 실수 I 신호를 생성하기 위한 수단, 상기 제1비간섭성 지역 기준 신호로부터 90도 만큼 위상 오프셋된 제2비간섭성 지역 기준 신호를 사용해 상기 제2신호를 복조하여 Q 신호를 생성하기 위한 수단, 상기 실수 I 신호에 칩 시퀀스의 홀수 칩들을 표현하는 홀수 칩 신호를 곱하여 실수 I 곱 신호를 생성하기 위한 실수 I 승산기, 상기 실수 Q 신호에 상기 칩 시퀀스의 짝수 칩들을 표현하는 짝수 칩 신호를 곱하여 실수 Q 곱 신호를 생성하기 위한 실수 Q 승산기, 상기 실수 I 곱 신호를 적분하여 실수 I 상관 신호를 생성하기 위한 실수 I 적분기, 상기 실수 Q 곱 신호를 적분하여 실수 Q 상관 신호를 생성하기 위한 실수 Q 적분기, 및 상기 실수 I 상관 신호 및 상기 실수 Q 상관 신호를 결합하여 상기 실수 상관 신호를 생성하기 위한 실수 가산기를 포함하는 실수 직렬 상관기; 상기 허수 신호를 상관시켜 허수 상관 신호를 생성하기 위한 것으로서, 상기 허수 신호를 서로의 복제물인 제3신호 및 제4신호로 분할하기 위한 허수 출력 분할기, 상기 제1비간섭성 지역 기준 신호를 사용해 상기 제3신호를 복조하여 허수 I 신호를 생성하기 위한 수단, 상기 제2비간섭성 지역 기준 신호를 사용해 상기 제4신호를 복조하여 허수 Q 신호를 생성하기 위한 수단, 상기 허수 I 신호에 상기 홀수 칩 신호를 곱하여 허수 I 곱 신호를 생성하기 위한 허수 I 승산기, 상기 허수 Q 신호에 상기 짝수 칩 신호의 역신호를 곱하여 허수 Q 곱 신호를 생성하기 위한 허수 Q 승산기, 상기 허수 I 곱 신호를 적분하여 허수 I 상관 신호를 생성하기 위한 허수 I 적분기, 상기 허수 Q 곱 신호를 적분하여 허수 Q 상관 신호를 생성하기 위한 허수 Q 적분기, 및 상기 허수 I 상관신호 및 상기 허수 Q 상관 신호를 결합하여 상기 허수 상관 신호를 생성하기 위한 허수 가산기를 포함하는 허수 직렬 상관기; 및 상기 실수 상관 신호 및 상기 허수 상관 신호를 결합하여 최종 상관 신호를 생성하기 위한 결합 수단을 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호를 수렴하기 위한 비간섭성 직렬 CPM 상관기.
  35. 제34항에 있어서, 상기 홀수 칩 신호 및 상기 짝수 칩 신호는 각각 3가 0 복귀 파형을 포함하는 비간섭성 직렬 CPM 상관기.
  36. 제34항에 있어서, 상기 결합수단은 상기 실수 상관 신호의 제곱 및 상기 허수 상관 신호의 제곱의 합의 제곱근을 계산하기 위한 수단을 포함하는 비간섭성 직렬 CPM 상관기.
  37. 수신된 확산 스펙트럼 신호를 실수 신호 및 허수 신호로 분할하는 단계; 상기 실수 신호를 상관시켜 실수 상관 신호를 생성하기 위한 것으로서, 상기 실수 신호를 서로의 복제물인 제1신호 및 제2신호로분할하는 단계, 제1비간섭성 지역 기준 신호를 사용해 상기 제1신호를 복조하여 실수 I 신호를 생성하는 단계. 상기 제1비간섭성 지역 기준 신호로부터 90도 만큼 위상 오프셋된 제2비간섭성 지역 기준 신호를 사용해 상기 제2신호를 복조하여 실수 Q 신호를 생성하는 단계, 상기 실수 I 신호에 칩 시퀀스의 홀수 칩들을 표현하는 홀수 칩 신호를 곱하여 실수 I 곱 신호를 생성하는 단계, 상기 실수 Q 신호에 상기 칩 시퀀스의 짝수 칩들을 표현하는 짝수 칩 신호를 곱하여 실수 Q 곱 신호를 생성하는 단계, 상기 실수 I 곱 신호를 적분하여 실수 I 상관 신호를 생성하는 단계, 상기 실수 Q 곱 신호를 적분하여 실수 Q 상관신호를 생성하는 단계, 및 상기 실수 I 상관 신호 및 상기 실수 Q 상관 신호를 더하여 상기 실수 상관 신호를 생성하는 단계를 더 포함하는 상기 실수 신호상관 단계; 상기 허수 신호를 상관시켜 허수 상관 신호를 생성하기 위한 것으로서, 상기 허수 신호를 서로의 복제물인 제3신호 및 제4신호로 분할하는 단계, 상기 제1비간섭성 지역 기준 신호를 사용해 상기 제3신호를 복조하여 허수 I 신호를 생성하는 단계, 상기 제2비간섭성 지역 기준 신호를 사용해 상기 제4신호를 복조하여 허수 O 신호를 생성하는 단계, 상기 허수 I 신호에 상기 홀수 칩 신호를 곱하여 허수 I 곱 신호를 생성하는 단계, 상기 허수 Q 신호에 상기 짝수 칩 신호의 역신호를 곱하여 허수 Q 곱 신호를 생성하는 단계, 상기 허수 I 곱 신호를 적분하여 허수 I 상관 신호를 생성하는 단계, 상기 허수 Q 곱 신호를 적분하여 허수 Q 상관 신호를 생성하는 단계, 및 상기 허수 I 상관 신호 및 상기 허수 Q 상관 신호를 더하여 상기 허수 상관 신호를 생성하는 단계를 더 포함하는 상기 허수 신호 상관 관계; 및 상기 실수 상관 신호 및 상기 허수 상관 신호를 결합하여 최종 상관 신호를 생성하는 단계를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 방법.
  38. 수신된 확산 스펙트럼 신호를 서로의 복제물인 제1신호 및 제2신호로 분할하는 출력 분할기; 상기 제1신호를 복조하여 실수I/허수Q 신호를 생성하기 위한 것으로서, 제1비간섭성 지역 기준 신호를 포함하는 수단; 상기 제2신호를 복조하여 허수 I/실수 Q 신호를 생성하기 위한 것으로서, 상기 제1비간섭성 지역 기준 신호와 동일한 주파수 및 90도 오프센된 위상을 가진 제2비간섭성 지역 기준 신호를 포함하는 수단; 상기 실수 I/허수 Q 신호에 칩 시퀀스의 홀수 칩들을 표현하는 홀수 칩 신호를 곱하여 실수 I 곱 신호를 생성하기 위한 실수 I 승산기; 상기 허수I/실수Q 신호에 상기 칩 시퀀스의 짝수 칩들을 표현하는 짝수 칩 신호를 곱하여 실수 Q 곱 신호를 생성하기 위한 실수 Q 승산기; 상기 허수 I/실수 Q 신호에 상기 홀수 칩 신호를 곱하여 허수 I 곱 신호를 생성하기 위한 허수 I 승산기; 상기 실수 I/허수 Q 신호에 상기 짝수 칩 신호의 역신호를 곱하여 허수 Q 곱 신호를 생성하기 위한 허수 Q 승산기; 상기 실수 I 곱 신호 및 상기 실수 Q 곱 신호를 결합하여 실수 곱 신호를 생성하기 위한 실수 가산기; 상기 허수 I 곱 신호 및 상기 허수 Q 곱 신호를 결합하여 허수 곱 신호를 생성하기 위한 허수 가산기; 상기 실수 곱 신호를 적분하여 실수 상관 신호를 생성하기 위한 실수 적분기; 상기 허수 곱 신호를 적분하여 허수 상관 신호를 생성하기 위한 허수 적분기; 및 상기 실수 상관 신호 및 상기 허수 상관 신호를 결합하여 최종 상관 신호를 생성하기 위한 결합 수단을 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  39. 제38항에 있어서, 상기 상기 홀수 칩 신호 및 상기 짝수 칩 신호는 각각 3가 0 복귀 파형을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  40. 제38항에 있어서, 상기 결합수단은 상기 실수 상관 신호의 제곱 및 상기 허수 상관 신호의 제곱의 합의 제곱근을 계산하기 위한 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  41. 수신된 확산 스펙트럼 신호에 결합되며 제1신호 및 제2신호의 출력들을 가진 출력 분할기; 상기 제1신호, 및 상기 확산 스펙트럼 신호내의 반송자와 시간 주기들 동안 위상 및 주파수가 다른 제1지역 기준 신호에 결합되며 제3신호를 출력하는 제1승산기; 상기 제2신호, 및 상기 제1지역 기준 신호로부터 90도 만큼 위상 오프셋된 제2지역 기준 신호에 결합되며 제4신호를 출력하는 제2승산기; 상기 제3신호에 결합되며 제1여파 신호를 출력하는 제1저역 필터; 상기 제4신호에 결합되며 제2여파 신호를 출력하는 제2저역 필터; 상기 제1여파 신호, 및 칩 시퀀스의 홀수 칩들을 표현하는 홀수 칩 신호를 입력받는 제1승산기; 상기 제2여파 신호 및 상기 홀수 칩 신호를 입력받는 제2승산기; 상기 제2여파 신호, 및 상기 칩 시퀀스이 짝수 칩들을 표현하는 짝수 칩 신호를 입력받는 제3승산기; 상기 제1여파 신호, 및 상기 짝수 칩 신호의 역신호를 입력받는 제4승산기; 상기 제1승산기의 출력 및 상기 제3승산기의 출력에 결합되는 제1가산기; 상기 제2승산기의 출력 및 상기 제4승산기의 출력에 결합되는 제2가산기; 상기 제1가산기의 출력에 접속되며 제1상관신호를 생성하는 제1적분기; 상기 제2가산기의 출력에접속되며 제2상관 신호를 생성하는 제2적분기; 및 상기 제1상관 신호 및 상기 제2상관 신호를 결합하여 초종 상관 신호를 생성하기 위한 결합 수단을 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴장치.
  42. 제41항에 있어서, 상기 홀수 칩 신호 및 사익 짝수 칩 신호는 각각 3가 0 복귀 파형을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴장치.
  43. 제41항에 있어서, 상기 결합 수단은 상기 제1상관 신호의 제곱 및 상기 제2상관 신호의 제곱의 합의 제곱근을 계산하기 위한 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴장치.
  44. 수신된 확산 스펙트럼 신호를 제1신호 및 제2신호로 분할하는 단계; 상기 제1신호, 및 상기 확산 스펙트럼 신호 내의 반송자와 시간 주기들 동안 위상 및 주파수가 다른 제1지역 기준 신호를 곱하여 제3신호를 생성하는 단계; 상기 제2신호, 및 상기 제1지역 기준 신호로부터 90도 만큼 위상 오프셋된 제2지역 기준 신호를 곱하여 제4신호를 생성하는 단계; 상기 제3신호를 저역 여파하여 제1여파 신호를 생성하는 단계; 상기 제4신호를 저역 여파하여 제2여파 신호를 생성하는 단계; 상기 제1여파 신호, 및 칩 시퀀스의 홀수 칩들을 표현하는 홀수 칩 시퀀스를 곱하여 제1곱 신호를 생성하는 단게; 상기 제2여파 신호및 상기 홀수 칩 신호를 곱하여 제2곱 신호를 생성하는 단계; 상기 제2여파 신호, 및 상기 칩 시퀀스의 짝수 칩 들을 표현하는 짝수 칩 신호를 곱하여 제3곱 신호를 생성하는 단계; 상기 제1여파 신호, 및 상기 짝수칩 신호의 역신호를 곱하여 제4곱 신호를 생성하는 단계; 상기 제1곱 신호 및 상기 제3곱 신호를 더하여 제1합 신호를 생성하는 단계; 상기 제2곱 신호 및 상기 제4곱 신호를 더하여 제2합 신호를 생성하는 단계; 상기 제1합 신호를 적분하여 제1상관 신호를 생성하는 단계; 상기 제2합 신호를 적분하여 제2상관 신호를 생성하는 단계; 및 상기 제1상관 신호 및 상기 제2상관 신호를 결합하여 최종 상관 신호를 생성하는 단계를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 방법.
  45. 제44항에 있어서, 상기 홀수 칩 신호 및 상기 짝수 칩 신호는 각각 3가 0 복귀 파형을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  46. 수신된 확산 스펙트럼 신호를 서로의 복제물인 제1신호 및 제2신호로 분할하는 단계; 제1비간섭성 지역 기준 신호를 사용해 상기 제1신호를 복조하여 실수 I/ 허수 Q 신호를 생성하는 단게; 상기 제1비간섭성 지역 기준 신호와 동일한 주파수 및 90도 만큼 오프셋된 위상을 가진 제2비간섭성 지역 기준 신호를 사용해 상기 제2신호를 복조하여 허수 I/실수 Q 신호를 생성하는 단계; 상기 실수 I/허수Q 신호에 칩 시퀀스의 홀수 칩들을 표현하는 홀수 칩 신호를 곱하여 실수 1곱 신호를 생성하는 단계; 상기 허수 I/실수 Q 신호에 상기 칩 시퀀스의 짝수 칩들을 표현하는 짝수 칩 신호를 곱하여 실수 Q 곱 신호를 생성하는 단계; 상기 허수 I/실수 Q 신호에 상기 홀수 칩 신호를 곱하여 허수 I 곱 신호를 생성하는 단계; 상기 실수 I/허수 Q 신호에 상기 짝수 칩 신호의 역신호를 곱하여 허수 Q 곱 신호를 생성하는 단계; 상기 실수 I 곱 신호 및 상기 실수 Q 곱 신호를 더하여 실수 곱 신호를 생성하는 단계; 상기 허수 I곱 신호 및 상기 허수 Q 곱 신호를 더하여 허수 곱 신호를 생성하는 단계; 상기 실수 곱 신호를 적분하여 실수 상관 신호를 생성하는 단계; 상기 허수 곱 신호를 적분하여 허수 상관 신호를 생성하는 단계; 및 상기 상기 실수 상관 신호 및 상기 허수 상관 신호를 결합하여 최종 상관 신호를 생성하는 단계를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 방법.
  47. 수신된 확산 스펙트럼 신호를 서로의 복제물인 제1신호 및 제2신호로 분할하기 위한 수단; 상기 제1신호를 복조하여 실수 I/허수 Q를 생성하기 위한 것으로서 제1비간섭성 지역 기준 신호를 포함하는 수단; 상기 제2신호를 복조하여 허수 I/실수 Q 신호를 생성하기 위한 것으로서 상기 제1비간섭성 지역 기준 신호와 동일한 주파수 및 90도 만큼 오프셋된 위상을 가진 제1비간섭성 지역 기준 신호를 포함하는 수단; 상기 실수 I/허수 Q 신호 및 칩 시퀀스를 입력으로서 수신하여 실수 I 출력 신호를 생성하는 실수 I 반전 배타적 논리합(inverted-XOR) 논리 게이트; 상기 허수 I/실수 Q 신호 및 상기 칩 시퀀스를 입력으로서 수신하여 허수 I 출력 신호 및 실수 Q 출력 신호를 생성하는 허수 I/실수 Q 반전 XOR 논리게이트; 상기 허수 I/실수 Q 신호 및 상기 칩 시퀀스를 입력으로서 수신하여 실수 Q 출력 신호를 생성하는 허수 Q 반전 XOR 논리게이트; 상기 실수 I 출력 신호 및 상기 실수 Q 출력 신호를 번갈아 수신하여 상기 실수 I/허수 Q 신호와 상기 칩 시퀀스의 홀수 칩들 간의 일치 수 및 상기 허수 I/실수 Q 신호와 상기 칩 시퀸스의 짝수 칩들 간의 일치 수를 나타내는 상관 신호를 생성하는 실수 계수기; 상기 허수 I 출력 신호및 상기 허수 Q 출력 신호를 번갈아 수신하여 상기 허수 I/ 실수 Q 신호와 상기 홀수 칩들 간의 일치 수 및 상기 실수 I/허수 Q 신호와 상기 짝수 칩들의 역순 칩들 간의 일치 수를 나타내는 허수 상관 신호를 생성하는 허수 계수기; 및 상기 실수 상관 신호 및 상기 허수 상관 신호를 결합하여 최종 상관 신호를 생성하기 위한 결합 수단을 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  48. 제47항에 있어서, 상기 결합 수단은 상기 실수 상관 신호의 제곱 및 상기 허수 상관 신호의 제곱의 합의 제곱근을 게산하기 위한 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  49. 제48항에 있어서, 상기 결합 수단은 로버트슨 장치를 더 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  50. 수신된 확산 스펙트럼 신호에 결합되며 제1신호 및 제2신호를 출력하는 출력 분할기; 상기 제1신호, 및 상기 확산 스펙트럼 신호 내의 반송자와 시간 주기들 동안 위상 및 주파수가 다른 제1지역 기준 신호에 결합되며 제3신호를 출력하는 제1승산기; 상기 제2신호, 및 상기 제1지역 기준 신호로부터 90도 만큼 위상 오프셋된 제2지역 기준 신호에 결합되며 제4신호를 출력하는 제2승산기; 상기 제3신호에 결합되며 제1여파 신호를 출력하는 제1저역 필터; 상기 제4신호에 결합되며 제2여파 신호를 출력하는 제2저역 필터; 상기 제1여파신호 및 칩 시퀀스를 입력받는 제1반전 XOR 논리게이트; 상기 제2여파 신호 및 상기 칩 시퀀스를 입력받는 제2반전 XOR 논리 게이트; 상기 제1여파 신호 및 상기 칩 시퀀스를 입력하는 제3반전 XOR 논리게이트; 상기 제1반전 XOR 논리 게이트의 출력 및 상기 제2반전 XOR 논리게이트의 출력을 입력받으며 공통 클럭신호에 의해 제어되는 제1멀티플렉서; 상기 제2반전 XOR 논리게이트의 출력 및 상기 제3반전 XOR 논리게이트의 출력을 입력받으며 상기 공통 클럭 신호에 의해 제어되는 제2멀티플렉서; 상기 제1멀티플렉서의 출력을 수신하며 제1계수 신호를 출력하는 제1계수기; 상기 제2멀티플렉서의 출력을 수신하며 제2계수 신호를 출력하는 제2계수기; 및 상기 제1게수 신호및 상기 제2계수 신호에 결합되며 상관 신호를 출력하는 로버트슨 장치를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  51. 수신된 확산 스펙트럼 신호를 실수 신호 및 허수 신호로 분할하기 위한 출력 분할기; 상기 실수 신호를 상관시키며 상관 시퀀스를 생성함이 없이 실수 상관 신호를 생성하기 위한 실수 CPM 상관기; 상기 허수 신호를 상관시키며 상관 시퀀스를 생성함이 없이 허수 상관 신호를 생성하기 위한 허수 CPM 상관기; 및 상기 실수 상관 신호 및 상기 허수 상관 신호를 결합하기 위한 수단을 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  52. 제51항에 있어서, 상기 결합 수단은 상기 실수 상관 신호의 제곱 및 상기 허수 상관 신호의 제곱의 합의 제곱근을 계산하기 위한 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  53. 수신된 확산 스펙트럼 신호를 실수 신호 및 허수 신호로 분할하기 위한 출력분할기; 상기 실수 신호를 상관시키며 상관 시퀀스를 생성함이 없이 실수 상관 신호를 생성하기 위한 것으로서, 상기 실수 신호를 제1신호 및 제2신호로 분할하기 위한 수단, 상기 제1신호를 복조하여 실수 I 신호를 생성학 위한 것으로서 제1비간섭성 지역 기준 신호를 더 포함하는 실수 I 복조기, 상기 제2신호를 복조하여 실수 Q 신호를 생성하기 위한 것으로서 상기 제1비간섭성 지역 기준 신호와 동일한 주파수 및 90도 만큼 오프셋된 위상을 가진 제2비간섭성 지역 기준 신호를 더 포함하는 실수 Q 복조기, 상기 실수 I 신호를 칩 시퀀스의 홀수 칩들과 상관시켜 상간 시퀀스를 생성함이 없이 실수 I 상관 신호를 생성하기 위한 자동 동기화 실수 I 상관기, 상기 실수 Q 신호를 상기 칩 시퀀스의 짝수 칩들과 상관시켜 상관 시퀀스를 생성함이 없이 실수 Q 상관 신호를 생성하기 위한 자동 동기화 실수 Q 상관기, 및 상기 실수 I 상관 신호 및 상기 실수 Q 상관 신호를 결합하여 상기 실수 상관 신호를 생성하기 위한 실수 가산기를 포함하는 실수 상관기; 상기 허수 신호를 상관시켜 상관 시퀀스를 생성함이 없이 허수 상관 신호를 생성하기 위한 것으로서, 상기 허수 신호를 제3신호 및 제4신호로 분할하기 위한 수단, 상기 제3신호를 복조하여 허수 I 신호를 생성하기 위한 것으로서 상기 제1비간섭성 지역 기준 신호를 더 포함하는 허수 I 복조기, 상기 제4신호를 복조하여 허수 Q 신호를 생성하기 위한 것으로서 상기 제2비간섭성 지역 기준 신호를 더 포함하는 허수 Q 복조기, 상기 허수 I 신호를 상기 홀수 칩들과 상관시켜 상관 시퀀스를 생성함이 없이 허수 I 상관 신호를 생성하기 위한 자동 동기화 허수 I 상관기, 상기 허수 Q 신호를 상기 짝수 칩들과 상과시켜 허수 Q 상관 신호를 생성하기 위한 자동 동기화 허수 Q 상관기, 및 상기 허수 I 상관 신호 및 상기 허수 Q 상관 신호를 결합하여 상관 시퀀스를 생성함이 없이 상기 허수 상관 신호를 생성하기 위한 허수 가산기를 포함하는 허수 상관기; 및 상기 실수 상관 신호 및 상기 허수 상관 신호를 결합하여 최종 상관 신호를 생성하기 위한 결합 수단을 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  54. 제53항에 앴어서, 상기 결합 수단은 상기 실수 상관 신호의 제곱 및 상기 허수 상관 신호의 제곱의 합의 제곱근을 게산하기 위한 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  55. 수신된 확산 스펙트럼 신호를 실수 신호 및 허수 신호로 분할하는 단계; 상기 실수 신호를 상관시켜 상관 시퀀스를 생성함이 없이 실수 상관 신호를 생성하는 단계; 상기 허수 신호를 상관시켜 상관 시퀀스를 생성함이 없이 허수 상관 신호를 생성하는 단계; 및 상기 실수 상관 신호 및 상기 허수 상관 신호를 결합하여 출력 상관 신호를 생성하는 단계를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 방법.
  56. 수신된 확산 스펙트럼 신호를 실수 신호 및 허수 신호로 분할하는 단계; 상기 실수 신호를 상관시켜 상관 시퀀스를 생성함이 없이 실수 상관 신호를 생성하기 위한 것으로서, 상기 실수 신호를 제1신호 및 제2신호로 분할하는 단계, 제1비간섭성 지역 기준 신호를 사용해 상기 제1신호를 복조하여 실수 I 신호를 생성하는 단계, 상기 제1비간섭성 지역 기준 신호와 동일한 주파수 및 90도 오프셋된 위상을 가진 제2비간섭성 지역 기준 신호를 사용해 상기 제2신호를 복조하여 실수 Q 신호를 생성하는 단계, 상기 실수 I 신호를 칩 시퀀스의 홀수 칩들과 상관시켜 상관 시퀀스를 생성함이 없이 실수 I 상관 신호를 생성하는 단계, 상기 실수 Q 신호를 상기 칩 시퀀스의 짝수 칩들과 상관시켜 상관 시퀀스를 생성함이 없이 실수 Q 상관 신호를 생성하는 단계, 및 상기 실수 I 상관 신호 및 상기 실수 Q 상관 신호를 결합하여 상기 실수 상관 신호를 생성히는 단계를 포함하는 상기 실수 신호 상관 단계; 상기 허수 신호를 상관시켜 상관 시퀀스를 생성함이 없이 허수 상관 신호를 생성하기 위한 것으로서, 상기 허수 신호를 제3신호 및 제4신호로 분할하는 단계, 상기 제1비간섭성 지역 기준 신호를 사용해 상기 제3신호를 복조하여 허수 I 신호를 생성하는 단계, 상기 제2비간섭성 지역 기준 신호를 사용해 상기 제4신호를 복조하여 허수 Q 신호를 생성하는 단계, 상기 허수 I 신호를 상기 홀수 칩들과 상관시켜 상관 시퀀스를 생성함이 없이 허수 I 상관 신호를 생성하는 단계, 상기 허수 Q 신호를 상기 짝수 칩들과 상관시켜 상관 시퀀스를 생성함이 없이 허수 Q 상관 신호를 생성하는 단계, 및 상기 허수 I 상관 신호 및 상기 허수 Q 상관 신호를 결합하여 상기 허수 상관 신호를 생성하는 단계를 포함하는 상기 허수 신호 상관 단계; 및 상기 실수 상관 신호 및 상기 허수 상관 신호를 결합하여 최종 상관 신호를 생성하는 단계를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 방법.
  57. 데이타 비트 집합에 각각 대응하는 복수의 심볼 부호, 및 프리앰블(preamble)을 포함하는 확산 스펙트럼 신호를 수신하기 위한 수단; 상기 프리앰블을 상관시키기 위한 것으로서 동기 신호를 출력하는 병렬 상관기; 상기 동기 신호에 응답하는 직렬 상관기 클럭; 상기 직렬 상관기 클럭에 응답하고, 상기 심볼 부호들 중 서로 다른 심볼 부호에 각각 응답하도록 예정되며, 상기 확산 스펙트럼 신호를 상기 일 심볼 부호에 소정의 정도로 정합시킴과 동시에 각각 상관 신호를 생성하는 복수의 직렬 상관기; 및 상기 직렬 상관기들에 접속되어 데이타 스트림을 생성하기 위한 수단을 포함하는 확산 스펙트럼 신호 수렴 장치.
  58. 제57항에 있어서, 상기 데이타 스트림 생성 수단은 상기 직렬 상관기들에 의해 생성된 상기 상관 신호들 중 가장 큰 신호를 선택하기 위한 베스트-오브-엠(best-of-M) 장치를 포함하는 확산 스펙트럼 신호 수렴 장치.
  59. 제57항에 있어서, 시분할 다중 접속 시스템 내에서 적시 동기성(timed synchronicity)을 유지하기 위한 계수기를 더 포함하는 확산 스팩트럼 신호 수렴 장치.
  60. 제57항에 있어서, 상기 확산 스펙트럼 신호는 연속 위상 변조 신호를 포함하는 확산 스펙트럼 신호 수렴 장치.
  61. 확산 스펙트럼 송신기 및 확산 스펙트럼 수신기를 포함하며, 상기 확산 스펙트럼 송신기는 데이타 스트림으로부터 칩 시퀀스를 생성하기 위한 칩 시퀀스 생성기; 상기 칩 시퀀스를 홀수 칩 시퀀스 및 짝수 시퀀스로 분할하기 위한 스위치; 및 상기 홀수 칩 시퀀스 및 상기 짝수 칩 시퀀스로부터 연속 위상 변조 신호를 생성하여 전송하기 위한 변조기를 포함하며, 상기 확산 스펙트럼 수신기는 복수의 비간섭성 직력CPM 상관기를 사용해 상기 확산 스펙트럼 신호를 수렴하여 상기 복수의 상관기 중 각각의 상관기에 대해 하나씩, 복수의 상관 신호를 생성하기 위한 수단; 및 상기 상관 신호들을 기초로 데이타 심복을 선택하기 위한 수단을 포함하는 확산 스펙트럼 통신 시스템.
  62. 제61항에 있어서, 상기 칩 시퀀스 생성기는 상기 데이타 스트림 내의 고유 비트열에 대응하는 칩 시퀀스를 각각 포함하는 심볼 부호들의 표(table)를 포함하는 확산 스펙트럼 통신 시스템.
  63. 제62항에 있어서, 상기 칩 시퀀스 생성기는 적어도 하나의 충전 부호(fill code)를 생성하기 위한 수단을 더 포함하는 확산 스펙트럼 통신 시스템.
  64. 제61항에 있어서, 상기 칩 시퀀스 생성기는 프리앰블을 생성하기 위한 수단을 포함하며, 상기 확산 스펙트럼 수신기는 상기 프리앰블을 상관시키기 위한 상관기를 더 포함하는 확산 스펙트럼 통신 시스템.
  65. 칩 시퀀스들을 저장하기 위한 복수의 표; 상기 복수의 표의 각각으로부터 출력을 선택하고 상기 칩 시퀀스들을 결합하여 단일화된 칩 시퀀스를 생성하기 위한 멀티플렉서; 상기 단일화된 칩 시퀀스를 홀수 및 시퀀스 및 짝수 칩 시퀀스로 분할하기 위한 스위치; 상기 홀수 칩 시퀀스로부터 제1사인 파형을 생성하고 상기 짝수 칩 시퀀스로부터 제2사인 파형을 생성하기 위한 파형 생성기; 및 상기 제1 및 제2사인 파형들을 결합하여 연속 위상 변조 신호를 생성하며 상기 연속 위상 변조 신호를 전송하기 위한 수단을 포함하는 확산 스펙트럼 송신기.
  66. 제65항에 있어서, 상기 복수의 표는 고유 데이타 비트열에 각각 대응하는 부호 시퀀스들을 저장하기 위한 제1표; 정합된 필터 부호를 저장하기 위한 제2표; 및 적어도 하나의 충전 부호를 저장하기 위한 제3표를 포함하는 확산 스펙트럼 수신기.
  67. 제65항에 있어서, 상기 파형 생성기는 상기 제1사인 파형을 생성하기 위해 I 복호기에 결합되며 상기 홀수 칩 시퀀스로부터 적어도 2개의 칩을 주소로 수신하는 I 탐색표(lookup table); 및 상기 제2사인 파형을 생성하기 위해 Q 복호기에 결합되며 상기 짝수 칩 시퀀스로부터 2개의 칩을 주소로 수신하는 2 탐색표를 더 포함하는 확산 스펙트럼 수신기.
  68. 입력 신호를 수신하는 단계; 제1반송 신호를 사용해 상기 입력 신호를 복조하여 제1복조 신호를 생성하고, 상기 제 1반송 신호와 동일한 주파수 및 오프셋된 위상을 가진 제2반송 신호를 사용해 상기 입력 신호를 복조하여 제2복조 신호를 생성하는 단계; 상기 제1복조 신호를 제1다중 비트 디지탈 신호로 변환하는 단계; 상기 제2복조 신호를 제2다중 비트 디지탈 신호로 변환하는 단계; 상기 제1다중 비트 디지탈 신호 및 상기 제2다중 비트 디지탈 신호를 칩 부호에 대해 개별적으로 상관시키는 단계; 및 상관 출력 신호를 생성하는 단계를 포함하는 확산 스펙트럼 신호 수렴 방법.
  69. 입력신호를 수신하는 수단; 상기 입력 신호 및 제1기준 신호에 결합된 입력들을 가진 제1승산기; 상기 입력 신호, 및 상기 제1기준 신호의 위상 오프셋 버전(version)에 결합된 입력들을 가진 제2승산기; 상기 제1승산기의 출력에 접속된 제1필터; 상기 제2승산기의 출력에 접속된 제2필터; 상기 제1필터의 출력에 접속된 제1다중 비트 아날로그/디지탈(A/D) 변환기; 상기 제2필터의 출력에 접속된 제2다중 비트 아날로그/디지탈 변환기; 및 상기 제1다중 비트 아날로그/디지탈 변환기의 출력 및 상기 제2다중 비트 아날로그/디지탈 변환기의 출력에 접속되며 상기 출력에 응답하여 단일화된 상관 신호를 출력하는 다중 비트 직렬 상관기를 포함하는 확산 스펙트럼 수신기.
  70. 제69항에 있어서, 사이 입력 신호는 연속 위상 변조 확산 스펙트럼 신호를 포함하는 확산 스펙트럼 수신기.
  71. 제69항에 있어서, 상기 제1기준 신호의 상기 위상 오프셋 버전은 상기 제1기준 신호로부터 90도 만큼 위상 오프셋된 확산 스펙트럼 수신기.
  72. 제69항에 있어서, 상기 다중 비트 직렬 상관기는 상기 제1다중 비트 아날로그/디지탈 변환기 또는 상기 제2다중 비트 아날로그/디지탈 변환기에 각각 접속된 복수의 승산기; 상기 승산기들 중 하나의 승산기의 출력에 각각 접속된 복수의 누산기; 상기 누산기들 중 적어도 2개의 누산기의 출력에 각각 접속된 복수의 가산기; 및 상기 가산기들 각각의 출력에 결합된 절대값(magnitude) 계산 블록을 포함하는 확산 스펙트럼 수신기.
  73. 제69항에 있어서, 상기 다중 비트 직렬 상관기는 상기 제1다중 비트 아날로그/디지탈 변환기의 출력에 각각 접속된 제3승산기 및 제4승산기; 상기 제2다중 비트 아날로그/디지탈 변환기의 출력에 각각 접속된 제5승산기 및 제6승산기; 상기 제3승산기의 입력 및 상기 제5승산기의 입력에 결합된 홀수 칩 신호; 상기 제6승산기의 입력에 결합된 짝수 칩 신호; 상기 제4승산기의 입력에 결합된 상기 짝수 칩 신호의 역신호; 상기 제3승산기의 입력에 접속된 제1누산기; 상기 제4승산기의 출력에 접속된 제2누산기; 상기 제5승산기의 출력에 접속된 제3누산기; 상기 제6승산기의 출력에 접속된 제4누산기; 상기 제1누산기 및 상기 제4누산기의 출력에 접속된 제1가산기; 상기 제2누산기 및 상기 제3누산기의 출력에 접속된 제2가산기; 및 상기 제1가산기의 출력 및 상기 제2가산기의 출력에 접속된 입력들을 가진 절대값 계산 블록을 포함하는 확산 스펙트럼 수신기.
  74. 제69항에 있어서, 상기 다중 비트 직렬 상관기는 상기 제1다중 비트 아날로그/디지탈 변환기의 출력 및 칩 신호에 접속된 입력들을 가진 제3승산기; 사익 제2다중 비트 아날로그/디지탈 변환기의 출력 및 상기 칩 신호에 접속된 입력들을 가진 제4승산기; 상기 제3승산기의 출력 및 상기 제4승산기의 출력에 접속된 제1멀티플렉서; 상기 제3승산기의 상기 출력 및 상기 제4승산기의 상기 출력의 역출력에 접속된 제2멀티플렉서; 상기 제1멀티플렉서의 출력에 접속된 제1누산기; 상기 제2멀티플렉서의 출력에 접속된 제2누산기; 및 상기 제1누산기의 출력 및 상기 제2누산기의 출력에 접속된 절대값 계산 블록을 포함하는 확산 스펙트럼 수신기.
  75. 제74항에 있어서, 상기 절대값 계산 블록은 로버트슨 장치를 포함하는 확산 스펙트럼 수신기.
  76. 제69항에 있어서, 상기 다중 비트 직렬 상관기는 위상 계산 블록을 포함하는 확산 스펙트럼 수신기.
  77. 확산 스펙트럼 신호를 서로의 복제물인 제1신호 및 제2신호로 분할하는 단계; 제1비간섭성 지역 기준 신호를 사용해 상기 제1신호를 복조하여 실수 I/허수 Q 신호를 생성하는 단계; 상기 제1비간섭성 지역 기준 신호와 동일한 주파수 및 90도 오프셋된 위상을 가진 제1비간섭성 지역 기준 신호를 사용해 상기 제2신호를 복조하여 허수 I/실수 Q 신호를 생성하는 단계; 상기 실수 I/허수 Q 신호를 제1다중 비트 디지탈 신호로 변환하는 단계; 상기 허수 I/실수 Q 신호를 제2다중 비트 디지탈 신호로 변환하는 단계; 상기 제1다중 비트 디지탈 신호를 홀수 및 짝수 칩들을 포함하는 칩 시퀀스와 상관시키며 제1상관 합계를 누산하는 단계; 상기 제2다중 비트 디지탈 신호를 상기 칩 시퀀스의 홀수 칩들, 및 짝수 칩들의 역순 칩들과 상관시키며 제2상관 합계를 누산하는 단계; 및 상기 제1상관 합계 및 상기 제2상관 합계를 결합하여 단일화된 상관 출력 신호를 생성하는 단계를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 방법.
  78. 입력 신호에 결합되며 제1신호 및 제2신호의출력들을 가진 출력 분할기; 상기 제1신호, 및 송신기 반송 신호와 동기화되지 않은 제1지역 기준 신호에 결합되며 제3신호를 출력하는 제1승산기; 상기 제2신호, 및 상기 제1지역 기준 신호로부터 90도 만큼 위상 오프셋된 제2지역 기준 신호에 결합되며 제4신호를 출력하는 제2승산기; 상기 제3신호에 결합되며 제1여파 신호를 출력하는 제1저역 필터; 상기 제4신호에 결합되며 제2여파 신호를 출력하는 제2저역 필터; 상기 제1여파 신호에 결합되며 제1다중 비트 디지탈 신호를 출력하는 제1다중 비트 A/D 변환기; 상기 제2여파 신호에 결합되며 제2다중 비트 디지탈 신호를 출력하는 제2다중 비트 A/D 변환기; 및 상기 제1다중 비트 디지탈 신호 및 상기 제2다중 비트 디지탈 신호에 결합되고 실수 I 상관신호, 실수 Q 상관 신호, 허수 I 상관 신호, 및 허수 Q 상관 신호를 생성하며 단일화된 상관 신호를 출력하는 다중 비트 상관기를 포함하는 수신된 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  79. 제78항에 있어서, 상기 다중 비트 상관기는 상기 제1다중 비트 디지탈 신호, 및 칩 시퀀스의 홀수 칩들을 표현하는 홀수 칩 신호를 입력받는 제1승산기; 상기 제2다중 비트 디지탈 신호 및 상기 홀수 칩 신호를 입력받는 제2승산기; 상기 제2다중 비트 디지탈 신호, 및 상기 칩 시퀀스의 짝수 칩들을 표현하는 짝수 칩 신호를 입력받는 제3승산기; 상기 제1다중 비트 디지탈 신호, 및 사익 짝수 칩 신호의 역신호를 입력받는 제4승산기; 상기 제1승산기의 출력에 결합된 제1누산기; 상기 제2승산기의 출력에 결합된 제2누산기; 상기 제3승산기의 출력에 결합된 제3누산기; 사익 제4승산기의 출력에 결합된 제4누산기; 상기 제1누산기의 출력 및 상기 제3누산기의 출력에 결합된 입력들을 가지며 제1상관 신호를 출력하는 제1가산기; 상기 제2누산기의 출력 및 상기 제4누산기의 출력에 결합된 입력들을 가지며 가지며 제2상관 신호를 출력하는 제2가산기; 및 상기 제1상관 신호 및 상기 제2상관 신호를 결합하여 상기 단일화된 상관 신호를 생성하기 위한 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  80. 제79항에 있어서, 상기 제1상관 신호는 실수 상관 신호에 대응하며 상기 제2상관 신호는 허수 상관 신호에 대응하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  81. 제78항에 있어서, 상기 다중 비트 상관기는 상기 제1다중 비트 디지탈 신호 및 칩 시퀀스를 입력받는 제1승산기; 상기 제2다중 비트 디지탈 신호 및 상기 칩 시퀀스를 입력받는 제2승산기; 상기 제1승산기의 출력 및 상기 제2승산기의 출력에 결합된 제1멀티플렉서; 상기 제1승산기의 상기 출력의 역출력 및 상기 제2승산기의 상기 출력에 결합된 제2멀티플렉서; 상기 제1멀티플렉서의 출력에 결합되며 제1상관 신호를 출력하는 제1누산기; 상기 제2멀티플렉서의 출력에 결합되며 제2상관 신호를 출력하는 제2누산기; 및 상기 제1상관 신호 및 상기 제2상관 신호를 결합하여 상기 단일화된 상관 신호를 생성하기 위한 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  82. 제81항에 있어서, 상기 제1상관 신호는 실수 상관 신호에 대응하며 상기 제2상관 신호는 허수 상관 신호에 대응하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  83. 제78항에 있어서, 상기 입력 신호의 위상을 계산하기 위한 수단을 더 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  84. 확산 스펙트럼 신호를 제1 및 제2복제 신호들로 분할하기 위한 출력 분할기; 상기 제1복제 신호를 복조하여 실수 I/허수 Q 신호를 생성하기 위한 것으로서 제1비간섭성 지역 기준 신호를 포함하는 수단; 상기 제2복제 신호를 복조하여 허수 I/실수 Q 신호를 생성하기 위한 것으로서 상기 제1비간섭성 지역 기준 신호와 동일한 주파수 및 90도 만큼 오프셋된 위상을 가진 제2비간섭성 지역 기준 신호를 포함하는 수단; 상기 실수 I/허수 Q 신호에 결합되며 제1다중 비트 신호를 출력하는 제1다중 비트 아날로그/디지탈 변환기; 상기 허수 I/실수 Q 신호에 결합되며 제2다중 비트 신호를 출력하는 제2다중 비트 아날로그/디지탈 변환기; 및 상기 제1다중 비트 신호 및 상기 제2다중 비트 신호를 칩 부호와 상관시켜 단일화된 상관 신호를 출력하기 위한 상관 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  85. 제84항에 있어서, 상기 상관 수단은 상기 제1다중 비트 신호에 칩 시퀀스의 홀수 칩들을 표현하는 홀수 칩 신호를 곱하여 실수 I 곱 신호를 생성하기 위한 실수 I 승산기; 상기 제2다중 비트 신호에 상기 칩 시퀸스의 짝수 칩들을 표현하는 짝수 칩 신호를 곱하여 실수 Q 곱 신호를 생성하기 위한 실수 Q 승산기; 상기 제2다중 비트 신호에 사익 홀수 칩 신호를 곱하여 허수 I 곱 신호를 생성하기 위한 허수 I 승산기; 상기 제1다중 비트 신호에 상기 짝수 칩 신호의 역신호를 곱하여 허수 Q 곱 신호를 생성하기 위한 허수 Q 승산기; 상기 실수 I 곱 신호에 결합된 실수 I 누산기 상기 실수 Q 곱 신호를 결합된 실수 Q 누산기; 상기 허수 I 곱 신호에 결합된 허수 I 누산기; 상기 허수 Q 곱 신호에 결합된 허수 Q 누산기; 상기 실수 I 누산기 및 상기 실수 Q 누산기에 결합된 입력들을 가지며 실수 상관 신호를 출력하는 실수 가산기; 상기 허수 I 누산기 및 상기 허수 Q 누산기에 결합된 입력들을 가지며 허수 상관 신호를 출력하는 허수 가산기; 및 상기 실수 상관 신호 및 상기 허수 상관 신호를 결합하여 사익 단일화된 상관 신호를 생성하기 위한 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  86. 제84항에 있어서, 상기 상관 수단은 상기 제1다중 비트 신호에 칩 시퀸스를 곱하여 실수 I/허수 Q 곱신호를 생성하기 위한 제1승산기; 상기 제2다중 비트 신호에 사익 칩 시퀀스를 곱하여 실수 Q/허수 I 곱 신호를 생성하기 위한 제2승산기; 상기 실수 I/허수 Q 곱 신호의 실수 I 성분 및 상기 실수 Q/허수 I곱 신호의 실수 Q 성분을 선택하기 위한 제1선택수단; 상기 실수 I/허수 Q 곱 신호의 허수 Q 성분 및 상기 실수 Q/허수 I 곱 신호의 허수 I 성분을 선택하기 위한 제2선택 수단; 상기 실수 I 성분 및 상기 실수 Q 성분에 결합되며 실수 상관 신호를 출력하는 실수 누산기; 상기 허수 I 성분 및 상기 허수 Q 성분에 결합되며 실수 상관 신호를 출력하는 허수 누산기; 및 상기 실수 상관 신호 및 상기 허수 상관 신호를 결합하여 상기 단일화된 상관 신호를 생성하기 위한 결합 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  87. 제86항에 있어서, 상기 제1선택 수단 및 상기 제2선택 수단은 각각 멀티플렉서를 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  88. 제86항에 있어서, 상기 결합 수단은 상기 실수 상관 신호의 제곱 및 상기 허수 상관 신호의 제곱의 합의 제곱근을 계산하기 위한 수단을 포함하는 연속 위상 변조 확산 스펙트럼 신호 수렴 장치.
  89. 데이타 스트림을 심볼 선택부 및 위상 선택부로분할하기 위한 수단; 사익 심볼 선택부에 접속되며 상기 심볼 선택부에 응답하여 심볼 부호 시퀀스를 출력하는 심볼표(symbol table); 및 상기 심볼 부호 시퀀스에 접속되어 상기 심볼부호들 각각에 대한 위상이 상기 위상 선택부 및 사전(previous) 심볼 부호 위상에 의해 결정되도록 하는 위상 선택기를 포함하는 전송 신호 차동 위상 부호화 장치.
  90. 제89항에 있어서, 상기 위상 선택기는 칩들의 스트림을 포함하는 위상 부호화된 심볼 부호 시퀀스를 출력하며, 상기 장치는 상기 위상 부호화된 심볼 부호 시퀀스에 결합되어 짝수 칩 스트림 및 홀수 칩 스트림을 출력하는 스위치; 상기 홀수 칩 스트림에 결합되어 제1파형을 출력하는 홀수 파형 생성기; 상기 짝수 칩 스트림에 결합되어 제2파형을 출력하는 작수 파형 생성기; 상기 제1파형 및 주파수 wot를 가진 제1반송자에 결합된 홀수 변조기; 상기 제2파형, 및 상기 제1반송자로부터 90도 만큼 위상 오프셋된 주파수 wot의 제2반송자에 결합된 짝수 변조기; 및 상기 홀수 변조기의 출력 및 상기 짝수 변조기의 출력에 결하되어 전송될 결합 신호를 출력하는 가산기를 포함하는 전송 신호 차동 위상 부호화 장치.
  91. 제90항에 있어서, 상기 결합 신호는 연속 위상 변조 신호인 전송 신호 차동 위상 부호화 장치.
  92. 제89항에 있어서, 상기 데이타 스트림을 분할하기 위한 상기 수단은 상기 심볼 선택부를 수신하는 제1레지스터 및 상기 위상 선택부를 수신하는 제2레지스터를 포함하는 전송 신호 차동 위상 부호화 장치.
  93. 제89항에 있어서, 수신기를 더 포함하며, 상기 수신기는 실수 상관 신호 및 허수 상관 신호를 출력하는 상관기; 상기 실수 상관 신호 및 상기 허수 상관 신호에 결합되어 섹터 식별 신호를 출력하는 위상 식별기; 및 상기 섹터 식별신호 및 사전의 섹터 식별 신호에 결합되어 섹터 차(sector difference) 신호를 출력하는 감산기를 포함하는 전송 신호 차동 위상 부호화 장치.
  94. 제93항에 있어서,상기 수신기는 상기 섹터 차 신호를 기초로 하여 위상 부호화된 정보를 복원하기 위한 수단을 더 포함하는 전송 신호 차동 위상 부호화 장치.
  95. 제94항에 있어서, 상기 위상 부호화된 정보는 사익 섹터 차 신호가 소정의 값보다 작은 경우에는 제1위상으로 상기 섹터 차 신호가 상기 소정의 값보다 큰 경우에는 제2위상으로 결정되는 전송 신호 차동 위상 부호화 장치.
  96. 제95항에 있어서, 상기 제1위상은 제1데이타 값을 나타내며 사익 제2위상은 제2데이타 값을 나타내는 전송 신호 차동 위상 부호화 장치.
  97. 제93항에 있어서, 상기 상관기는 비간섭성 CPM 상관기를 포함하는 전송 신호 차동 위상 부호화 장치.
  98. 제93항에 있어서, 사익 위상 식별기는 상기 실수 상관 신호의 부호(sign)를 결정하기 위한 수단; 상기 허수 상관 신호의부호를 결정하기 위한 수단; 상기 실수 상관 신호 및 상기 허수 상관 신호에 결합되어 절대값 비교 신호를 출력하는 비교기; 및 상기 실수 상관 신호의 부호, 상기 허수 상관 신호의 부호, 및 상기 절대값 비교 신호를 기초로 하여 상기 수신기에 의해 수신된 신호의 위상각의 섹터를 결정하기 위한 수단을 포함하는 전송 신호 차동 위상 부호화 장치.
  99. 제93항에 있어서, 상기 위상 식별기는 사익 실수 상관 신호 및 상기 허수 상관 신호로부터 주소를 형성하기 위한 수단; 및 상기 주소에 접속된 섹터 탐색표를 포함하는 전송 신호 차동 위상 부호화 장치.
  100. 데이타 스트림을 심볼 선택부 및 위상 선택부를 각각 포함하는 다중 비트 집합들로 분할하는 단계; 상기 심볼 선택부에 응답하여 심볼 부호표에 저장된 복수의 심볼 부호로부터 심볼 부호를 선택하는 단계; 및 상기 심볼 선택부 및 사전의 심볼 부호 위상에 응답하여 상기 심볼 부호의 위상을 선택하는 단계를 포함하는 전송 신호 차동 위상 부호화 방법.
  101. 입력데이타 신호에 응답하여 데이타 심볼들의 시퀀스를 생성하는 단계; 각각의 데이타 심볼에 대해, 상기 데이타 심볼의 제1소정 부분을 기초로 하여 심볼 부호를 선택하고 상기 데이타 심볼의 제2소정 부분 및 사전 심볼 부호 위상을 기초로 하여 상기 심볼 부호의 위상을 선택하는 단계; 상기 심볼 부호를 연속 위상 변조하는 단계; 상기 연속 위상 변조 심볼 부호를 전송 신호로서 전송하는 단계; 상기 전송 신호를 수신하는 단계; CPM 상관기로 상기 전송 신호를 상관시켜 실수 상관 신호 및 허수 상관 신호를 생성하는 단계; 및 상기 실수 상관 신호및 상기 허수 상관 신호의 상대적인 크기 및 극성을 기초로 하여 상기 전송 신호의 수신 신호 위상을 결정하는 단계를 포함하는 통신 방법.
  102. 입력데이타 스트립에 결합된 제1레지스터; 상기 제1레지스터에 결합되어상기 입력 데이타 스트림으로부터 소정 수의 비트가 상기 제1레지스터에 입력되어 저장되도록 하는 데이타 클럭 신호; 상기 제1레지스터에 접속되어, 상기 제1레지스터에 저장된 상기 소정 수의 비트 중에서 선택된 비트들을 사용하여 그 중 하나의 심볼 부호가 선택되는 복수의 심볼 부호들을 저장하는 심볼표; 상기 선택된 심볼 부호를 입력받는 위상 선택기; 위상값을 저장할 수 있으며 상기 위상 선택기에 결합되어 상기 심볼 부호의 위상이 선택되도록 하는 위상 저장 레지스터; 및 상기 위상 저장 레지스터의 출력, 및 상기 심볼 부호를 선택하기 위해 사용된 비트들과 다른, 상기 제1레지스터에 저장된 사익 소정수의 비트 중 적어도 하나의 선택된 비트에 접속되며 상기 위상 저장 레지스터의 입력에 결합된 위상 결정 회로를 포함하는 통신 장치.
  103. 제102항에 있어서, 상기 위상 결정 회로는 배타적 논리합 게이트를 포함하는 통신 장치.
  104. 제102항에 있어서, 상기 위상 선택기는 배타적 논리합 게이트를 포함하는 통신 장치.
  105. 제103항에 있어서, 상기 위상 선택기의 출력이 연속 위상 변조파형 송신기에 결합된 통신 장치.
  106. 제105항에 있어서, 상기 심볼 부호는 복수의 칩들을 포함하며, 상기 연속 위상 변조 파형 송신기는 상기 칩들을 홀수 칩 스트림 및 짝수 칩 스트림으로 분할하기 위한 수단; 상기 홀수 칩 스트림에 결합된 홀수 파형 생성기; 상기 짝수 칩 스트림에 결합된 짝수 파형 생성기; 및 상기 홀수 파형 생성기의 출력 및 상기 짝수 파형 생성기의 출력에 결합된 가산기를 포함하는 통신 장치.
  107. 입력데이타 스트림을 다중 비트 심볼들로 분할하는 단계; 상기 다중 비트 심볼들 각각의 제1부분을 심볼 부호 선택 레지스터에 저장하며 상기 다중 비트 심볼들 각각의 제2부분을 위상 선택 레지스터에 저장하는 단계; 상기 심볼 부호 선택 레지스터의 내용들에 따라 복수의 심볼 부호로부터 심볼 부호를 선택하는 단계; 상기 위상 선택 레지스터의 내용들 및 사전 심볼부호 위상에 따라 상기 심볼 부호를 위상 변조하는 단계; 및 사전 심볼 부호 위상 레지스터에 사이 심볼 부호의 위상 표시를 저장하는 단계를 포함하는 통신 방법.
  108. 신호 수신 수단; 상기 수신 신호에 결합되어 복수의 상관 신호를 출력하는 상관기; 상기 복수의 상관 신호에 결합되어 위상각 추정 신호를 출력하는 섹터 탐색표; 및 상기 위상각 추정 신호 및 사전 위상각 추정 신호에 결합된 입력들을 가지며 차(difference) 신호를 출력하는 비교기를 포함하는 차동 위상 부호화된 신호 수신 장치.
  109. 제108항에 있어서, 상기 복수의 상관 신호는 실수 상관 신호 및 허수 상관 신호를 포함하는 차동 위상 부호화된 신호 수신 장치.
  110. 제108항에 있어서, 상기 위상각 추정 신호는 상기 수신 신호의 양자회된 위상각을 나타내는 차동 위상 부호화된 신호 수신 장치.
  111. 제108항에 있어서, 상기 차 신호로부터 차동 위상 부호화된 데이타를 복원하기 위한 수단을 더 포함하는 차동 위상 부호화된 신호 수신 장치.
  112. 제111항에 있어서, 상기 차동 위상 부호화된 데이타를 복원하기 위한 사익 수단은 상기 차 신호에 결합되며 상기 차 신호에 응답하여 상기 위상 부호화된 데이타의 표시를 출력하는 탐색표를 포함하는 차동 위상 부호화된 신호 수신 장치.
  113. 제108항에 있어서, 상기 상관기는 CPM 상관기를 포함하는 차동 위상 부호화된 신호 수신 장치.
  114. 제108항에 있어서, 상기 상관기는 상기 수신 신호에 결합되어 실수 상관 신호, 허수 상관 신호, 및 단일화된 상관 신호를 각각 출력하는 복수의 상관기 중 하나이며, 상기 장치는 상기 복수 상관기 각각으로부터 상기 단일화된 상관 신호를 수신하며 상기 단일화된 상관 신호에 응답하여 선택 신호를 출력하는 베스트-오브-엠 검파기; 상기 복수의 상관기 각각으로부터 상기 실수 상관 신호를 수신하며 상기 선택 신호에 응답하여 선택된 실수 상관 신호를 출력하는 실수 상관 신호 멀티플렉서; 및 상기 복수의 상관기 각각으로부터 상기 허수 상관 신호를 수신하며 상기 선택 신호에 응답하여 선택된 허수 상관 신호를 출력하는 허수 상관 신호 멀티플렉서를 더 포함하는 차동 위상 부호화된 신호 수신 장치.
  115. 제114항에 있어서, 상기 복수의 상관 신호는 상기 선택된 실수 상관 신호 및 상기 선택된 허수 상관 신호를 포함하는 차동 위상 부호화된 신호 수신 장치.
  116. 신호를 수신하는 단계; 상기 수신 신호를 상관시켜 복수의 상관 신호를 생성하는 단계; 상기 복수의 상관 신호로부터 주소를 형성하는 단계; 섹터 탐색표에 사익 주소를 적용하여 사익 섹터 탐색표로부터 위상각 추정을 검색하는 단계; 및 상기 위상각 추정을 사전 위상각 추정과 비교하여 차 신호를 생성하는 단계를 포함하는 차동 위상 부호화된 신호 수신 방법.
  117. 연속 위상 변조 신호 수신 수단; 상기 수신 신호에 결합되며 실수 상관 신호 및 허수 상관 신호를 출력하는 비간섭성 CPM 상관기; 상기 실수 상관 신호 및 상기 허수 상관 신호에 결합되어 섹터 식별 신호를 출력하는 위상 식별기; 및 상기 섹터 식별 신호 및 사전 섹터 식별 신호에 결합되어 섹터 차 신호를 출력하는 감산기를 포함하는 차동 위상 부호화된 신호 수신 장치.
  118. 제117항에 있어서, 상기 섹터 차 신호로부터 사이 수신 신호의 상대 위상을 결정하기 위한 수단을 더 포함하는 차동 위상 부호화된 신호 수신 장치.
  119. 제118항에 있어서, 상기 상대 위상은 상기 섹터 차 신호가 소정의 값보다 작은 경우에는 제1위상으로, 상기 섹터 차 신호가 상기 소정의 값보다 큰 경우에는 제2위상으로 결정되는 차동 위상 부호화된 신호 수신 장치.
  120. 제117항에 있어서, 상기 위상 식별기는 상기 실수 상관 신호가 양인지 또는 음인지를 지시하는 제1비교 신호를 출력하는 제1비교 회로; 상기 허수 상관 신호가 양인지 또는 음인지를 지시하는 제2비교 신호를 출력하는 제2비교 회로; 상기 실수 상관 신호 및 상기 허수 상관 신호에 결합되어 절대값 비교 신호를 출력하는 제3비교 회로; 및 상기 제1비교 신호, 상기 제2비교 신호, 및 상기 절대값 비교 신호에 응답하여 상기 수신 신호의 위상각의 섹터를 결정하기 위한 수단을 포함하는 차동 위상 부호화된 신호 수신 장치.
  121. 제117항에 있어서, 상기 위상 식별기는 상기 실수 상관 신호 및 상기 허수 상관 신호로부터 주소를 형성하기 위한 수단; 및 상기 주소에 결합된 섹터 탐색표를 포함하는 차동 위상 부호화된 신호 수신 장치.
  122. 연속 위상 변조신호를 수신하는 단계; 상기 수신 신호를 상관시켜, 상기 수신 신호로부터 간섭성 클럭신호를 생성함이 없이 실수 상관 신호 및 허수 상관 신호를 생성하는 단계; 상기 실수 상관 신호 및 상기 허수 상관 신호에 응답하여 위상 섹터 식별 신호를 생성하는 단계; 및 상기 위상 섹터 식별 신호와 사전 위상 섹터 신호 간의 차를 계산하여 섹터 차 신호를 생성하는 단계를 포함하는 차동 위상 부호화된 신호 수신 방법.
  123. 신호 수신 수단; 상기 수신 수단에 결합되어 실수 상관 신호 및 허수 상관 신호를 출력하는 상관기; 상기 실수 상관 신호 및 상기 허수 상관 신호에 결합되어 섹터 신호를 출력하는 탐색표; 상기 섹터 신호에결합된 사전 섹터 레지스터; 및 상기 섹터 신호 및 상기 사전 섹터 신호를 입력받아 섹터 차 신호를 출력하는 감산기를 포함하는 확산 스펙트럼 수신기.
  124. 제123항에 있어서, 상기 실수 상과 신호 및 상기 허수 상관 신호는 상기 탐색표에 대한 주소를 공동으로 형성하는 디지탈 신호들인 확산 스펙트럼 수신기.
  125. 제124항에 있어서, 상기 실수 상관 신호 및 상기 허수 상관 신호는 상기 주소형성 전에 절단되는(truncated) 확산 스펙트럼 수신기.
  126. 제123항에 있어서, 상기 실수 상관 신호 및 상기 허수 상관 신호는 크기 및 부호(sing) 정보를 각각 포함하는 디지탈 신호들이며, 상기 탐색표는 상기크기 및 부호 정보에 대응하는 섹터 데이타를 포함하는 확산 스펙트럼 수신기.
  127. 제126항에 있어서, 상기 섹터 데이타는 상기 허수 상관 신호로 나누어진 상기 실수 상관 신호의 아크탄젠트(arctangent)를 기초로 하여 양자화된 위상각 추정을 나타내는 확산 스펙트럼 수신기.
  128. 제123항에 있어서, 상기 상관기는 비간섭성 CPM 상관기를 포함하는 확산 프펙트럼 수신기.
  129. 제123항에 있어서, 상기 상관기는 직렬 상관기를 포함하는 확산 프펙트럼 수신기.
  130. 제123항에 있어서, 상기 실수 상관 신호는 제1디지탈 계수값을 포함하며, 상기 허수 상관 신호는 제2디지탈 계수값을 포함하는 확산 프펙트럼 수신기.
  131. 제123항에 있어서, 상기 섹터 차 신호에 결합된 위상 탐색표를 더 포함하는 확산 프펙트럼 수신기.
  132. 제131항에 있어서, 상기 위상 탐색표는 사익 섹터 차 신호를 주소로서 수신하며 상기 섹터 차 신호에 응답하여 데이타 신호를 출력하는 확산 스펙트럼 수신기.
  133. 제132항에 있어서, 상기 데이타 신호는 상기 수신 신호에서 차동 위상 부호화된 정보에 대응하는 확산 스펙트럼 수신기.
  134. 확산 스펙트럼 신호 수신 단계; 상기 수신된 확산 스펙트럼 신호에 응답하여 실수 상관 신호 및 허수상관 신호를 생성하는 단계; 상기 실수 상관 신호 및 사익 허수 상관 신호에 응답하여 탐색표로부터 위상 섹터를 선택하는 단계; 및 상기 위상 섹터와 사전 위상 섹터 간의 차를 계산하는 단계를 포함하는 확산 스펙트럼 신호 복호화 방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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