KR970078567A - 바이페이즈 코드 복호 시스템 - Google Patents

바이페이즈 코드 복호 시스템 Download PDF

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KR970078567A
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겐지 히다까
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가네꼬 히사시
닛뽕덴끼 가부시끼가이샤
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    • H04N5/76—Television signal recording
    • H04N5/91—Television signal processing therefor
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    • H—ELECTRICITY
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    • H03K9/06—Demodulating pulses which have been modulated with a continuously-variable signal of frequency- or rate-modulated pulses
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    • G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
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    • G11B20/1403—Digital recording or reproducing using self-clocking codes characterised by the use of two levels
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    • G11B20/1419—Digital recording or reproducing using self-clocking codes characterised by the use of two levels code representation depending on a single bit, i.e. where a one is always represented by a first code symbol while a zero is always represented by a second code symbol to or from biphase level coding, i.e. to or from codes where a one is coded as a transition from a high to a low level during the middle of a bit cell and a zero is encoded as a transition from a low to a high level during the middle of a bit cell or vice versa, e.g. split phase code, Manchester code conversion to or from biphase space or mark coding, i.e. to or from codes where there is a transition at the beginning of every bit cell and a one has no second transition and a zero has a second transition one half of a bit period later or vice versa, e.g. double frequency code, FM code

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Abstract

수평 구간 카운터(3)는 복호될 바이페이즈 코드를 포함하는 직전의 수평 주사선의 구간을 계측하므로써 1비트 구간을 결정한다. 에지 펄스 발생기(6)는 입력된 바이페이즈 코드의 상승 구간 및 하강 구간에 에지 펄스를 발생한다. 보상 펄스 발생기(7)는 에지 펄스에 의해 트리거되고 바이페이즈 코드의 1비트 구간보다 짧고 그 1비트 구간의 2분의 1보다 긴 소정 구간에 보상 펄스를 발생한다. 상승 판정 회로(11)는 에지 펄스에 보상 펄스를 중첩하므로써 샘플링 펄스를 발생한다. 바이페이즈 코드는 샘플링 펄스에 의해 복호된다.

Description

바이페이즈 코드 복호 시스템
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 실시예를 나타내는 블록도, 제2도는 제1도의 실시예를 설명하는 파형도, 제3도는 관련된 형태의 바이페이즈 코드 복호 시스템을 나타내느 도면, 제4도는 바이페이즈 코드 데이터의 상승 구간 및 하강 구간을 판정하는 파형을 나타내는 도면.

Claims (5)

  1. 영상 신호에 포함된 바이페이즈 코드를 복호하는 바이페이즈 코드 복호 시스템에 있어서, 하나의 입력 수평 주사선의 1구간을 계측하므로써 입력 바이페이즈의 1비트 구간을 결정하고, 입력 바이페이즈 코드의 상승 및 하강 에지에 에지 펄스를 발생하고, 1비트 구간보다는 짧고 그 1비트 구간의 2분의 1보다는 긴 소정의 구간의 결정된 비트 구간에 기초하여 에지 펄스에 의해 트리거된 보상 펄스를 발생하고, 에지 펄스상에 보상 펄스를 중첩하여 샘플링 펄스를 발생하고, 발생된 샘플링 펄스에 기초하여 영상 신호로부터 바이페이즈 코드를 복호하는 것을 특징으로 하는 바이페이즈 복호 시스템.
  2. 제1항에 있어서, 계측될 수평 주사선의 1비트구간은, 복호될 바이페이즈 코드를 포함하는 직전의 수평 주사선인 것을 특징으로 하는 바이페이즈 코드 복호 시스템.
  3. 영상 신호에 포함된 바이페이즈 코드를 복호하는 바이페이즈 코드 복호 시스템에 있어서, 입력된 바이페이즈 코드와 동기된 수평 동기 신호의 1수평 주사 구간에 충분히 짧은 펄스 간격에서 복수의 클록 펄스를 포함하는 구동 클록 신호를 발행하는 클록 발생기, 구동 클럭 신호에 의한 수평 동기 신호의 1구간을 카운팅하는 수평 구간 카운터, 입력된 바이페이즈 코드의 상승 및 하강 에지에 에지 펄스를 발생하는 에지 펄스 발생기, 수평 구간 카운터의 카운터 출력에 기초하여, 바이페이즈의 1비트 구간보다 짧고 그1비트 구간의 2분의 1보다 긴 소정의 구간에 보상 펄스를 발생하기 위하여, 에지 발생기로부터 발생된 에지 펄스에 의해 트리거된 보상 펄스 발생기, 및 보상 펄스 발생기의 보상 펄스 출력을 에지 펄스 발생기의 에지 펄스 출력에 중첩하고 중첩된 결과를 2분주하여 얻어진 파형의 상승에서 샘플링 펄스를 발생하는 상승 판정 회로를 구비하고, 상승 판정 회로의 샘플링 신호 출력에 의해 영상 신호로부터 바이페이즈 코드를 복호하는 것을 특징으로 하는 바이페이즈 코드 복호 시스템.
  4. 제3항에 있어서, 수평 동기 신호 및 수직 동기 신호를 입력하여 수평 주사 선을 카운팅하여, 바이페이즈 코드를 복호하는 직전의 수평 주사선을 나타내는 데이터를 출력하는 수평 주사선 카운터를 더 구비하고, 상기 수평 구간 카운터 및 에지 펄스 발생기를 그 수평 주사선 카운터의 출력을 수신하여 동작을 개시하는 것을 특징으로 하는 바이페이즈 코드 복호 시스템.
  5. 제3항에 있어서, 상기 수평 구간 카운터의 카운트와, 본래의 수평 주사선의 주기와 본래의 바이페이즈 코드의 1비트의 주기와의 비율 데이타를 승산하여, 바이페이즈 코드의 1비트 구간보다 짧고 1비트 구간의 2분의 1보다 긴 구동 클록 간격을 발생하여 출력하는 승산기를 더 구비하고, 에지 펄스 발생기로부터 에지 펄스를 수신할 때 수평 구간 카운터를 구동하여 카운트를 수신하고 상기 승산기의 구동 클록 간격에 도달하면 보상 펄스를 발생하는 것을 특징으로 하는 바이페이즈 코드 복호 시스템.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019970019495A 1996-05-20 1997-05-20 바이페이즈코드복호방법및시스템 KR100254835B1 (ko)

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JP8124288A JP2862076B2 (ja) 1996-05-20 1996-05-20 バイフェーズコード復号方式
JP96-124288 1996-05-20

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KR970078567A true KR970078567A (ko) 1997-12-12
KR100254835B1 KR100254835B1 (ko) 2000-05-01

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KR1019970019495A KR100254835B1 (ko) 1996-05-20 1997-05-20 바이페이즈코드복호방법및시스템

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JP2862076B2 (ja) 1999-02-24

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