KR970055223A - 프리런닝 루프회로 - Google Patents

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KR970055223A
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변대열
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김광호
삼성전자 주식회사
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    • H03ELECTRONIC CIRCUITRY
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    • H03K5/00Manipulating of pulses not covered by one of the other main groups of this subclass
    • H03K5/156Arrangements in which a continuous pulse train is transformed into a train having a desired pattern
    • H03K5/1565Arrangements in which a continuous pulse train is transformed into a train having a desired pattern the output pulses having a constant duty cycle
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
    • H03K3/00Circuits for generating electric pulses; Monostable, bistable or multistable circuits
    • H03K3/01Details
    • H03K3/011Modifications of generator to compensate for variations in physical values, e.g. voltage, temperature
    • HELECTRICITY
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    • H03K5/13Arrangements having a single output and transforming input signals into pulses delivered at desired time intervals
    • H03K5/135Arrangements having a single output and transforming input signals into pulses delivered at desired time intervals by the use of time reference signals, e.g. clock signals

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  • Physics & Mathematics (AREA)
  • Nonlinear Science (AREA)
  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)

Abstract

프리런닝 루프를 이용한 발진회로에서 온도나 주변상황에 따라 소자 딜레이가 변화하여도 안정적으로 클럭을 발생하기 위해 프리런닝 탭 0-n 타이밍신호를 발생하여 탭 0의 신호를 카운트하여 루프갯수를 계산하여 래치하고, 이와 현재 루프갯수를 감산하여 전체프리런닝루핑속도를 결정하며, 이를 이용하여 정규화된 수정된 출력값을 발생하고, 이에 의해 출력 루프갯수와 상기 수정된 데이타값과 비교하여 수정된 데이타의 위치를 비교기를 통하여 출력하도록 구성되어 있다.

Description

프리런닝 루프회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 블럭도.

Claims (2)

  1. 프리런닝 루프회로에 있어서, 프리런닝 탭0-n 타이밍신호를 발생하는 프리런닝 루프회로(101)와, 상기 프리런닝 루프회로(101)의 탭0의 신호를 카운트하여 루프갯수를 계산하는 루프갯수카운터(102)와, 상기 루프갯수카운터(102)에서 카운트된 루프갯수를 래치하는 래치(103)와, 상기 래치(103)에서 래치된 루프갯수에서 상기 루프카운터(102)의 출력 현재 루프갯수를 감산하여 전체프리런닝루핑속도를 결정하는 뺄셈기(104)와, 상기 뺄셈기(104)의 전체 프리 런닝루프의 루핑속도결정출력과 입력 데이타단(113)의 출력을 곱하여 정규화된 수정된 출력값을 발생하는 곱셈기(105)와, 상기 프리런닝 루프회로(101)의 출력탭0-n값 및 상기 루프카운터(102)의 출력 루프갯수와 상기 곱셈기(105)의 수정된 데이타값과 비교하여 수정된 데이타의 위치를 출력하는 비교기(106)로 구성됨을 특징으로 하는 프리런닝 루프회로.
  2. 제1항에 있어서, 프리런닝 루프회로(101)가 리세트단(203)의 리세트신호와 딜레이라인 인버터들(201)의 출력을 앤드게이트(202)에서 논리곱하고, 각 인버터(201)의 출력을 통해 탭0-탭n신호를 발생토록 구성됨을 특징으로 하는 프리런닝 루프회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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