KR970024161A - 자유 컬렉터단자를 구비한 바이폴라 트랜지스터 회로 - Google Patents

자유 컬렉터단자를 구비한 바이폴라 트랜지스터 회로 Download PDF

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Abstract

본 발명은 씨모스(CMOS : Complementary Metal - Oxide - Semiconductor) 공정에 의해 제조되는 칩(chip) 상에 구현되는 자유 컬렉터(free collector)단자를 구비한 바이폴라 트랜지스터(Bipolar transistor)회로에 관한 것으로서, 각각의 베이스단자가 서로 연결되고, 각각의 켈렉터단자에 제1전원전압이 인가되도록 연결된 제 1 및 제2바이폴라 트랜지스터와; 상기 제1 및 제2바이폴라 트랜지스터의 에미터단자 전압을 입력전압으로 받아들여, 두 입력전압간의 오차를 검출하고 이를 증폭하여 출력하는 트랜스 콘덕터와; 상기 트랜스 콘덕터에서 검출된 두 입력전압간의 오차전압을 자체 출력저항에 의해 전압으로 변환되어 게이트 입력으로 받아들이도록 연결되고 드레인은 상기 제2바이폴라 트랜지스터의 에미터와 연결되도록 하여, 게이트 전압에 대응하는 드레인 전류를 생성하는 제1모스 트랜지스터와; 상기 제1모스 트랜지스터에 대해 미러관계를 가지도록 연결되어, 제1모스 트랜지스터의 드레인 전류에 비례하는 크기의 드레인 전류를 생성하는 제2모스 트랜지스터로 구성되어, 부가적인 회로의 큰 부담이 없으며, 자유 컬렉터단자를 구비하도록 한 종래의 수평형 바이폴라 트랜지스터 회로에서 기생적으로 나타나는 수직형 바이폴라 트랜지스터의 문제점을 해결할 수 있다.

Description

자유 컬렉터단자를 구비한 바이폴라 트랜지스터 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 이발명의 실시예에 따른 자유 컬렉터단자를 구비한 바이폴라 트랜지스터 회로의 상세 회로도이고,
제3도는 상기 제1도에 도시된 회로의 트랜스 콘덕터의 상세 회로도.

Claims (9)

  1. 각각의 베이스단자가 서로 연결되고, 각각의 컬렉터단자에 제1전원전압이 인가되도록 연결된 제1 및 제2바이폴라 트랜지스터와; 상기 제1 및 제2바이폴라 트랜지스터의 에미터단자 전압을 입력전압으로 받아들여, 두 입력전압간의 오차를 검출하고 이를 증폭하여 출력하는 트랜스 콘덕터와; 상기 트랜스 콘덕터에서 검출된 두 입력전압간의 오차전압을 게이트 입력으로 받아들이도록 연결되고 드레인은 상기 제2바이폴라 트랜지스터의 에미터와 연결되도록 하여, 게이트 전압에 대응하는 드레인 전류를 생성하는 제1모스 트랜지스터와; 상기 제1모스 트랜지스터에 대해 미러관계를 가지도록 연결되어, 제1모스 트랜지스터의 드레인 전류에 비례하는 크기의 드레인 전류를 생성하는 제2모스 트랜지스터를 포함하여 이루어지는 것을 특징으로 하는 자유 컬렉터단자를 구비한 바이폴라 트랜지스터 회로.
  2. 제1항에 있어서, 상기한 제1 및 제2바이폴라 트랜지스터의 공통 베이스단자는 전체 트랜지스터 회로의 베이스단자가 되고, 제1바이폴라 트랜지스터의 에미터단자는 전체트랜지스터 회로의 에미터단자가 되며, 제2모스 트랜지스터의 드레인단자는 전체 트랜지스터 회로의 컬렉터단자가 되도록 형성됨을 특징으로 하는 자유 컬렉터단자를 구비한 바이폴라 트랜지스터 회로.
  3. 제1항에 있어서, 상기한 트랜스 콘덕터, 제1 모스 트랜지스터 및 제2바이폴라 트랜지스터가 네가티브 피드백 루프를 평성하며, 상기 네가티브 피드백 루프의 이득이 충부히 증가하면 트랜스 콘덕터의 두 입력전압간의 오차가 감소되도록 동작함을 특징으로 하는 자유 컬렉터단자를 구비한 바이폴라 트랜지스터 회로.
  4. 제3항에 있어서, 상기 제1 및 제2바이폴라 트랜지스터의 바이어스 전류, 상기 트랜스 콘턱터의 이득 및 상기 제1모스 트랜지스터의 채널폭/채널길이의 비를 조절함으로써 상기 피드백 루프의 이득을 증가시키는 것을 특징으로 하는 자유 켈렉터단자를 구비한 바이폴라 트랜지스터 회로.
  5. 제1항에 있어서, 제1 모스 트랜지스터와 제2모스 트랜지스터에 출력 임피던스를 증가시키기 위해 모스 트랜지스터를 추가하여 캐스캐이드 형태로 연결되는 것을 특징으로 하는 자유 컬렉터단자를 구비한 바이폴라 트랜지스터 회로.
  6. 제1항에 있어서, 상기한 제1 및 제2모스 트랜지스터는 엔모스 트랜지스터이고, 상기한 제1 및 제2바이폴라 트랜지스터는 npn형 트랜지스터로 구성하는 것을 특징으로 하는 자유 컬렉터단자를 구비한 바이폴라 트랜지스터 회로.
  7. 제1항에 있어서, 상기한 트랜스 콘덕터는 공통 소스단자에 인가된 전류로부터 각 게이트단자에 인가되는 입력전압에 대응하는 소정의 드레인단자 전류를 생성하는 한 쌍의 피모스 트랜지스터와; 서로 미러구조를 가지도록 연결되어 상기 한 쌍의 피모스 트랜지스터 각각의 드레인단자 전류간의 차이값을 생성하여 출력전류로서 외부에 제공하는 한 쌍의 엔모스 트랜지스터를 포함하는 것을 특징으로 하는 자유 켈렉터단자를 구비한 바이폴라 트랜지스터 회로.
  8. 제7항에 있어서, 상기한 트랜스 콘덕터는 상기 출력전류를 외부에 제공하고 자체 출력저항에 의해 전압치로써 변환되도록 함을 특징으로 하는 자유 컬렉터 단자를 구비한 바이폴라 트랜지스터 회로.
  9. 제7항에 있어서, 상기한 트랜스 콘덕터는 상기 출력전류를 전압치로 변환하기 위하여, 상기 한 쌍의 엔모스 트랜지스터의 후단에 전류/전압 변화회로를 부가하여 포함하는 것을 특징으로 하는 자유 켈렉터 단자를 구비한 바이폴라 트랜지스터 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019950036001A 1995-10-18 1995-10-18 자유 컬렉터단자를 구비한 바이폴라 트랜지스터 회로 KR0158625B1 (ko)

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