KR950002288A - 가변길이 디코더장치 - Google Patents

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Abstract

본 발명은 가변길이 디코더장치에 관한 것으로, 종래의 디코더에서 디코더부는 그대로 두고, 입력 ＆ 시프터부를 로드/시프트기능을 갖는 제1, 2레지스터 및 로드기능을 갖는 제3레지스터로 구성하였다.
또한, 가산부를 타이밍 ＆ 제어부로 교체하여 제1, 2레지스터에서 로드기능과 시프트기능을 수행하도록 하고 제3레지스터에서 로드기능을 수행하는 동시에 타이밍 ＆ 제어부에서 길이 디코더의 코드길이는 계속 더하면서 그 값이 16보다 큰가, 작은가에 따라 로드/시프트를 변경하여 신호를 제1, 2레지스터에 출력하도록 회로를 구성하였다.
이와 같이 구성되는 디코더회로는 종래의 회로에 비해 구성이 간단하여 집적회로(IC)가 가능하다.

Description

가변길이 디코더장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 종래의 가변길이 디코더 회로 블럭도, 제2도는 바렐 시프터의 동작을 나타낸 개략도, 제3도는 본 발명의 가변길이 디코더 회로 블럭도, 제4도는 시프트/로드의 생성을 설명하기 위한 파형도.

Claims (3)

  1. 입력데이타를 로드 및 시프트하고, 시스템 클럭신호에 따라 래취하는 입력 ＆ 시프터부(14)와, 상기 일벽 ＆ 시프터부(14)의 출력데이타를 디코딩하고 누적하는 코드디코더(15), 길이디코더(16)로 된 디코더부(17)와, 상기 길이디코더(16)의 출력 및 시스템 클럭신호를 받아 누적하여 제1, 2레지스터(11, 12)의 로드 및 시프트신호를 출력하는 제어부(19)를 포함하여 구성됨을 특징으로 하는 가변길이 디코더장치.
  2. 제1항에 있어서, 입력 ＆ 시프터부(14)는 로드/시프트기능을 가진 제1, 2레지스터(11, 12), 로드기능을 가진 제3레지스터(13)로 이루어짐을 특징으로 하는 가변길이 디코더장치.
  3. 제1항에 있어서, 제어부(19)는 타이밍 ＆ 제어부(18)로 이루어짐을 특징으로 하는 가변길이 디코더장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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