KR930008585A - 스핀들싱크 제어시스템 - Google Patents
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Abstract
호스트 컴퓨터에 병렬로 접속된 복수의 자기디스크장치등의 스핀들 싱크제어 시스템에 관한 것이며 시이크에러등이 발생되어도 타임로스를 저감하여 시스템다운의 발생을 방지하는 것을 목적으로 하고 매체인덱스, 홀인덱스 및 기준인덱스의 유무를 판별하는 판별수단(25A)과 스핀들 싱크의 기동전에 매체 인덱스와 홀인덱스와의 오프셋치를 연산하는 오프셋치 연산수단(25B)과 연산된 오프셋치를 기억하는 기억수단(26)과, 오프셋치를 참조하여 기준인덱스와 매체인덱스와의 위상차를 연산하는 위상차 연산수단(25C)과 연산된 위상차에 의해서 스핀들 모터의 구동제어치를 결정하는 결정수단(25D)를 구비하도록 구성한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 원리에 준한 실시예를 나타낸 도면,
제4도는 본 발명의 구체적인 일실시예를 나타낸 도면,
제10도는 디스크 어레이 장치의 전체를 나타낸 사시도.
Claims (7)
- 호스트 컴퓨터(1)에 병렬로 접속된 복수의 기억장치에 있어서의 각각의 기록매체를 보지하는 스핀들 모터를 동기 회전시켜서 스핀들싱크제어를 행하기 위한 스핀들싱크제어 시스템이고, 기준신호인 기준인덱스가 송출되고 또한 상기 기록매체에 기록된 인덱스를 재생함으로써 매체인덱스가 생성되고 그리고 상기 스핀들모터(7)의 상절환 타이밍을 검출하기 위한 홀인덱스가 상기 스핀들모터(7)에서 출력되고 있고 상기 스핀들싱크제어를 개시하기 전에 상기 매체인덱스와 상기 홀인덱스로 오프셋치를 사전에 연산하여 기억하는 수단과, 상기 기억된 오프셋치를 참조하여 상기 기준인덱스와 상기 매체인덱스위 위상차를 의사적으로 연산하는 수단을 구비하고, 상기 연산된 위상차에 의해서 결정된 제어치에 준하여 상기 스핀들싱크제어를 행하는 것을 특징으로 하는 스핀들싱크제어 시스템.
- 제1항에 있어서, 상기 기준인덱스의 발생 시각에 상당하는 카운트치를 격납하는 기준인덱스 격납수단(21)과 상기 홀인덱스의 발생시각에 상당하는 카운트치를 격납하는 홀인덱스 격납수단(22)과, 상기 매체인덱스의 발생시각에 상당하는 카운트치를 격납하는 매체인덱스 격납수단(33)을 더 구비한 스핀들싱크제어 시스템.
- 제1항에 있어서, 상기 기억장치가 복수의 자기디스크장치(4)로 구성되고 상기 기록 매체가 복수매의 디스크(5)로 구성된 스핀들싱크제어 시스템.
- 호스트 컴퓨터(1)에 병렬로 접속된 복수의 기억장치에 있어서의 각각의 기록매체를 보지하는 스핀들모터를 동기회전 시켜서 스핀들싱크제어를 행하기 위한 스핀들싱크제어 시스템이고, 기준신호인 기준인덱스가 송출되고또한 상기 기록매체에 기록된 인덱스를 재생함으로써 매체인덱스가 생성되고 그리고 상기 스핀들모터(7)의 상절환 타이밍을 검출하기 위한 홀인덱스가 상기 스핀들모터(7)에서 출력되고 있고, 상기 기준인덱스의 발생시각에 상당하는 카운트치를 격납하는 기준인덱스 격납수단(21)과, 상기 홀인덱스의 발생시각에 상당하는 카운트치를 격납하는 홀인덱스 격납수단(22)과, 상기 매체인덱스의 발생시각에 상당하는 카운트치를 격납하는 매체인덱스 격납수단(23)과, 상기 기준인덱스, 매체인덱스 및 홀인덱스의 유무를 판별하는 판별수단(25A)과, 상기 스핀들싱크제어를 개시하기 전에 상기 매체인덱스와 상기 홀인덱스와의 오프셋치를 연산하는 오프셋 연산수단(25B)과, 상기 연산된 오프셋치를 기억하는 기억수단(26)과, 상기 기억된 오프셋치를 참조하여 상기 기준인덱스와 상기 매체인덱스의 위상차를 연산하는 위상차 연산수단(25C)과, 상기 연산된 위상차에 의해서 상기 스핀들모터(7)를 회전구동하기 위한 구동제어치를 결정하는 결정수단(25D)을 구비하고 상기 결정된 구동제어치에 준하여 상기 스핀들싱크제어를 행하는 것을 특징으로 하는 스핀들싱크제어 시스템.
- 제4항에 있어서, 상기 기억장치가 복수의 자기디스크장치(4)로 구성되고 상기 기록 매체가 복수매의 디스크(5)로 구성된 스핀들싱크제어 시스템.
- 제4항에 있어서, 상기 판별수단(25A), 상기 오프셋 연산수단(25B), 상기 기억수단(26), 상기 위상차 연산수단(25C) 및 상기 결정수단(25D)이 상기 호스트 컴퓨터(1)로 부터의 제어신호에 준하여 상기 기억장치를 제어하는 프로세서(25)에 의해서 실현되는 스핀들싱크제어 시스템.
- 제6항에 있어서, 상기 기억수단(26)이 상기 프로세서(25)에 접속되는 동시에 상기 프로세서(25)에서 연산된 오프셋치가 기억되는 RAM으로 구성된 스핀들싱키제어 시스템.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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