KR920020322A - 명령처리장치 - Google Patents

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KR920020322A
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유리코 규우마
야스오 야마다
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아오이 죠이치
가부시키가이샤 도시바
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    • G06F12/06—Addressing a physical block of locations, e.g. base addressing, module addressing, memory dedication
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
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Abstract

내용 없음

Description

명령처리장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 발명 원리도,
제2도(a)는 본 발명의 명령처리장치를 실현할 수 있는 CPU의 구성도,
제2도(b)는 본 발명의 명령처리장치를 실현할 수 있는 범용레지스터의 구성도,
제3도(a) 내지 제3도(c)는 본 발명의 제2실시예에 따른 명령처리장치의 실효어드레스 생성예를 나타낸 도면.

Claims (5)

  1. 메모리(5)의 전체 어드레스공간중 임의의 어드레스를 지정하는데 충분한 비트폭을 갖춘 적어도 1개의 제1레지스터(R1n)와, 전체 어드레스공간중 임의의 어드레스를 지정하는데 불충분한 비트폭을 갖춘 적어도 1개의 제2레지스터(R2m)를 갖추고서, 명령어에 의해 지정된 상기 1개 또는 결합된 복수개의 제1레지스터(R1n) 또는 제2레지스터(R2m)내에 보존되어 있는 값을 기초로 하여 오퍼랜드 어드레스를 생성하는 명령처리장치에 있어서, 상기 1개 또는 복수개의 제1레지스터(R1n)의 전체 비트에 의한 값 또슨 필요한 비트폭을 잘라 내어 얻은 값으로부터 소망하는 오퍼랜드 어드레스를 생성하는 제1어드레스생성수단(1)과, 상기 1개 또는 복수개의 제2레지스터(R2m)의 일부 비트의 값에 따라 어드레스지정에 부족한 비트를 생성하여 전체 어드레스공간중 소정의 부분공간에 대한 오퍼랜드 어드레스를 생성하는 제2어드레스생성수단(3)을 구비하고서, 명령어중의 정보에 의해 상기 제1어드레스생성수단(1) 또는 제2어드레스생성수단(3)중 어느 하나를 지정하도록 된 것을 특징으로 하는 명령 처리장치.
  2. 메모리(5) 전체 어드레스공간중 임의의 어드레스를 지정하는데 충분한 비트폭을 갖춘 적어도 1개의 제1레지스터(R1n)와, 전체 어드레스 공간중 임의의 어드레스를 지정하는데 불충분한 비트폭을 갖춘 적어도 1개의 제2레지스터(R2m)를 갖추고서, 명령어에 의해 지정된 상기 1개 또는 결하된 복수개의 제1레지스터(R1n) 또는 제1레지스터(R2m)내에 보존되어 있는 값을 기초로 하여 오퍼랜드 어드레스를 생성하거나 또는 명령어에 의해 지정된 상기 1개 또는 결합된 복수개의 제1 비스터(R1n) 또는 제2;레지스터(R2m)내애 보존되어 있는 값을 기초로 상기 메모리(5)를 억세스하여 상기 메모리(5)로부터 독출한 값을 기초로 간접적으로 오퍼랜드 어드레스를 생성하는 명령처리장치에 있어서, 상기 1개 또는 복수개의 제1레지스터(R1n)의 전체 비트에 의한 값 또는 상기 메모리(5)로부터 독출한 값 또는 이들 2개의 값에서 필요한 비트폭을 잘라 내어 얻은 값으로부터 소망하는 오퍼랜드 어드레스를 생성하는 제1어드레스생성수단(1)과, 상기 1개 또는 복수개의 제2레지스터(R2m) 또는 상기 메모리(5)로부터 독출한 데이터의 일부 비트의 값에 따라 어드레스 지정에 부족한 비트를 생성하여 전체 어드레스공간중 소정의 부분공간에 대한 오퍼랜드 어드레스를 생성하는 제2어드레스생성수단(3)을 구비하고서, 명령어중의 정보에 의해 상기 제1어드레스생성수단(1) 또는 제2어드레스생성수단(3)중 어느 하나를 지정하도록 된 것을 특징으로 하는 명령처리장치.
  3. 제2항에 있어서, 상기 명령어에 의해 지정된 상기 1개 또는 결합된 복수개의 제1레지스터(R1n) 또는 제2레지스터(R2m)내에 보존되어 있는 값을 기초로 상기 메모리(5)를 억세스하여 상기 메모리(5)로부터 독출한 값을 기초로 간접적으로 오퍼랜드 어드레스를 생성하는 기능을 복수회 적용할 수 있도록 된 것을 특징으로 하는 명령처리장치.
  4. 제1항에 있어서, 상기 제2어드레스생성수단(3)은 상기 1개 또는 복수개의 제2레지스터(R2m) 또는 메모리(5)로부터 독출한 데이터의 최상위 비트를 확장시켜 어드레스지정에 부족한 비트를 생성하여 전체 어드레스 공간중 소정의 부분공간에 대한 오퍼랜드 어드레스를 생성하는 것을 특징으로 하는 명령처리장치.
  5. 제1항에 있어서, 상기 제2어드레스생성수단(3)은 상기 1개 또는 복수개의 제2레지스터(R2m) 또는 메모리(5)로부터 독출한 데이터의 일부인 q비트의 값에 의해 지정되는 미리 준비된 변환표의 값을 기초로 어드레스지정에 부족한 비트를 생성하여 전체 어드레스 공간중 소정의 부분공간에 대한 오퍼랜드 어드레스를 생성하는 것을 특징으로 하는 명령처리장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019920006348A 1991-04-25 1992-04-16 명령처리장치 KR960008318B1 (ko)

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JP09584391A JP3181307B2 (ja) 1991-04-25 1991-04-25 命令処理装置
JP91-095843 1991-04-25

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