KR920008587A - 트랜스콘덕터-캐패시터 적분기 - Google Patents
트랜스콘덕터-캐패시터 적분기 Download PDFInfo
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본발명에 따른 트랜스콘덕터-캐패시터의 기본도,
제4도는 본 발명에 따른 트랜스콘덕터-캐패시터 적분기의 회로도,
제9도는 본 발명에 따른 두 트랜스콘덕터-캐패시터 적분기를 구비한 4차 필터 섹션도.
Claims (12)
- 입력신호의 적분에 비례하는 최소한 하나의 출력신호를 발생시키는 트랜스콘덕터-캐패시터 적분기로서, 입력 신호를 수신하는 입력단자, 출력신호를 공급하는 출력단자, 캐패시터와, 여기에 결합되어, 입력 및 출력을 가진 트랜스콘덕터를 구비한 트랜스콘덕터-캐패시터 적분기에 있어서, 입력신호 및 출력신호는 제각기 입력 전류 및 출력전류이며 트랜스콘덕터는 캐패시터 및 출력단자에 제각기 결합된 입력 및 출력을 가져, 캐패시터 양단의 전압을 출력전류로 변환시키며, 적분기는, 출력전류에 비례하는 피드백 전류의 캐패시터 양단의 전압에 대해 도함수에 비례하는 미분 전류를 발생시키는 미분기와, 입력단자 및 미분전류에서 입력 전류의 계수에 비례하는 계수전류를 캐패시터에 공급하는 전류 분할기를 구비하는 것을 특징으로 하는 트랜스콘덕터-캐패시터 적분기.
- 제1항에 있어서 미분기는 피드백 전류 및 미분 전류사이의 직류 경로이고, 트랜스콘덕터의 전압-전류 변환은 지수관계를 가지며, 출력전류는 캐패시터 양단의 전압의 지수에 비례하는 것을 특징으로 하는 트랜스콘덕터-캐패시터 적분기.
- 제2항에 있어서 트랜스콘덕터는 제1및 제2주전극과 제어전극, 출력단자에 결합된 제2주전극과, 캐패시터와 병렬로 장치된 제어전극 및 제1주전극에 의해 형성된 접합부를 가진 제1출력 트랜지스터를 구비하는 것을 특징으로 하는 트랜스콘덕터-캐패시터 적분기.
- 제3항에 있어서 트랜스콘덕터는 제1및 제2주전극과 제어전극을 가진 제2출력 트랜지스터를 구비하며, 상기트랜지스터의 제1주전극 및 제어전극을 제1출력 트랜지스터의 대응전극에 접속되며, 제2주전극은 피드백 전류에 대한 출력인것을 특징으로 하는 트랜스콘덕터-캐패시터 적분기.
- 제4항에 있어서, 전류분할기는, 제1및 제2주전극과 제어전극을 가지며 제1트 랜지스터의 제어전극은 제2트랜지스터의 제1주전극에 접속되고, 제2및 제3트랜지스터의 제어전극은 노드에서 상호 접속되며, 제3트랜지스터의 제1주전극은 제4트랜지스터의 제어전극에 접속되며, 제1트랜지스터의 제어전극은 입력단자에 결합되며, 제1트랜지스터의 제2주전극은 노드에 결합되며, 제1및 4트랜지스터의 제1주전극은 제1전원 공급단자에 접속되며, 그리고 제2및 제3트랜지스터의 제2주전극은 제2전원 공급단자에 결합되는 각각의 제1내지 4트랜지스터, 노드에 결합된 바이어스 전류원과 제4트랜지스터의 제2주전극과 제1출력 트랜지스터의 제어전극에 결합된 제1및 제2전류단자를 가진 전류 미러를 구비하며, 제1및 2출력 트랜지스터의 제1주전극은 제1전원 공급단자에 접속되는 것을 특징으로 하는 트랜스콘덕터-캐패시터 적분기.
- 제3항에 있어서, 전류분할기는, 제1및 제2주전극과 제어전극을 가지며, 제1트랜지스터의 제어전극은 제2트랜지스터의 제1주전극에 접속되고, 제2및 제3트랜지스터의 제어전극은 노드에서 상호 접속되며, 제3트랜지스터의 제1주전극은 제1출력트랜지스터의 제어전극에 접속되며, 제1트랜지스터의 제어전극은 입력단자에 결합되며, 제1트랜지스터의 제2주전극은 노드에 결합되며, 제1트랜지스터의 제1주전극은 제1전원 공급단자에 접속되며, 그리고 제2및 제3트랜지스터의 제2주전극은 제2전원 공급 단자에 결합되는 각각의 제1내지 3트랜지스터와, 노드에 결합된 바이어스 전류원을 구비하며, 제1출력 트랜지스터의 제1주전극은 제1전원 공급단자에 접속되는 것을 특징으로 하는 트랜스콘덕터-캐패시터 적분기.
- 제6항에 있어서, 적분기는 제1및 제2주전극과 제어 전극을 가진 각각의 제1및 2다른 트랜지스터를 구비하며, 제1다른 트랜지스터 및 제2다른 트랜지스터의 제어 전극 및 제1주전극은 제각기 제1트랜지스터 및 제1출력트랜지스터의 대응 전극에 접속되며, 제1다른 트랜지스터 및 제2다른 트랜지스터의 제2주전극은 제각기 제1출력 트랜지스터 및 제1트랜지스터의 제어전극에 결합되는 것을 특징으로 하는 트랜스콘덕터-캐패시터 적분기.
- 제6항에 있어서, 적분기는, 다른 입력 전류를 수신하는 다른 입력단자 및, 다른 출력 전류를 공급하는 다른 출력단자, 캐패시터가 상기 캐패시터의 것과 거의 같은 다른 캐패시터, 최초 기술된 바이어스 전류원의 전류와 거의 같은 전류를 공급하는 다른 바이어스 전류원, 제1및 2주전극과 제어 전극을 가지며, 제 4,5 및 6트랜지스터와 제2출력 트랜지스터의 전극은 서로 접속되고, 제각기 제1,2 및 3트 랜지스터와 제1출력 트랜지스터의 대응 전극과 유사한 방식으로 다른 입력단자, 다른 출력단자, 다른 캐패시터, 다른 바이어스 전류원, 제1전원 공급단자 및 제2전원 공급단자에 접속되는 각각의 제4내지 6캐패시터, 제1출력 트랜지스터의 대응 전극에 접속되는 제1주전극 및 제어전극과, 하나는 제2출력 트랜지스터의 제어 전극에 결합되고, 다른 하나는 최초 기술된 출력 전류에 비례하는 전류를 공급하는 각 다른 출력단자에 결합되는 제2주전극을 가진 각각의 최소한 하나의 다른 출력 트랜지스터의 제1그룹과, 제2출력 트랜지스터의 대응 전극에 접속되는 제1주전극 및 제어전극과, 하나는 제1출력 트랜지스터의 제어전극에 결합되고, 다른 하나는 다른 출력 전류에 비례하는 전류를 공급하는 각 다른 출력단자에 결합되는 제2주전극을 가진 각각의 최소한 하나의 다른 출력 트랜지스터의 제2그룹을 구비하는 것을 특징으로 하는 트랜스콘덕터-캐패시터 적분기.
- 제3,4,5,6,7 또는 8항에 있어서, 적분기는 바이폴라 트랜지스터로구성되며, 제어전극, 제1주전극 및 제2주전극은 제각기 베이스, 에미터 및 콜렉터에 대응하는 것을 특징으로 하는 트랜스콘덕터-캐패시터 적분기.
- 제3,4,5,6,7 또는 8항에 있어서, 적분기는 약한 반전 모드로 동작하는 유니폴라 MOS트랜지스터로 구성되며, 제어전극, 제1주전극 및 제2주전극은 제각기 게이트, 소스 및 드레인에 대응하는 것을 특징으로 하는 트랜스콘덕터-캐패시터 적분기.
- 제5,6,7,8,9 또는 10항에 있어서, 상기 바이어스 전류원은 크기가 제어가능한 전류를 공급하는 것을 특징으로 하는 트랜스콘덕터-캐패시터 적분기.
- 제8,9,10 또는 11항에서 청구된 바와같은 제1및 2적분기, 두 상보 필터 입력 단자와 두 상보 필터 출력단자를 구비한 필터 장치로서, 각 적분기는 상기 입력단자및 다른 입력단자에 제각기 대응하는 비반전 및 상보반전 입력을 가지며, 제1그룹의 두 다른 출력 트랜지스터의 제2주전극에 결합된 상기 출력단자 및 두 다른 출력 단자에 제각기 대응하는 제1, 2및 3반전 출력을 가지며, 그리고 제2그룹의 두 다른 출력 트랜지스터의 제2주전극에 결합된 다른 출력단자 및 두 다른 출력단자에 제각기 대응하는 제1, 2 및 3반전 출력에 상보적인 제1, 2 및 3비반전 출력을 가지며, 제1적분기의 비반전 입력 및 제1반전 출력과, 제2적분기의 제1비반전 출력은 필터 출력 단자의 하나에 접속되고, 제1및 2적분기의 제2반전 출력은 필터 출력 단자의 하나에 접속되며, 제1적분기의 제3반전 출력은 제2적분기의 비반전 입력 및 제1반전 출력에 접속되며, 그리고 적분기의 잔여 필터 입력단자, 필터 출력단자, 입력 및 출력은 그들의 상보적인 카운트파트에 일치하는 식으로 접속됨으로써, 계수가 적분기의 트랜지스터의 상대크기로 한정되는 4차 전달함수를 가진 필터 섹션을 구성하는 필터장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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