KR920005057Y1 - 수직라스터 클램핑 회로 - Google Patents

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Abstract

내용 없음.

Description

수직라스터 클램핑 회로
제 1 도는 종래의 수직 라스터 클램핑 회로도.
제 2 도는 본 고안에 따른 클램핑 회로도.
제 3 도는 본 고안에 따른 클램핑 회로도의 각부분의 파형도.
* 도면의 주요부분에 대한 부호의 설명
Vs : 수직동기 신호 입력단 G1 : 브라운관의 그리드
R1∼R9 : 저항 C1∼C6 : 콘덴서
D1, D2 : 다이오드 1 : 신호합성부
2 : 미분회로 3 : 펄스폭 조정부
4 : 신호 반전부 5 : 수직 평향회로
6 : 멀티바이브레이터 7 : 클리핑부
본 고안은 수직라스터(Raster) 크램핑(Clamping)회로에 관한 것으로 특히 수직 출력신호 파형의 클리핑(Clipping)된 신호와 저항과 콘덴서에 의한 멀티바이브레이터의 출력신호를 합성하여 블랭킹(Blanking) 신호를 만들어 내므로 수직라스터의 상부 말림을 개선한 수직라스터 크램핑 회로에 관한 것이다.
종래에는 수직라스터 크램핑 회로로서 제 1 도에 도시된 바와같이 수직동기 신호(V.S)를 수직편향회로(5)의 입력단에 연결하고 저항(R2)와 다이오드(D1) 저항(R4)를 거쳐 접지접속하고 수직편향회로(5)의 출력은 수직 편향요크(V. DY)와 콘덴서(C1) 저항(R1)을 거쳐 접지 접속됨과 동시에 저항(R3)과 다이오드(D2)을 거쳐 저항(R4)에 접속하여 다이오드(D1)(D2)로 구성되는 신호 합성부(1)를 구성하고, 그 합성된 신호는 콘덴서(C2)를 거쳐 단안정 멀티 바이브레이터(6)의 입력단에 접속됨과 동시에 저항(R5)를 거쳐 접지접속하여 미분회로(2)를 구성한다. 단안정 멀티바이브레이터(6)에는 모두 접지된 저항(R6)과 콘덴서(C3)로 이루어지는 펄스폭 조정회로(3)가 연결되고, 상기 단안정 멀티 바이브레이터(6)의 출력은 콘덴서(C4) 및 병렬 연결된 콘덴서(C5)와 저항(R7)을 거쳐 신호반전부(4)인 트랜지스터(TR1)의 베이스에 접속됨과 동시에 저항(R8)을 거쳐 접지접속되고, 상기 트랜지스터(TR1)의 에미터는 접지접속되고 그 콜렉터는 저항(R9)을 거쳐 전원단(B+)에 접속됨과 동시에 콘덴서(C6)을 거쳐 CPT의 그리드(G1)에 접속되어 구성된다.
이와같이 구성된 종래의 수직 라스터 클램핑 회로의 작동을 설명하면, 수직동기신호(V.S)가 수직편향 회로(5)를 거쳐 수직출력파형으로 수직 편향코일(V. DY)에 공급된다.
수직동기 신호와 수직출력 파형이 다이오드(D1, D2)에 의해 합성되고 이 합성된 신호는 미분회로(2)인 콘덴서(C2) 와 저항(R5)에 의해 미분되고, 이미분된 파형이 단안정 멀티바이브레이터(6)의 트리거 파형인 입력파형으로 입력된다.
단안정 멀티바이브레이터(6)에는 저항(R6)와 콘덴서(C3)로 구성된 펄스폭 조절회로(3)가 연결되어 이에의해 출력 파형의 폭이 결정된다. 단안정 멀티 바이브레이터(6)의 출력은 콘덴서(C4)에 의해 DC커플링되고 신호 반전부(4)인 트랜지스터(TR1)에 의해 반전된다.
이반전된 블랭킹 신호는 콘덴서(C6)에 의해 DC커플링되어 CPT의 그리드 전극(G1)에 공급되어 수직 라스터의 상부 말림이나 벌어짐을 막아주는 것이다.
그러나 상기 단안정 멀티바이브레터(6)의 출력파형을 블랭킹 신호로 사용함으로서 펄스폭을 결정하는 펄스폭 결정부(3)의 저항(R6)와 콘덴서(C3)의 오차에 의해(블랭킹신호) 출력파형이 변하고, 펄스폭 tw=0.6×R6×C3로 결정되어 블랭킹 신호는 약 600㎲가 되므로 저항(R6)와 콘덴서(C3)의 오차에 크게 영향을 받게된다.
따라서 수직라스터의 말림 또는 벌어짐의 클램핑 위치가 크게 변하므로 라스터의 말림 또는 벌어짐의 삭제가 불확실해지는등 여러 가지 문제점이 있다.
본 고안은 이러한 문제점을 해결하고자 안출된 것으로서 제 3 도에 따라 그 구성을 설명하면 다음과 같다.
수직동기 신호(V.S)가 인가되는 수직편향 회로(5)가 수직편향 요크(V. DY)와 콘덴서(C1)가 저항(R1)을 거쳐 접지접속됨과 동시에 콘덴서(C2)를 거쳐 다이오드(D1)에 접속되며 또한 저항(R2)를 거쳐 접지 접속되고, 다이오드(D1)은 저항(R3)을 거쳐 클리핑부(7)인 다이오드(D2)와 Vcc전원부를 거쳐 접지접속되고 동시에 저항(R4)를 거쳐 단안정 멀티 바이브레이터(6)의 입력단에 접속되고 또한 저항(R5)를 거쳐 접지접속된다.
또한 저항(R4)는 신호 합성부(1)의 다이오드(D4)에 연결된다. 단안정 멀티 바이브레이터(6)의 단자핀(14, 15, 16)에는 콘덴서(C3)와 저항(R6)으로 구성된 펄스폭 조절부(3)가 전원단(+Vcc)에 접속되어 연결되고, 단안정 멀티 바이브레이터(6)의 출력(OUT)은 신호 합성부(1)의 다이오드(D3)에 접속되고, 이 신호 합성부(1)는 저항(R7)을 거쳐 신호 반전부(4)의 트랜지스터(TR1)의 베이스(2)에 연결되고 그 콜렉터가 저항(R9)을 거쳐 전원단(B+)에 연결됨과 동시에 커플링 콘덴서(C4)를 거쳐 CPT의 그리드(G1)에 접속되어 구성된다.
본 고안에 따른 수직라스터 클램핑 회로의 동작을 제 3 도와 연결하여 설명하면 다음과 같다.
수직편향 회로(5)의 출력파형은 제 3a 도와 같이 수직편향 코일(V. DY)에 인가된다. 기존의 블랭킹 신호는 수직 출력파형(제 3a 도)의 폭 t2를 이용하기 때문에 수직 출력의 "S"부분에서 상부 라스터가 말리거나 떨어지게 된다.
따라서 블랭킹 신호를 t3만큼 늘려서 총블랭킹 신호가 t4(t4〈t1)가 되도록 하면 라스터의 상부가 말리거나 벌어지는 것을 없앨수 있는 것이다. 수직 출력파형(A)은 콘덴서(C2)에 의해 DC커플링되어 커플링된 파형은 저항(R2)에 의해 전압 레벨이 조정된다.
다이오드(D1)에 의해 정(+)의 신호만 통과하게 되고, 클리핑회로(7)에 의해 Vcc(-5V) 전압만 통과하게되고 나머지는 잘려서 제 3b 도의 파형을 얻을수 있게 된다.
이 파형은 단안정 멀티바이브레이터(6)의 입력(IN)에 인가되고 이입력은 홀링에지(Falling Edge)에서 트리거 되도록 다른 입력단(2, 3번핀)을 +Vcc(+5V)단에 연결한다.
단안정 멀티바이브레이터(6)의 출력(OUT)은 제 3c 도와 같은 파형으로 얻어지는데 클리핑된 신호폭(t2+t3) 수직주기의 영상신호가 시작되는데 까지의 시간(t1)보다 단안정 멀티바이브레이터(6)의 출력 신호폭(t3)를 결정하면 된다.
신호폭(t3)은 t3=0.45×R6×R3로 결정된다. 클리핑된 신호(제 3b 도 파형)와 단안정 멀티바이브레이터(6)의 출력(OUT)신호(제 3c 도 파형)는 신호합성부(1)에서 합성되어 제 3d 도의 파형으로 나타난다.
합성된 신호는 바로 블랭킹 신호로서 트랜지스터(TR1)에 의해 반전되고, 제 3e 도에 도시된 바와같은 상기 반전된 신호는 콘덴서(C4)에 의해 DC커플링되어 CPT의 그리드 전극(G1)으로 공급되어 블랭킹 신호로 동작하여 상부 라스터의 말림과 벌어짐이 없어진다.
한편 단안정 멀티바이브레이터(6)의 출력신호의 파형폭(t3)은 일정한 수직 출력파형폭(t2)에 비해 1/6(=100㎲)정도에 해당하여 저항(R6)와 콘덴서(C3)의 오차에 의한 파형폭(t3)오차는 전체 블랭킹 신호폭 t4(t2+t3)에 비해 거의 무시할수 있는 값이므로 항상 일정한 블랭킹 신호폭 t4를 얻을 수 있는 것이다.
본 고안에 따른 수직라스터 클램핑 회로는 수직출력파형과 이를 이용한 단안정 멀티 바이브레이터의 출력파형을 합성하여 블랭킹 신호를 사용함으로서 단안정 멀티바이브레이터의 펄스폭의 오차를 줄임으로써 블랭킹 신호의 폭이 일정한 파형을 얻을수 있도록 된 것이다.
따라서 수직 라스터의 상부 말림이나 벌어짐을 오차없이 없앨수 있는 등 여러 가지 이점이 있는 유용한 것이다.

Claims (1)

  1. 수직편향 회로(5)가 수직편향 요크(V. DY)와 콘덴서(C1) 저항(R1)을 거쳐 접지되고 클리핑신호와 단안정 멀티바이브레이터(6)의 출력파형이 합성된 신호가 트랜지스터(TR1)에 의해 반전되어 CPT 의 그리드(G1)에 인가되는 것에 있어서, 수직 편향회로(5)의 출력신호를 콘덴서(C2)로 DC커플링하고 저항(R1)으로 레벨조정하고 이를 클리핑하는 다이오드(D2)와 Vcc전원으로된 클리핑 회로(7)을 포함하고, 상기 클리핑 된 신호를 저항(R6)와 콘덴서(C3)로된 펄스폭 조정부(3)가 연결된 단안정멀티바이브레이터(6)을 거쳐 상기 클리핑 된 신호와 합성하는 다이오드(D3, D4)로 구성된 신호 합성부(1)를 포함하여, 블랭킹 신호의 신호폭을 일정하게 하도록 구성된 것을 특징으로 하는 수직 라스터 클램핑 회로.
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