KR920001893A - 디지탈 신호처리 프로세서의 비동기 직렬통신 시스템 - Google Patents

디지탈 신호처리 프로세서의 비동기 직렬통신 시스템 Download PDF

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KR920001893A
KR920001893A KR1019900008220A KR900008220A KR920001893A KR 920001893 A KR920001893 A KR 920001893A KR 1019900008220 A KR1019900008220 A KR 1019900008220A KR 900008220 A KR900008220 A KR 900008220A KR 920001893 A KR920001893 A KR 920001893A
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최상대
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이헌조
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    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L25/00—Baseband systems
    • H04L25/02—Details ; arrangements for supplying electrical power along data transmission lines
    • H04L25/20—Repeater circuits; Relay circuits

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Abstract

내용 없음.

Description

디지탈 신호처리 프로세서의 비동기 직렬통신 시스템
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명에 따른 디지탈 신호처리 프로세서의 비동기 직렬통신 시스템 구성도.
제4도 및 제5도는 본 발명에 따른 디지탈 신호처리 프로세서의 비동기 직렬데이타 송신 및 수신제어 흐름도.

Claims (2)

  1. 디지탈 신호처리 프로세서(5)의 데이타 통신에 있어서, 컴퓨터(1)와의 수신데이타(DR)의 레벨을 조정하는 수신버퍼(2)와, 송신데이타(DX)의 레벨을 조정하는 송신버퍼(3)와, 상기 수신버퍼(2)의 출력을 인가 받아 데이타 수신시작을 알리는 플립플롭부(4)를 구비하여 그 디지탈 신호처리 프로세서(5)가 데이타 수신시의 프레임 동기신호(FSR) 및 수신클럭(CLKR)과 데이타 송신시의 송신클럭(CLKX)을 발생시켜 그에따라 상기 수신버퍼(2) 및 송신버퍼(3)를 통해 직렬데이타 통신을 하도록 하는 것을 특징으로 하는 디지탈 신호처리 프로세서의 비동기 직렬통신 시스템.
  2. 제1항에 있어서, 디지탈 신호처리 프로세서(5)는 송신할 데이타를 최하위 비트(LSB)부터 최상위 비트(MMSB) 순서로 포멧 변환한 후 시작비트, 패리트 비트 및 끝비트를 추가하여 송신버퍼(3)를 통해 1워드 데이타 송신하고, 수신버퍼(2)를 통해 수신한 데이타에서 스타트 비트, 패리티 비트 및 끝비트를 제거한 후 최상위 비트(MSB)부터 최하위 비트(LSB) 순서로, 포멧 변환을 하여 1워드 데이타 수신완료 하는 것을 특징으로 하는 디지탈 신호처리 프로세서의 비동기 직렬 통신시스템.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019900008220A 1990-06-04 1990-06-04 디지탈 신호처리 프로세서의 비동기 직렬통신 시스템 KR920009389B1 (ko)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100367470B1 (ko) * 2000-04-22 2003-01-10 학교법인 문화교육원 김치분말을 이용한 빵의 제조방법

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