KR910014824A - 프로세서 및 정보 처리 장치 - Google Patents

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요시아끼 사와다
히로또시 마에가와
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오오가 노리오
소니 가부시끼가이샤
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Abstract

내용 없음

Description

프로세서 및 정보 처리 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 원에 따른 프로세서의 기본 구조를 나타낸 도면, 제10도는 스토리지의 상세도, 제11도는 평가부의 상세 구조도.

Claims (4)

  1. 마이크로코드 저장용으로서 저장형 중복 서입이 가능한 메모리 수단을 갖는 마이크로프로그램 제어형 프로세서에 있어서, 가상 메모리 공간을 설정하기 위한 설정수단과, 상기 설정 수단으로 표시된 가상 메모리 공간의 어드레스 정보와 상기 메모리 수단을 포함하는 실제 메모리 공간내의 어드레스와의 협력 관계를 나타내는 변환 테이블 수단을 구비하고, 상기 가상 메모리 공간내의 소정의 어드레스가 데이타를 판독하기 위해 설계되어 있고 상기 변환 테이블 수단의 내용을 수정될 수 있는 프로세서.
  2. 정보 처리 장치에 있어서, 리소스로서 실행 모델상의 데이타나 연산부를 유지하는 유지수단과, 실행 모델상에서 상기 리소스의 가시적 변동이나 동적 변동에 따라 평가를 행하는 평가 수단을 구비하고, 상기 유지 수단은 리소스데이타 저장의 기능과 상기 평가 수단에 의해 평가를 행하기 위한 데이타로서 상기 리소스 데이타를 관리하는 기능을 가지며, 상기 유진 수단은 평가에 필요한 정보를 출력하도록 저장된 라소스 데이타에 기초한 제이타를 처리하기 위하여 상기 평가 수단으로부터의 정보 요청 명령에 응답하는 정보 처리 장치.
  3. 제2항에 있어서, 상기 유지 수단은, 상기 평가 수단에 의해 평가를 실행하는 데이타로서, 마이크로코드 저장용으로 저장된 중복 서입이 가능한 메모리 수단을 갖는 마이크로 프로그램 시스템 프로세서에 의해서 상기 리소스 데이타를 관리하는 정보 처리 장치.
  4. 제3항에 있어서, 상기 가상 메모리 공간을 설정하기 위한 설정 수단과, 상기 설정 수단으로 표시된 가상 메모리 공간의 어드레스정보와 상기 메모리 수단을 포함하는 실제 메모리 공간내의 어드레스와의 협력 관계를 나타내는 변환 테이블 수단을 구비하고, 상기 가상 메모리 공간내의 소정의 어드레스가 데이타를 판독하기 위해 설계되어 있고 상기 변환 테이블 수단의 내용은 수정될 수 있는 정보 처리 장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910001166A 1990-01-24 1991-01-24 프로세서 및 정보 처리 장치 KR100220496B1 (ko)

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JP14062 1990-01-24
JP14063 1990-01-24
JP2014062A JPH03218543A (ja) 1990-01-24 1990-01-24 プロセッサ
JP02014063A JP3077812B2 (ja) 1990-01-24 1990-01-24 情報処理装置

Publications (2)

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KR100220496B1 KR100220496B1 (ko) 1999-09-15

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