KR910009004A - 집적된 서비스 디지탈 네트워크(isdn)의 스피드적용 처리 및 스피드 적용을 위한 모노리드식 집적장치 - Google Patents

집적된 서비스 디지탈 네트워크(isdn)의 스피드적용 처리 및 스피드 적용을 위한 모노리드식 집적장치 Download PDF

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Abstract

내용 없음

Description

집적된 서비스 디지탈 네트워크(ISDN)의 스피드적용 처리 및 스피드 적용을 위한 모노리드식 집적하기
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 속도적용을 위한 시스템 수신 블럭의 사극부분을 나타낸 도면,
제2도는 본 발명에 따라 만들어진 ISDN에 대한 속도적용을 위한 모노리드식 장치의 블럭도표,
제3도는 전송블럭과 수신블럭으로 기능적으로 나뉘어진 제2도블럭도표의 중간블럭RA1을 단단하게 도시한 도표.

Claims (2)

  1. 중간수신블럭에 의해 수행된 속도의 적용, 한 집적된 장치속도 적용, 집적된 서비스 디지탈 네트워크(ISDN)에 대한 CCITTV. 110 스탠다드에 따른 동기식, 비동기식 적용을 위한 팔정수ㅡ행 비트로 조직된 동기화 및 비동기식 프레임의 분해처리로서, 네트워크로 부터 자료의 수신모드에서 프레임 동기화 자료를 담고 있는 각기 다른 길이의 비동기식 프레임내에 함께 모아진 팔정수로 만들어진 입력내 자료를 사용할 수 있으며, 그같은 처리가 동기화 비트, 단말기 출력 접속장치를 위한 제어비트, 감독 마이크로프로세서를 위한 정보비트 그리고 필요하면 반복되며 8비트 쉬프트 레지스터에 의해 한번에 한 팔정수를 저장시키고 따라서 각 비동기식 프레임내에 저장된 각 팔정수의 현재위치를 저장시키기 위해 제1의 계수기를 사용하므로써 상기 스탠다드에 따라 배치되는 자료비트를 담고 있는 상기 비동기식 프레임을 분해시키고, 상기의 제1계수기와 이같은 계수기에 의해 각 팔정수의 관련 비트를 인식하며, 따라서 각 팔정수에 대해 인식된 비트를 전달 및 저장하고 따라서 인식된 그리고 저장된 비트를 네트워크로부터 상기 단말기로 자료의 직렬흐름관리 및 제어를 위한 각각의 요소로 스위치함을 포함함을 특징으로 하는 집적된 서비스 디지탈 네트워크의 스피드 적용처리.
  2. 수신모드로 프레임 동기화 자료를 담고있는 각기 다른 길이의 비동기식 프레임내에 함께 모아진 팔정수에 만들어진 입력에서의 자료를 사용할 수 있으며, 비동기식/동기식 변환기(RAO)를 포함하고 이같은 변환기가 출발/정지 포멧트 문자의 흐름을 600비트/초2 상부체 속도의 비동기식 비트흐름으로 변환시킬 수 있고, 이때 n가 송신단계에서 0-6의 크기를 갖고 수신단계에서 그 역으로 되며, 속도의 적용을 위한 첫번째 중간블럭(RA1)이 중간속도로 그리고 기본적으로 상기 중간블럭을 통해 자료의 직렬흐름 정규 클럭신호 주파수보다 높은 주파수를 갖는 제1클럭신호의 제어하에 동작하고 상기 스탠다드에 따라 80 또는 32비트의 비동기식 프레임을 전송단계에서는 합성시키고 수신단계에서는 동기화하고 분해시킬수 있으며, 동기식 네트워크 접속블럭(RA2)이 상기 중간 속도를 64 킬로비트/초의 캐리어 속도로 그리고 그 역으로 변환시킬 수 있고, 적어도 전술한 제1중간블럭이 수신(RA1RX)를 위한 제1서브로크에 의해 대체되고 전송(RA1TX)를 위한 제2의 서브로크에 의해 대체되며, 각각이 단말기의 부분에서 네트워크로 부터 자료를 수신하는 동안과 단말기의 부분에서 네트워크로 자료를 송신 시키는 동안에 각각 동작되고, 마이크로프로세서를 위한 접속장치(UP접속장치)가 장치의 초기 구성을 위한 기록레지스터와 집적된 장치로부터 정보를 탐지하기 위한 판독레지스터를 담고 있으며, 프로그램 가능한 클럭발생기(DOLL)가 네트워크 기준클릭에 의해 동기화되고 외부주파수 신호에 의해 구동되고, 이같은 발생기가 집적된 장치의 각기 다른 기능블럭에 의해 사용된 각 클럭신호를 발생시킬 수 있는, CCITT V.110 스탠다드에 따라 동기식 및 비동기식 단말기의 적용을 위한 집적된 서비스 디지탈 네트워크(ISDN) 속도적용을 위한 모노리드식 장치에 있어서, 수신(RA1RX)을 위한 상기 제1의 중간서브로크가 직렬자료의 동기식 흐름을 수신할 수 있으며 모든 재로에 의해 구성된 팔정수 레지스터내에 존재하는 출력정보에서 발생할 수있는 수단이 제공된 제1의 8-비트쉬프트 레지스터, 상기 제1레지스터와 관련하여 기능적으로 직렬로 연결되며 지시를 받아 상기 제1레지스터로 부터의 한 팔중수와 한 제어라인 신호와 관련된 6개의 중앙자료비프를 적재시킬 수 있는 7비트의 제2레지스터, 그리고 상기 제2레지스터와 기능적으로 직렬로 연결되며 상기 제2쉬프트 레지스터로부터 관련된 6개 자료비피를 적대하고 관련된 한 자료라인을 통해 출력에서 상기의 자료비트를 제공할 수 있는 6비트(RSC6)의 제3쉬프트레지스터, 상기 제1레지스터와 관련해서 기능적으로 직렬로 연결되며 지시를 받아 E 감독비트를 적재시킬 수 있으며, 이같은 감독비프로 부터 감독 마이크로프로세서에 의해 판독되는,7비트레지스터(RER)에 의해 구성된 감독자료를 스위치하기 위한 구조, 관리 및 제어를 위한 구조로서 8비트용 제1계수기(RSA), 프레임의 크기에 따라 10 또는 4비트용 제2프로그램가능 계수기, 제3계수기(CT80)으로 구성되며,제1계수기가 한전체팔중수가 입력되는 때 상기 제1레지스터(RSC8)내로 이동하면서 정보를 발생시킬수 있으며, 제2계수기가 프레임의 8중수 숫자를 계수할 수 있으며 출력에서 한 프레임이 끝이 도달하였는지에 대한 제1의 정보편과 7비트의 레지스터(RER)로 E비트의 동 팔중수를 스위치할 수 있도록 하기 위해 상기 제1쉬프트 레지스터(RSC8) 내 E 감독비트 팔중수 존재에 대한 제2정보편을 제공하고, 제1클럭신호로 동작하는 제1상태머신(RS2)이 집적된 구조 PLA에 의해 구성되며, 이같은 구조가 입력과 관련해서 동기화, 팔중수 주소를 관리할 수 있으며 동기식 작용의 단계에서 상기 계수기(RSB)로부터 획득된 정보를 사용하여 상기 계수기가 끝나자마자 존재하는 팔중수의 종류에 따라 동기화 유지의 제어 및 명령을 관리할 수 있고, 제3계수기가 동기화가 분실되는 때 상기 상태머신(RS2)에 의해 시작되고, 이는 상기 스탠다드에 의해 규정된 프레임 숫자(NFR)의 이동을 계수할 수 있으며, 프레임 비트를 계수할 수 있고, 각 계수가 끝나는 곳에서 연속적 프레임 비트의 계수를 재개하기 전에 4번째 계수기(CTNFR)를 증가시킬 수 있는 한 구조, 출력의 제어를 위한 구조로서 제2프로그램가능 상태머신(RS9), 제1지연블럭(RS7), 제2지연블럭(RIT)를 포함 하며,제2상태머신이 출력에서 자료를 위한 제2클럭신호와 함께 동작하는 집적된 구조 PLA에 의해 구성되며, 이때의 신호가 상기 제1상태머신(RS2)의 제1클럭신호와 관련 기본적으로 느리게 되며, 제1지연블럭이 상기 제1상태머신(RS2)에 의해 전송된 출력의 제어를 위한 구조의 블럭출발신호를 지연시킬 수가 있고, 제2지연블럭이 제어라인신호의 출력블럭(FILI CONR)에 의해 상기 CCITT V.110 스탠다드 요구조건에 따라 정확한 순간에 출력에서 동시에 제공될 수 있도록 하기 위해 이들이 도달하는 때 제어라인의 신호들을 저장 할 수 있는 한 구조를 포함함을 특징을 하는 집적된 서비스 디지탈 네트워크의 스피드 적용을 위한 모노리드식 집적장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019900017513A 1989-10-31 1990-10-31 집적된 서비스 디지탈 네트워크의 스피드적용 처리 및 스피드 적용을 위한 모노리드식 집적장치 KR0156921B1 (ko)

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