KR910007234A - 진폭변조신호의 검출회로 - Google Patents

진폭변조신호의 검출회로 Download PDF

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KR910007234A
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가쓰야 이시가와
야스히로 하시모또
찌가라 쓰찌야
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세끼자와 다다시
후지쓰 가부시끼가이샤
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    • H03—ELECTRONIC CIRCUITRY
    • H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
    • H03D1/00—Demodulation of amplitude-modulated oscillations
    • H03D1/14—Demodulation of amplitude-modulated oscillations by means of non-linear elements having more than two poles
    • H03D1/18—Demodulation of amplitude-modulated oscillations by means of non-linear elements having more than two poles of semiconductor devices

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Abstract

내용 없음.

Description

진폭변조신호의 검출회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 원리를 설명하기 위한 회로도.
제5도는 본 발명의 제1실시예를 나타낸 회로도.

Claims (8)

  1. 진폭변조신호가 공급되는 입력단자(10) ; 입력단자에 연결된 베이스, 제1전원(Vcc)에 연결되어 제1전원전압을 제공하는 콜렉터 및 에미터를 갖는 제1바이폴라 트랜지스터(Q1) ; 베이스, 제1전원에 연결된 콜렉터 및 제1바이폴라 트랜지스터의 에미터에 공통 결합된 에미터를 갖는 제2바이폴라 트랜지스터(Q2) ; 제1바이폴라 트랜지스터의 에미터와 제2바이폴라 트랜지스터의 에미터에 공통으로 연결된 출력신호를 제공하는 출력단자(11); 제1바이폴라 트랜지스터의 베이스와 제2바이폴라 트랜지스터의 베이스에 연결되어 제1 및 제2바이폴라 트랜지스터들을 바이어스시키는 바이어스수단(VREF,R1,R2)를 포함하는 진폭변조신호의 검출회로에 있어서, 상기 검출회로가, 입력단자로 공급되는 진폭변조신호에 응하여 제어신호(IX)를 생성하기 위하여 제1바이폴라 트랜지스터의 베이스에 연결된 입력단자 ; 제1 및 제2바이폴라 트랜지스터들의 에미터들에 연결된 제1단과, 제1전원전압과 다른 제2전원전압을 제공하는 제2전원에 연결되는 제2의 단을 갖고 있으며, 제1바이폴라 트랜지스터를 통하여 흐르는 에미터 전류와 제2바이폴라 트랜지스터를 통하여 흐르는 에미터전류의 합계인 구동전류를 그를 통하여 제2전원으로 흐르게 하고 제어신호를 수신하여 제어신호에 응하여 그를 통하여 흐르는 구동전류를 제어하기 위하여 제어수단에 연결된 입력단자를 갖고 있는 가변전류원을 포함하고, 상기 제어수단이 제어신호에 의해서 출력단자에서의 출력신호가 진폭변조신호의 정의 반사이클 및 부의 반사이클중의 하나인 반사이클동안에 입력되는 진폭변조신호의 진폭증가와 함께 선형증가되는 전압레벨을 갖고 진폭변조신호의 정의 반사이클 및 부의 반사이클중의 나머지 하나의 반사이클 동안에 정전압 레벨을 갖도록 가변전류원을 제어하는 것을 특징으로 하는 진폭변조신호의 검출회로.
  2. 제1항에 있어서, 상기 제어수단(22)이 소정의 범위내에서 제어전류 입력단자에서의 진폭변조신호의 진폭과 함께 변화하는 크기를 갖고 소정의 범위를 벗어난 범위에서는 제어전류가 진폭변조신호의 진폭에 상관없이 일정하게 유지되게 제어신호로서 제어전류(IX)를 생성하고 상기 가변전류원 수단이 소정의 전류로부터 제어전류를 감산한 구동전류(I-IX)를 제공하는 것을 특징으로 하는 진폭변조신호의 검출회로.
  3. 제2항에 있어서, 상기 제어수단이 소정의 범위내에서는 일반적으로 입력단자에서의 진폭변조신호의 정 및 부의 반사이클중의 진폭과 함께 제어전류를 선형 변화시키는 것을 특징으로 하는 진폭변조신호의 검출회로.
  4. 제2항에 있어서, 상기 제1바이폴라 트랜지스터가 베이스와 에미터간에 p-n-전크숀을 포함하고 상기 p-n전크숀이 소정의 입력 전압 범위보다도 작은 진폭을 갖는 진폭변조신호들에 대한 곡선으로된 정류 특성을 제공하고 상기 소정의 범위(A)가 상기 입력전압 범위에 상당되게 결정되는 것을 특징으로 하는 진폭변조신호의 검출회로.
  5. 제2항에 있어서, 상기 제어수단이 제1바이폴라 콜렉터의 베이스에 연결된 제1입력단자를 갖고 제2바이폴라 트랜지스터(Q2)에 연결된 제2입력단자를 갖고 상기 제1 및 제2입력단자간의 전압차를 검지하는 차동회로를 포함하고 상기 제어수단이 검출된 전압차에 응하여 제어신호를 생성하는 것을 특징으로 하는 진폭변조신호의 검출회로.
  6. 제2항에 있어서, 상기 제어수단이 제1바이폴라 트랜지스터(Q1)의 콜렉터와 제1전원(Vcc)과의 사이에 설비된 제1저항(R3) ; 제2바이폴라 트랜지스터(Q2)의 콜렉터와 제1전원 사이에 설비된 제2저항(R4) ; 제1바이폴라 트랜지스터의 베이스와 공통으로 입력단자에 연결된 베이스, 에미터 및 제1전원에 연결된 콜렉터를 갖고 있는 제3바이폴라 트랜지스터(Q3) ; 제2바이폴라 트랜지스터의 베이스와 공통으로 바이어스와 공통으로 바이어스 수단에 연결된 베이스, 제3바이폴라 트랜지스터의 에미터와 공통 연결된 에미터 및 제2레벨 쉬프트 수단을 거쳐서 제1전원에 연결된 콜렉터를 갖는 제4바이폴라 트랜지스터(Q4) ; 제2전원에 연결된 제1의 단과 제3바이폴라 트랜지스터와 제4 바이폴라 트랜지스터의 에미터들에 연결된 제2의 단을 갖는 제1정전류원수단(12c) ; 제1바이폴라 트랜지스터의 콜렉터에 연결된 베이스, 에미터 및 콜렉터를 갖는 제5바이폴라 트랜지스터(Q5) ; 제2바이폴라 트랜지스터의 콜렉터에 연결된 베이스, 제5바이폴라 트랜지스터의 에미터에 연결된 에미터 및 콜렉터를 갖는 제6바이폴라 트랜지스터(Q6) ; 제1전원에 연결된 제1의 단과 제5 및 제6바이폴라 트랜지스터들의 에미터들에 연결된 제2의 단을 갖는 제2정전류원(121) 제1레벨 쉬프팅 수단의 제2의 단에 연결된 베이스, 제5바이폴라 트랜지스터의 콜렉터에 연결된 에미터 및 콜렉터를 제7바이폴라 트랜지스터(Q7) ; 제4바이폴라 트랜지스터의 콜렉터에 연결된 베이스, 제7바이폴라 트랜지스터의 에미터 및 공통으로 제5바이폴라 트랜지스터의 콜렉터에 연결된 에미터와 콜랙터를 갖는 제8바이폴라 트랜지스터(Q8) ; 제8바이폴라 트랜지스터의 베이스와 공통으로 제4바이폴라 트랜지스터의 콜렉터에 연결된 베이스, 제6바이폴라 트랜지스터의 에미터에 연결된 에미터 및 제7바이폴라 트랜지스터의 콜렉터와 공통 연결된 콜렉터를 갖는 제9바이폴라 트랜지스터(Q9) ; 제7바이폴라 트랜지스터의 베이스와 공통으로 제3바이폴라 트랜지스터의 콜렉터에 연결된 베이스, 제9바이폴라 트랜지스터의 콜렉터와 공통으로 제6바이폴라 트랜지스터의 에미터에 연결된 에미터 및 제8바이폴라 트랜지스터의 콜렉터와 공통 연결된 콜렉터를 갖는 제10바이폴라 트랜지스터(Q10) ; 제1전원에 연결된 제1의 단과 제2의 단을 갖는 제3정전류원(122) ; 제3전류원의 제2의 단에 연결된 콜렉터, 제2전원에 연결된 에미터 및 자체 콜렉터에 연결된 베이스를 갖는 제11바이폴라 트랜지스터(Q11) ; 제11바이폴라 트랜지스터의 베이스에 연결된 베이스, 제1바이폴라 트랜지스터의 에미터에 연결된 콜렉터 및 제2전원에 연결된 에미터를 갖는 제12바이폴라 트랜지스터(Q12) ; 제8 및 제10바이폴라 트랜지스터들의 콜렉터들에 제3전류원의 제2의 단에 연결된 콜렉터, 베이스 및 제2전원에 연결된 에미터를 갖는 제13바이폴라 트랜지스터(Q13) ; 및 제7 및 제9바이폴라 트랜지스터들의 콜렉터들에 연결된 콜렉터, 제13바이폴라 트랜지스터의 베이스와 제13바이폴라 트랜지스터의 콜렉터에 연결된 베이스 및 제2전원에 연결된 에미터를 갖는 제14바이폴라 트랜지스터(Q14)를 포함하는 것을 특징으로 하는 진폭변조신호의 검출회로.
  7. 제6항에 있어서, 상기 제3,4,11,12,13 및 14바이폴라 트랜지스터들이 npn형 바이폴라 트랜지스터로 구성되고 상기 5,6,7,8,9 및 10바이폴라 트랜지스터가 pnp형 바이폴라 트랜지스터로 구성된 것을 특징으로 하는 진폭변조신호의 검출회로.
  8. 제1항에 있어서, 상기 제어수단(22)이 디지털 프로세싱 유니트로 구성된 것을 특징으로 하는 진폭변조신호의 검출회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019900015162A 1989-09-25 1990-09-25 진폭변조신호의 검출회로 KR940000923B1 (ko)

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