KR900008516A - 버퍼 기억장치 - Google Patents

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KR900008516A
KR900008516A KR1019890014987A KR890014987A KR900008516A KR 900008516 A KR900008516 A KR 900008516A KR 1019890014987 A KR1019890014987 A KR 1019890014987A KR 890014987 A KR890014987 A KR 890014987A KR 900008516 A KR900008516 A KR 900008516A
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가쯔유끼 사또
다따히꼬 니시무까이
구니오 우찌야마
히로까즈 아오끼
스스무 하따노
간지 오이시
히로시 후꾸따
다까시 기꾸찌
야스히꼬 사이고
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미다 가쓰시게
가부시끼가이샤 히다찌 세이사꾸쇼
오노 미노루
히다찌초엘에스 아이엔지니어링 가부시끼가이샤
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    • G—PHYSICS
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Abstract

내용 없음.

Description

버퍼 기억장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명을 캐시메모리에 직용한 경우의 1실시예를 도시한 블럭도,
제2도는 캐시메모리를 사용한 마이크로프로세서 시스템의 구성예를 도시한 시스템 구성도,
제3도는 데이타어레이와 게이트 & 셀렉터 및 플라이트 레지스터의 구체적인 예를 도시한 회로구성도.
제4도는 본 발명을 캐시메모리에 적용한 경우의 다른 실시예를 도시 한 블럭도.

Claims (10)

  1. 어드레스태그가 저장된 직접 메로리부, 상기 직접 메모리부에 저장된 어드레스태그에 대응한 데이타가 저장되는 데이타메모리부, 상기 데이타메모리부에서 리드된 데이타를 유지할 수 있는 버퍼레지스터, 상기 데이타메모리부와 상기 버퍼레지스터의 사이에 마련되어, 상기 데이타메모리부에서 리드된 데이타의 일부를 선택적으로 상기 버퍼레지스터로 전달하기 위한 셀렉터를 포함하는 버퍼기억장치.
  2. 특허청구 범위 제1항에 있어서, 상기 셀렉터는 상기 데이타메모리부에서 리드된 데이타의 다른부를 소정의 데이타로 치환하여 상기 버퍼레지스터로 전달하기 위한 데이타 치환수단을 갖는 버퍼기억장치.
  3. 특허청구 범위 제2항에 있어서, 상기 직접 메모리부, 데이타메모리부, 버퍼레지스터 및 셀렉터는 1개의 반도체 칩상에 형성된 버퍼기억장치.
  4. 특허청구 범위 제3항에 있어서, 상기 버러레지스터에 유지된 데이타를 외부로 동시에 전송하기 위한 내부 데이타버스를 갖는 버퍼기억장치.
  5. 특허청구의 범위 제4항에 있어서, 상기 데이타메모리부안의 각 비트선과 상기 버퍼레지스터의 사이에는 2개의 신호전달경로가 마련되고 한쪽의 신호전달 경로에는 상기 비트선과 버퍼 레지스터를 직접 연결하기 위한 1개의 스위치수단이 마련되고, 또 다른쪽의 신호전달경로에는 2개의 스위치 수단이 마련되어 이 2개의 스위치수단의 사이에 치환데이타를 공급하는 신호선이 접속된 버퍼기억장치.
  6. 어드레스태그가 저장된 직접 메모리부, 상기 직접 메모리부에 저장된 어드레스태그에 대응한 데이타가 저장된 데이타메모리부를 포함하는 버퍼기억장치에 있어서, 상기 직접 메모리부에는 각 어드레스태그에 대응하는 1블럭안의 데이타의 리라이트유무를나타내는 제1의 비트와 블럭을 구성하는 각 단위 데이타마다 데이타의 리라이트 유무틀 나타내는 제2의 비트군이 마련되는 버퍼기억장치.
  7. 특허청구의 범위 제6항에 있어서, 상기 직접 메모리부와 데이타메모리부는 1개의 반도체칩위에 형성된 버퍼기억장치.
  8. 특허정구의 범위 제7항에 있어서, 또 불일치가 발생했을때 상기 제2비트군을 참조하여 리라이트가 있었던 데이타만을 상기 반도체칩의 외부로 출력하는 제어수단을 포함하는 버퍼 기억장치.
  9. 특허청구의 범위 제8항에 있어서, 또 블럭전송용인 어드레스카운터를 포함하고, 불일치가 발생할 때 직접 메모리에서 리드된 태그어드레스가 상기 어드레스카운터에 세트되고, 상기 제2비트군의 정보에 따라서 카운터가 인클리멘트되는 버퍼기억장치.
  10. 특허청구의 범위 제9항에 있어서, 상기 제2비트군의 정보는 이들의 논리합으로써 제어수단에 공급되는 버퍼기억장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019890014987A 1988-11-01 1989-10-18 버퍼 기억장치 KR900008516A (ko)

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JP63-277624 1988-11-01
JP63330040A JPH02171944A (ja) 1988-12-26 1988-12-26 バッファ記憶装置
JP63-330040 1988-12-26

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Families Citing this family (27)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR930008050B1 (ko) * 1990-02-16 1993-08-25 가부시끼가이샤 히다찌세이사꾸쇼 원칩 마이크로프로세서 및 그 버스시스템
JPH05108484A (ja) * 1990-06-07 1993-04-30 Intel Corp キヤツシユメモリ
US5287512A (en) * 1990-08-06 1994-02-15 Ncr Corporation Computer memory system and method for cleaning data elements
US5386540A (en) * 1991-09-18 1995-01-31 Ncr Corporation Method and apparatus for transferring data within a computer using a burst sequence which includes modified bytes and a minimum number of unmodified bytes
US5530835A (en) * 1991-09-18 1996-06-25 Ncr Corporation Computer memory data merging technique for computers with write-back caches
JP2855019B2 (ja) * 1992-02-10 1999-02-10 富士通株式会社 外部記憶装置のデータ保証方法及び外部記憶装置
US5491811A (en) * 1992-04-20 1996-02-13 International Business Machines Corporation Cache system using mask bits to recorder the sequences for transfers of data through cache to system memory
US5420983A (en) * 1992-08-12 1995-05-30 Digital Equipment Corporation Method for merging memory blocks, fetching associated disk chunk, merging memory blocks with the disk chunk, and writing the merged data
JPH06222990A (ja) * 1992-10-16 1994-08-12 Fujitsu Ltd データ処理装置
US5914953A (en) * 1992-12-17 1999-06-22 Tandem Computers, Inc. Network message routing using routing table information and supplemental enable information for deadlock prevention
US5555391A (en) * 1993-12-23 1996-09-10 Unisys Corporation System and method for storing partial blocks of file data in a file cache system by merging partial updated blocks with file block to be written
EP0661638A1 (en) * 1993-12-28 1995-07-05 International Business Machines Corporation Method and apparatus for transferring data in a computer
KR100391727B1 (ko) * 1994-11-09 2003-11-01 소니 일렉트로닉스 인코포레이티드 메모리시스템및메모리억세싱방법
US5828823A (en) * 1995-03-01 1998-10-27 Unisys Corporation Method and apparatus for storing computer data after a power failure
US5784382A (en) * 1995-03-01 1998-07-21 Unisys Corporation Method and apparatus for dynamically testing a memory within a computer system
US5784712A (en) * 1995-03-01 1998-07-21 Unisys Corporation Method and apparatus for locally generating addressing information for a memory access
US5511164A (en) 1995-03-01 1996-04-23 Unisys Corporation Method and apparatus for determining the source and nature of an error within a computer system
US5680537A (en) * 1995-03-01 1997-10-21 Unisys Corporation Method and apparatus for isolating an error within a computer system that transfers data via an interface device
US5784393A (en) * 1995-03-01 1998-07-21 Unisys Corporation Method and apparatus for providing fault detection to a bus within a computer system
US5949970A (en) * 1997-01-07 1999-09-07 Unisys Corporation Dual XPCS for disaster recovery
US5940826A (en) * 1997-01-07 1999-08-17 Unisys Corporation Dual XPCS for disaster recovery in multi-host computer complexes
US5926838A (en) * 1997-03-19 1999-07-20 Micron Electronics Interface for high speed memory
US6581142B1 (en) * 2000-09-01 2003-06-17 International Business Machines Corporation Computer program product and method for partial paging and eviction of microprocessor instructions in an embedded computer
US7266645B2 (en) * 2003-02-18 2007-09-04 Intel Corporation Reducing communication for reads and updates in distributed object systems
US8694758B2 (en) * 2007-12-27 2014-04-08 Intel Corporation Mixing instructions with different register sizes
US9594679B2 (en) * 2008-05-01 2017-03-14 Sandisk Il Ltd. Flash cache flushing method and system
US10108376B1 (en) * 2017-05-04 2018-10-23 Xilinx, Inc. Memory initialization

Family Cites Families (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3820078A (en) * 1972-10-05 1974-06-25 Honeywell Inf Systems Multi-level storage system having a buffer store with variable mapping modes
US3938097A (en) * 1974-04-01 1976-02-10 Xerox Corporation Memory and buffer arrangement for digital computers
US4268907A (en) * 1979-01-22 1981-05-19 Honeywell Information Systems Inc. Cache unit bypass apparatus
US4370710A (en) * 1980-08-26 1983-01-25 Control Data Corporation Cache memory organization utilizing miss information holding registers to prevent lockup from cache misses
US4493026A (en) * 1982-05-26 1985-01-08 International Business Machines Corporation Set associative sector cache
EP0452989A3 (en) * 1985-05-29 1992-04-15 Kabushiki Kaisha Toshiba Magnetic disk controller incorporating a cache system adopting an lru system
JPS62145340A (ja) * 1985-12-20 1987-06-29 Toshiba Corp キヤツシユメモリ制御方式
US4914582A (en) * 1986-06-27 1990-04-03 Hewlett-Packard Company Cache tag lookaside
JPH0673114B2 (ja) * 1987-03-31 1994-09-14 日本電気株式会社 キヤツシユ制御装置
US4905188A (en) * 1988-02-22 1990-02-27 International Business Machines Corporation Functional cache memory chip architecture for improved cache access
CA1300758C (en) * 1988-03-07 1992-05-12 Colin H. Cramm Mechanism for lock-up free cache operation with a remote address translation unit

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