KR890009134A - 1비트/4비트 데이타 전송 클럭 발생회로 - Google Patents

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KR890009134A
KR890009134A KR1019870012746A KR870012746A KR890009134A KR 890009134 A KR890009134 A KR 890009134A KR 1019870012746 A KR1019870012746 A KR 1019870012746A KR 870012746 A KR870012746 A KR 870012746A KR 890009134 A KR890009134 A KR 890009134A
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이희
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삼성전자 주식회사
강진구
삼성반도체통신 주식회사
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    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L23/00—Apparatus or local circuits for systems other than those covered by groups H04L15/00 - H04L21/00
    • G—PHYSICS
    • G02—OPTICS
    • G02F—OPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
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Abstract

내용 없음

Description

1비트/4비트 데이타 전송 클럭 발생회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명 클럭발생회로의 구성도.
제2도는 본 발명 클럭발생회로의 상세회로도.
제3a∼k도는 본 발명 클럭발생회로의 각부 파형도.

Claims (1)

  1. 클럭 입력단자(Ci)가 인버터(I1)(I2)를 통하여 인버터(I3)(I4), 플립플롭(FF1)(FF2)로 구성된 병렬 클럭카운터부(1)에 접속됨과 아울러 낸드게이트(NAND9)∼(NAND12) 및 인버터(I5)(I8)로 구성된 클럭 발생 출력부(4)의 일측 단자에 접속되고, 상기 병렬 클럭 카운터부(1)의 출력단자(Q1)()(Q2)()는 낸드 게이트(NAND1)∼(NAND4)로 구성된 병렬 클럭 발생회로부(2)에 접속 구성되며, 병렬 클럭 발생회로부(2)는 낸드 게이트(NAND5)∼(NAND8)로 구성되어 직렬/병렬 선택신호 입력단자와 접속되어 구성되고, 클럭 발생 출력부(4)에 출력단자가 접속된 직렬/병렬 선택회로부(3)에 접속되어 있으며, 클럭발생 출력부(4)는 출력단자(C1)∼(C4)에 접속 구성됨을 특징으로한 1비트/4비트 데이타 전송 클럭 발생회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019870012746A 1987-11-12 1987-11-12 1비트/4비트 데이타 전송 클럭 발생회로 KR900004864B1 (ko)

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