KR880008194A - 속도 가변형 아날로그 데이터 취득회로 - Google Patents

속도 가변형 아날로그 데이터 취득회로 Download PDF

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KR880008194A KR870000418A KR870000418A KR880008194A KR 880008194 A KR880008194 A KR 880008194A KR 870000418 A KR870000418 A KR 870000418A KR 870000418 A KR870000418 A KR 870000418A KR 880008194 A KR880008194 A KR 880008194A
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이성화
남병덕
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한형수
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    • G06—COMPUTING; CALCULATING OR COUNTING
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    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
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Abstract

내용 없음.

Description

속도 가변형 아날로그 데이터 취득회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
첨부된 도면은 본 발명의 회로도이다.

Claims (1)

  1. 아날로드 데이터 취득장치에 있어서, 디코더(60) 출력단자(Y1)의 출력에 의해서 인에이블 되어 카운터(40-43)에서 출력되는 데이터를 어드레스 번지수로 하여 A/D 콘버터(10)에서 출력된 데이터를 램(30)에 저장하도록 하는 3상 스테이트 버퍼(20)(23)(24)와, 디코더(60) 출력단자(Y0)에서 출력되는 신호를 칭 셀렉트 신호로하여 샘플링 할려는 주파수를 세트시키고 타이머(40)에 클럭 펄스와 램(30)에 기입 신호 및 A/D 콘버터(10)에 클럭 펄스를 각각 공급하는 프로그램어블 인터벌타이머(50)와, 카운터(43)에서 출력되는 캐리신호와 디코더(60) 출력단자(Y3)에서 출력되는 신호를 조합하여 중앙처리장치(70)에 가로채기 신호를 공급하는 낸드게이트(80)와, 디코더(60)의 출력단자(Y2)의 출력에 의해서 인에 이블되어 중앙처리장치(70)에서, 출력되는 어드레스 신호를 받아 램(30)에 저장된 데이터를 독출하여 중앙처리장치(70)가 데이터를 인식하도록 하는 3상 스테이트 버퍼(21)(22)와 아날로그 신호를 디지탈 신호로 콘버트하는 A/D 콘버터(10)에 클럭퍼스가 인가된후 램(30)에 기입 신호를 공급하도록 지연 작용을 하는 인버터(90)(91)등 구비하여 이루어진 것을 특징으로 하는 속도 가변형 아날로그 데이터 취득회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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