KR880001101A - 중간 주파수 증폭회로 - Google Patents

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KR880001101A
KR880001101A KR870005649A KR870005649A KR880001101A KR 880001101 A KR880001101 A KR 880001101A KR 870005649 A KR870005649 A KR 870005649A KR 870005649 A KR870005649 A KR 870005649A KR 880001101 A KR880001101 A KR 880001101A
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Abstract

내용 없음

Description

중간 주파수 증폭회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 제1실시예에 따른 중간 주파수 증폭회로의 회로도.
제2도는 제1도에 도시된 증폭회로에 포함되는 한 유니트의 작동을 기술하는데 이용하기 위한 그래프도.
제3도는 제1도에 도시된 다수의 유니트의 결합을 기술하는데 이용하기 위한 그래프도.

Claims (4)

  1. 회로 입력 신호에 응답하여 증폭되는 회로 출력 신호를 발생하도록 작동하는 중간 주파수 증폭회로에 있어서, 상기 중간 주파수 증폭회로는 제1내지 n차 차동 증폭기를 포함하는데 상기 증폭기는, 제1내지 n차 증폭기 입력 단자쌍 및 제1내지 n차 증폭기 출력 단자쌍을 각각 가지며, 각 차동 증폭기의 증폭기 출력 단자쌍을 다음 차동 증폭기의 증폭기 입력 단자쌍에 계속하여 접속시키므로 상기 제1차동 증폭기로부터 상기 제n차 차동 증폭기까지 종속 접속되며, 상기 회로 입력신호는 상기 회로 출력 신호가 상기 n차 증폭기 출력 단자쌍을 통해 발생되는 동안 상기 제1 증폭기 입력 단자쌍 양단에 공급되며, 상기 중간 주파수 증폭기 회로는, 필드 세기를 나타내는 필드 세기 신호표시를 발생하도록 필드 세기를 측정하기 위해 상기회로 입력 신호에 응답하는 측정회로를 포함하며, 상기 측정회로는, 상기 제1내지 n차 증폭기 입력 단자쌍 및 상기 n차 증폭기 출력 단자쌍에 각기 접속된 제1내지(n+1)차 유니트 입력 단자쌍 및, 제1내지(n+1)차 유니트 출력 신호가 공급된 제1내지(n+1)차 유니트 출력 단자쌍을 갖는 제1내지(n+1)차 차동 유니트와, 상기 필드 세기 신호를 발생하도록 상기 제1내지(n+1)차 유니트 출력 신호를 합산하기 위해 상기 제1내지(n+1)차 유니트 출력 단자쌍에 접속된 가산기 회로를 포함하며, 각각의 상기 제1내지(n+1)차 차동 유니트는, 제1 및 제2베이스 영역, 제1 및 제2에미터 영역 및 제1 및 제2콜렉터 영역을 각기갖는 제1 및 제2주 트랜지스터의 주 차동회로를 구비하며, 상기 제1 및 제2베이스 영역은 증폭기 입력 단자쌍에 각기 접속되며, 반면에 상기 제1 및 제2에미터 영역은 K가 1보다 더 큰, 1:K의 면적비를 가지고, 서로 공통으로 결합되며, 상기 제1 및 제2콜렉터 영역은 상기 유니트 출력 단자쌍에 각기 접속되는 것을 특징으로 하는 중간 주파수 증폭회로.
  2. 제1항에 있어서, 상기 각각의 차동 유니트는, 서로가 달리 접속되어 있으면서 상기 각 차동 증폭기의 증폭기 입력 단자쌍과 상기 유니트 출력 단자쌍의 양쪽에 연결되어 있는 제1 및 제2트랜지스터부의 부가 차동 회로를 구비하는 것을 특징으로 하는 중간 주파수 증폭회로.
  3. 제2항에 있어서, 상기 각 증폭기 입력 단자쌍은 제1 및 제2증폭기 입력 단자로 이루어져 있으며, 상기 제1 및 제2베이스 영역은 상기 제1 및 제2증폭기 입력 단자에 각기 접속되며, 상기 제1트랜지스터부는, 예정된 에미터 갖는 에미터 영역과, 상기 제2증폭기 입력 단자에 접속된 베이스 영역 및 상기 제1주 트랜지스터의 제1콜렉터 영역에 공통으로 접속된 콜렉터 영역을 갖는 제1부가 트랜지스터를 구비하며, 상기 제2트랜지스터부는, 상기 제1부가 트랜지스터의 상기 예정된 에미터 면적을 K배한것과 동일한 에미터 영역을 가지며 상기 제1부가 트랜지스터의 에미터 영역에 공통으로 결합되어 있는 에미터 영역과 상기 제1베이스 영역에 공통으로 접속된 베이스 영역 및 상기 제2주 트랜지스터의 상기 제2콜렉터 영역에 공통으로 접속된 콜렉터 영역을 가진 제2부가 트랜지스터를 구비하는 것을 특징으로 하는 중간 주파수 증폭회로.
  4. 제2항에 있어서, 상기 제1내지 n차 증폭기 입력 단자쌍의 각각은 제1 및 제2증폭기 입력 단자로 구성되는 반면 상기 유니트 입력 단자쌍의 각각은 제1 및 제2유니트 입력 단자로 구성되며, 상기 유니트 출력 단자쌍의 각각은 제1 및 제2유니트 출력 단자로 구성하는데, 상기 제1트랜지스터부는, 상기 제1주 트랜지스터의 상기 제1콜렉터 영역에 공통으로 접속된 콜렉터 영역과 상기 제1에미터 영역의 면적과 실제로 동일한 에미터 면적을 갖는 에미터 영역과, 상기 제1증폭기 입력 단자에 공통으로 접속된 베이스 영역을 갖는 다수의 제1보조 트랜지스터를 구비하며,
    상기 제2트랜지스터 부분은,
    상기 제1보조 트랜지스터의 에미터 영역에 결합되고 상기 제2에미터 영역의 면적과 실제로 동일한 에미터 면적을 갖는 에미터 영역과, 상기 제2주 트랜지스터의 제2베이스 영역에 공통으로 접속된 베이스 영역, 상기 제2주 트랜지스터의 제2콜렉터 영역에 공통으로 접속된 콜렉터 영역을 가지고 있으면서 상기 제1보조 트랜지스터의 수와 같은 다수의 제2보조 트랜지스터를 구비하는 것을 특징으로 하는 중간 주파수 증폭회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019870005649A 1986-06-04 1987-06-04 중간 주파수 증폭 회로 KR910001372B1 (ko)

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