KR870005389A - 정보 기억장치 - Google Patents

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KR870005389A
KR870005389A KR860009264A KR860009264A KR870005389A KR 870005389 A KR870005389 A KR 870005389A KR 860009264 A KR860009264 A KR 860009264A KR 860009264 A KR860009264 A KR 860009264A KR 870005389 A KR870005389 A KR 870005389A
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KR
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input
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KR860009264A
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Inventor
더블유·밀러 호머
엘·크라인 스티븐
Original Assignee
루이스 피·엘빈저
허니웰 인포오메이숀 시스템즈 인코오포레이티드
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Publication date
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    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11CSTATIC STORES
    • G11C11/00Digital stores characterised by the use of particular electric or magnetic storage elements; Storage elements therefor
    • G11C11/21Digital stores characterised by the use of particular electric or magnetic storage elements; Storage elements therefor using electric elements
    • G11C11/34Digital stores characterised by the use of particular electric or magnetic storage elements; Storage elements therefor using electric elements using semiconductor devices
    • GPHYSICS
    • G01MEASURING; TESTING
    • G01RMEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
    • G01R31/00Arrangements for testing electric properties; Arrangements for locating electric faults; Arrangements for electrical testing characterised by what is being tested not provided for elsewhere
    • G01R31/28Testing of electronic circuits, e.g. by signal tracer
    • G01R31/317Testing of digital circuits
    • G01R31/3181Functional testing
    • G01R31/3185Reconfiguring for testing, e.g. LSSD, partitioning
    • G01R31/318533Reconfiguring for testing, e.g. LSSD, partitioning using scanning techniques, e.g. LSSD, Boundary Scan, JTAG
    • G01R31/318541Scan latches or cell details

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  • Engineering & Computer Science (AREA)
  • General Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
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  • Tests Of Electronic Circuits (AREA)

Abstract

내용 없음

Description

정보 기억장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 1비트 레지스터의 기능을 갖도록 구성한 본 발명의 블럭도.
제2도는 공통제어로직(logic)을 공유하고 다수의 1비트 레지스터를 결합하여 3비트 레지스터의 기능을 갖도록 구성한 본 발명의 블럭도.
제3도, 즉 제3a도 및 제3b도는 본 발명의 양호한 실시예에 따른 1비트 D형 레지스터의 논리회로도.
* 도면의 주요부분에 대한 부호의 설명
10 : 디멀티플렉서(DEMUX) 20 : 디코더
30 : 2 ×1 멀티플렉서(MUX) 40 : 드라이버
50 : 셀렉터 60 : 4 ×1 데이타 셀렉터
70 : D형 플립플롭(F/F)

Claims (6)

  1. 최소한 두개의 상태를 갖되, 그 제1의 상태를 세트 상태로 규정하고, 그 제2의 상태를 리세트 상태로 규정한 입력 디지탈 데이타 신호중 선택된 디지탈 데이타 신호에 포함되어 있는 정보를 기억하기 위한 장치에 있어서,
    (1) 제1, 제2 및 제3입력단자와 하나의 출력단자를 갖되, 상기 제1 및 제2입력단자는 데이타 입력단자로서, 상기 제1입력단자는 상기 장치가 정상 모드로 동작하는 경우에 작동 디지탈 데이타 신호를 수신하고, 상기 제2입력단자는 상기 장치가 보수 모드로 동작하는 경우에 시프트 된 테스트 데이타 신호를 수신하며, 한편 상기 제3입력단자는 일정한 리세트상태의 신호를 수신하도록 구성하고, 제1 및 제2제어신호에 응답하여 상기 제1, 제2 및 제3입력단자 중 하나의 입력단자를 상기 출력단자에 작동적으로 연결시키기 위한 셀렉터 수단과,
    (2) 상기 셀렉터 수단의 출력단자에 작동적으로 연결된 입력단자와, 상기 장치의 상태를 표시하는 출력단자와, 클럭신호를 수신하기 위한 클럭입력단자 및 리세트 신호를 수신하기 위한 리세트 단자를 갖되, 상기 클럭신호와 일치하여 상기 셀렉터 수단의 선택된 입력단자의 상태를 기억하기 위한 기억수단과,
    (3) 상기 제2제어신호를 수신하기 위한 입력단자를 갖되, 상기 기억수단의 상기 리세트단자와 작동적으로 연결됨과 동시에 상기 셀렉터 수단에 작동적으로 연결되도록 구성하고, 상기 장치가 정상모드로 동작하는 경우에는 상기 제2제어신호를 상기 기억수단에 인가하여, 상기 클럭신호와 비동기적으로 상기 제2제어신호가 발생하는 즉시 상기 장치를 상기 제2상태로 되게하고, 보수 모드시에는 상기 제2제어신호를 상기 셀렉터 수단에 인가하여 상기 셀렉터 수단의 상기 제3입력단자가 상기 셀렉터 수단의 상기 출력단자에 연결되도록 함으로써 상기 클럭신호와 일치하여 상기 장치가 상기 제2상태로 되게 하며, 상기 셀렉터 수단의 입력단자 선택시 상기 제2제어신호가 상기 제1제어신호보다 우선순위를 갖도록 한 스윗칭 수단을 구비하는 것을 특징으로 하는 정보 기억장치.
  2. 제1항에 있어서, 상기 기억 수단의 클럭 입력단자에 작동적으로 연결되는 출력단자와, 테스트 클럭신호를 수신하기 위한 제1입력단자 및 정상 클럭신호를 수신하기 위한 제2입력단자를 갖되, 상기 장치가 보수 모드인 경우에는 상기 테스트 클럭신호를 상기 기억수단의 상기 클럭 입력단자에 인가하고, 상기 장치가 정상모드인 경우에는 상기 정상 클럭신호를 상기 기억수단의 상기 클럭 입력단자에 인정하기 위한 멀티플렉서 수단의 포함하는 것을 특징으로 하는 정보 기억장치.
  3. 제2항에 있어서, 상기 기억수단을 또한 제4입력단자를 갖되, 상기 제4입력 단자는 상기 기억수단의 출력단자에 작동적으로 연결되는 한편 제3제어신호에 응답하여 상기 셀렉터 수단의 출력단자에 연결되도록 한 것을 특징으로 하는 정보 기억장치.
  4. 제3항에 있어서, 입력 제어신호들을 수신하기 위한 다수의 입력단자들을 갖되, 상기 입력단자들 중 하나는 테스트 클럭신호를 수신하기 위해 상기 멀티플렉서에 작동적으로 연결됨과 동시에, 상기 입력 제어신호 중 소정의 입력 제어신호를 상기 셀렉터 수단에 인가하여 상기 기억수단의 입력단자에 작동적으로 연결되는 상기 셀렉터 수단의 소정 입력단자를 선택하기 위해 상기 셀렉터 수단에 작동적으로 연결된 조작수단을 포함하는 것을 특징으로 하는 정보 기억장치.
  5. 최소한 두개의 상태를 갖되, 그 제1의 상태를 세트 상태로 규정하고, 그 제2의 상태를 리세트 상태로 규정한 입력 디지탈 데이타 신호중 선택된 디지탈 데이타 신호에 포함되어 있는 정보를 기억하기 위한 장치에 있어서,
    (1) 제1, 제2 및 제3입력단자와 하나의 출력단자를 갖되, 상기 제1 및 제2입력단자는 데이타 입력단자로서, 상기 제1입력단자는 상기 장치가 정상모드로 동작하는 경우에 작동디지탈 데이타 신호를 수신하고, 상기 제2입력단자는 상기 장치가 보수 모드로 동작하는 경우에 시프트 된 테스트 데이타 신호를 수신하며, 한편 상기 제3입력단자는 일정한 리세트상태의 신호를 수신하도록 구성하고, 다수의 제어신호중 하나의 제어신호에 응답하여 상기 제1 및 제2 및 제3입력단자 중 하나의 입력단자를 상기 출력단자에 작동적으로 연결시키기 위한 셀렉터 수단과,
    (2) 상기 셀렉터 수단의 출력단자 중 최소한 하나에 작동적으로 연결된 입력단자와, 상기 장치의 상태를 표시하는 최소한 하나의 출력단자와, 클럭신호를 수신하기 위한 클럭입력단자 및 리세트 신호를 수신하기 위한 리세트 단자를 갖되, 상기 클럭신호와 일치하여 상기 셀렉터 수단의 선택된 입력단자의 상태를 기억하기 위한 기억수단과,
    (3) 상기 리세트 제어신호를 수신하기 위한 입력단자를 갖되, 상기 기억수단의 상기 리세트 단자와 작동적으로 연결됨과 동시에 상기 셀렉터 수단에 작동적으로 연결되도록 구성하고, 상기 장치가 정상모드로 동작하는 경우에는 상기 리세트 제어신호를 상기 기억수단에 인가하여, 상기 클럭신호와 비동기적으로 상기 리세트 제어신호가 발생하는 즉시 상기 장치를 상기 제2상태로 되게하고, 보수 모드시에는 상기 리세트 제어신호를 상기 셀렉터 수단에 인가하여 상기 셀렉터 수단의 상기 입력단자가 상기 셀렉터 수단의 상기 출력단자에 연결되도록 함으로써 상기 클럭신호와 일치하여 상기 장치가 상기 제2상태로 되게 하며, 상기 셀렉터 수단의 입력단자 선택시 상기 리세트 제어신호가 상기 다수의 제어신호보다 우선순위를 갖도록 한 스윗칭 수단을 구비하는 것을 특징으로 하는 정보 기억장치.
  6. 최소한 두개의 상태를 갖되, 그 제1의 상태를 세트 상태로 규정하고, 그 제2의 상태를 리세트 상태로 규정한 입력 디지탈 데이타 신호중 선택된 디지탈 데이타 신호에 포함되어 있는 정보를 기억하기 위한 장치에 있어서,
    (1) 각각 제1, 제2 및 제3입력단자와 하나의 출력단자를 갖되, 상기 제1 입력단자는 상기 장치가 정상모드로 동파하는 경우 파동 디지탈 데이타 신호를 수신하고, 상기 제2입력단자는 상기 장치가 보수모드로 동파하는 경우에는 시프트 된 테스트 데이타 신호를 수신하며, 한편 상기 제3입력단자는 일정한 리세트 상태의 신호를 수신하도록 구성하고, 제1 및 제2제어신호에 응답하여 상기 제1 및 제2 및 제3입력단자 중 하나의 입력단자를 상기 출력단자에 파동적으로 연결시키기 위한 셀렉터 수단과,
    (2) 상기 다수의 셀렉터 수단중 해당 셀렉터 수단의 출력단자에 작동적으로 연결된 입력단자와, 상기 장치의 상태를 표시하는 출력단자와, 클럭신호를 수신하기 위한 클럭 입력단자 및 리세트 신호를 수신하기 위한 리세트 단자를 각각 갖도록 하되, 상기 클럭신호와 일치하여 상기 셀렉터 수단의 선택된 입력단자의 상태를 기억하기 위한 기억하고, 상기 시프트된 테스트 데이타 신호를 다음의 셀렉터 수단의 제2입력단자로 결합시키기 위한 다수의 기억수단과,
    (3) 상기 제2제어신호를 수신하기 위한 입력단자를 갖되, 상기 각 기억수단의 각 리세트 단자와 작동적으로 연결됨과 동시에 상기 각 셀렉터 수단에 작동적으로 연결되도록 구성하고, 상기 장치가 정상 모드로 동작하는 경우에는 상기 제2제어신호를 상기 각 기억수단에 인가하여, 상기 클럭신호와 비동기적으로 상기 제2제어신호가 발생하는 즉시 상기 장치를 상기 제2상태로 되게하고, 보수 모드시에는 상기 제2제어신호를 상기 각 셀렉터 수단에 인가하여 상기 셀렉터 수단의 상기 제3입력단자가 상기 셀렉터 수단의 상기 출력단자에 연결되도록 함으로써 상기 클럭신호와 일치하여 상기 장치가 상기 제2상태로 되게 하며, 상기 셀렉터 수단의 입력단자 선택시 상기 제2제어신호가 상기 제1제어신호보다 우선순위를 갖도록 한 스윗칭 수단을 구비하는 것을 특징으로 하는 정보 기억장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR860009264A 1985-11-04 1986-11-04 정보 기억장치 KR870005389A (ko)

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US06/795,035 US4649539A (en) 1985-11-04 1985-11-04 Apparatus providing improved diagnosability

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KR870005389A true KR870005389A (ko) 1987-06-08

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