KR20120078628A - 액정 디스플레이 장치의 게이트 라인 구동방법 및 게이트 라인 구동장치 - Google Patents

액정 디스플레이 장치의 게이트 라인 구동방법 및 게이트 라인 구동장치 Download PDF

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Abstract

본 발명의 실시예는 액정 디스플레이 장치의 영역에 관한 것으로서, 픽셀 전압 및 데이터 라인 전압 간의 전압차 ΔＶp의 영향에서 벗어나고, 플리커 현상 및 직류잔류가 초래하는 잔상불량을 효과적으로 제거할 수 있는 액정 디스플레이 장치의 게이트 라인 구동방법 및 게이트 라인 구동장치를 개시한다. 액정 디스플레이 장치의 게이트 라인 구동방법은, 전단 프레임에서, 제N행 게이트 라인이 완전히 턴-오프되는 순간에, 상기 제N 행의 게이트 라인에 보상전압 Ｖgc를 입력하는 단계와, 상기 보상전압 Ｖgc의 입력을 유지하는 단계와, 후단 프레임에 이르러, 상기 제N행 게이트 라인으로 턴-온 전압 Ｖgh가 입력될 때, 상기 제N행 게이트 라인으로 상기 보상전압 Ｖgc의 입력을 정지시키는 단계를 포함하고, 여기에서, N≤게이트 라인 총 행수이다.

Description

액정 디스플레이 장치의 게이트 라인 구동방법 및 게이트 라인 구동장치 {GATE DRIVE METHOD AND GATE DRIVE DEVICE OF LIQUID CRYSTAL DISPLAY}
본 발명은 액정 디스플레이 장치 분야에 관한 것으로서, 특히, 액정 디스플레이 장치의 게이트(gate) 라인 구동방법 및 게이트 라인 구동장치에 관한 것이다.
최근에 들어와서, 액정 디스플레이 장치(Liquid Crystal Display, 약칭으로 LCD) 제품의 발전이 매우 빠르고, 갈수록 고품질의 액정 디스플레이 장치가 점차 출시되고 있으며, 그 응용범위도 끊임없이 확장되고 있다.
액정 디스플레이 장치의 화면표시의 기본원리는 액정을 개재한 두 전극 간에 서로 다른 전압을 인가하여 액정을 일정한 각도로 회전시켜, 광을 투과시키고, 액정 회전각도의 크기가 액정을 투과하는 광량을 결정함으로써, 다른 그레이스케일의 휘도를 표시한다.
액정 디스플레이 장치는 화면을 표시할 때, 액정의 노화를 방지하기 위하여, 일반적으로 극성반전을 이용하고, 극성반전 중에서 극성은 픽셀 전압이 공통전극의 전압보다 높을 때, 정극성이라고 부르고, 픽셀 전압이 공통전극의 전압보다 낮을 때, 부극성이라고 부른다. 기생용량 등의 각종 인자들 때문에, 실제 픽셀 전극 상의 픽셀 전압과 데이터 라인의 전압은 일치하지 않고, ΔＶp의 전압차가 존재하며, ΔＶp의 존재와 정극성 및 부극성의 반전요구 때문에, 공통전극신호 Ｖcom은 정극성과 부극성의 중간에 위치하여야 한다.
통상적으로, 개발 및 양산 단계에서, 플리커(Flicker) 등의 현상에 근거하여, 공통전극신호 Ｖcom을 조정하여, 공통전극신호 Ｖcom이 실제 픽셀 전극의 정극성 및 부극성의 중간에 위치하도록 한 후, 제품에 응용한다. 종래기술은 일반적으로 기생용량을 줄이는 것을 통하여 ΔＶp를 줄이거나, 피드백 회로를 이용하여 공통전극신호 Ｖcom을 조정하고 있으나, 발명자는 종래기술에는 적어도 다음과 같은 문제점이 있음을 발견하였는데, 첫째로, 기생용량의 감소를 통하여 ΔＶp를 줄이는 것은, 충전 및 방전에서 요구에 제한을 받으므로, ΔＶp를 줄이는 것도 한계가 있고, 조정효과도 이상적이 않으며, 둘째로, 피드백 회로를 이용하여 공통전극신호 Ｖcom을 조정하는 것은, 조작자의 시각적 판단이 요구되고, 조정 후의 공통전극신호 Ｖcom을 실제 픽셀 전극의 정극성 및 부극성의 중간이라고 확정할 수 없기 때문에, 두 가지의 조정효과 모두 이상적이지 못하고, 전압차 ΔＶp가 조성하는 플리커 현상 및 직류잔류가 조성하는 잔상불량의 현상을 해결할 수 없다.
본 발명이 해결하고자 하는 과제는 액정 디스플레이 장치의 게이트 라인 구동방법 및 게이트 라인 구동장치를 제공함에 있어서, 픽셀 전압 및 데이터 라인 전압 간의 전압차 ΔＶp의 영향에서 벗어날 수 있고, 플리커 현상 및 직류잔류가 조성하는 잔상불량을 효과적으로 제거한다.
상술한 과제를 해결하기 위하여, 본 발명에 따른 액정 디스플레이 장치의 게이트 라인 구동방법 및 게이트 라인 구동 장치는 아래의 기술 방안을 채용한다. 게이트 라인 구동방법은, 전단 프레임에서 제N행 게이트 라인이 완전히 턴-오프 되는 순간에 상기 제N 행의 게이트 라인에 보상전압 Ｖgc를 입력하는 단계와, 상기 보상전압 Ｖgc의 입력을 유지하는 단계와, 후단 프레임에 이르러 상기 제N행 게이트 라인으로 턴-온 전압 Ｖgh가 입력될 때, 상기 제N행 게이트 라인으로 상기 보상전압 Ｖgc의 입력을 정지시키는 단계를 포함하고, 여기에서, N≤게이트 라인 총 행수이다.
상기 제N행 게이트 라인이 완전히 턴-오프 되는 순간 이전에, 상기 제N행 게이트 라인으로 턴-온 전압 Ｖgh를 입력하여 상기 게이트 라인의 턴-온을 제어하는 단계와, 상기 제N행 게이트 라인으로 턴-오프 전압 Ｖgl을 입력하여 상기 게이트 라인의 턴-오프를 제어하는 단계를 더 포함한다.
상기 액정 디스플레이 장치의 픽셀 구조는 게이트 라인이 스토리지 커패시턴스 Ｃst의 하부전극으로 작용하는 구조이면서, 박막 트랜지스터의 커패시턴스가 Ｃgs이므로, 상기 보상전압은
Figure pat00001
가 된다.
상기 액정 디스플레이 장치의 픽셀 구조는 게이트 라인 및 공통전극 라인이 스토리지 커패시턴스 Ｃst의 하부전극으로 작용하는 구조이면서, 박막 트랜지스터의 커패시턴스가 Ｃgs이므로, 상기 보상전압은
Figure pat00002
가 된다.
액정 디스플레이 장치의 게이트 라인 구동장치는 게이트 라인과 연결되며, 전단 프레임에서 제N행 게이트 라인이 완전히 턴-오프 되는 순간에 상기 제N행 게이트 라인으로 보상전압 Ｖgc를 입력하고, 상기 보상전압 Ｖgc의 입력을 유지하고, 후단 프레임에서 상기 제N행 게이트 라인으로 턴-온 전압 Ｖgh가 입력될 때 상기 제N행 게이트 라인으로 상기 보상전압 Ｖgc의 입력을 정지하는 보상모듈을 포함하고, 여기에서, N≤게이트 라인의 총 행수이다.
상기 액정 디스플레이 장치의 게이트 라인 구동장치는 상기 게이트 라인으로 턴-온 전압 Ｖgh를 입력하여 상기 게이트 라인을 턴-온 상태로 제어하는 턴-온 모듈과, 상기 게이트 라인으로 턴-오프 전압 Ｖgl을 입력하여 상기 게이트 라인을 턴-오프 상태로 제어하는 턴-오프 모듈을 더 포함한다.
상기 액정 디스플레이 장치의 픽셀 구조는 게이트 라인이 스토리지 커패시턴스 Ｃst의 하부전극으로 작용하는 구조이면서, 박막 트랜지스터의 커패시턴스가 Ｃgs이므로, 상기 보상전압은
Figure pat00003
가 된다.
상기 액정 디스플레이 장치의 픽셀 구조는 게이트 라인 및 공통전극 라인이 스토리지 커패시턴스 Ｃst의 하부전극으로 작용하는 구조이면서, 박막 트랜지스터의 커패시턴스가 Ｃgs이므로, 상기 보상전압은
Figure pat00004
가 된다.
본 발명에 있어서, 각 게이트 라인이 완전히 턴-오프 되는 순간부터 후단 프레임에서 상기 게이트 라인이 턴-온 될 때까지, 상기 게이트 라인을 일정한 보상전압 Ｖgc로 보상하여, 기생용량 등의 각종 인자가 초래하는 픽셀 전극 상의 픽셀 전압 및 데이터 라인 신호 간의 전압차 ΔＶp를 상쇄시킴으로써, 전압차 ΔＶp의 영향에서 벗어나고, 전압차 ΔＶp가 초래하는 플리커 현상 및 직류잔류가 초래하는 잔상불량을 효과적으로 제거한다.
본 발명의 실시예 또는 종래기술 중의 기술방안을 명확하게 설명하기 위하여, 하기는 실시예 또는 종래기술에 대한 설명 중 사용된 도면을 간단하게 소개하며, 명백하게, 하기 설명 중의 도면은 단지 본 발명의 일 실시예 일 뿐, 본 영역의 당업자에게 있어서는, 창조적 노동을 하지 않는다고 전제하더라도, 상기의 도면을 근거로 기타의 도면을 획득할 수 있다.
도 1은 본 발명의 일 실시예에 따른 액정 디스플레이 장치의 게이트 라인 구동방법을 도시한 제1 공정도이고,
도 2는 본 발명의 다른 실시예에 따른 액정 디스플레이 장치의 게이트 라인 구동방법을 도시한 제2 공정도이고,
도 3은 본 발명의 실시예에 따른 액정 디스플레이 장치의 구동방법의 원리를 도시한 개략도이고,
도 4는 본 발명의 실시예에 따른 액정 디스플레이 장치의 픽셀 구조를 도시한 개략도이고,
도 5는 본 발명의 실시예에 따른 액정 디스플레이 장치의 게이트 라인 구동 방법 중 보상전압을 획득하는 원리를 도시한 개략도이고,
도 6은 본 발명의 실시예에 따른 액정 디스플레이 장치의 게이트 구동장치의 구조를 도시한 개략도이다.
<도면의 주요 부분에 대한 부호의 설명>
1 : 게이트 라인 2 : 데이터 라인 3 : 픽셀 유닛
22: 턴-온 모듈 33: 턴-오프 모듈
하기에는 본 발명 실시예의 도면을 결합하여, 본 발명 실시예의 기술방안에 대한 명확하고 완성된 설명을 진행하고, 명백하게, 설명된 실시예는 단지 본 발명 실시예 중의 일부분일 뿐, 전체 실시예가 되지 않는다. 본 발명의 실시예에 기초하여, 본 영역의 당업자가 창조적 행위를 하지 않았다고 전제하더라도 획득할 수 있는 모든 기타 실시예는 본 발명의 보호 범위에 포함된다.
본 발명의 실시예가 제공하는 액정 디스플레이 장치의 게이트 라인 구동방법 및 게이트 라인 구동장치는, 픽셀 전압 및 데이터 라인 전압 간의 전압차 ΔＶp의 영향에서 벗어나고, 플리커 현상 및 직류잔류가 초래하는 잔상불량을 효과적으로 제거한다.
기생용량 등의 각종 인자가 존재하기 때문에, 실제 픽셀전극 상의 픽셀 전압 및 데이터 라인 전압은 불일치하여, 전압차 ΔＶp가 존재하고, 전압차 ΔＶp의 영향에서 벗어나고, 플리커 현상 및 직류잔류가 초래하는 잔상불량을 효과적으로 제거하기 위하여, 도 1에 도시된 바와 같이, 본 발명의 실시예는 액정 디스플레이 장치의 게이트 라인 구동방법을 제공하고, 상기 구동방법은, 전단 프레임에서 제N행 게이트 라인이 완전히 턴-오프 되는 순간에 상기 제N행 게이트 라인에 보상전압 Ｖgc를 입력하는 제1-1단계(101), 상기 보상전압 Ｖgc의 입력을 유지하는 제1-2단계(102), 및 후단 프레임에 이르러 상기 제N행 게이트 라인으로 턴-온 전압 Ｖgh가 입력될 때 상기 제N행 게이트 라인에 상기 보상전압 Ｖgc을 입력하는 것을 정지시키는 제1-3단계(103)를 포함하고, 여기에서, N≤게이트 라인 총 행수이다.
본 발명의 실시예가 제공하는 액정 디스플레이 장치의 게이트 라인 구동방법에 있어서, 각 게이트 라인이 완전히 턴-오프 되는 순간부터 후단 프레임에서 상기 게이트 라인이 턴-온 될 때까지, 상기 게이트 라인을 일정한 보상전압 Ｖgc으로 보상하여, 기생용량 등의 각종 인자가 초래하는 픽셀전극 상의 픽셀전압 및 데이터 라인 전압간의 전압차 ΔＶp를 상쇄시키고, 이로써 전압차 ΔＶp의 영향에서 벗어나고, 전압차 ΔＶp가 초래하는 플리커 현상 및 직류잔류가 초래하는 잔상불량을 효과적으로 제거한다.
본 발명의 실시예에 있어서, 우선적으로, 하기의 방법을 통하여 본 발명의 기술방안을 구체적으로 설명한다.
도 2에 도시된 바와 같이, 상기 방법은 다음의 단계를 포함한다.
제2-1단계(201)로서, 전단 프레임에서, 제N행 게이트 라인으로 턴-온 전압 Ｖgh를 입력하여 상기 게이트 라인을 턴-온 상태로 제어하는데, 각 프레임 화면에 있어서, 게이트 라인 구동장치의 제어하에 게이트 라인을 순차적으로 턴-온 시키는데, 상기 각 행의 게이트 라인에 대해, 게이트 구동장치는 게이트 라인으로 턴-온 전압 Ｖgh를 입력하여, 상기 게이트 라인을 턴-온 제어하고, 게이트 라인이 턴-온 상태가 된 후, 상기 게이트 라인과 대응하는 픽셀 유닛에 화상 데이터가 입력되고, 도 3에 도시된 바와 같이, 게이트 라인은 Ｔa의 순간에 턴-온 된다.
제2-2단계(202)로서, 제N행 게이트 라인으로 턴-오프 전압 Ｖgl을 입력하여, 상기 게이트 라인을 턴-오프 상태로 제어하는데, 도 3에 도시된 바와 같이, 게이트 라인은 Ｔb의 순간부터 턴-오프 되기 시작한다.
제2-3단계(203)로서, 제N행 게이트 라인이 완전히 턴-오프 상태가 된 순간에, 상기 제N행 게이트 라인으로 보상전압 Ｖgc를 입력하고, 다음 프레임에서 상기 제N행 게이트 라인으로 턴-온 전압 Ｖgh가 입력될 때까지 지속적으로 유지한다.
도 3에 도시된 바와 같이, 게이트 라인은 Ｔc의 순간에 완전히 턴-오프 상태가 되고, 이때, 게이트 라인으로 보상전압 Ｖgc가 입력되고, 후단 프레임에서 상기 게이트 라인으로 턴-온 전압 Ｖgh가 입력될 때까지 지속적으로 보상전압 Ｖgc를 입력한다.
보상전압 Ｖgc는 다양한 방법으로 얻을 수 있는데, 우선적으로, 순차적 제어신호가 게이트 라인을 제어하여 턴-온으로부터 턴-오프로 전환되는 순간에, IC가 보상전압 Ｖgc를 발생시키도록 설계하여, 이를 상기 게이트 라인이 후단 프레임에서 턴-온 상태가 되는 시점까지 지속적으로 유지한다.
액정 디스플레이 장치의 픽셀 구조로서 게이트 라인 상에 스토리지 캐퍼시턴스(Ｃst on Gate)를 형성하는 방식의 구조를 이용하는데, 게이트 라인이 스토리지 캐퍼시턴스 Ｃst의 하부전극으로 작용하는 구조는 예를 들어, 도 4에 도시된 바와 같이, 액정 디스플레이 장치의 픽셀구조는 게이트 라인(1) 및 데이터 라인(2)이 교차하여 한정하는 다수개의 픽셀 유닛(3)을 구성하고, Ｃgs는 박막 트랜지스터의 커패시턴스가 되고, Ｃst는 스토리지 커패시턴스가 된다. 다시 말해, 보상전압의 수치는
Figure pat00005
이다.
구체적인 원리 및 실현방법은 다음과 같다.
도 5는 제N행 및 제N＋1행 게이트 라인 상의 게이트 라인 신호를 도시한 개략도로서, 도 5에 도시된 바와 같이, Ｔ1 기간 동안, 제N＋1행 게이트 라인 상의 픽셀 박막 트랜지스터가 턴-온 되여, 그 픽셀 박막 트랜지스터의 턴-온 이전의 커플링 전압이 데이터 라인에 의해 입력되는 전압으로 다시 설정되도록 하고, 이 때 픽셀 전압은 데이터 라인의 전압과 같게 된다.
Ｔ2 기간 동안, 제N＋1행 게이트 라인에 대응되는 픽셀의 게이트 라인 신호에서 전압변화는
Figure pat00006
이고, 박막 트랜지스터의 커패시턴스 Ｃgs를 통하여 픽셀 전압의 변화 ΔＶ1을 초래하므로,
Figure pat00007
이며,
여기에서, Ｃlc는 픽셀 커패시턴스이다.
Ｔ3 기간 동안, 제N행 게이트 라인의 전압변화는 ＋Ｖgc이고, 스토리지 커패시턴스 Ｃst를 통하여, 제N＋1행 게이트 라인이 대응하는 픽셀의 픽셀 전압의 변화 ΔＶ2를 초래하고,
Figure pat00008
이다.
Ｔ4 기간 동안, 제N＋1행 게이트 라인이 대응하는 픽셀의 게이트 라인 신호에서 전압변화는 ＋Ｖgc이고, 박막 트랜지스터 커패시턴스 Ｃgs를 통하여, 픽셀 전압의 변화 ΔＶ3를 초래하고,
Figure pat00009
이므로,
Ｔ4 기간 후에, 픽셀 전압 Ｖpixel은,
Figure pat00010
이고,
Figure pat00011
가 0이 되면, 박막 트랜지스터가 턴-온 될 때 입력되는 픽셀 전압Ｖpixel은 Ｖdata와 같게 되는데, Ｔ1, Ｔ2, Ｔ3, Ｔ4의 기간을 거쳐 일련의 커패시턴스의 커플링 효과 후에, 픽셀 전압 Ｖpixel은 데이터 라인 전압 Ｖdata로 회귀하게 되고, 상술한 3개의 공식에 대입한 후, 커패시턴스의 커플링 변화가 0이 되도록 조건을 설계하면,
Figure pat00012
이다.
따라서, 보상전압 Ｖgc의 크기를 조절하면 커패시턴스의 커플링이 초래하는 전압변화의 영향을 제거할 수 있고, 게이트 라인의 커패시턴스의 커플링 효과를 완전히 보상하여, 기생용량 등의 각종 인자들이 초래하는 픽셀 전극 상의 픽셀 전압 및 데이터 라인 신호 사이의 전압차 ΔＶp를 상쇄시킴으로써, 전압차 ΔＶp의 영향에서 벗어나고, 전압차 ΔＶp가 초래하는 플리커 현상 및 직류잔류가 초래하는 잔상불량을 효과적으로 제거할 수 있다.
상술한 방법은 액정 디스플레이 장치의 픽셀 구조가 게이트 라인 및 공통전극 라인 상에 동시에 스토리지 커패시턴스를 형성하는 방식(Ｃst on Gate＋Common)의 구조에 있어서도, 동일하게 활용되며, 보상전압의 수치는
Figure pat00013
가 되고, 동일하게, 보상전압 Ｖgc의 크기 조절을 통하여 커패시턴스 커플링이 초래하는 전압변화의 영향을 제거하고, 게이트 라인의 커패시턴스의 커플링 효과를 완전하게 보상하며, 여기에서 다시 반복설명하지 않는다.
본 발명의 실시예는 상기 액정 디스플레이 장치의 게이트 라인 구동방법을 응용한 게이트 라인 구동장치를 제공하는데, 도 6에 도시된 바와 같이, 상기 장치는 보상모듈(11)을 포함하는데, 상기 보상모듈(11)은 전단 프레임에서 제N행 게이트 라인이 완전히 턴-오프되는 순간에, 상기 제N행 게이트 라인에 보상전압 Ｖgc를 입력하고, 상기 보상전압 Ｖgc의 입력을 다음 프레임까지 유지하고, 상기 제N행 게이트 라인으로 턴-온 전압 Ｖgh가 입력될 때, 상기 제N행 게이트 라인으로 보상전압 Ｖgc를 입력하는 것을 정지시키며, 여기에서, N≤게이트 라인의 총 행수이다. 보상모듈(11) 및 게이트 라인은 서로 연결되며, 그 기능은 타이밍 컨트롤러를 통해 실현된다.
상기 게이트 라인 구동장치는 턴-온 모듈(22) 및 턴-오프 모듈(33)을 더 포함한다.
턴-온 모듈(22)은 상기 제N행 게이트 라인에 턴-온 전압 Ｖgh을 입력하여, 상기 게이트 라인을 턴-온으로 제어하고, 턴-오프 모듈(33)은 상기 제N행 게이트 라인에 턴-오프 전압 Ｖgl을 입력하여, 상기 게이트 라인을 턴-오프로 제어한다.
본 실시예에 따라 상기 액정 디스플레이 장치의 픽셀 구조가 게이트 라인을 스토리지 커패시턴스 Ｃst의 하부전극 작용시키는 구조이면서, 박막 트랜지스터의 커패시턴스가 Ｃgs이면, 상기 보상전압
Figure pat00014
가 된다. 선택적으로, 다른 실시예에 따라 액정 디스플레이 장치의 픽셀 구조가 게이트 라인 및 공통전극 라인을 동시에 스토리지 캐퍼시턴스 Ｃst의 하부전극으로 작용시키는 구조이면서, 박막 트랜지스터 커패시턴스가 Ｃgs이면, 상기 보상전압
Figure pat00015
가 된다.
본 실시예에 따른 액정 디스플레이 장치의 게이트 라인 구동장치를 이용하는 방법과 전술한 다른 실시예에 따른 상기 게이트 구동장치를 이용하는 방법은 완전히 동일하므로, 여기에서 다시 반복설명하지 않는다.
본 발명의 실시예에 있어서, 각 게이트 라인은 완전히 턴-오프 되는 순간부터 후단 프레임에서 상기 게이트 라인이 턴-온 상태가 될 때까지, 보상모듈은 상기 게이트 라인에 일정한 보상전압 Ｖgc를 보상하여, 기생용량 등 각종 인자가 초래하는 픽셀 전극 상의 픽셀 전압 및 데이터 라인 신호 사이의 전압차 ΔＶp를 상쇄시킴으로써, 전압차 ΔＶp의 영향에서 벗어나고, 플리커 현상 및 직류잔류가 초래하는 잔상불량을 효과적으로 제거한다.
이상의 실시방식의 설명을 통하여, 해당 영역의 당업자가 본 발명을 명백하게 이해하고, 통상적으로 필요한 하드웨어를 결합한 소프트웨어의 방식을 빌려 실현할 수 있고, 당연히 하드웨어의 방식을 통해서도 실현할 수 있으며, 그러나 다양한 상황하에서 전자가 더욱 바람직한 실시 방식이다. 이러한 이해에 근거하여, 본 발명의 기술방안은 전체로부터 또는 종래기술로부터 도출한 개량한 부분으로부터 소프트웨어 제품의 형식으로 구체화될 수 있고, 상기 컴퓨터 소프트웨어 제품은 컴퓨터의 소프트 디스크, 하드 디스크, 광 디스크와 같은 컴퓨터의 인출할 수 있는 저장 매체에 저장할 수 있으며, 컴퓨터 장치(퍼스날 컴퓨터, 서버 또는 네트워크 장치 등)가 본 발명의 다양한 실시예에 기재된 방법들을 실시하도록 하는 지시를 포함할 수 있다.
이상의 설명은 단지 본 발명의 구체적 실시 방법일 뿐, 본 발명의 보호 범위는 여기에 국한되지 않고, 당업자가 본 발명이 개시하는 기술범위 내에 있어서 용이하게 유추할 수 있는 변화 또는 치환까지 모두 본 발명의 보호 범위 내로 포함해야 한다. 따라서, 본 발명의 보호범위는 상기 특허청구범위를 기준으로 삼는다.

Claims (8)

  1. 전단 프레임에서, 제N행 게이트 라인이 완전히 턴-오프 되는 순간에, 상기 제N 행의 게이트 라인에 보상전압 Ｖgc를 입력하는 단계와,
    상기 보상전압 Ｖgc의 입력을 유지하는 단계와,
    후단 프레임에 이르러, 상기 제N행 게이트 라인으로 턴-온 전압 Ｖgh가 입력될 때, 상기 제N행 게이트 라인으로 상기 보상전압 Ｖgc의 입력을 정지시키는 단계
    를 포함하고,
    상기 N≤게이트 라인 총 행수인 액정 디스플레이 장치의 게이트 라인 구동방법.
  2. 제1항에 있어서,
    상기 제N행 게이트 라인이 완전히 턴-오프 되는 순간 이전에,
    상기 제N행 게이트 라인으로 턴-온 전압 Ｖgh를 입력하여 상기 게이트 라인을 턴-온 제어하는 단계와,
    상기 제N행 게이트 라인으로 턴-오프 전압 Ｖgl을 입력하여 상기 게이트 라인을 턴-오프 제어하는 단계
    를 더 포함하는 액정 디스플레이 장치의 게이트 라인 구동방법.
  3. 제2항에 있어서,
    상기 액정 디스플레이 장치의 픽셀 구조는 게이트 라인이 스토리지 커패시턴스 Ｃst의 하부전극으로 작용하는 구조이고, 박막 트랜지스터의 커패시턴스가 Ｃgs이며, 상기 보상전압은
    Figure pat00016
    가 되는 액정 디스플레이 장치의 게이트 라인 구동방법.
  4. 제2항에 있어서,
    상기 액정 디스플레이 장치의 픽셀 구조는 게이트 라인 및 공통전극 라인이 스토리지 커패시턴스 Ｃst의 하부전극으로 작용하는 구조이고, 박막 트랜지스터의 커패시턴스가 Ｃgs이며, 상기 보상전압은
    Figure pat00017
    가 되는 액정 디스플레이 장치의 게이트 라인 구동방법.
  5. 게이트 라인과 연결되며, 전단 프레임에서 제N행 게이트 라인이 완전히 턴-오프 되는 순간에 상기 제N행 게이트 라인으로 보상전압 Ｖgc를 입력하고, 상기 보상전압 Ｖgc의 입력을 유지하여, 후단 프레임에서 상기 제N행 게이트 라인으로 턴-온 전압 Ｖgh가 입력될 때 상기 제N행 게이트 라인으로 상기 보상전압 Ｖgc의 입력을 정지하는 보상모듈을 포함하며, 상기 N≤게이트 라인의 총 행수인 액정 디스플레이 장치의 게이트 라인 구동장치.
  6. 제5항에 있어서,
    상기 게이트 라인으로 턴-온 전압 Ｖgh를 입력하여 상기 게이트 라인을 턴-온 제어하는 턴-온 모듈과,
    상기 게이트 라인으로 턴-오프 전압 Ｖgl을 입력하여 상기 게이트 라인을 턴-오프 제어하는 턴-오프 모듈
    을 더 포함하는 액정 디스플레이 장치의 게이트 라인 구동장치.
  7. 제6항에 있어서,
    상기 액정 디스플레이 장치의 픽셀 구조는 게이트 라인이 스토리지 커패시턴스 Ｃst의 하부전극으로 작용하는 구조이고, 박막 트랜지스터의 커패시턴스가 Ｃgs이며, 상기 보상전압은
    Figure pat00018
    가 되는 액정 디스플레이 장치의 게이트 라인 구동장치.
  8. 제6항에 있어서,
    상기 액정 디스플레이 장치의 픽셀 구조는 게이트 라인 및 공통전극 라인이 스토리지 커패시턴스 Ｃst의 하부전극으로 작용하는 구조이고, 박막 트랜지스터의 커패시턴스가 Ｃgs이며, 상기 보상전압은
    Figure pat00019
    가 되는 액정 디스플레이 장치의 게이트 라인 구동장치.
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