KR20100122212A - 반도체 메모리 테스트 보드, 이를 포함하는 반도체 메모리 테스트 시스템 및 반도체 메모리 테스트 방법 - Google Patents
반도체 메모리 테스트 보드, 이를 포함하는 반도체 메모리 테스트 시스템 및 반도체 메모리 테스트 방법 Download PDFInfo
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- G01R31/28—Testing of electronic circuits, e.g. by signal tracer
- G01R31/317—Testing of digital circuits
- G01R31/3181—Functional testing
- G01R31/319—Tester hardware, i.e. output processing circuits
- G01R31/31903—Tester hardware, i.e. output processing circuits tester configuration
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- G01R31/31917—Stimuli generation or application of test patterns to the device under test [DUT]
Abstract
Description
Claims (7)
- 제1 테스트 데이터 및 상기 제1 테스트 데이터에 상응하는 기대 예상 데이터를 생성하고, 피시험 메모리 장치에서 데이터 기입 동작 또는 데이터 독출 동작이 수행되도록 상기 피시험 메모리 장치에 명령 신호, 제1 데이터 스트로브 신호 및 제어 신호를 제공하는 제어부;상기 제어부로부터 인가된 상기 제1 테스트 데이터에 기초하여 상기 피시험 메모리 장치에 기입 데이터를 제공하고, 상기 피시험 메모리 장치로부터 인가된 독출 데이터에 기초하여 제2 테스트 데이터를 생성하는 드라이버부; 및상기 피시험 메모리 장치로부터 제2 데이터 스트로브 신호를 수신하고, 상기 제2 데이터 스트로브 신호에 응답하여 상기 기대 예상 데이터와 상기 제2 테스트 데이터를 동기화시키고, 동기화된 상기 기대 예상 데이터와 상기 제2 테스트 데이터를 비교하여 상기 피시험 메모리 장치의 정상 동작 여부를 판정하는 판정부를 포함하는 반도체 메모리 테스트 보드.
- 제1항에 있어서,상기 제어부는 상기 판정부에 판정 스트로브 신호를 제공하고,상기 판정부는, 제1 모드가 선택될 때 상기 판정 스트로브 신호에 응답하여 상기 기대 예상 데이터와 상기 제2 테스트 데이터를 동기화시키고, 제2 모드가 선택될 때 상기 제2 데이터 스트로브 신호에 응답하여 상기 기대 예상 데이터와 상기 제2 테스트 데이터를 동기화시키는 것을 특징으로 하는 반도체 메모리 테스트 보드.
- 제1항에 있어서, 상기 제어부는,상기 명령 신호, 상기 제1 데이터 스트로브 신호, 상기 제1 테스트 데이터 및 상기 기대 예상 데이터를 생성하는 메모리 컨트롤러; 및상기 제어 신호를 생성하는 타이밍 생성부를 포함하는 것을 특징으로 하는 반도체 메모리 테스트 보드.
- 제1항에 있어서, 상기 제어부 및 상기 판정부는 각각 필드 프로그래머블 게이트 어레이(field-programmable gate array, FPGA)로 구현된 것을 특징으로 하는 반도체 메모리 테스트 보드.
- 반도체 메모리 테스트 시스템을 제어하고 작동시키는 컨트롤 컴퓨터;피시험 메모리 장치의 정상 동작 여부를 판정하는 메모리 테스트 보드; 및상기 컨트롤 컴퓨터와 상기 메모리 테스트 보드를 연결하는 버스 인터페이스를 포함하며, 상기 메모리 테스트 보드는,제1 테스트 데이터 및 상기 제1 테스트 데이터에 상응하는 기대 예상 데이터를 생성하고, 상기 피시험 메모리 장치에서 데이터 기입 또는 데이터 독출 동작이 수행되도록 상기 피시험 메모리 장치에 명령 신호, 제1 데이터 스트로브 신호 및 제어 신호를 제공하는 제어부;상기 제어부로부터 인가된 상기 제1 테스트 데이터에 기초하여 상기 피시험 메모리 장치에 기입 데이터를 제공하고, 상기 피시험 메모리 장치로부터 인가된 독출 데이터에 기초하여 제2 테스트 데이터를 생성하는 드라이버부; 및상기 피시험 메모리 장치로부터 제2 데이터 스트로브 신호를 수신하고, 상기 제2 데이터 스트로브 신호에 응답하여 상기 기대 예상 데이터와 상기 제2 테스트 데이터를 동기화시키고, 상기 동기화된 기대 예상 데이터와 상기 제2 테스트 데이터를 비교하여 상기 피시험 메모리 장치의 정상 동작 여부를 판정하는 판정부를 포함하는 반도체 메모리 테스트 시스템.
- 제5항에 있어서,상기 제어부는 상기 판정부에 판정 스트로브 신호를 제공하고,상기 판정부는, 제1 모드가 선택될 때 상기 판정 스트로브 신호에 응답하여 상기 기대 예상 데이터와 상기 제2 테스트 데이터를 동기화시키고, 제2 모드가 선택될 때 상기 제2 데이터 스트로브 신호에 응답하여 상기 기대 예상 데이터와 상기 제2 테스트 데이터를 동기화시키는 것을 특징으로 하는 반도체 메모리 테스트 시스템.
- 피시험 메모리 장치에 제1 테스트 데이터가 기입되는 단계;상기 피시험 메모리 장치로부터 제2 테스트 데이터가 독출되는 단계;상기 피시험 메모리 장치로부터 제공되는 데이터 스트로브 신호에 응답하여 상기 제2 테스트 데이터와 상기 제1 테스트 데이터에 상응하는 기대 예상 데이터를 동기화시키는 단계; 및동기화된 상기 기대 예상 데이터와 상기 제2 테스트 데이터를 비교하여 상기 피시험 메모리 장치의 정상 동작 여부를 판정하는 단계를 포함하는 반도체 메모리 테스트 방법.
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