KR20080084759A - 빌드인 패키지 캐비티를 갖는 이미지 센서 모듈 및 그 방법 - Google Patents
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- 238000000034 method Methods 0.000 title claims abstract description 31
- 239000000758 substrate Substances 0.000 claims abstract description 63
- 229910000679 solder Inorganic materials 0.000 claims abstract description 30
- 239000000463 material Substances 0.000 claims abstract description 27
- 239000002184 metal Substances 0.000 claims description 24
- 229910052751 metal Inorganic materials 0.000 claims description 24
- 238000007639 printing Methods 0.000 claims description 4
- 238000004140 cleaning Methods 0.000 claims description 3
- 230000001681 protective effect Effects 0.000 claims description 3
- 238000005476 soldering Methods 0.000 claims description 3
- 230000004907 flux Effects 0.000 claims description 2
- 239000002245 particle Substances 0.000 abstract description 7
- 238000004891 communication Methods 0.000 abstract description 4
- 239000010410 layer Substances 0.000 description 38
- 239000011241 protective layer Substances 0.000 description 18
- 235000012431 wafers Nutrition 0.000 description 18
- 230000008569 process Effects 0.000 description 17
- 238000005516 engineering process Methods 0.000 description 12
- 229910052710 silicon Inorganic materials 0.000 description 10
- 239000010703 silicon Substances 0.000 description 10
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 8
- 229910045601 alloy Inorganic materials 0.000 description 6
- 239000000956 alloy Substances 0.000 description 6
- 238000011109 contamination Methods 0.000 description 6
- 239000011521 glass Substances 0.000 description 6
- 238000004806 packaging method and process Methods 0.000 description 6
- 239000004065 semiconductor Substances 0.000 description 5
- 239000004593 Epoxy Substances 0.000 description 4
- 229910052742 iron Inorganic materials 0.000 description 4
- 238000004519 manufacturing process Methods 0.000 description 4
- 229920000642 polymer Polymers 0.000 description 4
- 238000012545 processing Methods 0.000 description 4
- 229910001020 Au alloy Inorganic materials 0.000 description 3
- 239000004642 Polyimide Substances 0.000 description 3
- UMIVXZPTRXBADB-UHFFFAOYSA-N benzocyclobutene Chemical compound C1=CC=C2CCC2=C1 UMIVXZPTRXBADB-UHFFFAOYSA-N 0.000 description 3
- 230000015572 biosynthetic process Effects 0.000 description 3
- 239000000919 ceramic Substances 0.000 description 3
- 238000011161 development Methods 0.000 description 3
- 238000009826 distribution Methods 0.000 description 3
- 239000003921 oil Substances 0.000 description 3
- 229920001721 polyimide Polymers 0.000 description 3
- 230000002940 repellent Effects 0.000 description 3
- 239000005871 repellent Substances 0.000 description 3
- 238000012360 testing method Methods 0.000 description 3
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 3
- JYEUMXHLPRZUAT-UHFFFAOYSA-N 1,2,3-triazine Chemical compound C1=CN=NN=C1 JYEUMXHLPRZUAT-UHFFFAOYSA-N 0.000 description 2
- XQUPVDVFXZDTLT-UHFFFAOYSA-N 1-[4-[[4-(2,5-dioxopyrrol-1-yl)phenyl]methyl]phenyl]pyrrole-2,5-dione Chemical compound O=C1C=CC(=O)N1C(C=C1)=CC=C1CC1=CC=C(N2C(C=CC2=O)=O)C=C1 XQUPVDVFXZDTLT-UHFFFAOYSA-N 0.000 description 2
- 229910018072 Al 2 O 3 Inorganic materials 0.000 description 2
- 229910000881 Cu alloy Inorganic materials 0.000 description 2
- 229910000990 Ni alloy Inorganic materials 0.000 description 2
- 229910004298 SiO 2 Inorganic materials 0.000 description 2
- 229910052802 copper Inorganic materials 0.000 description 2
- 230000001351 cycling effect Effects 0.000 description 2
- 239000003989 dielectric material Substances 0.000 description 2
- KPUWHANPEXNPJT-UHFFFAOYSA-N disiloxane Chemical class [SiH3]O[SiH3] KPUWHANPEXNPJT-UHFFFAOYSA-N 0.000 description 2
- 238000009713 electroplating Methods 0.000 description 2
- 229910000833 kovar Inorganic materials 0.000 description 2
- 238000001459 lithography Methods 0.000 description 2
- 229910052759 nickel Inorganic materials 0.000 description 2
- 230000003287 optical effect Effects 0.000 description 2
- 229920003192 poly(bis maleimide) Polymers 0.000 description 2
- 229920005989 resin Polymers 0.000 description 2
- 239000011347 resin Substances 0.000 description 2
- 150000003376 silicon Chemical class 0.000 description 2
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N silicon dioxide Inorganic materials O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 2
- 229910052581 Si3N4 Inorganic materials 0.000 description 1
- 229910001069 Ti alloy Inorganic materials 0.000 description 1
- 239000000853 adhesive Substances 0.000 description 1
- 230000001070 adhesive effect Effects 0.000 description 1
- 230000004075 alteration Effects 0.000 description 1
- 238000004458 analytical method Methods 0.000 description 1
- 238000003491 array Methods 0.000 description 1
- 239000002131 composite material Substances 0.000 description 1
- 150000001875 compounds Chemical class 0.000 description 1
- 238000000151 deposition Methods 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 239000013013 elastic material Substances 0.000 description 1
- 230000009477 glass transition Effects 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 230000017525 heat dissipation Effects 0.000 description 1
- 238000005304 joining Methods 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 238000012858 packaging process Methods 0.000 description 1
- 238000012536 packaging technology Methods 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
- 238000000206 photolithography Methods 0.000 description 1
- 239000004033 plastic Substances 0.000 description 1
- 239000010453 quartz Substances 0.000 description 1
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 1
- 229910052814 silicon oxide Inorganic materials 0.000 description 1
- 238000004544 sputter deposition Methods 0.000 description 1
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- H01L2224/051—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
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- H01L2224/0554—External layer
- H01L2224/05599—Material
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Abstract
본 발명은 빌드인 패키지 캐비티를 갖는 이미지 센서 모듈 및 그 방법을 제공한다. 이미지 센서 모듈 구조는 상부 표면 내에 형성된 패키지 수용 캐비티 및 내부에 형성된 전도성 트레이스들을 갖는 기판, 및 상기 패키지 수용 캐비티 내에 배치된 마이크로 렌즈를 갖는 다이를 구비하는 패키지를 포함한다. 유전체층은 패키지 및 기판 상에 형성되며, 재배선 전도층(RDL)은 유전체층 상에 형성되며, 여기서 RDL은 다이 및 전도성 트레이스들에 결합되며, 유전체층은 마이크로 렌즈를 노출시킬 오프닝을 구비한다. 렌즈 홀더는 기판 상에 부착되며 그 윗부분에 부착된 렌즈를 구비한다. 필터는 렌즈 및 마이크로 렌즈 사이에 부착된다. 이 구조는 렌즈 홀더 내의 기판의 상부 표면 상에 패시브 디바이스를 더 포함한다.
Description
본 발명은 이미지 센서의 구조에 관련되며, 더 상세하게는 빌드인(build-in) 패키지 캐비티를 갖는 이미지 센서 모듈 및 그 방법에 관련된다.
디지털 비디오 카메라들은 가전제품으로써 용이하게 되도록 개발되고 있다. 반도체 기술의 급속한 발전으로 인하여 이미지 센서 어플리케이션은 디지털 스틸 카메라 또는 무비 카메라에 대하여 널리 사용된다. 소비자의 요구는 가벼운 무게, 다기능 및 고해상도를 향해 왔다. 이러한 요구를 충족시키기 위해서 카메라를 제조하는 기술적 수준들이 향상되어 왔다. CCD 또는 CMOS 칩은 이미지를 캡쳐하기 위해 이들 카메라에 일반적인 장치이며 전도성 접착제에 의하여 다이 본딩되어 있다. 전형적으로, CCD 또는 CMOS의 전극 패드는 금속 전선에 의하여 와이어 본딩되어 있다. 와이어 본딩(wire bonding)은 센서 모듈의 크기를 제한한다. 이 장치는 전통적인 수지 패키징 방법에 의해 형성된다.
통상적으로 사용된 종래의 이미지 센서 장치는 웨이퍼 기판의 표면 상에 형성된 포토다이오드들의 어레이(array)를 갖는다. 이러한 포토 어레이들을 형성하는 방법들은 본 기술 분야에서 통상의 지식을 가진 자들에게 잘 알려져 있다. 전형적으로, 웨이퍼 기판은 평평한 서포트 구조에 마운트되며 복수의 전기 접점들과 전기적으로 연결된다. 기판은 와이어들을 이용하는 서포트 구조의 본드 패드들에 전기적으로 연결된다. 이후 이 구조는 빛이 포토다이오드의 어레이 상에 부딪히도록 하는 광투과성 표면을 가진 패키지로 둘러싸인다. 비교적 적은 왜곡 또는 적은 색수차(chromatic aberration)를 갖는 평면영상(flat image)을 생성하도록 하기 위해서는 평면(flat) 광학면(optical plane)을 생성하도록 배열되는 복수의 렌즈들을 채용하는 것이 요구된다. 이것은 많은 값비싼 광학적 요소들을 요구할 수 있다.
나아가 반도체 디바이스 분야에 있어서, 계속적으로 디바이스 밀도는 증가되고 디바이스 크기는 감소되고 있다. 이러한 고밀도 디바이스들에서 패키징 또는 상호접속(interconnecting) 기술들에 대한 요구는 상기한 상황에 맞추기 위해 또한 증가되고 있다.
종래에는, 플립칩 부착 방법에 있어서, 솔더 범프들의 배열은 다이의 표면 상에 형성된다. 솔더 범프들의 형성은 원하는 패턴의 솔더 범프들을 생성하기 위하여 솔더 마스크를 통해 솔더 복합 재료를 이용하여 수행될 수 있다. 칩 패키지의 기능은 전력 분배, 신호 분배, 열 소산(heat dissipation), 보호 및 서포트 등을 포함한다. 반도체가 더 복잡해짐에 따라 전통적인 패키지 기술 예를 들면, 리드 프레임 패키지, 플렉스 패키지, 리지드 패키지 기술은 칩 상에 고밀도 요소들을 갖는 더 작은 칩을 생성하는 것에 대한 요구를 충족시킬 수가 없다. 종래의 패키지 기술들은 웨이퍼 상의 다이스(dice)를 각각의 다이들(dies)로 분할하고 이후 다이 각각 을 패키지하여야만 하기 때문에, 이들 기술들은 제조 공정에 대하여 시간 소모적이다. 칩 패키지 기술은 집적 회로들의 개발에 의해 매우 영향을 받기 때문에, 전자 제품의 크기에 대한 요구는 점점 더 커지고 있으며, 패키지 기술에 대해서도 마찬가지이다. 상기한 이유들로 인하여 패키지 기술의 경향은 오늘날 볼 그리드 어레이(BGA), 플립칩(FC-BGA), 칩 스케일 패키지(CSP), 웨이퍼 레벨 패키지(WLP)를 향하고 있다. "웨이퍼 레벨 패키지"는 다른 공정 단계들 뿐만 아니라 전체 패키징 및 웨이퍼 상의 모든 상호접속들은 칩들(다이들(dies))로 싱귤레이션(다이싱)하기 전에 수행되는 것을 의미하는 것으로 이해되어야 한다. 일반적으로 모든 조립 공정들 또는 패키징 공정들의 완료 이후에 개별 반도체 패키지들이 복수의 반도체 다이들을 갖는 웨이퍼로부터 분리된다. 웨이퍼 레벨 패키지는 극도로 양호한 전기적 특성들을 갖고 결합된 극히 작은 디멘젼들(dimensions)을 갖는다.
WLP 기술은 진화된 패키징 기술이며, 이에 의하여 다이가 웨이퍼 상에서 제조되고 테스트되며, 이후 표면 마운트 라인에서 조립을 위하여 다이싱함으로써 개별 분리된다(singulated). 웨이퍼 레벨 패키지 기술은 단일 칩 또는 다이를 이용하지 않고 하나의 오브젝트로서 전체의 웨이퍼를 이용하며, 그러므로, 스크라이빙(scribing) 공정을 수행하기 전에 패키징 및 테스팅이 완료되었다; 나아가 WLP는 이러한 진화된 기술이어서 와이어 본딩, 다이 마운트 및 언더필 공정이 생략될 수 있다. WLP 기술을 이용함으로써, 비용 및 제조 시간이 단축될 수 있으며, WLP의 결과적인 구조는 다이와 동일하게 될 수 있다; 그러므로 이 기술은 전자 디바이스들의 소형화 요구들을 충족시킬 수 있다.
그러므로 본 발명은 패키지 크기 및 비용을 감소시키는 이미지 센서 모듈을 제공한다.
본 발명의 목적은 BGA/LGA 타입용 "커넥터"가 없이 MB에 링크하기 위한 이미지 센서 모듈을 제공하는 것이다.
본 발명의 목적은 극도로 얇은 모듈 어플리케이션, 작은 풋 프린트(폼팩터), CIS 모듈을 위한 간단한 공정을 위해 캐비티들을 갖는 PCB를 구비하는 이미지 센서 모듈을 제공하기 위한 것이다.
본 발명의 추가적인 목적은 디솔더링(de-soldering)에 의하여 재가공 가능한 이미지 센서 모듈을 제공하기 위한 것이다.
본 발명은 기판의 상부 표면 내에 형성된 패키지 수용 캐비티 및 그 안에 형성된 전도성 트레이스를 갖는 기판을 제공하는 단계로, 상기 기판은 그 위에 형성된 접점 금속을 구비하는, 단계; 패키지를 취하여(picking) 상기 캐비티로 부착하는 단계; 여기서 상기 패키지는 상기 패키지의 베이스 상에 부착된 마이크로 렌즈 영역을 갖는 다이를 포함하며 상기 다이를 둘러싸면서 제1 물질을 충진하고 다이와 동일 레벨을 유지한다; 다이 표면 및 패드들을 클리닝하는 단계; 상기 베이스 및 다이 위에 유전체층을 형성하고 이후 I/O 패드들 및 다이의 마이크로 렌즈 영역을 오픈시키는 단계; 팬-아웃(fan-out) 구조를 형성하기 위해 상기 다이 및 베이스상 에 RDL을 형성하는 단계; 다음으로 상기 기판 및 상기 패키지 상에 스텐실 프린팅 솔더 페이스트를 부착하는 단계; 피킹 앤 플레이싱(picking and placing) 툴에 의하여 상기 기판 상에 패시브 구성요소들을 취하여 배치하는 단계; IR 리플로우에 의하여 상기 패시브 구성요소들을 상기 기판 상에 솔더링하는 단계; 또한 상기 접점 금속을 통해 상기 트레이스 및 상기 다이와 결합하도록 상기 RDL 및 상기 기판 상에 솔더 브리지(범프)를 형성하는 단계; 및 상기 기판 상에 렌즈 홀더를 마운팅하는 단계를 포함하는 이미지 센서 모듈 패키지를 형성하는 방법을 제공한다.
본 발명은 또한 상부 표면 내에 형성된 패키지 수용 캐비티 및 내부에 전도성 트레이스들을 가지며, 위에 형성된 접점 금속을 갖는 기판; 패키지의 베이스 상에 위치된 마이크로 렌즈를 가진 다이를 구비하는 패키지; 다이의 주변으로 충진되며 다이와 동일 평면을 유지하는 제1 물질; 상기 다이 및 상기 베이스 상에 형성된 유전체층으로, 상기 유전체층은 상기 마이크로 렌즈를 노출시키기 위해 오프닝을 구비하며; 상기 유전체층 상에 형성된 재배선 전도층(RDL)으로, 제1 RDL은 상기 다이 및 상기 전도성 트레이스들에 결합되며; 상기 RDL 위에 형성되며, 상기 마이크로 렌즈를 노출시키기 위한 오프닝을 갖는 보호 유전체층; 상기 접점 금속을 통해 상기 트레이스와 소통하도록 상기 보호 유전체층 및 상기 기판 상에 형성된 솔더 브리지(범프); 상기 기판 상에 부착되며, 윗부분에 부착된 렌즈를 구비하는 렌즈 홀더를 포함하는 이미지 센서 모듈 구조를 제공한다.
오프닝이 CMOS 이미지 센서(CIS)용 다이의 마이크로 렌즈 영역을 노출시키도록 유전체층 및 상부 보호층 내에 형성된다는 것이 주지되어야 한다. 코팅 IR 필터 를 갖는 투명 커버가 보호를 위하여 마이크로 렌즈 위에 선택적으로 형성된다.
이미지 센서 칩들은 마이크로 렌즈 영역 상에서 보호층(필름)으로 코팅되어 왔다; 마이크로 렌즈 영역 상의 파티클 오염을 없앨 수 있는 발수 및 발유 특성을 가진 보호층(필름); 보호층(필름)의 두께는 바람직하게 약 0.1㎛ 내지 0.3㎛이며, 반사파지수(reflection index)는 공기 반사파지수 1에 가깝다. 이 공정은 SOG(spin on glass) 기술에 의하여 수행될 수 있으며, 실리콘 웨이퍼 형태 또는 패널 웨이퍼 형태(바람직하게는 이후 공정 중의 파티클 오염을 회피하기 위하여 실리콘 웨이퍼 형태)로 가공될 수 있다. 보호층의 재료들은 SiO2, Al2O3 또는 플루오르-폴리머(fluore-polymer) 등이 될 수 있다.
유전체층의 재료는 탄성 유전체층, 실리콘 유전체 기반 재료, BCB 또는 PI를 포함한다. 실리콘 유전체 기반 재료는 실록산 폴리머(SINR), 다우 코닝 WL5000 시리즈를 포함한다. 택일적으로 유전체층은 포토센시티브층을 포함한다. RDL은 스루홀 구조를 통해 하향으로 접촉하는 단자 패드들과 소통한다.
기판의 재료는 유기 에폭시 타입 FR4, FR5, BT, PCB(인쇄 회로 기판), 합금 또는 금속을 포함한다. 택일적으로 기판은 유리, 세라믹 또는 실리콘일 수 있다.
베이스의 재료는 유기 에폭시 타입 FR4, FR5, BT, PCB(인쇄 회로 기판), 합금 또는 금속을 포함한다. 합금은 합금42 (42%Ni - 58%Fe) 또는 코바(Kovar)(29%Ni - 17%Co - 54%Fe)를 포함한다. 택일적으로 베이스는 유리, 세라믹 또는 실리콘일 수 있다.
다음의 실시예들 및 도면들이 기재되고 명세서에서 설명되나 이는 예시적이고 설명적인 것을 의미하며, 범위를 제한하지 않는다. 관련 기술분야에서 통상의 지식을 가진자는 본 발명이 하나 이상의 구체적 설명들 없이 실시될 수 있으며, 범위를 제한하지 않는다는 것을 확인할 것이다.
명세서 전체에 걸쳐 "일 실시예" 또는 "하나의 실시예"는 실시예와 관련하여 기재된 구체적 특성, 구조 또는 특징을 의미하며 본 발명의 적어도 하나의 실시예에 포함된다. 따라서 명세서 전체에 걸쳐 여러 곳에서 "일 실시예에 있어서" 또는 "하나의 실시예에 있어서"라는 문구의 출현들은 반드시 모두 동일한 실시예를 참조하는 것은 아니다. 나아가 구체적 특성들, 구조들 또는 특징들은 하나 이상의 실시예에 있어서 적당한 방식으로 결합될 수 있다.
본 발명은 기판 안에 형성된 기설정된 캐비티를 갖는 기판을 이용하는 이미지 센서 모듈의 구조를 개시한다. 포토센시티브 재료가 다이 및 베이스 위에 코팅된다. 바람직하게, 포토센시티브 재료의 재료는 탄성 재료로 형성된다. 이미지 센서 모듈은 이미지 센서 칩용의 캐비티를 가진 PCB 마더 보드를 포함하며, 이미지 센서 패키지의 접점 패드들 및 PCB 마더 보드의 접점 패드들 사이의 와이어들과 연결하기 위해 솔더 페이스트를 이용한다. 극도로 얇은(super thin) 구조를 가진 이 모듈은 400㎛보다 작다. 이미지 센서 칩들은 마이크로 렌즈 상에 보호층을 형성하도록 WLP로 가공될 수 있으며, 기판으로부터 패널 상에 RDL을 형성하기 위해 빌드업층들을 이용하여 가공될 수 있다. 마이크로 렌즈 상의 보호층은 칩의 파티클 오 염을 방지할 수 있으며, 이는 발수/발유성(water/oil repellent)을 가지며 이 층의 두께는 0.5㎛보다 작다. IR 카트를 가진 렌즈 홀더는 PCB 마더 보드 상에(마이크로 렌즈 영역 상부에) 고정될 수 있다. 높은 생산량 및 고품질 가공이 본 발명에 의하여 달성될 수 있다.
도 1은 본 발명의 일 실시예에 따른 이미지 센서 모듈의 횡단면도를 도시한다. 도 2에 도시된 바와 같이, 기판(100) 내에 형성된 패키지 구조는 패키지의 베이스(101) 상에 부착된 다이(104)를 포함하며, 제1 재료(101a)는 다이(104)를 둘러싸며 충진되며 패키지 상에 빌드업층들을 형성한다. 복수의 전도성 트레이스들(106)이 전기적 소통(communication)을 위하여 기판(100) 내에 형성되며, 출력(output)을 위해 플렉시블 회로(126)와 연결하며, 택일적으로 솔더 범프들(140)은 출력하기 위해 기판(100) 상에 형성된다. 렌즈 홀더(110)는 렌즈들을 지지하고 보호하기 위하여 기판(100) 위에 형성되며, 부가적으로 기판(100) 상에 형성된 스루홀을 갖는 홀더 가이드 핀들이 형성된다. 렌즈(112)는 렌즈 홀더(110)의 윗부분 상에 부착된다. 필터(114)는 렌즈 홀더(110) 내에 및 렌즈(112)와 다이(104)의 마이크로 렌즈(116) 사이에 위치된다. 필터(114)는 렌즈(112)와 함께 결합되면 생략될 수 있다. 마이크로 렌즈(116)는 그 위에 형성된 보호층(필름)(118)을 포함한다. 패시브 디바이스(136)는 기판(100) 상에 및 렌즈 홀더(110) 외부에 형성될 수 있다.
도 2는 본 발명의 일 실시예에 따라 도 1에 도시된 이미지 센서 모듈의 패키지 구조의 부분 상세 횡단면도를 도시한다. 다이(104)는 패키지(200)의 베이 스(101) 상에 부착되며, 부착(다이 부착) 재료(120a)에 의하여 고정되며, 제1 재료(101a)는 다이(104)의 주변 영역으로 충진된다. 알려진 것처럼, 접점 패드들(본딩 패드들)(122)은 다이(104) 상에 형성된다. 포토센시티브층 또는 유전체층(124)은 다이(104) 및 제1 재료(101a) 위에 형성된다. 복수의 오프닝들이 리소그래피 공정 또는 노광 및 현상 공정을 통해 유전체층(124) 내에 형성된다. 복수의 오프닝들은 접점 패드들 또는 I/O 패드들(122)에 각각 정렬된다. 또한 금속 트레이스로 언급되는 RDL(re-distribution layer; 재배선층)(128)이 상기 층 위에 형성된 금속층의 선택된 부분들을 제거함으로써 유전체층(124) 상에 형성되며, RDL(128)은 I/O 패드들(122)을 통해 다이(104)와 전기적으로 연결을 유지하며, 솔더 범프들(140)은 출력하기 위해 RDL(128) 및 트레이스(106)와 전기적으로 연결을 유지한다. RDL의 재료의 일부는 유전체층(124)의 오프닝들로 재충진될 것이며, 그럼으로써 본딩 패드(122) 위에서 접점 비어 금속(contact via metal)을 형성한다. 보호층(132)은 RDL(128)을 커버하도록 형성된다.
오프닝(130)은 유전체층(보호층)(132) 및 유전체층(124) 내에 형성되어 CMOS 이미지 센서(CIS)용 다이(104)의 마이크로 렌즈(116)를 노출시킨다는 것이 주지되어야 한다. 보호층(118)은 마이크로 렌즈 영역 상의 마이크로 렌즈(116) 위에 형성될 수 있다. 오프닝(130)은 전형적으로 본 기술분야의 당업자에게 잘 알려진 바와 같이 포토리소그래피 공정에 의하여 형성된다. 하나의 경우에 있어서, 오프닝(130)의 아래 부분은 비어 오프닝(via opening)의 형성 중 오픈될 수 있다. 오프닝(130)의 윗부분은 보호층(132)의 침착(deposition) 이후 형성된다. 택일적으로 전체 오 프닝(130)은 리소그래피에 의한 보호층(132)의 형성 이후에 형성된다. 이미지 센서 칩들은 마이크로 렌즈 영역 상에서 보호층(필름)(118)으로 코팅되어 왔다; 마이크로 렌즈 영역 상의 파티클 오염을 없앨 수 있는 발수 및 발유 특성을 가진 보호층(필름); 보호층(필름)(118)의 두께는 바람직하게 약 0.1㎛ 내지 0.3㎛이며, 반사파지수(reflection index)는 공기 반사파지수 1에 가깝다. 이 공정은 SOG(spin on glass) 기술에 의하여 수행될 수 있으며, 실리콘 웨이퍼 형태 또는 패널 웨이퍼 형태(바람직하게는 이후 공정 중의 파티클 오염을 회피하기 위하여 실리콘 웨이퍼 형태로)로 가공될 수 있다. 보호층의 재료들은 SiO2, Al2O3 또는 플루오르-폴리머(fluore-polymer) 등이 될 수 있다. 마지막으로, 코팅 IR 필터를 가진 투명 커버(114)가 선택적으로 보호를 위하여 마이크로 렌즈(116) 위에 형성된다. 투명 커버(114)는 유리, 석영 등으로 이루어진다.
도 3은 일 실시예에 따른 솔더 범프들(140)을 리플로우하는 동안 캐비티 영역(138)의 부분 상세 횡단면도를 도시한다. 도시로부터, 접점 금속 패드(142)가 기판(100) 상에 형성되며, RDL(128) 상의 접점 금속 패드는 다이(104) 상에 형성된다. 다이(104)는 RDL(128) 및 본딩 패드(122)를 통해 PCB 내의 트레이스들(106)과 소통할 수 있다. 이는 패키지(200)(다이(104))가 캐비티(102) 상에 부착된 이후 RDL(128) 및 접점 금속 패드(142) 사이에 동일 레벨을 형성하고, 이후 RDL(128) 및 접점 금속 패드(142)를 모두 덮는 스텐실 프린팅(stencil printing) 솔더 페이스트를 도포하기 위해서이다. 다이(104) 및 캐비티 측벽 사이의 갭은 약 100㎛이어서 솔더 페이스트는 IR 리플로우 공정 중 접점 금속 패드들(142) 및 RDL을 연결하기 위하여 함께 결합(브리지)될 수 있다.
택일적인 실시예가 도 4a 및 4b에 도시될 수 있으며, 대부분의 구조들은 도 1과 유사하므로, 상세한 설명은 생략한다. 패시브 디바이스들(402)은 SMT(표면 마운팅 기술)에 의하여 렌즈 홀더(110) 내에 형성될 수 있으며, 플렉시블 회로(126)가 팬아웃(fan out)을 위하여 솔더볼들(404)에 의해 생략된다. 이는 이미지 센서 모듈 및 패시브 구성요소들을 전체로 통합하고 많은 출력 핀을 획득하여 이미지 센서 모듈의 부피를 축소하기 위한 것이며, 택일적으로, 솔더 범프들(140)이 또한 출력을 위해 이용되며, 그러므로 이 구조는 출력하기 위한 두 경로들을 갖는다. 이 구조는 BGA(볼 그리드 어레이) 타입 이미지 센서 모듈용이다.
택일적으로 도 5는 본 발명에 따른 이미지 센서 모듈의 횡단면도를 나타낸다. 복수의 전도성 트레이스들(106)은 전기 소통을 위하여 기판(100) 내에 형성된다. 단자 패드들(508)은 기판(100)의 저표면 상에 위치되며 트레이스들(106)과 연결되어 이미지 센서 모듈은 보드 상에 직접 마운트될 수 있다. 택일적으로 솔더 범프들(140)은 또한 출력을 위해 이용되며 그러므로 이 구조는 출력하기 위한 두 경로를 갖는다. 상기한 구조는 LGA 타입 이미지 센서 모듈을 구축한다.
바람직하게는, 기판(100)의 재료는 CCL, FR4, FR5, BT(비스말레이미드 트리아진)와 같은 유기 기판, 형성된 캐비티를 갖는 PCB 또는 사전(pre) 에칭 회로를 갖는 합금42이다. 높은 유리 전이 온도(Tg)를 갖는 유기 기판은 에폭시 타입 FR5 또는 BT(비스말레이미드 트리아진) 타입 기판이다. 합금42는 42%Ni 및 58%Fe로 구 성된다. 코바(Kovar)가 또한 사용될 수 있으며 이는 29%Ni, 17%Co, 54%Fe로 구성된다. 유리, 세라믹, 실리콘이 낮은 CTE로 인하여 기판으로서 이용될 수 있다. 캐비티(102)의 깊이의 디멘젼은 다이(104)의 두께보다 더 클 수 있다. 또한 더 깊어질 수 있다.
베이스(101)는 웨이퍼 타입과 같은 라운드형일 수 있으며, 직경은 200, 300mm 또는 그 이상일 수 있다. 패널 형태와 같은 직사각형 타입이 이용될 수 있다. 기판(100)은 캐비티들(102) 및 빌트인 회로(106)를 갖고 형성된다.
본 발명의 하나의 실시예에 있어서, 유전체층(124)은 바람직하게 실록산 폴리머(SINR), 실리콘 산화물, 실리콘 질화물, 다우 코닝 WL5000 시리즈 및 그 화합물들을 포함하는 실리콘 유전체 재료들로 이루어지는 탄성 유전체 재료이다. 또 다른 실시예에 있어서, 유전체층은 벤조시크로브텐(BCB), 에폭시, 폴리이미드(PI) 또는 수지를 포함하는 재료에 의하여 구성된다. 바람직하게는, 이는 간단한 공정을 위하여 포토센시티브층이다. 본 발명의 하나의 실시예에 있어서, 탄성 유전체층은 100(ppm/℃) 보다 큰 CTE, 약 40 퍼센트(바람직하게는 30퍼센트-50퍼센트)의 연신률 및 플라스틱과 고무 사이의 재료의 경도를 갖는 종류의 재료이다. 탄성 유전체층(124)의 두께는 온도 사이클링 테스트 중 RDL/유전체층 인터페이스에 축적된 응력에 따라 달라진다.
본 발명의 하나의 실시예에 있어서, RDL의 재료는 Ti/Cu/Au 합금 또는 Ti/Cu/Ni/Au 합금을 포함한다; RDL의 두께는 2㎛와 15㎛ 사이에 있다. Ti/Cu 합금은 시드 금속층들처럼 또한 스퍼터링 테크닉에 의하여 형성되며 Cu/Au 또는 Cu/Ni/Au 합금은 전기도금에 의하여 형성된다; RDL을 형성하기 위해 전기 도금 공정을 이용하는 것은 온도 사이클링 중 CTE 오매칭을 견디기에 충분히 두꺼운 RDL을 만들 수 있다. 본딩 패드들(122)은 Al 또는 Cu 또는 그 조합이 될 수 있다. FO-WLP 구조의 경우에 탄성 유전체층으로서 SINR을, RDL 금속으로써 Cu를 이용한다. 여기에 도시되지는 않았으나 응력 분석에 따르면, RDL/유전체층 인터페이스에 축적된 응력은 감소된다.
도 2-5에 도시된 바와 같이, RDL 금속은 다이로부터 팬아웃하며 이 구조 아래서 단자 패드들(508) 또는 솔더볼들을 향해 하향으로 소통하며(communicate), 택일적으로 이 구조 위로 솔더 범프들(140)을 향해 상향으로 소통한다. 이는 다이 위에 층들을 적층하고 그럼으로써 패키지의 두께를 증가시키는 종래 기술과 다르다. 종래 기술은 다이 패키지의 두께를 감소시키려는 규칙을 위반한다. 반대로 단자 패드들은 다이 패드들 사이드에 대향하는 표면 상에 위치된다. 소통(communication) 트레이스들(106)은 기판(100)을 관통한다. 그러므로, 다이 패키지의 두께는 명백하게 감소한다. 본 발명의 패키지는 종래 기술보다 더 얇아질 것이다. 나아가 기판은 패키지 전에 미리 준비된다. 캐비티(102) 및 트레이스들(106)은 또한 기설정된다. 따라서 수득률(throughput)은 더 증가될 것이다.
본 발명의 방법은 CIS 패키지 캐비티를 갖는 PCB(FR4/FR5/BT)를 제공하는 단계를 포함한다. 이후 다음 단계는 CIS 패키지를 (청색 테이프 프레임으로부터) 선택하여(pick) CIS 패키지를 캐비티 내에 부착하는 것이다. 이후 부착 재료는 경화된다. 빌드업층들(RDL) 공정이 패키지(미리 형성된) 내에 RDL을 형성하기 위해 수 행된다. 이후 스텐실 프린팅 솔더 페이스트가 기판 상에 형성되며 (양 접점 패드들을 덮는다), 이어서, 피킹 앤 플레이싱(picking and placing) 툴에 의하여 PCB 상에 패시브 구성요소들을 피크 앤 플레이스한다. 이후, IR 리플로우가 이미지 센서 모듈의 접점 패드들 및 PCB, 패시브 구성요소들의 접점 패드들의 솔더 결합(solder joining)에 이용되며, 솔더 범프들은 트레이스를 가지고 기판의 상부 표면 상에 형성되며, 이후 PCB의 플럭스 클리닝이 뒤따른다. 다음은 렌즈 홀더를 마운팅하여 PCB 상에 홀더를 고정하는 것이며 모듈 테스팅이 뒤따른다.
본 발명의 이점들은;
모듈이 BGA/LGA 타입용 "커넥터" 없이 MB(마더 보드)와 연결된다
SMT 공정이 BGA/LGA 타입용 MB 상에 CIS 모듈을 마운트하기 위해 이용된다
빌드업층들 공정이 CIS 패키지를 위해 이용된다
극도로 얇은(super thin) 모듈용 캐비티들을 가진 PCB
작은 풋 프린트(폼팩터)
CIS 모듈을 위한 간단한 공정
솔더 조인트 단자 핀들은 (LGA/BGA 타입용) 표준 포맷이다
MB로부터의 디솔더링에 의하여 재가공 가능한 모듈.
모듈/시스템 어셈블리로 제조 중 가장 높은 생산량.
보호층이 파티클 오염을 방지하기 위하여 마이크로 렌즈 상에 있다
가장 낮은 비용의 기판(PCB-FR4 또는 FR5/BT 타입)
빌드업층들 공정으로 인한 높은 생산량.
본 발명의 바람직한 실시예들이 개시되었지만, 본 기술 분야의 통상의 지식을 가진 자들은 본 발명이 설명된 바람직한 실시예들로 제한되어서는 안된다는 것을 이해할 것이다. 오히려, 다음의 청구항에 의해 정해지는 것처럼 다양한 변화와 수정들이 본 발명의 정신 및 범위 내에서 이루어질 수 있다.
도 1은 본 발명에 따른 이미지 센서 모듈 구조의 횡단면도를 도시한다.
도 2는 본 발명에 따른 이미지 센서 모듈 구조의 부분 상세 횡단면도를 도시한다.
도 3은 본 발명에 따라 도 2에 도시된 캐비티 영역 구조의 부분 상세 횡단면도를 도시한다.
도 4a는 본 발명에 따른 이미지 센서 모듈 구조의 횡단면도를 도시한다.
도 4b는 본 발명에 따라 도 4a에 도시된 이미지 센서 모듈 구조의 저면도를 도시한다.
도 5는 본 발명에 따른 이미지 센서 모듈 구조의 횡단면도를 도시한다.
Claims (5)
- 상부 표면 내에 형성된 패키지 수용 캐비티 및 내부에 전도성 트레이스들을 가지며, 위에 형성된 접점 금속을 갖는 기판;마이크로 렌즈 영역, 및 상기 패키지 수용 캐비티 내에 배치된 패키지의 에지면 상에 단자 금속 패드들을 가진 팬아웃 빌드업층을 노출시키기 위한 오프닝을 구비하는 패키지;상기 점점 금속을 통해 상기 전도성 트레이스와 소통하도록 상기 패키지 및 상기 기판의 상기 단자 금속 패드들 상에 형성된 솔더 조인(solder join); 및상기 기판 상에 부착되며, 그 윗부분에 부착된 렌즈를 갖는 렌즈 홀더를 포함하는 빌드인 패키지 캐비티를 갖는 이미지 센서 모듈 구조.
- 청구항 1에 있어서,출력을 위해 상기 기판의 상기 하부 표면에 형성된 단자 접점;팬아웃을 위해 상기 기판의 하부 표면에 형성된 솔더볼;상기 렌즈 홀더 내의 상기 기판의 상기 상부 표면 상의 패시브 디바이스; 및상기 렌즈 및 상기 마이크로 렌즈 사이에 부착된 IR 필터를 더 포함하는 구조.
- 청구항 1에 있어서, 상기 패키지는:베이스;상기 베이스 상에 부착된 상기 마이크로 렌즈 영역을 갖는 다이;상기 다이의 둘레로 충진되는 제1 물질로, 상기 제1 물질의 표면은 상기 다이 표면과 동일 레벨을 가지며;상기 다이 및 상기 제1 물질 상에 형성된 유전체층으로, 상기 유전체층은 상기 마이크로 렌즈 및 I/O 패드들을 노출시기기 위해 복수의 오프닝을 가지며;상기 유전체층 상에 형성된 재배선 전도층(RDL)으로, 상기 RDL은 상기 다이 및 상기 단자 접점 패드들에 결합되며;상기 RDL 위에 형성되며, 상기 마이크로 렌즈 및 단자 접점 패드들을 노출시키기 위해 복수의 오프닝을 갖는 보호 유전체층을 포함하는, 구조.
- 기판의 상부 표면 내에 형성된 패키지 수용 캐비티 및 그 안에 형성된 전도성 트레이스를 갖는 기판을 제공하는 단계로, 상기 기판은 그 위에 형성된 접점 금속을 구비하는, 단계;패키지를 취하여(picking) 상기 캐비티로 부착하는 단계;상기 기판 및 상기 패키지 상에 스텐실 프린팅 솔더 페이스트를 부착하는 단계;피킹 앤 플레이싱(picking and placing) 툴에 의하여 상기 기판 상에 패시브 구성요소들을 취하여 배치하는 단계;IR 리플로우에 의하여 상기 패시브 구성요소들을 상기 기판 상에 솔더링하는 단계;상기 접점 금속을 통해 상기 트레이스 및 상기 패키지와 결합하도록 상기 RDL 및 상기 기판 상에 솔더 브리지(범프)를 형성하는 단계; 및상기 기판 상에 렌즈 홀더를 마운팅하는 단계를 포함하는 이미지 센서 모듈 패키지를 형성하는 방법.
- 청구항 4에 있어서,상기 기판을 플럭스 크리닝하는 단계;상기 기판의 하부 표면에 솔더볼을 형성하는 단계;상기 기판의 하부 표면에 단자 접점을 형성하는 단계를 더 포함하며,상기 기판 상에 패시브 구성요소들을 취하여 배치하는 단계는 상기 IR 리플로우가 수행되기 전에 수행되며, 상기 RDL 및 상기 기판 상에 상기 솔더 브리지를 형성하는 단계는 상기 IR 리플로우 중 수행되는 방법.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US11/725,041 | 2007-03-15 | ||
US11/725,041 US7498556B2 (en) | 2007-03-15 | 2007-03-15 | Image sensor module having build-in package cavity and the method of the same |
Publications (1)
Publication Number | Publication Date |
---|---|
KR20080084759A true KR20080084759A (ko) | 2008-09-19 |
Family
ID=39688484
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020080024325A KR20080084759A (ko) | 2007-03-15 | 2008-03-17 | 빌드인 패키지 캐비티를 갖는 이미지 센서 모듈 및 그 방법 |
Country Status (7)
Country | Link |
---|---|
US (1) | US7498556B2 (ko) |
JP (1) | JP2008228308A (ko) |
KR (1) | KR20080084759A (ko) |
CN (1) | CN101266990A (ko) |
DE (1) | DE102008014323A1 (ko) |
SG (1) | SG146570A1 (ko) |
TW (1) | TW200837902A (ko) |
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- 2008-03-12 TW TW097108661A patent/TW200837902A/zh unknown
- 2008-03-14 CN CNA2008100850496A patent/CN101266990A/zh not_active Withdrawn
- 2008-03-14 JP JP2008065054A patent/JP2008228308A/ja not_active Withdrawn
- 2008-03-14 DE DE102008014323A patent/DE102008014323A1/de not_active Withdrawn
- 2008-03-14 SG SG200802178-4A patent/SG146570A1/en unknown
- 2008-03-17 KR KR1020080024325A patent/KR20080084759A/ko not_active Application Discontinuation
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101056805B1 (ko) * | 2009-05-14 | 2011-08-12 | 옵토팩 주식회사 | 포토 센서 패키지 |
Also Published As
Publication number | Publication date |
---|---|
US20080224248A1 (en) | 2008-09-18 |
DE102008014323A1 (de) | 2008-09-18 |
JP2008228308A (ja) | 2008-09-25 |
SG146570A1 (en) | 2008-10-30 |
TW200837902A (en) | 2008-09-16 |
CN101266990A (zh) | 2008-09-17 |
US7498556B2 (en) | 2009-03-03 |
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