KR20080043675A - Plasma display apparatus - Google Patents

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Abstract

A plasma display device is provided to prevent electrical shock to a driving unit of the display device by adjusting rotating speed of a dither mask based on APL(Average Power Level). A plasma display device includes a PDP(Plasma Display Panel,100) and a driving unit(110). The PDP displays an image. The PDP includes first and second electrodes which are parallel to each other. Third electrodes of the PDP cross the first and second electrodes. The driving unit represents grayscale of an image using a dither mask. When the APL of the image data is a first level, the driving unit rotates the dither mask at a first speed. When the APL of the image data is a second level, the driving unit rotates the dither mask at a second speed which is smaller than the first speed.

Description

플라즈마 디스플레이 장치{Plasma Display Apparatus}Plasma Display Apparatus {Plasma Display Apparatus}

도 1은 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치의 구성의 일례를 설명하기 위한 도면.1 is a view for explaining an example of the configuration of a plasma display device according to an embodiment of the present invention.

도 2는 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 포함될 수 있는 플라즈마 디스플레이 패널의 구조의 일례를 설명하기 위한 도면.2 is a view for explaining an example of the structure of a plasma display panel that can be included in the plasma display device according to an embodiment of the present invention.

도 3은 제 1 전극 또는 제 2 전극 중 적어도 하나가 복수의 층인 경우의 일례를 설명하기 위한 도면.3 is a view for explaining an example where at least one of the first electrode or the second electrode is a plurality of layers;

도 4는 제 1 전극 또는 제 2 전극 중 적어도 하나가 단일 층인 경우의 일례를 설명하기 위한 도면.4 is a view for explaining an example in the case where at least one of the first electrode or the second electrode is a single layer;

도 5는 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에서 영상의 계조를 구현하기 위한 영상 프레임에 대해 설명하기 위한 도면.FIG. 5 is a diagram for describing an image frame for implementing gray levels of an image in a plasma display device according to an embodiment of the present invention. FIG.

도 6은 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치의 동작의 일례를 설명하기 위한 도면.6 is a view for explaining an example of the operation of the plasma display device according to an embodiment of the present invention.

도 7a 내지 도 7b는 상승 램프 신호 또는 제 2 하강 램프 신호의 또 다른 형태에 대해 설명하기 위한 도면.7A to 7B are views for explaining another form of the rising ramp signal or the second falling ramp signal.

도 8은 평균 전력 레벨에 대해 설명하기 위한 도면.8 is a diagram for explaining an average power level.

도 9는 하프톤 보정을 위한 구동부의 구성의 일례를 설명하기 위한 도면.9 is a view for explaining an example of the configuration of a drive unit for halftone correction.

도 10은 디더 마스크를 이용한 하프톤 보정 방법의 일례에 대해 설명하기 위한 도면.10 is a diagram for explaining an example of a halftone correction method using a dither mask.

도 11은 디더 마스크의 회전에 대해 설명하기 위한 도면.11 is a diagram for explaining rotation of a dither mask.

도 12는 평균 전력 레벨에 관련하여 디더 마스크의 회전속도를 조절하는 방법의 일례를 설명하기 위한 도면.12 is a view for explaining an example of a method of adjusting the rotational speed of the dither mask in relation to the average power level.

도 13a 내지 도 13b는 평균 전력 레벨에 관련하여 디더 마스크의 회전속도를 조절하는 방법의 다른 예를 설명하기 위한 도면.13A to 13B are views for explaining another example of a method of adjusting the rotational speed of the dither mask in relation to the average power level.

도 14는 평균 전력 레벨에 관련하여 디더 마스크의 회전속도를 조절하는 방법의 또 다른 예를 설명하기 위한 도면.14 is a view for explaining another example of a method of adjusting the rotational speed of the dither mask in relation to the average power level.

<도면의 주요 부분에 대한 번호의 설명><Description of the numbers for the main parts of the drawings>

100 : 플라즈마 디스플레이 패널 110 : 구동부100: plasma display panel 110: driver

본 발명은 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것이다.The present invention relates to a plasma display device (Plasma Display Apparatus).

플라즈마 디스플레이 장치는 전극이 형성된 플라즈마 디스플레이 패널과, 이러한 플라즈마 디스플레이 패널의 전극에 구동 신호를 공급하는 구동부를 포함할 수 있다.The plasma display apparatus may include a plasma display panel having electrodes formed thereon, and a driving unit supplying driving signals to the electrodes of the plasma display panel.

일반적으로 플라즈마 디스플레이 패널에는 격벽으로 구획된 방전 셀(Cell) 내에 형광체 층이 형성되고, 아울러 복수의 전극(Electrode)이 형성된다.In general, a phosphor layer is formed in a discharge cell (Cell) partitioned by a partition, and a plurality of electrodes are formed in the plasma display panel.

그리고 구동부는 전극을 통해 방전 셀로 구동 신호를 공급한다.The driver supplies a driving signal to the discharge cell through the electrode.

그러면, 방전 셀 내에서는 공급되는 구동 신호에 의해 방전이 발생한다. 여기서, 방전 셀 내에서 구동 신호에 의해 방전이 될 때, 방전 셀 내에 충진 되어 있는 방전 가스가 자외선(Ultraviolet rays) 등의 광을 발생하고, 이러한 자외선 등의 광이 방전 셀 내에 형성된 형광체를 발광시켜 가시 광을 발생시킨다. 이러한 가시 광에 의해 플라즈마 디스플레이 패널의 화면상에 영상이 표시된다.Then, the discharge is generated by the drive signal supplied in the discharge cell. Here, when discharged by a drive signal in the discharge cell, the discharge gas filled in the discharge cell generates light such as ultraviolet rays, and the light such as ultraviolet light emits phosphors formed in the discharge cell. Generates visible light The visible light displays an image on the screen of the plasma display panel.

본 발명의 일실시예는 입력되는 영상 데이터의 평균 전력 레벨(Average Power Level, APL)에 관련하여 디더 마스크(Dither Mask)의 회전 속도를 조절하여 화질을 개선하는 플라즈마 디스플레이 장치에 관한 것이다.One embodiment of the present invention relates to a plasma display apparatus for improving image quality by adjusting a rotation speed of a dither mask in relation to an average power level (APL) of input image data.

상술한 목적을 이루기 위한 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 영상을 표시하는 플라즈마 디스플레이 패널과, 디더 마스크(Dither Mask)를 이용하여 영상의 계조를 구현하고, 입력되는 영상 데이터의 평균 전력 레벨(Average Power Level : APL)이 제 1 레벨(APL 1)인 경우에는 제 1 속도로 디더 마스크를 회전시키고, 평균 전력 레벨이 제 1 레벨보다 높은 제 2 레벨에서는 제 1 속도보다 느린 제 2 속도로 디더 마스크를 회전시키는 구동부를 포함한다.A plasma display device according to an embodiment of the present invention for achieving the above object is to implement the grayscale of the image using a plasma display panel for displaying an image, a dither mask, the average power of the input image data When the level (Average Power Level: APL) is the first level (APL 1), the dither mask is rotated at the first speed, and the second speed is slower than the first speed when the average power level is higher than the first level. And a driver for rotating the dither mask.

또한, 구동부는 입력되는 영상 데이터의 평균 전력 레벨이 임계 레벨 이하인 경우에 디더 마스크의 회전 속도를 증가시킨다.Also, the driver increases the rotation speed of the dither mask when the average power level of the input image data is equal to or less than the threshold level.

또한, 구동부는 입력되는 영상 데이터의 평균 전력 레벨이 임계 레벨 이상인 경우에 디더 마스크의 회전 속도를 감소시킨다.In addition, the driver reduces the rotation speed of the dither mask when the average power level of the input image data is equal to or greater than the threshold level.

또한, 제 1 속도는 제 2 속도의 1배 초과 10배 이하이다.In addition, a 1st speed is more than 1 time and 10 times or less of a 2nd speed.

이하, 첨부된 도면을 참조하여 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치를 상세히 설명하기로 한다.Hereinafter, a plasma display device according to an embodiment of the present invention will be described in detail with reference to the accompanying drawings.

도 1은 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치의 구성의 일례를 설명하기 위한 도면이다.1 is a view for explaining an example of the configuration of a plasma display device according to an embodiment of the present invention.

도 1을 살펴보면, 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널(100)과 구동부(110)를 포함한다.1, a plasma display apparatus according to an embodiment of the present invention includes a plasma display panel 100 and a driver 110.

플라즈마 디스플레이 패널(100)은 영상을 표시한다. 아울러, 플라즈마 디스플레이 패널(100)은 서로 나란한 제 1 전극과 제 2 전극을 포함하고, 아울러 제 1 전극 및 제 2 전극과 교차하는 제 3 전극을 포함할 수 있다.The plasma display panel 100 displays an image. In addition, the plasma display panel 100 may include a first electrode and a second electrode parallel to each other, and may also include a third electrode crossing the first electrode and the second electrode.

구동부(110)는 디더 마스크(Dither Mask)를 이용하여 영상의 계조를 구현하고, 입력되는 영상 데이터의 평균 전력 레벨(Average Power Level : APL)이 제 1 레벨(APL 1)인 경우에는 제 1 속도로 디더 마스크를 회전시키고, 아울러 평균 전력 레벨이 제 1 레벨보다 높은 제 2 레벨에서는 제 1 속도보다 느린 제 2 속도로 디더 마스크를 회전시킨다.The driver 110 implements a gray level of an image by using a dither mask, and, when the average power level APL of the input image data is the first level APL 1, the first speed. The dither mask is rotated, and the dither mask is rotated at a second speed slower than the first speed at a second level where the average power level is higher than the first level.

여기, 도 1에서는 구동부(110)가 하나의 보드(Board) 형태로 이루어지는 경우만 도시하고 있지만, 본 발명에서 구동부(110)는 플라즈마 디스플레이 패널(100)에 형성된 전극에 따라 복수개의 보드 형태로 나누어지는 것도 가능하다.Here, in FIG. 1, only the case in which the driving unit 110 is formed in one board form is illustrated, but in the present invention, the driving unit 110 is divided into a plurality of board forms according to electrodes formed on the plasma display panel 100. It is also possible to lose.

예를 들면, 구동부(110)는 플라즈마 디스플레이 패널(100)의 제 1 전극을 구동시키는 제 1 구동부(미도시)와, 제 2 전극을 구동시키는 제 2 구동부와, 제 3 전극을 구동시키는 제 3 구동부(미도시)로 나누어질 수 있는 것이다.For example, the driver 110 may include a first driver (not shown) for driving the first electrode of the plasma display panel 100, a second driver for driving the second electrode, and a third for driving the third electrode. It can be divided into a driving unit (not shown).

이러한 본 발명의 플라즈마 디스플레이 장치의 구동부(110)에 대해서는 이후의 설명을 통해 보다 명확히 하도록 한다.The driving unit 110 of the plasma display device of the present invention will be more clearly described later.

다음, 도 2는 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 포함될 수 있는 플라즈마 디스플레이 패널의 구조의 일례를 설명하기 위한 도면이다.Next, FIG. 2 is a view for explaining an example of a structure of a plasma display panel that may be included in a plasma display device according to an embodiment of the present invention.

도 2를 살펴보면, 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 포함될 수 있는 플라즈마 디스플레이 패널은 서로 나란한 제 1 전극(202, Y)과 제 2 전극(203, Z)이 형성되는 전면 기판(201)과, 전술한 제 1 전극(202, Y) 및 제 2 전극(203, Z)과 교차하는 제 3 전극(213, X)이 형성되는 후면 기판(211)이 합착되어 이루어질 수 있다.Referring to FIG. 2, a plasma display panel that may be included in a plasma display apparatus according to an exemplary embodiment of the present invention has a front substrate 201 in which first electrodes 202 and Y and second electrodes 203 and Z are parallel to each other. ) And the rear substrate 211 on which the third electrodes 213 and X intersecting the first electrodes 202 and Y and the second electrodes 203 and Z are formed.

전면 기판(201)의 상부에는 전극, 예컨대 제 1 전극(202, Y)과 제 2 전극(203, Z)이 형성될 수 있다. 이러한 제 1 전극(202, Y)과 제 2 전극(203, Z)은 방전 공간, 즉 방전 셀(Cell)에서 방전을 발생시키고 아울러 방전 셀의 방전을 유지할 수 있다.An electrode such as first electrodes 202 and Y and second electrodes 203 and Z may be formed on the front substrate 201. The first electrodes 202 and Y and the second electrodes 203 and Z may generate a discharge in a discharge space, that is, a discharge cell, and maintain the discharge of the discharge cell.

이러한 제 1 전극(202, Y)과 제 2 전극(203, Z)이 형성된 전면 기판(201)의 상부에는 제 1 전극(202, Y)과 제 2 전극(203, Z)을 덮도록 유전체 층, 예컨대 상부 유전체 층(204)이 형성될 수 있다.The dielectric layer covers the first electrode 202 and the second electrode 203 and Z on the front substrate 201 where the first electrode 202 and the second electrode 203 and Z are formed. For example, upper dielectric layer 204 may be formed.

이러한, 상부 유전체 층(204)은 제 1 전극(202, Y) 및 제 2 전극(203, Z)의 방전 전류를 제한하며 제 1 전극(202, Y)과 제 2 전극(203, Z) 간을 절연시킬 수 있다.This upper dielectric layer 204 limits the discharge current of the first electrode 202, Y and the second electrode 203, Z and between the first electrode 202, Y and the second electrode 203, Z. Can be insulated.

이러한, 상부 유전체 층(204) 상면에는 방전 조건을 용이하게 하기 위한 보호 층(205)이 형성될 수 있다. 이러한 보호 층(205)은 산화마그네슘(MgO) 등의 재료를 상부 유전체 층(204) 상부에 증착하는 방법 등을 통해 형성될 수 있다.A protective layer 205 may be formed on the upper dielectric layer 204 to facilitate a discharge condition. The protective layer 205 may be formed through a method of depositing a material such as magnesium oxide (MgO) on the upper dielectric layer 204.

한편, 후면 기판(211) 상에는 전극, 예컨대 제 3 전극(213, X)이 형성되고, 이러한 제 3 전극(213, X)이 형성된 후면 기판(211)의 상부에는 제 3 전극(213, X)을 덮도록 유전체 층, 예컨대 하부 유전체 층(215)이 형성될 수 있다.Meanwhile, electrodes, for example, third electrodes 213 and X are formed on the rear substrate 211, and third electrodes 213 and X are formed on the rear substrate 211 on which the third electrodes 213 and X are formed. A dielectric layer, such as lower dielectric layer 215, may be formed to cover the gap.

이러한, 하부 유전체 층(215)은 제 3 전극(213, X)을 절연시킬 수 있다.The lower dielectric layer 215 may insulate the third electrodes 213 and X.

이러한 하부 유전체 층(215)의 상부에는 방전 공간 즉, 방전 셀을 구획하기 위한 스트라이프 타입(Stripe Type), 웰 타입(Well Type), 델타 타입(Delta Type), 벌집 타입 등의 격벽(212)이 형성될 수 있다. 이에 따라, 전면 기판(201)과 후면 기판(211)의 사이에서 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 등의 방전 셀이 형성될 수 있다.On top of the lower dielectric layer 215, a partition 212, such as a stripe type, a well type, a delta type, a honeycomb type, for partitioning a discharge cell, that is, a discharge cell, is formed. Can be formed. Accordingly, discharge cells such as red (R), green (G), and blue (B) may be formed between the front substrate 201 and the rear substrate 211.

또한, 적색(R), 녹색(G), 청색(B) 방전 셀 이외에 백색(White : W) 또는 황색(Yellow : Y) 방전 셀이 더 형성되는 것도 가능하다.In addition to the red (R), green (G), and blue (B) discharge cells, it is also possible to further form a white (W) or yellow (Yellow: Y) discharge cell.

한편, 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 포함될 수 있는 플라즈마 디스플레이 패널에서의 적색(R), 녹색(G) 및 청색(B) 방전 셀의 피치(Pitch)는 실질적으로 동일할 수도 있지만, 적색(R), 녹색(G) 및 청색(B) 방전 셀에서의 색 온도를 맞추기 위해 적색(R), 녹색(G) 및 청색(B) 방전 셀의 피치를 다르게 할 수도 있다.On the other hand, the pitch of the red (R), green (G) and blue (B) discharge cells in the plasma display panel that can be included in the plasma display device according to an embodiment of the present invention may be substantially the same. The pitches of the red (R), green (G) and blue (B) discharge cells may be varied to match the color temperature in the red (R), green (G) and blue (B) discharge cells.

이러한 경우 적색(R), 녹색(G) 및 청색(B) 방전 셀 별로 피치를 모두 다르게 할 수도 있지만, 적색(R), 녹색(G) 및 청색(B) 방전 셀 중 하나 이상의 방전 셀의 피치를 다른 방전 셀의 피치와 다르게 할 수도 있다. 예컨대, 적색(R) 방전 셀의 피치가 가장 작고, 녹색(G) 및 청색(B) 방전 셀의 피치를 적색(R) 방전 셀의 피치보다 크게 할 수도 있을 것이다.In this case, the pitch may be different for each of the red (R), green (G), and blue (B) discharge cells, but the pitch of one or more discharge cells among the red (R), green (G), and blue (B) discharge cells. May be different from the pitch of other discharge cells. For example, the pitch of the red (R) discharge cells is the smallest, and the pitch of the green (G) and blue (B) discharge cells may be larger than the pitch of the red (R) discharge cells.

여기서, 녹색(G) 방전 셀의 피치는 청색(B) 방전 셀의 피치와 실질적으로 동일하거나 상이할 수 있다.Here, the pitch of the green (G) discharge cells may be substantially the same as or different from the pitch of the blue (B) discharge cells.

또한, 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 포함될 수 있는 플라즈마 디스플레이 패널은 도 2에 도시된 격벽(212)의 구조뿐만 아니라, 다양한 형상의 격벽의 구조도 가능할 것이다. 예컨대, 격벽(212)은 제 1 격벽(212b)과 제 2 격벽(212a)을 포함하고, 여기서, 제 1 격벽(212b)의 높이와 제 2 격벽(212a)의 높이가 서로 다른 차등형 격벽 구조, 제 1 격벽(212b) 또는 제 2 격벽(212a) 중 하나 이상에 배기 통로로 사용 가능한 채널(Channel)이 형성된 채널형 격벽 구조, 제 1 격벽(212b) 또는 제 2 격벽(212a) 중 하나 이상에 홈(Hollow)이 형성된 홈형 격벽 구조 등이 가능할 것이다.In addition, the plasma display panel that may be included in the plasma display apparatus according to an exemplary embodiment of the present invention may have not only the structure of the partition 212 illustrated in FIG. 2 but also the structure of the partition having various shapes. For example, the partition 212 includes a first partition 212b and a second partition 212a, where the height of the first partition 212b and the height of the second partition 212a are different from each other. At least one of the first barrier rib 212b and the second barrier rib 212a, and a channel type barrier rib structure having a channel usable as an exhaust passage, at least one of the first barrier rib 212b and the second barrier rib 212a. Grooved partition wall structure having a groove formed in the groove will be possible.

여기서, 차등형 격벽 구조인 경우에는 제 1 격벽(212b) 또는 제 2 격벽(212a) 중 제 1 격벽(212b)의 높이가 제 2 격벽(212a)의 높이보다 더 낮을 수 있다. 아울러, 채널형 격벽 구조나 홈형 격벽 구조인 경우에는 제 1 격벽(212b)에 채널이 형성되거나 홈이 형성될 수 있다.Here, in the case of the differential partition structure, the height of the first partition 212b of the first partition 212b or the second partition 212a may be lower than the height of the second partition 212a. In addition, in the case of the channel barrier rib structure or the groove barrier rib structure, a channel or a groove may be formed in the first barrier rib 212b.

한편, 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 포함될 수 있는 플라즈마 디스플레이 패널에서는 적색(R), 녹색(G) 및 청색(B) 방전 셀 각각이 동일한 선상에 배열되는 것으로 도시 및 설명되고 있지만, 다른 형상으로 배열되는 것도 가능할 것이다. 예컨대, 적색(R), 녹색(G) 및 청색(B) 방전 셀이 삼각형 형상으로 배열되는 델타(Delta) 타입의 배열도 가능할 것이다. 또한, 방전 셀의 형상도 사각형상뿐만 아니라 오각형, 육각형 등의 다양한 다각 형상도 가능할 것이다.On the other hand, in the plasma display panel that can be included in the plasma display device according to an embodiment of the present invention, although the red (R), green (G) and blue (B) discharge cells are shown and described as being arranged on the same line, It may be possible to arrange them in other shapes. For example, a delta type arrangement in which red (R), green (G) and blue (B) discharge cells are arranged in a triangular shape may be possible. In addition, the shape of the discharge cell may also be a variety of polygonal shapes, such as pentagonal, hexagonal, as well as rectangular.

또한, 여기 도 2에서는 후면 기판(211)에 격벽(212)이 형성된 경우만을 도시하고 있지만, 격벽(212)은 전면 기판(201) 또는 후면 기판(211) 중 적어도 하나에 형성될 수 있다.In addition, in FIG. 2, only the case where the partition wall 212 is formed on the rear substrate 211 is illustrated, but the partition wall 212 may be formed on at least one of the front substrate 201 and the rear substrate 211.

여기서, 격벽(212)에 의해 구획된 방전 셀 내에는 소정의 방전 가스가 채워질 수 있다.Here, a predetermined discharge gas may be filled in the discharge cell partitioned by the partition wall 212.

아울러, 격벽(212)에 의해 구획된 방전 셀 내에는 어드레스 방전 시 화상표시를 위한 가시 광을 방출하는 형광체 층(214)이 형성될 수 있다. 예를 들면, 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 형광체 층이 형성될 수 있다.In addition, a phosphor layer 214 that emits visible light for image display may be formed in the discharge cells partitioned by the partition wall 212. For example, red (R), green (G), and blue (B) phosphor layers may be formed.

또한, 적색(R), 녹색(G), 청색(B) 형광체 이외에 백색(White : W) 및/또는 황색(Yellow : Y) 형광체 층이 더 형성되는 것도 가능하다.In addition to the red (R), green (G), and blue (B) phosphors, it is also possible to further form a white (W) and / or yellow (Y) phosphor layer.

또한, 적색(R), 녹색(G), 청색(B) 방전 셀의 형광체 층(214)은 두께(Width)가 실질적으로 동일하거나 하나 이상에서 상이할 수 있다. 예를 들어, 적색(R), 녹색(G) 및 청색(B) 방전 셀 중 적어도 어느 하나의 방전 셀에서의 형광체 층(214)의 두께가 다른 방전 셀과 상이한 경우에는 녹색(G) 또는 청색(B) 방전 셀에서의 형광 체 층(214)의 두께가 적색(R) 방전 셀에서의 형광체 층(214)의 두께보다 더 두꺼울 수 있다. 여기서, 녹색(G) 방전 셀에서의 형광체 층(214)의 두께는 청색(B) 방전 셀에서의 형광체 층(214)의 두께와 실질적으로 동일하거나 상이할 수 있다.In addition, the phosphor layers 214 of the red (R), green (G), and blue (B) discharge cells may have substantially the same thickness or may differ from one or more. For example, if the thickness of the phosphor layer 214 in at least one of the red (R), green (G), and blue (B) discharge cells is different from the other discharge cells, green (G) or blue (B) The thickness of the phosphor layer 214 in the discharge cell may be thicker than the thickness of the phosphor layer 214 in the red (R) discharge cell. Here, the thickness of the phosphor layer 214 in the green (G) discharge cell may be substantially the same as or different from the thickness of the phosphor layer 214 in the blue (B) discharge cell.

한편, 이상에서는 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 포함될 수 있는 플라즈마 디스플레이 패널의 일례만을 도시하고 설명한 것으로써, 본 발명의 일실시예가 이상에서 설명한 구조의 플라즈마 디스플레이 패널에 한정되는 것은 아님을 밝혀둔다. 예를 들면, 여기 이상의 설명에서는 번호 204의 상부 유전체 층 및 번호 215의 하부 유전체 층이 각각 하나의 층(Layer)인 경우만을 도시하고 있지만, 이러한 상부 유전체 층 및 하부 유전체 층 중 하나 이상은 복수의 층으로 이루지는 것도 가능한 것이다.In the above description, only one example of the plasma display panel which may be included in the plasma display apparatus according to the exemplary embodiment of the present invention is illustrated and described. However, one embodiment of the present invention is not limited to the plasma display panel having the above-described structure. To reveal. For example, the description hereinabove illustrates only the case where the top dielectric layer at number 204 and the bottom dielectric layer at number 215 are each one layer, but one or more of these top dielectric layers and bottom dielectric layers are a plurality of layers. It can also be layered.

아울러, 번호 212의 격벽으로 인한 외부 광의 반사를 방지하기 위해 격벽(212)의 상부에 외부 광을 흡수할 수 있는 블랙 층(미도시)을 더 형성할 수도 있다.In addition, a black layer (not shown) may be further formed on the partition 212 to prevent reflection of the external light due to the partition 212.

또한, 격벽(212)과 대응되는 전면 기판(201) 상의 특정 위치에 블랙 층(미도시)이 더 형성되는 것도 가능하다.In addition, a black layer (not shown) may be further formed at a specific position on the front substrate 201 corresponding to the partition 212.

또한, 후면 기판(211) 상에 형성되는 제 3 전극(213)은 폭이나 두께가 실질적으로 일정할 수도 있지만, 방전 셀 내부에서의 폭이나 두께가 방전 셀 외부에서의 폭이나 두께와 다를 수도 있을 것이다. 예컨대, 방전 셀 내부에서의 폭이나 두께가 방전 셀 외부에서의 그것보다 더 넓거나 두꺼울 수 있을 것이다.In addition, the width or thickness of the third electrode 213 formed on the rear substrate 211 may be substantially constant, but the width or thickness inside the discharge cell may be different from the width or thickness outside the discharge cell. will be. For example, the width or thickness inside the discharge cell may be wider or thicker than that outside the discharge cell.

다음, 도 3은 제 1 전극 또는 제 2 전극 중 적어도 하나가 복수의 층인 경우 의 일례를 설명하기 위한 도면이다.Next, FIG. 3 is a diagram for explaining an example in the case where at least one of the first electrode or the second electrode is a plurality of layers.

도 3을 살펴보면, 제 1 전극(202) 또는 제 2 전극(203) 중 적어도 하나는 복수의 층, 예컨대 두 개의 층(Layer)으로 이루어질 수 있다.Referring to FIG. 3, at least one of the first electrode 202 or the second electrode 203 may be formed of a plurality of layers, for example, two layers.

예를 들면, 광 투과율 및 전기 전도도를 고려하면 방전 셀 내에서 발생한 광을 외부로 방출시키며 아울러 구동 효율을 확보하는 차원에서 제 1 전극(202) 또는 제 2 전극(203) 중 적어도 하나는 은(Ag)과 같은 실질적으로 불투명한 재질을 포함하는 버스 전극(202b, 203b)과 투명한 인듐 틴 옥사이드(Indium Tin Oxide : ITO)와 같은 투명한 재질을 포함하는 투명 전극(202a, 203a)을 포함할 수 있다.For example, in consideration of light transmittance and electrical conductivity, at least one of the first electrode 202 or the second electrode 203 is made of silver (silver) to emit light generated in the discharge cell to the outside and to secure driving efficiency. Bus electrodes 202b and 203b including a substantially opaque material such as Ag) and transparent electrodes 202a and 203a including a transparent material such as transparent indium tin oxide (ITO). .

이와 같이, 제 1 전극(202)과 제 2 전극(203)이 투명 전극(202a, 203a)을 포함하면, 방전 셀 내에서 발생한 가시 광이 플라즈마 디스플레이 패널의 외부로 방출될 때 효과적으로 방출될 수 있다.As such, when the first electrode 202 and the second electrode 203 include the transparent electrodes 202a and 203a, visible light generated in the discharge cell can be effectively emitted when emitted to the outside of the plasma display panel. .

아울러, 제 1 전극(202)과 제 2 전극(203)이 버스 전극(202b, 203b)을 포함하면, 제 1 전극(202)과 제 2 전극(203)이 투명 전극(202a, 203a)만을 포함하는 경우에는 투명 전극(202a, 203a)의 전기 전도도가 상대적으로 낮기 때문에 구동 효율이 감소할 수 있는데, 이러한 구동 효율의 감소를 야기할 수 있는 투명 전극(202a, 203a)의 낮은 전기 전도도를 보상할 수 있다.In addition, when the first electrode 202 and the second electrode 203 include the bus electrodes 202b and 203b, the first electrode 202 and the second electrode 203 include only the transparent electrodes 202a and 203a. In this case, the driving efficiency can be reduced because the electrical conductivity of the transparent electrodes 202a and 203a is relatively low, and it is possible to compensate for the low electrical conductivity of the transparent electrodes 202a and 203a which can cause such a reduction in the driving efficiency. Can be.

이와 같이 제 1 전극(202)과 제 2 전극(203)이 버스 전극(202b, 203b)을 포함하는 경우에, 버스 전극(202b, 203b)에 의한 외부 광의 반사를 방지하기 위해 투명 전극(202a, 203a)과 버스 전극(202b, 203b)의 사이에 블랙 층(Black Layer : 320, 321)이 더 구비될 수 있다.As described above, in the case where the first electrode 202 and the second electrode 203 include the bus electrodes 202b and 203b, the transparent electrodes 202a and 203b may be used to prevent reflection of external light by the bus electrodes 202b and 203b. Black layers 320 and 321 may be further provided between the 203a and the bus electrodes 202b and 203b.

다음, 도 4는 제 1 전극 또는 제 2 전극 중 적어도 하나가 단일 층인 경우의 일례를 설명하기 위한 도면이다.Next, FIG. 4 is a figure for explaining an example in the case where at least one of a 1st electrode or a 2nd electrode is a single layer.

도 4를 살펴보면, 제 1 전극(202, Y) 및 제 2 전극(203, Z)은 단일 층(One Layer)이다. 예를 들면, 제 1 전극(202, Y) 및 제 2 전극(203, Z)은 앞선 도 3에서 번호 202a 또는 203a의 투명 전극이 생략된(ITO-Less) 전극일 수 있다.Referring to FIG. 4, the first electrodes 202 and Y and the second electrodes 203 and Z are one layer. For example, the first electrodes 202 and Y and the second electrodes 203 and Z may be electrodes (ITO-Less) in which the transparent electrode of numeral 202a or 203a is omitted in FIG. 3.

이러한, 제 1 전극(202, Y) 또는 제 2 전극(203, Z) 중 적어도 하나는 실질적으로 불투명한 전기 전도성의 금속 재질을 포함할 수 있다. 예를 들면, 은(Ag), 구리(Cu), 알루미늄(Al) 등과 같은 전기 전도성이 우수하고, 아울러 투명 재질, 예컨대 인듐-틴-옥사이드(ITO)에 비해 가격이 저렴한 재질을 포함할 수 있다.At least one of the first electrode 202 and Y or the second electrode 203 and Z may include a substantially opaque electrically conductive metal material. For example, it may include a material having excellent electrical conductivity such as silver (Ag), copper (Cu), aluminum (Al), and the like, and a material having a lower cost than a transparent material such as indium tin oxide (ITO). .

아울러, 제 1 전극(202, Y) 또는 제 2 전극(203, Z) 중 적어도 하나는 도 2의 번호 204의 상부 유전체 층보다 색이 어두울 수 있다.In addition, at least one of the first electrode 202 and the second electrode 203 and Z may be darker in color than the upper dielectric layer of FIG. 2.

이와 같이, 제 1 전극(202, Y) 또는 제 2 전극(203, Z) 중 적어도 하나가 단일 층인 경우는 앞선 도 3의 경우에 비해 제조 공정이 더 단순하다. 예를 들면, 앞선 도 3의 경우에서는 제 1 전극(202, Y)과 제 2 전극(203, Z)의 형성 공정 시 투명 전극(202a, 203a)을 형성한 이후에 버스 전극(202b, 203b)을 또 다시 형성하여야 하지만, 여기 도 4의 경우는 단일 층 구조이기 때문에 한 번의 공정으로 제 1 전극(202, Y)과 제 2 전극(203, Z)을 형성할 수 있다.As such, when at least one of the first electrode 202 and the second electrode 203 and Z is a single layer, the manufacturing process is simpler than in the case of FIG. 3. For example, in the case of FIG. 3, the bus electrodes 202b and 203b are formed after the transparent electrodes 202a and 203a are formed in the process of forming the first electrodes 202 and Y and the second electrodes 203 and Z. 4 again, the first electrode 202 and Y and the second electrode 203 and Z can be formed in one process because the single layer structure of FIG.

또한, 도 4와 같이 제 1 전극(202, Y)과 제 2 전극(203, Z)을 단일 층으로 형성하게 되면 제조 공정이 단순해지는 것과 함께 상대적으로 고가인 인듐-틴-옥사이드(ITO) 등의 투명한 재질을 사용하지 않아도 되기 때문에 제조 단가가 저감될 수 있다.In addition, as shown in FIG. 4, when the first electrodes 202 and Y and the second electrodes 203 and Z are formed in a single layer, the manufacturing process is simplified and relatively expensive indium-tin-oxide (ITO) or the like. Since it is not necessary to use a transparent material of the manufacturing cost can be reduced.

한편, 제 1 전극(202, Y) 및 제 2 전극(203, Z)과 전면 기판(201) 사이에는 전면 기판(201)의 변색을 방지하며 제 1 전극(202, Y) 또는 제 2 전극(203, Z) 중 적어도 어느 하나보다 더 어두운 색을 갖는 블랙 층(Black Layer : 400a, 400b)이 더 구비될 수 있다. 즉, 전면 기판(201)과 제 1 전극(202, Y) 또는 제 2 전극(203, Z)이 직접 접촉하는 경우에는 제 1 전극(202, Y) 또는 제 2 전극(203, Z)과 직접 접촉하는 전면 기판(201)의 일정 영역이 황색 계열로 변색되는 마이그레이션(Migration) 현상이 발생할 수 있는데, 블랙 층(400a, 400b)은 이러한 마이그레이션 현상을 방지함으로써 전면 기판(201)의 변색을 방지할 수 있는 것이다.Meanwhile, discoloration of the front substrate 201 is prevented between the first electrodes 202 and Y and the second electrodes 203 and Z and the front substrate 201, and the first electrode 202 or Y or the second electrode ( Black layers 400a and 400b having a darker color than at least one of 203 and Z) may be further provided. That is, when the front substrate 201 and the first electrode 202, Y or the second electrode 203, Z are in direct contact, the first electrode 202, Y or the second electrode 203, Z is directly in contact with each other. Migration phenomenon may occur in which a predetermined area of the front substrate 201 that is in contact with the yellow color is changed. The black layers 400a and 400b may prevent the migration of the front substrate 201 by preventing the migration phenomenon. It can be.

이러한 블랙 층(400a, 400b)은 실질적으로 어두운 계열의 색을 갖는 블랙 재질, 예컨대 루테늄(Ru)을 포함할 수 있다.The black layers 400a and 400b may include a black material having a substantially dark color, for example, ruthenium (Ru).

이와 같이, 전면 기판(201)과 제 1 전극(202, Y) 및 제 2 전극(203, Z)의 사이에 블랙 층(400a, 400b)을 구비하게 되면, 제 1 전극(202, Y)과 제 2 전극(203, Z)이 반사율이 높은 재질로 이루어지더라도 반사광의 발생을 방지할 수 있다.As such, when the black layers 400a and 400b are provided between the front substrate 201 and the first electrodes 202 and Y and the second electrodes 203 and Z, the first electrodes 202 and Y may be provided. Even if the second electrodes 203 and Z are made of a material having high reflectance, generation of reflected light can be prevented.

이와 같이, 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 포함될 수 있는 플라즈마 디스플레이 패널의 구조는 다양하게 변경될 수 있는 것이다.As such, the structure of the plasma display panel which may be included in the plasma display apparatus according to the exemplary embodiment may be variously changed.

다음, 도 5는 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에서 영상의 계조를 구현하기 위한 영상 프레임에 대해 설명하기 위한 도면이다.Next, FIG. 5 is a diagram for describing an image frame for implementing grayscale of an image in a plasma display device according to an embodiment of the present invention.

도 5를 살펴보면 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에서 영상의 계조(Gray Level)를 구현하기 위한 영상 프레임은 발광횟수가 다른 복수의 서브필드로 나누어질 수 있다.Referring to FIG. 5, an image frame for implementing gray levels of an image in a plasma display device according to an embodiment of the present invention may be divided into a plurality of subfields having different emission counts.

아울러, 도시하지는 않았지만 복수의 서브필드 중 하나 이상의 서브필드는 다시 방전 셀을 초기화시키기 위한 리셋 기간(Reset Period), 방전될 방전 셀을 선택하기 위한 어드레스 기간(Address Period) 및 방전횟수에 따라 계조를 구현하는 서스테인 기간(Sustain Period)으로 나누어 질 수 있다.Although not shown, one or more subfields among the plurality of subfields may be grayed out according to a reset period for initializing discharge cells, an address period for selecting discharge cells to be discharged, and the number of discharges. It can be divided into the sustain period to implement.

예를 들어, 256 계조로 영상을 표시하고자 하는 경우에 예컨대 하나의 영상 프레임은, 도 5와 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지고, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋 기간, 어드레스 기간 및 서스테인 기간으로 다시 나누어질 수 있다.For example, when an image is to be displayed with 256 gray scales, for example, one image frame is divided into eight subfields SF1 to SF8 as shown in FIG. 5, and each of the eight subfields SF1 to SF8, respectively. Can be subdivided into a reset period, an address period and a sustain period.

한편, 서스테인 기간에 공급되는 서스테인 신호의 개수를 조절하여 해당 서브필드의 계조 가중치를 설정할 수 있다. 즉, 서스테인 기간을 이용하여 각각의 서브필드에 소정의 계조 가중치를 부여할 수 있다. 예를 들면, 제 1 서브필드의 계조 가중치를 20 으로 설정하고, 제 2 서브필드의 계조 가중치를 21 으로 설정하는 방법으로 각 서브필드의 계조 가중치가 2n(단, n = 0, 1, 2, 3, 4, 5, 6, 7)의 비율로 증가되도록 각 서브필드의 계조 가중치를 결정할 수 있다. 이와 같이 각 서브필드에서 계조 가중치에 따라 각 서브필드의 서스테인 기간에서 공급되는 서스테인 신호의 개수를 조절함으로써, 다양한 영상의 계조를 구현하게 된다.The gray scale weight of the corresponding subfield may be set by adjusting the number of the sustain signals supplied in the sustain period. That is, a predetermined gray scale weight can be given to each subfield using the sustain period. For example, the gray scale weight of each subfield is 2 n by setting the gray scale weight of the first subfield to 2 0 and the gray scale weight of the second subfield to 2 1 (where n = 0, 1). , 2, 3, 4, 5, 6, and 7) to increase the gray scale weight of each subfield. As described above, the number of sustain signals supplied in the sustain period of each subfield is adjusted according to the gray scale weight in each subfield, thereby implementing gray levels of various images.

본 발명의 일실시예에 따른 플라즈마 디스플레이 패널은 영상을 구현하기 위해, 예컨대 1초의 영상을 표시하기 위해 복수의 영상 프레임을 사용한다. 예를 들 면, 1초의 영상을 표시하기 위해 60개의 영상 프레임을 사용하는 것이다. 이러한 경우에 하나의 영상 프레임의 길이(T)는 최대 1/60 초, 즉 16.67ms일 수 있다.A plasma display panel according to an embodiment of the present invention uses a plurality of image frames to implement an image, for example, to display an image of 1 second. For example, 60 image frames are used to display one second of images. In this case, the length T of one image frame may be at most 1/60 second, that is, 16.67 ms.

여기 도 5에서는 하나의 영상 프레임이 8개의 서브필드로 이루어진 경우만으로 도시하고 설명하였지만, 이와는 다르게 하나의 영상 프레임을 이루는 서브필드의 개수는 다양하게 변경될 수 있다. 예를 들면, 제 1 서브필드부터 제 12 서브필드까지의 12개의 서브필드로 하나의 영상 프레임을 구성할 수도 있고, 10개의 서브필드로 하나의 영상 프레임을 구성할 수도 있는 것이다.In FIG. 5, only one image frame is composed of eight subfields. However, the number of subfields constituting one image frame may be variously changed. For example, one video frame may be configured with 12 subfields from the first subfield to the twelfth subfield, or one video frame may be configured with 10 subfields.

또한, 여기 도 5에서는 하나의 영상 프레임에서 계조 가중치의 크기가 증가하는 순서에 따라 서브필드들이 배열되었지만, 이와는 다르게 하나의 영상 프레임에서 서브필드들이 계조 가중치가 감소하는 순서에 따라 배열될 수도 있고, 또는 계조 가중치에 관계없이 서브필드들이 배열될 수도 있는 것이다.In addition, in FIG. 5, subfields are arranged in increasing order of gray scale weight in one image frame. Alternatively, subfields may be arranged in order of decreasing gray scale weight in one image frame. Alternatively, subfields may be arranged regardless of the gray scale weight.

다음, 도 6은 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치의 동작의 일례를 설명하기 위한 도면이다.6 is a view for explaining an example of the operation of the plasma display device according to an embodiment of the present invention.

도 6을 살펴보면 앞선 도 5와 같은 영상 프레임에 포함된 복수의 서브필드 어느 하나의 서브필드(Subfield)에서의 플라즈마 디스플레이 장치의 동작의 일례가 나타나 있다. 이하에서 설명될 구동 신호들은 앞선 도 1의 번호 110의 구동부가 공급하는 것임을 미리 밝혀둔다.Referring to FIG. 6, an example of the operation of the plasma display apparatus in any one of the plurality of subfields included in the image frame as shown in FIG. 5 is shown. It will be appreciated that the driving signals to be described below are supplied by the driving unit 110 of FIG. 1.

먼저, 리셋 기간 이전의 프리(Pre) 리셋 기간에서 제 1 전극(Y)에 제 1 하강 램프(Ramp-Down) 신호가 공급될 수 있다.First, the first ramp-down signal may be supplied to the first electrode Y in the pre-reset period before the reset period.

아울러, 제 1 전극(Y)에 제 1 하강 램프 신호가 공급되는 동안 제 1 하강 램 프 신호와 반대 극성 방향의 프리(Pre) 서스테인 신호가 제 2 전극(Z)에 공급될 수 있다.In addition, while the first falling ramp signal is supplied to the first electrode Y, a pre-sustain signal in a polarity opposite to the first falling ramp signal may be supplied to the second electrode Z.

여기서, 제 1 전극(Y)에 공급되는 제 1 하강 램프 신호는 제 1 전압(V1)까지 점진적으로 하강할 수 있다.Here, the first falling ramp signal supplied to the first electrode Y may gradually fall to the first voltage V1.

아울러, 프리 서스테인 신호는 프리 서스테인 전압(Vpz)을 실질적으로 일정하게 유지할 수 있다. 여기서, 프리 서스테인 전압(Vpz)은 이후의 서스테인 기간에서 공급되는 서스테인 신호(SUS)의 전압, 즉 서스테인 전압(Vs)과 대략 동일한 전압일 수 있다.In addition, the pre-sustain signal can keep the pre-sustain voltage Vpz substantially constant. Here, the pre-sustain voltage Vpz may be a voltage of the sustain signal SUS supplied in a subsequent sustain period, that is, a voltage approximately equal to the sustain voltage Vs.

이와 같이, 프리 리셋 기간에서 제 1 전극(Y)에 제 1 하강 램프 신호가 공급되고, 이와 함께 제 2 전극(Z)에 프리 서스테인 신호가 공급되면 제 1 전극(Y) 상에 소정 극성의 벽 전하(Wall Charge)가 쌓이고, 제 2 전극(Z) 상에는 제 1 전극(Y)과 반대 극성의 벽 전하들이 쌓인다. 예를 들면, 제 1 전극(Y) 상에는 양(+)의 벽 전하(Wall Charge)가 쌓이고, 제 2 전극(Z) 상에는 음(-)의 벽 전하가 쌓일 수 있다.As such, when the first falling ramp signal is supplied to the first electrode Y and the presuspension signal is supplied to the second electrode Z in the pre-reset period, a wall of a predetermined polarity is formed on the first electrode Y. Wall charges are accumulated, and wall charges of opposite polarity to the first electrode Y are accumulated on the second electrode Z. For example, positive wall charges may be accumulated on the first electrode Y, and negative wall charges may be accumulated on the second electrode Z.

이에 따라, 이후의 리셋 기간에서 충분한 세기의 셋업 방전을 발생시킬 수 있게 되고, 결국 초기화를 충분히 안정적으로 수행할 수 있게 된다.This makes it possible to generate a set-up discharge of sufficient intensity in the subsequent reset period, which in turn makes it possible to perform the initialization sufficiently stably.

아울러, 리셋 기간에서 제 1 전극(Y)으로 공급되는 상승 램프 신호(Ramp-Up)의 전압이 더 작아지더라도 충분한 세기의 셋업 방전을 발생시킬 수 있게 된다.In addition, even when the voltage of the rising ramp signal Ramp-Up supplied to the first electrode Y becomes smaller in the reset period, it is possible to generate the setup discharge of sufficient intensity.

구동 시간을 확보하는 관점에서 영상 프레임의 서브필드 중에서 시간상 가장 먼저 배열되는 서브필드에서의 리셋 기간이전에 프리 리셋 기간이 포함되거나 영상 프레임의 서브필드 중 2개 또는 3개의 서브필드에서 리셋 기간이전에 프리 리셋 기간이 포함되는 것도 가능하다.From the viewpoint of securing the driving time, a pre-reset period is included before the reset period in the subfields arranged first in time among the subfields of the image frame, or before the reset period in two or three subfields of the subfields of the image frame. It is also possible to include a pre-reset period.

또는, 이러한 프리 리셋 기간은 모든 서브필드에서 생략되는 것도 가능하다.Alternatively, this pre-reset period may be omitted in all subfields.

프리 리셋 기간 이후, 초기화를 위한 리셋 기간의 셋업(Set-Up) 기간에서는 제 1 전극(Y)으로 제 1 하강 램프 신호와 반대 극성 방향의 상승 램프(Ramp-Up) 신호가 공급될 수 있다.After the pre-reset period, in a set-up period of a reset period for initialization, a ramp-up signal in a direction opposite to that of the first falling ramp signal may be supplied to the first electrode Y.

여기서, 상승 램프 신호는 제 2 전압(V2)부터 제 3 전압(V3)까지 제 1 기울기로 점진적으로 상승하는 제 1 상승 램프 신호와 제 3 전압(V3)부터 제 4 전압(V4)까지 제 2 기울기로 상승하는 제 2 상승 램프 신호를 포함할 수 있다.Here, the rising ramp signal may be a first rising ramp signal gradually increasing with the first slope from the second voltage V2 to the third voltage V3 and a second voltage from the third voltage V3 to the fourth voltage V4. It may include a second rising ramp signal rising to the slope.

이러한 셋업 기간에서는 상승 램프 신호에 의해 방전 셀 내에는 약한 암방전(Dark Discharge), 즉 셋업 방전이 일어난다. 이 셋업 방전에 의해 방전 셀 내에는 어느 정도의 벽 전하(Wall Charge)가 쌓일 수 있다.In this setup period, a weak dark discharge, that is, setup discharge, occurs in the discharge cell by the rising ramp signal. By this setup discharge, some wall charges can be accumulated in the discharge cells.

여기서, 제 2 상승 램프 신호의 제 2 기울기는 제 1 기울기보다 더 완만할 수 있다. 이와 같이, 제 2 기울기를 제 1 기울기보다 더 완만하게 하게 되면, 셋업 방전이 발생하기 이전까지는 전압을 상대적으로 빠르게 상승시키고, 셋업 방전이 발생하는 동안에는 전압을 상대적으로 느리게 상승시키는 효과를 획득함으로써, 셋업 방전에 의해 발생하는 광의 양을 저감시킬 수 있다.Here, the second slope of the second rising ramp signal may be gentler than the first slope. As such, when the second slope is made gentler than the first slope, the voltage is increased relatively quickly until the setup discharge occurs, and the voltage is increased relatively slowly while the setup discharge occurs. The amount of light generated by the setup discharge can be reduced.

이에 따라, 콘트라스트(Contrast) 특성을 개선할 수 있다.Accordingly, the contrast characteristic can be improved.

셋업 기간 이후의 셋다운(Set-Down) 기간에서는 상승 램프 신호 이후에 이러한 상승 램프 신호와 반대 극성 방향의 제 2 하강 램프(Ramp-Down) 신호가 제 1 전 극(Y)에 공급될 수 있다.In a set-down period after the set-up period, a second ramp-down signal in a direction opposite to that of the ramp ramp signal may be supplied to the first electrode Y after the ramp ramp signal.

여기서, 제 2 하강 램프 신호는 제 5 전압(V5)부터 제 6 전압(V6)까지 점진적으로 하강할 수 있다.Here, the second falling ramp signal may gradually fall from the fifth voltage V5 to the sixth voltage V6.

이에 따라, 방전 셀 내에서 미약한 소거 방전(Erase Discharge), 즉 셋다운 방전이 발생한다. 이 셋다운 방전에 의해 방전 셀 내에는 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 균일하게 잔류된다.As a result, weak erase discharge, that is, set-down discharge, occurs in the discharge cell. By this set-down discharge, wall charges such that address discharge can be stably generated in the discharge cells remain uniformly.

다음, 도 7a 내지 도 7b는 상승 램프 신호 또는 제 2 하강 램프 신호의 또 다른 형태에 대해 설명하기 위한 도면이다.Next, FIGS. 7A to 7B are diagrams for describing another form of the rising ramp signal or the second falling ramp signal.

먼저, 도 7a를 살펴보면, 상승 램프 신호는 제 2 전압(V2)부터 제 3 전압(V3)까지는 급격히 상승한 이후에 제 3 전압(V3)부터 제 4 전압(V4)까지 점진적으로 상승하는 형태이다.First, referring to FIG. 7A, the rising ramp signal gradually increases from the third voltage V3 to the fourth voltage V4 after rapidly rising from the second voltage V2 to the third voltage V3.

이와 같이, 상승 램프 신호는 도 6에서와 같이 두 단계에 걸쳐 서로 다른 기울기로 점진적으로 상승하는 것도 가능하고, 여기 도 7a에서와 같이 하나의 단계에서 점진적으로 상승하는 것도 가능한 것과 같이, 다양한 형태로 변경되는 것이 가능한 것이다.As such, the rising ramp signal may rise gradually with different inclinations over two stages, as shown in FIG. 6, and in various forms, such as gradually rising in one stage as shown here in FIG. 7A. It is possible to change.

다음, 도 7b를 살펴보면 제 2 하강 램프 신호는 제 8 전압(V8)에서부터 전압이 점진적으로 하강하는 형태이다. 여기서, 제 8 전압(V8)은 제 3 전압(V3)과 실질적으로 동일할 수도 있고, 상이할 수도 있다.Next, referring to FIG. 7B, the second falling ramp signal has a form in which the voltage gradually decreases from the eighth voltage V8. Here, the eighth voltage V8 may be substantially the same as or different from the third voltage V3.

이와 같이, 제 2 하강 램프 신호는 전압이 하강하는 시점을 다르게 변경하는 것도 가능한 것과 같이, 다양한 형태로 변경되는 것이 가능한 것이다.As described above, the second falling ramp signal may be changed in various forms, such as a different point in time at which the voltage falls.

한편, 리셋 기간 이후의 어드레스 기간에서는 제 2 하강 램프 신호의 최저 전압, 즉 제 6 전압(V6)보다는 높은 전압을 실질적으로 유지하는 스캔 바이어스 신호가 제 1 전극(Y)에 공급될 수 있다.Meanwhile, in the address period after the reset period, a scan bias signal that substantially maintains the lowest voltage of the second falling ramp signal, that is, a voltage higher than the sixth voltage V6 may be supplied to the first electrode Y.

아울러, 스캔 바이어스 신호로부터 스캔 전압(ㅿVy)만큼 하강하는 스캔 신호(Scan)가 제 1 전극(Y1~Yn)에 공급될 수 있다.In addition, the scan signal Scan, which decreases from the scan bias signal by the scan voltage qVy, may be supplied to the first electrodes Y1 to Yn.

예를 들면, 복수의 제 1 전극(Y) 중 첫 번째 제 1 전극(Y1)에 첫 번째 스캔 신호(Scan 1)가 공급되고, 이후에 두 번째 제 1 전극(Y2)에 두 번째 스캔 신호(Scan 2)가 공급되고, n 번째 제 1 전극(Yn)에는 n 번째 스캔 신호(Scan n)가 공급되는 것이다.For example, the first scan signal Scan 1 is supplied to the first first electrode Y1 of the plurality of first electrodes Y, and then the second scan signal (2) is applied to the second first electrode Y2. Scan 2) is supplied, and the n-th scan signal Scan n is supplied to the n-th first electrode Yn.

한편, 서브필드 단위로 스캔 신호(Scan)의 폭은 가변적일 수 있다. 즉, 적어도 하나의 서브필드에서 스캔 신호(Scan)의 폭은 다른 서브필드에서의 스캔 신호(Scan)의 폭과 다를 수 있다. 예컨대, 시간상 뒤에 위치하는 서브필드에서의 스캔 신호(Scan)의 폭이 앞에 위치하는 서브필드에서의 스캔 신호(Scan)의 폭보다 작을 수 있다. 또한, 서브필드의 배열 순서에 따른 스캔 신호(Scan) 폭의 감소는 2.6㎲(마이크로초), 2.3㎲(마이크로초), 2.1㎲(마이크로초), 1.9㎲(마이크로초) 등과 같이 점진적으로 이루어질 수 있거나 2.6㎲(마이크로초), 2.3㎲(마이크로초), 2.3㎲(마이크로초), 2.1㎲(마이크로초)......1.9㎲(마이크로초), 1.9㎲(마이크로초) 등과 같이 이루어질 수도 있을 것이다.On the other hand, the width of the scan signal in units of subfields may vary. That is, the width of the scan signal Scan in at least one subfield may be different from the width of the scan signal Scan in other subfields. For example, the width of the scan signal Scan in the subfield located later in time may be smaller than the width of the scan signal Scan in the subfield located earlier. In addition, the scan signal scan width decreases according to the arrangement order of the subfields gradually, such as 2.6 ms (microseconds), 2.3 ms (microseconds), 2.1 ms (microseconds), 1.9 ms (microseconds), and the like. Or 2.6 ㎲ (microseconds), 2.3 ㎲ (microseconds), 2.3 ㎲ (microseconds), 2.1 ㎲ (microseconds) ... 1.9 ㎲ (microseconds), 1.9 ㎲ (microseconds) It could be done.

이와 같이, 스캔 신호(Scan)가 제 1 전극(Y)으로 공급될 때, 스캔 신호에 대응되게 제 3 전극(X)에 데이터 전압의 크기(ㅿVd)만큼 상승하는 데이터 신호가 공 급될 수 있다.As such, when the scan signal Scan is supplied to the first electrode Y, a data signal rising by the magnitude of the data voltage VVd may be supplied to the third electrode X to correspond to the scan signal. .

이러한 스캔 신호(Scan)와 데이터 신호(Data)가 공급됨에 따라, 스캔 신호(Scan)의 전압과 데이터 신호의 데이터 전압(Vd) 간의 전압 차와 리셋 기간에 생성된 벽 전하들에 의한 벽 전압이 더해지면서 데이터 신호의 전압(Vd)이 공급되는 방전 셀 내에는 어드레스 방전이 발생될 수 있다.As the scan signal Scan and the data signal Data are supplied, the voltage difference between the voltage of the scan signal and the data voltage Vd of the data signal and the wall voltage generated by the wall charges generated in the reset period are In addition, address discharge may occur in a discharge cell to which the voltage Vd of the data signal is supplied.

여기서, 어드레스 기간에서 제 2 전극(Z)의 간섭에 의해 어드레스 방전이 불안정해지는 것을 방지하기 위해 제 2 전극(Z)에 서스테인 바이어스 신호가 공급될 수 있다.Here, a sustain bias signal may be supplied to the second electrode Z to prevent address discharge from becoming unstable due to interference of the second electrode Z in the address period.

여기서, 서스테인 바이어스 신호는 서스테인 기간에서 공급되는 서스테인 신호의 전압보다는 작고 그라운드 레벨(GND)의 전압보다는 큰 서스테인 바이어스 전압(Vz)을 실질적으로 일정하게 유지할 수 있다.Here, the sustain bias signal may maintain a substantially constant sustain bias voltage Vz smaller than the voltage of the sustain signal supplied in the sustain period and greater than the voltage of the ground level GND.

이후, 영상 표시를 위한 서스테인 기간에서는 제 1 전극(Y) 및 제 2 전극(Z)에 중 적어도 하나에 서스테인 신호(SUS)가 공급될 수 있다. 예를 들면, 제 1 전극(Y)과 제 2 전극(Z)에 교호적으로 서스테인 신호(SUS)가 공급될 수 있다.Thereafter, in the sustain period for displaying an image, the sustain signal SUS may be supplied to at least one of the first electrode Y and the second electrode Z. FIG. For example, the sustain signal SUS may be alternately supplied to the first electrode Y and the second electrode Z. FIG.

이러한 서스테인 신호(SUS)가 공급되면, 어드레스 방전에 의해 선택된 방전 셀은 방전 셀 내의 벽 전압과 서스테인 신호(SUS)의 서스테인 전압(Vs)이 더해지면서 서스테인 신호(SUS)가 공급될 때 제 1 전극(Y)과 제 2 전극(Z) 사이에 서스테인 방전 즉, 표시방전이 발생될 수 있다.When the sustain signal SUS is supplied, the discharge cell selected by the address discharge is added with the wall voltage in the discharge cell and the sustain voltage Vs of the sustain signal SUS, and the first electrode when the sustain signal SUS is supplied. A sustain discharge, that is, a display discharge, may be generated between (Y) and the second electrode Z.

다음, 도 8은 평균 전력 레벨에 대해 설명하기 위한 도면이다.Next, FIG. 8 is a diagram for explaining an average power level.

도 8을 살펴보면, 평균 전력 레벨(Average Power Level : APL)은 플라즈마 디스플레이 패널 상에서 영상이 표시되는 부분의 크기와 관련하여 서스테인 신호의 개수를 조절하는 방법이다. 즉, 평균 전력 레벨은 플라즈마 디스플레이 패널의 방전 셀 중 온(On) 되는 방전 셀의 개수에 따라 결정된다.Referring to FIG. 8, an average power level (APL) is a method of adjusting the number of sustain signals in relation to the size of a portion where an image is displayed on a plasma display panel. That is, the average power level is determined according to the number of discharge cells that are turned on among the discharge cells of the plasma display panel.

바람직하게는, 평균 전력 레벨(APL)의 값이 증가할수록 단위계조 당 서스테인 신호의 개수는 감소하고, 평균 전력 레벨(APL)의 값이 감소할수록 단위계조 당 서스테인 신호의 개수는 증가한다.Preferably, as the value of the average power level APL increases, the number of sustain signals per unit gray scale decreases, and as the value of the average power level APL decreases, the number of sustain signals per unit gray scale increases.

예를 들어, (a)와 같이 플라즈마 디스플레이 패널(600)의 화면상에서 상대적으로 작은 면적의 부분에 영상이 표시되는 경우, 즉 플라즈마 디스플레이 패널(600)에 형성된 방전 셀 중 온(On) 되는 방전 셀의 개수가 상대적으로 적은 경우에(이러한 경우는 APL레벨은 상대적으로 낮은 경우이다) 영상 표시에 기여하는 방전 셀의 개수가 상대적으로 적기 때문에 영상 표시에 기여하는 방전 셀 각각으로 공급되는 단위계조 당 서스테인 신호의 개수를 상대적으로 많게 한다. 이에 따라, 영상의 전체 휘도를 증가시킬 수 있다.For example, when an image is displayed on a portion of a relatively small area on the screen of the plasma display panel 600 as shown in (a), that is, a discharge cell that is turned on among discharge cells formed in the plasma display panel 600. When the number of cells is relatively small (in this case, the APL level is relatively low), since the number of discharge cells contributing to the image display is relatively small, the sustain per unit gradation supplied to each discharge cell contributing to the image display is relatively small. Make the number of signals relatively large. Accordingly, the overall brightness of the image can be increased.

이와는 반대로, (b)와 같이 플라즈마 디스플레이 패널(600)의 화면상에서 상대적으로 큰 면적의 부분에 영상이 표시되는 경우, 즉 플라즈마 디스플레이 패널(600)에 형성된 방전 셀 중에서 온 되는 방전 셀의 개수가 상대적으로 많은 경우에(이러한 경우는 APL레벨이 상대적으로 높은 경우이다) 영상 표시에 기여하는 방전 셀의 개수가 상대적으로 많기 때문에 영상 표시에 기여하는 방전 셀 각각으로 공급되는 단위계조 당 서스테인 신호의 개수를 상대적으로 적게 한다. 이에 따라 플라즈마 디스플레이 패널(600)의 전체 전력 소모 양의 급격한 증가를 방지한다.On the contrary, when an image is displayed on a portion of a relatively large area on the screen of the plasma display panel 600 as shown in (b), that is, the number of discharge cells turned on among the discharge cells formed in the plasma display panel 600 is relatively high. In many cases (in this case, the APL level is relatively high), since the number of discharge cells contributing to the image display is relatively large, the number of sustain signals per unit gradation supplied to each discharge cell contributing to the image display is determined. Relatively few. Accordingly, a sudden increase in the total power consumption of the plasma display panel 600 is prevented.

그 일례로, 평균 전력 레벨이 a 레벨인 경우, 이 경우에서의 단위계조 당 서스테인 신호의 개수는 N개이다.As an example, when the average power level is a level, in this case, the number of sustain signals per unit gradation is N.

또한, 평균 전력 레벨이 전술한 a 레벨보다 높은 b 레벨인 경우, 이에 따른 단위계조 당 서스테인 신호의 개수는 전술한 N개 보다는 적은 M개일 수 있다.In addition, when the average power level is a b level higher than the above-described a level, the number of sustain signals per unit gray level may be M less than N described above.

다음, 도 9는 하프톤 보정을 위한 구동부의 구성의 일례를 설명하기 위한 도면이다.Next, FIG. 9 is a diagram for explaining an example of the configuration of a driver for halftone correction.

도 9를 살펴보면, 구동부는 역감마 보정부(900), 하프톤 보정부(910), 서브필드 맵핑부(920)를 포함할 수 있다.Referring to FIG. 9, the driver may include an inverse gamma corrector 900, a halftone corrector 910, and a subfield mapping unit 920.

역감마 보정부(900)는 입력되는 영상 데이터를 역감마 보정(Reverse Gamma) 할 수 있다.The inverse gamma correction unit 900 may reverse gamma correct the input image data.

하프톤 보정부(910)는 입력되는 영상 데이터를 디더 마스크를 사용하여 하프톤(Half-tone) 보정할 수 있다.The halftone corrector 910 may correct half-tones of the input image data using a dither mask.

서브필드 맵핑부(920)는 입력되는 영상 데이터를 서브필드 맵핑(Subfield mapping) 할 수 있다. 이에 따라, 서브필드 맵핑 데이터가 출력된다. 서브필드 맵핑 데이터는 앞선 도 6에서 설명한 데이터 신호로서 제 3 전극에 공급될 수 있다.The subfield mapping unit 920 may subfield map the input image data. Accordingly, subfield mapping data is output. The subfield mapping data may be supplied to the third electrode as the data signal described above with reference to FIG. 6.

다음, 도 10은 디더 마스크를 이용한 하프톤 보정 방법의 일례에 대해 설명하기 위한 도면이다.Next, FIG. 10 is a figure for explaining an example of the halftone correction method using a dither mask.

도 10을 살펴보면, 2×2 디더 마스크를 이용하여 영상 데이터를 하프톤 보정하는 방법의 일례가 나타나 있다.Referring to FIG. 10, an example of a method of halftone correction of image data using a 2 × 2 dither mask is illustrated.

하나의 방전 셀이 온(On)되는 경우 계조 1을 구현한다고 가정하자. 여기서, 계조 1보다 작은 소수 계조, 예컨대 0.25계조를 구현하기 위해서 디더 마스크를 사용할 수 있다.Assume that gray scale 1 is implemented when one discharge cell is turned on. Here, a dither mask may be used to implement a few gray scales, for example, 0.25 gray scales smaller than gray scale 1.

예를 들면, 0.25의 계조를 구현하기 위해 (a)와 같이 2×2 디더 마스크 내의 4개의 방전 셀(1000a, 1000b, 1000c, 1000d) 중 번호 1000b의 방전 셀을 온(On)시키고 나머지 방전 셀을 오프(Off)시킨다.For example, to realize a gradation of 0.25, the discharge cell of the number 1000b of the four discharge cells 1000a, 1000b, 1000c, and 1000d in the 2 × 2 dither mask is turned on, as shown in (a), and the remaining discharge cells are turned on. Off.

그러면, 4개의 방전 셀(1000a, 1000b, 1000c, 1000d) 중 하나만이 온 되고 나머지 3개의 방전 셀은 오프된 상태이지만, 시각적으로는 2×2 디더 마스크 내에서 4개의 방전 셀(1000a, 1000b, 1000c, 1000d) 각각이 (b)와 같이 0.25의 계조를 구현하는 것으로 보이게 된다.Then, only one of the four discharge cells 1000a, 1000b, 1000c, and 1000d is on and the other three discharge cells are off, but visually, the four discharge cells 1000a, 1000b, 1000c and 1000d) appear to implement a gradation of 0.25 as shown in (b).

이러한 방식으로 정수계조를 이용하여 소수계조를 구현할 수 있다. 이에 따라, 영상의 화질을 향상시킬 수 있다. 이러한 영상 처리 방식은 하프톤 보정 방식의 일례이다.In this way, decimal gradations can be implemented using integer gradations. Accordingly, the image quality of the image can be improved. This image processing method is an example of a halftone correction method.

아울러, 영상의 화질을 더욱 향상시키기 위해 디더 마스크를 회전시킬 수 있다. 이에 대해 살펴보면 다음과 같다.In addition, the dither mask may be rotated to further improve image quality. This is as follows.

다음, 도 11은 디더 마스크의 회전에 대해 설명하기 위한 도면이다.Next, FIG. 11 is a diagram for explaining the rotation of the dither mask.

도 11을 살펴보면, (a)와 같이 2×2 디더 마스크 내의 4개의 방전 셀(1000a, 1000b, 1000c, 1000d) 중 번호 1000a의 방전 셀을 온(On)시키고 나머지 방전 셀을 오프(Off)시킨다. 여기, 도 11에서는 온 되는 방전 셀을 상대적으로 어둡게 표시하였다.Referring to FIG. 11, the discharge cell of the number 1000a of the four discharge cells 1000a, 1000b, 1000c, and 1000d in the 2 × 2 dither mask is turned on and the remaining discharge cells are turned off as shown in (a). . Here, in FIG. 11, the discharge cells to be turned on are relatively dark.

이후, (b)와 같이 4개의 방전 셀(1000a, 1000b, 1000c, 1000d) 중 번호 1000b의 방전 셀을 온(On)시키고 나머지 방전 셀을 오프(Off)시킨다. 이러한 (b)의 경우는 (a)의 경우를 시계 방향(clockwise) 90°회전시킨 것이다.Thereafter, as shown in (b), the discharge cells of the number 1000b of the four discharge cells 1000a, 1000b, 1000c, and 1000d are turned on and the remaining discharge cells are turned off. In the case of (b), the case of (a) is rotated 90 degrees clockwise.

이러한 방식으로, (c)와 같이 (b)의 경우를 다시 시계 방향(clockwise) 90°회전시키고, 이후 (d)와 같이 (c)의 경우를 다시 시계 방향(clockwise) 90°회전시킬 수 있다.In this way, the case of (b) can be rotated clockwise 90 ° again as shown in (c), and the case of (c) can be rotated 90 degrees clockwise again as shown in (d). .

이와 같이, 디더 마스크를 회전시키면서 하프톤 보정을 수행하게 되면 특정 패턴(Pattern)의 디더 마스크가 화면상에 보이는 디더링 노이즈(Noise) 현상의 발생을 억제할 수 있다.As described above, when halftone correction is performed while the dither mask is rotated, it is possible to suppress occurrence of dithering noise phenomenon in which a dither mask of a specific pattern is displayed on the screen.

아울러, 영상의 화질을 더욱 향상시키기 위해 평균 전력 레벨에 관련하여 디더 마스크의 회전속도를 조절할 수 있다. 이에 대해 살펴보면 다음과 같다.In addition, the rotation speed of the dither mask may be adjusted in relation to the average power level to further improve the image quality of the image. This is as follows.

도 12는 평균 전력 레벨에 관련하여 디더 마스크의 회전속도를 조절하는 방법의 일례를 설명하기 위한 도면이다.12 is a view for explaining an example of a method of adjusting the rotational speed of the dither mask in relation to the average power level.

도 12를 살펴보면, 입력되는 영상 데이터의 평균 전력 레벨(Average Power Level : APL)이 제 1 레벨(APL 1)인 경우에는 제 1 속도로 디더 마스크를 회전시킨다.Referring to FIG. 12, when the average power level APL of the input image data is the first level APL 1, the dither mask is rotated at a first speed.

예를 들면, 제 1 프레임에서는 2×2 디더 마스크 내의 4개의 방전 셀(a, b, c, d) 중 a의 방전 셀을 온(On)시키고 나머지 방전 셀을 오프(Off)시킨다. 여기, 도 12에서는 온 되는 방전 셀을 상대적으로 어둡게 표시하였다.For example, in the first frame, the discharge cells of a of the four discharge cells a, b, c, and d in the 2x2 dither mask are turned on and the remaining discharge cells are turned off. In FIG. 12, the discharge cells that are turned on are relatively dark.

다음, 제 2 프레임에서는 4개의 방전 셀(a, b, c, d) 중 b의 방전 셀을 온(On)시키고 나머지 방전 셀을 오프(Off)시킨다. 즉, 디더 마스크를 시계 방 향(clockwise) 90°회전시키면서 하프톤 보정을 수행한다.Next, in the second frame, the discharge cells of b of the four discharge cells a, b, c, and d are turned on and the remaining discharge cells are turned off. That is, halftone correction is performed while rotating the dither mask by 90 ° clockwise.

이러한 방식으로 각각의 프레임별로 디더 마스크를 90°회전시키면서 하프톤 보정을 수행한다.In this manner, halftone correction is performed while rotating the dither mask by 90 ° for each frame.

반면에, 입력되는 영상 데이터의 평균 전력 레벨이 제 1 레벨(APL 1)보다 높은 제 2 레벨인 경우에는 제 1 속도 보다 더 느린 제 2 속도로 디더 마스크를 회전시킨다.On the other hand, when the average power level of the input image data is a second level higher than the first level APL1, the dither mask is rotated at a second speed slower than the first speed.

예를 들면, 제 1 프레임과 제 2 프레임에서는 2×2 디더 마스크 내의 4개의 방전 셀(a, b, c, d) 중 a의 방전 셀을 온(On)시키고 나머지 방전 셀을 오프(Off)시킨다.For example, in the first frame and the second frame, one of the four discharge cells a, b, c, and d in the 2 × 2 dither mask is turned on and the remaining discharge cells are turned off. Let's do it.

다음, 제 3 프레임과 제 4 프레임에서는 4개의 방전 셀(a, b, c, d) 중 b의 방전 셀을 온(On)시키고 나머지 방전 셀을 오프(Off)시킨다.Next, in the third and fourth frames, the discharge cells of b of the four discharge cells a, b, c, and d are turned on and the remaining discharge cells are turned off.

이와 같이, 평균 전력 레벨이 상대적으로 높은 제 2 레벨인 경우에는 디더 마스크를 2개의 프레임마다 시계 방향(clockwise) 90°회전시키면서 하프톤 보정을 수행할 수 있다.As described above, when the average power level is a relatively high second level, halftone correction may be performed while rotating the dither mask by 90 ° clockwise every two frames.

이와 같이, 설정하는 이유에 대해 살펴보면 다음과 같다.As described above, the reason for setting is as follows.

평균 전력 레벨이 상대적으로 낮은 제 1 레벨인 경우에는 전체 방전 셀 중 온 되는 방전 셀의 개수가 상대적으로 적다. 이에 따라, 디더 마스크를 상대적으로 빠른 속도로 회전시키더라도 전체 영상 데이터의 변환 횟수는 상대적으로 적다. 아울러, 디더 마스크를 빠른 속도로 회전시키게 되면 디더링 노이즈가 더욱 저감되는 등의 이유로 인해 영상의 화질이 더욱 향상될 수 있다.When the average power level is a relatively low first level, the number of discharge cells that are turned on among the total discharge cells is relatively small. Accordingly, even when the dither mask is rotated at a relatively high speed, the number of conversions of the entire image data is relatively small. In addition, if the dither mask is rotated at a high speed, the image quality of the image may be further improved due to the reduction of the dither noise.

반면에, 평균 전력 레벨이 상대적으로 높은 제 2 레벨인 경우에는 전체 방전 셀 중 온 되는 방전 셀의 개수가 상대적으로 많다. 이에 따라, 디더 마스크를 상대적으로 빠른 속도로 회전시키게 되면 전체 영상 데이터의 변환 횟수가 급격히 증가할 수 있다. 이에 따라, 변위 전류의 발생이 급격히 증가할 수 있고, 이로 인해 구동부의 스위칭(Switching) 소자들이 전기적 손상을 입을 수 있다.On the other hand, when the average power level is a relatively high second level, the number of discharge cells that are turned on among the total discharge cells is relatively large. Accordingly, when the dither mask is rotated at a relatively high speed, the number of conversions of the entire image data may increase rapidly. As a result, the generation of the displacement current may increase rapidly, which may cause electrical damage to the switching elements of the driving unit.

따라서 평균 전력 레벨이 상대적으로 낮은 경우에는 디더 마스크의 회전 속도를 상대적으로 빠르게 하고, 반면에 평균 전력 레벨이 상대적으로 높은 경우에는 디더 마스크의 회전 속도를 상대적으로 느리게 하는 것이다.Therefore, when the average power level is relatively low, the rotation speed of the dither mask is relatively high. On the other hand, when the average power level is relatively high, the rotation speed of the dither mask is relatively slow.

아울러, 영상의 화질을 더욱 향상시키고 아울러 구동부의 전기적 손상을 보다 효과적으로 방지하기 위해 평균 전력 레벨이 제 1 레벨인 경우에서의 제 1 속도를 평균 전력 레벨이 제 2 레벨인 경우에서의 제 2 속도의 1배 초과 10배 이하로 설정할 수 있다.In addition, the first speed when the average power level is the first level and the second speed when the average power level is the second level to further improve the image quality of the image and more effectively prevent electrical damage to the driver. It can be set more than 1 time and less than 10 times.

다음, 도 13a 내지 도 13b는 평균 전력 레벨에 관련하여 디더 마스크의 회전속도를 조절하는 방법의 다른 예를 설명하기 위한 도면이다.Next, FIGS. 13A to 13B are views for explaining another example of a method of adjusting the rotation speed of the dither mask in relation to the average power level.

먼저, 도 13a를 살펴보면 입력되는 영상 데이터의 평균 전력 레벨이 임계 레벨 이하인 경우에 디더 마스크의 회전 속도를 증가시킬 수 있다.First, referring to FIG. 13A, when the average power level of the input image data is less than or equal to the threshold level, the rotation speed of the dither mask may be increased.

예를 들면, 임계 레벨이 P1 레벨이라고 가정하면 입력되는 영상 데이터의 평균 전력 레벨이 임계 레벨인 P1 레벨보다 큰 경우에는 디더 마스크의 회전 속도를 S1로 유지한다. 반면에, 입력되는 영상 데이터의 평균 전력 레벨이 임계 레벨인 P1 레벨 이하인 경우에는 디더 마스크의 회전 속도를 S1보다 빠른 S2로 설정할 수 있 다.For example, assuming that the threshold level is a P1 level, when the average power level of the input image data is larger than the threshold level P1, the rotation speed of the dither mask is maintained at S1. On the other hand, when the average power level of the input image data is below the threshold level P1, the rotation speed of the dither mask may be set to S2 which is faster than S1.

다음, 도 13b를 살펴보면 입력되는 영상 데이터의 평균 전력 레벨이 임계 레벨 이상인 경우에 디더 마스크의 회전 속도를 감소시킬 수 있다.Next, referring to FIG. 13B, when the average power level of the input image data is greater than or equal to the threshold level, the rotation speed of the dither mask may be decreased.

예를 들면, 임계 레벨이 P2 레벨이라고 가정하면 입력되는 영상 데이터의 평균 전력 레벨이 임계 레벨인 P2 레벨보다 작은 경우에는 디더 마스크의 회전 속도를 S3으로 유지한다. 반면에, 입력되는 영상 데이터의 평균 전력 레벨이 임계 레벨인 P2 레벨 이상인 경우에는 디더 마스크의 회전 속도를 S3보다 느린 S4로 설정할 수 있다.For example, assuming that the threshold level is the P2 level, when the average power level of the input image data is smaller than the threshold level P2, the rotation speed of the dither mask is maintained at S3. On the other hand, when the average power level of the input image data is equal to or higher than the threshold level P2, the rotation speed of the dither mask may be set to S4 which is slower than S3.

다음, 도 14는 평균 전력 레벨에 관련하여 디더 마스크의 회전속도를 조절하는 방법의 또 다른 예를 설명하기 위한 도면이다.Next, FIG. 14 is a view for explaining another example of a method of adjusting the rotation speed of the dither mask in relation to the average power level.

도 14를 살펴보면 입력되는 영상 데이터의 평균 전력 레벨이 상대적으로 낮은 a 영역에 포함되는 경우에 디더 마스크의 회전 속도를 1ns로 설정할 수 있다. 즉, 1ns 마다 디더 마스크를 소정 각도로 회전시킬 수 있다.Referring to FIG. 14, when the average power level of the input image data is included in a relatively low region, the rotation speed of the dither mask may be set to 1 ns. That is, the dither mask may be rotated at a predetermined angle every 1 ns.

또한, 평균 전력 레벨이 a 영역보다는 높은 b 영역에 포함되는 경우에는 2ns 마다 디더 마스크를 소정 각도로 회전시키고, 평균 전력 레벨이 b 영역보다는 높은 c 영역에 포함되는 경우에는 3ns 마다 디더 마스크를 소정 각도로 회전시키고, 평균 전력 레벨이 c 영역보다는 높은 d 영역에 포함되는 경우에는 4ns 마다 디더 마스크를 소정 각도로 회전시킬 수 있다.In addition, when the average power level is included in the b region higher than the a region, the dither mask is rotated at a predetermined angle every 2 ns. When the average power level is included in the c region higher than the b region, the dither mask is rotated at a predetermined angle every 3 ns. If the average power level is included in the d region higher than the c region, the dither mask may be rotated at a predetermined angle every 4 ns.

이상에서와 같이, 다양한 방법으로 디더 마스크를 회전속도를 조절할 수 있다.As described above, the rotation speed of the dither mask may be adjusted in various ways.

이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 예를 들면, 이상에서는 2×2 디더 마스크를 이용하는 경우만을 설명하였지만, 3×3 디더 마스크, 4×4 디더 마스크, 4×3 디더 마스크, 8×8 디더 마스크를 이용하는 것도 가능한 것이다.As such, the technical configuration of the present invention described above can be understood by those skilled in the art that the present invention can be implemented in other specific forms without changing the technical spirit or essential features of the present invention. For example, although only the case where 2x2 dither mask is used was demonstrated above, it is also possible to use a 3x3 dither mask, a 4x4 dither mask, a 4x3 dither mask, and an 8x8 dither mask.

그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 전술한 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.Therefore, the exemplary embodiments described above are to be understood as illustrative and not restrictive in all respects, and the scope of the present invention is indicated by the appended claims rather than the foregoing detailed description, and the meaning and scope of the claims are as follows. And all changes or modifications derived from the equivalent concept should be interpreted as being included in the scope of the present invention.

이상에서 상세히 설명한 바와 같이 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 평균 전력 레벨에 관련하여 디더 마스크의 회전속도를 조절함으로써, 영상의 화질을 향상시키고 아울러 구동부의 전기적 손상을 방지하는 효과가 있다.As described in detail above, the plasma display apparatus according to the exemplary embodiment of the present invention has an effect of improving image quality and preventing electrical damage to the driving unit by adjusting the rotation speed of the dither mask in relation to the average power level. .

Claims (4)

영상을 표시하는 플라즈마 디스플레이 패널과,A plasma display panel for displaying an image, 디더 마스크(Dither Mask)를 이용하여 상기 영상의 계조를 구현하고, 입력되는 영상 데이터의 평균 전력 레벨(Average Power Level : APL)이 제 1 레벨(APL 1)인 경우에는 제 1 속도로 상기 디더 마스크를 회전시키고, 상기 평균 전력 레벨이 상기 제 1 레벨보다 높은 제 2 레벨에서는 상기 제 1 속도보다 느린 제 2 속도로 상기 디더 마스크를 회전시키는 구동부The dither mask is implemented using a dither mask, and when the average power level (APL) of the input image data is the first level APL1, the dither mask is operated at a first speed. And rotate the dither mask at a second speed slower than the first speed when the average power level is higher than the first level. 를 포함하는 플라즈마 디스플레이 장치.Plasma display device comprising a. 제 1 항에 있어서,The method of claim 1, 상기 구동부는The driving unit 상기 입력되는 영상 데이터의 평균 전력 레벨이 임계 레벨 이하인 경우에 상기 디더 마스크의 회전 속도를 증가시키는 플라즈마 디스플레이 장치.And a rotation speed of the dither mask is increased when the average power level of the input image data is equal to or less than a threshold level. 제 1 항에 있어서,The method of claim 1, 상기 구동부는The driving unit 상기 입력되는 영상 데이터의 평균 전력 레벨이 임계 레벨 이상인 경우에 상기 디더 마스크의 회전 속도를 감소시키는 플라즈마 디스플레이 장치.And a rotation speed of the dither mask when the average power level of the input image data is greater than or equal to a threshold level. 제 1 항에 있어서,The method of claim 1, 상기 제 1 속도는 제 2 속도의 1배 초과 10배 이하인 플라즈마 디스플레이 장치.And the first speed is greater than one time and less than ten times the second speed.
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