KR20070022960A - 플라즈마 디스플레이 패널의 구동방법 및 장치 - Google Patents

플라즈마 디스플레이 패널의 구동방법 및 장치 Download PDF

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Abstract

본 발명은 셋업기간동안 벽전하 분포를 안정화시킬 수 있는 플라즈마 디스플레이 패널의 구동방법 및 장치에 관한 것이다.
본 발명에 따른 플라즈마 디스플레이 구동장치는 복수의 서스테인 전극; 및 셀을 초기화하는 리셋기간 이전에 그라운드에서 스캔전압까지 하강하는 이레이즈 램프파형을 서스테인 전극에 공급하는 서스테인 구동부를 포함하는 것을 특징으로 한다.
본 발명의 실시 예에 따르면, 리셋기간에 발생하는 리셋방전을 오방전 및 미스 방전없이 올바르게 실시할 수 있다. 또한, 본 발명에 따른 PDP의 구동방법 및 장치는 리셋기간 동안 스캔전극과 서스테인전극에 유사한 상승 램프파형 및 하강 램프파형을 각각 공급함으로써 암방전을 최소화하여 콘트라스트를 개선시키고, 서스테인전극에 정극성의 전하를 쌓게 함으로 어드레스기간 동안 면방전 발생을 원할하게 할 수 있다.

Description

플라즈마 디스플레이 패널의 구동방법 및 장치{METHOD AND APPARATUS FOR DRIVING PLASMA DISPLAY PANEL}
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널의 전극배치를 개략적으로 나타내는 평면도이다.
도 2는 256 계조를 구현하기 위한 8 비트 디폴트 코드의 서브필드 패턴을 나타내는 도면이다.
도 3은 통상적인 PDP의 구동 파형을 나타내는 파형도이다.
도 4는 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 구동장치를 개략적으로 나타내는 블럭도이다.
도 5는 본 발명의 제 1 실시 예에 따른 PDP의 구동파형을 나타내는 파형도이다.
도 6은 본 발명의 제 2 실시 예에 따른 PDP의 구동파형을 나타내는 파형도이다.
< 도면의 주요 부분에 대한 부호의 설명 >
31 : 타이밍콘트롤러 32 : 데이터구동부
33 : 스캔구동부 34 : 서스테인구동부
35 : 구동전압 발생부
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 특히 셋업기간동안 벽전하 분포를 안정화시킬수 있는 플라즈마 디스플레이 패널의 구동방법 및 장치에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 한다)은 He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 방전할 때 발생하는 자외선을 이용하여 형광체를 여기 발광시킴으로써 화상을 표시하게 된다. 이러한 PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 화질이 향상되고 있다.
도 1을 참조하면, 종래의 3전극 교류 면방전형 PDP의 방전셀은 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z)과, 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z)과 직교하는 어드레스전극(X1 내지 Xm)을 포함한다.
스캔전극(Y1 내지 Yn), 서스테인전극(Z) 및 어드레스전극(X1 내지 Xm)의 교차부에는 적색, 녹색 및 청색 중 어느 하나를 표시하기 위한 셀(1)이 형성된다. 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z)은 도시하지 않은 상부기판 상에 형성된다. 상부기판에는 도시하지 않는 유전체층과 MgO 보호층이 적층된다. 어드레스전극(X1 내지 Xm)은 도시하지 않은 하부기판 상에 형성된다. 하부기판 상에는 수평으로 인접한 셀들 간에 광학적, 전기적 혼신을 방지하기 위한 격벽이 형성된다. 하부기판과 격벽 표면에는 진공자외선에 의해 여기되어 가시광을 방출하는 형광체가 형성된다. 상부기판과 하부기판 사이의 방전공간에는 He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 주입된다.
PDP는 화상의 계조를 구현하기 위하여, 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 시분할 구동하게 된다. 각 서브필드는 전화면을 초기화시키기 위한 리셋기간과, 주사라인을 선택하고 선택된 주사라인에서 셀을 선택하기 위한 어드레스기간과, 방전횟수에 따라 계조를 구현하는 서스테인기간으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 도 2와 같이 1/60 초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들(SF1 내지 SF8)로 나누어지게 된다. 8개의 서브 필드들(SF1 내지 SF8) 각각은 전술한 바와 같이, 초기화기간, 어드레스기간 및 서스테인기간으로 나누어지게 된다. 각 서브필드의 초기화기간과 어드레스 기간은 각 서브필드마다 동일한 반면에 서스테인 기간과 그에 할당되는 서스테인펄스의 수는 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
도 3은 두 개의 서브필드에 공급되는 PDP의 구동파형을 나타낸다.
도 3을 참조하면, PDP는 전화면을 초기화시키기 위한 초기화기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간으로 나누어 구동된다.
리셋기간의 초기에는 모든 스캔전극들(Y)에 상승 램프파형(Ramp-up)이 인가되며, 서스테인전극(Z)과 어드레스전극(X)에는 0[V]가 인가된다. 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에서 스캔전극(Y)과 어드레스전극(X) 사이와 스캔전극(Y)과 서스테인전극(Z) 사이에는 빛이 거의 발생되지 않는 쓰기 암방전(Dark discharge) 또는 셋업방전이 일어난다. 이러한 셋업방전에 의해 어드레스전극(X)과 서스테인전극(Z) 상에는 정극성(+)의 벽전하가 쌓이게 되며, 스캔전극(Y) 상에는 부극성(-)의 벽전하가 쌓이게 된다.
리셋기간의 후기에는 대략 서스테인전압(Vs)부터 하강하기 시작하는 하강 램프파형(Ramp-dn)이 스캔전극들(Y)에 동시에 인가된다. 이와 동시에, 서스테인전극(Z)에는 정극성의 서스테인전압(Vs)이 인가되고, 어드레스전극(X)에는 0[V]가 인가된다. 이렇게 하강 램프파형(Ramp-dn)이 인가될 때, 스캔전극(Y)과 서스테인전극(Z) 사이에 빛이 거의 발생되지 않는 소거 암방전 또는 셋다운방전이 일어난다. 이러한 셋다운방전에 의해 어드레스방전에 불필요한 과도 벽전하가 소거된다.
어드레스기간에는 부극성 스캔펄스(scan)가 스캔전극들(Y)에 순차적으로 인가됨과 동시에 스캔펄스(scan)에 동기되어 어드레스전극들(X)에 정극성의 데이터펄스(data)가 인가된다. 스캔펄스(scan)와 데이터펄스(data)의 전압차와 초기화기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 인가되는 셀 내에는 어드레스 방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 서스테인전압(Vs)이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다.
서스테인전극(Z)에는 셋다운기간과 어드레스기간 동안에 스캔전극(Y)과의 전 압차를 줄여 스캔전극(Y)과의 오방전이 일어나지 않도록 정극성 직류전압(Zdc)이 공급된다.
서스테인기간에는 스캔전극들(Y)과 서스테인전극들(Z)에 교번적으로 서스테인펄스(sus)가 인가된다. 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 인가될 때 마다 스캔전극(Y)과 서스테인전극(Z) 사이에 서스테인방전 즉, 표시방전이 일어나게 된다.
이와 같은 구조를 가지는 종래의 PDP는 하나의 서브필드 기간이 시작하기 전에 벽전하가 모두 소실되어야, 새로 시작되는 서브필드 기간의 벽전하가 안정화되어 리셋기간이 올바르게 실시될 수 있다. 이러하 벽전하의 소실을 위하여 다양한 파형이 제안되고 있으나, 별도의 전압공급원이 필요하는 등 효율적인 벽전하 소실이 어려운 실정이다.
따라서, 본 발명의 목적은 셋업기간동안 벽전하 분포를 안정화시킬 수 있는 PDP의 구동방법 및 장치를 제공하는 데 있다.
상기 목적을 달성하기 위하여, 본 발명에 따른 플라즈마 디스플레이 구동장치는 복수의 서스테인 전극; 및 셀을 초기화하는 리셋기간 이전에 그라운드에서 스캔전압까지 하강하는 이레이즈 램프파형을 서스테인 전극들에 공급하는 서스테인 구동부를 포함하는 것을 특징으로 한다.
상기 이레이즈 하강램프파형은 그라운드전압에서 스캔전압까지 하강하는 것을 특징으로 한다.
상기 이레이즈 하강램프파형은 공급되는 시간이 50um ~ 150um 사이인 것을 특징으로 한다.
본 발명의 실시 예에 따른 플라즈마 디스플레이 구동장치는 셀을 초기화하는 리셋기간 이전에 이레이즈 하강램프파형을 서스테인전극들에 공급하고, 상기 리셋기간에는 스캔전극에 공급되는 파형과 유사한 상승 및 하강 램프파형을 서스테인 전극에 공급하는 서스테인 구동부를 포함하는 것을 특징으로 한다.
상기 서스테인 구동부는 상기 리셋기간이 셋업 기간 및 셋다운 기간을 포함하는 경우, 상기 셋업 기간에 상기 상승 램프파형이 공급되며, 상기 셋다운 기간에는 상기 하강 램프파형이 공급되는 것을 특징으로 ㅍ
상기 서스테인 구동부는 어드레스 기간 동안 서스테인 전압에 해당하는 정극성의 직류전압을 상기 서스테인 전극들에 공급하는 것을 특징으로 한다.
상기 이레이즈 하강램프파형은 그라운드전압에서 스캔전압까지 하강하는 것을 특징으로 한다.
상기 이레이즈 하강램프파형은 공급되는 시간이 50um ~ 150um 사이인 것을 특징으로 한다.
본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 구동방법은 셀을 초기화하기 위한 리셋기간; 셀을 어드레싱하기 위한 어드레스기간; 방전을 유지하기 위한 서스테인기간; 및 상기 리셋기간 이전에 벽전하를 제거하기 위한 이레이즈 기간을 포함하며, 상기 이레이즈 기간 동안 하강 램프파형인 이레이즈 램프파형이 공급되는 것을 특징으로 한다.
상기 이레이즈 램프파형은 그라운드 전압에서 스캔전압까지 하강하는 하강 램프파형인 것을 특징으로 한다.
상기 플라즈마 디스플레이 패널의 구동방법은 상기 리셋 기간 동안 스캔전극들과 서스테인 전극들에 공급되는 전압파형이 유사한 것을 특징으로 한다.
이하, 도 4 내지 도 6을 참조하여 본 발명의 바람직한 실시 예들에 대하여 설명하기로 한다.
도 4를 참조하면, 본 발명의 제 1 실시 예에 따른 PDP의 구동장치는 PDP의 어드레스전극들(X1 내지 Xm)에 데이터를 공급하기 위한 데이터구동부(32), 스캔전극들(Y1 내지 Yn)을 구동하기 위한 스캔구동부(33), 공통전극인 서스테인전극(Z)을 구동하기 위한 서스테인구동부(34), 각 구동부(32,33,34)를 제어하기 위한 타이밍콘트롤러(31) 및 각 구동부(32,33,34)에 구동전압을 공급하기 위한 구동전압 발생부(35)를 포함한다.
데이터구동부(32)에는 도시하지 않은 역감마보정회로, 오차확산회로 등에 의해 역감마보정 및 오차확산 된 후, 서브필드 맵핑회로에 의해 미리 설정된 서브필드 패턴에 맵핑된 데이터가 공급된다. 이 데이터구동부(32)는 타이밍콘트롤러(31)의 제어 하에 데이터를 샘플링하고 래치한 다음, 그 데이터를 어드레스전극들(X1 내지 Xm)에 공급하게 된다.
스캔구동부(33)는 타이밍 콘트롤러(31)의 제어 하에 전화면을 초기화하기 위하여 리셋기간 중 셋업 기간(Set_up)동안 상승 램프파형(Ramp_up)을 공급하며 및 셋 다운기간(Set_down)동안에는 하강 램프파형(Ramp-dn)을 스캔전극들(Y1 내지 Yn)에 연속으로 공급한 후, 스캔라인을 선택하기 위하여 어드레스기간 동안 부극성의 스캔펄스(scan)를 스캔전극들(Y1 내지 Yn)에 순차적으로 공급하게 된다. 보다 구체적으로 설명하면, 셋업 기간(Set_up)에 공급되는 상승 램프파형(Ramp_up)은 400[V]까지 상승하다가 셋 다운(Set_down) 기간에는 스캔전압 예를 들면, -90[V]까지 하강하는 하강 램프파형(Ramp_dn)이 공급된다.
서스테인구동부(34)는 타이밍 콘트롤러(31)의 제어 하에 셋업 기간(Set_up) 이전에는 하강하는 이레이즈 램프파형(Erase_dn)을 공급함과 아울러, 셋업 기간 동안에는 그라운드(GND) 전압이 공급되며, 셋 다운 기간(Set_down)에는 정극성의 직류전압을 서스테인전극(Z)에 공급한 후, 서스테인기간 동안 스캔구동부(33)와 교대로 동작하여 서스테인펄스를 서스테인전극(Z)에 공급한다. 보다 구체적으로, 이레이즈 램프파형(Erase_dn)은 0[V]에서 스캔전압 예를 들면, -90[V]까지 하강하는 하강 램프파 형태로 공급되며, 정극성의 직류전압은 서스테인전압(Vs)과 유사한 대략 190[V] 정도로 공급된다. 또한 서스테인 구동부(34)는 타이밍 콘트롤러(31)의 제어 하에 셋업 기간(Set_up) 이전에는 하강하는 이레이즈 램프파형(Erase_dn)을 공급함과 아울러, 셋업 기간 및 셋 다운기간(Set_up, Set_down)동안 스캔 구동부에 공급되는 파형과 유사한 파형이 공급될 수 있다. 이에 관하여, 도 5 및 도 6을 참조하여 상세히 후술하기로 한다.
타이밍 콘트롤러(31)는 수직/수평 동기신호를 입력받고 각 구동부(32,33,34)에 필요한 타이밍제어신호(CTRX,CTRY,CTRZ)를 발생하고 그 타이밍제어신호(CTRX,CTRY,CTRZ)를 해당 구동부(32,33,34)에 공급함으로써 각 구동부(32,33,34)를 제어하게 된다. 데이터구동부(32)에 공급되는 타이밍제어신호(CTRX)에는 데이터를 샘플링하기 위한 샘플링클럭, 래치제어신호, 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다. 타이밍 콘트롤러(31)로부터 스캔구동부(33)에 인가되는 타이밍제어신호(CTRY)에는 스캔구동부(33) 내의 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다. 그리고 타이밍 콘트롤러(31)로부터 서스테인구동부(34)에 인가되는 타이밍제어신호(CTRZ)에는 서스테인구동부(34) 내의 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다.
구동전압 발생부(35)는 상승 램프파형의 상한 전압으로 공급되는 셋업전압(Vsetup), 어드레스기간 동안 스캔전극(Y)에 공급되는 스캔바이어스전압(Vscan-com), 대략 서스테인전압(Vs)부터 하강하기 시작하여 스캔전압(Vscan)하강하는 하강 램프파형(Ramp-dn)을 가지는 셋다운전압(Vsetdown)과, 0[V]에서 스캔전압(Vscan)까지 하강하는 이레이즈 램프파형(Erase_dn)과, 스캔펄스의 전압으로 설정되는 스캔전압(Vscan), 서스테인펄스의 서스테인전압(Vs), 데이터전압(Vd) 등을 발생한다. 스캔바이어스전압(Vscan-com)은 서스테인전압(Vs)보다 낮은 정극성 전압으로 설정된다. 스캔전압(Vscan)은 -70∼-100[V] 내에서 선택될 수 있다. 서스테인전압(Vs)은 180∼200[V] 내에서 선택될 수 있다. 데이터전압(Vd)은 대략 50∼80[V] 사이에서 선택될 수 있다. 이레이즈 램프파형(Erase_dn)은 셋 다운 전압(Vsetdown)의 타이밍을 조절하여 생성할 수 있다.
한편, 상기 전압조건은 위와 같이 한정되는 것이 아니라 PDP의 방전특성이나 모델에 따라 달라질 수 있다.
도 5는 본 발명의 제 1 실시 예에 따른 PDP의 구동파형을 나타낸다.
도 5를 참조하면, 본 발명의 제 1 실시 예에 따른 PDP는 벽전하분포를 안정시키기 위한 이레이즈 기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시킴과 아울러 후반부에 전 셀을 초기화시키기는 서스테인기간으로 나누어 구동된다.
이레이즈 기간에는 그라운드(GND)에서 스캔전압 예를 들면, -90[V]까지 하강하는 이레이즈 램프파형(Erase_dn)이 인가된다. 이러한 이레이즈 램프파형(Erase_dn)이 리셋기간 이전에 인가됨에 따라, 벽전하들이 모두 소실되게 된다.
리셋기간의 초기 즉 셋업기간(Set_up)에는 모든 스캔전극들(Y)에 셋업전압(Vsetup)까지 상승하는 상승 램프파형(Ramp-up)이 인가된다. 이와 동시에, 서스테인전극(Z)과 어드레스전극(X)에는 0[V]가 인가된다. 이 상승 램프파형(Ramp-up)은 스캔전극(Y)과 서스테인전극(Z) 사이의 전압차와, 스캔전극(Y)과 어드레스전극(X) 사이의 전압차를 크게 하여 셋업방전을 안정하게 일으킴으로써 스캔전극(Y) 사이에 충분한 양의 부극성 벽전하를 축적시키게 된다.
리셋기간의 후기 즉 셋 다운(Set_down)에는 대략 서스테인전압(Vs)부터 하강하기 시작하여 스캔전압(Vscan)까지 하강하는 하강 램프파형(Ramp-dn)이 스캔전극 들(Y)에 인가된다. 이와 동시에, 서스테인전극(Z)에는 서스테인전압(Vs)이 인가되고, 어드레스전극(X)에는 0[V]가 인가된다. 이렇게 하강 램프파형(Ramp-dn)이 인가될 때, 스캔전극(Y)과 서스테인전극(Z) 사이에 빛이 거의 발생되지 않는 소거 암방전 또는 셋다운방전이 일어난다. 이러한 셋다운방전에 의해 어드레스방전에 불필요한 과도한 벽전하가 소거된다.
어드레스기간과 서스테인기간은 전술한 도 3의 그 것과 실질적으로 동일하므로 이에 대한 상세한 설명을 생략하기로 한다.
이와 같은 방식으로 구동되는 본 발명의 제 1 실시 예에 따른 PDP의 구동파형은 이레이즈 기간 동안 그라운드에서 스캔전압까지 하강하는 이레이즈 램프파형(Erase_dn)이 인가됨으로 벽전하를 소실시켜 다음 서브시필드의 리셋기간동안 초기화 과정이 올바르게 진행될 수 있도록 한다. 또한, 이레이즈 램프파형(Erase_dn)은 셋 다운 기간에 공급되는 하강 램프파형(Ramp_dn)가 기울기가 같으며, 타이밍 콘트롤러(31)에 의해 타이밍 조절이 가능하므로 별도의 전원이 필요하지 않게 된다. 여기서, 이레이즈 램프파형(Erase_dn)의 공급 시간은 50um ~ 150um 정도가 적절한다.
도 6은 본 발명의 제 2 실시 예에 따른 PDP의 구동파형을 나타낸 도면이다.
도 6을 참조하면, 본 발명의 제 2 실시 예에 따른 PDP는 벽전하분포를 안정시키기 위한 이레이즈 기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시킴과 아울러 후반부에 전 셀을 초기화시키기는 서스테인기간으로 나누어 구동된다.
이레이즈 기간에는 그라운드(GND)에서 -90[V]까지 하강하는 이레이즈 램프파 형(Erase_dn)이 인가된다. 이러한 이레이즈 램프파형(Erase_dn)이 리셋기간 이전에 인가됨에 따라, 벽전하들이 모두 소실되게 된다.
리셋기간의 초기 즉 셋업기간(Set_up)에는 모든 스캔전극들(Y) 및 서스테인전극(Z)에 셋업전압(Vsetup)까지 상승하는 상승 램프파형(Ramp-up)이 인가된다. 이와 동시에, 어드레스전극(X)에는 0[V]가 인가된다. 이 상승 램프파형(Ramp-up)은 서스테인전극(Z)에 정극성의 전하를 쌓게 함으로써 어드레스 기간에 면방전이 잘 발생할 수 있도록 돕게 된다.
리셋기간의 후기 즉 셋 다운(Set_down)에는 대략 서스테인전압(Vs)부터 하강하기 시작하여 스캔전압(Vscan)까지 하강하는 하강 램프파형(Ramp-dn)이 스캔전극들(Y)과 서스테인전극(Z)들에 인가된다. 이와 동시에, 어드레스전극(X)에는 0[V]가 인가된다. 이렇게 하강 램프파형(Ramp-dn)이 인가될 때, 스캔전극(Y)과 서스테인전극(Z) 사이에 빛이 거의 발생되지 않는 소거 암방전 또는 셋다운방전이 일어난다. 이러한 셋다운방전에 의해 어드레스방전에 불필요한 과도 벽전하가 소거된다.
어드레스기간과 서스테인기간은 전술한 도 3의 그 것과 실질적으로 동일하므로 이에 대한 상세한 설명을 생략하기로 한다.
이와 같은 방식으로 구동되는 본 발명의 제 2 실시 예에 따른 PDP의 구동파형은 이레이즈 기간 동안 그라운드에서 스캔전압까지 하강하는 이레이즈 램프파형(Erase_dn)이 인가됨으로 벽전하를 소실시켜 다음 서브시필드의 리셋기간동안 초기화 과정이 올바르게 진행될 수 있도록 한다. 또한, 리셋 기간동안 스캔전극들(Y)과 서스테인 전극들(Z)에 공급되는 파형이 유사하게 공급됨으로써, 스캔전극들(Y)과 서스테인 전극들(Z) 사이의 전압차가 줄어들게 되어 방전 발생을 최소화함으로써 콘트라스트를 개선할 수 있으며, 서스테인 전극들(Z)에 정극성 전하가 쌓게 됨으로, 어드레스 기간에 면방전이 잘 발생할 수 있게 된다.
상술한 바와 같이, 본 발명에 따른 PDP의 구동방법 및 장치는 이레이즈 기간 동안 그라운드에서 스캔전압까지 하강하는 이레이즈 램프파형을 공급함으로써 새로운 서브필드가 시작하기 전에 벽전하를 소실함으로써 리셋기간에 발생하는 리셋방전을 오방전 및 미스 방전없이 올바르게 실시할 수 있다. 또한, 본 발명에 따른 PDP의 구동방법 및 장치는 리셋기간 동안 스캔전극과 서스테인전극에 유사한 상승 램프파형 및 하강 램프파형을 각각 공급함으로써 암방전을 최소화하여 콘트라스트를 개선시키고, 서스테인전극에 정극성의 전하를 쌓게 함으로 어드레스기간 동안 면방전 발생을 원할하게 할 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여 져야만 할 것이다.

Claims (11)

  1. 복수의 서스테인 전극; 및
    셀을 초기화하는 리셋기간 이전에 그라운드에서 스캔전압까지 하강하는 이레이즈 램프파형을 상기 서스테인 전극에 공급하는 서스테인 구동부를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  2. 제 1 항에 있어서,
    상기 이레이즈 하강램프파형은
    그라운드전압에서 스캔전압까지 하강하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  3. 제 1 항에 있어서,
    상기 이레이즈 하강램프파형은
    공급되는 시간이 50um ~ 150um 사이인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  4. 셀을 초기화하는 리셋기간 이전에 이레이즈 하강램프파형을 서스테인전극들에 공급하고,
    상기 리셋기간에는 스캔전극에 공급되는 파형과 유사한 상승 및 하강 램프파 형을 서스테인 전극에 공급하는 서스테인 구동부를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  5. 제 4 항에 있어서,
    상기 서스테인 구동부는
    상기 리셋기간이 셋업 기간 및 셋다운 기간을 포함하는 경우, 상기 셋업 기간에 상기 상승 램프파형이 공급되며, 상기 셋다운 기간에는 상기 하강 램프파형이 공급되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  6. 제 4 항에 있어서,
    상기 서스테인 구동부는
    어드레스 기간 동안 서스테인 전압에 해당하는 정극성의 직류전압을 상기 서스테인 전극들에 공급하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  7. 제 4 항에 있어서,
    상기 이레이즈 하강램프파형은
    그라운드전압에서 스캔전압까지 하강하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  8. 제 4 항에 있어서,
    상기 이레이즈 하강램프파형은
    공급되는 시간이 50um ~ 150um 사이인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  9. 셀을 초기화하기 위한 리셋기간;
    셀을 어드레싱하기 위한 어드레스기간;
    방전을 유지하기 위한 서스테인기간; 및
    상기 리셋기간 이전에 벽전하를 제거하기 위한 이레이즈 기간을 포함하며,
    상기 이레이즈 기간 동안 하강 램프파형인 이레이즈 램프파형이 공급되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  10. 제 9 항에 있어서,
    상기 이레이즈 램프파형은
    그라운드 전압에서 스캔전압까지 하강하는 하강 램프파형인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  11. 제 9 항에 있어서
    상기 리셋 기간 동안
    스캔전극들과 서스테인 전극들에 공급되는 전압파형이 유사한 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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