KR20060025202A - 순방향 에러 정정을 제공하기 위한 방법 및 장치 - Google Patents

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Abstract

개시된 실시예는 순방향 에러 정정(FEC) 패킷을 생성하는 시스템에 대한 것이다. 이 시스템은 제1 FEC 인코더를 포함하는데, 이 인코더는 데이터를 수신하며 (FEC 인코딩된 데이터를 형성하기 위해) 제1 FEC 데이터를 수신 데이터로 인코딩한다. 또한 이 시스템에는 제2 FEC 인코더도 포함되는데, 이 인코더는 제2 FEC 데이터를 생성하기 위해 FEC 인코딩된 데이터를 인코딩한다. FEC 패킷 포맷터는 제2 FEC 데이터를 FEC 패킷으로 만든다.

Description

순방향 에러 정정을 제공하기 위한 방법 및 장치{METHOD AND APPARATUS FOR PROVIDING FORWARD ERROR CORRECTION}
본 발명은 시분할 다중 접속(TDMA) 통신 시스템에서 순방향 에러 정정(FEC)를 제공하는 것과 관계 있다.
이 부분은, 아래에서 설명되고/되거나 청구되는 본 발명의 다양한 측면과 관계 있을 수 있는 다양한 기술 측면을 소개하기 위해 의도된다. 본 검토는 본 발명의 다양한 측면에 대한 더 나은 이해를 촉진시키기 위한 배경 정보를 독자에게 제공하는데 유익한 것으로 생각된다. 따라서, 본 기록은 이러한 관점에서 읽혀져야 하며, 종래 기술을 인정하는 것으로서 읽혀져서는 안 된다는 것이 이해되어야 한다.
TDMA 통신 시스템에서, 베이스 유닛은 다른 베이스 유닛과 다수의 로컬 모바일 단말기(MT) 사이의 통신을 촉진시킨다. 베이스 유닛과 모바일 단말기는 통상, 특정 주파수로 또는 주파수 그룹으로 데이터 신호를 송신하고 수신할 수 있다. 데이터 신호는 타임 슬롯으로 알려진 다수의 더욱 작은 인크리먼트로 분할되는데, 이는 각각의 데이터 신호 사이클 동안에 되풀이될 수 있다. 소정의 통신 세션 동안에, 모바일 단말기에 특정 타임 슬롯이 할당될 수 있다. 이 모바일 단말기로부터 나오는 데이터는 통신 세션이 지속되는 동안 할당된 시간 슬롯 내에서 송신될 수 있다. 소정의 기지국 환경에서, 적어도 일부의 타임 슬롯이 소정의 시간에 사용되지 않는 것이 통상적이다.
FEC는 TDMA 통신을 포함하는 디지털 통신을 개선시키는데 유익한 기술이다. FEC를 사용하는 통신 시스템에서, 에러 정정 패리티 비트가 실제 통신 데이터를 포함하는 패킷과 함께 송신될 수 있다. 에러 정정 패리티 비트는 데이터를 정확하게 재구성하기 위해 데이터 송신의 수신 종단 상에서 사용될 수 있다.
FEC는 다른 가능한 것보다 데이터가 더 적은 전력을 사용해서 송신될 수 있게 하는데, 그 이유는 FEC 시스템은 일정 정도의 에러있는 데이터를 극복 또는 허용할 수 있기 때문이다. FEC의 세기는 통상, 소정의 수의 데이터 비트에 대해 송신되는 FEC 패리티 비트의 수와 비례한다. (예컨대, 데이터 비트 당 더욱 많은 패리티 비트를 사용해서) 강한 FEC 코드를 사용하는 시스템은 더 많은 수의 에러있는 데이터 비트를 허용할 수 있으며 또한 정확한 데이터 패킷 재구성을 허용한다. 이러한 시스템은 소정의 정보 처리량을 위한 증가된 모바일 단말기 범위, 더 긴 배터리 수명 및 더 낮은 송신기 전력을 촉진할 수 있다.
그러나, 소정의 통신 시스템에 대한 (변조 유형, FEC 방식, 허용된 대역폭, 매체 액세스 제어 등과 같은) 송신 방식 파라미터는 통상, 한정 및 고정되어 있다. 이러한 시스템에서, 모바일 단말기의 범위를 증가시키기 위한 (또는 소정의 범위 및 처리량을 위한 전력 소비를 감소시키기 위한)유일한 방식은 종래에, 송신기 전력을 증가시키는 것이었는데, 이는 배터리 수명을 단축시킨다. TDMA 통신 시스템에 서 FEC 성능을 개선시키는 장치 및 방법이 바람직하다.
개시된 실시예는 순방향 에러 정정(FEC) 패킷을 생성하는 시스템에 대한 것이다. 이 시스템은 제1 FEC 인코더를 포함하는데, 이 인코더는 데이터를 수신하며 FEC 인코딩된 데이터를 형성하기 위해 제1 FEC 데이터를 수신 데이터로 인코딩한다. 또한 이 시스템에는 제2 FEC 인코더도 포함되는데, 이 인코더는 제2 FEC 데이터를 생성하기 위해 FEC 인코딩된 데이터를 인코딩한다. FEC 패킷 포맷터는 제2 FEC 데이터를 FEC 패킷으로 만든다.
도 1은 본 발명의 실시예에 따라 예시적인 데이터 및 FEC 패킷을 도시하는 블록도.
도 2는 본 발명의 실시예에 따라 송신용 패킷을 포맷팅하기 위한 예시적인 메커니즘을 도시하는 블록도.
도 3은 본 발명의 실시예에 따라 수신 패킷을 처리하기 위한 예시적인 매커니즘을 도시하는 블록도.
도 4는 본 발명의 예시적인 실시예의 동작을 도시하는 프로세스 흐름도.
본 발명의 하나 이상의 특정 실시예가 이하에서 개시될 것이다. 이들 실시예에 대한 간단한 설명을 제공하기 위한 시도로, 실제 구현의 모든 특징이 본 명세서에서 설명되지는 않을 것이다. 임의의 이러한 실제 구현예의 개발시에, 임의의 엔 지니어링 또는 설계 프로젝트에서와 마찬가지로, 각 구현마다 달라질 수 있는 시스템-관련 및 비즈니스-관련 제약을 준수하는 것과 같은 개발자의 특정 목표를 달성하기 위해 다양한 구현-특정 결정이 이루어질 수 있다는 것이 인식되어야 한다. 더욱이, 이러한 개발 노력은 복잡하고 시간이 들 수 있으나, 그럼에도 불구하고 본 개시의 혜택을 입는 당업자에게는 일상적인 설계, 제작, 및 제조 업무일 것이라는 점이 인식되어야 한다.
도 1은 본 발명의 실시예에 따라 예시적인 데이터와 FEC 패킷을 도시하는 블록도이다. 전체적으로 참조 번호(10)로 언급되는 도면은 데이터 패킷(12)과 FEC 패킷(14)을 포함한다. 본 명세서에서 사용된 바와 같이, "데이터" 단독으로 쓰인 표현은 데이터 신호를 나타내는 통신 데이터를 가리킨다. FEC 패리티 비트와 같은 에러 정정 데이터는 "FEC 데이터"로 언급된다. TDMA 통신 시스템은 베이스 유닛과 다수의 모바일 단말기 사이에 통신을 제공하기 위해 데이터 패킷(12) 및 FEC 패킷(14)과 같은 패킷을 사용할 수 있다.
데이터 패킷(12)은 제1 헤더(16), 데이터 페이로드(18) 및 FEC 데이터의 제1 비트 또는 비트들(20)을 포함한다. FEC 패킷(14)은 제2 헤더(22)와 FEC 데이터의 제2 비트 또는 비트들(24)을 포함한다. 헤더(16)는 점선 화살표로 도시된 바와 같이, 헤더(22)를 가리키는 포인터 데이터를 포함할 수 있다. 따라서, 헤더(16)는 FEC 데이터(24)를 데이터 패킷(12)과 관련시킨다.
본 발명의 실시예는, 임의의 소정의 시간에 모든 TDMA 타임 슬롯이 점유된다(사용된다)는 것이 가능하지 않다는 점을 이용할 수 있다. 이는 사실인데 그 이유 는 특정 TDMA 기지국과 관련된 모든 사용자가 임의의 특정 시간에 활성화되는 것이 가능하지 않기 때문이다. 사용되지 않는 TDMA 타임 슬롯은 이때 (FEC 패킷(14))과 같은) 추가 패킷을 송신하는데 사용될 수 있는데, 이 추가 패킷은 추가 FEC 패리티 비트를 전달한다. 본 명세서에 개시된 예시적인 실시예는, 사용되지 않는 TDMA 타임 슬롯을 추가 FEC 패리티 데이터를 송신하기 위해 사용하나, 당업자는, 사용되지 않는 대역폭에 걸쳐 추가 FEC 패리티 비트를 분배하는 다른 방법이 사용될 수 있다는 것을 인식할 것이다.
FEC 패킷(14)으로 전달되는 FEC 데이터(24)는 현재 활성화된 모바일 단말기에 대한 체계적인 블록 코드를 위한 FEC 패리티 비트를 포함한다. 체계적인 블록 코드의 사용은, 원래의 데이터 비트가 추가 패리티 비트를 사용하지 않고도 복구될 수 있는 것을 보장하는데, 추가 패리티 비트는 FEC 패킷(14)에 오프로드될 수 있다. FEC 패킷(14)은 사용을 허용하기에 충분히 이용가능한 대역폭(사용되지 않는 타임 슬롯)이 있는 경우에만 생성되거나 사용될 수 있다.
유리하게는, 데이터 페이로드(18)는 추가 FEC 패킷(14)이 사용되는지 여부와 무관하게 변경되지 않는다. 따라서, 소정의 모바일 단말기에 대한 평균 정보 전송 속도는 동일하게 유지된다. FEC 패킷(14)이 사용되는 기간 동안, 다른 이용가능한 것보다 더 강한 FEC 코드를 사용하는 이점이 향유된다. 이들 이점은 평균 데이터 전송 속도를 변경시키지 않고도 모바일 단말기 내의 송신기 전력을 더 낮출 수 있음을 포함할 수 있다.
도 2는 본 발명의 실시예에 따라 송신용 패킷을 포맷팅하기 위한 예시적인 메커니즘을 도시하는 블록도이다. 도 2에 도시된 블록도는 전체적으로 참조 번호(100)로 언급된다. 베이스 유닛 또는 모바일 단말기 중 하나로부터 송신될 디지털화된 통신 데이터원에 대응할 수 있는 정보원(102)이 신호 경로(104)를 거쳐 제1 FEC 인코더(106)에 데이터를 제공한다. FEC 블록 코드를 사용할 필요가 없는 FEC 인코더(106)는 추가 FEC 데이터(24)(도 1)가 사용되는지 여부와 무관하게 데이터 패킷(12)(도 1)에 포함되는 FEC 데이터(20)(도 1)를 제공하기 위해 사용될 수 있다.
FEC 데이터(20)(도 1) 및 관련된 데이터 페이로드(18)(도 1)를 포함하는 FEC 인코더(106)의 출력이 데이터 경로(110)를 거쳐 페이로드 패킷 포맷터(114)에 전달된다. FEC 인코더(106)로부터의 출력은 FEC 인코딩된 데이터로 언급될 수 있다. 페이로드 패킷 포맷터(114)는 FEC 인코딩된 데이터를 완성된 데이터 패킷(12)(도 1)으로 포맷팅하는 것을 완성시킬 수 있다. 데이터 패킷 헤더(16)(도 1)와 같은 헤더는 페이로드 패킷 포맷터(114)에 의해 생성될 수 있다. 페이로드 패킷 포맷터(114)에 의해 생성된 헤더는 패킷을 수신하는 모바일 단말기가 추가 FEC 패킷을 찾기 위해,사용되지 않는 TDMA 타임 슬롯에 대해 인식하도록 위치 포인터를 포함할 수 있는데, 추가 FEC 패킷은 추가 FEC 패리티 데이터(24)(도 1)를 포함한다. 완성된 데이터 패킷은 페이로드 패킷 포맷터(114)에 의해 데이터 경로(120)에 전달된다.
FEC 패킷(14)(도 1)으로의 포인터를 갖는 헤더의 사용에 대한 대안으로서, 베이스 유닛은 수신 모바일 단말기가 미리 정해진 위치에서 FEC 패킷을 찾을 수 있는 방식으로 TDMA 타임 슬롯을 할당할 수 있다. 예컨대, 페이로드 타임 슬롯(#i)이 합의하에 특정 FEC 슬롯(#k)과 관련될 수 있다. 이러한 경우에, 수신 모바일 단말기는, 패킷이 추가 FEC 패리티 데이터를 포함하고 있는지 보기 위해 FEC 패킷의 헤더를 확인함으로써, 관련 FEC 슬롯이 그 패킷을 포함하고 있는지 결정할 수 있다.
FEC 인코더(106)로부터 나온 FEC 인코딩된 데이터는 또한 데이터 경로(108)를 거쳐 제2 FEC 패킷 인코더(112)에 전달될 수 있다. 충분한 여분의 TDMA 타임 슬롯이 이용가능한 경우에만 사용될 수 있다는 것을 나타내기 위해 점선으로 도시되어 있는 FEC 패킷 인코더(112)는 FEC 패킷(14)(도 1)에서 사용하기 위한 추가 FEC 데이터(24)(도 1)를 체계적인 FEC 블록 코드를 사용해서 계산할 수 있다.
FEC 패킷 인코더(112)는 단지 추가 FEC 패리티 데이터만을 포함하는 자신의 출력을 데이터 경로(116)를 거쳐, 또한 점선으로 도시된 FEC 패킷 포맷터(118)에 전달할 수 있다. FEC 패킷 포맷터(118)는 패킷에 헤더를 제공함으로써 그리고 완성된 패킷을 데이터 경로(122)를 거쳐 포워딩함으로써, FEC 패킷(14)(도 1)과 같은 FEC 패킷의 포맷팅을 완성할 수 있다. 페이로드 패킷 포맷터(114)로부터 나온 완성 된 데이터 패킷과 FEC 패킷 포맷터(118)로부터 나온 완성된 FEC 패킷은 데이터 경로(124)를 거쳐 송신기(미도시)에 전달될 수 있다.
도 2에 도시된 패킷을 포맷팅하는 구성요소는 베이스 유닛 또는 모바일 단말기 중 하나에서 사용될 수 있으나, 관련 송신기가 베이스 유닛에 있는지 또는 모바일 단말기에 있는지에 따라 추가 FEC 데이터가 생성되고/되거나 송신되는지를 결정하는 것과 관련해 상이한 고려가 있을 수 있다. 베이스 측에 있는 경우, FEC 인코더(106)에 의해 생성된 FEC 코드는 블록 코드일 필요가 없으며 FEC 패리티 비트는 인접 블록에 위치될 필요도 없다. FEC 인코더(106)로부터 나온 FEC 인코딩된 데이터는 FEC 인코더(112)에 의해 인코딩되나, 체계적인 블록 코드가 사용된다.
베이스 유닛은 바람직하게는, (데이터 송신을 위해 안테나로부터 방사된 전력이 아닌) 처리 회로가 이용가능한 다량의 전력을 가질 수 있다. 다량의 전력은 베이스 유닛이 제2 FEC 패리티 데이터를 생성할 수 있도록 그리고 이 데이터를 사용되지 않는 타임 슬롯에 삽입되는 FEC 패킷(14)(도 1)을 거쳐 어떠한 성능 페널티 없이 송신할 수 있도록 하기에 충분히 많은 전력일 수 있다. 이러한 시스템에서, 통신 범위는 가능하게는, 동일 평균 허용 방사 전력(또는 전력 스펙트럼 밀도)에 대해 확장될 수 있다. 이는 FEC 패킷 수신 및 처리에 대해도 사실이다.
모바일 유닛에 의해 추가 FEC 패리티 데이터를 송신하는 것과 관련해서, 모바일 유닛은 추가 FEC 데이터를 처리하기 위한 전력 및 송신기를 운영하기 위한 전력과의 관계 모두에서, 제한된 전력을 갖는 것이 고려된다. 그러나, 베이스 유닛(이는 TDMA 마스터임)이 비어 있는 타임 슬롯을 할당할 수 있는 경우, FEC 패킷(14)(도 1)을 송신하는 것에 대한 결정이 언제나 베이스 유닛에 의해 이루어질 수 있다. 이는 사실인데, 그 이유는 추가 FEC 프로텍션의 사용이 송신된 정보 비트 당 에너지에 대해 전체적으로 더 효율적이기 때문이다.
도 3은 본 발명의 실시예에 따라 수신 패킷을 처리하기 위한 예시적인 메커니즘을 도시하는 블록도이다. 이 도면은 전체적으로 참조 번호(200)로 언급된다. 수신 패킷은 데이터 경로(202)를 거쳐 페이로드 패킷 버퍼(204) 또는 FEC 패킷 버퍼(206)에 전달될 수 있다.
추가 FEC 패리티 비트가 소정의 데이터 송신을 위해 사용되는 경우, 인입 데이터 패킷의 헤더는 이 패킷(12)(도 1)의 헤더가 관련 FEC 패킷(14)(도 1)을 가리키는지 결정하도록 헤더 디코더(210)(도 3에 점선으로 도시)에 의해 검사받을 수 있다. 이 패킷(14)을 가리키는 경우, 데이터는 인입 FEC 패킷이 수신기에 의해 FEC 패킷 버퍼(206)로 향할 수 있도록 데이터 경로(212)를 거쳐 수신기(미도시)에 전송될 수 있다.
추가 FEC 패리티 비트가 사용되지 않는 경우, 데이터 패킷은 데이터 경로(214)를 거쳐 페이로드 패킷 버퍼(204)로부터 FEC 디코더(224)에 직접 전달될 수 있다. 이러한 경우에, 데이터 패킷은 모든 데이터 패킷과 통합되는 FEC 데이터(20)만을 사용해서 FEC 정정을 받는다.
그러나, 추가 FEC 데이터가 모바일 단말기 내에서 배터리 수명을 보존하기 위해 사용되는 경우, 예컨대, 페이로드 패킷 버퍼(204)로부터 나오는 데이터 패킷은 데이터 경로(216)(도 3에 점선으로 도시)를 거쳐 FEC 디코더(220)에 전달될 수 있다. FEC 패킷 버퍼(206)로부터 나오는 FEC 패킷(14)(도 1)은 또한, 데이터 경로(218)를 거쳐 FEC 디코더(220)에 전달될 수 있다. FEC 디코더(220)는 부분 정정된 패킷 콘텐츠를 생성하기 위해, FEC 패리티 비트(24)(도 1)를 페이로드 패킷 버퍼(204)로부터 수신되는 데이터 패킷(12)(도 1)에 포함되어 있는 데이터 페이로드(18)(도 1) 및 FEC 데이터(20) (또는 이들의 임의의 조합)에 인가할 수 있다. 부분 정정된 패킷 콘텐츠는 FEC 디코더(224)에 전달될 수 있는데, 이 디코더는 FEC-디코딩된 페이로드 데이터를 획득하기 위해, FEC 데이터(20)(도 1)를 부분 정정된 패킷 콘텐츠에 인가할 수 있다. FEC-디코딩된 페이로드 데이터는 추가적으로 처리하기 위해 데이터 경로(226)를 거쳐 FEC 디코더(224)로부터 전달될 수 있다.
모바일 단말기가 베이스 유닛에 의해 송신된 FEC 패킷(14)(도 1)에 포함되어 있는 추가 FEC 데이터를 수신하고 처리하는 것에 대해 결정하는 것과 관련해서, 모바일 단말기 수신기는 두 개의 선택권: (1) 데이터 패킷 및 관련 FEC 패킷(14)(도 1) 모두가 수신될 때까지 데이터 패킷(12)(도 1)을 디코딩하는 것을 보류하거나, (2) FEC 패킷을 무시하고 정상적인 방식으로 수신 및 디코딩을 계속하는 선택권을 가질 수 있다. 모바일 유닛에 의해 추가 FEC 데이터를 사용하는 것이 바람직한지에 영향을 미치는 인자는 인입 신호 품질이 최저인지 또는 로딩된 모든 TDMA 타임 슬롯으로 시스템에 의해 획득가능한 것(즉, 모든 모바일 단말기가 온-라인) 이상인 동작 범위가 요구되는지를 포함할 수 있다.
최저 신호 품질 또는 요구된 추가 범위의 경우에, FEC 패킷(14)(도 1)에 의해 제공되는 데이터와 같은 추가 FEC 데이터를 사용하는 것이 바람직할 수 있다. 추가 FEC 데이터가 모바일 단말기의 범위를 확장시키기 위해 이 단말기에 의해 사용되는 경우, 데이터 송신 세션에 참여하는 모바일 유닛의 수의 증가가 FEC 패리티 데이터를 위해 사용되는 타임 슬롯으로 하여금 데이터 패킷의 송신에 요구되게 한다면 추가 FEC 패리티 데이터를 위해 이용가능한 TDMA 타임 슬롯을 사용하는 것이 매우 급하게 상실될 수 있다는 것을 당업자는 인식할 것이다.
도 4는 본 발명의 예시적인 실시예의 동작을 도시하는 프로세스 흐름도이다. 블록(302)에서, 프로세스가 시작된다. 블록(304)에서, FEC 패킷(14)(도 1)으로부터 나오는 FEC 데이터(24)(도 1)와 같은 추가 FEC 데이터가 소정의 데이터 송신을 위해 사용되어야 하는지와 관련해서 결정이 이루어진다. 이러한 결정에 영향을 미치는 인자는 위의 도 2 및 도 3에 대해 논의한 부분에 개시되어 있다. 추가 FEC 데이터가 사용되지 않는 경우, 데이터 패킷은 통상 데이터 패킷(12)(도 1)에 포함되는 FEC 데이터(20)(도 1)만을 사용해서 처리된다.
추가 FEC 데이터가 사용되어야 하는 경우, 블록(306)에 개시된 바와 같이, 추가 FEC 데이터가 획득된다. 블록(308)에서, 인입 데이터가 추가 FEC 데이터를 사용해서 처리된다. 블록(310)에서, 패킷에 포함된 FEC 데이터가 부분 정정된 데이터에 인가된다. 블록(312)에서, 처리가 종료된다.
본 발명은 다양한 변형 및 대안적인 형태가 가능할 수 있는 한편, 특정 실시예가 예로서 도면에 도시되었으며 본 명세서에서 상세히 설명될 것이다. 그러나, 본 발명은 개시된 특정 형태에 제한되지 않는다는 점이 이해되어야 한다. 오히려, 본 발명은 후술하는 첨부된 청구항에 의해 한정되는 바와 같이 본 발명의 사상 및 범주 내에 있는 모든 변형, 등가물 및 대안을 포함한다.
본 발명은 시분할 다중 접속(TDMA) 통신 시스템에서 순방향 에러 정정(FEC)에 이용가능하다.

Claims (20)

  1. 순방향 에러 정정(FEC) 패킷을 생성하기 위한 시스템으로서,
    데이터를 수신하며 FEC 인코딩된 데이터를 형성하기 위해 제1 FEC 데이터를 수신 데이터로 인코딩하는 제1 FEC 인코더(106);
    제2 FEC 데이터를 생성하기 위해 FEC 인코딩된 데이터를 인코딩하는 제2 FEC 인코더(112); 및
    제2 FEC 데이터를 FEC 패킷으로 포맷팅하는 FEC 패킷 포맷터(118)
    를 포함하는, 순방향 에러 정정(FEC) 패킷 생성 시스템.
  2. 제1 항에 있어서,
    FEC 패킷이 다른 비어 있는 시분할 다중 접속(TDMA) 타임 슬롯에 삽입되는, 순방향 에러 정정(FEC) 패킷 생성 시스템.
  3. 제2 항에 있어서,
    수신 데이터와 관련된 헤더가 수신 데이터를 다른 비어 있는 TDMA 타임 슬롯에 포함되어 있는 제2 FEC 데이터와 관련시키는 정보를 포함하는, 순방향 에러 정정(FEC) 패킷 생성 시스템.
  4. 제2 항에 있어서,
    다른 비어 있는 TDMA 타임 슬롯에 대응하는 위치가 TDMA 마스터에 의해 미리 결정되는, 순방향 에러 정정(FEC) 패킷 생성 시스템.
  5. 제1 항에 있어서,
    FEC 인코딩된 데이터를 데이터 패킷으로 포맷팅하는 페이로드 패킷 포맷터(114)를 더 포함하는, 순방향 에러 정정(FEC) 패킷 생성 시스템.
  6. 제1 항에 있어서,
    제2 FEC 인코더(112)는 제2 FEC 데이터를 생성하기 위해 체계적인 블록 코드를 사용하는, 순방향 에러 정정(FEC) 패킷 생성 시스템.
  7. 제1 항에 있어서,
    FEC 패킷은 전력을 보존하기 위해 수신기에 의해 무시되는, 순방향 에러 정정(FEC) 패킷 생성 시스템.
  8. 순방향 에러 정정(FEC) 패킷을 디코딩하기 위한 시스템으로서,
    데이터 패킷과 FEC 패킷을 수신하며, 부분 디코딩된 데이터를 생성하기 위해 FEC 패킷에 포함되어 있는 제1 FEC 데이터를 사용해서 데이터 패킷에 포함되어 있는 데이터를 디코딩하는 제1 FEC 디코더(224); 및
    부분 디코딩된 데이터를 수신하며, 데이터 패킷에 포함되어 있는 제2 FEC 데 이터를 기초로 해서 수신 데이터를 더 디코딩하는 제2 FEC 디코더(220)
    를 포함하는, 순방향 에러 정정(FEC) 패킷 디코딩 시스템.
  9. 제8 항에 있어서,
    데이터 패킷과 관련된 헤더를 디코딩하고 FEC 패킷을 식별하기 위한 헤더 디코더(210)를 더 포함하는, 순방향 에러 정정(FEC) 패킷 디코딩 시스템.
  10. 제8 항에 있어서,
    FEC 패킷은 미리 결정된 시분할 다중 접속(TDMA) 타임 슬롯으로부터 수신되는, 순방향 에러 정정(FEC) 패킷 디코딩 시스템.
  11. 제10 항에 있어서,
    TDMA 타임 슬롯에 대응하는 위치가 송신기에 의해 미리 결정되는, 순방향 에러 정정(FEC) 패킷 디코딩 시스템.
  12. 제8 항에 있어서,
    FEC 패킷은 전력을 보존하기 위해 수신기에 의해 무시되는, 순방향 에러 정정(FEC) 패킷 디코딩 시스템.
  13. 순방향 에러 정정(FEC) 패킷을 처리하는 방법으로서,
    데이터와 제1 FEC 데이터를 포함하는 데이터 패킷을 수신하는 단계;
    제2 FEC 데이터를 포함하는 FEC 패킷을 수신하는 단계; 및
    수신 데이터를 처리하기 위해 제2 FEC 데이터를 사용할지 결정하는 단계
    를 포함하는, 순방향 에러 정정(FEC) 패킷 처리 방법.
  14. 제13 항에 있어서,
    부분 디코딩된 데이터를 생성하기 위해 제2 FEC 데이터를 사용해서 수신 데이터를 처리하는 단계를 포함하는, 순방향 에러 정정(FEC) 패킷 처리 방법.
  15. 제14 항에 있어서,
    부분 디코딩된 데이터를 제1 FEC 데이터로 처리하는 단계를 포함하는, 순방향 에러 정정(FEC) 패킷 처리 방법.
  16. 제15 항에 있어서,
    언급된 단계는 언급된 순서로 수행되는, 순방향 에러 정정(FEC) 패킷 처리 방법.
  17. 제13 항에 있어서,
    제1 FEC 데이터만을 사용해서 수신 데이터를 처리하는 단계를 포함하는, 순방향 에러 정정(FEC) 패킷 처리 방법.
  18. 제17 항에 있어서,
    언급된 단계는 언급된 순서로 수행되는, 순방향 에러 정정(FEC) 패킷 처리 방법.
  19. 제13 항에 있어서,
    전력을 보존하기 위해 제2 FEC 데이터를 무시하는 단계를 포함하는, 순방향 에러 정정(FEC) 패킷 처리 방법.
  20. 제13 항에 있어서,
    언급된 단계는 언급된 순서로 수행되는, 순방향 에러 정정(FEC) 패킷 처리 방법.
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