KR20060001358A - Driving apparatus of plasma display panel - Google Patents

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KR20060001358A KR1020040050461A KR20040050461A KR20060001358A KR 20060001358 A KR20060001358 A KR 20060001358A KR 1020040050461 A KR1020040050461 A KR 1020040050461A KR 20040050461 A KR20040050461 A KR 20040050461A KR 20060001358 A KR20060001358 A KR 20060001358A
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임재혁
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Abstract

본 발명은 유지전극에 인가되는 바이어스 전압을 유지방전 전압으로 대체하여 공급하는 플라즈마 디스플레이 패널의 구동장치를 제공하는 것을 목적으로 한다.An object of the present invention is to provide a driving device of a plasma display panel which replaces and supplies a bias voltage applied to a sustain electrode with a sustain discharge voltage.

이와 같은 목적을 달성하기 위하여, 본 발명은, 어드레스 전극, 유지전극, 및 주사전극에, 전체 셀을 초기화 시키는 리셋 기간, 켜져야 할 셀을 선택하는 어드레스 기간, 상기 선택된 셀에서 유지방전이 수행되는 유지방전 기간을 갖는 구동신호를 인가하는 플라즈마 디스플레이 패널의 구동장치에 있어서,In order to achieve the above object, the present invention provides a reset period for initializing all cells, an address period for selecting a cell to be turned on, and a sustain discharge in the selected cell. In the driving apparatus of the plasma display panel for applying a driving signal having a sustain discharge period,

유지방전 전압이 인가되는 전원 전압 단자에 일단이 연결된 상부 스위치 및An upper switch having one end connected to a power supply voltage terminal to which a sustain discharge voltage is applied;

상부 스위치의 타단에 일단이 연결되고, 타단은 접지에 연결된 하부 스위치를 구비하고,One end is connected to the other end of the upper switch, the other end has a lower switch connected to the ground,

어드레스 기간에서, 상부 스위치와 하부 스위치의 스위칭에 의해 유지전극에 바이어스 전압을 공급하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치를 제공한다.A drive device for a plasma display panel is provided, wherein a bias voltage is supplied to a sustain electrode by switching of an upper switch and a lower switch in an address period.

Description

플라즈마 디스플레이 패널의 구동장치{Driving apparatus of plasma display panel}Driving apparatus for plasma display panel {Driving apparatus of plasma display panel}

도 1은 통상적인 3-전극 면 방전 방식의 플라즈마 디스플레이 패널의 구조를 나타내는 도면이다.1 is a view showing the structure of a conventional three-electrode surface discharge plasma display panel.

도 2는 도 1에 도시된 플라즈마 디스플레이 패널의 통상적인 구동 장치를 보여준다.FIG. 2 shows a typical driving apparatus of the plasma display panel shown in FIG. 1.

도 3은 도 1에 도시된 패널의 구동 신호의 일예를 설명하기 위한 타이밍도이다.3 is a timing diagram illustrating an example of a driving signal of the panel illustrated in FIG. 1.

도 4는 본 발명의 구동장치를 도시한 도면이다.4 is a view showing a drive device of the present invention.

도 5는 본 발명에 의한 바이어스 전압을 공급하기 위한 신호 흐름을 도 4의 구동장치를 이용해 도시한 도면이다.5 is a view illustrating a signal flow for supplying a bias voltage according to the present invention using the driving apparatus of FIG. 4.

도 6은 본 발명에 의한 구동신호를 설명하기 위한 타이밍도이다.6 is a timing diagram for explaining a driving signal according to the present invention.

도 7은 본 발명에 의한 플라즈마 디스플레이 패널을 간략히 도시한 블록도이다.7 is a block diagram schematically illustrating a plasma display panel according to the present invention.

* 도면의 주요부분에 대한 부호의 설명 *Explanation of symbols on main parts of drawing

1...플라즈마 디스플레이 패널, 100...앞쪽 글라스 기판,1 ... plasma display panel, 100 ... front glass substrate,

102, 110...유전층, 104...보호층,102, 110, dielectric layer, 104 ... protective layer,

106...뒤쪽 글라스 기판, 108...방전 공간,106 ... rear glass substrate, 108 ... discharge space,

112...형광층, 114...격벽,112 fluorescent layer, 114 bulkhead,

A1, A2, ... , Am...어드레스 전극 라인,A 1 , A 2 , ..., A m ... address electrode line,

X1, ... , Xn...X 전극 라인, Y1, ... , Yn...Y 전극 라인,X 1 , ..., X n ... X electrode line, Y 1 , ..., Y n ... Y electrode line,

Xna, Yna...투명 전극 라인, Xnb, Ynb...금속 전극 라인,X na , Y na ... transparent electrode line, X nb , Y nb ... metal electrode line,

200...영상처리부, 202...논리제어부,200 image processing unit, 202 logic control unit,

204...Y 구동부, 206...어드레스 구동부,204 ... Y drive, 206 ... address drive,

208...X 구동부, Vs...유지방전 전압,208 ... X drive, Vs ... Dielectric potential voltage,

Vg...그라운드 전압, Va...어드레스 전압, Vg ... ground voltage, Va ... address voltage,

Xs...상부 전계효과 트랜지스터, Xg...하부 전계효과 트랜지스터, Cp...패널 커패시터, 401...에너지 회수 회로, Xs ... top field effect transistor, Xg ... bottom field effect transistor, Cp ... panel capacitor, 401 ... energy recovery circuit,

403...X 구동 회로, 700...전원공급부.  403 ... X drive circuit, 700 ... power supply.

본 발명은 플라즈마 디스플레이 패널의 구동장치에 관한 것으로서, 더 상세하게는 플라즈마 디스플레이 패널에 공급되는 바이어스 전압을 유지방전전압으로 대체하여 공급하는 플라즈마 디스플레이 패널의 구동장치에 관한 것이다.The present invention relates to a driving device of a plasma display panel, and more particularly, to a driving device of a plasma display panel in which a bias voltage supplied to a plasma display panel is replaced with a sustain discharge voltage.

도 1은 통상적인 3-전극 면 방전 방식의 플라즈마 디스플레이 패널의 구조를 나타내는 도면이다.1 is a view showing the structure of a conventional three-electrode surface discharge plasma display panel.

도 1을 참조하면, 통상적인 면 방전 플라즈마 디스플레이 패널(1)의 앞쪽 및 뒤쪽 글라스 기판들(100, 106) 사이에는, 어드레스전극 라인들(A1, A2, ... , Am), 유전층(102, 110), Y 전극 라인들(Y1, ... , Yn), X 전극 라인들(X1, ... , Xn), 형광층(112), 격벽(114) 및 보호층으로서 예컨대 일산화마그네슘(MgO)층(104)이 마련되어 있다.Referring to FIG. 1, between the front and rear glass substrates 100 and 106 of a conventional surface discharge plasma display panel 1, the address electrode lines A 1 ,. A 2 , ..., A m ), Dielectric layers 102 and 110, Y electrode lines Y 1 , ..., Y n , X electrode lines X 1 , ..., X n , fluorescent layer 112, barrier rib 114, and As a protective layer, the magnesium monoxide (MgO) layer 104 is provided, for example.

어드레스전극 라인들(A1, A2, ... , Am)은 뒤쪽 글라스 기판(106)의 앞쪽에 일정한 패턴으로 형성된다. 아래쪽 유전층(110)은 어드레스전극 라인들(A1, A2 , ... , Am)의 앞쪽에 도포된다. 아래쪽 유전층(110)의 앞쪽에는 격벽(114)들이 어드레스전극 라인들(A1, A2, ... , Am)과 평행한 방향으로 형성된다. 이 격벽(114)들은 각 디스플레이 셀의 방정 영역을 구획하고, 각 디스플레이 셀 사이의 광학적 간섭을 방지하는 기능을 한다. 형광층(112)은, 격벽(114)들 사이에서 형성된다.Address electrode lines A 1 , A 2 , ..., A m ) is formed in a predetermined pattern on the front side of the rear glass substrate 106. The lower dielectric layer 110 includes the address electrode lines A 1 ,. A 2 , ..., A m ) is applied to the front. In front of the lower dielectric layer 110, barrier ribs 114 may include address electrode lines A 1 ,. A 2 , ..., A m ) is formed in a direction parallel to. The partition walls 114 function to partition a predetermined area of each display cell and to prevent optical interference between each display cell. The fluorescent layer 112 is formed between the partition walls 114.

X 전극 라인들(X1, ... , Xn)과 Y 전극 라인들(Y1, ... , Yn )은 어드레스전극 라인들(A1, A2, ... , Am)과 직교되도록 앞쪽 글라스 기판(100)의 뒤쪽에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 디스플레이 셀을 설정한다. 각 X전극 라인(X1, ... , Xn)과 각 Y 전극 라인(Y1, ... , Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극 라인(Xna, Yna)과 전도도를 높이기 위한 금속 전극 라인(Xnb, Ynb)이 결합되어 형성될 수 있다. 앞쪽 유전층(102)은 X 전극 라인들(X1, ... , Xn)과 Y 전극 라인들(Y1, ... , Yn)의 뒤쪽에 전면(全面) 도포되어 형성된다. 강한 전계로부터 패널(1)을 보호하기 위한 보호층(104) 예를 들어, 일산화마그네슘(MgO)층은 앞쪽 유전층(102)의 뒤쪽에 전면 도포되어 형성된다. 방전 공간(108)에는 플라즈마 형성용 가스가 밀봉된다.The X electrode lines X 1 ,..., X n and the Y electrode lines Y 1 , ..., Y n are the address electrode lines A 1 ,. A 2 , ..., A m ) is formed in a predetermined pattern on the back of the front glass substrate 100 to be orthogonal to each other. Each intersection sets a corresponding display cell. Each X electrode line (X 1 , ..., X n ) and each Y electrode line (Y 1 , ..., Y n ) are transparent electrode lines (X na ) made of a transparent conductive material such as indium tin oxide (ITO). , Y na ) and metal electrode lines X nb and Y nb for increasing conductivity may be formed. The front dielectric layer 102 is formed by applying the entire surface to the rear of the X electrode lines (X 1 ,..., X n ) and the Y electrode lines (Y 1 ,..., Y n ). A protective layer 104 for protecting the panel 1 from a strong electric field, for example, a magnesium monoxide (MgO) layer, is formed by applying a front surface to the back of the front dielectric layer 102. The plasma forming gas is sealed in the discharge space 108.

이와 같은 플라즈마 디스플레이 패널에 일반적으로 적용되는 구동 방식은, 초기화, 어드레스 및 디스플레이 유지 단계가 단위 서브-필드에서 순차적으로 수행되게 하는 방식이다. 초기화 단계에서는 구동될 디스플레이 셀들의 전하상태가 균일하게 된다. 어드레스 단계에서는, 선택될 디스플레이 셀들의 전하 상태와 선택되지 않을 디스플레이 셀들의 전하 상태가 설정된다. 디스플레이 유지 단계에서는, 선택된 디스플레이 셀들에서 디스플레이 방전이 수행된다. 이때, 디스플레이 방전을 수행하는 디스플레이 셀들의 플라즈마 형성용 가스로부터 플라즈마가 형성되고, 이 플라즈마로부터의 자외선 방사에 의하여 상기 디스플레이 셀들의 형광층(112)이 여기되어 빛이 발생된다.A driving scheme generally applied to such a plasma display panel is a method in which initialization, address, and display holding steps are sequentially performed in a unit sub-field. In the initialization step, the state of charge of the display cells to be driven becomes uniform. In the address step, the charge state of display cells to be selected and the charge state of display cells not to be selected are set. In the display holding step, display discharge is performed in selected display cells. At this time, a plasma is formed from the plasma forming gas of the display cells performing display discharge, and the fluorescent layer 112 of the display cells is excited by ultraviolet radiation from the plasma to generate light.

도 2는 도 1의 플라즈마 디스플레이 패널의 일반적인 구동 장치를 보여준다.2 illustrates a general driving device of the plasma display panel of FIG. 1.

도면을 참조하면, 플라즈마 디스플레이 패널(1)의 통상적인 구동 장치는 영상처리부(200), 논리제어부(202), 어드레스 구동부(206), X 구동부(208) 및 Y 구동부를 포함한다. 영상처리부(200)는 외부 아날로그 영상 신호를 디지털 신호로 변환하여 내부 영상 신호 예를 들어, 각각 8비트의 적색(R), 녹색(G), 및 청색(B) 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 발생시킨다. 어드레스 구동부(206)는, 논리제어부(202)로부터의 어드레스 구동 제어 신호(SA)를 처리하여 표시 데이터 신호를 발생시키고, 발생된 표시 데이터 신호를 어드레스전극 라인들에 인가한다. X 구동부(208)는 논리제어부(202)로부터의 X 구동 제어 신호(SX)를 처리하여 X 전극 라인들에 인가한다. Y 구동부(204)는 논리제어부(202)로부터의 Y 구동 제어 신호(SY)를 처리하여 Y 전극 라인들에 인가한다.Referring to the drawings, a typical driving apparatus of the plasma display panel 1 includes an image processor 200, a logic controller 202, an address driver 206, an X driver 208, and a Y driver. The image processing unit 200 converts an external analog image signal into a digital signal, and internal image signals such as 8-bit red (R), green (G), and blue (B) image data, clock signals, vertical and Generate horizontal sync signals. The address driver 206 processes the address drive control signal SA from the logic controller 202 to generate a display data signal, and applies the generated display data signal to the address electrode lines. The X driver 208 processes the X drive control signal SX from the logic controller 202 and applies it to the X electrode lines. The Y driver 204 processes and applies the Y drive control signal SY from the logic controller 202 to the Y electrode lines.

상기한 바와 같은 구조의 플라즈마 디스플레이 패널(1)의 구동방법으로, 주로 사용되는 어드레스-디스플레이 분리 구동방법이 미국특허 제 5541618호에 개시되어 있다.As a driving method of the plasma display panel 1 having the above-described structure, an address-display separation driving method mainly used is disclosed in US Pat. No. 5,541,618.

도 3은 도 1에 도시된 패널의 구동 신호의 일예를 설명하기 위한 타이밍도로서, 한 서브필드(SF)내에 어드레스전극(A), 유지전극(X) 및 주사전극(Y1~Yn)에 인가되는 구동신호를 나타낸다. 하나의 서브필드(SF)는 리셋 기간(PR), 어드레스 기간(PA) 및 유지방전 기간(PS)를 구비한다.FIG. 3 is a timing diagram illustrating an example of a driving signal of the panel shown in FIG. 1 and applied to the address electrode A, the sustain electrode X, and the scan electrodes Y1 to Yn in one subfield SF. The drive signal to be displayed. One subfield SF includes a reset period PR, an address period PA, and a sustain discharge period PS.

리셋 기간(PR)은 모든 그룹의 주사라인에 대해 리셋펄스를 인가하여, 강제로 기입방전을 수행함으로써, 전체 셀의 벽전하 상태를 초기화한다. 어드레스 기간(PA)에는, 유지전극(X)에 바이어스 전압(Vb)이 인가되고, 표시되어야 할 셀 위치에서 주사전극(Y1~Yn)과 어드레스전극(A1~Am)을 동시에 턴온시킴으로써 표시 셀을 선택한다. 어드레스 기간(PA)이 수행된 후에, 유지전극(X)과 주사전극(Y1~Yn)에 유지펄스(Vs)를 교대로 인가하여, 유지방전 기간(PS)이 수행된다. 유지방전 기간(PS) 중에 어드레스전극(A1~Am)에는 로우레벨의 전압(Vg)이 인가된다. PDP에서 휘도는 유지방전 펄스 수에 의하여 조정된다. 하나의 서브필드 또는 하나의 TV 필드에서의 유지방전 펄스수가 많으면 휘도가 증가한다.The reset period PR applies a reset pulse to all of the scan lines of all groups and forcibly performs a write discharge, thereby initializing the wall charge states of all cells. In the address period PA, the bias voltage Vb is applied to the sustain electrode X, and the display cells are turned on simultaneously by turning on the scan electrodes Y1 to Yn and the address electrodes A1 to Am at the cell positions to be displayed. Choose. After the address period PA is performed, the sustain pulse Vs is alternately applied to the sustain electrodes X and the scan electrodes Y1 to Yn to perform the sustain discharge period PS. During the sustain discharge period PS, a low level voltage Vg is applied to the address electrodes A1 to Am. In PDP, the brightness is adjusted by the number of sustain discharge pulses. If the number of sustain discharge pulses in one subfield or one TV field is large, the luminance increases.

도 2에 도시된 X 구동부(208)에서 유지전극(X)에 바이어스 전압(Vb)을 공급하기 위한 스위칭부를 사용하고 있으며, 유지 펄스를 공급하기 위해 유지방전 전압(Vs)을 이용한 스위치회로도 또한 사용하고 있다. 종래에 이와 같이 X 구동장치(208) 내에서 바이어스 전압(Vb)을 유지전극(X)에 공급하기 위한 스위치 회로를 더 구비함으로써, 그에 의한 플라즈마 디스플레이 패널의 제조비용이 상승하게 된다.In the X driver 208 shown in FIG. 2, a switching unit for supplying the bias voltage Vb to the sustain electrode X is used, and a switch circuit using the sustain discharge voltage Vs is also used to supply the sustain pulse. Doing. Conventionally, by further including a switch circuit for supplying the bias voltage Vb to the sustain electrode X in the X driver 208, the manufacturing cost of the plasma display panel is thereby increased.

본 발명은 상기와 같은 문제점을 해결하기 위하여, 유지전극에 인가되는 바이어스 전압을 유지방전 전압으로 대체하여 공급하는 플라즈마 디스플레이 패널의 구동장치를 제공하는 것을 목적으로 한다.In order to solve the above problems, an object of the present invention is to provide a driving device of a plasma display panel in which a bias voltage applied to a sustain electrode is replaced with a sustain discharge voltage.

상기와 같은 목적을 달성하기 위하여, 본 발명은 본 발명은, 어드레스 전극, 유지전극, 및 주사전극에, 전체 셀을 초기화 시키는 리셋 기간, 켜져야 할 셀을 선택하는 어드레스 기간, 상기 선택된 셀에서 유지방전이 수행되는 유지방전 기간을 갖는 구동신호를 인가하는 플라즈마 디스플레이 패널의 구동장치에 있어서,In order to achieve the above object, the present invention provides a reset period for initializing all cells, an address period for selecting a cell to be turned on, and a sustain period for the address electrode, sustain electrode, and scan electrode. A driving apparatus of a plasma display panel for applying a driving signal having a sustain discharge period in which discharge is performed,

유지방전 전압이 인가되는 전원 전압 단자에 일단이 연결된 상부 스위치 및An upper switch having one end connected to a power supply voltage terminal to which a sustain discharge voltage is applied;

상부 스위치의 타단에 일단이 연결되고, 타단은 접지에 연결된 하부 스위치를 구비하고,One end is connected to the other end of the upper switch, the other end has a lower switch connected to the ground,

어드레스 기간에서, 상부 스위치와 하부 스위치의 스위칭에 의해 유지전극에 바이어스 전압을 공급하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치를 제공한다.A drive device for a plasma display panel is provided, wherein a bias voltage is supplied to a sustain electrode by switching of an upper switch and a lower switch in an address period.

이러한 본 발명의 다른 특징에 의하면, 상기 상부 스위치 와 상기 하부 스위치의 스위칭은 상부 스위치가 턴온되고, 하부 스위치가 턴오프될 수 있다.According to another aspect of the present invention, the upper switch and the lower switch switching of the upper switch is turned on, the lower switch may be turned off.

이러한 본 발명의 또 다른 특징에 의하면, 상기 상부 스위치 및 상기 하부 스위치는 모두 전계효과 트랜지스터일 수 있다. According to another feature of the present invention, both the upper switch and the lower switch may be a field effect transistor.

이하, 첨부된 도면들을 참조하여 본 발명의 실시예에 대하여 상세히 설명한다.Hereinafter, with reference to the accompanying drawings will be described in detail an embodiment of the present invention.

도 4는 본 발명의 구동장치를 도시한 도면이다.4 is a view showing a drive device of the present invention.

도면을 참고하여 설명하면, 도 4는 X 구동 장치(208)를 도시한 도면이다. X 구동 장치(208)는 크게 에너지 회수 회로(401)와 X 구동 회로(403)로 나뉘어 진다.Referring to the drawings, FIG. 4 is a view showing the X driving device 208. The X driving device 208 is largely divided into an energy recovery circuit 401 and an X driving circuit 403.

X 구동회로는(403), 유지방전 전압(Vs)이 인가되는 전원 전압 단자에 일단이 연결된 상부 스위치 및 상부 스위치의 타단에 일단이 연결되고, 타단은 접지에 연결된 하부 스위치(Xg)를 구비한다. The X driving circuit 403 includes an upper switch having one end connected to a power supply voltage terminal to which the sustain discharge voltage Vs is applied, and one end connected to the other end of the upper switch, and the other end having a lower switch Xg connected to ground. .

상부 스위치와 하부 스위치는 모두 전계 효과 트랜지스터(FET)일수 있다. 따라서 상부 전계효과 트랜지스터(Xs)의 드레인 단자에 유지방전 전압(Vs)이 인가되는 전원 전압 단자가 연결되고, 게이트 단자에 상부 전계 효과 트랜지스터(Xs)를 동작시키기 위한 제어신호가 입력되며, 소스 단자에 하부 전계효과 트랜지스터(Xg) 의 드레인 단자가 연결된다. 하부 전계효과 트랜지스터(Xg)의 소스단자에는 접지에 연결되며, 게이트 단자에는 하부 전계 효과 트랜지스터(Xg)를 동작시키기 위한 제어신호가 입력된다. 상부 전계효과 트랜지스터(Xs)의 소스단자와 하부 전계효과 트랜지스터(Xg)의 드레인 단자 사이는 패널 커패시터(Cp)의 일단과 연결되며, 패널 커패시터(Cp)의 타단은 접지와 연결된다.Both the upper and lower switches can be field effect transistors (FETs). Therefore, a power supply voltage terminal to which the sustain discharge voltage Vs is applied is connected to the drain terminal of the upper field effect transistor Xs, and a control signal for operating the upper field effect transistor Xs is input to the gate terminal. To the drain terminal of the lower field effect transistor Xg is connected. The source terminal of the lower field effect transistor Xg is connected to ground, and a control signal for operating the lower field effect transistor Xg is input to the gate terminal. The source terminal of the upper field effect transistor Xs and the drain terminal of the lower field effect transistor Xg are connected to one end of the panel capacitor Cp, and the other end of the panel capacitor Cp is connected to ground.

에너지 회수 회로(401)는 주로 유지방전 기간(도 3의 PS)에서의 유지방전 전압(Vs) 인가 종료시에 패널 커패시터(Cp)에 남아 있는 전하들을 회수하여 저장하고, 유지방전 전압(Vs) 인가시에 패널 커패시터(Cp)에 회수된 에너지를 공급하는 역할을 한다. The energy recovery circuit 401 recovers and stores the charges remaining in the panel capacitor Cp at the end of the application of the sustain discharge voltage Vs in the sustain discharge period (PS in FIG. 3), and applies the sustain discharge voltage Vs. It serves to supply the recovered energy to the panel capacitor (Cp) at the time.

동작을 설명하면, 유지방전 전압(Vs)이 인가되기 직전에 제 1 스위칭 소자(Xr)가 턴온되어 에너지 저장용 커패시터(Cxerc)에 충전된 전하들을 패널 커패시터(Cp)에 공급하고, 에너지 저장용 커패시터(Cxerc)에서 공급되는 전압이 최고치가 될 때 상부 전계효과 트랜지스터(Xs)를 턴온되어 유지방전 전압(Vs)까지 상승시켜 패널 커패시터(Cp)에 공급하며, 유지방전 전압(Vs)의 인가가 종료될 때 제 2 스위칭 소자(Xf)가 턴온되어 패널 커패시터(Cp)에 남아있는 전하들을 수집하여 에너지 저장용 커패시터(Cxerc)에 저장한다. Referring to the operation, immediately before the sustain discharge voltage Vs is applied, the first switching element Xr is turned on to supply charges charged in the energy storage capacitor Cxerc to the panel capacitor Cp, and for energy storage. When the voltage supplied from the capacitor Cxerc reaches its maximum value, the upper field effect transistor Xs is turned on to rise to the sustain discharge voltage Vs and supplied to the panel capacitor Cp, and the application of the sustain discharge voltage Vs Upon termination, the second switching element Xf is turned on to collect the charges remaining in the panel capacitor Cp and store the charges in the energy storage capacitor Cxerc.

본 발명은 어드레스 기간(PA)에 유지전극(X)에 인가되는 바이어스 전압을 유지방전 기간에 인가되는 유지방전 전압(Vs)으로 대체하여 공급하는 것을 목적으로 한다. 즉 종래의 X 구동부(208)에 있던 바이어스 전압을 공급하기 위한 별도의 스위칭부를 제거하고, 그 대신에 유지방전 전압(Vs)을 공급하는 스위칭부를 통해 바 이어스 전압을 공급한다. 따라서 X 구동회로(403)의 동작으로 바이어스 전압이 공급된다. 이와 같이, X 구동장치(208)의 회로를 간단히 할 수 있으며, 플라즈마 디스플레이 패널의 제조비용을 절감할 수 있게 된다. An object of the present invention is to replace the bias voltage applied to the sustain electrode X in the address period PA with the sustain discharge voltage Vs applied in the sustain discharge period. That is, the separate switching unit for supplying the bias voltage in the conventional X driver 208 is removed, and instead, the bias voltage is supplied through the switching unit supplying the sustain discharge voltage Vs. Therefore, the bias voltage is supplied to the operation of the X driving circuit 403. In this manner, the circuit of the X driver 208 can be simplified, and the manufacturing cost of the plasma display panel can be reduced.

도 5는 본 발명에 의한 바이어스 전압을 공급하기 위한 신호 흐름을 도 4의 구동장치를 이용해 도시한 도면이다.5 is a view illustrating a signal flow for supplying a bias voltage according to the present invention using the driving apparatus of FIG. 4.

어드레스 기간(도 3의 PA)에서, 유지방전 전압(Vs)을 바이어스 전압으로 인가하는 동작을 살펴보면, 유지방전 전압(Vs)이 인가되는 전원 전압 단자에 연결된 상부 전계효과 트랜지스터(Xs)가 턴 온 되고, 이때 하부 전계효과 트랜지스터(Xg)는 턴 오프 될 수 있다. 따라서 유지방전 전압(VS)이 상부 전계효과 트랜지스터(Xs)를 거쳐 패널 커패시터(Cp)에 인가된다. Referring to the operation of applying the sustain discharge voltage Vs as the bias voltage in the address period (PA of FIG. 3), the upper field effect transistor Xs connected to the power supply voltage terminal to which the sustain discharge voltage Vs is applied is turned on. In this case, the lower field effect transistor Xg may be turned off. Therefore, the sustain discharge voltage VS is applied to the panel capacitor Cp via the upper field effect transistor Xs.

도 6은 본 발명에 의한 구동신호를 설명하기 위한 타이밍도이다.6 is a timing diagram for explaining a driving signal according to the present invention.

도 4 및 도 6을 참고하여 설명하면, 플라즈마 디스플레이 패널을 구동하기 위하여 어드레스 전극, 유지전극, 주사전극에 각각 구동신호를 인가하며, 이에 따라 화소를 구성하는 방전셀내에서의 방전에 의해 플라즈마 디스플레이 패널에 화상이 디스플레이 된다.Referring to FIGS. 4 and 6, a driving signal is applied to the address electrode, the sustain electrode, and the scan electrode to drive the plasma display panel, and accordingly, the plasma display panel is discharged by discharge in the discharge cells constituting the pixel. The image is displayed on the screen.

구동신호는 리셋 기간(PR), 어드레스 기간(PA), 유지방전 기간(PS)을 갖는다. 먼저 리셋 기간(PR)에는 전체 셀에 대하여 초기화 방전을 수행하여 방전셀 내부에 고른 벽전하 분포를 생성한다. 이를 위하여, 어드레스 전극(A)에는 그라운드 전압을 인가하며, 주사전극(Y)에는 상승 램프 신호와 하강 램프 신호를 인가하고. 유지전극(X)에는 하강 램프 신호 인가시 바이어스 전압을 인가한다. 주사전극과 유 지전극 사이의 전위차에 의한 약방전을 중심으로한 초기화 방전이 수행된다.The drive signal has a reset period PR, an address period PA, and a sustain discharge period PS. First, in the reset period PR, initialization discharge is performed on all cells to generate an even wall charge distribution in the discharge cells. To this end, a ground voltage is applied to the address electrode A, and a rising ramp signal and a falling ramp signal are applied to the scan electrode Y. A bias voltage is applied to the sustain electrode X when the falling ramp signal is applied. Initialization discharge is performed centering on the weak discharge due to the potential difference between the scan electrode and the sustain electrode.

다음에 어드레스 기간에서는 켜져야할 셀을 선택하기 위한 어드레스 방전이 수행된다. 주사전극(Y1, Y2, ..., Yn) 주사전극 라인별로 시간에 따라 부극성의 스캔전압(Vscan)을 갖는 주사신호를 각각 인가하며, 어드레스 전극(A1, A2, ..., Am))에는 해당 표시셀을 선택하기 위해 어드레스 전압(Va)을 갖는 표시 데이터 신호를 인가한다. 이때 유지전극(X1, X2, ..., Xn)에는 켜져야할 셀에서의 어드레스 방전의 원활한 수행을 위해서, 또한 켜지지 않을 셀에 대해서 오방전이 일어나지 않도록 정극성의 바이어스 전압을 인가한다. 어드레스 방전은 주로 주사전극(Y)과 어드레스 전극(A)사이의 전위차에 의해 발생하며, 이에 따라 방전셀 내부에 벽전하를 축적하게 된다.Next, in the address period, address discharge for selecting a cell to be turned on is performed. Scanning electrodes Y1, Y2, ..., Yn The scan signals having the negative scan voltage Vscan are applied to each scan electrode line with time, and the address electrodes A1, A2, ..., Am are applied. ), A display data signal having an address voltage Va is applied to select the corresponding display cell. At this time, a positive bias voltage is applied to the sustain electrodes X1, X2, ..., Xn so as to smoothly perform the address discharge in the cells to be turned on, and to prevent erroneous discharges from occurring in the cells that will not be turned on. The address discharge is mainly caused by the potential difference between the scan electrode Y and the address electrode A, thereby accumulating wall charges in the discharge cell.

다음에 유지방전 기간(PS)에서는, 어드레스 기간(PA)에서 선택된 방전셀에서 유지방전이 수행되도록 한다. 이를 위하여, 주사전극(Y)과 유지전극(X)에 유지방전전압을 갖는 유지펄스를 교호하게 인가한다. 유지방전은 주사전극(Y)과 유지전극(X)의 전위차에 의해 발생하며, 또한 어드레스 기간(PA)에서 방전셀 내부에 쌓아둔 벽전하를 이용한다. 따라서 유지방전 전압(Vs)은 방전개시 전압보다 낮은 전압으로 인가될 수 있다.Next, in the sustain discharge period PS, sustain discharge is performed in the discharge cells selected in the address period PA. For this purpose, a sustain pulse having a sustain discharge voltage is alternately applied to the scan electrode Y and the sustain electrode X. The sustain discharge is generated by the potential difference between the scan electrode Y and the sustain electrode X, and also uses the wall charges accumulated inside the discharge cell in the address period PA. Therefore, the sustain discharge voltage Vs may be applied at a voltage lower than the discharge start voltage.

통상적으로 바이어스 전압이 유지방전 전압보다 낮게 인가되나, 본 발명과 관련하여 플라즈마 디스플레이 패널의 구동장치의 회로 간략화 및 비용절감을 위해 바이어스 전압을 인가하는 스위칭부를 제거함으로써, 본 발명의 구동장치에서는 유지방전 전압을 인가하는 스위칭부를 통해 유지방전 전압(Vs)이 바이어스 전압으로 인가되게 된다.  In general, the bias voltage is lower than the sustain discharge voltage, but in the driving apparatus of the present invention, by removing the switching unit applying the bias voltage to simplify the circuit and reduce the cost of the driving apparatus of the plasma display panel in accordance with the present invention. The sustain discharge voltage Vs is applied as a bias voltage through a switching unit that applies a voltage.

도 7은 본 발명에 의한 플라즈마 디스플레이 패널을 간략히 도시한 블록도이다.7 is a block diagram schematically illustrating a plasma display panel according to the present invention.

참조하여 설명하면, 영상처리부(200)는 외부 영산신호를 입력받아 신호를 처리하여 내부 영상신호를 출력한다. 논리제어부(202)는 상기 내부 영상신호를 입력받아 감마보정, APC(automaticc power control)단계 등을 거쳐 X 구동 제어신호(SX), Y 구동 제어 신호(SY), 어드레스 구동 제어 신호(SA)를 출력한다. 각 구동부(204, 206, 208)는 각각의 구동 제어신호(SY, SA, SX)를 입력받아 패널에 각각의 구동신호를 출력한다. Referring to the description, the image processing unit 200 receives an external production signal and processes the signal to output an internal image signal. The logic controller 202 receives the internal image signal and performs an X driving control signal SX, a Y driving control signal SY, and an address driving control signal SA through a gamma correction and an automatic power control (APC) step. Output Each driver 204, 206, or 208 receives respective drive control signals SY, SA, and SX and outputs each drive signal to the panel.

특히 본 발명과 관련하여, X 구동부는 바이어스 전압을 공급하는 스위칭부를 제거하여 회로를 간단히 구현할 수 있다.In particular with respect to the present invention, the X driver can simply implement the circuit by removing the switching unit for supplying the bias voltage.

전원공급부(700)는 영상처리부(200), 논리제어부(202)에 제어전압(Vc) 및 그라운드 전압(Vg)을 공급하며, Y 구동부(204)에는 유지방전 전압(Vs), 최종상승 전압(Vset), 최종하강 전압(Vnf), 스캔전압(Vscan) 및 그라운드 전압(Vg)을 공급하며, 어드레스 구동부(206)에는 어드레스 전압(Va) 및 그라운드 전압(Vg)을 공급한다. 본 발명과 관련하여, X 구동부(208)는 바이어스 전압을 대신하여 유지방전 전압(Vs)을 사용하고 있으므로, 전원공급부(700)는 X 구동부(208)에 유지방전 전압(Vs)과 그라운드 전압(Vg)을 공급하는 것으로 충분하다.The power supply unit 700 supplies the control voltage Vc and the ground voltage Vg to the image processor 200 and the logic controller 202, and the sustain discharge voltage Vs and the final rise voltage to the Y driver 204. Vset, the final falling voltage Vnf, the scan voltage Vscan, and the ground voltage Vg are supplied, and the address driver 206 is supplied with the address voltage Va and the ground voltage Vg. In relation to the present invention, since the X driver 208 uses the sustain discharge voltage Vs instead of the bias voltage, the power supply 700 supplies the sustain discharge voltage Vs and the ground voltage (Vs) to the X driver 208. It is enough to supply Vg).

고전압으로 구동되는 플라즈마 디스플레이 패널에서, 전원공급부(700)는 다양한 고전압을 공급하여야 함으로써, 비용이 증대하며, 회로가 복잡하게 되었다. 그러나 본 발명과 관련하여, X 구동부(208)의 회로를 간단히 하여 유지방전 전압(Vs)을 바이어스 전압으로 사용함으로써, 더불어 전원공급부(700) 또한 조금 더 간단히 구현할 수 있게 된다. In a plasma display panel driven with a high voltage, the power supply 700 must supply various high voltages, thereby increasing costs and complicated circuits. However, in connection with the present invention, by using the sustain discharge voltage Vs as a bias voltage by simplifying the circuit of the X driver 208, the power supply 700 may also be more easily implemented.

상기한 바와 같은 본 발명의 따르면, 다음과 같은 효과를 얻을 수 있다.According to the present invention as described above, the following effects can be obtained.

첫째, X 구동부내의 바이어스 전압을 공급하는 스위칭부를 제거할 수 있으므로, 회로의 간단화 및 비용절감의 효과가 있다.First, since the switching part for supplying the bias voltage in the X driving part can be removed, the circuit can be simplified and the cost can be reduced.

둘째, 또한 전원공급부에서 종래의 바이어스 전압을 공급할 필요가 없어져, 전원공급부의 간단화 및 비용절감의 효과도 생기게 된다.Secondly, there is no need to supply a conventional bias voltage in the power supply, resulting in the effect of simplifying the power supply and reducing costs.

본 발명은 도면에 도시된 실시예를 참고로 설명되었으나 이는 예시적인 것에 불과하며, 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 다른 실시예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의하여 정해져야 할 것이다.Although the present invention has been described with reference to the embodiments shown in the drawings, this is merely exemplary, and it will be understood by those skilled in the art that various modifications and equivalent other embodiments are possible. Therefore, the true technical protection scope of the present invention will be defined by the technical spirit of the appended claims.

Claims (3)

어드레스 전극, 유지전극, 및 주사전극에, 전체 셀을 초기화 시키는 리셋 기간, 켜져야 할 셀을 선택하는 어드레스 기간, 상기 선택된 셀에서 유지방전이 수행되는 유지방전 기간을 갖는 구동신호를 인가하는 플라즈마 디스플레이 패널의 구동장치에 있어서,A plasma display for applying a drive signal having a reset period for initializing all cells, an address period for selecting a cell to be turned on, and a sustain discharge period for sustain discharge in the selected cell, to the address electrode, the sustain electrode, and the scan electrode. In the driving device of the panel, 유지방전 전압이 인가되는 전원 전압 단자에 일단이 연결된 상부 스위치 및 An upper switch having one end connected to a power supply voltage terminal to which a sustain discharge voltage is applied; 상기 상부 스위치의 타단에 일단이 연결되고, 타단은 접지에 연결된 하부 스위치를 구비하고,One end is connected to the other end of the upper switch, the other end has a lower switch connected to the ground, 상기 어드레스 기간에서, 상기 상부 스위치와 상기 하부 스위치의 스위칭에 의해 상기 유지전극에 바이어스 전압을 공급하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.And in the address period, a bias voltage is supplied to the sustain electrode by switching between the upper switch and the lower switch. 제 1항에 있어서, 상기 상부 스위치 와 상기 하부 스위치의 스위칭은,The method of claim 1, wherein the switching of the upper switch and the lower switch, 상기 상부 스위치가 턴온되고, 상기 하부 스위치가 턴오프 되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치. And the upper switch is turned on and the lower switch is turned off. 제 2항에 있어서, 상기 상부 스위치 및 상기 하부 스위치는 The method of claim 2, wherein the upper switch and the lower switch is 모두 전계효과 트랜지스터인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.A driving device of a plasma display panel, wherein all of them are field effect transistors.
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