KR20040075502A - 플라즈마 디스플레이 패널 및 그 구동방법 - Google Patents

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Abstract

본 발명은 콘트라스트를 향상시킬 수 있는 플라즈마 디스플레이 패널 및 그 구동방법에 관한 것이다.
본 발명에 따른 플라즈마 디스플레이 패널은 상부기판 상에 형성되며 서스테인방전을 일으키는 서스테인전극쌍과, 상기 상부기판과 서스테인전극쌍 사이에 형성되어 상기 서스테인방전시 서스테인전극쌍에 인가된 전계에 의해 구동되는 광셔터층을 구비하는 것을 특징으로 한다.

Description

플라즈마 디스플레이 패널 및 그 구동방법{Plasma Display Panel And Driving Method Thereof}
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 특히 콘트라스트를 향상시킬 수 있는 플라즈마 디스플레이 패널 및 그 구동방법에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 함)은 가스방전에 의해 발생되는 자외선이 형광체를 여기시킬 때 형광체로부터 가시광선이 발생되는 것을 이용한 표시장치이다. PDP는 지금까지 표시수단의 주종을 이루어왔던 음극선관(CRT)에 비해 두께가 얇고 가벼우며, 고선명 대형화면의 구현이 가능하다는 점등의 장점이 있다. PDP는 매트릭스 형태로 배열된 다수의 방전셀들로 구성되며, 하나의 방전셀은 화면의 한 화소를 이루게 된다.
도 1 및 도 2를 참조하면, 종래 PDP의 방전셀은 상부기판(10) 상에 형성되어진 서스테인전극쌍, 즉 스캔전극(14) 및 서스테인전극(16)과, 하부기판(12) 상에 형성되어진 데이터전극(22)을 구비한다.
스캔전극(14)과 서스테인전극(16)이 나란하게 형성된 상부기판(10)에는 상부 유전체층(18)과 보호막(20)이 적층된다. 상부 유전체층(18)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(20)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전체층(18)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호막(20)으로는 통상 산화마그네슘(MgO)이 이용된다. 데이터전극(22)은 스캔전극(14) 및 서스테인전극(16)과 교차하는 방향으로 하부기판(12) 상에 형성된다.
데이터전극(22)이 형성된 하부기판(12) 상에는 벽전하 축적을 위한 하부 유전체층(24)이 형성된다. 하부 유전체층(24) 위에는 격벽(26)이 형성되며, 하부 유전체층(24)과 격벽(26) 표면에는 형광체(28)가 도포된다. 격벽(26)은 데이터전극(22)과 나란하게 형성되어 방전에 의해 생성된 자외선 및 가시광이 인접한 방전셀에 누설되는 것을 방지한다. 형광체(28)는 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 이러한 상부기판(10) 및 하부기판(12)과 격벽(26)에 의해 마련된 방전공간에는 가스방전을 위한 불활성 가스가 주입된다.
이러한 구조의 방전셀은 데이터전극(22)과 스캔전극(14) 간의 대향방전에 의해 선택된 후 서스테인전극쌍(14,16) 간의 면방전에 의해 방전을 유지하게 된다. 이러한 방전셀에서는 유지방전시 발생되는 자외선에 의해 형광체(28)가 발광함으로써 가시광이 셀 외부로 방출되게 된다. 이 결과, 방전셀들은 방전이 유지되는 기간을 조절하여 계조를 구현하게 되고, 그 방전셀들이 매트릭스 형태로 배열된 PDP는 화상을 표시하게 된다.
또한, 3전극 교류 면방전형 PDP는 방전시간에 의존하여 광량을 조절함으로써 계조 (Gray Level)를 실현하게 된다. 이를 위하여, 3전극 교류 면방전형 PDP는 ADS(Addressing Display Separated) 방식의 구동방식으로 화상을 표시하게 된다. 이 ADS 방식의 PDP 구동방법은 구현하고자 하는 계조 레벨에 따라 하나의 프레임을 다수의 서브 필드들(Sub Fields)로 분할함과 아울러 서브 필드들 각각은 리셋기간(RPD) 및 어드레스기간(APD)과 서로 다른 서스테인기간(SPD)으로 나누어지게 된다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임 기간(16.67ms)은 도 3에 도시된 바와 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지게 된다. 아울러, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋기간(RPD), 어드레스기간(APD) 및 서스테인기간(SPD)으로 다시 나누어지게 된다. 여기서, 각 서브필드의 리셋기간(RPD) 및 어드레스기간(APD)은 각 서브필드마다 동일한 반면에 서스테인기간(SPD)은 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다. 이와 같이 각 서브필드에서 서스테인기간(SPD)이 달라지게 되므로 각 서브필드의 서스테인기간(SPD) 즉, 서스테인 방전횟수를 조절하여 화상의 계조를 표현하고 있다.
도 4는 종래 PDP의 구동방법을 나타내는 파형도이다.
도 4를 참조하면, 종래 PDP의 한 서브필드는 리셋기간(RPD), 어드레스기간(APD) 및 서스테인기간(SPD)으로 나뉘어 구동된다.
리셋기간(RPD)에는 스캔전극(Y)에 리셋펄스(RP)가 공급된다. 리셋펄스(RP)는 램프파 형태로 셋업(Set-up)시 전압이 증가하고 셋다운(Set-down) 시에는 전압이 감소하는 형태를 가진다. 셋업 시 리셋방전이 발생되어 제2 상부 유전체층(14)에 벽전하가 형성된다. 이어서, 셋다운 시 감소하는 전압에 의해 불요의 하전입자들이 부분적으로 소거되어 벽전하가 오방전을 일으키지 않으면서 다음의 어드레스방전에 도움을 줄 정도로 감소하게 된다. 이 벽전하 감소를 위하여, 리셋펄스(RP)의 셋다운 시 서스테인전극(Z)에 정극성(+)의 직류전압(Vd)을 공급한다. 이 정극성(+)의 직류전압(Vd)에 대하여 리셋펄스(RP)는 서서히 감소하는 형태로 공급되므로 셋다운 시 스캔전극(Y)이 서스테인전극(Z)에 대하여 상대적인 부극성(-)이 됨으로써, 즉 극성이 반전됨으로써 셋업 시 생성된 벽전하들이 감소하게 된다.
어드레스기간(APD)에서 스캔전극(Y)에 부극성의 스캔전압(Vy)을 가지는 스캔펄스(SP)가 공급됨과 아울러 동시에 어드레스전극(X)에 어드레스전압(Va)에 해당하는 데이터펄스(DP)가 공급됨으로써 어드레스방전이 발생하게 된다. 이 어드레스방전으로 형성된 벽전하는 다른 방전셀들이 어드레스되는 기간동안 유지된다.
서스테인기간(SPD)의 시작부에서 스캔전극(Y)에 트리거링펄스(TP)를 공급하여 어드레스기간(APD)에서 충분히 벽전하가 형성된 방전셀들에서 서스테인방전이 개시되게 한다. 이어서, 서스테인전극(Z)과 스캔전극(Y)에 교번적으로 서스테인전압(Vs)에 해당하는 서스테인펄스(SP1, SP2)를 공급하여 서스테인기간(SPD) 동안 서스테인방전이 유지되게 한다.
이와 같이 구동되는 PDP에서는 리셋기간(RPD)에 수차례의 방전이 연속되어 하전입자와 벽전하를 생성하고, 서스테인기간에는 수차례의 방전이 일어나게 된다. 그러나, 비표시기간인 리셋기간(RPD)과 어드레스기간(APD)의 발광시에 원하지 않는 발광이 일어나게 된다. 이 발광에 의하여 화상의 콘트라스트가 저하되는 문제점이 있다.
따라서, 본 발명의 목적은 콘트라스트를 향상시킬 수 있는 플라즈마 디스플레이 패널과 그 구동방법을 제공하는 데 있다.
도 1은 종래의 3전극 교류 면방전 플라즈마 디스플레이 패널의 방전셀을 나타내는 사시도이다.
도 2는 도 1에 도시된 플라즈마 디스플레이 패널을 나타내는 단면도이다.
도 3은 도 1에 도시된 플라즈마 디스플레이 패널에서 한 프레임의 계조를 나타내는 도면이다.
도 4는 도 1에 도시된 플라즈마 디스플레이 패널에 공급되는 구동파형을 나타내는 파형도이다.
도 5는 본 발명에 따른 플라즈마 디스플레이 패널의 방전셀을 나타내는 단면도이다.
도 6은 도 5에 도시된 플라즈마 디스플레이 패널에 공급되는 구동파형을 나타내는 파형도이다.
도 7a 및 도 7b는 리셋기간, 어드레스기간 및 서스테인기간동안 도 4에 도시된 광셔터층의 상태변화를 나타내는 단면도이다.
< 도면의 주요 부분에 대한 부호의 설명 >
10,40 : 상부기판 12,42 : 하부기판
14,44 : 스캔전극 16,46 : 서스테인전극
18,24,48,54,64 : 유전체층 20,50 : 보호막
22,52 : 데이터전극 26,56 : 격벽
28,58 : 형광체 60 : 광셔터층
62 : 블랙매트릭스
상기 목적을 달성하기 위하여, 본 발명에 따른 플라즈마 디스플레이 패널은 상부기판 상에 형성되며 서스테인방전을 일으키는 서스테인전극쌍과, 상기 상부기판과 서스테인전극쌍 사이에 형성되어 상기 서스테인방전시 서스테인전극쌍에 인가된 전계에 의해 구동되는 광셔터층을 구비하는 것을 특징으로 한다.
상기 플라즈마 디스플레이 패널은 상기 서스테인전극쌍과 광셔터층 사이에 위치하는 제1 상부유전체층과, 상기 광셔터층의 양측에 형성되는 블랙매트릭스를 추가로 구비하는 것을 특징으로 한다.
상기 플라즈마 디스플레이 패널은 상기 서스테인전극쌍을 덮도록 형성되는제2 상부유전체층과, 상기 제2 상부유전체층 상에 형성되는 보호막과, 상기 상부기판에 대향되는 하부기판 상에 상기 서스테인전극쌍과 교차되는 방향으로 형성되는 어드레스전극과, 상기 어드레스전극을 덮도록 형성되는 하부유전체층과, 상기 상부기판과 하부기판 사이에 위치하는 격벽과, 상기 격벽과 하부유전체층에 도포되는 형광체층을 추가로 구비하는 것을 특징으로 한다.
상기 블랙매트릭스는 상기 격벽과 중첩되게 형성되는 것을 특징으로 한다.
상기 광셔터층의 두께는 약 10~60㎛인 것을 특징으로 한다.
상기 광셔터층은 PDLC, PSCT, TN, LC, FSTN, ECB 및 PCGH 중 적어도 어느 하나로 형성되는 것을 특징으로 한다.
상기 제2 상부유전체층의 유전율은 약 5~20이며, 상기 제1 상부유전체층의 유전율은 약 0~20인 것을 특징으로 한다.
상기 목적을 달성하기 위하여, 본 발명에 따른 플라즈마 디스플레이 패널의 구동방법은 리셋기간, 어드레스기간 및 서스테인기간으로 나뉘어 구동되는 플라즈마 디스플레이 패널의 구동방법에 있어서, 상기 서스테인기간동안 상부기판과 서스테인전극쌍 사이에 형성되는 광셔터층이 서스테인방전에 의해 구동되어 광을 방출하는 단계를 포함하는 것을 특징으로 한다.
상기 플라즈마 디스플레이 패널의 구동방법은 상기 리셋기간과 어드레스기간 중 적어도 어느 한 기간동안 상기 광셔터층을 이용하여 광을 차단하는 단계를 포함하는 것을 특징으로 한다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부한 설명 예들에 대한설명을 통하여 명백하게 드러나게 될 것이다.
이하, 도 5 내지 도 7b를 참조하여 본 발명의 바람직한 실시 예에 대하여 설명하기로 한다.
도 5는 본 발명에 따른 광셔터를 갖는 PDP를 나타내는 단면도이다.
도 5를 참조하면, 본 발명에 따른 광셔터층을 갖는 PDP의 방전셀은 격벽(56)을 사이에 두고 마주보는 상판(UP)과 하판(DP)을 구비한다.
상판(UP)에는 상부기판(40) 상에 순차적으로 형성되는 블랙매트릭스(62), 광셔터층(60), 제1 상부유전체층(64), 스캔전극(44), 서스테인전극(46), 제2 상부유전체층(48) 및 보호막(50)을 구비한다.
블랙매트릭스(62)는 인접한 방전셀간의 광간섭을 방지하기 위하여 격벽(56)과 중첩되게 형성된다.
광셔터층(60)은 상부기판(40) 상에 형성된 블랙매트릭스(62) 사이에 형성된다. 광셔터층(60)은 자신에 인가되는 전압에 의해 방향성을 갖도록 배열되는 물질로 형성된다. 예를 들어, 광셔터층(60)은 PDLC(Polymer Dispersed Liquid Crystal), PSCT(Polymer Stabilized Cholesteric Texures), TN(twisted Nematic), LC(Liquid Crystal), FSTN(Film compensated Super Twisted Nematic), ECB(Electically Controlled Birefringence) 및 PCGH(cholesteric-nematic phase change guest) 중 적어도 어느 하나로 약 10~60㎛로 형성된다. 이러한 광셔터층(60)에 전계를 인가하면, 광셔터층(60)을 이루는 물질은 방향성을 갖도록 배열된다. 즉, 광셔터층(60)은 방전공간의 반대편인 비방전영역에 위치하게 되므로 광셔터층(60)과 인접한 서스테인전극쌍(44,46)에 서스테인방전시 인가되는 서스테인전압에 의해 구동된다. 이에 따라, 서스테인기간동안 광셔터층(60)을 이루는 물질은 방향성을 갖도록 배열되어 서스테인방전시 가시광이 셀외부로 방출되게 된다. 반면에 리셋기간과 어드레스기간에 광셔터층(60)을 이루는 물질은 방향성을 갖지 못하므로 PDP에서 발생하는 광을 차단하게 된다.
제1 상부유전체층(64)은 형광체(58)로부터 발광되는 광을 차단 및 투과할 수 있도록 전하를 축적하는 역할을 하게 된다. 이 제1 상부유전체층(64)의 유전율은 제2 상부유전체층(48), 보호막(50)의 유전율과 제2 상부유전체층(48)과 보호막(50)의 두께에 따라 달라지게 된다. 즉, 방전공간측에 위치하는 제2 상부유전체층(48) 및 보호막(50)을 사이에 두고 형성되는 스캔전극(44)과 서스테인전극(46)간의 제1 캐패시터(C1)는 비방전공간측에 위치하는 제1 상부유전체층(64)을 사이에 두고 형성되는 스캔전극(44)과 서스테인전극(46)간의 제2 캐패시터(C2)보다 크게 형성되도록 제1 상부유전체층(64)의 유전율을 결정해야 한다. 예를 들어, 제2 상부유전체층(48)의 유전율은 약 5~20이며, 제1 상부유전체층(64)의 유전율은 약 0~20이다.
스캔전극(44)과 서스테인전극(46)은 제1 상부유전체층(64) 상에 광셔터층(60)과 중첩되게 소정간격을 사이에 두고 평행하게 형성된다. 이러한 스캔전극(44)과 서스테인전극(46)은 각각 상대적으로 넓은 폭을 가지며 90%이상의 광투과율이 좋은 투명전도성물질로 이루어진 투명전극들(44A,46A)과, 상대적으로 좁은 폭을 갖는 금속물질로 이루어진 버스전극들(44B,46B)로 이루어진다. 버스전극(44B,46B)은 저항값이 커 전력을 효율적으로 전달하지 못하는투명전극(44A,46A)의 저항성분을 보상하게 된다. 버스전극(44B,46B)은 예를 들어 은(Ag) 및 구리(Cu) 중 어느 하나로 형성된다.
제2 상부 유전체층(48)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(50)은 플라즈마 방전시 발생된 스퍼터링에 의한 제2 상부 유전체층(48)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호막(50)으로는 통상 산화마그네슘(MgO)이 이용된다.
하판(DP)에는 하부기판(42) 상에 순차적으로 형성되는 데이터전극(52), 하부유전체층(54), 격벽(56) 및 형광체(58)를 구비한다.
데이터전극(52)은 스캔전극(44)과 서스테인전극(45)과 교차하는 방향으로 하부기판(42) 상에 형성된다. 데이터전극(52)이 형성된 하부기판(42) 상에는 벽전하 축적을 위한 하부 유전체층(54)이 형성된다. 하부 유전체층(54) 위에는 격벽(56)이 형성되며, 하부 유전체층(54)과 격벽(56) 표면에는 형광체(58)가 도포된다.
격벽(56)은 데이터전극(52)과 나란하게 형성되어 방전에 의해 생성된 자외선 및 가시광이 인접한 셀에 누설되는 것을 방지한다.
형광체(58)는 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 이러한 상부기판(40) 및 하부기판(42)과 격벽(56)에 의해 마련된 방전공간에는 가스방전을 위한 불활성 가스가 주입된다.
이러한 구조의 방전셀은 데이터전극(52)과 스캔전극(44) 간의 대향방전에 의해 선택된 후 서스테인전극쌍(44,46) 간의 면방전에 의해 방전을 유지하게 된다.이러한 방전셀에서는 유지방전시 발생되는 자외선에 의해 형광체(58)가 발광함으로써 가시광이 셀 외부로 방출되게 된다. 이 결과, 방전셀들은 방전이 유지되는 기간을 조절하여 계조를 구현하게 되고, 그 방전셀들이 매트릭스 형태로 배열된 PDP는 화상을 표시하게 된다.
도 6은 본 발명에 따른 광셔터를 갖는 PDP의 구동방법을 나타내는 파형도이다.
도 6을 참조하면, 본 발명에 따른 광셔터층를 갖는 PDP의 한 서브필드는 리셋기간(RPD), 어드레스기간(APD) 및 서스테인기간(SPD)으로 나뉘어 구동된다.
리셋기간(RPD)에는 스캔전극(Y)에 리셋펄스(RP)가 공급된다. 리셋펄스(RP)는 램프파 형태로 셋업(Set-up)시 전압이 증가하고 셋다운(Set-down) 시에는 전압이 감소하는 형태를 가진다. 셋업 시 리셋방전이 발생되어 제2 상부 유전체층에 벽전하가 형성된다. 이어서, 셋다운 시 감소하는 전압에 의해 불요의 하전입자들이 부분적으로 소거되어 벽전하가 오방전을 일으키지 않으면서 다음의 어드레스방전에 도움을 줄 정도로 감소하게 된다. 이 벽전하 감소를 위하여, 리셋펄스(RP)의 셋다운 시 서스테인전극(Z)에 정극성(+)의 직류전압(Vd)을 공급한다. 이 정극성(+)의 직류전압(Vd)에 대하여 리셋펄스(RP)는 서서히 감소하는 형태로 공급되므로 셋다운 시 스캔전극(Y)이 서스테인전극(Z)에 대하여 상대적인 부극성(-)이 됨으로써, 즉 극성이 반전됨으로써 셋업 시 생성된 벽전하들이 감소하게 된다. 이 때, 스캔전극(Y)에 인가되는 리셋펄스(RP)의 리셋전압은 상대적으로 약하기 때문에 광셔터층(LS)이 방향성을 갖지 못하게 되므로 PDP에서 발생하는 광을 차단하게 된다.
어드레스기간(APD)에서 스캔전극(Y)에 부극성의 스캔전압(Vy)을 가지는 스캔펄스(SP)가 공급됨과 아울러 동시에 데이터전극(X)에 데이터전압(Va)에 해당하는 데이터펄스(DP)가 공급됨으로써 어드레스방전이 발생하게 된다. 이 어드레스방전으로 형성된 벽전하는 다른 방전셀들이 어드레스되는 기간동안 유지된다. 이 때, 스캔전극(Y)과 데이터전극(X)에 인가되는 스캔전압(Vy) 및 데이터전압(Va)은 상대적으로 약하기 때문에 광셔터층(LS)이 방향성을 갖지 못하게 되므로 PDP에서 발생하는 광을 차단하게 된다.
서스테인기간(SPD)의 시작부에서 스캔전극(Y)에 트리거링펄스(TP)를 공급하여 어드레스기간(APD)에서 충분히 벽전하가 형성된 방전셀들에서 서스테인방전이 개시되게 한다. 이어서, 서스테인전극(Z)과 스캔전극(Y)에 교번적으로 서스테인전압(Vs)에 해당하는 서스테인펄스(SP1, SP2)를 공급하여 서스테인기간(SPD) 동안 서스테인방전이 유지되게 한다. 이 때, 서스테인전극(Z)과 스캔전극(Y)에 인가되는 서스테인전압(Vs)에 의해 구동되는 광셔터층(LS)은 방향성을 가지게 되어 형광체로부터 발광된 가시광을 상부기판을 통해 외부로 방출하게 된다.
도 7a 및 도 7b는 PDLC로 형성된 광셔터층을 갖는 플라즈마 디스플레이 패널의 구동방법을 나타내는 단면도이다.
도 7a 및 도 7b에 도시된 바와 같이 상부기판(40)과 제1 상부유전체층(64) 사이에 위치하는 광셔터층(60)은 폴리머(60b)와 액정(60a)이 혼합된 PDLC로 형성한다. 이러한 PDLC는 전압이 걸리지 않았을 때는 무질서하게 배열되어 굴절률 차이로 지나는 빛을 산란시킨다. 반면에 PDLC는 문턱전압 이상의 전압을 걸어주었을 때는 액정(60a)분자가 전기장방향과 나란하게 배열되어 빛이 투과된다.
이를 상세히 설명하면, 리셋기간과 어드레스기간동안에는 광셔터층(60)에 문턱전압이상의 전압을 공급하지 못하기 때문에 광셔터층(60)에 포함된 액정(60a)은 도 7a에 도시된 바와 같이 형광체로부터 발광된 가시광의 진행방향으로 정렬되지 못한다. 이에 따라, 액정(60a)과 액정(60a)을 둘러싸고 있는 폴리머(60b)와의 굴절률에 차이가 생겨 리셋방전과 어드레스방전시 방출되는 광을 차단할 수 있다.
서스테인기간동안에는 광셔터층(60)에 문턱전압이상의 전압이 공급되기 때문에 광셔터층(60)에 포함된 액정(60a)은 도 7b에 도시된 바와 같이 형광체로부터 발광된 가시광의 진행방향으로 정렬된다. 이에 따라, 액정(60a)과 액정(60a)을 둘러싸고 있는 폴리머(60b)와의 굴절률이 동일해져 형광체로부터 발광된 가시광은 상부기판을 통해 외부로 방출된다.
상술한 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널 및 그 구동방법은 서스테인전극쌍과 상부기판 사이에 서스테인기간동안 서스테인전극쌍에 인가되는 서스테인펄스에 의해 구동되는 광셔터층을 형성한다. 이에 따라, 광셔터층은 리셋기간 및 어드레스기간동안 PDP에서 생성되어 외부로 방출되는 광을 차단하며, 서스테인기간동안 형광체에서 발광된 광을 외부로 방출시킨다. 즉, 리셋기간 및 어드레스기간동안 발생된 광을 차단하므로 콘트라스트를 향상시킬 수 있다. 또한,본 발명에 따른 플라즈마 디스플레이 패널의 광셔터층은 서스테인펄스에 의해 구동되므로 복잡한 구동회로나 구동파형이 불필요하다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.

Claims (9)

  1. 상부기판 상에 형성되며 서스테인방전을 일으키는 서스테인전극쌍과,
    상기 상부기판과 서스테인전극쌍 사이에 형성되어 상기 서스테인방전시 서스테인전극쌍에 인가된 전계에 의해 구동되는 광셔터층을 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  2. 제 1 항에 있어서,
    상기 서스테인전극쌍과 광셔터층 사이에 위치하는 제1 상부유전체층과,
    상기 광셔터층의 양측에 형성되는 블랙매트릭스를 추가로 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  3. 제 2 항에 있어서,
    상기 서스테인전극쌍을 덮도록 형성되는 제2 상부유전체층과,
    상기 제2 상부유전체층 상에 형성되는 보호막과,
    상기 상부기판에 대향되는 하부기판 상에 상기 서스테인전극쌍과 교차되는 방향으로 형성되는 어드레스전극과,
    상기 어드레스전극을 덮도록 형성되는 하부유전체층과,
    상기 상부기판과 하부기판 사이에 위치하는 격벽과,
    상기 격벽과 하부유전체층에 도포되는 형광체층을 추가로 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  4. 제 3 항에 있어서,
    상기 블랙매트릭스는 상기 격벽과 중첩되게 형성되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  5. 제 1 항에 있어서,
    상기 광셔터층의 두께는 약 10~60㎛인 것을 특징으로 하는 플라즈마 디스플레이 패널.
  6. 제 1 항에 있어서,
    상기 광셔터층은 PDLC, PSCT, TN, LC, FSTN, ECB 및 PCGH 중 적어도 어느 하나로 형성되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  7. 제 3 항에 있어서,
    상기 제2 상부유전체층의 유전율은 약 5~20이며, 상기 제1 상부유전체층의 유전율은 약 0~20인 것을 특징으로 하는 플라즈마 디스플레이 패널.
  8. 리셋기간, 어드레스기간 및 서스테인기간으로 나뉘어 구동되는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    상기 서스테인기간동안 상부기판과 서스테인전극쌍 사이에 형성되는 광셔터층이 서스테인방전에 의해 구동되어 광을 방출하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  9. 제 8 항에 있어서,
    상기 리셋기간과 어드레스기간 중 적어도 어느 한 기간동안에는 상기 광셔터층에 의해 광이 차단되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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