KR20040059453A - 원자층 증착 방법을 이용한 캐패시터 제조 방법 - Google Patents
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Abstract
본 발명은 하부 전극의 계면에 케미컬 옥사이드를 형성하고, O3가스와 H2O 가스를 이용하여 층상 구조의 유전막을 형성하는 원자층 증착 방법을 이용한 캐패시터 제조 방법을 개시한다.
본 발명의 원자층 증착 방법을 이용한 캐패시터 제조 방법은 반도체 기판 상부에 하부 전극을 형성하는 제 1 공정; 상기 하부 전극 상부에 케미컬 옥사이드와 알루미늄옥사이드(AL2O3) 또는 하푸늄옥사이드(HfO2) 레이어를 증착하여 유전막을 적층하는 제 2 공정; 및 상기 유전막 상부에 상부 전극을 형성하는 제 3 공정을 구비하여 이루어진다.
Description
본 발명은 원자층 증착 방법을 이용한 캐패시터 제조 방법에 관한 것으로서, 보다 상세하게는 하부 전극의 계면에 케미컬 옥사이드를 형성하고, O3가스와 H2O 가스를 이용하여 층상 구조의 유전막을 형성하는 것이다.
하프늄옥사이드(HfO2)-알루미늄옥사이드(Al2O3)의 고유전막 공정 기술은 탄탈륨옥사이드를 적용한 기존 유전막 공정 기술에 비해 정전용량 향상과 공정수 감축이 가능하다.
하프늄옥사이드(HfO2)-알루미늄옥사이드(Al2O3)의 유전막은 원자층 증착기술(ALD : Atomic Layer Deposition)로 형성된다.
그러나, 종래에는 Al2O3와 같은 유전막을 형성하기 위하여트리메틸알루미늄(Al(CH3)3)과 O3또는 H2O가 사용된다. 여기에서 O3와 H2O는 반응가스이다.
그러나, 반응가스로 H2O를 사용하는 경우, 하부전극과 맞닿는 계면에서 산소가 부족한 Al2O3박막이 형성되여, Al-Al 본딩(Bonding)의 피크(Peak)가 관찰되는 현상이 있다.
그리고, 반응가스로 H2O만 사용하는 경우는 Al2O3박막 내에 수소가 많이 존재하여 전기적 특성이 저하되는 문제점이 있었다.
또한, 반응가스로 O3를 사용하는 경우는 반응가스로 H2O를 사용하는 경우에 비하여 Al2O3박막 내에 카본(Carbon)이 많이 존재하여 전기적 특성을 열화시키는 문제점이 있었다.
본 발명의 목적은 ALD 방법으로 증착되는 AL2O3캐패시터의 전기적 특성을 향상시킴에 있다.
본 발명의 다른 목적은 H2O를 반응가스로 사용하여 스텝커버리지 특성을 향상시키고, 박막 내 카본 성분을 줄임으로써 캐패시터의 누설 전류 특성을 향상시킴에 있다.
도 1 내지 도 4는 본 발명에 따른 원자층 증착 방법을 이용한 캐패시터 제조 방법의 바람직한 실시예를 설명하는 공정도
본 발명에 따른 원자층 증착 방법을 이용한 캐패시터 제조 방법은 반도체 기판 상부에 하부 전극을 형성하는 제 1 공정; 상기 하부 전극 상부에 케미컬 옥사이드와 알루미늄옥사이드(AL2O3) 또는 하푸늄옥사이드(HfO2) 레이어를 증착하여 유전막을 적층하는 제 2 공정; 및 상기 유전막 상부에 상부 전극을 형성하는 제 3 공정을 구비하여 이루어진다.
알루미늄옥사이드(AL2O3) 또는 하푸늄옥사이드(HfO2) 레이어는 시드 레이어와 상부 레이어의 적층 구조를 가질 수 있다.
이 중 시드 레이어는 알루미늄옥사이드(AL2O3) 또는 하푸늄옥사이드(HfO2) 소스를 공정 챔버 내부에 플로우시키는 제 1 공정; 원자층을 형성한 Al 이외의 미반응 가스를 제거하기 위하여 N2가스를 공정 챔버 내부에 플로우시키는 제 2 공정; 반응 가스인 O3가스를 플로우 시키는 제 3 공정; 미반응된 O3가스를 제거하기 위하여 N2가스를 플로우 시키는 제 4 공정을 구비하며, 상기 제 1 공정 내지 제 4 공정을 순차적으로 반복하여 형성될 수 있다.
그리고, 상부 레이어는 알루미늄옥사이드(AL2O3) 또는 하푸늄옥사이드(HfO2) 소스를 공정 챔버 내부에 플로우시키는 제 5 공정; 원자층을 형성한 Al 이외의 미반응 가스를 제거하기 위하여 N2가스를 공정챔버 내부에 플로우시키는 제 6 공정; 반응 가스인 H2O 가스를 플로우 시키는 제 7 공정; 및 미반응된 H2O 가스를 제거하기 위하여 N2가스를 플로우 시키는 제 8 공정을 포함하며, 상기 제 5 공정 내지 제8 공정을 순차적으로 반복하여 형성될 수 있다.
이하, 본 발명에 따른 원자층 증착 방법을 이용한 캐패시터 제조 방법의 바람직한 실시예에 대하여 첨부 도면을 참조하여 상세히 설명한다.
본 발명에서 캐패시터는 하부전극과, 유전막 및 상부 전극으로 구성되며, 유전막은 케미컬 옥사이드와 하프늄옥사이드(HfO2) 또는 알루미늄옥사이드(AL2O3)의 적층 구조를 갖는다.
실시예로써 Al2O3의 유전막을 갖는 캐패시터 형성 방법을 도 1 내지 도 4를 참조하여 설명한다.
캐패시터의 하부 전극(10)은 폴리실리콘 재질로 형성되며, 구체적으로 도핑된 폴리실리콘(Doped poly silicon)을 50Å 내지 300Å 두께로 증착하고, 도핑되지 않은 폴리실리콘(Undoped poly silicon)을 50Å 내지 300Å 두께로 증착하며, 500℃ 내지 700℃의 질소분위기에서 PH3를 도핑하여 형성될 수 있다.
상술한 바와 같이 캐패시터의 하부 전극(10)이 형성되면 그 상부에 유전막을 형성한다. 유전막은 케미컬 옥사이드(12)와 Al2O3레이어의 적층 구조로 형성된다.
케미컬 옥사이드(12)는 도 1과 같이 5Å 내지 10Å의 두께로 형성되며, 이를 형성하기 위하여 하부 전극(10)의 표면을 HF+SC-1(NH4OH : H2O2: H2O)으로 세정한다.
HF+SC-1의 세정으로 형성된 케미컬 옥사이드(12)의 상부에 Al2O3가 적층되며, Al2O3는 트리메틸알루미늄(Al(CH3)3)을 소스로 하여 형성된다.
그리고, Al2O3레이어는 도 2와 같이 시드 레이어(Seed layer)(14)와 상부 레이어(16)로 구분되며, 시드 레이어(14)는 트리메틸알루미늄(Al(CH3)3) 소스를 O3가스와 반응시켜서 형성되고, 상부 레이어(16)는 트리메틸알루미늄(Al(CH3)3) 소스를 H2O 가스와 반응시켜서 형성된다. 그리고, Al2O3레이어를 형성하는 공정 챔버는 0.1 Torr 내지 10 Torr의 내부 압력을 유지하고, 200℃ 내지 500℃의 온도를 유지하여 공정을 수행한다.
시드 레이어(14)를 형성하는 공정은, 트리메틸알루미늄(Al(CH3)3) 소스를 0.1 sec 내지 2 sec 동안 공정 챔버 내부에 플로우시키는 제 1 단계, 원자층을 형성한 Al 이외의 미반응 가스를 제거하기 위하여 N2가스를 0.1 sec 내지 5 sec 동안 공정 챔버 내부에 플로우시키는 제 2 단계, 반응 가스인 O3가스를 0.1 sec 내지 5 sec 동안 플로우 시키는 제 3 단계, 미반응된 O3가스를 제거하기 위하여 N2가스를 0.1 sec 내지 5 sec 동안 플로우 시키는 제 4 단계을 포함한다.
상기 제 1 단계 내지 제 4 단계를 순차적으로 반복함으로써 시드 레이어(14)는 15Å 이하의 두께로 증착한다.
그리고, 상부 레이어(16)를 형성하는 공정은 트리메틸알루미늄(Al(CH3)3) 소스를 0.1 sec 내지 2 sec 동안 공정 챔버 내부에 플로우시키는 제 5 단계, 원자층을 형성한 Al 이외의 미반응 가스를 제거하기 위하여 N2가스를 0.1 sec 내지 5 sec 동안 공정챔버 내부에 플로우시키는 제 6 단계, 반응 가스인 H2O 가스를 0.1 sec 내지 5 sec 동안 플로우 시키는 제 7 단계, 미반응된 H2O 가스를 제거하기 위하여 N2가스를 0.1 sec 내지 5 sec 동안 플로우 시키는 제 8 단계를 포함한다.
상기 제 5 단계 내지 제 8 단계를 순차적으로 반복함으로써 상부 레이어(16)는 원하는 두께로 증착한다.
상기한 바와 같이 형성된 Al2O3레이어는 불순물을 포함할 수 있다. 이를 제거하기 위하여 같이 어닐(Aneal)을 실시한다. 어닐은 질소 분위기에서 600℃ 내지 800℃의 고온으로 2분 내지 60분 동안 실시된다.
그 이후 도 3과 같이 AL2O3레이어는 표면특성 향상을 위하여 200℃ 내지 500℃의 온도에서 2분 내지 10분 정도 자외선과 O3처리를 실시한다.
한편, Al2O3레이어의 특성 향상 및 결정화를 위하여 500℃ 내지 800℃의 온도에서 N2O 또는 N2분위기에서 퍼니스(Furnace)를 이용한 열처리가 추가 진행될 수 있다.
상기한 바와 같이 시드 레이어와 상부 레이어로 구분되는 Al2O3레이어가 형성된 후 도 4와 같이 상부 전극(18)을 형성하면 캐패시터가 구성된다.
상부 전극(18)은 화학기상증착된 TiN과 폴리실리콘이 순차적으로 증착되어적층되는 2중막으로 형성될 수 있다. 또한, 상부 전극(18)은 폴리실리콘, TiN 또는 Ru 단일막으로 형성될 수 있다.
상술한 바에 의하여 Al2O3재질의 유전막을 갖는 캐패시터가 형성되며, 이와 다르게 HfO2재질의 유전막을 갖는 캐패시터가 형성될 수 있다.
이 경우, 상기한 Al2O3재질의 유전막을 갖는 캐패시터 공정이 그대로 적용될 수 있으며, HfO2소스로서 Hf[NC2H5CH3]4, Hf[N(CH3)2]4, Hf[OC(CH3)2CH2OCH3]4또는 Hf[OC(CH3)3]4등이 사용될 수 있으며, 이에 대한 HfO2재질의 유전막을 갖는 캐패시터의 제조 공정에 대해서는 설명을 생략한다.
따라서, 본 발명에 의하면 하부 전극과 유전막의 계면에서 형성되는 메탈릭 성분의 Al2O3막의 형성이 방지되고, 계면에서 수소 성분이 제거됨으로써 ALD 방법의 유전막의 전기적 특성이 향상될 수 있다.
또한, 상부 레이어 형성시 H2O 반응 가스를 사용함으로써 스텝커버리지가 향상되고, 박막 내의 카본 성분을 크게 줄임으로써 캐패시터의 누설전류 특성이 향상될 수 있다.
Claims (30)
- 반도체 기판 상부에 하부 전극을 형성하는 제 1 공정;상기 하부 전극 상부에 케미컬 옥사이드와 알루미늄옥사이드(AL2O3) 레이어를 증착하여 유전막을 적층하는 제 2 공정; 및상기 유전막 상부에 상부 전극을 형성하는 제 3 공정을 구비함을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 1 항에 있어서,상기 제 1 공정에서 상기 하부 전극은 50Å 내지 300Å의 두께로 도핑된 폴리실리콘(Doped poly silicon)을 증착하고, 50Å 내지 300Å의 두께로 도핑되지 않은 폴리실리콘(Undoped poly silicon)을 증착하며, 500℃ 내지 700℃ 온도의 질소분위기에서 PH3를 도핑하여 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 1 항에 있어서,상기 제 2 공정의 상기 케미컬 옥사이드는 상기 하부 전극의 표면을 HF+SC-1(NH4OH : H2O2: H2O)으로 세정하여 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 3 항에 있어서,상기 케미컬 옥사이드는 5Å 내지 10Å의 두께로 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 1 항에 있어서,상기 제 2 공정의 상기 알루미늄옥사이드(AL2O3) 레이어는 트리메틸알루미늄 (Al(CH3)3)을 소스로 하여 형성되는 시드 레이어와 상부 레이어가 적층됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 5 항에 있어서,상기 시드 레이어는 O3가스를 반응가스로 이용하여 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 5 항에 있어서,상기 상부 레이어는 H20 가스를 반응가스로 이용하여 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 5 항 내지 제 7 항에 있어서,0.1 Torr 내지 10 Torr의 내부 압력을 유지하고, 200℃ 내지 500℃의 온도를 유지하여 공정이 수행됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 5 항에 있어서, 상기 시드 레이어는,상기 트리메틸알루미늄(Al(CH3)3) 소스를 공정 챔버 내부에 플로우시키는 제 1 단계;원자층을 형성한 Al 이외의 미반응 가스를 제거하기 위하여 N2가스를 공정 챔버 내부에 플로우시키는 제 2 단계;반응 가스인 O3가스를 플로우 시키는 제 3 단계;미반응된 O3가스를 제거하기 위하여 N2가스를 플로우 시키는 제 4 단계를 구비하며,상기 제 1 단계 내지 제 4 단계를 순차적으로 반복하여 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 5 항에 있어서, 상기 상부 레이어는,상기 트리메틸알루미늄(Al(CH3)3) 소스를 공정 챔버 내부에 플로우시키는 제 5 단계;원자층을 형성한 Al 이외의 미반응 가스를 제거하기 위하여 N2가스를 공정챔버 내부에 플로우시키는 제 6 단계;반응 가스인 H2O 가스를 플로우 시키는 제 7 단계; 및미반응된 H2O 가스를 제거하기 위하여 N2가스를 플로우 시키는 제 8 단계를 포함하며,상기 제 5 단계 내지 제 8 단계를 순차적으로 반복하여 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 5 항에 있어서,상기 Al2O3레이어는 질소 분위기에서 600℃ 내지 800℃의 고온으로 2분 내지 60분 동안 어닐됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 5 항에 있어서,상기 AL2O3레이어는 표면특성 향상을 위하여 200℃ 내지 500℃의 온도에서 2분 내지 10분 정도 자외선과 O3처리됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 5 항에 있어서,상기 Al2O3레이어는 특성 향상 및 결정화를 위하여 500℃ 내지 800℃의 온도에서 N2O 또는 N2분위기에서 퍼니스(Furnace)를 이용하여 열처리됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 1 항에 있어서,상기 제 3 공정의 상기 상부 전극은 화학기상증착된 TiN과 폴리실리콘이 순차적으로 증착되어 적층되는 2중막으로 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 1 항에 있어서,상기 제 3 공정의 상기 상부 전극은 폴리실리콘, TiN 또는 Ru 중 어느 하나를 재질호하는 단일막으로 형성됨을 특징으로 하는 원자층 증착 방법.
- 반도체 기판 상부에 하부 전극을 형성하는 제 1 공정;상기 하부 전극 상부에 케미컬 옥사이드와 하프늄옥사이드(HfO2) 레이어를 증착하여 유전막을 적층하는 제 2 공정; 및상기 유전막 상부에 상부 전극을 형성하는 제 3 공정을 구비함을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 16 항에 있어서,상기 제 1 공정에서 상기 하부 전극은 50Å 내지 300Å의 두께로 도핑된 폴리실리콘(Doped poly silicon)을 증착하고, 50Å 내지 300Å의 두께로 도핑되지 않은 폴리실리콘(Undoped poly silicon)을 증착하며, 500℃ 내지 700℃ 온도의 질소분위기에서 PH3를 도핑하여 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 16 항에 있어서,상기 제 2 공정의 상기 케미컬 옥사이드는 상기 하부 전극의 표면을 HF+SC-1(NH4OH : H2O2: H2O)으로 세정하여 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 18 항에 있어서,상기 케미컬 옥사이드는 5Å 내지 10Å의 두께로 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 16 항에 있어서,상기 제 2 공정의 상기 하프늄옥사이드(HfO2) 레이어는 Hf[NC2H5CH3]4, Hf[N(CH3)2]4, Hf[OC(CH3)2CH2OCH3]4또는 Hf[OC(CH3)3]4증 어느 하나를 소스로 하여형성되는 시드 레이어와 상부 레이어가 적층됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 20 항에 있어서,상기 시드 레이어는 O3가스를 반응가스로 이용하여 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 20 항에 있어서,상기 상부 레이어는 H20 가스를 반응가스로 이용하여 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 20 항 내지 제 22 항에 있어서,0.1 Torr 내지 10 Torr의 내부 압력을 유지하고, 200℃ 내지 500℃의 온도를 유지하여 공정이 수행됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 20 항에 있어서, 상기 시드 레이어는,상기 하프늄옥사이드(HfO2) 소스를 공정 챔버 내부에 플로우시키는 제 1 단계;원자층을 형성한 Al 이외의 미반응 가스를 제거하기 위하여 N2가스를 공정 챔버 내부에 플로우시키는 제 2 단계;반응 가스인 O3가스를 플로우 시키는 제 3 단계;미반응된 O3가스를 제거하기 위하여 N2가스를 플로우 시키는 제 4 단계를 구비하며,상기 제 1 단계 내지 제 4 단계를 순차적으로 반복하여 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 20 항에 있어서, 상기 상부 레이어는,상기 하프늄옥사이드(HfO2) 소스를 공정 챔버 내부에 플로우시키는 제 5 단계;원자층을 형성한 Al 이외의 미반응 가스를 제거하기 위하여 N2가스를 공정챔버 내부에 플로우시키는 제 6 단계;반응 가스인 H2O 가스를 플로우 시키는 제 7 단계; 및미반응된 H2O 가스를 제거하기 위하여 N2가스를 플로우 시키는 제 8 단계를 포함하며,상기 제 5 단계 내지 제 8 단계를 순차적으로 반복하여 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 20 항에 있어서,상기 하프늄옥사이드(HfO2) 레이어는 질소 분위기에서 600℃ 내지 800℃의 고온으로 2분 내지 60분 동안 어닐됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 20 항에 있어서,상기 하프늄옥사이드(HfO2) 레이어는 표면특성 향상을 위하여 200℃ 내지 500℃의 온도에서 2분 내지 10분 정도 자외선과 O3처리됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 20 항에 있어서,상기 하프늄옥사이드(HfO2) 레이어는 특성 향상 및 결정화를 위하여 500℃ 내지 800℃의 온도에서 N2O 또는 N2분위기에서 퍼니스(Furnace)를 이용하여 열처리됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 16 항에 있어서,상기 제 3 공정의 상기 상부 전극은 화학기상증착된 TiN과 폴리실리콘이 순차적으로 증착되어 적층되는 2중막으로 형성됨을 특징으로 하는 원자층 증착방법을 이용한 캐패시터 제조 방법.
- 제 16 항에 있어서,상기 제 3 공정의 상기 상부 전극은 폴리실리콘, TiN 또는 Ru 중 어느 하나를 재질호하는 단일막으로 형성됨을 특징으로 하는 원자층 증착 방법.
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