KR20040030316A - 플라즈마 디스플레이 패널의 구동방법 및 구동장치 - Google Patents

플라즈마 디스플레이 패널의 구동방법 및 구동장치 Download PDF

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Abstract

본 발명은 서스테인 구동마진을 향상시킬 수 있도록 한 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
본 발명의 실시예에 의한 플라즈마 디스플레이 패널의 구동방법은 평균휘도레벨(Average Picture Level : APL)에 대응하여 서스테인 펄스 수를 설정하는 단계와, 평균휘도레벨에 비례하여 서스테인 펄스의 주기를 설정하는 단계를 포함한다.

Description

플라즈마 디스플레이 패널의 구동방법 및 구동장치{Method and Apparatus of Driving Plasma Display Panel}
본 발명은 플라즈마 디스플레이 패널의 구동방법 및 구동장치에 관한 것으로 특히, 서스테인 구동마진을 향상시킬 수 있도록 한 플라즈마 디스플레이 패널의 구동방법 및 구동장치에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 함)은 가스방전에 의해 발생되는 진공 자외선이 형광체를 여기시킬 때 형광체로부터 가시광선이 발생되는 것을 이용한 표시장치이다. PDP는 지금까지 표시수단의 주종을 이루어왔던 음극선관(Cathode Ray Tube : CRT)에 비해 두께가 얇고 가벼우며, 고선명 대형화면의 구현이 가능하다는 점등의 장점이 있다. PDP는 매트릭스 형태로 배열된 다수의 방전셀들로 구성되며, 하나의 방전셀은 화면의 한 화소를 이루게 된다.
도 1은 종래의 3 전극 교류 면방전형 PDP의 방전셀 구조를 도시한 사시도이다.
도 1을 참조하면, 종래의 3 전극 교류 면방전형 PDP의 방전셀은 상부기판(10) 상에 형성되어진 제 1전극(12Y) 및 제 2전극(12Z)과, 하부기판(18)상에 형성되어진 어드레스 전극(20X)을 구비한다.
제 1전극(12Y)과 제 2전극(12Z)이 나란하게 형성된 상부기판(10)에는 상부 유전체층(14)과 보호막(16)이 적층된다. 상부 유전체층(14)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(16)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전체층(14)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호막(16)으로는 통상 산화마그네슘(MgO)이 이용된다.
어드레스전극(20X)이 형성된 하부기판(18) 상에는 하부 유전체층(22), 격벽(24)이 형성되며, 하부 유전체층(22)과 격벽(24) 표면에는 형광체층(26)이 도포된다. 어드레스전극(20X)은 제 1전극(12Y) 및 제 2전극(12Z)과 교차되는 방향으로 형성된다.
격벽(24)은 어드레스전극(20X)과 나란하게 형성되어 방전에 의해 생성된 자외선 및 가시광이 인접한 방전셀에 누설되는 것을 방지한다. 형광체층(26)은 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 상부기판(10), 하부기판(18)과 격벽(24) 사이에 마련된 방전공간에는 가스방전을 위한 불활성 가스가 주입된다.
이와 같은 PDP는 화상의 계조(Gray Level)를 표현하기 위하여 한 프레임을 방전횟수가 다른 여러 서브필드로 나누어 구동하고 있다. 각 서브필드는 다시 방전을 균일하게 일으키기 위한 리셋 기간, 방전셀을 선택하기 위한 어드레스 기간 및 방전횟수에 따라 계조를 표현하는 서스테인 기간으로 나뉘어진다.
예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 1/60 초에 해당하는프레임 기간(16.67㎳)은 도 2와 같이 8개의 서브필드들(SF1내지SF8)로 나누어지게 된다. 아울러, 8개의 서브 필드별(SF1내지SF8) 각각은 어드레스 기간과 서스테인 기간으로 다시 나누어지게 된다. 여기서, 각 서브필드의 리셋 기간 및 어드레스 기간은 각 서브필드마다 동일한 반면에 서스테인 기간은 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가되면서 계조에 따른 화상을 표시한다.
도 3은 종래의 플라즈마 디스플레이 패널의 구동장치를 나타내는 도면이다.
도 3을 참조하면, 종래의 PDP의 구동장치는 입력라인(1)과 패널(46) 사이에 접속된 제 1역감마 보정부(32A), 이득 제어부(34), 오차 확산부(36), 서브필드 맵핑부(38) 및 데이터 정렬부(40)와; 입력라인(1)과 패널(46) 사이에 접속된 프레임 메모리(30), 제 2역감마 보정부(32B), APL(Average Picture Level : 평균휘도레벨)부(42) 및 파형 발생부(44)를 구비한다.
제 1 및 제 2역감마 보정부(32A,32B)는 감마보정된 비디오신호를 역감마 보정하여 영상신호의 계조값에 따른 휘도값을 선형적으로 변환시킨다. 프레임 메모리(30)는 한 프레임 분의 데이터(R,G,B)를 저장하고, 저장된 데이터를 제 2역감마 보정부(32B)로 공급한다.
APL 부(42)는 제 2역감마 보정부(32B)에 의해 보정된 비디오 데이터를 입력받아 서스테인 펄스수를 조절하기 위한 N(N은 자연수)단계 신호를 발생한다. 이득 제어부(34)는 제 1역감마 보정부(32A)에서 보정된 비디오 데이터를 유효이득만큼 증폭시킨다.
오차 확산부(36)는 셀의 오차성분을 인접한 셀들로 확산시킴으로써 휘도값을미세하게 조정한다. 서브필드 맵핑부(38)는 오차 확산부(36)로부터 보정된 비디오 데이터를 서브필드별로 재할당 한다.
데이터 정렬부(40)는 패널(46)의 해상도 포맷에 적합하게 서브필드 맵핑부(38)로부터 입력되는 비디오 데이터를 변환하여 패널(46)의 어드레스 구동 집적회로(Integrated Circuit : 이하 "IC"라 함)로 공급한다.
파형 발생부(44)는 APL 부(42)로부터 입력된 N단계 신호에 의해 타이밍 제어신호를 생성하고, 생성된 타이밍 제어신호를 패널(46)의 어드레스 구동 IC, 스캔 구동 IC 및 서스테인 구동 IC로 공급한다.
이와 같은 종래의 플라즈마 디스플레이 패널의 구동장치에서 APL부(42)는 PDP의 소비전력을 어느 정도 일정하게 유지함과 아울러 전체 영상의 밝기가 어두울 때 상대적으로 밝은 부분을 강조한다. 이를 위해, APL 단계는 도 4와 같이 서스테인 펄스 수와 반비례되도록 설정된다. 다시 말하여, APL 단계가 높을 경우 적은 수의 서스테인 펄스가 공급되고, APL 단계가 낮을 경우 많은 수의 서스테인 펄스가 공급된다. 이와 같이 APL 단계가 서스테인 펄스 수와 반비례되도록 설정되면 패널에서 소비되는 소비전력이 어느 정도 일정하게 유지됨과 아울러 전체 영상의 밝기가 어두울 때 상대적으로 밝은 부분이 강조된다.
하지만, 이와 같이 APL 단계가 서스테인 펄스 수와 반비례 관계로 설정되면 높은 APL 단계에서 적은 수의 서스테인 펄스가 공급됨으로써 서스테인 기간이 충분히 활용되지 못하는 문제점이 발생된다. 다시 말하여, 높은 APL 단계에서는 서스테인 기간 중 일부 기간에만 서스테인 펄스가 공급되기 때문에 서스테인 구동마진이 저하된다. 따라서, 종래의 PDP는 APL 단계가 높을 경우의 발광효율이 그 외의 경우보다 낮아진다.
이를 상세히 설명하면, 높은 APL 단계에서는 적은 수의 서스테인 펄스가 공급되기 때문에 미리 할당된 서스테인 기간 중 일부 구간동안만 서스테인 펄스가 공급되게 된다. 따라서, 높은 APL 단계에서는 서스테인 기간 중 방전이 발생되지 않는 기간(이하 "휴지기간"이라 함)이 넓어지게 된다. 이와 같이 휴지기간이 넓어지면, 즉 현재 서스테인 기간과 다음 서스테인 기간사이에서 서스테인 펄스가 공급되는 시간이 길게 설정되면 서스테인 구동마진이 저하되게 된다. 일례로, 휴지기간이 넓어지게 되면 이전 서스테인 방전에 의하여 생성된 하전입자들이 재결합에 의하여 소모되기 때문에 서스테인 방전이 불안정하게 발생되게 된다.
따라서, 본 발명의 목적은 서스테인 구동마진을 향상시킬 수 있도록 한 플라즈마 디스플레이 패널의 구동방법 및 구동장치를 제공하는 것이다.
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널의 방전셀 구조를 나타내는 사시도.
도 2는 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널의 한 프레임을 나타내는 도면.
도 3은 종래의 플라즈마 디스플레이 패널의 구동장치를 나타내는 블록도.
도 4는 APL 단계에 대응되어 설정되는 서스테인 펄스 수를 나타내는 그래프.
도 5a 및 도 5b는 본 발명의 제 1실시예에 의한 APL에 따른 서스테인펄스의 주기를 나타내는 그래프.
도 6a 및 도 6b는 서스테인 펄스의 주기가 넓어질 수 있도록 APL에 비례되어 서스테인 펄스의 하이 폭이 넓어지는 것을 나타내는 그래프.
도 7a 및 도 7b는 서스테인 펄스의 주기가 넓어질 수 있도록 APL에 비례되어 서스테인 펄스의 로우 폭이 넓어지는 것을 나타내는 그래프.
도 8a 및 도 8b는 본 발명의 제 2실시예에 의한 APL에 따른 서스테인펄스의 주기를 나타내는 그래프.
도 9a 및 도 9b는 본 발명의 제 3실시예에 의한 APL에 따른 서스테인펄스의 주기를 나타내는 그래프.
도 10a 및 도 10b는 본 발명의 제 4실시예에 의한 APL에 따른 서스테인펄스의 주파수를 나타내는 그래프.
도 11은 본 발명의 제 5실시예에 의한 APL에 따른 서스테인펄스의 주파수를 나타내는 그래프.
도 12는 본 발명의 실시예에 의한 플라즈마 디스플레이 패널의 구동장치를 나타내는 블록도.
도 13은 본 발명의 다른 실시예에 의한 플라즈마 디스플레이 패널의 구동장치를 나타내는 블록도.
< 도면의 주요 부분에 대한 부호의 설명 >
1,61,81 : 입력라인10 : 상부기판
12Y : 제 1전극12Z : 제 2전극
14,22 : 유전체층16 : 보호막
18 : 하부기판20X : 어드레스전극
24 : 격벽26 : 형광체층
30,51,71 : 프레임 메모리34,54,74 : 이득제어부
32A,32B,52A,52B,72A,72B : 역감마 보정부
36,56,76 : 오차확산부38,58,78 : 서브필드 맵핑부
40,60,80 : 데이터 정렬부42,62,82 : APL부
44,64,84 : 파형발생부46,66,86 : 패널
68,88 : 주파수(주기) 설정부90 : 한계값 설정부
상기 목적을 달성하기 위하여, 본 발명의 실시예에 의한 플라즈마 디스플레이 패널의 구동방법은 평균휘도레벨(Average Picture Level : APL)에 대응하여 서스테인 펄스 수를 설정하는 단계와, 평균휘도레벨에 비례하여 서스테인 펄스의 주기를 설정하는 단계를 포함한다.
상기 서스테인 펄스 수를 설정하는 단계에서는 평균휘도레벨과 반비례 관계로 서스테인 펄스 수를 설정한다.
상기 서스테인 펄스의 주기를 설정하는 단계는 평균휘도레벨에 비례하여 서스테인 펄스의 하이 폭을 넓게 설정하는 단계를 포함한다.
상기 서스테인 펄스의 주기를 설정하는 단계는 평균휘도레벨에 비례하여 서스테인 펄스의 로우 폭을 넓게 설정하는 단계를 포함한다.
상기 서스테인 펄스의 주기를 설정하는 단계는 평균휘도레벨에 비례하여 서스테인 펄스의 로우 폭 및 하이 폭을 넓게 설정하는 단계를 포함한다.
상기 서스테인 펄스의 최대 주기를 서스테인 펄스의 최소 주기 보다 0.5㎲ 내지 10㎲의 범위 내에서 넓게 설정한다.
상기 평균휘도레벨의 적어도 일부구간에서 서스테인 펄스의 주기가 변화된다.
상기 서스테인 펄스의 주기가 일정폭 이하로 제한되도록 소정의 평균휘도레벨 단계 이상에서 미니멈 한계주파수를 설정하는 단계를 추가로 포함한다.
상기 미너멈 한계주파수는 공급될 수 있는 서스테인 펄스의 최대 주기가 서스테인 펄스의 최소 주기 보다 0.5㎲ 내지 10㎲의 범위 내에서 넓어지도록 설정한다.
상기 서스테인 펄스의 주기가 일정폭 이상으로 제한되도록 소정의 평균휘도레벨 단계 이하에서 맥시멈 한계주파수를 설정하는 단계를 추가로 포함한다.
상기 서스테인 펄스의 주기는 평균휘도레벨의 낮은 단계에서 높은 단계로 갈수록 계단 형태로 증가한다.
본 발명의 플라즈마 디스플레이 패널의 구동방법은 평균휘도레벨(Average Picture Level : APL)에 대응하여 서스테인 펄스 수를 설정하는 단계와, 평균휘도레벨에 비례하여 서스테인 펄스의 하이 폭을 설정하는 단계를 포함한다.
상기 서스테인 펄스 수를 설정하는 단계에서는 평균휘도레벨과 반비례 관계로 서스테인 펄스 수를 설정한다.
상기 서스테인 펄스의 로우 폭은 평균휘도레벨과 무관하게 일정폭을 유지한다.
상기 서스테인 펄스의 최대 하이 폭을 서스테인 펄스의 최소 하이 폭보다 0.5㎲ 내지 10㎲의 범위 내에서 넓게 설정한다.
상기 평균휘도레벨에 비례하여 서스테인 펄스의 하이 폭을 설정하는 단계는 적어도 둘 이상의 평균휘도레벨 단계가 포함될 수 있도록 평균휘도레벨을 다수의 구간으로 분할하는 단계와, 평균휘도레벨 구간을 단위로 서스테인 펄스의 하이 폭을 설정하는 단계를 추가로 포함한다.
상기 평균휘도레벨의 적어도 일부구간에서 서스테인 펄스의 하이 폭이 변화된다.
상기 서스테인 펄스의 하이 폭이 일정폭 이하로 제한되도록 소정의 평균휘도레벨 단계 이상에서 미니멈 한계주파수를 설정하는 단계를 추가로 포함한다.
상기 미너멈 한계주파수는 공급될 수 있는 서스테인 펄스의 최대 하이 폭이 서스테인 펄스의 최소 하이 폭보다 0.5㎲ 내지 10㎲의 범위 내에서 넓어지도록 설정한다.
상기 서스테인 펄스의 하이 폭이 일정폭 이상으로 제한되도록 소정의 평균휘도레벨 단계 이하에서 맥시멈 한계주파수를 설정하는 단계를 추가로 포함한다.
상기 서스테인 펄스의 하이 폭은 평균휘도레벨의 낮은 단계에서 높은 단계로 갈수록 계단 형태로 증가한다.
본 발명의 플라즈마 디스플레이 패널의 구동방법은 평균휘도레벨(Average Picture Level : APL)에 대응하여 서스테인 펄스 수를 설정하는 단계와, 평균휘도레벨에 비례하여 서스테인 펄스의 로우 폭을 설정하는 단계를 포함한다.
상기 서스테인 펄스 수를 설정하는 단계에서는 평균휘도레벨과 반비례 관계로 서스테인 펄스 수를 설정한다.
상기 서스테인 펄스의 최대 로우 폭을 서스테인 펄스의 최소 로우 폭보다 0.5㎲ 내지 10㎲의 범위 내에서 넓게 설정한다.
상기 평균휘도레벨에 비례하여 서스테인 펄스의 로우 폭을 설정하는 단계는 적어도 둘 이상의 평균휘도레벨 단계가 포함될 수 있도록 평균휘도레벨을 다수의 구간으로 분할하는 단계와, 평균휘도레벨 구간을 단위로 서스테인 펄스의 로우 폭을 설정하는 단계를 추가로 포함한다.
상기 평균휘도레벨의 적어도 일부구간에서 서스테인 펄스의 로우 폭이 변화된다.
상기 서스테인 펄스의 로우 폭이 일정폭 이하로 제한되도록 소정의 평균휘도레벨 단계 이상에서 미니멈 한계주파수를 설정하는 단계를 추가로 포함한다.
상기 미너멈 한계주파수는 공급될 수 있는 서스테인 펄스의 최대 로우 폭이 서스테인 펄스의 최소 로우 폭보다 0.5㎲ 내지 10㎲의 범위 내에서 넓어지도록 설정한다.
상기 서스테인 펄스의 로우 폭이 일정폭 이상으로 제한되도록 소정의 평균휘도레벨 단계 이하에서 맥시멈 한계주파수를 설정하는 단계를 추가로 포함한다.
상기 서스테인 펄스의 로우 폭은 평균휘도레벨의 낮은 단계에서 높은 단계로 갈수록 계단 형태로 증가한다.
본 발명의 플라즈마 디스플레이 패널의 구동장치는 비디오 데이터에 대응되는 평균휘도레벨을 설정하기 위한 평균휘도 레벨부와, 평균휘도 레벨부에서 설정된 평균휘도레벨에 비례되도록 서스테인 펄스의 주기를 설정하기 위한 주기 설정부를 구비한다.
상기 주기 설정부는 평균휘도레벨에 비례되도록 서스테인 펄스의 하이 폭을 설정한다.
상기 주기 설정부는 평균휘도레벨에 비례되도록 서스테인 펄스의 로우 폭을 설정한다.
상기 주기 설정부는 평균휘도레벨에 비례되도록 서스테인 펄스의 로우 폭 및 하이 폭을 설정한다.
상기 서스테인 펄스 주기가 넓어 질 수 있는 최대 한계값 및 상기 서스테인 펄스의 주기가 좁아 질 수 있는 최소 한계값 중 적어도 하나 이상을 설정하기 위한 한계값 설정부를 구비한다.
상기 주기 설정부는 최대 한계값 및 최소 한계값 중 적어도 하나 이상을 입력받아 서스테인 펄스의 주기를 제어한다.
본 발명의 플라즈마 디스플레이 패널의 구동장치는 비디오 데이터에 대응되는 평균휘도레벨을 설정하기 위한 평균휘도 레벨부와, 평균휘도 레벨부에서 설정된 평균휘도레벨에 비례되도록 서스테인 펄스의 하이 폭을 설정하기 위한 주기 설정부를 구비한다.
상기 서스테인 펄스의 하이 폭이 넓어 질 수 있는 최대 한계값 및 서스테인 펄스의 하이 폭이 좁아 질 수 있는 최소 한계값 중 적어도 하나 이상을 설정하기 위한 한계값 설정부를 구비한다.
상기 주기 설정부는 최대 한계값 및 최소 한계값 중 적어도 하나 이상을 입력받아 서스테인 펄스의 하이 폭을 제어한다.
본 발명의 플라즈마 디스플레이 패널의 구동장치는 비디오 데이터에 대응되는 평균휘도레벨을 설정하기 위한 평균휘도 레벨부와, 평균휘도 레벨부에서 설정된 평균휘도레벨에 비례되도록 서스테인 펄스의 로우 폭을 설정하기 위한 주기 설정부를 구비한다.
상기 서스테인 펄스의 로우 폭이 넓어 질 수 있는 최대 한계값 및 서스테인 펄스의 로우 폭이 좁아 질 수 있는 최소 한계값 중 적어도 하나 이상을 설정하기 위한 한계값 설정부를 구비한다.
상기 주기 설정부는 최대 한계값 및 최소 한계값 중 적어도 하나 이상을 입력받아 서스테인 펄스의 로우 폭을 제어한다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부도면을 참조한 실시예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하 도 5a 내지 도 13을 참조하여 본 발명의 바람직한 실시예에 대하여 설명하기로 한다.
도 5a 및 도 5b는 본 발명의 제 1실시예에 의한 APL에 따른 서스테인펄스의 주기를 나타내는 그래프이다.
APL과 서스테인 펄스 수는 도 4와 같이 반비례 관계를 갖는다. 다시 말하여, APL 단계가 높아질 때 적은 수의 서스테인 펄스가 패널로 공급되고, APL 단계가 낮아질 때 많은 수의 서스테인 펄스가 패널로 공급된다. 이때, 본 발명에서는 도 5a 및 도 5b와 같이 낮은 APL 단계로부터 높은 APL 단계로 갈수록 서스테인 펄스의 주기가 선형적으로 증가되도록(주파수는 선형적으로 감소) 설정된다.(여기서, 실제로 공급되는 서스테인 펄스의 수는 종래와 동일하게 설정된다.)
이를 상세히 설명하면, 낮은 APL 단계에서는 i(예를 들어 1024)개의 서스테인 펄스가 패널로 공급된다. 이때, 낮은 APL 단계에서 공급되는 서스테인 펄스의 주파수(f2)는 높은 값을 갖도록 설정된다. 따라서, 주파수(f2)와 반비례 관계를 가지는 서스테인 펄스의 주기(T2)는 좁은 폭, 예를 들면 5㎲의 주기를 갖게 된다. 즉, 낮은 APL 단계에서는 i개의 서스테인펄스가 T2의 주기를 갖도록 패널로 공급된다.
한편, 높은 APL 단계에서는 J(예를 들어 200)개의 서스테인 펄스가 패널로 공급된다. 이때, 높은 APL 단계에서 공급되는 서스테인 펄스의 주파수(f1<f2)는낮은 값을 갖도록 설정된다. 따라서, 주파수(f1)와 반비례 관계를 가지는 서스테인 펄스의 주기(T1)는 넓은 폭, 예를 들면 15㎲의 주기를 갖게 된다. 즉, 높은 APL 단계에서 J개의 서스테인 펄스가 T1의 주기를 갖도록 패널로 공급된다.
다시 말하여, 본 발명의 제 1실시예에서는 APL 단계와 비례되도록 서스테인 펄스의 주기를 증가시킨다. 이와 같이 APL 단계와 비례되도록 서스테인 펄스의 주기가 증가되면 높은 APL 단계에서도 휴지시간이 넓어지지 않고, 이에 따라 서스테인 구동마진을 향상시킬 수 있다.
한편, APL 단계와 비례되어 증가되는 서스테인 펄스의 주기 증가 비율은 실험적으로 결정되게 된다. 실제로, APL 단계에 비례되어 증가되는 서스테인 펄스의 주기는 PDP의 해상도 및 인치 등에 의하여 다양하게 설정되게 된다. 일례로, 최저 APL 단계에서 5㎲ 주기를 가지는 서스테인 펄스가 공급된다면 최고 APL 단계에서는 5.5㎲ 내지 15㎲의 주기를 가지는 서스테인 펄스가 공급될 수 있다. 즉, 본 발명의 제 1실시예에서 서스테인 펄스의 주기는 최저 APL 단계에서 최고 APL 단계로 증가될 때 대략 0.5㎲ 내지 10㎲ 증가될 수 있다.
아울러, 본 발명에서는 APL 단계를 다수의 구간단위로 분할하고, 이 구간단위에 대응되어 서스테인 펄스의 주기를 증가시킬 수 있다. 다시 말하여, 본 발명에서는 도 5b의 점선과 같이 APL 단계를 다수의 구간으로 분할하고, 같은 구간에 포함된 APL 단계에서는 동일한 주기를 가지는 서스테인 펄스를 공급하고 다른 구간에 포함된 APL 단계에서는 상이한 주기를 가지는 서스테인 펄스를 공급할 수 있다. 여기서, 구간에 포함된 APL 단계가 높아질수록 서스테인 펄스의 주기도 증가하게된다.
한편, 본 발명에서는 서스테인 펄스의 주기를 넓게 설정하기 위하여 다양한 방법이 이용될 수 있다. 예를 들어, 도 6a 및 도 6b에 도시된 바와 같이 서스테인 펄스에서 하이 폭 만을 증가시켜 서스테인 펄스의 주기를 넓게 설정할 수 있다.
즉, 도 6a 및 도 6b와 같이 낮은 APL 단계로부터 높은 APL 단계로 갈수록 서스테인 펄스의 하이 폭을 증가시킴으로써 서스테인 펄스의 주기를 넓게 설정한다. 이와 같이 서스테인 펄스의 하이 폭이 넓어지면 서스테인 방전이 안정적으로 일어날 수 있다. 다시 말하여, 서스테인 펄스의 하이 폭이 넓어지면 서스테인 방전이 발생될 수 있는 시간이 넓어지므로 서스테인 방전이 발생될 수 있는 확률이 증가된다. 한편, 본 발명에서는 도 6a의 점선에 도시된 바와 같이 APL 단계를 다수의 구간으로 분할하고, 그 구간에 대응하여 서스테인 펄스의 하이 폭을 증가킬 수 있다. 다시 말하여, 본 발명에서는 도 6a의 점선과 같이 APL 단계를 다수의 구간으로 분할하고, 같은 구간에 포함된 APL 단계에서는 동일한 하이 폭을 가지는 서스테인 펄스를 공급하고 다른 구간에 포함된 APL 단계에서는 상이한 하이 폭을 가지는 서스테인 펄스를 공급할 수 있다.
또한, 본 발명에서는 서스테인 펄스의 주기를 넓게 설정하기 위하여 도 7a 및 도 7b에 도시된 바와 같이 서스테인 펄스의 로우 폭만을 증가시킬 수 있다. 즉, 도 7a 및 도 7b에 도시된 바와 같이 낮은 APL 단계로부터 높은 APL 단계로 갈수록 서스테인 펄스의 로우 폭을 증가시킴으로써 서스테인 펄스의 주기를 넓게 설정할 수 있다. 이와 같이 APL 단계에 비례하여 서스테인 펄스의 로우 폭이 넓어지면 높은 APL 단계에서 휴지시간이 증가되는 것을 방지할 수 있고, 이에 따라 안정적으로 서스테인 방전을 일으킬 수 있다. 다시 말하여, APL에 비례하여 서스테인 펄스의 로우 폭이 넓어지면 서스테인 펄스가 공급되지 않는 휴지기간이 APL 단계와 무관하게 대략 일정하게 유지될 수 있다. 이와 같이 휴지기간이 높은 APL 단계에 대응하여 넓어지지 않으면 안정적으로 서스테인 방전을 일으킬 수 있다.
한편, 본 발명에서는 도 7a의 점선에 도시된 바와 같이 APL 단계를 다수의 구간으로 분할하고, 그 구간에 대응하여 서스테인 펄스의 로우 폭을 증가킬 수 있다. 다시 말하여, 본 발명에서는 도 7a의 점선과 같이 APL 단계를 다수의 구간으로 분할하고, 같은 구간에 포함된 APL 단계에서는 동일한 로우 폭을 가지는 서스테인 펄스를 공급하고 다른 구간에 포함된 APL 단계에서는 상이한 로우 폭을 가지는 서스테인 펄스를 공급할 수 있다. 그리고, 본 발명에서는 낮은 APL 단계로부터 높은 APL 단계로 갈수록 서스테인 펄스의 로우 폭 및 하이 폭을 증가시킴으로써 서스테인 펄스의 주기를 넓게 설정할 수도 있다.
도 8a 및 도 8b는 본 발명의 제 2실시예에 의한 APL에 따른 서스테인펄스의 주기를 나타내는 그래프이다.
도 8 및 도 8b를 참조하면, 본 발명의 제 2실시예에서는 낮은 APL 단계로부터 높은 APL 단계로 갈수록 서스테인 펄스의 주기가 선형적으로 증가(주파수는 선형적으로 감소)된다. 또한, 본 발명의 제 2실시예에서는 미니멈 한계주파수(f3)(즉, 최대 서스테인펄스 주기(T3))를 설정하고, APL 단계가 소정이상으로 증가할 때 미니멈 한계주파수(f3)를 가지는 서스테인 펄스를 패널로 공급한다.
이를 상세히 설명하면, 본 발명의 제 2실시예에서는 APL 단계와 비례되도록 서스테인 펄스의 주기가 설정된다. 다시 말하여, APL 단계가 증가될 때 서스테인 펄스의 주기도 함께 증가시킴으로써 높은APL 단계에서도 서스테인 기간이 충분히 활용되도록 한다.
그리고, 본 발명의 제 2실시예에서는 APL 단계가 특정단계 이상이 될 때 서스테인 펄스의 주기가 일정하게 유지될 수 있도록 미니멈 한계주파수(f3)를 설정한다. 예를 들어, 서스테인 펄스가 15㎲의 주기를 갖도록 미니멈 한계 주파수(f3)를 설정하면, 특정단계 이상의 APL 단계에서는 15㎲의 주기를 가지는 서스테인펄스가 공급된다. 다시 말하여, 특정단계 이상의 APL단계에서는 서스테인 펄스의 수만이 변화될 뿐(도 4에 도시된 바와 같이 APL 단계가 높아질 수록 서스테인 펄스의 수가 적어진다.) 서스테인 펄스의 주기(또는 주파수)는 일정하게 유지된다. 여기서, 미니멈 한계주파수(f3)는 높은 APL 단계에서 충분한 서스테인 마진이 확보되도록 설계자에 의해 미리 설정된다. 실제로, 미니멈 한계주파수(f3)는 PDP가 안정된 동작을 할 수 있도록 PDP의 해상도 및 인치 등을 고려하여 다양하게 설정될 수 있다. 일례로, 최저 APL 단계에서 5㎲ 주기를 가지는 서스테인 펄스가 공급된다면 최대 공급될 수 있는 서스테인 펄스의 주기가 5.5㎲ 내지 15㎲가 될 수 있도록 미니멈 한계주파수(f3)가 설정될 수 있다. 즉, 본 발명의 제 2실시예에서 서스테인 펄스의 주기는 최저 APL 단계에서 공급되는 서스테인 펄스의 주기로부터 대략 0.5㎲ 내지 10㎲ 증가될 수 있도록 한계주파수(f3)가 설정된다.
이와 같은 본 발명의 제 2실시예에서는 APL 단계와 비례되도록 서스테인 펄스의 주기가 선형적으로 증가되기 때문에 높은 APL 단계에서 휴지시간이 넓어지는 것을 방지할 수 있고, 이에 따라 서스테인 구동마진을 향상시킬 수 있다. 아울러, 미리 할당된 서스테인 기간내에 모든 서스테인 펄스가 공급될 수 있도록 미니멈 한계주파수(f3)를 설정함으로써 안정된 서스테인 방전을 일으킬 수 있다.
도 9a 및 도 9b는 본 발명의 제 3실시예에 의한 APL에 따른 서스테인 펄스의 주기를 나타내는 그래프이다.
도 9a 및 도 9b를 참조하면, 본 발명의 제 3실시예에서는 낮은 APL 단계로부터 높은 APL 단계로 갈수록 서스테인 펄스의 주기가 선형적으로 증가(주파수는 선형적으로 감소)된다. 또한, 본 발명의 제 3실시예에서는 맥시멈 한계주파수(f4)(즉, 최소 서스테인펄스 주기(T4))를 설정하여 낮은 APL 단계에서 패널로 공급되는 서스테인 펄스 수를 임의로 설정할 수 있다.
즉, 본 발명의 제 3실시예에서는 맥시멈 한계주파수(f4)를 APL 단계의 특정 위치에 설정함으로써 최저 APL 단계에서 패널로 공급될 수 있는 서스테인 펄스 수를 임의로 설정할 수 있다. 예를 들어, 최저로 낮은 APL 단계에서는 i(예를 들어 1024) 보다 많은 값을 가지는 M(예를 들어 1500)개의 서스테인 펄스가 패널로 공급되도록 맥시멈 한계주파수(f4>f2)를 설정할 수 있다. 이때, 서스테인 펄스의 주기는 맥시멈 한계주파수에 반비례되기 때문에 좁은 주기(T4), 예를 들면 3㎲의 주기를 갖는다. 이와 같이 맥시멈 한계주파수(f4)를 높게 설정하여 패널로 많은 수의 서스테인 펄스가 공급되면 패널의 피크 휘도가 향상될 수 있다.
한편, 높은 APL 단계에서는 J(예를 들어 200)개의 서스테인 펄스가 패널로공급된다. 이때, 높은 APL 단계에서 공급되는 서스테인 펄스의 주파수(f1)는 낮은 값을 갖도록 설정된다. 따라서, 주파수(f1)와 반비례 관계를 가지는 서스테인 펄스의 주기(T1)는 넓은 값, 예를 들면 15㎲의 주기를 갖게 된다. 즉, 높은 APL 단계에서 J개의 서스테인 펄스가 T1의 주기를 갖도록 패널로 공급된다.
이와 같이, 본 발명의 제 3실시예에서는 APL 단계에 비례하여 서스테인 펄스의 주기를 선형적으로 증가시킴으로써 발광효율을 향상시킬 수 있다. 아울러, 본 발명의 제 3실시예에서는 맥시멈 한계주파수(f4)를 설정하여 낮은 APL 단계에서 많은 수의 서스테인 펄스가 공급되도록 하고, 이에 따라 패널의 피크휘도를 향상시킬 수 있다.
한편, 본 발명에서는 도 10a와 10b와 같이 맥시멈 한계주파수(f4) 및 미니멈 한계주파수(f3)를 동시에 설정할 수 있다. 즉, 본 발명에서는 도 8과 같이 맥시멈 한계주파수(f4) 및 미니멈 한계주파수(f3)를 동시에 설정함으로써 패널의 피크휘도를 향상시킴과 아울러 안정적으로 서스테인 방전을 일으킬 수 있다.
한편, 도 5a, 도 6a, 7a, 8a, 9a 및 10a에서는 APL 단계에 따라 주파수(즉, 주기)가 선형적으로 증가 또는 감소되었다. 하지만, 실제로 본 발명이 PDP에 적용될 때에는 도 11과 같이 APL 단계에 대응되어 주파수(및 주기)는 계단형태로 증가 또는 감소된다. 이를 상세히 설명하면, APL단계에 따라 주파수가 선형적으로 증가 또는 감소되게 되면 APL의 특정 단계(50)에서는 f5(f2>f5>f1)의 주파수를 가지는 K개의 서스테인 펄스가 공급되어야 한다. 여기서, APL 단계가 선형적으로 증가 또는 감소되면 f5의 주파수(또는 주기)가 소수점을 가지는 실수형태로 설정될 수 있다. 하지만, 소수점 형태의 주파수가 공급될 수 없으므로 내림방법을 이용하여 주파수(f5)를 정수 형태로 설정한다. 즉, 본 발명이 실제 적용될 때에는 내림 방법을 이용하여 주파수를 설정하게 됨으로 APL 단계에 대응되어 주파수(즉, 주기)는 계단형태로 증가 또는 감소된다.
도 12는 본 발명의 실시예에 의한 플라즈마 디스플레이 패널의 구동장치를 나타내는 도면이다.
도 12를 참조하면, 본 발명의 실시예에 의한 PDP의 구동장치는 입력라인(61)과 패널(66) 사이에 접속된 제 1역감마 보정부(52A), 이득 제어부(54), 오차 확산부(56), 서브필드 맵핑부(58) 및 데이터 정렬부(60)와; 입력라인(61)과 패널(66) 사이에 접속된 프레임 메모리(51), 제 2역감마 보정부(52B), APL부(62), 주파수(주기) 설정부(68) 및 파형 발생부(64)를 구비한다.
제 1 및 제 2역감마 보정부(52A,52B)는 감마 보정된 비디오신호를 역감마 보정하여 영상신호의 계조값에 따른 휘도값을 선형적으로 변환시킨다. 프레임 메모리(51)는 한 프레임 분의 데이터(R,G,B)를 저장하고, 저장된 데이터를 제 2역감마 보정부(52B)로 공급한다.
APL 부(62)는 제 2역감마 보정부(52B)에 의해 보정된 비디오 데이터를 입력받아 서스테인 펄스 수를 조절하기 위한 N(N은 자연수)단계 신호를 발생한다. 이득 제어부(54)는 제 1역감마 보정부(52A)에서 보정된 비디오 데이터를 유효이득만큼 증폭시킨다.
오차 확산부(56)는 셀의 오차성분을 인접한 셀들로 확산시킴으로써 휘도값을미세하게 조정한다. 서브필드 맵핑부(58)는 오차 확산부(56)로부터 보정된 비디오 데이터를 서브필드별로 재할당한다.
데이터 정렬부(60)는 패널(66)의 해상도 포맷에 적합하게 서브필드 맵핑부(58)로부터 입력되는 비디오 데이터를 변환하여 패널(66)의 어드레스 구동 집적회로(Integrated Circuit : 이하 "IC"라 함)로 공급한다.
주파수(주기) 설정부(68)는 APL부(62)로부터 공급되는 APL 단계에 대응하여 서스테인 펄스의 주파수(주기)를 결정한다. 일례로, 주파수(주기) 설정부(68)는 도 5a 내지 도 7b에 도시된 바와 같이 APL 단계가 높아질 수록 넓은 주기를 갖는 서스테인 펄스가 공급되도록 서스테인 펄스의 주기를 설정한다. 여기서, 주파수(주기) 설정부(68)는 APL에 비례하여 서스테인 펄스의 하이 폭 및/또는 로우 폭을 넓게 설정함으로써 서스테인 펄스의 주기가 넓어지도록 한다.
파형 발생부(64)는 APL부(62)로부터 공급되는 A단계 신호에 의해 타이밍 제어신호를 생성한다. 이때, 파형 발생부(64)는 주파수(주기) 설정부(68)로부터 공급되는 서스테인 펄스의 주파수 설정신호에 의하여 서스테인 펄스의 주파수를 설정한다. 파형 발생부(64)로부터 생성된 타이밍 제어신호는 패널(66)의 어드레스 구동 IC, 스캔 구동 IC 및 서스테인 구동 IC로 공급한다.
도 13은 본 발명의 다른 실시예에 의한 플라즈마 디스플레이 패널의 구동장치를 나타내는 도면이다.
도 13을 참조하면, 본 발명의 다른 실시예에 의한 PDP의 구동장치는 입력라인(81)과 패널(86) 사이에 접속된 제 1역감마 보정부(72A), 이득 제어부(74), 오차확산부(76), 서브필드 맵핑부(78) 및 데이터 정렬부(80)와; 입력라인(81)과 패널(86) 사이에 접속된 프레임 메모리(71), 제 2역감마 보정부(72B), APL부(72), 주파수(주기) 설정부(78), 한계값 설정부(90) 및 파형 발생부(84)를 구비한다.
제 1 및 제 2역감마 보정부(72A,72B)는 감마보정된 비디오신호를 역감마보정하여 영상신호의 계조값에 따른 휘도값을 선형적으로 변환시킨다. 프레임 메모리(71)는 한 프레임 분의 데이터(R,G,B)를 저장하고, 저장된 데이터를 제 2역감마 보정부(72B)로 공급한다.
APL 부(82)는 제 2역감마 보정부(72B)에 의해 보정된 비디오 데이터를 입력받아 서스테인 펄스수를 조절하기 위한 N(N은 자연수)단계 신호를 발생한다. 이득 제어부(74)는 제 1역감마 보정부(72A)에서 보정된 비디오 데이터를 유효이득만큼 증폭시킨다.
오차 확산부(76)는 셀의 오차성분을 인접한 셀들로 확산시킴으로써 휘도값을 미세하게 조정한다. 서브필드 맵핑부(78)는 오차 확산부(76)로부터 보정된 비디오 데이터를 서브필드별로 재할당한다.
데이터 정렬부(80)는 패널(86)의 해상도 포맷에 적합하게 서브필드 맵핑부(78)로부터 입력되는 비디오 데이터를 변환하여 패널(86)의 어드레스 구동 IC로 공급한다.
한계값 설정부(90)는 주파수(주기) 설정부(88)에서 설정되는 맥시멈 한계값 및/또는 미니멈 한계값을 주파수(주기) 설정부(88)로 공급한다.
주파수(주기) 설정부(88)는 APL부(82)로부터 공급되는 APL 단계에 대응하여서스테인 펄스의 주파수(주기)를 결정한다. 일례로, 주파수(주기) 설정부(68)는 도 5a 내지 도 7b에 도시된 바와 같이 APL 단계가 높아질 수록 넓은 주기를 갖는 서스테인 펄스가 공급되도록 서스테인 펄스의 주기를 설정한다. 여기서, 주파수(주기) 설정부(68)는 APL에 비례하여 서스테인 펄스의 하이 폭 및/또는 로우 폭을 넓게 설정함으로써 서스테인 펄스의 주기가 넓어지도록 한다. 또한, 주파수(주기) 설정부(88)는 한계값 설정부(90)로부터 공급되는 맥시멈 한계값 및/또는 미니멈 한계값을 이용하여 도 8a 내지 도 10b에 도시된 바와 같이 서스테인 펄스의 주파수(주기)를 설정한다.
파형 발생부(84)는 APL부(82)로부터 공급되는 N단계 신호에 의해 타이밍 제어신호를 생성한다. 이때, 파형 발생부( 주파수(주기) 설정부(88)로부터 공급되는 서스테인 펄스의 주파수 설정신호에 의하여 서스테인 펄스의 주파수를 설정한다. 파형 발생부(84)로부터 생성된 타이밍 제어신호는 패널(86)의 어드레스 구동 IC, 스캔 구동 IC 및 서스테인 구동 IC로 공급한다.
상술한 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널의 구동방법 및 구동장치에 의하면 APL 단계가 높아질 수록 넓은 주기를 가지는 서스테인 펄스를 공급하여 발광효율을 향상시킬 수 있다. 아울러, 본 발명에서는 높은 미니멈 한계주파수를 설정하여 낮은 APL 단계에서 많은 수의 서스테인 펄스를 공급할 수 있고, 이에 따라 패널의 피크 휘도를 향상시킬 수 있다. 더불어, 본 발명에서는 일정한서스테인 마진이 확보될 수 있도록 맥시멈 한계주파수를 설정함으로써 안정된 서스테인 방전을 일으킬 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.

Claims (42)

  1. 평균휘도레벨(Average Picture Level : APL)에 대응하여 서스테인 펄스 수를 설정하는 단계와,
    상기 평균휘도레벨에 비례하여 서스테인 펄스의 주기를 설정하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  2. 제 1항에 있어서,
    상기 서스테인 펄스 수를 설정하는 단계에서는 상기 평균휘도레벨과 반비례 관계로 상기 서스테인 펄스 수를 설정하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  3. 제 1항에 있어서,
    상기 서스테인 펄스의 주기를 설정하는 단계는
    상기 평균휘도레벨에 비례하여 상기 서스테인 펄스의 하이 폭을 넓게 설정하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  4. 제 1항에 있어서,
    상기 서스테인 펄스의 주기를 설정하는 단계는
    상기 평균휘도레벨에 비례하여 상기 서스테인 펄스의 로우 폭을 넓게 설정하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  5. 제 1항에 있어서,
    상기 서스테인 펄스의 주기를 설정하는 단계는
    상기 평균휘도레벨에 비례하여 상기 서스테인 펄스의 로우 폭 및 하이 폭을 넓게 설정하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  6. 제 1항에 있어서,
    상기 서스테인 펄스의 최대 주기를 상기 서스테인 펄스의 최소 주기 보다 0.5㎲ 내지 10㎲의 범위 내에서 넓게 설정하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  7. 제 1항에 있어서,
    상기 평균휘도레벨의 적어도 일부구간에서 서스테인 펄스의 주기가 변화되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  8. 제 7항에 있어서,
    상기 서스테인 펄스의 주기가 일정폭 이하로 제한되도록 소정의 평균휘도레벨 단계 이상에서 미니멈 한계주파수를 설정하는 단계를 추가로 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  9. 제 8항에 있어서,
    상기 미너멈 한계주파수는 공급될 수 있는 서스테인 펄스의 최대 주기가 상기 서스테인 펄스의 최소 주기 보다 0.5㎲ 내지 10㎲의 범위 내에서 넓어지도록 설정하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  10. 제 7항에 있어서,
    상기 서스테인 펄스의 주기가 일정폭 이상으로 제한되도록 소정의 평균휘도레벨 단계 이하에서 맥시멈 한계주파수를 설정하는 단계를 추가로 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  11. 제 1항에 있어서,
    상기 서스테인 펄스의 주기는 상기 평균휘도레벨의 낮은 단계에서 높은 단계로 갈수록 계단 형태로 증가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  12. 평균휘도레벨(Average Picture Level : APL)에 대응하여 서스테인 펄스 수를 설정하는 단계와,
    상기 평균휘도레벨에 비례하여 서스테인 펄스의 하이 폭을 설정하는 단계를포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  13. 제 12항에 있어서,
    상기 서스테인 펄스 수를 설정하는 단계에서는 상기 평균휘도레벨과 반비례 관계로 상기 서스테인 펄스 수를 설정하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  14. 제 12항에 있어서,
    상기 서스테인 펄스의 로우 폭은 상기 평균휘도레벨과 무관하게 일정폭을 유지하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  15. 제 12항에 있어서,
    상기 서스테인 펄스의 최대 하이 폭을 상기 서스테인 펄스의 최소 하이 폭보다 0.5㎲ 내지 10㎲의 범위 내에서 넓게 설정하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  16. 제 12항에 있어서,
    상기 평균휘도레벨에 비례하여 서스테인 펄스의 하이 폭을 설정하는 단계는
    적어도 둘 이상의 평균휘도레벨 단계가 포함될 수 있도록 상기 평균휘도레벨을 다수의 구간으로 분할하는 단계와,
    상기 평균휘도레벨 구간을 단위로 상기 서스테인 펄스의 하이 폭을 설정하는 단계를 추가로 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  17. 제 12항에 있어서,
    상기 평균휘도레벨의 적어도 일부구간에서 상기 서스테인 펄스의 하이 폭이 변화되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  18. 제 17항에 있어서,
    상기 서스테인 펄스의 하이 폭이 일정폭 이하로 제한되도록 소정의 평균휘도레벨 단계 이상에서 미니멈 한계주파수를 설정하는 단계를 추가로 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  19. 제 18항에 있어서,
    상기 미너멈 한계주파수는 공급될 수 있는 서스테인 펄스의 최대 하이 폭이 상기 서스테인 펄스의 최소 하이 폭보다 0.5㎲ 내지 10㎲의 범위 내에서 넓어지도록 설정하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  20. 제 17항에 있어서,
    상기 서스테인 펄스의 하이 폭이 일정폭 이상으로 제한되도록 소정의 평균휘도레벨 단계 이하에서 맥시멈 한계주파수를 설정하는 단계를 추가로 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  21. 제 12항에 있어서,
    상기 서스테인 펄스의 하이 폭은 상기 평균휘도레벨의 낮은 단계에서 높은 단계로 갈수록 계단 형태로 증가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  22. 평균휘도레벨(Average Picture Level : APL)에 대응하여 서스테인 펄스 수를 설정하는 단계와,
    상기 평균휘도레벨에 비례하여 서스테인 펄스의 로우 폭을 설정하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  23. 제 22항에 있어서,
    상기 서스테인 펄스 수를 설정하는 단계에서는 상기 평균휘도레벨과 반비례 관계로 상기 서스테인 펄스 수를 설정하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  24. 제 22항에 있어서,
    상기 서스테인 펄스의 최대 로우 폭을 상기 서스테인 펄스의 최소 로우 폭보다 0.5㎲ 내지 10㎲의 범위 내에서 넓게 설정하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  25. 제 22항에 있어서,
    상기 평균휘도레벨에 비례하여 서스테인 펄스의 로우 폭을 설정하는 단계는
    적어도 둘 이상의 평균휘도레벨 단계가 포함될 수 있도록 상기 평균휘도레벨을 다수의 구간으로 분할하는 단계와,
    상기 평균휘도레벨 구간을 단위로 상기 서스테인 펄스의 로우 폭을 설정하는 단계를 추가로 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  26. 제 22항에 있어서,
    상기 평균휘도레벨의 적어도 일부구간에서 상기 서스테인 펄스의 로우 폭이 변화되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  27. 제 26항에 있어서,
    상기 서스테인 펄스의 로우 폭이 일정폭 이하로 제한되도록 소정의 평균휘도레벨 단계 이상에서 미니멈 한계주파수를 설정하는 단계를 추가로 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  28. 제 27항에 있어서,
    상기 미너멈 한계주파수는 공급될 수 있는 서스테인 펄스의 최대 로우 폭이 상기 서스테인 펄스의 최소 로우 폭보다 0.5㎲ 내지 10㎲의 범위 내에서 넓어지도록 설정하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  29. 제 26항에 있어서,
    상기 서스테인 펄스의 로우 폭이 일정폭 이상으로 제한되도록 소정의 평균휘도레벨 단계 이하에서 맥시멈 한계주파수를 설정하는 단계를 추가로 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  30. 제 22항에 있어서,
    상기 서스테인 펄스의 로우 폭은 상기 평균휘도레벨의 낮은 단계에서 높은 단계로 갈수록 계단 형태로 증가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  31. 비디오 데이터에 대응되는 평균휘도레벨을 설정하기 위한 평균휘도 레벨부와,
    상기 평균휘도 레벨부에서 설정된 평균휘도레벨에 비례되도록 서스테인 펄스의 주기를 설정하기 위한 주기 설정부를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  32. 제 31항에 있어서,
    상기 주기 설정부는 상기 평균휘도레벨에 비례되도록 상기 서스테인 펄스의 하이 폭을 설정하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  33. 제 31항에 있어서,
    상기 주기 설정부는 상기 평균휘도레벨에 비례되도록 상기 서스테인 펄스의 로우 폭을 설정하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  34. 제 31항에 있어서,
    상기 주기 설정부는 상기 평균휘도레벨에 비례되도록 상기 서스테인 펄스의 로우 폭 및 하이 폭을 설정하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  35. 제 31항에 있어서,
    상기 서스테인 펄스 주기가 넓어 질 수 있는 최대 한계값 및 상기 서스테인 펄스의 주기가 좁아 질 수 있는 최소 한계값 중 적어도 하나 이상을 설정하기 위한 한계값 설정부를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  36. 제 35항에 있어서,
    상기 주기 설정부는 상기 최대 한계값 및 최소 한계값 중 적어도 하나 이상을 입력받아 상기 서스테인 펄스의 주기를 제어하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  37. 비디오 데이터에 대응되는 평균휘도레벨을 설정하기 위한 평균휘도 레벨부와,
    상기 평균휘도 레벨부에서 설정된 평균휘도레벨에 비례되도록 서스테인 펄스의 하이 폭을 설정하기 위한 주기 설정부를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  38. 제 37항에 있어서,
    상기 서스테인 펄스의 하이 폭이 넓어 질 수 있는 최대 한계값 및 상기 서스테인 펄스의 하이 폭이 좁아 질 수 있는 최소 한계값 중 적어도 하나 이상을 설정하기 위한 한계값 설정부를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  39. 제 38항에 있어서,
    상기 주기 설정부는 상기 최대 한계값 및 최소 한계값 중 적어도 하나 이상을 입력받아 상기 서스테인 펄스의 하이 폭을 제어하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  40. 비디오 데이터에 대응되는 평균휘도레벨을 설정하기 위한 평균휘도 레벨부와,
    상기 평균휘도 레벨부에서 설정된 평균휘도레벨에 비례되도록 서스테인 펄스의 로우 폭을 설정하기 위한 주기 설정부를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  41. 제 40항에 있어서,
    상기 서스테인 펄스의 로우 폭이 넓어 질 수 있는 최대 한계값 및 상기 서스테인 펄스의 로우 폭이 좁아 질 수 있는 최소 한계값 중 적어도 하나 이상을 설정하기 위한 한계값 설정부를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  42. 제 41항에 있어서,
    상기 주기 설정부는 상기 최대 한계값 및 최소 한계값 중 적어도 하나 이상을 입력받아 상기 서스테인 펄스의 로우 폭을 제어하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
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