KR20030038022A - 플라즈마 디스플레이 패널과 그 구동방법 - Google Patents

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Abstract

본 발명은 서브필드 수를 줄일 수 있도록 한 플라즈마 디스프레이 패널과 그 구동방법 및 장치에 관한 것이다.
이 플라즈마 디스플레이 패널은 하나의 메인 방전셀 내에서 분할된 적어도 둘 이상의 서브 방전셀들과, 서브 방전셀들 각각에 형성되어 서브 방전셀들 각각을 선택하기 위한 비디오 데이터가 공급되는 어드레스전극과, 서브 방전셀들에 공유되어 선택된 서브 방전셀들의 방전을 유지시키기 위한 서스테인펄스가 공급되는 적어도 둘 이상의 서스테인전극을 구비한다.

Description

플라즈마 디스플레이 패널과 그 구동방법{PLASMA DISPLAY PANEL AND METHOD OF DRIVING THE SAME}
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 특히 서브필드 수를 줄일 수 있도록 한 플라즈마 디스프레이 패널과 그 구동방법에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 함)은 He+Xe 또는 Ne+Xe 불활성 혼합가스의 방전시 발생하는 147nm의 자외선에 의해 형광체를 발광시킴으로써 문자 또는 그래픽을 포함한 화상을 표시하게 된다. 이러한 PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 크게 향상된 화질을 제공한다. 특히, 3전극 교류 면방전형 PDP는 방전시 표면에 벽전하가 축적되며 방전에 의해 발생되는 스퍼터링으로부터 전극들을 보호하기 때문에 저전압 구동과 장수명의 장점을 가진다.
도 1을 참조하면, 3전극 교류 면방전형 PDP의 방전셀은 상부기판(10) 상에 형성되어진 스캔전극(Y) 및 공통서스테인전극(Z)과, 하부기판(18) 상에 형성되어진 어드레스전극(X)을 구비한다.
스캔전극(Y)과 공통서스테인전극(Z) 각각은 투명전극(12Y,12Z)과 금속버스전극(13Y,13Z)을 포함한다. 상부기판(10)에는 스캔전극(Y)과 공통서스테인전극(Z)을 덮도록 상부 유전체층(14)과 보호막(16)이 적층된다.
어드레스전극(X)은 스캔전극(Y) 및 공통서스테인전극(Z)과 직교하게 된다. 하부기판(18)에는 어드레스전극(X)을 덮도록 하부 유전체층(20)이 형성되며, 그 위에 격벽(22)이 수직으로 형성된다.
이러한 PDP는 화상의 계조(Gray Level)를 표현하기 위하여 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 구동하고 있다. 각 서브필드는 전화면을 초기화시키기 위한 셋업기간(또는 리셋 기간), 방전셀을 선택하기 위한 어드레스기간 및 방전횟수에 따라 계조를 구현하는 서스테인기간으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임 기간(16.67ms)은 도 2와 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지게 된다. 각 서브필드(SF1 내지 SF8)의 셋업기간(또는 리셋기간)과 어드레스 기간은 각 서브필드마다 동일한 반면에, 서스테인 기간과 그 때의 방전횟수는 휘도 가중치 2n(단, n=0,1,2,3,4,5,6,7)의 비율로 증가된다. 이러한 각 서스테인기간마다 2n의 비율로 증가되는 휘도 가중치가 표 1과 같이 바이너리 코딩되어 PDP는 0에서부터 255까지 256 계조를 표현하게 된다.
계조 SF1 SF2 SF3 SF4 SF5 SF6 SF7 SF8
0 0 0 0 0 0 0 0 0
1 1 0 0 0 0 0 0 0
2 0 1 0 0 0 0 0 0
3 1 1 0 0 0 0 0 0
4 0 0 1 0 0 0 0 0
5 1 0 1 0 0 0 0 0
6 0 1 1 0 0 0 0 0
7 1 1 1 0 0 0 0 0
ː ː ː ː ː ː ː ː ː
248 0 0 0 1 1 1 1 1
249 1 0 0 1 1 1 1 1
250 0 1 0 1 1 1 1 1
251 1 1 0 1 1 1 1 1
252 0 0 1 1 1 1 1 1
253 1 0 1 1 1 1 1 1
254 0 1 1 1 1 1 1 1
255 1 1 1 1 1 1 1 1
PDP의 각 셀에서 나타나는 발광은 도 3과 같이 서스테인펄스가 교번적으로 공급되는 스캔전극(Y)과 서스테인전극(Z) 사이에서 집중적으로 일어나게 된다. 계조값은 서스테인펄스의 수에 비례하여 증감된다.
PDP는 고정세/고해상도의 추세에 있으며, 또한, 셋업기간(또는 리셋기간)에서의 광방출을 줄이기 위한 램프(Ramp) 파형이 인가되는 추세에 있다. 이러한 고정세/고해상도화와 램프파형 인가는 비표시기간인 셋업기간(또는 리셋기간)과 어드레스기간을 증가시키는 반면에, 표시기간인 서스테인기간의 감소를 초래하게 된다.
고해상도에 따른 어드레스기간을 확보하기 위하여, 서스테인펄스의 수를 줄이게 되면 표시기간인 서스테인기간의 감소와 발광횟수가 작아지게 되므로 휘도가 그 만큼 저하된다. 또한, 서스테인펄스의 주파수를 늘여 서스테인기간을 줄이는 대신에, 어드레스기간을 확보하는 경우에는 서스테인펄스폭과 벽전하 형성기간의 감소로 인하여 발광효율이 떨어지게 된다.
한편, 동영상에서 의사 윤곽 노이즈(Contour noise)를 줄이기 위하여 서브필드의 수를 늘리게 되는 경우에는 서스테인기간이 확보되기가 어렵다.
셋업기간에 인가되는 램프 파형은 오방전을 방지할 수 있는 완만한 기울기로 연속되게 인가되고 있지만, 콘트라스트를 높이고 셋업기간을 줄이기 위하여 램프 파형의 개 수를 줄이는 방안이 있다. 이렇게 램프 파형의 개 수를 줄이면 램프 파형 자체의 펄스폭 때문에 셋업기간이 크게 줄어들 수 없을 뿐만 아니라 오방전이 일어날 수 있는 또 다른 문제점이 발생된다.
어드레스전극(X)을 상하로 이분할하고 어드레스전극(X)에 비디오 데이터를 공급하기 위한 데이터 구동회로를 PDP의 상부와 하부에 설치하는 듀얼스캔(Dual-scan) 구동은 어드레스기간을 1/2로 줄일 수 있다. 즉, 듀얼스캔 구동은 2 분할된 PDP의 상반부와 하반부를 동시에 순차적으로 스캔함으로써 어드레스기간을 줄이게 된다. 그러나 듀얼 스캔 구동은 패널을 분할하지 않고 전화면을 순차적으로 스캐닝하는 싱글스캔(Single-scan)에 비하여 데이터 구동부의 드라이브 집적회로(Iintegrated Circuit : 이하, "IC"라 한다)의 수가 더 필요하므로 그 만큼 제조단가(cost)가 높을 수 밖에 없다.
따라서, 본 발명의 목적은 서브필드 수를 줄일 수 있도록 한 PDP와 그 구동방법 및 장치을 제공함에 있다.
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널에 있어서 하나의 방전셀을 나타내는 사시도.
도 2는 종래의 플라즈마 디스플레이 패널의 구동방법에 있어서 8 개의 서브필드들이 포함된 종래의 한 프레임을 나타내는 도면.
도 3은 도 1에 도시된 방전셀의 발광부분을 나타내는 평면도.
도 4는 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널에 있어서 하나의 방전셀을 나타내는 사시도.
도 5는 도 4에 도시된 방전셀의 발광부분을 나타내는 평면도.
도 6은 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동장치를 개략적으로 나타내는 블럭도.
도 7은 도 6에 도시된 각 구동부의 출력파형을 나타내는 파형도.
도 8은 본 발명의 제2 실시예에 따른 플라즈마 디스플레이 패널에 있어서 하나의 방전셀을 나타내는 사시도.
도 9는 도 8에 도시된 방전셀의 발광부분을 나타내는 평면도.
도 10은 본 발명의 제3 실시예에 따른 플라즈마 디스플레이 패널에 있어서 하나의 방전셀을 나타내는 사시도.
도 11은 도 10에 도시된 방전셀의 발광부분을 나타내는 평면도.
도 12는 본 발명의 제3 실시예에 따른 플라즈마 디스플레이 패널의 구동장치를 개략적으로 나타내는 블럭도.
도 13은 도 12에 도시된 각 구동부의 출력파형을 나타내는 파형도.
도 14는 본 발명의 제4 실시예에 따른 플라즈마 디스플레이 패널에 있어서 하나의 방전셀을 나타내는 사시도.
도 15는 도 14에 도시된 방전셀의 발광부분을 나타내는 평면도.
도 16은 본 발명의 제5 실시예에 따른 플라즈마 디스플레이 패널의 발광부분을 나타내는 평면도.
도 17은 본 발명의 제5 실시예에 따른 플라즈마 디스플레이 패널의 서스테인펄스를 나타내는 파형도.
도 18은 본 발명의 제6 실시예에 따른 플라즈마 디스플레이 패널에 있어서 하나의 방전셀을 나타내는 사시도.
도 19는 도 18에 도시된 방전셀의 발광부분을 나타내는 평면도.
도 20은 본 발명의 제7 실시예에 따른 플라즈마 디스플레이 패널에 있어서 하나의 방전셀을 나타내는 사시도.
도 21은 도 20에 도시된 방전셀의 발광부분을 나타내는 평면도.
도 22는 본 발명의 제8 실시예에 따른 플라즈마 디스플레이 패널을 나타내는평면도.
도 23은 본 발명의 제9 실시예에 따른 플라즈마 디스플레이 패널에 있어서 하나의 방전셀을 나타내는 사시도.
도 24는 도 23에 도시된 방전셀의 발광부분을 나타내는 평면도.
도 25는 본 발명의 제10 실시예에 따른 플라즈마 디스플레이 패널에 있어서 하나의 방전셀을 나타내는 사시도.
도 26은 도 25에 도시된 방전셀의 발광부분을 나타내는 평면도.
도 27은 본 발명의 제11 실시예에 따른 플라즈마 디스플레이 패널을 나타내는 평면도.
< 도면의 주요 부분에 대한 부호의 설명 >
X,XA,XB : 어드레스전극 Y,YA,YB : 스캔전극
Z : 공통서스테인전극 10,90 : 상부기판
14,20,46,86,94,154 : 유전체층 16,96 : 보호막
18,48,88 : 하부기판 24,44,84,254 : 형광체
60,110 : 메인 방전셀 62 : 플라즈마 디스플레이 패널
64,114 : 데이터 구동부 66,116 : 스캔/서스테인 구동부
68,118 : 공통서스테인 구동부
12Y,12Z,92Y,92Z,202Y,202Z : 투명전극
13Y,13Z,93Y,93Z,203Y,203Z : 금속버스전극
40A,40B,80A,80B,100A,100B,110A,110B,150A,150B,200A,200B,250A,250B,230A,230B : 서브 방전셀
22,42A,42B,42C,82A,82B,112A,112B,112C,252A,252B : 격벽
상기 목적을 달성하기 위하여, 본 발명에 따른 PDP는 하나의 메인 방전셀 내에서 분할된 적어도 둘 이상의 서브 방전셀들과, 서브 방전셀들 각각에 형성되어 서브 방전셀들 각각을 선택하기 위한 비디오 데이터가 공급되는 어드레스전극과, 서브 방전셀들에 공유되어 선택된 서브 방전셀들의 방전을 유지시키기 위한 서스테인펄스가 공급되는 적어도 둘 이상의 서스테인전극을 구비한다.
본 발명에 따른 PDP는 하나의 메인 방전셀 내에서 분할된 적어도 둘 이상의 서브 방전셀들과, 서브 방전셀들에 공유되어 서브 방전셀들 각각을 선택하기 위한 비디오 데이터를 서브 방전셀들에 순차적으로 공급하기 위한 어드레스전극과, 서브 방전셀들 각각에 형성되어 선택된 서브 방전셀들의 방전을 유지시키기 위한 서스테인펄스가 공급되는 적어도 둘 이상의 서스테인전극을 구비한다.
상기 PDP는 메인 방전셀들 각각의 방전공간을 분리하기 위한 제1 격벽과, 서브 방전셀들 각각의 방전공간을 분리하기 위한 제2 격벽을 추가로 구비하는 것을 특징으로 한다.
상기 메인 방전셀은 적어도 두 개 이상의 서브 방전셀들로 분할되어, 두 개 이상의 서브 방전셀들의 선택에 따라 적어도 3 단계 이상의 밝기로 발광되는 것을 특징으로 한다.
상기 PDP는 메인 방전셀 내에 분할된 서브 방전셀의 수 N과 한 프레임 내에 설정된 서브필드의 수 K에 따라 2NK의 계조를 표현하는 것을 특징으로 한다.
본 발명에 따른 PDP의 구동방법은 하나의 메인 방전셀 내에서 적어도 둘 이상으로 분할된 서브 방전셀들 각각에 형성된 어드레스전극에 서브 방전셀들 각각을 선택하기 위한 비디오 데이터를 공급하는 단계와, 서브 방전셀들에 공유되는 적어도 둘 이상의 서스테인전극들에 선택된 서브 방전셀들의 방전을 유지시키기 위한 서스테인펄스를 공급하는 단계를 포함한다.
본 발명에 따른 PDP의 구동방법은 하나의 메인 방전셀 내에서 적어도 둘 이상으로 분할된 서브 방전셀들에 공유되는 어드레스전극에 서브 방전셀을 선택하기 위한 비디오 데이터를 순차적으로 공급하는 단계와, 서브 방전셀들 각각에 형성되는 적어도 둘 이상의 서스테인전극들에 선택된 서브 방전셀들의 방전을 유지시키기 위한 서스테인펄스를 공급하는 단계를 포함한다.
상기 메인 방전셀과 서브 방전셀 각각을 분리하기 위한 격벽들의 간격이 서브 방전셀별로 비대칭적인 것을 특징으로 한다.
상기 서스테인전극을 덮는 유전층의 두께가 상기 서브 방전셀별로 상이한 것을 특징으로 한다.
상기 서스테인펄스의 전압레벨은 상기 서브 방전셀들 각각에서 다른 것을 특징으로 한다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부한 도면들을 참조한 실시예들에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 도 4 내지 도 27을 참조하여 본 발명의 바람직한 실시예에 대하여 설명하기로 한다.
도 4를 참조하면, 본 발명의 제1 실시예에 따른 PDP에 있어서 하나의방전셀(이하, "메인 방전셀"이라 한다)은 두 개의 서브 방전셀들(40A,40B)을 포함한다. 두 개의 서브 방전셀들(40A,40B) 각각은 상부기판(10) 상에 형성되어진 스캔전극(Y) 및 공통서스테인전극(Z)를 공유하며, 하부기판(48) 상에 형성되어진 어드레스전극(XA 또는 XB)을 구비한다.
스캔전극(Y)과 공통서스테인전극(Z) 각각은 투명전극(12Y,12Z)과, 투명전극(12Y,12Z)의 선폭보다 작은 선폭을 가지며 투명전극(12Y,12Z)의 일측 가장자리에 형성되는 금속버스전극(13Y,13Z)을 포함한다. 투명전극(12Y,12Z)은 투명전도성금속 예를 들면, ITO로 상부기판(10) 상에 형성된다. 금속버스전극(13Y,13Z)은 크롬(Cr) 등의 금속으로 투명전극(12Y,12Z) 상에 형성되어 저항이 높은 투명전극(12Y,12Z)에 의한 전압강하를 줄이는 역할을 한다.
스캔전극(Y)과 공통서스테인전극(Z)이 나란하게 형성된 상부기판(10)에는 상부 유전체층(14)과 보호막(16)이 적층된다. 상부 유전체층(14)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(16)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전체층(14)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다.
어드레스전극(XA,XB)은 스캔전극(Y) 및 공통서스테인전극(Z)과 직교되며, 각 서브 방전셀(40A,40B)이 독립적으로 어드레싱되도록 각 서브 방전셀(40A,40B)에 하나씩 형성된다. 이 어드레스전극(XA,XB)이 형성된 하부기판(48) 상에는 하부 유전체층(46)과 격벽(42A,42B,42C)이 형성된다.
격벽(42A,42B,42C)은 어드레스전극(XA,XB)과 나란하며, 인접한 메인 방전셀들 간 또는 인접한 서브 방전셀(40A,40B) 간의 방전공간을 광학적, 전기적으로 분리하게 된다. 즉, 격벽(42A,42B,42C)은 인접한 메인 방전셀들 사이 또는 인접한 서브 방전셀(40A,40B) 사이에 플라즈마 방전의 확산을 차단함과 아울러 방전에 의해 생성된 자외선 및 가시광이 인접한 방전셀로 확산되는 것을 차단하게 된다. 하부 유전체층(46)과 격벽(42A,42B,42C)의 표면에는 형광체층(44)이 도포된다.
형광체층(44)은 플라즈마 방전시 발생된 자외선에 의해 여기되어 각 서브 방전셀(40A,40B)에서 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다.
상/하부기판(10,48)과 격벽(42A,42B,42C) 사이에 마련된 방전공간에는 방전을 위한 He+Xe 또는 Ne+Xe 등의 불활성 혼합가스가 주입된다.
본 발명에 따른 PDP에서 적색, 녹색 또는 청색 중 어느 한 색을 표현하는 메인 방전셀은 도 5와 같이 두 개의 서브 방전셀(40A,40B) 각각에서 발광이 일어나게 되어, 3 단계의 밝기를 표현하게 된다. 다시 말하여, 메인 방전셀은 두 개의 서브 방전셀들(40A,40B) 모두가 꺼진(Off) 경우에는 '0'의 밝기로, 두 개의 서브 방전셀들(40A,40B) 중 어느 하나가 켜지고(On) 다른 하나가 꺼진 경우에는 '1'의 밝기로 발광하게 된다. 그리고 메인 방전셀은 두 개의 서브 방전셀들(40A,40B) 모두가 켜진 경우에는 '2'의 밝기로 발광하게 된다.
도 6은 본 발명에 따른 PDP의 구동장치를 나타낸다.
도 6을 참조하면, 본 발명에 따른 PDP의 구동장치는 스캔전극(Y1 내지 Ym), 공통서스테인전극(Z) 및 어드레스전극들(XA1 내지 XAn, XB1 내지 XBn) 중 인접한두 개의 어드레스전극들(XA,XB)의 교차부에 매트릭스 형태로 m×n(단, m과 n은 m≠n의 조건인 임의의 양의 정수) 개의 메인 방전셀들(60)이 배치된 PDP(62)와, 스캔전극(Y1 내지 Ym)을 구동하기 위한 스캔/서스테인 구동부(66)와, 공통서스테인전극(Z)을 구동하기 위한 공통서스테인 구동부(68)와, 어드레스전극들(XA1 내지 XAn, XB1 내지 XBn)에 비디오 데이터를 공급하기 위한 데이터 구동부(64)를 구비한다.
PDP(62)의 각 메인 방전셀(60)은 서스테인전극(Y)과 공통서스테인전극(Z)을 공유하며 각각 인접한 제1 및 제2 어드레스전극들(XA,XB)이 독립적으로 할당되는 두 개의 서브 방전셀들(40A,40B)을 포함한다.
스캔/서스테인 구동부(66)는 어드레스기간과 서스테인기간에 스캔전극들(Y1 내지 Ym)에 스캔펄스와 서스테인펄스를 순차적으로 공급하게 된다. 또한, 스캔/서스테인 구동부(66)는 셋업기간(또는 리셋기간)에 적어도 하나 이상의 램프파형이나 리셋파형을 스캔전극들(Y1 내지 Ym)에 동시에 공급할 수 있다.
공통서스테인 구동부(68)는 서스테인기간 동안, 공통서스테인전극들(Z)에 서스테인펄스를 동시에 공급하게 된다.
데이터 구동부(64)는 스캔펄스에 동기되게끔 인접한 제1 및 제2 어드레스전극(XA,XB)에 비디오 데이터를 공급하게 된다. 제1 및 제2 어드레스전극(XA,XB) 각각에 공급되는 비디오 데이터 XA XB는 그 논리값에 따라 메인 방전셀(60)의 밝기를 3 단계로 분리하게 된다. 즉, 비디오 데이터 XA XB의 논리값이 '00'인 경우에는 하나의 메인 방전셀(60)에 포함된 두 개의 서브 방전셀들(40A,40B)이 모두 오프되어 해당 메인 방전셀(60)은 '0'의 밝기로 적색, 녹색 또는 청색을 표시하게 된다. 비디오 데이터 XA XB의 논리값이 '01' 또는 '10'인 경우에는 두 개의 서브 방전셀들(40A,40B) 중 어느 하나가 켜지고 다른 하나가 오프되어 해당 메인 방전셀(60)은 '1'의 밝기로 적색, 녹색 또는 청색을 표시하게 된다. 그리고 비디오 데이터 XA XB의 논리값이 '11'인 경우에는 두 개의 서브 방전셀들(40A,40B) 모두가 켜지게 되어 해당 메인 방전셀(60)은 '2'의 밝기로 적색, 녹색 또는 청색을 표시하게 된다.
도 7은 본 발명의 실시예에 따른 PDP의 구동방법을 설명하기 위한 한 서브필드의 구동파형이다.
도 7을 참조하면, 본 발명에 따른 PDP의 구동방법은 제1 및 제2 어드레스전극(XA,XB)에 데이터펄스(AD,BD)를 공급하여 메인 방전셀(60) 내의 서브 방전셀들(40A,40B)을 선택하고, 선택된 메인 방전셀(60)에 대하여 서스테인 방전을 일으킴으로써 메인 방전셀(60)의 밝기를 3 단계로 표시하게 된다.
먼저, 셋업기간(또는 리셋기간)의 초기에 공통서스테인전극(Z)이나 스캔전극(Y1 내지 Ym)에 도시하지 않은 리셋펄스나 램프파형을 인가하여 전화면을 초기화시키게 된다.
어드레스기간에는 두 개의 서브 방전셀들(40A,40B)을 선택하기 위한 정극성의 제1 및 제2 데이터펄스(AD,BD)가 각각 제1 및 제2 어드레스전극들(XA,XB)에 동시에 공급된다. 이와 동기되어, 스캔전극들(Y1 내지 Ym)에는 부극성의 스캔펄스(-SC)가 공급된다. 어드레스 방전이 일어난 서브 방전셀들(40A,40B)의 스캔전극들(Y1 내지 Ym) 상에는 정극성의 벽전하가 축적되는 반면,어드레스전극들(XA,XB) 상에는 부극성의 벽전하가 축적된다. 이 때 선택된 서브 방전셀들(40A,40B)의 벽전압레벨은 이 후에 서스테인 펄스가 공급되면 서스테인 방전이 일어날 수 있는 서스테인전압레벨로 상승된다.
서스테인기간에는 스캔전극들(Y1 내지 Ym)과 공통서스테인전극들(Z)에 교번적으로 정극성의 서스테인펄스(SUS)가 공급된다. 서스테인펄스(SUS)의 수는 휘도 가중치에 따라 서브필드들마다 다르게 설정된다.
본 발명에 따른 PDP의 구동장치는 화상의 계조(Gray Level)를 표현함에 있어서, 하나의 방전셀이 3 단계의 밝기로 적색, 녹색 또는 청색을 표시하므로 아래의 표 2와 같이 한 프레임 기간(16.67ms)을 5 개의 서브필드만으로 나누어 구동하여도 243(또는 35) 계조를 표현할 수 있다. 각 서브필드(SF1 내지 SF5)의 셋업기간(또는 리셋기간)과 어드레스 기간은 각 서브필드마다 동일한 반면에, 서스테인 기간과 그 때의 방전횟수는 휘도 가중치 3k(단, k=0,1,2,3,4)의 비율로 증가된다.
계조 SF1 SF2 SF3 SF4 SF5
0 0 0 0 0 0
1 1 0 0 0 0
2 2 0 0 0 0
3 0 1 0 0 0
4 1 1 0 0 0
5 2 1 0 0 0
6 0 2 0 0 0
7 1 2 0 0 0
8 2 2 0 0 0
ː ː ː ː ː ː
234 0 0 2 2 2
235 1 0 2 2 2
236 2 0 2 2 2
237 0 1 2 2 2
238 1 1 2 2 2
239 2 1 2 2 2
240 0 2 2 2 2
241 1 2 2 2 2
242 2 2 2 2 2
도 4에 도시된 PDP에 있어서, 도 8 및 도 9와 같이 서브 방전셀들(80A,80B)을 공간적으로 분리하기 위한 중간 격벽은 생략될 수 있다. 이 경우, 서브 방전셀들(80A,80B) 사이에 광학적, 적기적 크로스토크가 일어날 수 있지만 데이터펄스와 스캔펄스의 전압레벨이나 펄스폭 등을 적절히 선택하여 서브 방전셀들(40A,40B)의 방전을 독립적으로 제어할 수 있다면 표 2와 같이 5 개의 서브필드만으로 243 계조가 표현될 수 있다.
도 10 및 도 11은 본 발명의 제3 실시예에 따른 PDP를 나타낸다.
도 10 및 도 11을 참조하면, 본 발명의 제3 실시예에 따른 PDP의 메인 방전셀은 어드레스전극(X)을 공유하며 스캔전극(YA,YB)과 공통서스테인전극(Z)이 분리된 두 개의 서브 방전셀들(40A,40B)을 포함한다.
어드레스전극(X)은 스캔전극(YA,YB) 및 공통서스테인전극(Z)과 직교된다. 이 어드레스전극(X)에는 각 서브 방전셀(100A,100B)이 독립적으로 어드레싱되도록각 서브 방전셀(100A,100B)에 순차적으로 공급되는 스캐닝펄스에 동기되는 비디오 데이터가 순차적으로 공급된다. 어드레스전극(X)이 형성된 하부기판(18) 상에는 하부 유전체층(20)과 격벽(22)이 형성된다.
격벽(22)은 어드레스전극(X)과 나란하며, 인접한 메인 방전셀들 간의 방전공간을 광학적, 전기적으로 분리하게 된다. 하부 유전체층(20)과 격벽(22)의 표면에는 형광체층(24)이 도포된다.
형광체층(24)은 플라즈마 방전시 발생된 자외선에 의해 여기되어 각 서브 방전셀(100A,100B)에서 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다.
스캔전극(YA,YB)과 공통서스테인전극(Z) 각각은 투명전극(92Y,92Z)과, 투명전극(92Y,92Z)의 선폭보다 작은 선폭을 가지며 투명전극(92Y,92Z)의 일측 가장자리에 형성되는 금속버스전극(93Y,93Z)을 포함한다. 투명전극(92Y,92Z)은 투명전도성금속 예를 들면, ITO로 상부기판(90) 상에 형성된다. 금속버스전극(93Y,93Z)은 크롬(Cr) 등의 금속으로 투명전극(92Y,92Z) 상에 형성되어 저항이 높은 투명전극(92Y,92Z)에 의한 전압강하를 줄이는 역할을 한다. 이 스캔전극(YA,YB)과 공통서스테인전극(Z)은 각각 하나의 스캔전극(YA 또는 YB)과 하나의 공통서스테인전극(Z)이 한 쌍을 이루어 하나의 서브 방전셀(100A 또는 100B)에 할당된다.
스캔전극(YA,YB)과 공통서스테인전극(Z)이 나란하게 형성된 상부기판(90)에는 상부 유전체층(94)과 보호막(96)이 적층된다. 상부 유전체층(94)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(96)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전체층(94)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다.
상/하부기판(90,18)과 격벽(22) 사이에 마련된 방전공간에는 방전을 위한 He+Xe 또는 Ne+Xe 등의 불활성 혼합가스가 주입된다.
본 발명에 따른 PDP에서 적색, 녹색 또는 청색 중 어느 한 색을 표현하는 메인 방전셀은 도 11과 같이 두 개의 서브 방전셀(100A,100B) 각각에서 발광이 일어나게 되어, 3 단계의 밝기를 표현하게 된다. 다시 말하여, 메인 방전셀은 두 개의 서브 방전셀들(100A,100B) 모두가 꺼진(Off) 경우에는 '0'의 밝기로, 두 개의 서브 방전셀들(40A,40B) 중 어느 하나가 켜지고(On) 다른 하나가 꺼진 경우에는 '1'의 밝기로 발광하게 된다. 그리고 메인 방전셀은 두 개의 서브 방전셀들(40A,40B) 모두가 켜진 경우에는 '2'의 밝기로 발광하게 된다.
도 12는 도 10에 도시된 PDP의 구동장치를 나타낸다.
도 12를 참조하면, 본 발명의 제3 실시예에 따른 PDP의 구동장치는 인접한 스캔전극(YA,YB), 공통서스테인전극(Z) 및 어드레스전극(X1 내지 Xn)의 교차부에 매트릭스 형태로 m×n 개의 메인 방전셀들(110)이 배치된 PDP(1112)와, 스캔전극(YA1 내지 YAm, YB1 내지 YBm)을 구동하기 위한 스캔/서스테인 구동부(116)와, 공통서스테인전극(Z)을 구동하기 위한 공통서스테인 구동부(118)와, 어드레스전극(X1 내지 Xn)에 비디오 데이터를 공급하기 위한 데이터 구동부(114)를 구비한다.
PDP(112)의 각 메인 방전셀(110)은 하나의 어드레스전극(X)을 공유하며 인접한 서스테인전극(YA 또는 YB)와 공통서스테인전극(Z)이 독립적으로 할당되는 두 개의 서브 방전셀들(100A,100B)을 포함한다.
스캔/서스테인 구동부(116)는 어드레스기간과 서스테인기간에 스캔전극들(YA1 내지 YAm, YB1 내지 YBm)에 스캔펄스와 서스테인펄스를 순차적으로 공급하게 된다. 또한, 스캔/서스테인 구동부(116)는 셋업기간(또는 리셋기간)에 적어도 하나 이상의 램프파형이나 리셋파형을 스캔전극들(YA1 내지 YAm, YB1 내지 YBm)에 동시에 공급할 수 있다.
공통서스테인 구동부(118)는 서스테인기간 동안, 공통서스테인전극들(Z)에 서스테인펄스를 동시에 공급하게 된다.
데이터 구동부(114)는 메인 방전셀(110)에 포함된 두 서브 방전셀들(100A,100B)에 순차적으로 공급되는 스캔펄스에 동기되게끔 한 주사라인당 2 비트의 비디오 데이터를 어드레스전극(X1 내지 Xn)에 연속으로 공급하게 된다. 여기서, 비디오 데이터 b1 b2가 '00'인 경우에는 하나의 메인 방전셀(110)에 포함된 두 개의 서브 방전셀들(100A,100B)이 모두 오프되어 해당 메인 방전셀(110)은 '0'의 밝기로 적색, 녹색 또는 청색을 표시하게 된다. 비디오 데이터 b1 b2가 '01' 또는 '10'인 경우에는 두 개의 서브 방전셀들(100A,100B) 중 어느 하나가 켜지고 다른 하나가 오프되어 해당 메인 방전셀(110)은 '1'의 밝기로 적색, 녹색 또는 청색을 표시하게 된다. 그리고 비디오 데이터 b1 b2의 논리값이 '11'인 경우에는 두 개의 서브 방전셀들(100A,100B) 모두가 켜지게 되어 해당 메인 방전셀(110)은 '2'의 밝기로 적색, 녹색 또는 청색을 표시하게 된다.
도 13은 도 12에 도시된 각 전극 구동부에 의해 출력되는 구동파형이다.
도 13에 있어서, 셋업기간(또는 리셋기간)의 구동파형은 생략된다.
도 13을 참조하면, 본 발명의 제3 실시예에 따른 PDP의 구동방법은 인접한 제1 및 제2 스캔전극(YA,YB)에 순차적으로 공급되는 스캔펄스(SC)와, 이 스캔펄스(SC) 각각에 동기되는 비디오 데이터(D)에 따라 메인 방전셀(110) 내의 서브 방전셀들(100A,100B)을 선택하게 된다.
어드레스기간에는 두 개의 서브 방전셀들(100A,100B)을 선택하기 위한 부극성의 스캔펄스(-SC)가 인접한 제1 및 제2 스캔전극(YA,YB)에 순차적으로 공급된다. 이와 동기되어, 어드레스전극들(X1 내지 Xn)에는 정극성의 비디오 데이터 펄스(D)가 공급된다. 어드레스 방전이 일어난 서브 방전셀들(100A,100B)의 스캔전극들(YA1 내지 YAm, YB1 내지 YBm) 상에는 정극성의 벽전하가 축적되는 반면, 어드레스전극들(X1 내지 Xn) 상에는 부극성의 벽전하가 축적된다. 이 때, 선택된 서브 방전셀들(100A,100B)의 벽전압레벨은 이 후에 서스테인 펄스가 공급되면 서스테인 방전이 일어날 수 있는 서스테인전압레벨로 상승된다.
서스테인기간에는 스캔전극들(YA1 내지 YAm, YB1 내지 YBm)과 공통서스테인전극들(Z)에 교번적으로 정극성의 서스테인펄스(SUS)가 공급된다. 서스테인펄스(SUS)의 수는 휘도 가중치에 따라 서브필드들마다 다르게 설정된다.
243 계조를 표현하는 경우에, 하나의 방전셀이 3 단계의 밝기로 적색, 녹색 또는 청색을 표시하므로 표 2와 같이 한 프레임 기간(16.67ms)이 5 개의 서브필드로 나누어 구동된다.
본 발명에 따른 실시예들과 같이 하나의 메인 방전셀을 2 개로 분할하여 한 메인 방전셀의 밝기를 3 단계로 조정하여 서브필드의 수를 줄일 수 있을 뿐만 아니라, 2NK(N은 메인 방전셀 내에 분할된 서브 방전셀의 수, K는 서브필드의 수)의 계조를 표현하기 위하여 메인 방전셀의 방전공간을 2 가 아닌 N 개의 수로 분할할 수도 있음은 물론이다.
도 14 및 도 15는 본 발명의 제4 실시예에 따른 PDP를 나타낸다.
도 14 및 도 15를 참조하면, 본 발명의 제4 실시예에 따른 PDP는 간격이 서로 다른 비대칭 격벽(112A,112B,112C)를 구비한다. 이 PDP는 격벽(112A,112B,112C)이 다를뿐 그 이외의 상판구조와 하판구조는 도 4 및 도 5에 도시된 그것과 실질적으로 동일하다.
이 PDP의 메인 방전셀은 비대칭 격벽(112A,112B,112C)에 의해 그 크기가 서로 다르게 분할된 두 개의 서브 방전셀들(110A,110B)을 포함한다. 두 개의 서브 방전셀들(110A,110B) 각각은 상부기판(10) 상에 형성되어진 스캔전극(Y) 및 공통서스테인전극(Z)를 공유한다. 그리고 두 개의 서브 방전셀들(110A,110B)은 데이터가 독립적으로 인가될 수 있도록 어드레스전극(X)이 각각 형성된다. 이 서브 방전셀들(110A,110B)은 비대칭 격벽(112A,112B,112C)에 의해 방전공간과 형광체 도포면적이 서로 다르게 된다.
메인 방전셀은 방전공간의 크기가 서로 다른 서브 방전셀(112A,112B)의 온/오프 조합으로 4 단계 이상의 밝기를 표현하게 된다. 즉, 메인 방전셀은 두 개의서브 방전셀들(110A,110B) 모두가 꺼진(Off) 경우에는 '0'의 밝기로, 두 개의 서브 방전셀들(110A,110B) 중에 작은 방전셀(110A)만이 켜진 경우에는 '1'의 밝기로, 큰 방전셀(110B)만이 켜진 경우에는 '2'의 밝기로 발광하게 된다. 그리고 두 개의 서브 방전셀들(110A,110B) 모두가 켜진 경우에는 '3'의 밝기로 발광하게 된다.
도 14 및 도 15에 도시된 PDP는 화상의 계조(Gray Level)를 표현함에 있어서, 하나의 방전셀이 4 단계의 밝기로 적색, 녹색 또는 청색을 표시하므로 아래의 표 3과 같이 한 프레임 기간(16.67ms)을 4 개의 서브필드만으로 나누어 구동하여도 256 계조를 표현할 수 있다. 각 서브필드(SF1 내지 SF5)의 셋업기간(또는 리셋기간)과 어드레스 기간은 각 서브필드마다 동일한 반면에, 서스테인 기간과 그 때의 방전횟수는 휘도 가중치 4k(단, k=0,1,2,3)의 비율로 증가된다.
계조 SF1 SF2 SF3 SF4
0 0 0 0 0
1 1 0 0 0
2 2 0 0 0
3 3 0 0 0
4 0 1 0 0
ː ː ː ː ː
255 3 3 3 3
방전셀의 어드레싱은 다수의 비트 조합에 의해 어드레스하는 것이 아니라 방전공간이 서로 다른 크기로 비대칭 격벽(112A,112B,112C)에 의해 물리적으로 분할되기 때문에 종래의 어드레스 방법과 실질적으로 동일한 방법으로 어드레싱된다. 예를 들어, 서브 방전셀들(110A,110B) 각각을 켜기 위해서는 하이논리의 데이터가 해당 어드레스 전극에 인가되며, 셀을 끄기 위해서는 로우논리의 데이터가 해당 어드레스 전극에 인가된다. 따라서, 본 발명의 제4 실시예에 따른 PDP는 어드레스기간의 증가없이 서브필드 수를 절반 이하로 줄일 수 있게 된다.
도 16 및 도 17는 본 발명의 제5 실시예에 따른 PDP의 발광크기와 그 구동펄스를 나타낸다.
도 16 및 도 17를 참조하면, 본 발명의 제5 실시예에 따른 PDP는 동일한 방전공간을 가지는 서브방전셀들 각각에 인가되는 서스테인펄스의 전압을 달리하여 메인 방전셀을 4 단계 이상의 밝기로 발광하게 한다.
두 개의 서브 방전셀들에 인가되는 서스테인펄스는 종래의 서스테인펄스의 전압레벨을 Vs라 할 때, 도 14와 같이 Vs 보다 작은 Vs(-) 전위(또는 Vs)와 Vs 보다 큰 Vs(+) 전위의 두 개의 전압레벨을 가지게 된다. Vs(-) 전위의 서스테인펄스가 인가되는 서브 방전셀(130A 또는 130B)은 '1'의 밝기로 발광된다. 이에 비하여, Vs(+) 전위의 서스테인펄스가 인가되는 서브 방전셀(130A 또는 130B)은 Vs(-) 전위에 비하여 방전이 크게 일어나므로 그 만큰 자외선 양이 많아지게 되어 '2'의 밝기로 발광된다. 이렇게 서브 방전셀(130A,130B) 간의 밝기 차이를 이용하여 한 서브필드에서 4 단계 이상으로 계조를 표혈할 수 있게 되므로 서브필드의 수가 줄어들게 된다. 즉, 본 발명의 제5 실시예에 따른 PDP는 동일한 발광면적을 가지는 서브 방전셀들 각각의 발광크기 또는 방전세기를 조절하여 하나의 셀을 4 단계 이상의 밝기로 발광하게 한다.
이 PDP의 구동방법 및 회로는 종래의 PDP 구동회로와 대비할 때 스캔/서스테인 구동부와 공통서스테인 구동부의 서스테인 전압원만 다르게 된다.
도 18 및 도 19는 본 발의 제6 실시예에 따른 PDP를 나타낸다.
도 18 및 도 19를 참조하면, 본 발명의 제6 실시예에 따른 PDP는 상부기판 상에 서브 방전셀(150A,150B)별로 두께가 서로 다르게 설정된 유전층(154)을 구비한다. 이 PDP는 유전층(154)이 다를뿐 그 이외의 상판구조와 하판구조는 도 10에 도시된 그것과 실질적으로 동일하다.
두 서브 방전셀들(150A,150B) 중에, 제1 서브 방전셀(150A)의 유전층 두께(d1)은 제2 서브 방전셀(150B)의 그것(d2)에 비하여 두껍게 된다. 이러한 두께 차이에 의해, 유전층(154)에 의한 캐패시턴스가 제2 서브 방전셀(150B)보다 제1 서브 방전셀(150A)에서 더 작게 된다. 동일한 전압레벨의 방전전압이 두 서브 방전셀들(150A,150B) 각각에 인가될 때, 제1 서브 방전셀(150A)은 제2 서브 방전셀(150B)에 비하여 방전이 작게 일어나게 되어 자외선 양도 그 만큼 작아지게 된다. 따라서, 제1 서브 방전셀(150A)은 '1'의 밝기로 발광하게 되며, 제2 서브 방전셀(150B)은 '2'의 밝기로 발광하게 된다. 이 서브 방전셀(150A,150B) 간의 밝기 차이를 이용하여 한 서브필드에서 4 단계 이상으로 계조를 표혈할 수 있게 되므로 서브필드의 수가 줄어들게 된다.
도 20 및 도 21은 본 발명의 제7 실시예에 따른 PDP를 나타낸다.
도 20 및 도 21을 참조하면, 본 발명의 제7 실시예에 따른 PDP의 메인 방전셀은 어드레스전극(X)을 공유하며 스캔전극(YA,YB)과 공통서스테인전극(Z) 간의 간격이 다른 두 개의 서브 방전셀들(200A,200B)을 포함한다. 이 PDP는 스캔전극(YA,YB)과 공통서스테인전극(Z) 간의 간격이 다를뿐 그 이외의 상판구조와하판구조는 도 10에 도시된 그것과 실질적으로 동일하다.
두 서브 방전셀들(200A,200B) 중에, 제1 서브 방전셀(200A)의 서스테인전극간 간격(D1)은 제2 서브 방전셀(200B)의 그것(D2)에 비하여 크게 된다. 이러한 서스테인전극간 간격의 차이에 의해, 서스테인방전시 방전패스가 제2 서브 방전셀(200B)보다 제1 서브 방전셀(200A)에서 더 길게 된다. 그 결과, 동일한 전압레벨의 방전전압이 두 서브 방전셀들(200A,200B) 각각에 인가될 때, 제1 서브 방전셀(200A)은 방전경로가 상대적으로 길기 때문에 제2 서브 방전셀(200B)에 비하여 자외선 양도 그 만큼 많게 된다. 따라서, 제1 서브 방전셀(200A)은 '2'의 밝기로 발광하게 되며, 제2 서브 방전셀(200B)은 '1'의 밝기로 발광하게 된다.
한편, 도 22와 같이 서스테인전극간 간격은 동일하게 하고 서스테인전극쌍(Y,Z) 각각의 폭이 다르게 하는 경우에도, 본 발명의 제7 실시예와 같이 서스테인전극의 전극폭이 큰 서브 방전셀이 서스테인전극의 전극폭이 작은 서브 방전셀에 비하여 방전경로가 길기 때문에 서브 방전셀 간의 휘도차가 발생된다.
본 발명의 제6 실시예와 제7 실시예의 특징들을 조합하여 도 23 및 도 24와 같이 서스테인전극간 간격(또는 서스테인전극의 폭)이 다르고 유전층(154)의 두께(d3,d4)가 다르게 될 수도 있다. 이 경우, 하나의 메인 방전셀은 4 단계 이상의 밝기로 계조를 표현하게 되므로 서브필드 수를 줄이게 된다.
도 25 및 도 26은 본 발명의 제10 실시예에 따른 PDP를 나타낸다.
도 25 및 도 26을 참조하면, 본 발명의 제10 실시예에 따른 PDP는 세로 격벽(252A)과 가로 격벽(252B)을 포함한 격자형 격벽을 구비한다. 이 격자형 격벽의 가로 격벽(252B)은 서브 방전셀들(250A,250B) 각각의 방전공간 크기가 다르도록 그 간격이 비대칭적이다. 즉, 제1 서브 방전셀(250A)의 가로 격벽(252A)의 간격(RW1)은 제2 서브 방전셀(250B)의 그것(RW2)보다 크다.
제1 서브 방전셀(150A)은 상대적으로 큰 가로 격벽간 간격(RW1)에 의해 제2 서브 방전셀(150B)에 비하여, 방전공간이 크고 형광체(254) 도포면적이 넓다. 따라서, 동일한 전압레벨의 방전전압이 두 서브 방전셀들(250A,250B) 각각에 인가될 때, 제1 서브 방전셀(250A)은 '2'의 밝기로 발광하게 되며, 제2 서브 방전셀(250B)은 '1'의 밝기로 발광하게 된다. 이 서브 방전셀(250A,250B) 간의 밝기 차이를 이용하여 한 서브필드에서 4 단계 이상으로 계조를 표혈할 수 있게 되므로 서브필드의 수가 줄게 된다.
전술한 실시예들을 조합하여, 본 발명에 따른 PDP는 도 27과 같이 하나의 메인 방전셀을 휘도비가 1 : 2 : 4 : 8로 휘도차이가 나는 네 개의 서브 방전셀들로 분할할 수 있다. 이 경우, 하나의 메인 방전셀이 한 서브필드에서 0∼15 까지의 24개의 계조레벨들이 표현되므로 본 발명에 따른 PDP는 아래의 표 3과 같이 두 개의 서브필드(SF1,SF2) 만으로 256 계조로 영상을 표시할 수 있게 된다.
계조 SF1 SF2
0 0 0
1 1 0
2 2 0
3 3 0
4 4 0
5 5 0
6 6 0
7 7 0
8 8 0
ː ː ː
16 0 1
17 1 1
18 2 1
ː ː ː
251 11 15
252 12 15
253 13 15
254 14 15
255 15 15
상술한 바와 같이, 본 발명에 따른 PDP와 그 구동방법은 2NK(N은 메인 방전셀 내에 분할된 서브 방전셀의 수, K는 서브필드의 수)의 계조를 표현하기 위하여 메인 방전셀의 방전공간을 N 개로 분할함으로써 서브필드의 수를 K 개로 줄이게 된다. 그 결과, 본 발명에 따른 PDP와 그 구동방법 및 장치는 고정세/고해상도의 PDP에서도 충분한 어드레스기간과 서스테인기간을 확보할 수 있음은 물론, 안정된 셋업동작이 이루어지도록 다수의 램프파형을 인가하는 경우에도 한 프레임 내에서 구동시간을 만족시킬 수 있게 된다.
본 발명에 따른 PDP와 그 구동방법은 듀얼 스캔할 필요없이 싱글 스캔만으로도 고정세/고해상도 PDP의 어드레스기간을 확보할 수 있으므로 구동회로의 증가로 인한 코스트 증가를 방지할 수 있다. 또한, 본 발명에 따른 PDP와 그 구동방법은고정세/고해상도 PDP의 어드레스기간을 확보할 수 있으므로 전극라인을 분할하여 두 배의 IC가 필요한 듀얼스캔할 필요없이 싱글스캔으로도 안정되게 PDP를 구동할 수 있을 뿐만 아니라, 서스테인기간에 대한 시간이 충분히 확보되므로 인하여 휘도를 높이고 세밀한 계조표현이 가능하게 된다. 나아가, 본 발명에 따른 PDP와 그 구동방법은 계조표현에 필요한 서브필드 이외에 여유시간이 마련될 수 있으므로 그 여유시간에 의사 윤곽 노이즈(Contour noise)를 줄이기 위한 별도의 서브필드를 추가하여 동영상에서 의사 윤곽 노이즈를 줄일 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 예를 들어, 전압레벨이 다른 서스테인펄스나 상이한 유전층 두께는 본 발명의 제1 내지 제9 실시예에도 동일하게 적용되어 동일한 또는 상이한 서브 방전셀 구조 모두에서 서브 방전셀 각각에서 밝기를 4 단계 이상으로 분리할 수도 있다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여 져야만 할 것이다.

Claims (19)

  1. 하나의 메인 방전셀 내에서 분할된 적어도 둘 이상의 서브 방전셀들과,
    상기 서브 방전셀들 각각에 형성되어 상기 서브 방전셀들 각각을 선택하기 위한 비디오 데이터가 공급되는 어드레스전극과,
    상기 서브 방전셀들에 공유되어 상기 선택된 서브 방전셀들의 방전을 유지시키기 위한 서스테인펄스가 공급되는 적어도 둘 이상의 서스테인전극을 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  2. 제 1 항에 있어서,
    상기 메인 방전셀들 각각의 방전공간을 분리하기 위한 제1 격벽과,
    상기 서브 방전셀들 각각의 방전공간을 분리하기 위한 제2 격벽을 추가로 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  3. 제 1 항에 있어서,
    상기 메인 방전셀은 적어도 두 개 이상의 서브 방전셀들로 분할되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  4. 제 3 항에 있어서,
    상기 메인 방전셀은 상기 적어도 두 개 이상의 서브 방전셀들의 선택에 따라적어도 3 단계 이상의 밝기로 발광되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  5. 제 2 항 또는 제 3 항에 있어서,
    상기 제2 격벽은 양측에 각각 인접한 상기 제1 격벽과의 간격이 비대칭적인 것을 특징으로 하는 플라즈마 디스플레이 패널.
  6. 제 1 항에 있어서,
    상기 서스테인전극을 덮는 유전층을 구비하고,
    상기 유전층은 상기 서브 방전셀 각각에서 그 두께가 다른 것을 특징으로 하는 플라즈마 디스플레이 패널.
  7. 하나의 메인 방전셀 내에서 분할된 적어도 둘 이상의 서브 방전셀들과,
    상기 서브 방전셀들에 공유되어 상기 서브 방전셀들 각각을 선택하기 위한 비디오 데이터를 상기 서브 방전셀들에 순차적으로 공급하기 위한 어드레스전극과,
    상기 서브 방전셀들 각각에 형성되어 상기 선택된 서브 방전셀들의 방전을 유지시키기 위한 서스테인펄스가 공급되는 적어도 둘 이상의 서스테인전극을 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  8. 제 7 항에 있어서,
    상기 메인 방전셀들 각각의 방전공간을 분리하기 위한 제1 격벽과,
    상기 서브 방전셀들 각각의 방전공간을 분리하기 위한 제2 격벽을 추가로 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  9. 제 7 항에 있어서,
    상기 메인 방전셀은 적어도 두 개 이상의 서브 방전셀들로 분할되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  10. 제 8 항 또는 제 9 항에 있어서,
    상기 제2 격벽은 양측에 각각 인접한 상기 제1 격벽과의 간격이 비대칭적인 것을 특징으로 하는 플라즈마 디스플레이 패널.
  11. 제 7 항에 있어서,
    상기 서스테인전극을 덮는 유전층을 구비하고,
    상기 유전층은 상기 서브 방전셀 각각에서 그 두께가 다른 것을 특징으로 하는 플라즈마 디스플레이 패널.
  12. 제 7 항에 있어서,
    상기 서브 방전셀들 각각에 대하여 서스테인 방전을 일으키기 위한 서스테인펄스의 전압레벨은 상기 서브 방전셀들 각각에서 다른 것을 특징으로 하는 플라즈마 디스플레이 패널.
  13. 하나의 메인 방전셀 내에서 적어도 둘 이상으로 분할된 서브 방전셀들 각각에 형성된 어드레스전극에 상기 서브 방전셀들 각각을 선택하기 위한 비디오 데이터를 공급하는 단계와,
    상기 서브 방전셀들에 공유되는 적어도 둘 이상의 서스테인전극들에 상기 선택된 서브 방전셀들의 방전을 유지시키기 위한 서스테인펄스를 공급하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  14. 하나의 메인 방전셀 내에서 적어도 둘 이상으로 분할된 서브 방전셀들에 공유되는 어드레스전극에 상기 서브 방전셀을 선택하기 위한 비디오 데이터를 순차적으로 공급하는 단계와,
    상기 서브 방전셀들 각각에 형성되는 적어도 둘 이상의 서스테인전극들에 상기 선택된 서브 방전셀들의 방전을 유지시키기 위한 서스테인펄스를 공급하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  15. 제 13 항 또는 제 14 항에 있어서,
    상기 메인 방전셀은 적어도 두 개 이상의 서브 방전셀들로 분할되어, 상기 적어도 두 개 이상의 서브 방전셀들의 선택에 따라 적어도 3 단계 이상의 밝기로 발광되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  16. 제 13 항 또는 제 14 항에 있어서,
    상기 메인 방전셀과 서브 방전셀 각각을 분리하기 위한 격벽들의 간격이 서브 방전셀별로 비대칭적인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  17. 제 13 항 또는 제 14 항에 있어서,
    상기 서스테인전극을 덮는 유전층의 두께가 상기 서브 방전셀별로 상이한 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  18. 제 14 항에 있어서,
    상기 서스테인펄스의 전압레벨은 상기 서브 방전셀들 각각에서 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  19. 제 13 항 또는 제 14 항에 있어서,
    상기 플라즈마 디스플레이 패널은 상기 메인 방전셀 내에 분할된 서브 방전셀의 수 N과 한 프레임 내에 설정된 서브필드의 수 K에 따라 2NK의 계조를 표현하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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