KR20020077724A - 플라즈마 디스플레이의 구동방법 - Google Patents

플라즈마 디스플레이의 구동방법 Download PDF

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Abstract

본 발명은 플라즈마 디스플레이 패널의 구동방법에서 소거동작을 확실히 하기 위한 소거펄스를 서스테인전극과 스캔전극에 인가한 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
본 발명의 플라즈마 디스플레이 패널의 구동방법은 유지방전을 개시시키기 위한 트리거 전극쌍, 상기 유지방전의 개시방전을 이용하여 유지방전을 일으키는 유지전극쌍을 구비하는 플라즈마 디스플레이 패널의 구동방법에 있어서, 트리거 전극쌍 및 유지전극쌍에 소거펄스를 적어도 2 회이상 연속하여 공급함으로써 유지방전을 소거시키는 단계를 포함한다.
이로써 본 발명에서는 전 필드 데이터의 소거를 위한 소거 펄스의 변화를 통하여 전 필드데이터의 확실한 소거를 가능케 할 수 있게 된다.

Description

플라즈마 디스플레이의 구동방법{Method of driving Plasma Display Panel}
본 발명은 플라즈마 디스플레이의 구동방법에 관한 것으로, 특히 플라즈마 디스플레이의 구동방법에서 소거동작을 확실하게 하기 위한 소거파형을 제공하기 위한 플라즈마 디스플레이의 구동방법에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"이라 함)은 He+Xe 또는 Ne+Xe 불활성 혼합가스의 방전시 발생하는 147nm의 자외선에 의해 형광체를 발광시킴으로써 문자 또는 그래픽을 포함한 화상을 표시하게 된다. 이러한 PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 크게 향상된 화질을 제공한다. 특히, 3전극 교류 면방전형 PDP는 방전시 표면에 벽전하가 축적되며 방전에 의해 발생되는 스퍼터링으로부터 전극들을 보호하기 때문에 저전압 구동과 장수명의 장점을 가진다.
도 1을 참조하면, 3전극 교류 면방전형 PDP의 방전셀은 상부기판(10) 상에 형성되어진 주사/유지전극(12Y) 및 공통유지전극(12Z)과, 하부기판(18) 상에 형성되어진 어드레스전극(20X)을 구비한다. 주사/유지전극(12Y)과 공통유지전극(12Z)이 나란하게 형성된 상부기판(10)에는 상부 유전층(14)과 보호막(16)이 적층된다. 상부 유전층(14)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(16)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전층(14)의 손상을방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호막(16)으로는 통상 산화마그네슘(MgO)이 이용된다. 어드레스전극(20X)이 형성된 하부기판(18) 상에는 하부 유전층 (22), 격벽(24)이 형성되며, 하부 유전층(22)과 격벽(24) 표면에는 형광체(26)가 도포된다. 어드레스전극(20X)은 주사/유지전극(12Y) 및 공통유지전극(12Z)과 교차되는 방향으로 형성된다. 격벽(24)은 어드레스전극(20X)과 나란하게 형성되어 방전에 의해 생성된 자외선 및 가시광이 인접한 방전셀에 누설되는 것을 방지한다. 형광체(26)는 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 상/하판과 격벽 사이에 마련된 방전공간에는 가스방전을 위한 불활성 가스가 주입된다.
이러한 방전셀은 도 2에 도시된 바와 같이 매트릭스로 형태로 배치된다. 도 2에서 방전셀(1)은 주사/유지 전극라인(Y1 내지 Ym), 공통 유지 전극라인(Z) 및 어드레스 전극라인(X1 내지 Xn)의 교차부에 마련된다. 주사/유지전극라인(Y1 내지 Ym)은 순차적으로 구동되고, 공통 유지 전극라인(Z)은 공통적으로 구동된다. 어드레스 전극라인들(X1 내지 Xn)은 기수번째 라인들과 우수번째 라인들로 분할되어 구동된다.
이러한 3전극 교류 면방전형 PDP는 다수개의 서브필드로 분리되어 구동되고, 각 서브필드기간에는 비디오 데이터의 가중치에 비례시킨 횟수의 발광이 진행됨으로써 계조표시가 행해지게 된다. 실례로, 8비트의 비디오 데이터를 이용하여 256계조로 화상이 표시되는 경우 각 방전셀(1)에서의 1 프레임 표시 기간(예를 들면, 1/60초=약 16.7msec)은 도 3에 도시된 바와 같이 8개의 서브 필드(SF1 내지 SF8)로 분할하게 된다. 각 서브 필드(SF1 내지 SF8)는 다시 리셋 기간, 어드레스 기간 및유지기간으로 분할하고, 그 유지기간에 1:2:4:8:…:128의 비율로 가중치를 부여하게 된다. 여기서, 리셋기간은 방전셀을 초기화하는 기간이고, 어드레스기간은 비디오데이터의 논리값에 따라 선택적인 어드레스방전이 발생하게 하는 기간이며, 유지기간은 상기 어드레스방전이 발생된 방전셀에서 방전이 유지되게 하는 기간이다. 리셋 기산과 어드레스기간은 각 서브필드 기간에 동일하게 할당된다.
도 4를 참조하면, 종래의 PDP 구동방법에 따라 임의의 서브필드 기간동안 도 2에 도시된 PDP에 공급되는 구동파형도가 도시되어 있다. 우선, 도시하지 않은 리셋기간에서 주사/유지 전극라인들(Y1 내지 Ym)과 공통유지 전극라인들(X1 내지 Xn)에 공통적으로 라이팅펄스를 공급하여 모든 방전셀들에서 방전이 발생되게 함으로써 모든 방전셀들을 초기화하게 된다. 이러한 리셋기간에 이어 어드레스기간에서는 주사/유지 전극라인들(Y1 내지 Ym)에 순차적으로 주사펄스(SP)를 공급함과 아울러 그 주사펄스(SP)에 동기되는 데이터펄스(DP)를 어드레스전극라인들(X1 내지 Xn)에 공급함으로써 선택적인 어드레스방전이 발새되게 한다. 이어서, 방전유지기간에서 주사/유지 전극라인들(Y1 내지 Ym)과 공통유지 전극라인들(X1 내지 Xn)에 교번적으로 유지펄스(SUSP)를 교번적으로 공급함으로써 상기 어드레스 방전이 발생된 방전셀들에서 방전이 소정의 기간동안 유지되게 한다.
그런데, 종래의 3 전극 PDP에서는 서스테인방전을 일으키는 주사/서스테인전극(5)과 공통서스테인전극(8) 간의 서스테인방전이 방전셀의 중앙부에서만 일어나기 때문에 방전셀의 공간을 충분히 활용하지 못했다. 이에 따라, 방전셀의 휘도는 낮아지고 발광효율을 저하되는 문제점이 있었다. 이러한 문제점을 해결하는 방안으로 서스테인방전을 일으키는 주사/서스테인전극(5)과 공통서스테인전극(8)을 방전셀의 양쪽 경계부에 설치하거나 방전전극의 폭을 넓게 하고 있다. 하지만 주사/서스테인전극(5)과 공통서스테인전극(8)의 간격이 멀어지면 방전전압이 높아지고 방전전극의 폭을 넓게하면 방전전류도 함께 증가하여 전력 소모량이 많아지는 단점이 있다.
이와 같은 문제점을 해결하기 위해 도 5와 같이 5 전극 교류 면방전형 PDP가 개발되어 상용화되고 있다.
도 5는 5 전극 교류 면방전형 PDP를 나타내는 사시도이다.
도 5를 참조하면, 5 전극 PDP의 방전셀은 상부기판(50) 상에 주사/서스테인전극(45)과, 공통서스테인전극(58)과, 스캔전극(40) 및 트리거전극(66)들을 구비하고 하부기판(55) 상에는 어드레스전극(60)을 구비한다. 스캔전극(40) 및 트리거전극(66)은 투명전극(44A,66A)과 버스전극(48B,64B)으로 구성된다. 주사/서스테인전극(45)과 공통서스테인전극(58) 사이에 스캔전극(40) 및 트리거전극(66)이 좁은 간격으로 평행하게 배치되고, 이 전극들(45,40,66,58)이 형성된 상부기판(50)에는 상부 유전층(51)과 보호층(52)이 적층된다. 상부 유전층(51)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호층(52)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전층(51)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호층(52)으로는 통상 산화마그네슘(MgO)이 이용된다. 어드레스전극(60)이 형성된 하부기판(55) 상에는 하부 유전층(64), 격벽(53)이 형성되며, 하부 유전층 (64)과 격벽(53) 표면에는 형광체층(62)이 도포된다. 어드레스전극(60)은 주사/서스테인전극(45)과, 공통서스테인전극(58)과 스캔전극(40) 및 트리거전극(66)들과 교차되는 방향으로 형성된다. 격벽(53)은 어드레스전극(60)과 나란하게 형성되어 방전에 의해 생성된 자외선 및 가시광이 인접한 방전셀에 누설되는 것을 방지한다. 형광체층(620은 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 상/하판(50/55)과 격벽(53) 사이에 마련된 방전공간(62)에는 가스방전을 위한 불활성 가스가 주입된다.
빛이 방출되는 과정을 간략히 설명하면, 먼저 패널의 모든 방전셀들을 초기화하기 위해서 모든 방전셀들의 내부에 배치된 주사/서스테인전극(45)이나 스캔전극(40) 및 트리거전극(66) 중의 하나에 리셋펄스가 공급되어 리셋방전이 일어난다. 리셋방전시에는 방전셀 별로 벽전하들이 생성되어 뒤이어지는 어드레스방전에 필요한 방전전압을 낮추게 된다. 그 다음 주사/서스테인전극(45)에 주사펄스가 공급되고, 이에 동기되어 어드레스전극(60)에 데이터 펄스가 인가됨으로써 두 전극 간에 어드레스 방전이 일어나 상/하부 유전층(50,55)에 벽전하가 형성된다. 어드레스방전에 의해 선택된 방전셀들에서는 주사/서스테인전극(45)과 공통서스테인전극(58)사이에 설치된 스캔전극(40) 및 트리거전극(66)이 서스테인 기간 중에 교류 펄스전압인 트리거 펄스전압에 응답하여 보조방전을 일으킨다. 보조방전이 일어난 직후, 주사/서스테인전극(45)과 공통서스테인전극(58)에는 서스테인펄스가 공급된다. 그러면 주사/서스테인전극(45)과 공통서스테인전극(58)은 보조방전에 의해 방전셀 내에 축적된 벽전하와 서스테인 펄스에 의한 전압차에 의해 셀 내의 중앙부에서 방전을 일으킬 수 있게 된다. 이러한 서스테인방전은 서스테인펄스와 트리거펄스에 의해 연속적으로 발생된다.
도 6은 도 5에서 도시된 5전극 PDP의 전극 구조를 나타낸 단면도이고, 도 7은 도 5에서 도시된 5전극 PDP의 전극 배치를 나타낸 도면이다.
도 6 내지 도 7을 참조하면, 먼저 5 전극 PDP의 방전셀은 상부기판(50) 상에 주사/서스테인전극(45)과, 공통서스테인전극(58)과, 스캔전극(40)과, 트리거전극 (66)을 구비하고 하부기판(55) 상에는 어드레스전극(60)을 구비한다. 스캔전극 (40) 및 트리거전극(66)은 투명전극(48A, 64A)과 버스전극(48B,64B)으로 구성된다. 주사/서스테인전극(45)과 공통서스테인전극(58) 사이에 스캔전극(40) 및 트리거전극(66)이 좁은 간격으로 평해하게 배치되고, 이 전극들(45,40,66,58)이 형성된 상부기판(50)에는 도시되지 않은 상부 유전층과 보호층이 적층된다. 상부 유전층에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호층은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전층의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호층으로는 통상 산화마그네슘(MgO)이 이용된다. 어드레스전극 (60)이 형성된 하부기판(55) 상에는 도시되지 않은 유전층 및 격벽이 형성되며, 하부 유전층과 격벽 포면에는 도시되지 않은 형광체층이 도포된다. 어드레스전극 (60)은 주사/서스테인전극(45)과, 공통서스테인전극(58)과, 스캔전극 (40) 및 트리거전극(66)들과 교차되는 방향으로 형성된다. 격벽은어드레스전극(60)과 나란하게 형성되어 방전에 의해 생성된 자외선 및 가시광선이 인접한 방전셀에 누설되는 것을 방지한다. 형광체층은 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 상/하판(50,55)과 격벽 사이에 마련된 방전공간(24)에는 가스방전을 위한 불활성 가스가 주입된다.
도 8은 종래의 5전극 PDP의 구동파형을 도시한 도면이다.
도 8을 참조하면, 먼저 리셋기간(Reset period)에는 스캔전극(Yt)에 음극성의 벽전하가 쌓이고, 공통서스테인전극(Zs)과 트리거전극(Zt)에 양극성의 벽전하가 쌓이도록 리셋펄스(Reset Pulse)를 공통적으로 공급하여 리셋방전이 발생되게 함으로서 벽전하가 방전셀들의 내부에 오방전을 일으키지 않을 정도로 균일하게 잔류하게 된다. 이러한 리셋기간에 이어 어드레스기간(Address Period)에는 스캔펄스를 스캔전극(Yt)에 공급함과 아울러 어드레스전극에 데이터펄스를 공급함으로써 주사/서스테인전극(Ys)과 어드레스전극과의 방전면적을 크게하여 저전압 및 고속의 안정된 어드레스방전이 발생하도록 한다. 이와 아울러 공통서스테인전극(Zs) 및 트리거전극(Zt)에는 스캔전극(Yt)에 대해 높은 전압의 바이어스를 인가하여 어드레싱방전시 서스테인방전을 위한 음극성 벽전하를 형성한다. 이러한 어드레스기간에 이어 서스테인기간에서는 주사/서스테인 전극(Ys) 및 스캔전극(Yt)에 동위상의 서스테인 펄스를 인가하고, 공통서스테인전극(Zs) 및 트리거전극(Zt)에 주사/서스테인 전극(Ys) 및 스캔전극(Yt)에 인가되는 서스테인펄스와는 반대의 위상을 갖는 동 위상의 서스테인펄스를 인가하여 스캔전극(Yt)과 트리거전극(Zt)간 서스테인방전을 일으켜 주사/서스테인전극 (Ys)과 공통서스테인전극(Zs)간 롱갭서스테인방전을 용이하게 하면서 방전전압을 낮춘다. 첫 번째 서스테인펄스는 주사/서스테인전극 (Ys)과 공통서스테인전극(Zs)의 서스테인펄스전압은 스캔전극(Yt)과 트리거전극 (Zt)보다 높게하여 롱갭서스테인방전을 일으킨다. 또한, 주사/서스테인전극(Ys)및 스캔전극(Yt)에 스캔펄스가 인가됨과 아울러 서스테인전압이 서로 다르기 때문에 생기는 스캔드라이버 IC의 증가를 막기위해 주사/서스테인전극(Ys)과 스캔전극(Yt)을 하나로 묶어 구동할 수도 있다. 마지막 소거기간에서는 공통서스테인전극(Zs)과 트리거전극(Zt)에 소거펄스를 공급하여 소거방전이 발생함으로써 이전단계에서의 서스테인방전을 소거하게 된다. 즉, 이미지 어드레스 후 유지방전을 일으켜 데이터를 표시하고 난후 다음 리셋 파형이 인가되기 전에 전 필드의 화면을 소거하기 위하여 세폭펄스 약 1㎲ 짜리를 인가하여 다음 필드에서의 오방전의 가능성을 줄이게 된다. 그러나 롱갭 유지방전으로 인하여 주사/서스테인전극 (Ys)과 스캔전극(Zt) 근처의 잔여 방전을 확실히 소거하지 못하는 문제점이 있게 된다.
따라서, 본 발명의 목적은 5 전극 교류 플라즈마 디스플레이 패널의 구동방법에서 소거동작을 확실하게 하기 위한 소거파형을 제공하기 위한 구동방법을 제공하는데 있다.
도 1은 종래의 3전극 교류 면방전 플라즈마 디스플레이 패널의 방전셀 구조를 도시한 사시도.
도 2는 도 1에 도시된 플라즈마 디스플레이 패널의 전극 배치도.
도 3은 도 1에 도시된 방전셀의 서브필드 구동방법을 설명하기 위한 프레임 구성도.
도 4는 도 1에 도시된 방전셀의 구동파형도.
도 5는 종래의 5전극 교류 면방전 플라즈마 디스플레이 패널의 방전셀 구조를 도시한 사시도.
도 6은 도 5에 도시된 플라즈마 디스플레이 패널의 단면도.
도 7은 도 5에 도시된 플라즈마 디스플레이 패널의 전극배치도.
도 8은 종래의 트리거드 서스테인 플라즈마 디스플레이 패널의 구동 파형도.
도 9는 본 발명에 따른 플라즈마 디스플레이 패널 구동방법에서의 구동파형도.
도 10a 내지 도 10b는 도 9에 도시된 구동방법에서의 소거 방전의 순서도.
도 11은 본 발명의 제 1 실시예에 따른 플라즈마 디스플레이 패널 구동방법에서의 구동파형도.
도 12a 내지 도 12c는 도 11에 도시된 구동방법에서의 방전순서도.
도 13은 본 발명의 제 2 실시예에 따른 플라즈마 디스플레이 패널 구동방법에서의 구동파형도.
도 14는 본 발명의 제 3 실시예에 따른 플라즈마 디스플레이 패널 구동방법에서의 구동파형도.
도 15a 내지 도 15c는 도 14에 도시된 구동방법에서의 방전순서도.
< 도면의 주요 부분에 대한 부호의 설명 >
10, 50 : 상부기판 12Y, Ys, 45 : 제 1 서스테인전극
12Z, Zs, 58 : 제 2 서스테인 전극 14 : 상부 유전층
16 : 보호막 18, 55 : 하부기판
20X, 60 : 어드레스 전극 22, 64 : 하부 유전층
24, 61 : 격벽 26, 62 : 형광체
1 : 방전셀 30 : PDP
34A, 36A, 44A, 48A, 52A, 54A, 57A, 64A : 투명전극
34B, 36B, 44B, 48B, 52B, 54B, 57B, 64B : 버스전극
34C, 36C, 52C, 54C : 패드전극
Yt : 스캔전극 Zt : 트리거 전극
상기 목적들을 달성하기 위하여 본 발명의 플라즈마 디스플레이 패널의 구동방법은 유지방전을 개시시키기 위한 트리거 전극쌍, 상기 유지방전의 개시방전을 이용하여 유지방전을 일으키는 유지전극쌍을 구비하는 플라즈마 디스플레이 패널의구동방법에 있어서, 트리거 전극쌍 및 유지전극쌍에 소거펄스를 적어도 2 회이상 연속하여 공급함으로써 유지방전을 소거시키는 단계를 포함한다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부도면을 참조한 실시예들에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 본 발명의 바람직한 실시예들을 도 9 내지 도 13을 참조하여 상세히 설명하기로 한다.
도 9는 본 발명에 따른 5 전극 PDP의 구동파형을 도시한 도면이다.
도 9를 참조하면, 트리거전극(Zt)과 공통서스테인전극(Zs)이 속하는 Z전극쪽에 소거펄스 인가후 서스테인전극(Ys)과 스캔전극(Yt)이 속하는 Y전극쪽에 추가로 소거펄스를 인가하여, Z전극 소거 방전 후 남은 Y전극쪽의 유지 데이터의 소거를 실행한다.
도 10을 참조하면, 도 9에 도시한 구동방법의 소거방전의 순서에 의한 도면이 열거되어 있다. 유지방전이 종료한 상태는 도 10a에서 처럼 Y전극 (-)전하들이 (+)전하들이 남은 상태이다. 소거를 위해서 그 첫 단계로 도 10b와 같이 트리거 전극(Zt)과 공통서스테인전극(Zs)에 20OV의 전압을 인가하여 Z전극에 남아있던 (+)벽전하들과 합하여 소거방전을 일으키게 된다. 이때의 소거방전은 방전이 일어난 후 Y와 Z전극에 벽전하가 쌓일 정도의 충분한 시간을 공급하지 않는 1㎲ 이하의 펄스를 인가하면, 방전후 셀 내의 공간전하들이 전극으로 이동하지 못하고 소멸하게 된다. 이 Z전극 전압을 인가한 소거 방전에서 완전한 소거 방전이 발생하지 않을 경우 도 10c에서 처럼 잔류 벽전하가 Y와 Z 전극에 다시 생성이 될 수 있는데, 이러한 벽전하를 제거하기 위하여, 도 10d에서 처럼 Y전극에 전압을 인가하여 완전한 소거 방전이 일어나게 한다.
도 11과 도 12를 참조하면, 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동방법과 방전순서가 도시되어 있다.
도 11을 보면 Y전극과 Z전극의 소거기간에 소거펄스를 인가하는 데에 본 발명과 약간의 차이가 있음을 알 수 있다. 이들은 트리거전극(Zt)에 소거펄스를 인가하고 난 후 스캔전극(Yt)과 공통서스테인전극(Zs)에 소거펄스를 인가하였다. 이들의 방전순서를 도 12에서 살펴보면, 유지방전후의 상태에서 트리거전극(Zt)에 전압을 인가하여 스캔전극(Yt)과 트리거전극(Zt)사이에서 방전이 일어나게 하여 트리거전극(Yt)과 공통서스테인전극(Zs)의 벽전하를 소거하고, 스캔전극(Yt)과 공통서스테인전극(Zs)에 벽전하가 남아있는 상태에서 스캔전극(Yt)과 공통서스테인 전극(Zs)에 전압을 인가하여 주사/서스테인전극(Ys)과 스캔전극(Yt)간에 방전, 공통서스테인전극(Zs)과 트리거전극(Zt)간에 방전을 각각 일어나게 하여 주사/서스테인전극(Ys)과 공통서스테인전극(Zs)의 벽전하도 소거하도록 한다. 이와 같이 전극간의 소거방전을 각각 발생시켜서 좀 더 확실한 소거를 할 수 있도록 한다.
도 13은 본 발명의 제 2 실시예에 따른 플라즈마 디스플레이 패널의 구도방법이 도시되어 있다. 이는 도 11에 도시된 제 1 실시예의 경우에 있어서, 트리거전극(Zt)에 인가전압을 가한 후 방전이 스캔전극(Yt)과 시작한 직후에 공통서스테인전극(Zs)에 전압을 인가하여 메인 방전이 일어나게 하여 벽전하를 소거시키는 방법이다. 이로써 세폭 소거펄스가 중첩된 경우를 도 13에서 나타내고 있다. 트리거전극(Zt)에 전압인가 직후에 공통서스테인전극(Zs)에 전압을 인가하면 Z쪽에 강한 전계가 걸려 소거의 가능성이 높아질 가능성이 있게 된다.
도 14와 도 15를 참조하면, 본 발명의 제3 실시예에 따른 플라즈마 디스플레이 패널의 구동방법과 방전순서가 도시되어 있다.
도 14와 도 15에서와 같이 Z전극에 세폭 소거펄스를 인가하여 소거 방전을 일으킨다. 이 소거 방전 후 전극에 남아 있을 수 있는 벽전하를 Y전극에 시간에 대하여 직선적으로 증가하는 램프펄스를 인가하여 좀더 정확한 소거를 하게 된다.
상술한 바와 같이, 본 발명은 플라즈마 디스플레이 패널의 구동에 있어서 소거 방전을 여러번 일으켜 전극에 남아있는 전하를 확실하게 소거하게 된다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.

Claims (5)

  1. 유지방전을 개시시키기 위한 트리거 전극쌍, 상기 유지방전의 개시방전을 이용하여 유지방전을 일으키는 유지전극쌍을 구비하는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    상기 트리거 전극쌍 및 유지전극쌍에 소거펄스를 적어도 2회 이상 연속하여 공급함으로써 상기 유지방전을 소거시키는 단계를 포함하는 것을 특징으로 하는 5전극 플라즈마 디스플레이 패널의 구동방법.
  2. 상기 트리거 전극쌍은 스캔전극과 트리거전극의 군으로 구성되고, 상기 유지전극쌍은 주사/서스테인 전극과 공통서스테인전극의 군으로 구성되는 데 있어서,
    상기 소거펄스를 트리거전극과 공통서스테인전극에 먼저 인가후 주사/서스테인전극과 스캔전극에 인가하여 유지방전을 소거시키는 단계를 포함하는 것을 특징으로 하는 5전극 플라즈마 디스플레이 패널의 구동방법.
  3. 제 2 항에 있어서,
    상기 소거펄스를 트리거전극에 먼저 인가후 스캔전극과 공통서스테인전극에 인가하여 유지방전을 소거시키는 단계를 포함하는 것을 특징으로 하는 5 전극 플라즈마 디스플레이 패널의 구동방법.
  4. 제 1 항에 있어서,
    상기 소거펄스를 트리거전극에 먼저 인가후 방전이 스캔전극과 시작한 직후에 공통서스테인전극에 인가하여 유지방전을 소거시키는 단계를 포함하는 것을 특징으로 하는 5 전극 플라즈마 디스플레이 패널의 구동방법.
  5. 제 1 항에 있어서,
    상기 소거펄스를 트리거전극과 공통서스테인전극에 먼저 인가한 후 주사/서스테인전극과 스캔전극에 램프펄스를 인가하여 유지방전을 소거시키는 단계를 포함하는 것을 특징으로 하는 5전극 플라즈마 디스플레이 패널의 구동방법.
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